JPH09109389A - インクジェット記録装置の記録素子駆動用集積回路 - Google Patents

インクジェット記録装置の記録素子駆動用集積回路

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JPH09109389A
JPH09109389A JP7274183A JP27418395A JPH09109389A JP H09109389 A JPH09109389 A JP H09109389A JP 7274183 A JP7274183 A JP 7274183A JP 27418395 A JP27418395 A JP 27418395A JP H09109389 A JPH09109389 A JP H09109389A
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久義 藤本
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Abstract

(57)【要約】 【課題】 階調性の向上と記録時間の短縮とを両立でき
るインクジェット記録装置の記録素子駆動用集積回路を
提供する。 【解決手段】 複数の出力パッド14を有し、インクジ
ェット記録装置のノズルからインクを吐出させるための
圧電素子に駆動電圧を印加するインクジェット記録装置
の記録素子駆動用集積回路であって、各出力パッド14
に対応するビットをそれぞれ有する複数のシフトレジス
タ22,23を設けるとともに、各シフトレジスタ2
2,23に入力されるデータに応じてオン・オフ制御さ
れ、オン時に相互に異なる駆動電圧を出力パッド14に
供給する複数のアナログスイッチ21を、各出力パッド
14毎に設けた。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本願発明は、インクジェット
記録装置のノズルからインクを吐出させるための圧電素
子に駆動電圧を印加するインクジェット記録装置の記録
素子駆動用集積回路に関する。
【0002】
【従来の技術】インクジェット記録装置のノズルからイ
ンクを吐出させるための圧電素子に駆動電圧を印加する
従来の記録素子駆動用集積回路は、各出力パッド毎に、
待機電圧と駆動電圧とを切り替える構成であった。たと
えば、シフトレジスタに入力されるデータに応じて、デ
ータが「1」であるビットについては、該当する出力パ
ッドに駆動電圧を供給し、データが「0」であるビット
については、該当する出力パッドを待機電圧のままとす
ることにより、複数の出力パッドから選択的に駆動電圧
を出力していた。したがって、駆動電圧は1種類のみで
あり、記録されるドットの大きさも各ノズルについて同
じ大きさであった。
【0003】ところで、インクジェット記録装置により
写真などのように濃淡のある記録を行う場合、ドットの
密度の相違により濃淡を表現するのであるが、淡い部分
はドットの密度が小さいことから、ドットが目立ち易
く、特にカラー記録の場合に非常に不自然な表現になっ
てしまう。
【0004】そこで、ドットを小さくすれば、ドットが
目立ち難くなり、自然な表現が得られるが、記録時間が
非常に長くなってしまう。たとえば、ドット径を半分に
すれば、ドットの面積は1/4になるので、データ量が
4倍になり、同じ面積の記録を行うのに4倍の時間がか
かることになる。
【0005】したがって、従来の記録素子駆動用集積回
路のように、出力パッドから出力される駆動電圧が1種
類であれば、ノズルから吐出されたインクにより記録用
紙上に形成されるドットの大きさも1種類であることか
ら、階調性を向上させるためにドットの大きさを小さく
すると、記録時間が非常に長くなるという課題があっ
た。たとえば、720dpiの記録密度でA4サイズの
記録用紙にカラー記録するのに、14〜25分程度かか
っていた。
【0006】
【発明の開示】本願発明は、上記した事情のもとで考え
出されたものであって、階調性の向上と記録時間の短縮
とを両立できるインクジェット記録装置の記録素子駆動
用集積回路を提供することを、その課題とする。
【0007】上記の課題を解決するため、本願発明で
は、次の技術的手段を講じている。
【0008】本願発明の第1の側面によれば、複数の出
力パッドを有し、インクジェット記録装置のノズルから
インクを吐出させるための圧電素子に駆動電圧を印加す
るインクジェット記録装置の記録素子駆動用集積回路で
あって、各出力パッド毎に駆動電圧を複数段階に切り替
え制御可能に構成したことを特徴とする、インクジェッ
ト記録装置の記録素子駆動用集積回路が提供される。
【0009】この記録素子駆動用集積回路を用いること
により、各出力パッド毎に駆動電圧を複数段階に切り替
え制御可能であるので、駆動電圧に応じた複数種類の大
きさのドットを各ノズル毎に形成させることができる。
したがって、記録ピッチを最も大きなドットに合わせ
て、濃度の濃い部分は駆動電圧をたとえば高くして大き
なドットを形成させ、濃度の淡い部分は駆動電圧をたと
えば低くして小さなドットを形成させることにより、階
調性の向上と記録時間の短縮とを両立できる。すなわ
ち、濃度の濃い部分は大きなドットを形成させるので、
小さなドットを多数記録する必要がなく、しかも、濃度
の淡い部分は小さなドットを形成させるので、ドットが
目立たず、カラー記録においても自然な美しい記録を実
現できる。換言すれば、記録ピッチを最大のドットに合
わせて大きくしても、濃度の濃い部分であっても淡い部
分であっても良好な記録が行えるということなので、記
録ピッチを大きくすることによりデータ量が少なくな
り、記録時間を短縮できる。たとえば、100μm径と
50μm径との2種類の印字ドットサイズを用いる場
合、エリア的な画像階調処理である誤差拡散処理を実行
することにより、上記2種類のドットサイズで4階調の
表現が画像表現で可能となり、データ量を半減できる。
【0010】本願発明の第2の側面によれば、複数の出
力パッドを有し、インクジェット記録装置のノズルから
インクを吐出させるための圧電素子に駆動電圧を印加す
るインクジェット記録装置の記録素子駆動用集積回路で
あって、各出力パッドに対応するビットをそれぞれ有す
る複数のシフトレジスタを設けるとともに、各シフトレ
ジスタに入力されるデータに応じてオン・オフ制御さ
れ、オン時に相互に異なる駆動電圧を出力パッドに供給
する複数のアナログスイッチを、各出力パッド毎に設け
たことを特徴とする、インクジェット記録装置の記録素
子駆動用集積回路が提供される。
【0011】この記録素子駆動用集積回路においては、
シフトレジスタに入力されるデータの各ビットが各出力
パッドに対応しており、たとえば、データが「1」であ
るビットに対応する出力パッドから駆動電圧が出力され
る。また、駆動電圧の大きさは、各シフトレジスタに対
応して決まっており、各シフトレジスタ毎に1個のアナ
ログスイッチが全ての出力パッドについてそれぞれ設け
られている。たとえば、出力パッド数がn個、駆動電圧
の種類がm種類であるとすると、nビットのシフトレジ
スタがm個設けられ、さらに、m個1組のアナログスイ
ッチがn組設けられる。そして、第m番目のシフトレジ
スタに入力されたデータの第n番目のビットが「1」で
あったとすると、第n番目の組の第m番目のアナログス
イッチがオンし、第m番目の駆動電圧である例えば最も
低い電圧の駆動電圧が第n番目の出力端子から出力さ
る。この結果、第n番目のノズルからインクが吐出され
てたとえば最も小さいドットが記録用紙上に形成され
る。ただし、各出力パッドから駆動電圧が出力されてい
ないときに待機電圧を出力する場合は、待機電圧用の1
個のアナログスイッチを各出力パッド毎に追加する必要
がある。
【0012】したがって、m個のシフトレジスタに入力
されるデータを、たとえばプリンタドライブソフトを用
いてパーソナルコンピュータで作成することにより、そ
れらのデータに応じてドットの位置および大きさが決定
され、階調性を有する記録がなされる。もちろん、いず
れか1つのシフトレジスタのみにデータを入力し、他の
シフトレジスタのデータをオール「0」にすれば、全て
のドットが同じ大きさになり、従来の記録素子駆動用集
積回路として用いることができる。ただし、ドットの大
きさに応じて記録ピッチを変えることはもちろんであ
る。
【0013】好ましい実施の形態によれば、出力パッド
に駆動電圧が出力されていないときに、その出力パッド
に所定の待機電圧を供給する待機電圧用の1個のアナロ
グスイッチを、各出力パッド毎に設ける。
【0014】別の好ましい実施の形態によれば、各シフ
トレジスタに入力されたデータが、ラッチ回路によりラ
ッチされ、ストローブ信号が入力されることによりラッ
チ回路から全てのビットが同時に出力される。
【0015】本願発明のその他の特徴および利点は、添
付図面を参照して以下に行う詳細な説明によって、より
明らかとなろう。
【0016】
【発明の実施の形態】以下、本願発明の好ましい実施の
形態を、図面を参照して具体的に説明する。
【0017】図1は、本願発明に係る記録素子駆動用集
積回路の回路ブロック図であって、この記録素子駆動用
集積回路は、待機電圧VPP0が入力される待機電圧入
力パッド1、待機電圧VPP0よりも高電圧の第1の駆
動電圧VPP1が入力される第1の駆動電圧入力パッド
2、第1の駆動電圧VPP1よりも高電圧の第2の駆動
電圧VPP2が入力される第2の駆動電圧入力パッド
3、記録素子駆動用集積回路内部の絶縁を確保するため
の30V程度の電圧VHが入力される絶縁電圧入力パッ
ド4、記録素子駆動用集積回路内部の論理回路を動作さ
せるための5V程度の電圧VCCが入力されるロジック
電源入力端子5、グランド端子GNDとしての接地用パ
ッド6、ストローブ信号STRが入力されるストローブ
信号入力パッド7、ラッチ信号LATが入力されるラッ
チ信号入力パッド8、第1のデータS1がシリアル入力
される第1のデータ入力パッド9、第2のデータS2が
シリアル入力される第2のデータ入力パッド10、クロ
ック信号CLKが入力されるクロック信号入力パッド1
1、第1のデータS1がシリアル出力される第1のデー
タ出力パッド12、第2のデータS2がシリアル出力さ
れる第2のデータ出力パッド13、および、待機電圧V
PP0と第1の駆動電圧VPP1と第2の駆動電圧VP
P2とのうちのいずれかを選択的に出力電圧OUT1〜
OUT64として出力する合計64個の出力パッド14
を備えている。
【0018】さらに、この記録素子駆動用集積回路は、
待機電圧入力パッド1に入力された待機電圧VPP0と
第1の駆動電圧入力パッド2に入力された第1の駆動電
圧VPP1と第2の駆動電圧入力パッド3に入力された
第2の駆動電圧VPP2とのうちのいずれかを出力パッ
ド14に選択的に供給する、3個1組で64組、すなわ
ち合計192個のアナログスイッチ21、合計64個の
フリップフロップからなり、第1のデータ入力パッド9
を介して第1のデータS1がシリアル入力される第1の
シフトレジスタ22、合計64個のフリップフロップか
らなり、第2のデータ入力パッド10を介して第2のデ
ータS2がシリアル入力される第2のシフトレジスタ2
3、合計64個のフリップフロップからなり、ラッチ信
号入力パッド8を介してラッチ信号LATが入力される
ことにより第1のシフトレジスタ22を構成するフリッ
プフロップの出力を保持する第1のラッチ回路24、ラ
ッチ信号入力パッド8を介してラッチ信号LATが入力
されることにより第2のシフトレジスタ23を構成する
フリップフロップの出力を保持する第2のラッチ回路2
5、ストローブ信号入力パッド7を介して入力されるス
トローブ信号STRと第1のラッチ回路24を構成する
フリップフロップの出力との否定的論理積を演算する合
計64個のNAND回路26、第1のラッチ回路24を
構成するフリップフロップの出力と第2のラッチ回路2
5を構成するフリップフロップの出力との否定的論理積
を演算する合計64個のNAND回路27、ストローブ
信号入力パッド7を介して入力されるストローブ信号S
TRと第2のラッチ回路25を構成するフリップフロッ
プの出力とNAND回路27の出力との否定的論理積を
演算する合計64個のNAND回路28、NAND回路
26の出力とNAND回路28の出力との否定的論理積
を演算する合計64個のNAND回路29、NAND回
路29の出力がローレベルのときに3個1組のアナログ
スイッチ21のうちの所定のアナログスイッチをオンさ
せて、待機電圧入力パッド1を介して入力された待機電
圧VPP0を出力パッド14に供給させる合計64個の
レベルシフト回路30、NAND回路26の出力がロー
レベルのときに3個1組のアナログスイッチ21のうち
の所定のアナログスイッチをオンさせて、第1の駆動電
圧入力パッド2を介して入力された第1の駆動電圧VP
P1を出力パッド14に供給させる合計64個のレベル
シフト回路31、および、NAND回路28の出力がロ
ーレベルのときに3個1組のアナログスイッチ21のう
ちの所定のアナログスイッチをオンさせて、第2の駆動
電圧入力パッド3を介して入力された第2の駆動電圧V
PP2を出力パッド14に供給させる合計64個のレベ
ルシフト回路32を備えている。
【0019】図2は上記記録素子駆動用集積回路の入出
力信号のタイミングチャートであって、(a)はクロッ
ク信号入力パッド11に入力されるクロック信号CL
K、(b)は第1のデータ入力パッド9に入力される第
1のデータS1、(c)は第1のデータ出力パッド12
から出力される第1のデータS1、(d)はラッチ信号
入力パッド8に入力されるラッチ信号LAT、(e)は
ストローブ信号入力パッド7に入力されるストローブ信
号STR、(f)は第1の駆動電圧入力パッド2に入力
される第1の駆動電圧VPP1、(g)は第2の駆動電
圧入力パッド3に入力される第2の駆動電圧VPP2、
(h)は出力パッド14から出力される出力電圧OUT
をそれぞれ示している。なお、(b)と(c)とは互い
に異なるデータであり、(h)は第1の駆動電圧VPP
1が出力電圧OUTとして出力された場合を示してい
る。
【0020】次に動作を説明する。クロック信号入力パ
ッド11には、たとえばインクジェットヘッドが備えら
れた図外の印字装置の制御部から、クロック信号CLK
が入力される。このクロック信号CLKは、第1のシフ
トレジスタ22および第2のシフトレジスタ23を構成
する各フリップフロップのタイミング信号入力端に入力
される。また、第1のデータ入力パッド9には、上記制
御部から、第1のデータS1がシリアル入力される。こ
の第1のデータS1は、タイミング信号入力端に供給さ
れるクロック信号CLKと同期して、第1のシフトレジ
スタ22を構成する各フリップフロップのデータ入力端
に順次シリアル入力され、64ビットの第1のデータS
1が第1のシフトレジスタ22に一時記憶される。同様
に、第2のデータ入力パッド10には、上記制御部か
ら、第2のデータS2がシリアル入力される。この第2
のデータS2は、タイミング信号入力端に供給されるク
ロック信号CLKと同期して、第2のシフトレジスタ2
3を構成する各フリップフロップのデータ入力端に順次
シリアル入力され、64ビットの第2のデータS2が第
2のシフトレジスタ23に一時記憶される。なお、複数
の記録素子駆動用集積回路を用いる場合、前段側の記録
素子駆動用集積回路の第1のデータ出力パッド12およ
び第2のデータ出力パッド13と後段側の記録素子駆動
用集積回路の第1のデータ入力パッド9および第2のデ
ータ入力パッド10とが縦続接続されており、全ての記
録素子駆動用集積回路の第1のデータS1および第2の
データS2が、それぞれシリアルに伝送されるので、次
段以降の記録素子駆動用集積回路の第1のデータS1お
よび第2のデータS2が第1のデータ入力パッド9およ
び第2のデータ入力パッド10から入力されても、それ
らは第1のデータ出力パッド12および第2のデータ出
力パッド13から出力されることになる。
【0021】次に、上記制御部からラッチ信号入力パッ
ド8にラッチ信号LATが入力されると、このラッチ信
号LATは、第1のラッチ回路24および第2のラッチ
回路25を構成するフリップフロップのラッチ信号入力
端に入力される。そして、ラッチ信号LATの立ち上が
りのタイミングで、第1のラッチ回路24および第2の
ラッチ回路25を構成するフリップフロップのデータ入
力端に、第1のシフトレジスタ22および第2のシフト
レジスタ23を構成するフリップフロップのデータ出力
端からの第1のデータS1および第2のデータS2がパ
ラレル入力され、これらのデータが第1のラッチ回路2
4および第2のラッチ回路25にラッチされて、第1の
ラッチ回路24を構成するフリップフロップのデータ出
力端からNAND回路26の一方の入力端に第1のデー
タS1が出力されるとともに、第2のラッチ回路25を
構成するフリップフロップのデータ出力端からNAND
回路28の第1の入力端に第2のデータS2が出力され
る。一方、上記と同様の動作により、第1のシフトレジ
スタ22および第2のシフトレジスタ23には次の第1
のデータS1および第2のデータS2が一時記憶され
る。
【0022】次に、上記制御部からストローブ信号入力
パッド7にストローブ信号STRが入力されると、この
ストローブ信号STRは、NAND回路26の他方の入
力端およびNAND回路28の第3の入力端に入力され
る。ここで、ラッチ信号LATはハイレベルであり、第
1のデータS1は記録の必要なドットに対応するビット
がハイレベルであるので、ストローブ信号STRがハイ
レベルになると、NAND回路26からは、記録の必要
なドットに対応するNAND回路26についてはローレ
ベルの信号が出力され、記録の不要なドットに対応する
NAND回路26についてはハイレベルの信号が出力さ
れる。なお、ここでいうドットとは、インクジェットヘ
ッドにより記録可能な多数個の点のうちの1個を意味し
ており、インクジェットヘッドの多数のノズルのうちの
1個が1個のドットに対応している。NAND回路26
の出力は、レベルシフト回路31に入力されるととも
に、NAND回路29の一方の入力端に入力される。レ
ベルシフト回路31は、インバータ機能を含んでおり、
NAND回路26の出力がローレベルになると、アナロ
グスイッチ21の制御端に駆動信号を出力し、アナログ
スイッチ21をオンさせる。これにより第1の駆動電圧
入力パッド2に入力された第1の駆動電圧VPP1がア
ナログスイッチ21を介して出力パッド14に供給さ
れ、対応する圧電素子に出力される。ここで、第1の駆
動電圧VPP1は、図2の(f)に示すように、待機電
圧VPP0から0Vまで立ち下がり、次にVPP1まで
立ち上がって、次にVPP0まで立ち下がる波形である
ので、最初の立ち下がりで圧電素子の変形量が減少して
インクを吸引し、次の立ち上がりで圧電素子の変形量が
増加してインクをノズルから吐出する。これにより、記
録用紙上にドットが形成される。なお、第1の駆動電圧
VPP1は第2の駆動電圧VPP2よりも低電圧である
ので、圧電素子の変形量が小さく、インクの吐出量が少
ないことから、小さなドットが形成される。
【0023】また、第2のデータS2は記録の必要なド
ットに対応するビットがハイレベルであるので、NAN
D回路28の第2の入力端すなわちNAND回路27の
出力がハイレベルの場合、ストローブ信号STRがハイ
レベルになると、NAND回路28からは、記録の必要
なドットに対応するNAND回路28についてはローレ
ベルの信号が出力され、記録の不要なドットに対応する
NAND回路28についてはハイレベルの信号が出力さ
れる。NAND回路28の出力は、レベルシフト回路3
2に入力されるとともに、NAND回路29の他方の入
力端に入力される。レベルシフト回路32は、インバー
タ機能を含んでおり、NAND回路28の出力がローレ
ベルになると、アナログスイッチ21の制御端に駆動信
号を出力し、アナログスイッチ21をオンさせる。これ
により第2の駆動電圧入力パッド3に入力された第2の
駆動電圧VPP2がアナログスイッチ21を介して出力
パッド14に供給され、対応する圧電素子に出力され
る。ここで、第2の駆動電圧VPP1は、図2の(g)
に示すように、待機電圧VPP0から0Vまで立ち下が
り、次にVPP2まで立ち上がって、次にVPP0まで
立ち下がる波形であるので、最初の立ち下がりで圧電素
子の変形量が減少してインクを吸引し、次の立ち上がり
で圧電素子の変形量が増加してインクをノズルから吐出
する。これにより、記録用紙上にドットが形成される。
なお、第2の駆動電圧VPP2は第1の駆動電圧VPP
1よりも高電圧であるので、圧電素子の変形量が大き
く、インクの吐出量が多いことから、大きなドットが形
成される。
【0024】NAND回路27の入力端には、第1のラ
ッチ回路24の出力と第2のラッチ回路25の出力とが
入力されている。すなわち、第1のラッチ回路24の出
力である第1のデータS1と第2のラッチ回路25の出
力である第2のデータS2とがともにハイレベルの場合
に、NAND回路27の出力がローレベルになり、この
結果、NAND回路28の出力がハイレベルになること
から、第2の駆動電圧VPP2が出力パッド14から出
力されることがない。これは、第1のデータS1および
第2のデータS2の作成ミスなどにより、両者の同一ビ
ットがともに「1」になって、第1の駆動電圧入力パッ
ド2と第2の駆動電圧入力パッド3とがアナログスイッ
チ21を介して短絡されるのを防止するためであり、こ
のような場合には、第1の駆動電圧VPP1が出力パッ
ド14から出力されるように構成している。
【0025】NAND回路29の入力端には、NAND
回路26の出力とNAND回路28の出力とが入力され
ており、NAND回路26の出力とNAND回路28の
出力とがともにハイレベルのときに、NAND回路29
の出力がローレベルになる。これにより、インバータ機
能を有するレベルシフト回路30が、アナログスイッチ
21をオンさせ、待機電圧入力パッド1に入力されてい
る待機電圧VPP0が出力パッド14に供給される。す
なわち、NAND回路26の出力がローレベルのときは
出力パッド14に第1の駆動電圧VPP1が供給され、
NAND回路28の出力がローレベルのときは出力パッ
ド14に第2の駆動電圧VPP2が供給されるので、そ
れ以外のときは常に出力パッド14に待機電圧VPP0
が供給されていることになる。
【0026】以上の動作により、記録用紙上には、第1
の信号S1および第2の信号S2の内容に応じて、たと
えば図3に示すようなドットが形成される。すなわち、
破線は記録ピッチを表しており、各記録位置において
は、第1の信号S1および第2の信号S2の内容に応じ
て、大きなドットが形成されたり、小さなドットが形成
されたり、ドットが形成されなかったりする。これらの
各記録位置におけるドットの大きさや有無は、記録すべ
き原画像の内容に基づいて、たとえばパーソナルコンピ
ュータのプリンタドライブソフトにより決定され、それ
に応じて第1の信号S1および第2の信号S2が作成さ
れる。このとき、原画像を忠実に再現できるように、た
とえば誤差拡散処理などが施される。
【0027】このように、各出力パッド14毎に駆動電
圧を第1の駆動電圧VPP1と第2の駆動電圧VPP2
との2段階に切り替え制御可能であるので、駆動電圧に
応じた2種類の大きさのドットを各ノズル毎に形成させ
ることができる。したがって、記録ピッチを大きなドッ
トに合わせて、濃度の濃い部分は第2の駆動電圧VPP
2を印加して大きなドットを形成させ、濃度の淡い部分
は第1の駆動電圧VPP1を印加して小さなドットを形
成させることにより、階調性の向上と記録時間の短縮と
を両立できる。
【0028】すなわち、濃度の濃い部分は第2の駆動電
圧VPP2を印加して大きなドットを形成させるので、
小さなドットを多数記録する必要がなく、しかも、濃度
の淡い部分は第1の駆動電圧VPP1を印加して小さな
ドットを形成させるので、ドットが目立たず、カラー記
録においても自然な美しい記録を実現できる。換言すれ
ば、記録ピッチを大きなドットに合わせて大きくして
も、濃度の濃い部分であっても淡い部分であっても良好
な記録が行えるということなので、記録ピッチを大きく
することによりデータ量が少なくなり、記録時間を短縮
できる。たとえば、大きなドットが360dpiに相当
する大きさであり、小さなドットが720dpiに相当
する大きさであるとすると、従来の記録素子駆動用集積
回路を用いた場合、濃度の淡い部分のドットを目立ち難
くするために、720dpiの記録密度で記録する必要
があったが、上記記録素子駆動用集積回路を用いた場
合、360dpiの記録密度で記録を行っても、濃度の
淡い部分は720dpiに相当する大きさの小さなドッ
トが形成されるので、記録速度が4倍になり、しかも濃
度の淡い部分のドットが目立つことはない。
【0029】もちろん、上記記録素子駆動用集積回路を
用いて、従来の記録素子駆動用集積回路を用いた場合と
同様に、全て同じ大きさのドットを形成することもでき
る。たとえば、第2のシフトレジスタ23に記録内容に
応じたデータを入力して、第1のシフトレジスタ22の
内容をオール0にすれば、大きなドットのみにより記録
がなされる。逆に、第1のシフトレジスタ22に記録内
容に応じたデータを入力して、第2のシフトレジスタ2
3の内容をオール0にすれば、小さなドットのみにより
記録がなされる。ただしこの場合は、記録ピッチを半分
にする必要がある。
【0030】なお、上記実施形態では、ドットの大きさ
を2種類に切り替えるように構成したが、ドットの大き
さを3種類以上に切り替えるように構成してもよい。す
なわち、駆動電圧入力パッド2,3やシフトレジスタ2
2,23やラッチ回路24,25やアナログスイッチ2
1などの設置数を増加させて、出力パッド14から出力
される駆動電圧の大きさを3種類以上に切り替えること
により、ドットの大きさを3種類以上に切り替えること
ができ、さらに優れた階調性を得ることができる。
【0031】また、上記実施形態では、VPP0<VP
P1<VPP2とし、駆動電圧が高いほど大きなドット
が形成される例について説明したが、これは圧電素子の
使用方法などによって決定されるものであり、VPP0
>VPP1>VPP2とし、駆動電圧が低いほど大きな
ドットが形成されるようにしてもよい。
【図面の簡単な説明】
【図1】本願発明に係る記録素子駆動用集積回路の回路
ブロック図である。
【図2】本願発明に係る記録素子駆動用集積回路の入出
力信号のタイミングチャートである。
【図3】本願発明に係る記録素子駆動用集積回路を用い
たインクジェット記録装置により記録用紙上に形成され
たドットの説明図である。
【符号の説明】
1 待機電圧入力パッド 2 第1の駆動電圧入力パッド 3 第2の駆動電圧入力パッド 7 ストローブ信号入力パッド 9 第1のデータ入力パッド 10 第2のデータ入力パッド 14 出力パッド 21 アナログスイッチ 22 第1のシフトレジスタ 23 第2のシフトレジスタ 24 第1のラッチ回路 25 第2のラッチ回路

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】 複数の出力パッドを有し、インクジェッ
    ト記録装置のノズルからインクを吐出させるための圧電
    素子に駆動電圧を印加するインクジェット記録装置の記
    録素子駆動用集積回路であって、 各出力パッド毎に駆動電圧を複数段階に切り替え制御可
    能に構成したことを特徴とする、インクジェット記録装
    置の記録素子駆動用集積回路。
  2. 【請求項2】 複数の出力パッドを有し、インクジェッ
    ト記録装置のノズルからインクを吐出させるための圧電
    素子に駆動電圧を印加するインクジェット記録装置の記
    録素子駆動用集積回路であって、 前記各出力パッドに対応するビットをそれぞれ有する複
    数のシフトレジスタを設けるとともに、 前記各シフトレジスタに入力されるデータに応じてオン
    ・オフ制御され、オン時に相互に異なる駆動電圧を前記
    出力パッドに供給する複数のアナログスイッチを、前記
    各出力パッド毎に設けたことを特徴とする、インクジェ
    ット記録装置の記録素子駆動用集積回路。
  3. 【請求項3】 前記出力パッドに駆動電圧が出力されて
    いないときに、その出力パッドに所定の待機電圧を供給
    する待機電圧用の1個のアナログスイッチを、前記各出
    力パッド毎に設けたことを特徴とする、請求項2に記載
    のインクジェット記録装置の記録素子駆動用集積回路。
  4. 【請求項4】 前記各シフトレジスタに入力されたデー
    タは、ラッチ回路によりラッチされ、ストローブ信号が
    入力されることにより前記ラッチ回路から全てのビット
    が同時に出力される構成としたことを特徴とする、請求
    項2に記載のインクジェット記録装置の記録素子駆動用
    集積回路。
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