JPH085516Y2 - 表示回路 - Google Patents
表示回路Info
- Publication number
- JPH085516Y2 JPH085516Y2 JP1988066800U JP6680088U JPH085516Y2 JP H085516 Y2 JPH085516 Y2 JP H085516Y2 JP 1988066800 U JP1988066800 U JP 1988066800U JP 6680088 U JP6680088 U JP 6680088U JP H085516 Y2 JPH085516 Y2 JP H085516Y2
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- JP
- Japan
- Prior art keywords
- turned
- switch
- display
- series
- display element
- Prior art date
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【考案の詳細な説明】 〔産業上の利用分野〕 本考案は複数のスイッチと、これに接続された複数の
表示素子とを備え、該スイッチの１つがオンすると対応
する表示素子が点灯するような表示回路に関するもので
ある。
表示素子とを備え、該スイッチの１つがオンすると対応
する表示素子が点灯するような表示回路に関するもので
ある。
上記したスイッチと表示素子とを備える表示回路の適
用例として、例えば第５図に示す液面位置検出装置があ
る。図において、筒体１中には複数のリードスイッチＳ
1〜Ｓ3が装填されており、これを液体Ａ中に固定配置す
る。液体Ａにはリング状のフロート２内に埋設したリン
グ状マグネットMgを有し、前記筒体１をこのフロート２
の内部に装着する。また各リードスイッチＳ1〜Ｓ3の端
子は表示回路部３に結合されており、該表示回路部３に
は外部液面位置表示用のLEDD1〜Ｄ4が直線状に整列して
配置されている。
用例として、例えば第５図に示す液面位置検出装置があ
る。図において、筒体１中には複数のリードスイッチＳ
1〜Ｓ3が装填されており、これを液体Ａ中に固定配置す
る。液体Ａにはリング状のフロート２内に埋設したリン
グ状マグネットMgを有し、前記筒体１をこのフロート２
の内部に装着する。また各リードスイッチＳ1〜Ｓ3の端
子は表示回路部３に結合されており、該表示回路部３に
は外部液面位置表示用のLEDD1〜Ｄ4が直線状に整列して
配置されている。
以上の構成において、液面位置が変位すると、それに
応じてフロート２が上下し、マグネットMgも上下する。
そこでこのマグネットMgの位置がリードスイッチＳ1〜
Ｓ3の対応するスイッチと略同一平面上に位置すると
き、そのスイッチがオンする。一方表示回路部３は各リ
ードスイッチＳ1〜Ｓ3のオン・オフ状態を監視してお
り、リードスイッチがオンすることにより、対応するLE
DD1〜Ｄ4の１つが点灯し、液面位置を表示する。
応じてフロート２が上下し、マグネットMgも上下する。
そこでこのマグネットMgの位置がリードスイッチＳ1〜
Ｓ3の対応するスイッチと略同一平面上に位置すると
き、そのスイッチがオンする。一方表示回路部３は各リ
ードスイッチＳ1〜Ｓ3のオン・オフ状態を監視してお
り、リードスイッチがオンすることにより、対応するLE
DD1〜Ｄ4の１つが点灯し、液面位置を表示する。
上記リードスイッチＳ1〜Ｓ3の液面位置に対するオン
期間特性は第６図の期間Ｔ1,T2に示す如く第ｎのスイッ
チと、次の第（ｎ＋１）のスイッチ（ｎ＝１〜３）との
オン期間が一部重複するように設定される。これは重複
期間Ｔ1,T2を設けないと、液面位置によっては全てのス
イッチＳ1〜Ｓ3がオフとなる期間が生じ、LEDD1〜Ｄ4の
全てが消灯する場合があるからであり、これを防止する
ために重複期間を設けてある。ところが各スイッチＳ1
〜Ｓ3に対応するLEDD1〜Ｄ4が、単にスイッチをオンす
るとそのLEDが点灯するように構成すると、前記重複期
間において２つのLEDが同時に点灯するという不都合を
生じる。
期間特性は第６図の期間Ｔ1,T2に示す如く第ｎのスイッ
チと、次の第（ｎ＋１）のスイッチ（ｎ＝１〜３）との
オン期間が一部重複するように設定される。これは重複
期間Ｔ1,T2を設けないと、液面位置によっては全てのス
イッチＳ1〜Ｓ3がオフとなる期間が生じ、LEDD1〜Ｄ4の
全てが消灯する場合があるからであり、これを防止する
ために重複期間を設けてある。ところが各スイッチＳ1
〜Ｓ3に対応するLEDD1〜Ｄ4が、単にスイッチをオンす
るとそのLEDが点灯するように構成すると、前記重複期
間において２つのLEDが同時に点灯するという不都合を
生じる。
そこで表示回路部３において、スイッチＳ1〜Ｓ3の中
で１つがオンしているときには対応するLEDD1〜Ｄ4が点
灯すると共に、前記重複期間では液面位置の低い方を感
知するオン状態にあるスイッチに対応するLEDを点灯さ
せ、高い方を感知するオン状態にあるスイッチに対応す
るLEDを消灯させて、液面位置にかかわらず常時１つのL
EDが点灯するように制御している。即ち、表示回路部３
は各スイッチＳ1〜Ｓ3のオン状態に対してLEDD1〜Ｄ4の
点灯に優先順位を設けるように制御している。
で１つがオンしているときには対応するLEDD1〜Ｄ4が点
灯すると共に、前記重複期間では液面位置の低い方を感
知するオン状態にあるスイッチに対応するLEDを点灯さ
せ、高い方を感知するオン状態にあるスイッチに対応す
るLEDを消灯させて、液面位置にかかわらず常時１つのL
EDが点灯するように制御している。即ち、表示回路部３
は各スイッチＳ1〜Ｓ3のオン状態に対してLEDD1〜Ｄ4の
点灯に優先順位を設けるように制御している。
この表示回路部３は従来第４図の如く構成されてい
る。図において、最も低位置にて点灯する他方の端のLE
DD1は電源ＶB、電流制限抵抗Ｒ11及びスイッチＳ1が直
列接続される。また最も高位置にて点灯する一方の端の
LEDD4はそのアノード側に電源ＶBと電流制限抵抗Ｒ14が
接続され、カソード側にはインバータ４3とAND回路５3
が接続される。AND回路５3の入力には各スイッチＳ1〜
Ｓ3が接続される。またその中間の位置にて点灯するLED
D2,D3のアノード側はＤ1,D4と同様の構成であり、カソ
ード側はインバータ４1,42とAND回路５1,52が各々直列
接続されている。AND回路５1の入力はスイッチＳ1及び
インバータ４4を介したスイッチＳ2が接続され、AND回
路５2の入力にはスイッチＳ2及びインバータ４5を介し
たスイッチＳ2が接続される。
る。図において、最も低位置にて点灯する他方の端のLE
DD1は電源ＶB、電流制限抵抗Ｒ11及びスイッチＳ1が直
列接続される。また最も高位置にて点灯する一方の端の
LEDD4はそのアノード側に電源ＶBと電流制限抵抗Ｒ14が
接続され、カソード側にはインバータ４3とAND回路５3
が接続される。AND回路５3の入力には各スイッチＳ1〜
Ｓ3が接続される。またその中間の位置にて点灯するLED
D2,D3のアノード側はＤ1,D4と同様の構成であり、カソ
ード側はインバータ４1,42とAND回路５1,52が各々直列
接続されている。AND回路５1の入力はスイッチＳ1及び
インバータ４4を介したスイッチＳ2が接続され、AND回
路５2の入力にはスイッチＳ2及びインバータ４5を介し
たスイッチＳ2が接続される。
以上の構成において、スイッチＳ1のみオンしている
場合にはLEDD1が点灯すると共に、他のスイッチＳ2,S3
はオフであるため、インバータ４4,45の出力は「Ｌ」レ
ベルである。従って各AND回路５1〜５3の出力は「Ｌ」
レベルとなり、インバータ４1〜４3の出力は「Ｈ」レベ
ルとなるためLEDD2〜Ｄ4は消灯する。また同様にスイッ
チＳ2及びＳ3のみオンしている場合には、対応するイン
バータ４4又は４5の出力のみ「Ｈ」レベルとなり、その
AND回路５1,52の出力が「Ｈ」レベルとなる。従って、
それに接続されたインバータ４1又は４2のみその出力が
「Ｌ」レベルとなって、LEDD2又はＤ3を点灯する。更に
全てのスイッチＳ1〜Ｓ3がオフすると、AND回路５3の出
力のみ「Ｈ」レベルとなり、インバータ４3が「Ｌ」レ
ベルとなってLEDD4が点灯する。
場合にはLEDD1が点灯すると共に、他のスイッチＳ2,S3
はオフであるため、インバータ４4,45の出力は「Ｌ」レ
ベルである。従って各AND回路５1〜５3の出力は「Ｌ」
レベルとなり、インバータ４1〜４3の出力は「Ｈ」レベ
ルとなるためLEDD2〜Ｄ4は消灯する。また同様にスイッ
チＳ2及びＳ3のみオンしている場合には、対応するイン
バータ４4又は４5の出力のみ「Ｈ」レベルとなり、その
AND回路５1,52の出力が「Ｈ」レベルとなる。従って、
それに接続されたインバータ４1又は４2のみその出力が
「Ｌ」レベルとなって、LEDD2又はＤ3を点灯する。更に
全てのスイッチＳ1〜Ｓ3がオフすると、AND回路５3の出
力のみ「Ｈ」レベルとなり、インバータ４3が「Ｌ」レ
ベルとなってLEDD4が点灯する。
一方、スイッチＳ1,S2が共にオンする期間（第６図期
間Ｔ1）では、LEDD1は点灯するがAND回路５1の２入力が
各々「Ｈ」及び「Ｌ」レベルとなり、その出力が「Ｌ」
レベルとなるから、インバータ４1の出力が「Ｈ」レベ
ルとなってLEDD2は消灯する。またスイッチＳ2,S3が共
にオンする期間（第６図期間Ｔ2）では、AND回路５1の
２入力は共に「Ｈ」レベルとなりLEDD2は点灯するが、A
ND回路５2の２入力は「Ｈ」及び「Ｌ」レベルとなり、L
EDD3は消灯する。
間Ｔ1）では、LEDD1は点灯するがAND回路５1の２入力が
各々「Ｈ」及び「Ｌ」レベルとなり、その出力が「Ｌ」
レベルとなるから、インバータ４1の出力が「Ｈ」レベ
ルとなってLEDD2は消灯する。またスイッチＳ2,S3が共
にオンする期間（第６図期間Ｔ2）では、AND回路５1の
２入力は共に「Ｈ」レベルとなりLEDD2は点灯するが、A
ND回路５2の２入力は「Ｈ」及び「Ｌ」レベルとなり、L
EDD3は消灯する。
以上の動作より、スイッチＳn及びＳn+1が共にオンす
る期間では、LEDDnのみ点灯し、LEDDn+1を含むその他の
LEDが消灯する。従って、液面変化に応じて常時１つのL
EDのみが点灯し、その液面位置を表示する。
る期間では、LEDDnのみ点灯し、LEDDn+1を含むその他の
LEDが消灯する。従って、液面変化に応じて常時１つのL
EDのみが点灯し、その液面位置を表示する。
上述した従来の構成においては、AND回路やインバー
タ等の多くの論理回路を必要とし、該論理回路は多数の
トランジスタ素子等により構成されるため、回路構成が
複雑でコスト高となっていた。
タ等の多くの論理回路を必要とし、該論理回路は多数の
トランジスタ素子等により構成されるため、回路構成が
複雑でコスト高となっていた。
そこで本考案は簡単な構成でコストダウンを図った表
示回路を提供することを課題としている。
示回路を提供することを課題としている。
上記課題を解決するために本考案により成された表示
回路は、直線状に配置した複数の表示素子と、一端がア
ースされ他端が電源に接続されている一方の端に配置さ
れた前記表示素子を除く残りの表示素子と直列にアース
との間にそれぞれ直列に接続され、所定情報量に応じて
順次オン状態となり、かつ隣接する表示素子に対応する
２つが同時にオンする期間を有する複数のスイッチと、
他方の端に配置された前記表示素子を除く残りの表示素
子と直列に電源との間にそれぞれ接続された複数の駆動
用トランジスタと、該複数の駆動用トランジスタの各々
の制御端子とアースとの間に接続されると共に、当該駆
動用トランジスタと直列接続された表示素子に隣接する
他方の端側の表示素子の一端に制御端子が接続され、該
隣接する他方の端側の表示素子と直列に接続された前記
スイッチがオンしたとき又は該隣接する他方の端側の表
示素子と直列に接続された前記駆動用トランジスタがオ
フしたときオフとなり、当該駆動用トランジスタをオフ
させる制御用トランジスタとを備えることを特徴として
いる。
回路は、直線状に配置した複数の表示素子と、一端がア
ースされ他端が電源に接続されている一方の端に配置さ
れた前記表示素子を除く残りの表示素子と直列にアース
との間にそれぞれ直列に接続され、所定情報量に応じて
順次オン状態となり、かつ隣接する表示素子に対応する
２つが同時にオンする期間を有する複数のスイッチと、
他方の端に配置された前記表示素子を除く残りの表示素
子と直列に電源との間にそれぞれ接続された複数の駆動
用トランジスタと、該複数の駆動用トランジスタの各々
の制御端子とアースとの間に接続されると共に、当該駆
動用トランジスタと直列接続された表示素子に隣接する
他方の端側の表示素子の一端に制御端子が接続され、該
隣接する他方の端側の表示素子と直列に接続された前記
スイッチがオンしたとき又は該隣接する他方の端側の表
示素子と直列に接続された前記駆動用トランジスタがオ
フしたときオフとなり、当該駆動用トランジスタをオフ
させる制御用トランジスタとを備えることを特徴として
いる。
［作用］ 上記構成において、全てのスイッチがオフしていると
きは、これと直列に接続されている表示素子は消灯して
いるが、これらの表示素子の一端に制御端子が接続され
ている制御用トランジスタがオンしているので、この制
御用トランジスタが制御端子に接続されている駆動用ト
ランジスタはオンしている。よって、スイッチが直列に
接続されていない一方の端の表示素子のみが点灯するよ
うになる。
きは、これと直列に接続されている表示素子は消灯して
いるが、これらの表示素子の一端に制御端子が接続され
ている制御用トランジスタがオンしているので、この制
御用トランジスタが制御端子に接続されている駆動用ト
ランジスタはオンしている。よって、スイッチが直列に
接続されていない一方の端の表示素子のみが点灯するよ
うになる。
また、他方の端の表示素子と直列に接続されたスイッ
チがオンしたときには、電源、表示素子及びスイッチを
通じてアースに電流が流れオンしたスイッチと直列に接
続されたスイッチのオンにより、このスイッチと直列接
続されている表示素子の一端に制御端子に接続されてい
る制御用トランジスタがオフとなり、この制御用トラン
ジスタのオフにより、この制御用トランジスタが制御端
子に接続されている駆動用トランジスタがオフとなる。
そして、この駆動用トランジスタのオフにより、他方の
端の表示素子を除く、オンとなっていないスイッチと直
列に接続されている表示素子は勿論のこと一方の端の表
示素子も消灯している。
チがオンしたときには、電源、表示素子及びスイッチを
通じてアースに電流が流れオンしたスイッチと直列に接
続されたスイッチのオンにより、このスイッチと直列接
続されている表示素子の一端に制御端子に接続されてい
る制御用トランジスタがオフとなり、この制御用トラン
ジスタのオフにより、この制御用トランジスタが制御端
子に接続されている駆動用トランジスタがオフとなる。
そして、この駆動用トランジスタのオフにより、他方の
端の表示素子を除く、オンとなっていないスイッチと直
列に接続されている表示素子は勿論のこと一方の端の表
示素子も消灯している。
更に、他方の端の表示素子と直列に接続されたスイッ
チ以外の任意の１つのスイッチのみがオンしたときに
は、このスイッチのオンにより、このスイッチと直列に
接続されている表示素子の一端に制御端子が接続されて
いる制御用トランジスタがオフとなる。この制御用トラ
ンジスタのオフにより、その制御端子に接続されている
一方の端側の全ての駆動用トランジスタがオフとなるの
で、オンしていないスイッチと直列に接続されている表
示素子は勿論のこと、直列にスイッチが接続されていな
い一方の端の表示素子も消灯したままである。
チ以外の任意の１つのスイッチのみがオンしたときに
は、このスイッチのオンにより、このスイッチと直列に
接続されている表示素子の一端に制御端子が接続されて
いる制御用トランジスタがオフとなる。この制御用トラ
ンジスタのオフにより、その制御端子に接続されている
一方の端側の全ての駆動用トランジスタがオフとなるの
で、オンしていないスイッチと直列に接続されている表
示素子は勿論のこと、直列にスイッチが接続されていな
い一方の端の表示素子も消灯したままである。
また、隣接する２つの表示素子と直列にそれぞれ接続
されている２つのスイッチが同時にオンしたときには、
これらのスイッチと直列に接続されている表示素子の一
端に制御端子が接続されている制御用トランジスタはオ
フとなるので、これらの制御用トランジスタが制御端子
に接続されている一方の端側の表示素子と直列接続した
駆動用トランジスタもオフとなる。このオフとなった駆
動用トランジスタと直列に接続されている隣接する一方
の端側の表示素子は、スイッチがオンしていても点灯す
ることができないが、隣接する他方の端側の表示素子は
これと直列に接続されている駆動用トランジスタがオン
状態にあるので点灯されるようになる。
されている２つのスイッチが同時にオンしたときには、
これらのスイッチと直列に接続されている表示素子の一
端に制御端子が接続されている制御用トランジスタはオ
フとなるので、これらの制御用トランジスタが制御端子
に接続されている一方の端側の表示素子と直列接続した
駆動用トランジスタもオフとなる。このオフとなった駆
動用トランジスタと直列に接続されている隣接する一方
の端側の表示素子は、スイッチがオンしていても点灯す
ることができないが、隣接する他方の端側の表示素子は
これと直列に接続されている駆動用トランジスタがオン
状態にあるので点灯されるようになる。
以上のように、駆動用トランジスタと制御用トランジ
スタの使用のみによって、隣接する表示素子に対応する
２つのスイッチが同時にオンする期間を有しても、隣接
する２つの表示素子が同時に点灯されることがなくさ
れ、他方の端側の一方の表示素子のみが点灯されるよう
になる。
スタの使用のみによって、隣接する表示素子に対応する
２つのスイッチが同時にオンする期間を有しても、隣接
する２つの表示素子が同時に点灯されることがなくさ
れ、他方の端側の一方の表示素子のみが点灯されるよう
になる。
以下本考案の実施例を図面と共に説明する。第１図に
おいて、第４図と同一部分は同一符号を付記する。最も
低位置を表示する他方の端のLEDD1は第４図と同様にス
イッチＳ1、抵抗Ｒ11、及び電源ＶBが直列接続されてい
る。またその他のLEDD2〜Ｄ4のアノードと電源ＶB間に
はPNP型の駆動用トランジスタＱ11〜Ｑ13のエミッタ・
コレクタ路が直列接続されており、更に最高位置を表示
するLEDD4を除くＤ1〜Ｄ3のアノードにはNPN型の制御用
トランジスタＱ21〜Ｑ23のベースが抵抗Ｒ41〜Ｒ43を介
して接続されている。各駆動用トランジスタＱ11〜Ｑ13
のエミッタ・ベース間には抵抗Ｒ21〜Ｒ23が接続され、
そのベースは抵抗Ｒ31〜Ｒ33を介して制御用トランジス
タＱ21〜Ｑ23のコレクタに接続される。該トランジスタ
Ｑ21〜Ｑ23のエミッタ・ベース間には各々抵抗Ｒ51〜Ｒ
53が接続され、そのエミッタはスイッチＳ1〜Ｓ3の他端
と同様に接地されている。また一方の端のLEDD4のカソ
ードも同様に接地されている。
おいて、第４図と同一部分は同一符号を付記する。最も
低位置を表示する他方の端のLEDD1は第４図と同様にス
イッチＳ1、抵抗Ｒ11、及び電源ＶBが直列接続されてい
る。またその他のLEDD2〜Ｄ4のアノードと電源ＶB間に
はPNP型の駆動用トランジスタＱ11〜Ｑ13のエミッタ・
コレクタ路が直列接続されており、更に最高位置を表示
するLEDD4を除くＤ1〜Ｄ3のアノードにはNPN型の制御用
トランジスタＱ21〜Ｑ23のベースが抵抗Ｒ41〜Ｒ43を介
して接続されている。各駆動用トランジスタＱ11〜Ｑ13
のエミッタ・ベース間には抵抗Ｒ21〜Ｒ23が接続され、
そのベースは抵抗Ｒ31〜Ｒ33を介して制御用トランジス
タＱ21〜Ｑ23のコレクタに接続される。該トランジスタ
Ｑ21〜Ｑ23のエミッタ・ベース間には各々抵抗Ｒ51〜Ｒ
53が接続され、そのエミッタはスイッチＳ1〜Ｓ3の他端
と同様に接地されている。また一方の端のLEDD4のカソ
ードも同様に接地されている。
かかる構成において、スイッチＳ1〜Ｓ3がオンする
と、対応する制御用トランジスタＱ21〜Ｑ23はオンから
オフ状態となり、該トランジスタＱ21〜Ｑ23がオフであ
れば、駆動用トランジスタＱ11〜Ｑ13にはベース電源が
流れないためオフであり、オンであればベース電流が流
れるのでオン状態となる。
と、対応する制御用トランジスタＱ21〜Ｑ23はオンから
オフ状態となり、該トランジスタＱ21〜Ｑ23がオフであ
れば、駆動用トランジスタＱ11〜Ｑ13にはベース電源が
流れないためオフであり、オンであればベース電流が流
れるのでオン状態となる。
スイッチＳ1のみオンすると電源ＶBの電流がLEDD1に
流れて点灯し、スイッチＳ2のみオンすると、制御用ト
ランジスタＱ21はオンしているため、駆動用トランジス
タＱ11がオンし、電源ＶB→Ｑ11→LEDD2→スイッチＳ2
の経路で電流が流れＤ2が点灯する。またスイッチＳ3の
みが点灯すると同様にLEDD3のみ点灯し、全てのスイッ
チがオフであれば、制御用トランジスタＱ23がオンして
いるため、駆動用トランジスタＱ13がオンし、LEDD4が
点灯する。
流れて点灯し、スイッチＳ2のみオンすると、制御用ト
ランジスタＱ21はオンしているため、駆動用トランジス
タＱ11がオンし、電源ＶB→Ｑ11→LEDD2→スイッチＳ2
の経路で電流が流れＤ2が点灯する。またスイッチＳ3の
みが点灯すると同様にLEDD3のみ点灯し、全てのスイッ
チがオフであれば、制御用トランジスタＱ23がオンして
いるため、駆動用トランジスタＱ13がオンし、LEDD4が
点灯する。
一方、スイッチＳ1とＳ2が共にオンする場合には、LE
DD1は上記のとおり点灯するが、制御用トランジスタＱ
21はスイッチＳ1がオンのためオフしているため、駆動
用トランジスタＱ11がオフ状態となりLEDD2は消灯状態
となる。またスイッチＳ2とＳ3が共にオンする場合に
は、同様に制御用トランジスタＱ21がオンしているので
駆動用トランジスタＱ11はオンし、制御用トランジスタ
Ｑ22がオフしているので駆動用トランジスタＱ12はオフ
となる。よってLEDD2のみ点灯し、LEDD3は消灯する。即
ち、スイッチＳnとＳn+1が共にオンすると、駆動トラン
ジスタＱ1nがオンし、Ｑ1(n+1)がオフするためLEDDnの
み点灯することになる。
DD1は上記のとおり点灯するが、制御用トランジスタＱ
21はスイッチＳ1がオンのためオフしているため、駆動
用トランジスタＱ11がオフ状態となりLEDD2は消灯状態
となる。またスイッチＳ2とＳ3が共にオンする場合に
は、同様に制御用トランジスタＱ21がオンしているので
駆動用トランジスタＱ11はオンし、制御用トランジスタ
Ｑ22がオフしているので駆動用トランジスタＱ12はオフ
となる。よってLEDD2のみ点灯し、LEDD3は消灯する。即
ち、スイッチＳnとＳn+1が共にオンすると、駆動トラン
ジスタＱ1nがオンし、Ｑ1(n+1)がオフするためLEDDnの
み点灯することになる。
第２図は本考案の他の実施例を示し、第１図において
LEDD1〜Ｄ4と電源の方向を逆にし、駆動用トランジスタ
Ｑ11〜Ｑ13をNPN型とし、制御用トランジスタＱ21〜Ｑ
23をPNP型としたものであり、その動作は第１図と同様
である。
LEDD1〜Ｄ4と電源の方向を逆にし、駆動用トランジスタ
Ｑ11〜Ｑ13をNPN型とし、制御用トランジスタＱ21〜Ｑ
23をPNP型としたものであり、その動作は第１図と同様
である。
また第３図は本考案の他の実施例を示し、表示素子と
して白熱ランプＬ1〜Ｌ4を用いたものであり、制御用ト
ランジスタＱ21〜Ｑ23のベースは各ランプＬ1〜Ｌ3とス
イッチＳ1〜Ｓ3間に接続され、電流制限用抵抗Ｒ11〜Ｒ
14は省略されている。かかる第３図の構成においても、
その動作は第１図と同様である。
して白熱ランプＬ1〜Ｌ4を用いたものであり、制御用ト
ランジスタＱ21〜Ｑ23のベースは各ランプＬ1〜Ｌ3とス
イッチＳ1〜Ｓ3間に接続され、電流制限用抵抗Ｒ11〜Ｒ
14は省略されている。かかる第３図の構成においても、
その動作は第１図と同様である。
以上説明したように本考案によれば、直線状に整列さ
れて配置された複数の表示素子のうちの隣接する表示素
子に対応する２つのスイッチが同時にオンすることがあ
っても、２つのスイッチの重複オン期間に対する表示素
子の優先順位機能を、論理回路を用いることなく、駆動
用と制御用トランジスタの使用のみによって実現し、隣
接する２つの表示素子が同時に点灯することがなくさ
れ、一方の表示素子のみが点灯されるようになるので、
回路の簡素化とコストダウンを図ることができる。
れて配置された複数の表示素子のうちの隣接する表示素
子に対応する２つのスイッチが同時にオンすることがあ
っても、２つのスイッチの重複オン期間に対する表示素
子の優先順位機能を、論理回路を用いることなく、駆動
用と制御用トランジスタの使用のみによって実現し、隣
接する２つの表示素子が同時に点灯することがなくさ
れ、一方の表示素子のみが点灯されるようになるので、
回路の簡素化とコストダウンを図ることができる。
第１図〜第３図は本考案に係る実施例を示す回路図、 第４図は従来の表示回路を示す回路図、 第５図は本考案及び従来の表示回路が適用される液面位
置表示装置を示す図、 第６図は第５図における液面位置に対するスイッチ特性
を示す図である。 Ｓ1,S2,S3……スイッチ、Ｄ1,D2,D3……LED、Ｌ1,L2,L3
……ランプ、Ｑ11,Q12,Q13……駆動用トランジスタ、Ｑ
21,Q22,Q23……制御用トランジスタ、Ｒ11,R12,R13……
電流制限抵抗。
置表示装置を示す図、 第６図は第５図における液面位置に対するスイッチ特性
を示す図である。 Ｓ1,S2,S3……スイッチ、Ｄ1,D2,D3……LED、Ｌ1,L2,L3
……ランプ、Ｑ11,Q12,Q13……駆動用トランジスタ、Ｑ
21,Q22,Q23……制御用トランジスタ、Ｒ11,R12,R13……
電流制限抵抗。
Claims (1)
- 【請求項１】直線状に配置した複数の表示素子と、 一端がアースされ他端が電源に接続されている一方の端
に配置された前記表示素子を除く残りの表示素子と直列
にアースとの間にそれぞれ直列に接続され、所定情報量
に応じて順次オン状態となり、かつ隣接する表示素子に
対応する２つが同時にオンする期間を有する複数のスイ
ッチと、 他方の端に配置された前記表示素子を除く残りの表示素
子と直列に電源との間にそれぞれ接続された複数の駆動
用トランジスタと、 該複数の駆動用トランジスタの各々の制御端子とアース
との間に接続されると共に、当該駆動用トランジスタと
直列接続された表示素子に隣接する他方の端側の表示素
子の一端に制御端子が接続され、該隣接する他方の端側
の表示素子と直列に接続された前記スイッチがオンした
とき又は該隣接する他方の端側の表示素子と直列に接続
された前記駆動用トランジスタがオフしたときオフとな
り、当該駆動用トランジスタをオフさせる制御用トラン
ジスタと を備えることを特徴とする表示回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1988066800U JPH085516Y2 (ja) | 1988-05-23 | 1988-05-23 | 表示回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1988066800U JPH085516Y2 (ja) | 1988-05-23 | 1988-05-23 | 表示回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01172092U JPH01172092U (ja) | 1989-12-06 |
| JPH085516Y2 true JPH085516Y2 (ja) | 1996-02-14 |
Family
ID=31292187
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1988066800U Expired - Lifetime JPH085516Y2 (ja) | 1988-05-23 | 1988-05-23 | 表示回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH085516Y2 (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5826088A (ja) * | 1981-08-10 | 1983-02-16 | 松下電工株式会社 | 養生装置 |
| JPS6059164B2 (ja) * | 1982-03-04 | 1985-12-24 | 住友重機械工業株式会社 | 硫黄回収プラントから排出される低圧蒸気の利用法 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6059164U (ja) * | 1983-09-28 | 1985-04-24 | パイオニア株式会社 | バッテリ−チェック回路 |
-
1988
- 1988-05-23 JP JP1988066800U patent/JPH085516Y2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5826088A (ja) * | 1981-08-10 | 1983-02-16 | 松下電工株式会社 | 養生装置 |
| JPS6059164B2 (ja) * | 1982-03-04 | 1985-12-24 | 住友重機械工業株式会社 | 硫黄回収プラントから排出される低圧蒸気の利用法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01172092U (ja) | 1989-12-06 |
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