JPH08340243A - バイアス回路 - Google Patents
バイアス回路Info
- Publication number
- JPH08340243A JPH08340243A JP7147133A JP14713395A JPH08340243A JP H08340243 A JPH08340243 A JP H08340243A JP 7147133 A JP7147133 A JP 7147133A JP 14713395 A JP14713395 A JP 14713395A JP H08340243 A JPH08340243 A JP H08340243A
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- JP
- Japan
- Prior art keywords
- current
- circuit
- current mirror
- supplied
- circuit block
- Prior art date
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- Pending
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Semiconductor Integrated Circuits (AREA)
- Logic Circuits (AREA)
Abstract
(57)【要約】
【目的】 複数の回路ブロックのカレントミラーの値の
相対精度を高くする。 【構成】 第１のカレントミラー回路を有する一の回路
ブロック１と、該第１のカレントミラー回路の出力電流
が供給される第２のカレントミラー回路をそれぞれ有す
る複数の他の回路ブロック２，３，４とを備えた。
相対精度を高くする。 【構成】 第１のカレントミラー回路を有する一の回路
ブロック１と、該第１のカレントミラー回路の出力電流
が供給される第２のカレントミラー回路をそれぞれ有す
る複数の他の回路ブロック２，３，４とを備えた。
Description
【０００１】
【産業上の利用分野】本発明はバイアス回路に係わり、
特にＩＣ内の複数の回路ブロックにおいて相対精度の良
いカレントミラーを実現するバイアス回路に関するもの
である。
特にＩＣ内の複数の回路ブロックにおいて相対精度の良
いカレントミラーを実現するバイアス回路に関するもの
である。
【０００２】
【従来の技術】従来、複数の回路ブロックにおいて同一
の電流値のバイアスを供給するバイアス回路としては図
２に示す構成がとられている。すなわち、図２に示すよ
うに、回路ブロック１の内に形成したバイアス回路のバ
イアス電圧を、他の回路ブロック２，３，４…に供給
し、回路ブロック１と同様な構成のカレントミラーによ
り、各回路ブロック内でバイアス電流を発生させてい
る。
の電流値のバイアスを供給するバイアス回路としては図
２に示す構成がとられている。すなわち、図２に示すよ
うに、回路ブロック１の内に形成したバイアス回路のバ
イアス電圧を、他の回路ブロック２，３，４…に供給
し、回路ブロック１と同様な構成のカレントミラーによ
り、各回路ブロック内でバイアス電流を発生させてい
る。
【０００３】
【発明が解決しようとする課題】しかしながら、上記従
来のバイアス回路ではバイアス電圧を供給する配線１６
や電源配線６の配線抵抗と、配線を流れる電流とにより
電圧降下が生じるため、ＩＣ上の各回路ブロックの配置
や回路ブロック間の配線抵抗というレイアウト的要素で
各回路ブロックのバイアス電流の相対精度が悪化すると
いう問題があった。
来のバイアス回路ではバイアス電圧を供給する配線１６
や電源配線６の配線抵抗と、配線を流れる電流とにより
電圧降下が生じるため、ＩＣ上の各回路ブロックの配置
や回路ブロック間の配線抵抗というレイアウト的要素で
各回路ブロックのバイアス電流の相対精度が悪化すると
いう問題があった。
【０００４】本発明の目的は、回路ブロック間の配線抵
抗と、回路ブロック内でミラーする電流値に影響されな
い、相対精度の高いバイアス回路を実現することにあ
る。
抗と、回路ブロック内でミラーする電流値に影響されな
い、相対精度の高いバイアス回路を実現することにあ
る。
【０００５】
【課題を解決するための手段】本発明のバイアス回路
は、第１のカレントミラー回路を有する一の回路ブロッ
クと、該第１のカレントミラー回路の出力電流が供給さ
れる第２のカレントミラー回路をそれぞれ有する複数の
他の回路ブロックとを備えたものである。
は、第１のカレントミラー回路を有する一の回路ブロッ
クと、該第１のカレントミラー回路の出力電流が供給さ
れる第２のカレントミラー回路をそれぞれ有する複数の
他の回路ブロックとを備えたものである。
【０００６】
【作用】本発明では一の回路ブロック内のカレントミラ
ー回路の出力を他の回路ブロックに供給するため、回路
ブロック間の配線抵抗の値に依存しない電流を供給出来
る。
ー回路の出力を他の回路ブロックに供給するため、回路
ブロック間の配線抵抗の値に依存しない電流を供給出来
る。
【０００７】また、カレントミラー回路を他の複数の回
路ブロック内のそれぞれに構成することにより、カレン
トミラーを構成する素子をバイアスするバイアスライン
の配線抵抗の影響を極力小さくすることが可能となり、
相対精度の良いカレントミラーを実現出来る。
路ブロック内のそれぞれに構成することにより、カレン
トミラーを構成する素子をバイアスするバイアスライン
の配線抵抗の影響を極力小さくすることが可能となり、
相対精度の良いカレントミラーを実現出来る。
【０００８】なお、本発明において、他の回路ブロック
のカレントミラー回路にバイポーラトランジスタを使用
すれば、絶縁ゲート型トランジスタを使用した場合に比
べ、出力インピーダンスの高いカレントミラー回路を構
成することができる。また、カレントミラーを構成する
バイポーラトランジスタのベース電流を絶縁ゲート型ト
ランジスタで供給すれば、各回路ブロックでのミラーす
る電流値に影響されない相対精度の高いバイアスを実現
出来る。
のカレントミラー回路にバイポーラトランジスタを使用
すれば、絶縁ゲート型トランジスタを使用した場合に比
べ、出力インピーダンスの高いカレントミラー回路を構
成することができる。また、カレントミラーを構成する
バイポーラトランジスタのベース電流を絶縁ゲート型ト
ランジスタで供給すれば、各回路ブロックでのミラーす
る電流値に影響されない相対精度の高いバイアスを実現
出来る。
【０００９】
【実施例】以下、本発明の実施例について図面を用いて
詳細に説明する。
詳細に説明する。
【００１０】図１は本発明のバイアス回路の一実施例を
示す回路構成図であり、１は他の回路ブロックに電流を
供給するカレントミラー回路を内蔵する回路ブロック、
２，３，４は回路ブロック１により電流が供給される他
の回路ブロック、５は第１の電源ライン、６は第２の電
源ライン、７はミラーする電流の元となる電流源、８，
９，１０は他の回路ブロック２，３，４へ電流を供給す
るカレントミラーを構成するバイポーラトランジスタ、
１１は回路ブロックに供給された電流をミラーするため
のバイアスを発生させるためのバイポーラトランジス
タ、１３，１４，１５は回路ブロック内の回路にミラー
した電流を供給するためのバイポーラトランジスタ、１
２はカレントミラーを構成するバイポーラトランジスタ
のベース電流を供給する絶縁ゲート型トランジスタたる
ＭＯＳトランジスタである。
示す回路構成図であり、１は他の回路ブロックに電流を
供給するカレントミラー回路を内蔵する回路ブロック、
２，３，４は回路ブロック１により電流が供給される他
の回路ブロック、５は第１の電源ライン、６は第２の電
源ライン、７はミラーする電流の元となる電流源、８，
９，１０は他の回路ブロック２，３，４へ電流を供給す
るカレントミラーを構成するバイポーラトランジスタ、
１１は回路ブロックに供給された電流をミラーするため
のバイアスを発生させるためのバイポーラトランジス
タ、１３，１４，１５は回路ブロック内の回路にミラー
した電流を供給するためのバイポーラトランジスタ、１
２はカレントミラーを構成するバイポーラトランジスタ
のベース電流を供給する絶縁ゲート型トランジスタたる
ＭＯＳトランジスタである。
【００１１】電流源７より供給された電流は回路ブロッ
ク１内のカレントミラー回路により、他の回路ブロック
２，３，４に供給される。ここでは、カレントミラーを
構成するバイポーラトランジスタ８，９，１０のベース
電流をバイポーラトランジスタ１７により供給している
がこのベース電流供給トランジスタにＭＯＳトランジス
タを使用しても良い。その場合、回路ブロック１のカレ
ントミラー回路の出力電流はベース電流を供給するトラ
ンジスタのベース電流の影響を受けなくなる。また、電
流源７は、ある電圧との間に抵抗を挿入しただけの簡単
なものから、外部での調整を可能とする可変電流源な
ど、複雑な形式のものまで使用可能であり、その構成を
答わない。
ク１内のカレントミラー回路により、他の回路ブロック
２，３，４に供給される。ここでは、カレントミラーを
構成するバイポーラトランジスタ８，９，１０のベース
電流をバイポーラトランジスタ１７により供給している
がこのベース電流供給トランジスタにＭＯＳトランジス
タを使用しても良い。その場合、回路ブロック１のカレ
ントミラー回路の出力電流はベース電流を供給するトラ
ンジスタのベース電流の影響を受けなくなる。また、電
流源７は、ある電圧との間に抵抗を挿入しただけの簡単
なものから、外部での調整を可能とする可変電流源な
ど、複雑な形式のものまで使用可能であり、その構成を
答わない。
【００１２】回路ブロック１でミラーされた電流は他の
回路ブロック２，３，４…へ供給される。各回路ブロッ
ク２，３，４…へ供給された電流は、それぞれの回路ブ
ロックでミラーされ、各回路ブロック内の回路に使用さ
れる。例えば、トランジスタ８のコレクタから回路ブロ
ック２へ供給された電流はトランジスタ１１によりカレ
ントミラーのバイアス電圧へと変換され、カレントミラ
ーを構成する他のバイポーラトランジスタ１３，１４，
１５…のベースに電圧供給される。また、このカレント
ミラーを構成するバイポーラトランジスタのベース電流
はＭＯＳトランジスタ１２により供給される。回路ブロ
ック１及び２に示したカレントミラーを構成するトラン
ジスタをバイポーラトランジスタで構成しているのはＭ
ＯＳトランジスタを使用するのに比べ、出力インピーダ
ンスを大きくすることが出来るここと、一般的に同一面
積を占めるＭＯＳトランジスタより相対精度を良くする
ことが出来るためである。また、カレントミラーを構成
するバイポーラトランジスタのエミッタと電源との間に
抵抗を挿入しているのは、カレントミラーの出力インピ
ーダンスをさらに高め、また相対精度をさらに良くする
ためであるが、抵抗を挿入するかどうか、また、抵抗の
値をいくらにするかは、電流の精度やミラーを構成する
バイポーラトランジスタのコレクタ電位の取りうる範囲
や、電流のノイズスペックなどにより決定される。カレ
ントミラーを構成するトランジスタ１１，１３，１４，
１５…のベース電流はＭＯＳトランジスタ１２により供
給される。このため、複数の回路ブロック２，３，４…
のそれぞれでカレントミラーされる電流値はそれぞれの
回路ブロックのカレントミラー回路のミラーするトラン
ジスタの数の影響を受けない。たとえば、回路ブロック
２，３，４が、ｇm アンプを用いたフィルターであり、
カレントミラーの出力電流が、ｇm アンプのｇmを決定
する電流源に使われている場合を考えてみる。この場
合、各フィルターに求められる特性が異なれば、当然、
カレントミラーでミラーされる電流値も異なる場合が多
い。この時カレントミラーを構成するバイポーラトラン
ジスタのベース電流をバイポーラトランジスタで供給し
ようとすると、そのトランジスタのベース電流により、
ミラーされる電流に誤差が発生する。したがって、電流
源７の値を調整してフィルターのｆc を調整しようとし
た時、回路ブロック２，３，４…の特性がまったく同調
しては調整されなくなってしまう。
回路ブロック２，３，４…へ供給される。各回路ブロッ
ク２，３，４…へ供給された電流は、それぞれの回路ブ
ロックでミラーされ、各回路ブロック内の回路に使用さ
れる。例えば、トランジスタ８のコレクタから回路ブロ
ック２へ供給された電流はトランジスタ１１によりカレ
ントミラーのバイアス電圧へと変換され、カレントミラ
ーを構成する他のバイポーラトランジスタ１３，１４，
１５…のベースに電圧供給される。また、このカレント
ミラーを構成するバイポーラトランジスタのベース電流
はＭＯＳトランジスタ１２により供給される。回路ブロ
ック１及び２に示したカレントミラーを構成するトラン
ジスタをバイポーラトランジスタで構成しているのはＭ
ＯＳトランジスタを使用するのに比べ、出力インピーダ
ンスを大きくすることが出来るここと、一般的に同一面
積を占めるＭＯＳトランジスタより相対精度を良くする
ことが出来るためである。また、カレントミラーを構成
するバイポーラトランジスタのエミッタと電源との間に
抵抗を挿入しているのは、カレントミラーの出力インピ
ーダンスをさらに高め、また相対精度をさらに良くする
ためであるが、抵抗を挿入するかどうか、また、抵抗の
値をいくらにするかは、電流の精度やミラーを構成する
バイポーラトランジスタのコレクタ電位の取りうる範囲
や、電流のノイズスペックなどにより決定される。カレ
ントミラーを構成するトランジスタ１１，１３，１４，
１５…のベース電流はＭＯＳトランジスタ１２により供
給される。このため、複数の回路ブロック２，３，４…
のそれぞれでカレントミラーされる電流値はそれぞれの
回路ブロックのカレントミラー回路のミラーするトラン
ジスタの数の影響を受けない。たとえば、回路ブロック
２，３，４が、ｇm アンプを用いたフィルターであり、
カレントミラーの出力電流が、ｇm アンプのｇmを決定
する電流源に使われている場合を考えてみる。この場
合、各フィルターに求められる特性が異なれば、当然、
カレントミラーでミラーされる電流値も異なる場合が多
い。この時カレントミラーを構成するバイポーラトラン
ジスタのベース電流をバイポーラトランジスタで供給し
ようとすると、そのトランジスタのベース電流により、
ミラーされる電流に誤差が発生する。したがって、電流
源７の値を調整してフィルターのｆc を調整しようとし
た時、回路ブロック２，３，４…の特性がまったく同調
しては調整されなくなってしまう。
【００１３】本発明によれば、カレントミラーを構成す
るバイポーラトランジスタのベース電流をＭＯＳトラン
ジスタにより供給しているため、各回路ブロック２，
３，４…でのカレントミラーのミラー数によらず、各回
路ブロックのカレントミラーの電流値の相対精度を高く
することが可能となっている。
るバイポーラトランジスタのベース電流をＭＯＳトラン
ジスタにより供給しているため、各回路ブロック２，
３，４…でのカレントミラーのミラー数によらず、各回
路ブロックのカレントミラーの電流値の相対精度を高く
することが可能となっている。
【００１４】
【発明の効果】以上説明したように、本発明によれば、
複数の回路ブロックのカレントミラーの値の相対精度を
高くすることが可能となる。これにより、たとえばｇm
アンプを用いたフィルターに使用した場合、各フィルタ
ーの特性の相対精度を高くすることが可能となり、フィ
ルターのｆc をｇm アンプのバイアス電流により調整し
ようとした場合、各フィルターの特性を精度よく調整す
ることが可能となる。また、この回路を用いたＩＣをレ
イアウトする場合、回路ブロック間の配線抵抗の影響を
受けないことから、レイアウト時の自由度が増し、レイ
アウト時間の短縮、及び性能の向上が可能となる。
複数の回路ブロックのカレントミラーの値の相対精度を
高くすることが可能となる。これにより、たとえばｇm
アンプを用いたフィルターに使用した場合、各フィルタ
ーの特性の相対精度を高くすることが可能となり、フィ
ルターのｆc をｇm アンプのバイアス電流により調整し
ようとした場合、各フィルターの特性を精度よく調整す
ることが可能となる。また、この回路を用いたＩＣをレ
イアウトする場合、回路ブロック間の配線抵抗の影響を
受けないことから、レイアウト時の自由度が増し、レイ
アウト時間の短縮、及び性能の向上が可能となる。
【図１】本発明のバイアス回路の一実施例を示す回路構
成図である。
成図である。
【図２】従来のバイアス回路の回路構成図である。
１ 第１の回路ブロック ２〜４ 第２〜第４の回路ブロック ５ 第１の電源ライン ６ 第２の電源ライン ７ 電流源 ８〜１０ 第１のカレントミラーを構成するトランジス
タ １１，１３〜１５ 第２のカレントミラーを構成するバ
イポーラトランジスタ １２ 第２のカレントミラーを構成するＭＯＳトランジ
スタ １６ バイアス電圧配線
タ １１，１３〜１５ 第２のカレントミラーを構成するバ
イポーラトランジスタ １２ 第２のカレントミラーを構成するＭＯＳトランジ
スタ １６ バイアス電圧配線
フロントページの続き (72)発明者 松野 靖司 東京都大田区下丸子３丁目30番２号 キヤ ノン株式会社内
Claims (2)
- 【請求項１】 第１のカレントミラー回路を有する一の
回路ブロックと、該第１のカレントミラー回路の出力電
流が供給される第２のカレントミラー回路をそれぞれ有
する複数の他の回路ブロックとを備えたバイアス回路。 - 【請求項２】 請求項１記載のバイアス回路において、
前記第２のカレントミラー回路は、電流をミラーするバ
イポーラトランジスタと、該バイポーラトランジスタの
ベース電流を供給する絶縁ゲート型トランジスタとを備
えてなるバイアス回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7147133A JPH08340243A (ja) | 1995-06-14 | 1995-06-14 | バイアス回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7147133A JPH08340243A (ja) | 1995-06-14 | 1995-06-14 | バイアス回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08340243A true JPH08340243A (ja) | 1996-12-24 |
Family
ID=15423317
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7147133A Pending JPH08340243A (ja) | 1995-06-14 | 1995-06-14 | バイアス回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08340243A (ja) |
Cited By (67)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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