JPH08338973A - 液晶表示素子の静電気防止回路 - Google Patents
液晶表示素子の静電気防止回路Info
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Abstract
に投入して基板に用いるれるグラス当りのセル取得数が
減少することを防ぎ、同じ大きさの基板内にセル取得数
を増加させて費用を節減できる液晶表示素子の静電気防
止回路を提供する。 【解決手段】 液晶表示素子の静電気防止回路は、セル
11の内部にあるパッドを隣接した他のセル11の内部
の当接する位置にあるパッドと個別的に連結する連結ラ
インと、連結ラインの左側連結ラインと真横の右側連結
ラインとを連結して連続的に配置されている連結ライン
すべてを短絡させる短絡線と、短絡線に連結され連続的
に配置される一面の2部分の連結ラインを連結する短絡
線連結部8とからなる。
Description
気防止回路、より詳しくは、アクティブマトリックス駆
動方式の液晶表示素子の液晶セルの組立工程中に薄膜ト
ランジスタ(Thin Film Transisto
r,TFT)アレイ基板の各ラインに発生する静電気を
防止するための液晶表示素子の静電気防止回路に関す
る。
ition TV)などの新しい先端映像機器が開発さ
れるに従って平板表示器に対する需要が増加されている
趨勢にある。その中でも、液晶表示素子は平板表示器の
代表的な技術としてEL(Electro Lumin
escence)素子、VFD(Vacuum Flu
orescence Display)、PDP(Pl
asma Display Panel)などが解決し
ないカラー化、低電力および高速化などの問題が解決さ
れ、極度に軽量で薄型、低価、低消費電力駆動で集積回
路との整合性もよいなどの特徴を有してラップトップコ
ンピュータ(Lap Top Computer)やポ
ケットコンピュータ(Pocket Compute
r)の表示以外に車両積載用、カラーTV画像用として
その用途が急速に拡大されている。
クティブ形の二つの形態に分けられるが、アクティブ形
液晶表示素子は各画素の一つ一つをTFTの如き能動素
子が制御するようにされていて速度、視野角および輝度
においてパッシブ形液晶表示素子よりずっとすぐれて1
00万画素以上の解像度を必要とするHDTVに最も適
合した表示器として注目されている。
デバイスの画素にアクティブ素子を付加し、十分なしき
い値特性の鋭さを有しない液晶に等価的に鋭敏なしきい
値特性を付加し、また各セルにおいて電圧を保持してク
ロストークを節減する方法である。その中でも、TFT
は走査線に対応するゲートバスの走査電極を順々に走査
し、そのラインのゲートバス上の全てのトランジスタを
ターンオフさせ、ホールド回路においてドレインバスを
介して各信号蓄積キャパシタに信号を供給し、各画素の
液晶に電荷の形態でデータを書き込む方法である。供給
された信号は、トランジスタをターンオンさせるとデー
タ書込み状態を保持し次のフレームの走査時まで液晶を
同期させる。
個のTFTアレイおよび液晶表示素子セルを配置して製
造できるが、このとき、前記各ラインまたはTCP(T
ape Carrier Package)実装のため
のパッド部上に静電気が発生する。前記パッド部上に発
生する静電気は容量は小さいが電位が数百ボルトから数
千ボルトまで出る。あるラインにパッドなどを通じて静
電気が加わると、そのライン上のTFT特性を劣化させ
るかあるいは絶縁膜が弱い部分を通じてローラインとカ
ラムラインの中間膜を短絡させるおそれがあるため、か
かる不良を縮めるため工程中に各ラインを短絡させて工
程を進行した後、TCP実装のための最後の工程として
前記短絡回路を分離させる。
素子の静電気防止回路を説明する。図1は従来の1基板
内に液晶表示素子を配置したレイアウトである。同図に
示すように、従来の1基板内に液晶表示素子を配置した
レイアウトは、まず、全体300*400サイズを有す
るTFTアレイ基板18に、セル全体を取り囲んでセル
領域を表示しそれぞれのセルを分離する従来の隣接した
セル間の境界線4と、前記従来の隣接したセル間の境界
線4によって分離された個別のセルからTCP実装前に
除去される領域を分離する短絡回路分離線3と、前記短
絡回路分離線3の内側にあるTCP取付パッド2と上側
基板領域6の内側に画面を表示する画面領域1を表示す
る境界線とで構成されている。
ィング前の液晶表示素子の静電気防止回路である。図2
に示すように、従来の液晶表示素子の静電気防止回路
は、まず、TCP取付パッド2を通じて静電気が加わる
ことを防止するために各TCP取付パッド2に連結され
るライン間を同一の金属、金属抵抗もしくは非線形素子
の抵抗を使用して連結する短絡回路5をつくる。
5はTCP実装のためその直前の工程で除去しなければ
ならない。従って、短絡回路5のパターンを有する領域
をカッティングして切り出すことによりセルから短絡回
路を分離する。
短絡回路5をつくるためには、各TCP取付パッド2に
連結されるラインの端を用いるため、図2に示すよう
に、セルを分離するためのカッティングを行う前の液晶
表示素子において、短絡回路分離線3と隣接したセル間
の境界線4との間の領域に、静電気防止回路に該当する
短絡回路5のための領域が別途に必要であるという短所
がある。
決するためのものであって、その目的は、1セル当りの
基板に占める面積が増加し、最初に投入して基板に用い
られるグラス当りのセル取得数が短絡回路パターンがな
いときに比べ減少することを防ぎ、同じ大きさの基板内
にセル取得数を増加させて費用を節減できる液晶表示素
子の静電気防止回路を提供することにある。
の本発明の液晶表示素子の静電気防止回路の構成は、1
基板内に複数個のセルを配置して製造する場合の液晶表
示素子の静電気防止回路であって、セルの内部にあるパ
ッドを隣接した他のセルの内部の当接する位置にあるパ
ッドと個別的に連結する連結ラインと、連結ラインをそ
れぞれ連結して連続的に配置されている連結ラインすべ
てを短絡させる短絡線と、短絡線に連結され連続的に配
置される一面の2部分の連結ラインをつながれる短絡連
結部とからなる。
添付図面に基づいて詳細に説明する。図3は本発明の実
施例に従う1基板内に液晶表示素子を配置したレイアウ
トであり、図4は本発明の実施例に従うセルを分離する
ためのカッティング前の液晶表示素子の静電気防止回路
である。
液晶表示素子の静電気防止回路の構成は、1基板内に複
数個のTFTアレイおよび液晶表示素子セル11を配置
して製造する際の静電気による破損防止のために短絡回
路を配置する工程において、セル11の内部にあるTC
P取付パッド2が隣接した他のセル11の内部と接する
場合、当接する位置にあるTCP取付パッド2と個別的
に連結される導体でなる連結ライン2′を設けている。
また、この個々の連結ライン2′のうち隣接する連結ラ
イン2′の左側連結ライン2′の上端部に始点が連結さ
れ、セルが分離される短絡回路分離線3を中心にし、右
側連結ライン2′の下端部に終着点が連結されるZ字状
の短絡線5′が設けられる。さらに前記連結ライン2′
は1面当り2つの部分で連続して設けられている。その
2つの部分のうち、左側において連結ライン2′が連続
して設けられる部分で最後の連結ライン2′の下端部に
始点が連結され、セルが分離される短絡回路分離線3と
平行でかつ2つの連続される部分間の中間部において、
セルが分離される短絡回路分離線3を垂直に横切る線か
ら90°角度左側に(短絡回路分離線3と垂直につなが
れる線を中心に)折られてつながれ、かつ、連結ライン
2′とTCP取付パッド2の接点付近の位置から再び9
0°角度で右側に(短絡回路分離線3と垂直につながれ
る線を中心に)折られて、セルが分離される短絡回路分
離線3と平行につながれ、前記連結ライン2′が連続し
て設けられる二つの部分のうち右側の一番目の連結ライ
ン2′の上端部と終着点が連結される畳まれたZ字状の
短絡線連結部8が設けられている。
液晶表示素子の静電気防止回路の作用は、次のようであ
る。従来の液晶表示素子のセル組立工程において、TC
P取付パッド2を通じて静電気をなくすために必要な短
絡回路5は、工程中に連結されて用いられた後、TCP
取付のための最後の工程で除去するためセル10から分
離される。
路5をつくり、TCP取付のためのTCP取付パッド2
に連結される各ラインと短絡回路5とを連結して短絡さ
せる。この状態において工程が進行されるため前記静電
気による被害を縮めて不良を減少できるが、TCP取付
の際にセル10から除去するため前記短絡回路5がある
部分7を短絡回路分離線3を用いてカッティングする。
あった短絡回路5を除去しなければならないので、前記
短絡回路5のある部分7をカッティングすることは必須
であるが、この場合各セル10当りのセル10の材料で
あるグラス基板を占める面積が増加し、この基板18当
りのセル10の取得数が減少することになる。これに対
し、本発明に従うと、カッティングして捨てる部分がな
いように短絡回路5′を配線したため、前記各セル10
が占有する面積を縮小してグラス基板18当りのセル1
0の取得数を増すことができる。
るためのカッティング前の液晶表示素子の静電気防止回
路の詳細図であり、図6は本発明の実施例に従うセルを
分離するためのカッティング以後の液晶表示素子の静電
気防止回路の詳細図である。すなわち、前記した構成の
如く各セル11の内部のTCP取付パッド2の間を連結
するライン2′の間をZ字状に相互連結し、前記連結に
よって連続され、1面に存在し比較的長い距離をもって
離れている二つの部分を連結する短絡線連結部8を置き
従来の短絡回路5のように1面のTCP取付パッド2を
つなぐ連結ライン2′すべてを短絡させる。
ライン2′の間を短絡し短絡回路分離線3をカッティン
グして各セル11を分けると図6に示すように、短絡回
路5′が自動的に分離されて実質的に短絡のための連結
がなされない。従って、短絡回路5′を分離するための
カッティング過程が不要になって工程が簡単になる。
液晶表示素子を配置したレイアウトを参考にして本発明
の実施例に従うグラス基板当りのセルの取得数を比較す
る。 グラス基板のサイズ:300mm*400mm 液晶表示素子画面1のサイズ:60mm*45mm(2.
95″対角サイズ) 工程最後(TCP実装前)のセル3のサイズ:74mm
*59mm 短絡回路5を除去する前のセル4のサイズ:84mm*
69mm 短絡回路部分7を除去する従来の液晶表示素子の静電
気防止回路で前記条件によるセル10の取得数:グラス
基板18当り16個のセル10取得 本発明の実施例に従う液晶表示素子の静電気防止回路
で前記条件によるセル11の取得数:グラス基板当り2
0個のセル11取得 上記の結果値は、各セル11当りTFTアレイ基板をカ
ッティングして切り出すには最少5mmの長さが必要であ
るので、この点を勘案した値である。
ら示すように、量産工程で1基板19に多数のセル11
を確保するための手段であって、本発明の実施例によっ
て2回のカッティングによる前記カッティングのための
長さの損失まで減少させることができ、同一の大きさの
基板19内においてセル11の取得数を増加させ、1段
階の製造工程が縮まることにより費用を節減することが
できることになる。
ル当りの基板を占める面積が増加して最初に投入して基
板に用いられるグラス当りのセルの取得数が短絡回路パ
ターンがないときに比べ減少することを防ぎ、同一の大
きさの基板内にセルの取得数を増加させて費用を節減す
るなどの効果を有する。
アウトである。
液晶表示素子の静電気防止回路を示すものである。
を配置したレイアウトである。
ッティング前の液晶表示素子の静電気防止回路を示すも
のである。
ッティング前の液晶表示素子の静電気防止回路の詳細図
である。
ッティング以後の液晶表示素子の静電気防止回路の詳細
図である。
Claims (6)
- 【請求項1】 1基板内に複数個のセルを配置して製造
する場合の液晶表示素子の静電気防止回路であって、 セルの内部にあるパッドを隣接した他のセルの内部の当
接する位置にあるパッドと連結する連結ラインと、 前記連結ラインをそれぞれ連結して連続的に配置されて
いる連結ラインすべてを短絡させる短絡線と、 前記短絡線に連結され連続的に配置される一面の2部分
の連結ラインを連結する短絡線連結部と、で構成される
ことを特徴とする液晶表示素子の静電気防止回路。 - 【請求項2】 前記連結ラインは同一の導体を用いて個
別的に連結することを特徴とする請求項1に記載の液晶
表示素子の静電気防止回路。 - 【請求項3】 前記短絡線は隣り合う連結ラインのうち
左側連結ラインの上端部と右側連結ラインの下端部とを
連結することを特徴とする請求項1に記載の液晶表示素
子の静電気防止回路。 - 【請求項4】 前記短絡線は隣り合う二つの連結ライン
の間でZ字状に連結されて前記二つの連結ラインを短絡
させることを特徴とする請求項1または3に記載の液晶
表示素子の静電気防止回路。 - 【請求項5】 前記短絡線連結部は左側の短絡線に連結
されて連続される1部分の最後の連結ラインと、右側の
短絡線に連結されて連続される他の部分の最初の連結ラ
インとを連結することを特徴とする請求項1に記載の液
晶表示素子の静電気防止回路。 - 【請求項6】 前記短絡線連結部は二つの連続される部
分間の中間部において2回90°角度で折られながら、
セルを分離する短絡回路分離線を垂直に横切って連結さ
れることを特徴とする請求項1または5に記載の液晶表
示素子の静電気防止回路。
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