JPH08320797A - プログラム制御システム - Google Patents
プログラム制御システムInfo
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- 238000012545 processing Methods 0.000 claims description 30
- 230000015654 memory Effects 0.000 abstract description 43
- 230000006870 function Effects 0.000 abstract description 15
- 238000010586 diagram Methods 0.000 description 13
- 230000005540 biological transmission Effects 0.000 description 4
- 238000004891 communication Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3818—Decoding for concurrent execution
- G06F9/3822—Parallel decoding, e.g. parallel decode units
-
- G—PHYSICS
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- G06F9/462—Saving or restoring of program or task context with multiple register sets
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Abstract
(57)【要約】
【目的】 独立した複数の処理のプログラムを１つに編
集する必要がなく、各処理の切替えパターンの変更の際
にもプログラムの再編集や再インストールの必要がない
プログラム制御システムを提供する。 【構成】 プログラムカウンタ切替制御部７は、外部か
ら通知されるプログラムカウンタ切替規則に基づき、各
被制御部４−１〜４−ｎからの命令完了信号に従い、セ
レクタ６に対してプログラムカウンタ切替指示を行な
う。セレクタ６は、プログラムカウンタ切替指示に従っ
て、プログラムカウンタ１−１〜１−ｎを選択する。選
択されたプログラムカウンタによってプログラムメモリ
２から読み出された命令は、各デコーダ３−１〜３−ｎ
でデコードされ、対応する被制御部に制御信号が出力さ
れる。被制御部は、制御信号に従い、必要なら共有化機
能部５を用いて処理を行なう。処理終了後、命令完了信
号をプログラムカウンタ切替え制御部７へ通知する。
集する必要がなく、各処理の切替えパターンの変更の際
にもプログラムの再編集や再インストールの必要がない
プログラム制御システムを提供する。 【構成】 プログラムカウンタ切替制御部７は、外部か
ら通知されるプログラムカウンタ切替規則に基づき、各
被制御部４−１〜４−ｎからの命令完了信号に従い、セ
レクタ６に対してプログラムカウンタ切替指示を行な
う。セレクタ６は、プログラムカウンタ切替指示に従っ
て、プログラムカウンタ１−１〜１−ｎを選択する。選
択されたプログラムカウンタによってプログラムメモリ
２から読み出された命令は、各デコーダ３−１〜３−ｎ
でデコードされ、対応する被制御部に制御信号が出力さ
れる。被制御部は、制御信号に従い、必要なら共有化機
能部５を用いて処理を行なう。処理終了後、命令完了信
号をプログラムカウンタ切替え制御部７へ通知する。
Description
【０００１】
【産業上の利用分野】本発明は、内部の記憶装置に格納
されているプログラムにより一連の処理が制御される被
制御手段を有し、被制御手段でそれぞれ独立に複数の処
理が行なわれるプログラム制御システムに関するもので
ある。
されているプログラムにより一連の処理が制御される被
制御手段を有し、被制御手段でそれぞれ独立に複数の処
理が行なわれるプログラム制御システムに関するもので
ある。
【０００２】
【従来の技術】図２は、一般的なプログラム制御システ
ムの基本構成図である。図中、１１はプログラムカウン
タ、１２はプログラムメモリ、１３はデコーダ、１４は
被制御部である。図２には、単一の処理（処理番号＃
１）を行なうシステムを示している。プログラムカウン
タ１１は、読み出すプログラムのメモリ・アドレスを指
定する。プログラムメモリ１２は、プログラムを記憶す
る。図２中の＃１−（１），（２），（３），・・・が
プログラムの内容、即ち、命令を示している。デコーダ
１３は、命令を解釈し、制御信号に変換する。被制御部
１４は、制御信号に従い、処理を行なう。１つの命令の
実行が完了すると、被制御部１４は完了信号をプログラ
ムカウンタ１１へ通知する。プログラムカウンタ１１
は、被制御部１４からの完了信号を受けて、メモリ・ア
ドレスを次の値に更新する。
ムの基本構成図である。図中、１１はプログラムカウン
タ、１２はプログラムメモリ、１３はデコーダ、１４は
被制御部である。図２には、単一の処理（処理番号＃
１）を行なうシステムを示している。プログラムカウン
タ１１は、読み出すプログラムのメモリ・アドレスを指
定する。プログラムメモリ１２は、プログラムを記憶す
る。図２中の＃１−（１），（２），（３），・・・が
プログラムの内容、即ち、命令を示している。デコーダ
１３は、命令を解釈し、制御信号に変換する。被制御部
１４は、制御信号に従い、処理を行なう。１つの命令の
実行が完了すると、被制御部１４は完了信号をプログラ
ムカウンタ１１へ通知する。プログラムカウンタ１１
は、被制御部１４からの完了信号を受けて、メモリ・ア
ドレスを次の値に更新する。
【０００３】図２に示すシステムでは、被制御部１４が
一つであり、単一の処理を行なうのみである。被制御部
が複数存在し、その各々の被制御部が独立した処理を行
なうシステムも存在する。その場合、すべての独立した
処理を制御するプログラム制御システムの形態として、
以下のような従来方式が提案されている。
一つであり、単一の処理を行なうのみである。被制御部
が複数存在し、その各々の被制御部が独立した処理を行
なうシステムも存在する。その場合、すべての独立した
処理を制御するプログラム制御システムの形態として、
以下のような従来方式が提案されている。
【０００４】まず、処理ごとにシステム全体を独立に設
ける方式がある。図３は、従来のプログラム制御システ
ムの一例の説明図である。図中、２１，２１−１，２１
−２，・・・，２１−ｎはプログラムカウンタ、２２，
２２−１，２２−２，・・・，２２−ｎはプログラムメ
モリ、２３，２３−１，２３−２，・・・，２３−ｎは
デコーダ、２４，２４−１，２４−２，・・・，２４−
ｎは被制御部である。図３に示した構成は、例えば、特
開昭６２−１６８２３１号公報等に記載されている。
ける方式がある。図３は、従来のプログラム制御システ
ムの一例の説明図である。図中、２１，２１−１，２１
−２，・・・，２１−ｎはプログラムカウンタ、２２，
２２−１，２２−２，・・・，２２−ｎはプログラムメ
モリ、２３，２３−１，２３−２，・・・，２３−ｎは
デコーダ、２４，２４−１，２４−２，・・・，２４−
ｎは被制御部である。図３に示した構成は、例えば、特
開昭６２−１６８２３１号公報等に記載されている。
【０００５】この構成では、ｎ個の被制御部２４−１，
２４−２，・・・２４−ｎに対応して、ｎ個のプログラ
ムカウンタ、ｎ個のプログラムメモリ、ｎ個のデコーダ
を有している。そして、ｉ番目の処理については、プロ
グラムカウンタ２１−ｉ、プログラムメモリ２２−ｉ、
デコーダ２３−ｉ、被制御部２４−ｉにより実行され
る。このように、個々の処理については、図２と同様に
それぞれのプログラムカウンタ、プログラムメモリ、デ
コーダ、被制御部を有している。そのため、システムの
構成要素を処理数に応じて全て設けることになるため、
回路規模が増大するという問題がある。
２４−２，・・・２４−ｎに対応して、ｎ個のプログラ
ムカウンタ、ｎ個のプログラムメモリ、ｎ個のデコーダ
を有している。そして、ｉ番目の処理については、プロ
グラムカウンタ２１−ｉ、プログラムメモリ２２−ｉ、
デコーダ２３−ｉ、被制御部２４−ｉにより実行され
る。このように、個々の処理については、図２と同様に
それぞれのプログラムカウンタ、プログラムメモリ、デ
コーダ、被制御部を有している。そのため、システムの
構成要素を処理数に応じて全て設けることになるため、
回路規模が増大するという問題がある。
【０００６】別の方式として、プログラムを時分割でデ
コーダに与える方式がある。図４は、従来のプログラム
制御システムの別の例の説明図である。図中、３１はプ
ログラムカウンタ、３２はプログラムメモリ、３３−
１，３３−２，・・・，３３−ｎはデコーダ、３４−
１，３４−２，・・・，３４−ｎは被制御部、３５は共
有化機能部である。図４に示した構成は、例えば、特開
昭６２−１６８２３１号公報等に記載されている。
コーダに与える方式がある。図４は、従来のプログラム
制御システムの別の例の説明図である。図中、３１はプ
ログラムカウンタ、３２はプログラムメモリ、３３−
１，３３−２，・・・，３３−ｎはデコーダ、３４−
１，３４−２，・・・，３４−ｎは被制御部、３５は共
有化機能部である。図４に示した構成は、例えば、特開
昭６２−１６８２３１号公報等に記載されている。
【０００７】この方式では、デコーダ３３−１，３３−
２，・・・，３３−ｎおよび被制御部３４−１，３４−
２，・・・，３４−ｎは処理ごとに設けられており、各
被制御部３４−１，３４−２，・・・，３４−ｎに共通
のプログラムカウンタ３１およびプログラムメモリ３２
を有している。そして、プログラムメモリ３２から読み
出された各処理の命令は、各デコーダ３３−１，３３−
２，・・・，３３−ｎが時分割で受け取る。さらに、各
処理が時分割で実行されるため、状態保持を必要とせず
に実行可能な各処理間に共通した機能は、共有化するこ
とができる。共有化機能部３４は、このような各処理間
に共通した機能について処理を行なう。このように、こ
の方式では、プログラムメモリ３２が１つとなり、共有
化機能部３４を共有するので、上述の図３に示した方式
と比較して回路規模を小さくすることができる。
２，・・・，３３−ｎおよび被制御部３４−１，３４−
２，・・・，３４−ｎは処理ごとに設けられており、各
被制御部３４−１，３４−２，・・・，３４−ｎに共通
のプログラムカウンタ３１およびプログラムメモリ３２
を有している。そして、プログラムメモリ３２から読み
出された各処理の命令は、各デコーダ３３−１，３３−
２，・・・，３３−ｎが時分割で受け取る。さらに、各
処理が時分割で実行されるため、状態保持を必要とせず
に実行可能な各処理間に共通した機能は、共有化するこ
とができる。共有化機能部３４は、このような各処理間
に共通した機能について処理を行なう。このように、こ
の方式では、プログラムメモリ３２が１つとなり、共有
化機能部３４を共有するので、上述の図３に示した方式
と比較して回路規模を小さくすることができる。
【０００８】図５、図６は、被制御部の動作順序の一例
の説明図である。この方式では、プログラムカウンタ３
１が１つであるため、プログラムメモリ３２に格納され
ているプログラムは、各デコーダ３３−１，３３−２，
・・・，３３−ｎに渡す順に並べられていなければなら
ない。例えば、図５に示すように、ｎ個の独立処理（処
理番号＃１〜＃ｎ）が１命令ごとに切り替わり、順次実
行される場合を考える。この場合、図４に示すように、
プログラムメモリ３２には、まず処理番号＃１の１番目
の命令が格納され、次に処理番号＃２の１番目の命令が
格納されていなくてはならない。同様に、処理番号＃ｎ
の１番目の命令までが順に格納された後、処理番号＃１
の２番目の命令から処理番号＃ｎの２番目の命令が並ぶ
ことになる。このように並べておけば、プログラムカウ
ンタ３１が順にプログラムを取り出し、デコーダ３３−
１，３３−２，・・・，３３−ｎに順に渡すことによっ
て、図５に示すような順序で各被制御部３４−１，３４
−２，・・・，３４−ｎが動作することができる。
の説明図である。この方式では、プログラムカウンタ３
１が１つであるため、プログラムメモリ３２に格納され
ているプログラムは、各デコーダ３３−１，３３−２，
・・・，３３−ｎに渡す順に並べられていなければなら
ない。例えば、図５に示すように、ｎ個の独立処理（処
理番号＃１〜＃ｎ）が１命令ごとに切り替わり、順次実
行される場合を考える。この場合、図４に示すように、
プログラムメモリ３２には、まず処理番号＃１の１番目
の命令が格納され、次に処理番号＃２の１番目の命令が
格納されていなくてはならない。同様に、処理番号＃ｎ
の１番目の命令までが順に格納された後、処理番号＃１
の２番目の命令から処理番号＃ｎの２番目の命令が並ぶ
ことになる。このように並べておけば、プログラムカウ
ンタ３１が順にプログラムを取り出し、デコーダ３３−
１，３３−２，・・・，３３−ｎに順に渡すことによっ
て、図５に示すような順序で各被制御部３４−１，３４
−２，・・・，３４−ｎが動作することができる。
【０００９】しかし、この方式によって図５に示すよう
に動作させるには、各処理のプログラムを、図４のプロ
グラムメモリ３２に示すような順序の１つのプログラム
に編集する必要がある。また、例えば、図５に示すよう
な１命令ごとの切替えを、図６に示すような２命令ごと
の切替えに変更したい場合のように、複数処理の切替え
パターンを変更したい場合、プログラムの再編集が必要
となる。また、その再編集したプログラムを格納したＲ
ＯＭ等のプログラムメモリを交換したり、あるいはシス
テムにダウンロードするなど、システムへの再インスト
ールが必要である。同様に、デバッグ時など、ある一つ
の処理のみを実行させてその動作を確認したい場合に
も、デバッグ専用のプログラムを編集してインストール
する必要がある。
に動作させるには、各処理のプログラムを、図４のプロ
グラムメモリ３２に示すような順序の１つのプログラム
に編集する必要がある。また、例えば、図５に示すよう
な１命令ごとの切替えを、図６に示すような２命令ごと
の切替えに変更したい場合のように、複数処理の切替え
パターンを変更したい場合、プログラムの再編集が必要
となる。また、その再編集したプログラムを格納したＲ
ＯＭ等のプログラムメモリを交換したり、あるいはシス
テムにダウンロードするなど、システムへの再インスト
ールが必要である。同様に、デバッグ時など、ある一つ
の処理のみを実行させてその動作を確認したい場合に
も、デバッグ専用のプログラムを編集してインストール
する必要がある。
【００１０】
【発明が解決しようとする課題】本発明は、上述した事
情に鑑みてなされたもので、独立した複数の処理をプロ
グラム制御システムにより実行する際に、各処理のプロ
グラムを１つのプログラムへ編集する必要がなく、各処
理の切替えパターンの変更を行ないたい場合にも、プロ
グラムの再編集や再インストールの必要がないシステム
を回路規模を増大させずに実現することを目的とするも
のである。
情に鑑みてなされたもので、独立した複数の処理をプロ
グラム制御システムにより実行する際に、各処理のプロ
グラムを１つのプログラムへ編集する必要がなく、各処
理の切替えパターンの変更を行ないたい場合にも、プロ
グラムの再編集や再インストールの必要がないシステム
を回路規模を増大させずに実現することを目的とするも
のである。
【００１１】
【課題を解決するための手段】本発明は、プログラムに
より一連の処理が制御される被制御手段を有し、該被制
御手段でそれぞれ独立に複数の処理が行なわれるプログ
ラム制御システムにおいて、前記被制御手段で行なわれ
る処理を制御するプログラムが格納される共通の記憶手
段と、前記複数の処理にそれぞれ対応して設けられ前記
記憶手段からプログラムを読み出すアドレスを発生する
複数のプログラムカウンタと、前記複数のプログラムカ
ウンタの出力から１つを選択し前記記憶手段に供給する
選択手段を備えていることを特徴とするものである。
より一連の処理が制御される被制御手段を有し、該被制
御手段でそれぞれ独立に複数の処理が行なわれるプログ
ラム制御システムにおいて、前記被制御手段で行なわれ
る処理を制御するプログラムが格納される共通の記憶手
段と、前記複数の処理にそれぞれ対応して設けられ前記
記憶手段からプログラムを読み出すアドレスを発生する
複数のプログラムカウンタと、前記複数のプログラムカ
ウンタの出力から１つを選択し前記記憶手段に供給する
選択手段を備えていることを特徴とするものである。
【００１２】前記被制御手段においては、それぞれ独立
に複数の処理が行なわれるが、特に請求項２に記載の発
明のように、複数の処理にそれぞれ対応した複数の個別
被制御手段を有する構成とすることができる。このと
き、請求項３に記載の発明のように、前記被制御手段
は、前記複数の処理に共通する部分の処理を行なう共有
化機能手段を有する構成とすることができる。
に複数の処理が行なわれるが、特に請求項２に記載の発
明のように、複数の処理にそれぞれ対応した複数の個別
被制御手段を有する構成とすることができる。このと
き、請求項３に記載の発明のように、前記被制御手段
は、前記複数の処理に共通する部分の処理を行なう共有
化機能手段を有する構成とすることができる。
【００１３】また、請求項４に記載の発明のように、前
記被制御手段からの制御信号に基づき前記選択手段を制
御するプログラムカウンタ切り替え制御手段を有する構
成とすることもできる。
記被制御手段からの制御信号に基づき前記選択手段を制
御するプログラムカウンタ切り替え制御手段を有する構
成とすることもできる。
【００１４】さらに、請求項５に記載の発明のように、
与えられた切り替え規則に従って前記選択手段を制御す
るプログラムカウンタ切り替え制御手段を有する構成と
することもできる。
与えられた切り替え規則に従って前記選択手段を制御す
るプログラムカウンタ切り替え制御手段を有する構成と
することもできる。
【００１５】
【作用】本発明によれば、独立した複数の処理を実行す
るプログラム制御システムにおいて、それぞれの処理に
対応したプログラムカウンタを設け、これらのプログラ
ムカウンタを選択手段で切り替えて共通のプログラムメ
モリをアクセスするように構成している。そのため、プ
ログラムメモリは１つでよく、例えば、図３に示した従
来のシステムと比較して回路規模を小さくすることがで
きる。また、例えば、図４に示した従来のシステムと比
較しても、プログラムカウンタおよび選択回路の増加だ
けであるので、回路規模はそれほど増加しない。被制御
手段は、請求項２に記載の発明のように、複数の処理に
それぞれ対応した複数の個別被制御手段を有する構成と
することができるが、このとき、請求項３に記載の発明
のように、複数の処理に共通する部分の処理を行なう共
有化機能手段を有する構成とすることによっても、回路
規模の減少を図ることができる。
るプログラム制御システムにおいて、それぞれの処理に
対応したプログラムカウンタを設け、これらのプログラ
ムカウンタを選択手段で切り替えて共通のプログラムメ
モリをアクセスするように構成している。そのため、プ
ログラムメモリは１つでよく、例えば、図３に示した従
来のシステムと比較して回路規模を小さくすることがで
きる。また、例えば、図４に示した従来のシステムと比
較しても、プログラムカウンタおよび選択回路の増加だ
けであるので、回路規模はそれほど増加しない。被制御
手段は、請求項２に記載の発明のように、複数の処理に
それぞれ対応した複数の個別被制御手段を有する構成と
することができるが、このとき、請求項３に記載の発明
のように、複数の処理に共通する部分の処理を行なう共
有化機能手段を有する構成とすることによっても、回路
規模の減少を図ることができる。
【００１６】また、本発明では、それぞれの処理に対応
したプログラムカウンタを用いるので、プログラムメモ
リに格納されるそれぞれの処理のプログラムは、例え
ば、図４に示したような従来のシステムのように編集す
る必要はなく、個々の処理のプログラムを順番にプログ
ラムメモリ内に配置すればよい。そのため、例えば、請
求項５に記載の発明のように、与えられた切り替え規則
に従って行なう場合に、その切り替え規則を変更して処
理の切り替えパターンを変更する場合でも、プログラム
メモリに格納されているプログラムの再編集および再イ
ンストールは必要なく、切り替え規則に従って選択手段
を制御し、プログラムカウンタを選択するのみで実現す
ることができる。なお、切り替え規則の変更は、システ
ム動作中であっても可能である。また、選択手段による
プログラムカウンタの切り替えのタイミング制御は、例
えば、請求項４に記載の発明のように、被制御手段から
の制御信号に基づいて行なうことができる。
したプログラムカウンタを用いるので、プログラムメモ
リに格納されるそれぞれの処理のプログラムは、例え
ば、図４に示したような従来のシステムのように編集す
る必要はなく、個々の処理のプログラムを順番にプログ
ラムメモリ内に配置すればよい。そのため、例えば、請
求項５に記載の発明のように、与えられた切り替え規則
に従って行なう場合に、その切り替え規則を変更して処
理の切り替えパターンを変更する場合でも、プログラム
メモリに格納されているプログラムの再編集および再イ
ンストールは必要なく、切り替え規則に従って選択手段
を制御し、プログラムカウンタを選択するのみで実現す
ることができる。なお、切り替え規則の変更は、システ
ム動作中であっても可能である。また、選択手段による
プログラムカウンタの切り替えのタイミング制御は、例
えば、請求項４に記載の発明のように、被制御手段から
の制御信号に基づいて行なうことができる。
【００１７】
【実施例】図１は、本発明のプログラム制御システムの
一実施例を示す構成図である。図中、１−１〜１−ｎは
プログラムカウンタ、２はプログラムメモリ、３−１〜
３−ｎはデコーダ、４−１〜４−ｎは被制御部、５は共
有化機能部、６はセレクタ、７はプログラムカウンタ切
替制御部、８はＣＰＵインタフェース部である。
一実施例を示す構成図である。図中、１−１〜１−ｎは
プログラムカウンタ、２はプログラムメモリ、３−１〜
３−ｎはデコーダ、４−１〜４−ｎは被制御部、５は共
有化機能部、６はセレクタ、７はプログラムカウンタ切
替制御部、８はＣＰＵインタフェース部である。
【００１８】このプログラム制御システムは、独立した
処理を実行するｎ個の被制御部４−１〜４−ｎを有して
いる。プログラムカウンタ１−１〜１−ｎは、各被制御
部４−１〜４−ｎに対応して設けられ、それぞれの被制
御部４−１〜４−ｎが実行すべきプログラムメモリ２中
のプログラムを指し示している。プログラムメモリ２に
は、複数の処理のプログラムが、個々の処理ごとに格納
されている。デコーダ３−１〜３−ｎは、各処理ごとに
複数設けられ、プログラムメモリ２から出力される命令
を制御信号に変換する。被制御部４−１〜４−ｎは、そ
れぞれ対応するデコーダ３−１〜３−ｎから出力される
制御信号に従って処理を行なう。処理終了後は、命令完
了信号をプログラムカウンタ切替制御部７に送る。共有
化機能部５は、各処理間に共通して必要な機能について
の処理を行なう。
処理を実行するｎ個の被制御部４−１〜４−ｎを有して
いる。プログラムカウンタ１−１〜１−ｎは、各被制御
部４−１〜４−ｎに対応して設けられ、それぞれの被制
御部４−１〜４−ｎが実行すべきプログラムメモリ２中
のプログラムを指し示している。プログラムメモリ２に
は、複数の処理のプログラムが、個々の処理ごとに格納
されている。デコーダ３−１〜３−ｎは、各処理ごとに
複数設けられ、プログラムメモリ２から出力される命令
を制御信号に変換する。被制御部４−１〜４−ｎは、そ
れぞれ対応するデコーダ３−１〜３−ｎから出力される
制御信号に従って処理を行なう。処理終了後は、命令完
了信号をプログラムカウンタ切替制御部７に送る。共有
化機能部５は、各処理間に共通して必要な機能について
の処理を行なう。
【００１９】セレクタ６は、複数のプログラムカウンタ
１−１〜１−ｎの出力から１つを選択し、プログラムメ
モリに供給する。プログラムカウンタ切替制御部７は、
プログラムカウンタ切替規則に基づき、各被制御部４−
１〜４−ｎからの命令完了信号に従って、セレクタ６に
よるプログラムカウンタ１−１〜１−ｎの切り替えを制
御する。ＣＰＵインタフェース部８は、外部のＣＰＵ等
から指定されるプログラムカウンタ切替規則を、プログ
ラムカウンタ切替え制御部７に与える。
１−１〜１−ｎの出力から１つを選択し、プログラムメ
モリに供給する。プログラムカウンタ切替制御部７は、
プログラムカウンタ切替規則に基づき、各被制御部４−
１〜４−ｎからの命令完了信号に従って、セレクタ６に
よるプログラムカウンタ１−１〜１−ｎの切り替えを制
御する。ＣＰＵインタフェース部８は、外部のＣＰＵ等
から指定されるプログラムカウンタ切替規則を、プログ
ラムカウンタ切替え制御部７に与える。
【００２０】次に、本発明のプログラム制御システムの
一実施例における動作の一例を説明する。まず、外部の
ＣＰＵ等からＣＰＵインタフェース部８に対してプログ
ラムカウンタ切替規則が通知される。ＣＰＵインタフェ
ース部８は、入力されたプログラムカウンタ切替規則を
プログラムカウンタ切替制御部７に渡す。プログラムカ
ウンタ切替規則を受け取ったプログラムカウンタ切替制
御部７は、各被制御部４−１〜４−ｎからの命令完了信
号に従って、セレクタ６に対してプログラムカウンタ切
替指示を行なう。プログラムカウンタ切替指示を受けた
セレクタ６は、その指示に従って、複数のプログラムカ
ウンタ１−１〜１−ｎの出力から１つを選択し、選択し
たプログラムカウンタの出力をプログラムメモリ２にア
ドレスとして供給する。プログラムメモリ２では、各プ
ログラムカウンタ１−１〜１−ｎの出力が示すメモリ・
アドレスに、各処理のプログラムが配置されており、他
のプログラムカウンタの出力が示すメモリ・アドレスに
は配置されていない。そのため、選択したプログラムカ
ウンタに対応した処理のプログラムがプログラムメモリ
２から読み出される。例えば、セレクタ６がｉ番目のプ
ログラムカウンタ、すなわちプログラムカウンタ１−ｉ
を選択している場合、プログラムカウンタ１−ｉの出力
がプログラムメモリ２に供給され、処理＃ｉのプログラ
ムの１つがプログラムメモリ２から出力される。
一実施例における動作の一例を説明する。まず、外部の
ＣＰＵ等からＣＰＵインタフェース部８に対してプログ
ラムカウンタ切替規則が通知される。ＣＰＵインタフェ
ース部８は、入力されたプログラムカウンタ切替規則を
プログラムカウンタ切替制御部７に渡す。プログラムカ
ウンタ切替規則を受け取ったプログラムカウンタ切替制
御部７は、各被制御部４−１〜４−ｎからの命令完了信
号に従って、セレクタ６に対してプログラムカウンタ切
替指示を行なう。プログラムカウンタ切替指示を受けた
セレクタ６は、その指示に従って、複数のプログラムカ
ウンタ１−１〜１−ｎの出力から１つを選択し、選択し
たプログラムカウンタの出力をプログラムメモリ２にア
ドレスとして供給する。プログラムメモリ２では、各プ
ログラムカウンタ１−１〜１−ｎの出力が示すメモリ・
アドレスに、各処理のプログラムが配置されており、他
のプログラムカウンタの出力が示すメモリ・アドレスに
は配置されていない。そのため、選択したプログラムカ
ウンタに対応した処理のプログラムがプログラムメモリ
２から読み出される。例えば、セレクタ６がｉ番目のプ
ログラムカウンタ、すなわちプログラムカウンタ１−ｉ
を選択している場合、プログラムカウンタ１−ｉの出力
がプログラムメモリ２に供給され、処理＃ｉのプログラ
ムの１つがプログラムメモリ２から出力される。
【００２１】各デコーダ３−１〜３−ｎは、プログラム
メモリ２から出力される命令のデコードを行なう。デコ
ードした命令がそのデコーダに対応する被制御部の処理
に対する実行指示であると解釈した場合には、その命令
に対応した制御信号を被制御部に対して出力する。他の
被制御部で行なう処理に対する実行指示であると解釈し
た場合には、何も出力しない。各被制御部４−１〜４−
ｎは、各デコーダ３−１〜３−ｎからの制御信号に従っ
てそれぞれの処理を行なう。その際、必要に応じて共有
化機能部５を用いる。処理が終了すると、命令完了信号
をプログラムカウンタ切替え制御部７へ通知する。
メモリ２から出力される命令のデコードを行なう。デコ
ードした命令がそのデコーダに対応する被制御部の処理
に対する実行指示であると解釈した場合には、その命令
に対応した制御信号を被制御部に対して出力する。他の
被制御部で行なう処理に対する実行指示であると解釈し
た場合には、何も出力しない。各被制御部４−１〜４−
ｎは、各デコーダ３−１〜３−ｎからの制御信号に従っ
てそれぞれの処理を行なう。その際、必要に応じて共有
化機能部５を用いる。処理が終了すると、命令完了信号
をプログラムカウンタ切替え制御部７へ通知する。
【００２２】以上のように、このプログラム制御システ
ムでは、プログラムカウンタ１−１〜１−ｎを切り替え
ることにより、複数の処理が時分割で実行される。
ムでは、プログラムカウンタ１−１〜１−ｎを切り替え
ることにより、複数の処理が時分割で実行される。
【００２３】以下、具体例を用いて上述の動作を説明す
る。ここでは一例として、上述の図５に示すように、各
処理を１命令づつ順次実行する場合について説明する。
まず、外部のＣＰＵ等からＣＰＵインタフェース部８を
介してプログラムカウンタ切替制御部７へプログラムカ
ウンタ切替規則が通知される。この例の場合、「プログ
ラムカウンタを１命令づつ順次切り替える」旨のプログ
ラムカウンタ切替規則が通知される。以下の説明では、
通知されるプログラムカウンタ切替規則を各処理の命令
数比で表わすことにする。ここでは、具体的には「＃
１：＃２：＃３：・・・：＃ｎ＝１：１：１：・・・：
１」というプログラムカウンタ切替規則が通知される。
る。ここでは一例として、上述の図５に示すように、各
処理を１命令づつ順次実行する場合について説明する。
まず、外部のＣＰＵ等からＣＰＵインタフェース部８を
介してプログラムカウンタ切替制御部７へプログラムカ
ウンタ切替規則が通知される。この例の場合、「プログ
ラムカウンタを１命令づつ順次切り替える」旨のプログ
ラムカウンタ切替規則が通知される。以下の説明では、
通知されるプログラムカウンタ切替規則を各処理の命令
数比で表わすことにする。ここでは、具体的には「＃
１：＃２：＃３：・・・：＃ｎ＝１：１：１：・・・：
１」というプログラムカウンタ切替規則が通知される。
【００２４】通知を受けたプログラムカウンタ切替制御
部７は、最初にセレクタ６がプログラムカウンタ１−１
を選択するようにセレクタ６に対してプログラムカウン
タ切替指示を行なう。プログラムカウンタ切替え指示を
受けたセレクタ６は、指示に従ってプログラムカウンタ
１−１の出力を選択し、プログラムメモリ２にアドレス
として供給する。このとき、プログラムカウンタ１−１
のアドレスが図１のプログラムメモリ２のうち、命令＃
１−（１）を指し示しているとすれば、これがプログラ
ムメモリ２から読み出され、デコーダ３−１〜３−ｎに
入力される。デコーダ３−１は、この命令＃１−（１）
をデコードして制御信号を被制御部４−１に対して出力
する。被制御部４−１は、デコーダ３−１からの制御信
号に従って処理を行なう。その際、必要に応じて共有化
機能部５を用いる。処理が終了すると、命令完了信号を
プログラムカウンタ切替え制御部７へ通知する。
部７は、最初にセレクタ６がプログラムカウンタ１−１
を選択するようにセレクタ６に対してプログラムカウン
タ切替指示を行なう。プログラムカウンタ切替え指示を
受けたセレクタ６は、指示に従ってプログラムカウンタ
１−１の出力を選択し、プログラムメモリ２にアドレス
として供給する。このとき、プログラムカウンタ１−１
のアドレスが図１のプログラムメモリ２のうち、命令＃
１−（１）を指し示しているとすれば、これがプログラ
ムメモリ２から読み出され、デコーダ３−１〜３−ｎに
入力される。デコーダ３−１は、この命令＃１−（１）
をデコードして制御信号を被制御部４−１に対して出力
する。被制御部４−１は、デコーダ３−１からの制御信
号に従って処理を行なう。その際、必要に応じて共有化
機能部５を用いる。処理が終了すると、命令完了信号を
プログラムカウンタ切替え制御部７へ通知する。
【００２５】プログラムカウンタ切替制御部７は、被制
御部４−１からの命令完了信号を受けると、セレクタ６
がプログラムカウンタ１−２を選択するように、セレク
タ６に対してプログラムカウンタ切替指示を行なう。セ
レクタ６は、指示に従ってプログラムカウンタ１−２の
出力を選択し、プログラムメモリ２にアドレスとして供
給する。プログラムカウンタ１−２は、被制御部４−２
が実行すべきプログラムの先頭のアドレスが設定されて
いるので、命令＃２−（１）が読み出され、デコーダ３
−２から被制御部４−２へ制御信号が出力されて、被制
御部４−２で制御信号に従った処理が実行される。処理
が終了すると、命令完了信号がプログラムカウンタ切替
制御部７へ通知される。
御部４−１からの命令完了信号を受けると、セレクタ６
がプログラムカウンタ１−２を選択するように、セレク
タ６に対してプログラムカウンタ切替指示を行なう。セ
レクタ６は、指示に従ってプログラムカウンタ１−２の
出力を選択し、プログラムメモリ２にアドレスとして供
給する。プログラムカウンタ１−２は、被制御部４−２
が実行すべきプログラムの先頭のアドレスが設定されて
いるので、命令＃２−（１）が読み出され、デコーダ３
−２から被制御部４−２へ制御信号が出力されて、被制
御部４−２で制御信号に従った処理が実行される。処理
が終了すると、命令完了信号がプログラムカウンタ切替
制御部７へ通知される。
【００２６】以下、同様にして、被制御部４−１〜４−
ｎからの命令完了信号がプログラムカウンタ切替制御部
７へ通知されるたびに、プログラムカウンタ切替制御部
７はプログラムカウンタ切替指示をセレクタ６に対して
行ない、プログラムカウンタ１−１〜１−ｎが順次選択
され、被制御部４−１〜４−ｎにおいて処理が順次行な
われる。プログラムカウンタ１−１〜１−ｎは、指し示
している命令が実行されるごとに次の命令を指し示すよ
うに構成されており、プログラムカウンタ１−１〜１−
ｎが順次選択されて命令＃１−（１）〜＃ｎ−（１）が
実行された後は、再びプログラムカウンタ１−１が選択
されて次の命令＃１−（２）が実行され、順次＃２−
（２），・・・，＃ｎ−（ｍn ）が実行される。
ｎからの命令完了信号がプログラムカウンタ切替制御部
７へ通知されるたびに、プログラムカウンタ切替制御部
７はプログラムカウンタ切替指示をセレクタ６に対して
行ない、プログラムカウンタ１−１〜１−ｎが順次選択
され、被制御部４−１〜４−ｎにおいて処理が順次行な
われる。プログラムカウンタ１−１〜１−ｎは、指し示
している命令が実行されるごとに次の命令を指し示すよ
うに構成されており、プログラムカウンタ１−１〜１−
ｎが順次選択されて命令＃１−（１）〜＃ｎ−（１）が
実行された後は、再びプログラムカウンタ１−１が選択
されて次の命令＃１−（２）が実行され、順次＃２−
（２），・・・，＃ｎ−（ｍn ）が実行される。
【００２７】次に、処理の切替えパターンを図６に示す
ように各処理を２命令ずつ順次実行としたい場合を考え
る。この場合には、プログラムカウンタ切替制御部７に
対し、プログラムカウンタ切替規則として「＃１：＃
２：＃３：・・・：＃ｎ＝２：２：２：・・・：２」と
通知すればよい。プログラムカウンタ切替制御部７は、
最初にプログラムカウンタ１−１の出力を選択するよう
にセレクタ６に対してプログラムカウンタ切替指示を行
なう。これにより、被制御部４−１は命令＃１−（１）
を実行する。被制御部４−１から命令完了信号を受ける
と、プログラムカウンタ切替制御部７は命令完了信号を
内部のカウンタでカウントし、この時点ではプログラム
カウンタ切替指示を行なわない。すると、プログラムカ
ウンタ１−１は、次の命令のアドレスをプログラムメモ
リ２に出力し、被制御部４−１は命令＃１−（２）を実
行する。プログラムカウンタ切替制御部７は、被制御部
４−１から２回目の命令完了信号を受けると、セレクタ
６に対してプログラムカウンタ切替指示を行ない、プロ
グラムカウンタ１−２の出力を選択するように切り替え
られる。これにより、被制御部４−２が２命令について
動作する。同様にして、被制御部４−３〜４−ｎについ
ても２命令ずつ実行する。このような動作が繰り返し行
なわれることになる。
ように各処理を２命令ずつ順次実行としたい場合を考え
る。この場合には、プログラムカウンタ切替制御部７に
対し、プログラムカウンタ切替規則として「＃１：＃
２：＃３：・・・：＃ｎ＝２：２：２：・・・：２」と
通知すればよい。プログラムカウンタ切替制御部７は、
最初にプログラムカウンタ１−１の出力を選択するよう
にセレクタ６に対してプログラムカウンタ切替指示を行
なう。これにより、被制御部４−１は命令＃１−（１）
を実行する。被制御部４−１から命令完了信号を受ける
と、プログラムカウンタ切替制御部７は命令完了信号を
内部のカウンタでカウントし、この時点ではプログラム
カウンタ切替指示を行なわない。すると、プログラムカ
ウンタ１−１は、次の命令のアドレスをプログラムメモ
リ２に出力し、被制御部４−１は命令＃１−（２）を実
行する。プログラムカウンタ切替制御部７は、被制御部
４−１から２回目の命令完了信号を受けると、セレクタ
６に対してプログラムカウンタ切替指示を行ない、プロ
グラムカウンタ１−２の出力を選択するように切り替え
られる。これにより、被制御部４−２が２命令について
動作する。同様にして、被制御部４−３〜４−ｎについ
ても２命令ずつ実行する。このような動作が繰り返し行
なわれることになる。
【００２８】このように、プログラムカウンタ切替規則
の設定によって、１つの処理に与える時間を任意に設定
することができる。図７、図８は、被制御部の動作順序
の別の例の説明図である。図７に示す例では、被制御部
４−１と被制御部４−２の処理のみを１：３の比率で行
なう場合を示している。この場合には、プログラムカウ
ンタ切替制御部７に対してプログラムカウンタ切替規則
として「＃１：＃２：＃３：・・・：＃ｎ＝１：３：
０：・・・：０」と通知すればよい。この場合、プログ
ラムカウンタ切替制御部７は、比率が０のプログラムカ
ウンタの出力をセレクタ６が選択しないように、プログ
ラムカウンタ切替指示をセレクタ６に対して行なう。こ
のようなプログラムカウンタ切替規則を用いることによ
って、実行する処理の選択と各処理間の動作比率を任意
に設定することができる。
の設定によって、１つの処理に与える時間を任意に設定
することができる。図７、図８は、被制御部の動作順序
の別の例の説明図である。図７に示す例では、被制御部
４−１と被制御部４−２の処理のみを１：３の比率で行
なう場合を示している。この場合には、プログラムカウ
ンタ切替制御部７に対してプログラムカウンタ切替規則
として「＃１：＃２：＃３：・・・：＃ｎ＝１：３：
０：・・・：０」と通知すればよい。この場合、プログ
ラムカウンタ切替制御部７は、比率が０のプログラムカ
ウンタの出力をセレクタ６が選択しないように、プログ
ラムカウンタ切替指示をセレクタ６に対して行なう。こ
のようなプログラムカウンタ切替規則を用いることによ
って、実行する処理の選択と各処理間の動作比率を任意
に設定することができる。
【００２９】さらに、図８に示すように、ある１つの処
理のみを連続して実行したい場合には、例えば、被制御
部４−１のみを連続して実行させるときには、プログラ
ムカウンタ切替制御部７に対してプログラムカウンタ切
替規則「＃１：＃２：＃３：・・・：＃ｎ＝１：０：
０：・・・：０」を通知すればよい。これは、デバッグ
時等、一つの処理のみの動作の確認を行ないたい場合に
有効である。
理のみを連続して実行したい場合には、例えば、被制御
部４−１のみを連続して実行させるときには、プログラ
ムカウンタ切替制御部７に対してプログラムカウンタ切
替規則「＃１：＃２：＃３：・・・：＃ｎ＝１：０：
０：・・・：０」を通知すればよい。これは、デバッグ
時等、一つの処理のみの動作の確認を行ないたい場合に
有効である。
【００３０】このように、プログラムカウンタ切替制御
部７に通知するプログラムカウンタ切替規則を変更する
だけで、被制御部の選択および動作比率を変更すること
ができる。このとき、プログラムメモリ２に格納されて
いるプログラムを再編集したり、再インストールする必
要はない。以上のようなプログラムカウンタ切替規則の
変更動作は、例えば、ＣＰＵ等による指定により実現で
きるため、システム動作中の変更も可能である。例え
ば、外部のユーザインタフェースからの指示や、被制御
部４−１〜４−ｎの動作状態を監視し、最適な動作割合
を求めてプログラムカウンタ切替規則を生成することも
可能である。
部７に通知するプログラムカウンタ切替規則を変更する
だけで、被制御部の選択および動作比率を変更すること
ができる。このとき、プログラムメモリ２に格納されて
いるプログラムを再編集したり、再インストールする必
要はない。以上のようなプログラムカウンタ切替規則の
変更動作は、例えば、ＣＰＵ等による指定により実現で
きるため、システム動作中の変更も可能である。例え
ば、外部のユーザインタフェースからの指示や、被制御
部４−１〜４−ｎの動作状態を監視し、最適な動作割合
を求めてプログラムカウンタ切替規則を生成することも
可能である。
【００３１】上述のプログラムカウンタ切替規則では、
各被制御部４−１〜４−ｎの動作の有無および動作割合
しか指定できないが、これに限らず、種々の指定を可能
にすることができ、例えば各プログラムカウンタ１−１
〜１−ｎの選択順序などを指定可能に構成することもで
きる。なお、プログラムカウンタ切替規則の書式は、上
述のものに限らない。
各被制御部４−１〜４−ｎの動作の有無および動作割合
しか指定できないが、これに限らず、種々の指定を可能
にすることができ、例えば各プログラムカウンタ１−１
〜１−ｎの選択順序などを指定可能に構成することもで
きる。なお、プログラムカウンタ切替規則の書式は、上
述のものに限らない。
【００３２】上述の実施例の構成において、プログラム
カウンタ切替規則が予め決まっているようなシステムで
は、ＣＰＵインタフェース部８は不要であるし、また、
図５や図６に示したように、ある特定のパターンのみに
従ってプログラムカウンタ１−１〜１−ｎの切り替えを
行なう場合には、プログラムカウンタ切替制御部７を設
けず、セレクタ６に命令完了信号を直接入力して、切り
替えを行なうように構成してもよい。さらに、共有化機
能部５は必ずしも設ける必要はない。
カウンタ切替規則が予め決まっているようなシステムで
は、ＣＰＵインタフェース部８は不要であるし、また、
図５や図６に示したように、ある特定のパターンのみに
従ってプログラムカウンタ１−１〜１−ｎの切り替えを
行なう場合には、プログラムカウンタ切替制御部７を設
けず、セレクタ６に命令完了信号を直接入力して、切り
替えを行なうように構成してもよい。さらに、共有化機
能部５は必ずしも設ける必要はない。
【００３３】上述の説明では、各被制御部４−１〜４−
ｎは、時分割で動作するものとしたが、例えば並列的に
動作させることも可能である。この場合には、プログラ
ムカウンタ切替制御部７は、各被制御部４−１〜４−ｎ
から出力される命令完了信号を受けると、その命令完了
信号を発した被制御部に対応するプログラムカウンタの
出力を選択するように、セレクタ６に対してプログラム
カウンタ切替指示を行なうことができる。このようにす
ると、処理の速く終了した被制御部から順に次の命令を
供給して処理を続行させることができる。
ｎは、時分割で動作するものとしたが、例えば並列的に
動作させることも可能である。この場合には、プログラ
ムカウンタ切替制御部７は、各被制御部４−１〜４−ｎ
から出力される命令完了信号を受けると、その命令完了
信号を発した被制御部に対応するプログラムカウンタの
出力を選択するように、セレクタ６に対してプログラム
カウンタ切替指示を行なうことができる。このようにす
ると、処理の速く終了した被制御部から順に次の命令を
供給して処理を続行させることができる。
【００３４】上述のプログラム制御システムの応用例と
しては、例えば、通信端末への適用が考えられる。例え
ば、被制御部４−１において行なわれる処理として送信
処理とし、被制御部４−２において行なわれる処理とし
て受信処理とする。アプリケーションデータの送信時お
よび同データの受信時とも、フロー制御などのプロトコ
ル処理のために、送信処理および受信処理の両方の処理
が必要である。しかし、アプリケーションデータの送信
時には送信処理の割合が高く、逆に同データの受信時に
は受信処理の割合が高い。このような場合、上述のプロ
グラム制御システムを用いれば、アプリケーションデー
タの送信時と同データの受信時とでプログラムカウンタ
切替規則を変更し、送信処理と受信処理の動作比率を変
更することによって、効率よく処理を制御することが可
能となる。
しては、例えば、通信端末への適用が考えられる。例え
ば、被制御部４−１において行なわれる処理として送信
処理とし、被制御部４−２において行なわれる処理とし
て受信処理とする。アプリケーションデータの送信時お
よび同データの受信時とも、フロー制御などのプロトコ
ル処理のために、送信処理および受信処理の両方の処理
が必要である。しかし、アプリケーションデータの送信
時には送信処理の割合が高く、逆に同データの受信時に
は受信処理の割合が高い。このような場合、上述のプロ
グラム制御システムを用いれば、アプリケーションデー
タの送信時と同データの受信時とでプログラムカウンタ
切替規則を変更し、送信処理と受信処理の動作比率を変
更することによって、効率よく処理を制御することが可
能となる。
【００３５】
【発明の効果】以上の説明から明らかなように、本発明
によれば、独立した複数の処理が共有するプログラムメ
モリを設けているので、回路規模の増大を防ぐことがで
きるとともに、各処理に対応したプログラムカウンタを
設け、複数のプログラムカウンタを時分割で切り替えて
処理を実行するので、従来のようにプログラムそのもの
の編集を行なう必要はない。また、処理の切替えパター
ンを変更する際には、プログラムカウンタ切替規則を変
更するだけで対応可能であり、従来のようにプログラム
の再編集や再インストールの必要がない。さらに、プロ
グラムカウンタ切替規則によって各処理を行なうか否
か、および、各処理間の動作比率、１つの処理の連続実
行時間を任意に設定することができる。また、プログラ
ムカウンタ切替規則は外部からの指定によって設定また
は変更できるため、システム動作中にダイナミックに変
更を行なうことができる、等の効果がある。
によれば、独立した複数の処理が共有するプログラムメ
モリを設けているので、回路規模の増大を防ぐことがで
きるとともに、各処理に対応したプログラムカウンタを
設け、複数のプログラムカウンタを時分割で切り替えて
処理を実行するので、従来のようにプログラムそのもの
の編集を行なう必要はない。また、処理の切替えパター
ンを変更する際には、プログラムカウンタ切替規則を変
更するだけで対応可能であり、従来のようにプログラム
の再編集や再インストールの必要がない。さらに、プロ
グラムカウンタ切替規則によって各処理を行なうか否
か、および、各処理間の動作比率、１つの処理の連続実
行時間を任意に設定することができる。また、プログラ
ムカウンタ切替規則は外部からの指定によって設定また
は変更できるため、システム動作中にダイナミックに変
更を行なうことができる、等の効果がある。
【図１】 本発明のプログラム制御システムの一実施例
を示す構成図である。
を示す構成図である。
【図２】 一般的なプログラム制御システムの基本構成
図である。
図である。
【図３】 従来のプログラム制御システムの一例の説明
図である。
図である。
【図４】 従来のプログラム制御システムの別の例の説
明図である。
明図である。
【図５】 被制御部の動作順序の一例の説明図である。
【図６】 被制御部の動作順序の別の例の説明図であ
る。
る。
【図７】 被制御部の動作順序のさらに別の例の説明図
である。
である。
【図８】 被制御部の動作順序のさらに別の例の説明図
である。
である。
１−１〜１−ｎ…プログラムカウンタ、２…プログラム
メモリ、３−１〜３−ｎ…デコーダ、４−１〜４−ｎ…
被制御部、５…共有化機能部、６…セレクタ、７…プロ
グラムカウンタ切替制御部、８…ＣＰＵインタフェース
部。
メモリ、３−１〜３−ｎ…デコーダ、４−１〜４−ｎ…
被制御部、５…共有化機能部、６…セレクタ、７…プロ
グラムカウンタ切替制御部、８…ＣＰＵインタフェース
部。
Claims (5)
- 【請求項１】 プログラムにより一連の処理が制御され
る被制御手段を有し、該被制御手段でそれぞれ独立に複
数の処理が行なわれるプログラム制御システムにおい
て、前記被制御手段で行なわれる処理を制御するプログ
ラムが格納される共通の記憶手段と、前記複数の処理に
それぞれ対応して設けられ前記記憶手段からプログラム
を読み出すアドレスを発生する複数のプログラムカウン
タと、前記複数のプログラムカウンタの出力から１つを
選択し前記記憶手段に供給する選択手段を備えているこ
とを特徴とするプログラム制御システム。 - 【請求項２】 前記被制御手段は、前記複数の処理にそ
れぞれ対応した複数の個別被制御手段を有することを特
徴とする請求項１に記載のプログラム制御システム。 - 【請求項３】 前記被制御手段は、前記複数の処理に共
通する部分の処理を行なう共有化機能手段を有すること
を特徴とする請求項２に記載のプログラム制御システ
ム。 - 【請求項４】 前記被制御手段からの制御信号に基づき
前記選択手段を制御するプログラムカウンタ切り替え制
御手段を有することを特徴とする請求項１ないし３のい
ずれか１項に記載のプログラム制御システム。 - 【請求項５】 与えられた切り替え規則に従って前記選
択手段を制御するプログラムカウンタ切り替え制御手段
を有することを特徴とする請求項１ないし３のいずれか
１項に記載のプログラム制御システム。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7125355A JPH08320797A (ja) | 1995-05-24 | 1995-05-24 | プログラム制御システム |
| US08/634,732 US5761522A (en) | 1995-05-24 | 1996-04-18 | Program control system programmable to selectively execute a plurality of programs |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7125355A JPH08320797A (ja) | 1995-05-24 | 1995-05-24 | プログラム制御システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08320797A true JPH08320797A (ja) | 1996-12-03 |
Family
ID=14908086
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7125355A Pending JPH08320797A (ja) | 1995-05-24 | 1995-05-24 | プログラム制御システム |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5761522A (ja) |
| JP (1) | JPH08320797A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
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