JPH08222688A - 混成集積回路装置 - Google Patents
混成集積回路装置Info
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- JPH08222688A JPH08222688A JP2413695A JP2413695A JPH08222688A JP H08222688 A JPH08222688 A JP H08222688A JP 2413695 A JP2413695 A JP 2413695A JP 2413695 A JP2413695 A JP 2413695A JP H08222688 A JPH08222688 A JP H08222688A
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
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- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
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- H01L2224/484—Connecting portions
- H01L2224/48463—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
- H01L2224/48465—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch
Landscapes
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】
【目的】 ベアチップを搭載した混成集積回路装置に関
するもので、小型で電気的特性の優れたものを提供する
ことを目的とする。 【構成】 基板11の表面に設けた導電パターン12上
の第1のベアチップ13の上面に第2のベアチップ15
を設け、第2のベアチップ15の端子15aと導電パタ
ーン12とを導電性ワイヤー16にて電気的に接続する
ことにより、小型で電気的特性の優れた混成集積回路装
置を提供できる。
するもので、小型で電気的特性の優れたものを提供する
ことを目的とする。 【構成】 基板11の表面に設けた導電パターン12上
の第1のベアチップ13の上面に第2のベアチップ15
を設け、第2のベアチップ15の端子15aと導電パタ
ーン12とを導電性ワイヤー16にて電気的に接続する
ことにより、小型で電気的特性の優れた混成集積回路装
置を提供できる。
Description
【0001】
【産業上の利用分野】本発明は、ベアチップを搭載した
混成集積回路装置に関するものである。
混成集積回路装置に関するものである。
【0002】
【従来の技術】近年、混成集積回路装置は、小型化のた
め、ベアチップを重ねて搭載するものが増えてきてい
る。
め、ベアチップを重ねて搭載するものが増えてきてい
る。
【0003】以下に、従来の混成集積回路装置につい
て、図面を参照しながら説明する。図3は、従来の混成
集積回路の斜視図である。図3において、1は表面に導
体パターン2を有する絶縁基板である。3は下面に端子
(図示せず)を有するフリップチップからなる第1のベ
アチップで、絶縁基板1の導体パターン2上に半田4を
介して第1のベアチップ3と電気的に接続されている。
5は上面に端子5aを有する第2のベアチップで、導電
性ワイヤー6を用いて第2のベアチップ5の端子5aと
ワイヤーボンディングにて電気的に接続して、従来の混
成集積回路装置を構成していた。
て、図面を参照しながら説明する。図3は、従来の混成
集積回路の斜視図である。図3において、1は表面に導
体パターン2を有する絶縁基板である。3は下面に端子
(図示せず)を有するフリップチップからなる第1のベ
アチップで、絶縁基板1の導体パターン2上に半田4を
介して第1のベアチップ3と電気的に接続されている。
5は上面に端子5aを有する第2のベアチップで、導電
性ワイヤー6を用いて第2のベアチップ5の端子5aと
ワイヤーボンディングにて電気的に接続して、従来の混
成集積回路装置を構成していた。
【0004】
【発明が解決しようとする課題】しかしながら、上記従
来の構成では、並列して第1のベアチップ3と第2のベ
アチップ5とを絶縁基板1上の導電パターン2と電気的
に接続しているため、絶縁基板1の実装面積が広くなる
とともに、絶縁基板1の上面のパターン設計における自
由度が制限されるという課題を有していた。
来の構成では、並列して第1のベアチップ3と第2のベ
アチップ5とを絶縁基板1上の導電パターン2と電気的
に接続しているため、絶縁基板1の実装面積が広くなる
とともに、絶縁基板1の上面のパターン設計における自
由度が制限されるという課題を有していた。
【0005】本発明は上記従来の課題を解決するもの
で、小型で電気的な特性に優れた混成集積回路装置を提
供することを目的とする。
で、小型で電気的な特性に優れた混成集積回路装置を提
供することを目的とする。
【0006】
【課題を解決するための手段】上記目的を達成するため
に、本発明は、表面に導体パターンを有する基板と、下
面に端子を有し前記導体パターンと電気的に接続する第
1のベアチップと、この第1のベアチップ上に固着され
るとともに上面に端子を有する第2のベアチップと、こ
の第2のベアチップの端子と前記導体パターンとを導電
性ワイヤーにて電気的に接続してなる構成を有したもの
である。
に、本発明は、表面に導体パターンを有する基板と、下
面に端子を有し前記導体パターンと電気的に接続する第
1のベアチップと、この第1のベアチップ上に固着され
るとともに上面に端子を有する第2のベアチップと、こ
の第2のベアチップの端子と前記導体パターンとを導電
性ワイヤーにて電気的に接続してなる構成を有したもの
である。
【0007】
【作用】この構成によって、第1ベアチップ上に第2ベ
アチップを搭載することにより、基板の実装面積が小さ
くなり、2つのベアチップ間の接続距離も短くすること
ができる。
アチップを搭載することにより、基板の実装面積が小さ
くなり、2つのベアチップ間の接続距離も短くすること
ができる。
【0008】
【実施例】以下に本発明の一実施例における混成集積回
路装置について、図面を参照しながら説明する。
路装置について、図面を参照しながら説明する。
【0009】図1は本発明の一実施例における混成集積
回路装置の斜視図、図2は同側断面図である。図におい
て、11はアルミナ等の絶縁性を有する基板である。1
2は基板11の表面に、銀、パラジウム、銀−パラジウ
ム等の導電性材料を印刷工法により設けられた導体パタ
ーンである。13は下面に端子(図示せず)を有するフ
リップチップからなる第1のベアチップで、基板11の
表面に設けられた導体パターン12と第1のベアチップ
13の端子とを半田14を介して電気的に接続されてい
る。15は上面に端子15aを有する第2のベアチップ
で、第1のベアチップ13の端子を有する面と対向する
面(上面)と第2のベアチップ15の端子を有する面と
対向する面(下面)とを接着剤等で固着するとともに、
第2のベアチップ15の端子15aと基板11の表面に
設けられた導電パターン12とは金等の導電性を有する
導電性ワイヤー16により電気的に接続して混成集積回
路装置を構成したものである。
回路装置の斜視図、図2は同側断面図である。図におい
て、11はアルミナ等の絶縁性を有する基板である。1
2は基板11の表面に、銀、パラジウム、銀−パラジウ
ム等の導電性材料を印刷工法により設けられた導体パタ
ーンである。13は下面に端子(図示せず)を有するフ
リップチップからなる第1のベアチップで、基板11の
表面に設けられた導体パターン12と第1のベアチップ
13の端子とを半田14を介して電気的に接続されてい
る。15は上面に端子15aを有する第2のベアチップ
で、第1のベアチップ13の端子を有する面と対向する
面(上面)と第2のベアチップ15の端子を有する面と
対向する面(下面)とを接着剤等で固着するとともに、
第2のベアチップ15の端子15aと基板11の表面に
設けられた導電パターン12とは金等の導電性を有する
導電性ワイヤー16により電気的に接続して混成集積回
路装置を構成したものである。
【0010】
【発明の効果】以上のように本発明は、第1,第2のベ
アチップを積層構造で実装するので、ベアチップ搭載面
積を、従来のワイヤーボンディング工法で搭載されてい
るベアチップ1つ分の面積で2つのベアチップの搭載が
可能になるとともに、2つのベアチップ間の電気的接続
距離が、横に並んでいるのに比べ短くでき、2つのベア
チップのそれぞれの底面を電気的に直接接続することが
可能になるため、電気的動作の連携がとれ、動作の安定
が図れた混成集積回路装置を提供できる。
アチップを積層構造で実装するので、ベアチップ搭載面
積を、従来のワイヤーボンディング工法で搭載されてい
るベアチップ1つ分の面積で2つのベアチップの搭載が
可能になるとともに、2つのベアチップ間の電気的接続
距離が、横に並んでいるのに比べ短くでき、2つのベア
チップのそれぞれの底面を電気的に直接接続することが
可能になるため、電気的動作の連携がとれ、動作の安定
が図れた混成集積回路装置を提供できる。
【図1】本発明の一実施例における混成集積回路装置の
斜視図
斜視図
【図2】同断面図
【図3】従来の混成集積回路装置の斜視図
11 絶縁基板 12 導体パターン 13 第1ベアチップ 14 半田 15 第2ベアチップ 16 導電性ワイヤー
Claims (1)
- 【請求項1】 表面に導体パターンを有する基板と、下
面に端子を有し前記導体パターンと電気的に接続する第
1のベアチップと、この第1のベアチップ上に固着され
るとともに上面に端子を有する第2のベアチップと、こ
の第2のベアチップの端子と前記導体パターンとを導電
性ワイヤーにて電気的に接続してなる混成集積回路装
置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2413695A JPH08222688A (ja) | 1995-02-13 | 1995-02-13 | 混成集積回路装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2413695A JPH08222688A (ja) | 1995-02-13 | 1995-02-13 | 混成集積回路装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH08222688A true JPH08222688A (ja) | 1996-08-30 |
Family
ID=12129910
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2413695A Pending JPH08222688A (ja) | 1995-02-13 | 1995-02-13 | 混成集積回路装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH08222688A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP1187210A3 (en) * | 2000-09-07 | 2005-03-02 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device |
-
1995
- 1995-02-13 JP JP2413695A patent/JPH08222688A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP1187210A3 (en) * | 2000-09-07 | 2005-03-02 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device |
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