JPH07154076A - 多層プリント基板のｅｍｉ対策法 - Google Patents
多層プリント基板のｅｍｉ対策法Info
- Publication number
- JPH07154076A JPH07154076A JP5298803A JP29880393A JPH07154076A JP H07154076 A JPH07154076 A JP H07154076A JP 5298803 A JP5298803 A JP 5298803A JP 29880393 A JP29880393 A JP 29880393A JP H07154076 A JPH07154076 A JP H07154076A
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- Japan
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- gnd
- power supply
- multilayer printed
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- integrated circuit
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- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/0213—Electrical arrangements not otherwise provided for
- H05K1/0216—Reduction of cross-talk, noise or electromagnetic interference
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/0296—Conductive pattern lay-out details not covered by sub groups H05K1/02 - H05K1/0295
- H05K1/0298—Multilayer circuits
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
- H05K3/32—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
- H05K3/34—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
- H05K3/341—Surface mounted components
- H05K3/3421—Leaded components
Landscapes
- Production Of Multi-Layered Print Wiring Board (AREA)
- Shielding Devices Or Components To Electric Or Magnetic Fields (AREA)
- Structure Of Printed Boards (AREA)
Abstract
(57)【要約】
【目的】電源層とＧＮＤ層を持つ多層プリント基板にお
いて、多層プリント基板上の集積回路のＥＭＩ対策を行
う。 【構成】電源層３とＧＮＤ層５とを集積回路周辺で切り
放し、切り放された電源層３をノイズフィルタ２を通し
て接続し、切り放されたＧＮＤ層５をノイズフィルタ２
直下で接続したのちノイズフィルタ２のＧＮＤとも接続
する。
いて、多層プリント基板上の集積回路のＥＭＩ対策を行
う。 【構成】電源層３とＧＮＤ層５とを集積回路周辺で切り
放し、切り放された電源層３をノイズフィルタ２を通し
て接続し、切り放されたＧＮＤ層５をノイズフィルタ２
直下で接続したのちノイズフィルタ２のＧＮＤとも接続
する。
Description
【０００１】
【産業上の利用分野】本発明は、電源層とＧＮＤ層をも
つ多層プリント基板を使用している装置のＥＭＩ対策法
に関する。
つ多層プリント基板を使用している装置のＥＭＩ対策法
に関する。
【０００２】
【従来の技術】プリント基板上の集積回路のＥＭＩ対策
として用いられてきた方法としては、電源とＧＮＤとを
結ぶコンデンサをその集積回路の近傍に実装する方法が
あげられる。
として用いられてきた方法としては、電源とＧＮＤとを
結ぶコンデンサをその集積回路の近傍に実装する方法が
あげられる。
【０００３】集積回路（ＩＣ）がある瞬間に大きな処理
をした時（例えば、取り込んだ信号をそのまま外部に伝
えていたＩＣが取り込んだ信号を全て反転して外部に伝
えるような場合）、電流供給部分（電源が接続されてい
る場所）からの電流を使用するとパターンのインピーダ
ンスのために供給が間に合わないため、そのＩＣの近く
にコンデンサを配置しそれを電池として使用する。この
方法の別の効果として、ＩＣのＧＮＤからのノイズをバ
イパスして電源に、または電源からのノイズをＧＮＤに
帰すことによりＩＣのノイズを抑制することができる。
をした時（例えば、取り込んだ信号をそのまま外部に伝
えていたＩＣが取り込んだ信号を全て反転して外部に伝
えるような場合）、電流供給部分（電源が接続されてい
る場所）からの電流を使用するとパターンのインピーダ
ンスのために供給が間に合わないため、そのＩＣの近く
にコンデンサを配置しそれを電池として使用する。この
方法の別の効果として、ＩＣのＧＮＤからのノイズをバ
イパスして電源に、または電源からのノイズをＧＮＤに
帰すことによりＩＣのノイズを抑制することができる。
【０００４】但し、例えば、図３に示すように、一般に
コンデンサは、そのコンデンサの容量とパターンのＣ成
分とＬ成分により決定される周波数を中心とした狭い範
囲の周波数帯の信号しか通すことができず、コンデンサ
のバイパス効果を期待したＥＭＩ対策では、狭い範囲の
周波数帯のみ有効となる。そして、この場合は、既に決
まったパターンのひかれている多層プリント基板上にコ
ンデンサを実装するので、Ｌ成分の値は固定となる。
コンデンサは、そのコンデンサの容量とパターンのＣ成
分とＬ成分により決定される周波数を中心とした狭い範
囲の周波数帯の信号しか通すことができず、コンデンサ
のバイパス効果を期待したＥＭＩ対策では、狭い範囲の
周波数帯のみ有効となる。そして、この場合は、既に決
まったパターンのひかれている多層プリント基板上にコ
ンデンサを実装するので、Ｌ成分の値は固定となる。
【０００５】図３は一般に使用されているコンデンサの
等価回路図である。
等価回路図である。
【０００６】
【発明が解決しようとする課題】上述した従来の方法で
は、コンデンサの容量によって決定される周波数を中心
とした狭い周波数帯でのＥＭＩ対策効果しか期待できな
いという問題点があった。
は、コンデンサの容量によって決定される周波数を中心
とした狭い周波数帯でのＥＭＩ対策効果しか期待できな
いという問題点があった。
【０００７】さらに、大規模集積回路が使用されるよう
になると、集積回路の占有面積の大規模化と多層プリン
ト基板の採用が一般的になり、その結果コンデンサを集
積回路の近傍に実装することが不可能になり、また、多
層プリント基板の電源層とＧＮＤ層の存在からコンデン
サのバイパス効果が減少してＥＭＩ対策効果が薄れると
いう問題点があった。
になると、集積回路の占有面積の大規模化と多層プリン
ト基板の採用が一般的になり、その結果コンデンサを集
積回路の近傍に実装することが不可能になり、また、多
層プリント基板の電源層とＧＮＤ層の存在からコンデン
サのバイパス効果が減少してＥＭＩ対策効果が薄れると
いう問題点があった。
【０００８】
【課題を解決するための手段】本発明の多重プリント基
板のＥＭＩ対策法では、電源層とＧＮＤ層とを集積回路
周辺で切り放し、切り放された電源層をノイズフィルタ
を通して接続し、切り放されたＧＮＤ層をノイズフィル
タ直下で接続したのちノイズフィルタのＧＮＤとも接続
することを特徴としている。
板のＥＭＩ対策法では、電源層とＧＮＤ層とを集積回路
周辺で切り放し、切り放された電源層をノイズフィルタ
を通して接続し、切り放されたＧＮＤ層をノイズフィル
タ直下で接続したのちノイズフィルタのＧＮＤとも接続
することを特徴としている。
【０００９】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
て説明する。
【００１０】図１は本発明によるＥＭＩ対策法の一実施
例を説明するための多層プリント基板の平面図、図２は
図１の多層プリント基板の断面図、図２（ａ）はＡ−Ａ
断面図、図２（ｂ）はＢ−Ｂ断面図である。
例を説明するための多層プリント基板の平面図、図２は
図１の多層プリント基板の断面図、図２（ａ）はＡ−Ａ
断面図、図２（ｂ）はＢ−Ｂ断面図である。
【００１１】ＥＭＩ対策の対象となる集積回路１の周辺
にて電源層４を切り放す。集積回路１に供給する電源電
流は、電源用スルーホール４とノイズフィルタ２を通し
て供給される。集積回路１の周辺にてＧＮＤ層５を切り
放す。集積回路１のＧＮＤ電流は、ノイズフィルタ２の
直下の接続用ＧＮＤパターン６を通して供給される。接
続用ＧＮＤパターン６の幅とノイズフィルタ２の種類
は、集積回路１で消費される電流値と抑制しようとする
ノイズ周波数を考慮にいれて決定する。ノイズフィルタ
２のＧＮＤはＧＮＤ用スルーホール７で接続用ＧＮＤパ
ターン６と接続される。
にて電源層４を切り放す。集積回路１に供給する電源電
流は、電源用スルーホール４とノイズフィルタ２を通し
て供給される。集積回路１の周辺にてＧＮＤ層５を切り
放す。集積回路１のＧＮＤ電流は、ノイズフィルタ２の
直下の接続用ＧＮＤパターン６を通して供給される。接
続用ＧＮＤパターン６の幅とノイズフィルタ２の種類
は、集積回路１で消費される電流値と抑制しようとする
ノイズ周波数を考慮にいれて決定する。ノイズフィルタ
２のＧＮＤはＧＮＤ用スルーホール７で接続用ＧＮＤパ
ターン６と接続される。
【００１２】この方法によって、集積回路１の電源はノ
イズフィルタ２を通過し、集積回路１のＧＮＤはノイズ
フィルタ２の近傍のパターンを通過する。従って、ノイ
ズフィルタ２による効果的なバイパス効果を得ることが
可能となり、集積回路１のＥＭＩ対策を行うことができ
る。
イズフィルタ２を通過し、集積回路１のＧＮＤはノイズ
フィルタ２の近傍のパターンを通過する。従って、ノイ
ズフィルタ２による効果的なバイパス効果を得ることが
可能となり、集積回路１のＥＭＩ対策を行うことができ
る。
【００１３】
【発明の効果】以上説明したように、本発明の多重プリ
ント基板のＥＭＩ対策法では、集積回路から発生するノ
イズを広い周波数帯に渡って抑えることができ、また、
電源、ＧＮＤのパターン占有面積が少ないため、信号パ
ターンの領域を広くとることができるという効果を奏す
る。
ント基板のＥＭＩ対策法では、集積回路から発生するノ
イズを広い周波数帯に渡って抑えることができ、また、
電源、ＧＮＤのパターン占有面積が少ないため、信号パ
ターンの領域を広くとることができるという効果を奏す
る。
【図１】本発明によるＥＭＩ対策法の一実施例を説明す
るための多層プリント基板の平面図である。
るための多層プリント基板の平面図である。
【図２】図２は図１の多層プリント基板の断面図であ
る。図２（ａ）はＡ−Ａ断面図である。図２（ｂ）はＢ
−Ｂ断面図である。
る。図２（ａ）はＡ−Ａ断面図である。図２（ｂ）はＢ
−Ｂ断面図である。
【図３】一般に使用されているコンデンサの等価回路図
である。
である。
１ 集積回路 ２ ノイズフィルタ ３ ＧＮＤ層 ４ 電源層 ５ 電源用スルーホール ６ 接続用ＧＮＤパターン ７ ＧＮＤ用スルーホール
Claims (1)
- 【請求項１】電源層とＧＮＤ層を持つ多層プリント基板
のＥＭＩ対策法において、前記電源層と前記ＧＮＤ層と
を集積回路周辺で切り放し、切り放された前記電源層を
ノイズフィルタを通して接続し、切り放された前記ＧＮ
Ｄ層を前記ノイズフィルタ直下で接続したのち前記ノイ
ズフィルタのＧＮＤとも接続することを特徴とする多層
プリント基板のＥＭＩ対策法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5298803A JP2758816B2 (ja) | 1993-11-30 | 1993-11-30 | 多層プリント基板のｅｍｉ対策法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5298803A JP2758816B2 (ja) | 1993-11-30 | 1993-11-30 | 多層プリント基板のｅｍｉ対策法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07154076A true JPH07154076A (ja) | 1995-06-16 |
| JP2758816B2 JP2758816B2 (ja) | 1998-05-28 |
Family
ID=17864427
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5298803A Expired - Fee Related JP2758816B2 (ja) | 1993-11-30 | 1993-11-30 | 多層プリント基板のｅｍｉ対策法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2758816B2 (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001127387A (ja) * | 1999-10-29 | 2001-05-11 | Fuji Xerox Co Ltd | プリント配線基板 |
| US6418032B2 (en) | 2000-03-14 | 2002-07-09 | Fuji Xerox Co., Ltd. | Printed wiring board |
| JP2006013373A (ja) * | 2004-06-29 | 2006-01-12 | Koyo Seiko Co Ltd | 多層回路基板およびトルク検出装置 |
| JP2006332698A (ja) * | 2002-03-19 | 2006-12-07 | Nec Tokin Corp | ノイズフィルタ実装基板 |
-
1993
- 1993-11-30 JP JP5298803A patent/JP2758816B2/ja not_active Expired - Fee Related
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001127387A (ja) * | 1999-10-29 | 2001-05-11 | Fuji Xerox Co Ltd | プリント配線基板 |
| US6418032B2 (en) | 2000-03-14 | 2002-07-09 | Fuji Xerox Co., Ltd. | Printed wiring board |
| JP2006332698A (ja) * | 2002-03-19 | 2006-12-07 | Nec Tokin Corp | ノイズフィルタ実装基板 |
| JP2006013373A (ja) * | 2004-06-29 | 2006-01-12 | Koyo Seiko Co Ltd | 多層回路基板およびトルク検出装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2758816B2 (ja) | 1998-05-28 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980210 |
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