JPH0654265A - インターレース信号発生方法及び装置 - Google Patents

インターレース信号発生方法及び装置

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JPH0654265A JP5129662A JP12966293A JPH0654265A JP H0654265 A JPH0654265 A JP H0654265A JP 5129662 A JP5129662 A JP 5129662A JP 12966293 A JP12966293 A JP 12966293A JP H0654265 A JPH0654265 A JP H0654265A
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Abstract

(57)【要約】 【目的】 高解像度ノンインターレースカメラシステム
用の、インターレース信号発生方法及び装置を提供す
る。 【構成】 シフトレジスタ内における第１及び第２列を
総和すると共に、電荷結合素子（ＣＣＤ）センサチップ
上でダイオードを介してピクセル情報の各４列のうち第
３列及び第４列を廃棄し、これによってインターレース
信号の奇数フィールドを生成する。偶数フィールドは、
第１及び第２列を廃棄すると共に第３及び第４列を総和
することによって生成される。同期及びブランキングパ
ルスは信号を完成するために付加される。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は電子カメラ、特に高解像
度カメラシステムに関する。
【０００２】
【従来の技術】電子カメラは、捕捉したイメージを電子
形態で記憶するため、伝統的なフィルムカメラに対して
大きな利点を有する。電子記憶システムは、フィルムよ
り遥かに安価である。超高密度であり、占有スペースが
極めて小さい。また、フェーデイングしない。即ち、フ
ィルムと異なりそのカラー情報はほぼ永久的である。そ
してコンピュータにより容易に再生できる。現世代の電
子カメラは、主にその捕捉イメージをテレビセット上に
表示するよう設計されている。従って、それらはＮＴＳ
Ｃ規格と互換性をもつように製造されている。中でも、
ＮＴＳＣ規格では１／６０秒のインターバルで２６２．
５水平ラインのインターレースフィールドであり、これ
によって毎秒３０フレームの割合で５２５ラインを含む
完全フレームを生成する。従って、各フィールドは、完
全フレームの一本おきのラインを含み、奇数ラインフィ
ールドと偶数ラインフィールドとが交互に現れる。
【０００３】これらのカメラに使用される電荷結合素子
（ＣＣＤ）は、特にこのサービスのために設計されたも
のである。例えば、一般的な素子は、７６０×４８４の
個別フォトセンサ区画を有し、７６０×４８４ピクセル
解像度及び４８４水平ラインを生成する。このデバイス
は、また、フォトセンサ区画の各垂直列に対応した垂直
シフトレジスタを備え、一つおきの各行内のピクセル電
荷を対応する垂直レジスタへ同時にシフトする性能をも
つ。垂直シフトレジスタ内のピクセル電荷が水平シフト
レジスタ内へ順次シフトされて出力されると、ピクセル
情報の一本おきのラインを含むフィールドが生成され
る。次のフィールドは、前フィールド内で省かれたピク
セル情報のラインを含む。ＮＴＳＣ規格の同期パルスが
付加されると、２６２ラインのではなく２４２ラインの
フィールドであっても、テレビセットに如何なる問題も
生じない。
【０００４】結果として生じる７６０×４８４ピクセル
解像度は、テレビでの視認に対しては極めて適切である
が、プリントされると標準フィルムカメラに対して著し
く品質が劣る。特に商業的及び工業的な用途において、
記憶されたイメージへのコンピュータアクセス及び高品
質プリントを主眼として設計された高解像度電子カメラ
が要望されていた。少なくとも一つの新規なＣＣＤフォ
トセンサが、この要望に応えて開発された。コダックＫ
ＡＩ−１０００インターラインＣＣＤセンサは、１０２
４×１０２４のフォトセンサ区画のアレイ、及び１０２
４個の垂直シフトレジスタを有する。コンピュータアク
セス性及びプリント品質を向上するため、センサはノン
インターレースモードで作動し、これによって隣接ライ
ンが順次記憶される。動作捕捉のフレームレートを３０
フレーム／秒とし且つ合理的な読み出しレートを達成す
るため、センサは２個の水平シフトレジスタを有する。
２個の隣接ラインは、２０ＭＨｚの読み出しレートで同
時に読み出される。
【０００５】
【発明が解決しようとする課題】このセンサが提供する
種類の機能への要求に加えて、イメージフィードバック
が必要とされ、これによって正確な対象物フレーミング
が達成される。これは、特に工業用または研究用カメラ
の場合に該当する。しかしながら、この種のセンサによ
り生成された高解像度イメージは、リアルタイムで容易
に表示することはできず、高価な広帯域回路及び特別の
高品位テレビ技術を必要とする。一方、通常のテレビ型
表示では周知の低コスト回路を使用しているが、これに
はインターレース信号が必要となる。
【０００６】従って、低コストの装置、及び高解像度ノ
ンインターレースカメラシステムのための低解像度リア
ルタイムイメージを生成する方法が要望されていた。
【０００７】
【課題を解決するための手段及び作用】上記目的を達成
するためになされた本発明は、イメージを連続列で表す
ピクセル情報を生成する高解像度ＣＣＤカメラシステム
からの交互に奇数及び偶数フィールドを有する低解像度
インターレース信号を発生するための装置に関する。こ
の装置は、ビデオチャンネル、ピクセル情報の生成され
た列を選択的に廃棄するための減衰手段、ピクセル情報
の生成された列をビデオチャンネル内へ転送するための
シフトレジスタ、及び第１、第２及び第３駆動手段を含
む。第１駆動手段は、奇数イメージを表すピクセル情報
のｎ個の連続した列から成るグループから所定の第１組
を繰り返し廃棄するよう減衰手段を駆動する。第２駆動
手段は減衰手段を駆動し、ピクセル情報のｎ個の連続し
た列から成るグループから所定の第２組を繰り返し廃棄
する。第３駆動手段はレジスタを駆動し、減衰手段によ
って廃棄されなかったピクセル情報の各列を生成された
順にビデオチャンネルへ転送する。ビデオチャンネルへ
転送された奇数イメージを表すピクセル情報の列はイン
ターレース信号の奇数フィールドを構成し、偶数イメー
ジを表すピクセル情報の列はインターレース信号の偶数
フィールドを構成する。
【０００８】上記装置の典型的な実施例は、更に、ライ
ン間に水平ブランキングパルス及び水平同期パルスを付
加すると共に各フィールド間に垂直ブランキングパルス
及び垂直同期パルスを付加し、ＮＴＳＣ規格に合致させ
るための同期挿入回路を含む。レジスタ及び減衰手段
は、ＣＣＤセンサチップの一部とすることができ、これ
にはビデオ信号を生成するための安価なビデオチャンネ
ル及び簡単なタイミング回路を付加すればよい。
【０００９】また、上記目的を達成するためになされた
本発明は、連続列でイメージを表すピクセル情報を生成
する高解像度ＣＣＤカメラシステムから交互に奇数フィ
ールド及び偶数フィールドを有する低解像度インターレ
ース信号を発生する方法に関する。この方法は、ピクセ
ル情報列の少なくとも一つの所定の第１組を表すビデオ
情報のラインをビデオチャンネルへ繰り返し転送し、第
１イメージを表すピクセル情報のｎ個の連続した列から
なるグループから前記所定の第１組以外の列を廃棄して
奇数フィールドを形成する第１ステップを含む。更に、
前記所定の第１組とは異なる少なくとも一つの所定の第
２組を表すビデオ情報ラインをビデオチャンネル内へ繰
り返し転送し、第２イメージを表すピクセル情報のｎ個
の連続した列から成るグループから、前記所定の第２組
以外の列を廃棄する第２のステップを含み、更に、第１
ステップと第２ステップとを交互に繰り返す第３ステッ
プを含む。
【００１０】
【実施例】図１は、照射された物体（例えばここでは人
間の頭部）１２のイメージを形成するのに有用な本発明
に係るカメラシステム１０をブロック図で示したもので
ある。システム１０は、レンズ系１４、ＣＣＤセンサ１
６、シャッタ１８、垂直走査発生器３８、クランプ同期
挿入回路４０、ビデオディスプレイ４２、クランピング
サンプルホールド（クランプＳ＆Ｈ）回路４６及び５
６、アナログ／デジタル（Ａ／Ｄ）コンバータ４８及び
５８、ＦＩＦＯ（first in, first out ）バッファ５０
及び６０、マルチプレクサ（ＭＵＸ）５２、スイッチ３
７、使用装置（プロセッサ，メモリなど）６２、及び制
御システム６４を含む。
【００１１】写真撮影される照射された物体１２からの
光は、レンズ系１４を通過し、シャッタ１８を介してＣ
ＣＤセンサ１６上に収束される。シャッタ１８はオプシ
ョンであり、スチール写真を撮るための露光量の制御の
ために使用することができる。システム１０が記録作用
のために或いは視認のために連続的に作用していると
き、シャッタ１８は通常は使用されない。ＣＣＤセンサ
１６は、列及び行に配列されたフォトセンサ２０のアレ
イを有する。フォトセンサ２０（例：ゲート付感光性ダ
イオード）の列及び行の数は、全く重要な要素ではない
が、便宜上センサ１６は、１０２４×１０２４フォトセ
ンサを備えたコダック ＫＡＩ１０００である。垂直シ
フトレジスタ２２がフォトセンサ２０の各列に隣接して
結合されている。各垂直シフトレジスタ２２の出力端に
は、電子クロックゲート（ＥＣＧ）２４及び水平シフト
レジスタ２６及び２８が配置されている。垂直走査発生
器３０は２個の信号φＶ１及びφＶ２を生成し、これら
をＣＣＤセンサ１６へ接続して垂直シフトレジスタ２２
を駆動する。水平走査発生器３２は３個の信号φＨ１
Ａ，φＨ１Ｂ及びφＨ２を生成し、これらをＣＣＤセン
サ１６へ接続して水平シフトレジスタ２４及び２６を駆
動する。水平シフトレジスタ２６の出力は、スイッチ３
７の位置によって定められる２個の径路３４または３６
の一方をたどる。図示のように、水平シフトレジスタ２
６の出力は、スイッチ３７を介して径路（配線）３６へ
接続される。径路（配線）３４は、ビデオ増幅器３８及
び同期挿入回路４０を介してビデオディスプレイ４２へ
接続されている。径路３６は、アナログ増幅器４４、ク
ランピングサンプルホールド回路４６、アナログ−デジ
タルコンバータ（以下、Ａ／Ｄと略する）４８、及び第
ＦＩＦＯバッファ（以下ＦＩＦＯと略する）５０を介し
てマルチプレクサ（ＭＵＸ）５２の一方の入力へ接続さ
れる。水平シフトレジスタ２８の出力は、アナログ増幅
器５４、クランピングサンプルホールド回路５６、Ａ／
Ｄコンバータ５８及びＦＩＦＯ６０を介してマルチプレ
クサ５２へ接続する径路をたどる。マルチプレクサ５２
の出力は使用装置６２へ供給され、該装置６２は例えば
プリンタ、メモリまたはプロセッサ等である。制御シス
テム６４は、シャッタ１８、垂直及び水平走査発生器３
０及び３２、ＥＣＧゲート２４、同期挿入回路４０及び
マルチプレクサ５２によってシステムを具体的に制御す
る。
【００１２】本発明に係るカメラシステム１０は、２種
のモード、即ち低解像度視認モード及び高解像度記録モ
ードで作動することができる。該両モードにおいて、各
フォトセンサ２０は、受光量と露光時間との積に比例し
たピクセル電荷を蓄積する。露光時間が完了すると、各
フォトセンサ２０からのピクセル電荷がその対応する垂
直シフトレジスタ２２内へ転送される。これによってフ
ォトセンサ２０は解放され、照射された時に新たなイメ
ージを捕捉することとなる。全ての１０２４垂直シフト
レジスタは同時に駆動され、これによってピクセル電荷
を一回に１水平列ずつダウンシフトする。各水平列はイ
メージの１ラインを表す。記録モードにおいて、２個の
水平列が垂直レジスタからシフトされ、それぞれ各水平
レジスタ２６及び２８を満たす。レジスタ２６及び２８
はその後同時に１度のチャージによって、それぞれ固有
の出力チャンネルに読み出される。スイッチ３７によっ
て選択されたチャンネル３６において、増幅器４４は各
ピクセル電荷のアナログ値を増幅する。クランピングサ
ンプルホールド回路４６は増幅された電荷値をクランプ
された基準電圧に付加し、その結果をピクセルレートで
サンプルして各ピクセルに対する離散値を得、それを保
持してＡ／Ｄ４８によるデジタル数への変換に供する。
Ａ／Ｄ４８のデジタル出力は、ＦＩＦＯ５０内に一時的
に記憶される。レジスタ２８の出力は、ＦＩＦＯ６０内
で同様に処理及び記憶される。マルチプレクサ５２は、
一回に複数の入力のうちの一つを出力へ接続し、これに
よってまずＦＩＦＯ６０からのピクセルデータの全ライ
ンを、ついでＦＩＦＯ５０からのピクセルデータの全ラ
インを使用装置６２へそれぞれ供給し、これによってイ
メージ処理及び記憶を行う。更に２本のラインがその後
垂直レジスタから水平レジスタ内へシフトアウトされ、
同時に読み出される。この処理は、１０２４×１０２４
ピクセルイメージ全体が使用装置へ転送されるまで繰り
返される。ピクセルデータの連続ラインが、処理または
印刷に理想的な連続したノンインータリーブ順序で受信
される。本発明の作用には必要ないが、２個の水平レジ
スタを使用することによって、与えられたチャンネル帯
域幅に対する出力速度が２倍に成る。両チャンネルが２
０ＭＨｚで作用すると、毎秒３０フレームが記録可能と
なる。これは、通常の動作を記録するに十分な速さであ
る。
【００１３】視認モードにおいて、水平レジスタ２８は
使用されず、ＥＣＧレジスタ２４が使用される。垂直解
像度を低減するため、半分のラインが廃棄される。更
に、残存ラインは足し合わされて２本が１本にまとめら
れる。これを達成するため、垂直レジスタ２２からのピ
クセル電荷の第１列は、水平レジスタ２６へ転送され
る。その後、レジスタ２６が読み出しを開始する前に、
第２列の電荷がレジスタ２６へ転送され、第１列の上に
付加される。ＣＣＤ１６は電荷結合されているので、各
レジスタセル内の第２電荷は単純に第１電荷に加えら
れ、１０２４ピクセルの総和電荷の一ラインを形成す
る。ピクセル電荷の第３及び第４列は、その後ＥＣＧゲ
ートを介して廃棄され、レジスタ２６はスイッチ３７に
より選択されたビデオチャンネル３４を介して読み出さ
れる。レジスタ２６内のつぎの２ラインを総和し、つぎ
の２ラインを廃棄し、そしてレジスタ２６を連続して読
み出す処理は、各垂直レジスタが空になるまで繰り返さ
れる。水平及び垂直シフトレジスタがシフトされる割合
は、水平走査発生器３２及び垂直走査発生器３０によっ
て発生される信号によって制御される。それらは、ライ
ンレートがＮＴＳＣ規格と同様になるよう容易に行われ
る。この処理によって、２５６ラインのフィールドが生
じる。
【００１４】次のフィールドを発生するため、新たなイ
メージが使用される。ピクセル電荷が垂直シフトレジス
タ内へ転送された後、各電荷の４列が、前述のようにシ
フトアウトされる。しかしながら、この場合にはインタ
ーリーブ効果を得るため、各４列のうちの最初の２列が
廃棄され、第３列と第４列とが足し合わされてフィール
ドの１ラインが生成される。ビデオ増幅器３８は信号を
増幅し、同期挿入回路４０は水平同期パルス、垂直同期
パルス、垂直ブランキングパルス及び垂直同期パルスを
適切な時間に挿入し、ビデオディスプレイ４２を駆動す
るためのＮＴＳＣ型信号を完成する。レジスタ２６が２
０ＭＨｚレートで読み出すと、２個のインターリーブフ
ィールドを含むフレームは毎秒３０のＮＴＳＣレートで
生成可能となる。従って、ビデオディスプレイ４２は、
通常のテレビディスプレイを使用可能である。２０ＭＨ
ｚのレートでは、各ライン毎にレジスタ２６から読み出
された１０２４個の個別ピクセル総和値が存在するが、
ビデオ増幅器３８はそのような帯域幅を有する必要はな
い。事実、５ＭＨｚの帯域幅の通常のテレビビデオチャ
ンネルが、標準テレビ映像と同等のイメージを生成する
のに十分なのである。
【００１５】２種の作用モードを生成するようＣＣＤセ
ンサ１６が制御される方法を理解するため、図２に示さ
れたＣＣＤセンサ１６の幾つかの詳細部を考慮すること
が有用である。
【００１６】図２は、各垂直シフトレジスタ及びその垂
直シフトレジスタに対応するフォトセンサ２０の縦列の
出力端においてＥＣＧゲート２４及び水平シフトレジス
タ２６及び２８を形成する半導体物質の種々の領域を示
す平面図である。水平の影を施した領域は、電荷蓄積の
ために使用される半導体物質内の領域を表し、対角線影
を施した領域は所望方向へ電荷を案内するためのスレッ
ショルド（threshold）を形成する注入領域を表す。電
荷の動作を制御するために電圧が印加される電極は示さ
れていないが、影響をうける半導体領域の上部に存在し
ている。各領域は、その領域を制御する電極に従って分
類されている。
【００１７】一般に、シフトレジスタの各セルは、２個
の記憶領域を制御する２個の電極を有する。電荷は、近
接電極へ一組の相補信号を印加することによって、レジ
スタに沿って移動する。各信号は、高値と低値との間を
交互に変化し、制御された領域内において信号の高値、
低値に対応して、高いフィールドと低いフィールドを形
成する。各電荷は、低いフィールドの領域から高いフィ
ールドの領域へ移動する。一般に、注入領域は、同じ電
極に制御される記憶フィールドよりも低いフィールドを
形成する。垂直シフトレジスタは、従って、領域Ｖ１及
びＶ２を有し、水平シフトレジスタは領域Ｈ１（Ｈ１Ａ
及びＨ１Ｂとして示した）およびＨ２を有する。水平シ
フトレジスタ２６及び２８は、個別に制御されるので、
それらのＨ１領域はＨ１Ａ及びＨ１Ｂとそれぞれ分類さ
れる。
【００１８】露光時間中、フォトセンサ（例：フォトダ
イオード、ゲート付感光性ダイオード）上に落ちる光
は、その下方に蓄積される電荷を発生する。露光が完了
すると、第３レベル転送電圧が、全領域Ｖ１を制御する
電極へ印加される。転送電圧は、シフトレジスタ内にお
ける電荷をシフトさせるために使用される高値よりも遥
かに高い。注入領域７４内のフィールドは、常に領域７
２内のフィールドより低く、また領域７２と同じくＶ１
によって制御されるが、前述の転送電圧により、結果的
にフォトダイオード記憶領域内におけるフィールドより
も高くなる。従って、電荷は各フォトダイオード２０の
下方から、注入領域７４を通過してその対応する領域７
２へ移動する。通常の高値及び低値の相補信号がその後
印加されるとき、領域７４はフォトセル領域よりも低い
ままであり、これによって後者が電荷を蓄積するが、こ
のとき垂直レジスタは作動している。Ｖ１が低くなりＶ
２が高くなると、領域７４は領域７２よりも更に低いフ
ィールドを有し、電荷は領域７２から領域７６へ移動す
る。続いてＶ２が低くなると、もしＥＣＧ２４が高くＨ
１Ａが低い場合は、電荷はＥＣＧ２４を通過してダンプ
ダイオード７８へ伝送され、そして電源（不図示）へ達
する。一方、もしＨ１Ａが高くＥＣＧが低い場合は、領
域７６からの電荷は水平レジスタ２６内の領域８０へ向
かう。このとき、領域８０内の電荷は、２方向のいずれ
かの方向に移動可能である。Ｈ１Ａが低くなるときに、
もしＨ２が高ければ、電荷は水平レジスタ２６に沿って
領域８２へ伝送される。一方、もしＨ１Ａが低くなると
きＨ１Ｂが高ければ、電荷は水平レジスタ２８内の領域
８４へ移動する。従って、ＣＣＤセンサ１６の構造によ
り、いくらかの読み出しの多様性が得られる。
【００１９】図３は、記録モード中においてＣＣＤセン
サ１６の読み出し時間中にそれぞれ電極制御領域Ｈ１
Ａ、Ｈ１Ｂ及びＶ１に印加された電圧信号φＨ１Ａ，φ
Ｈ１Ｂ，及びφＶ１の時間関係を示すタイミングチャー
トである。信号φＨ２及びφＶ２（不図示）は、それぞ
れ信号φＨ１Ｂ及びφＶ１の相補信号である。図３は事
象の順序を示すタイミングチャートであり、必ずしも正
確に時間スケール通りの大きさではない。時刻Ｔ１にお
いて、レジスタ２６及び２８はその各々の出力チャンネ
ル内へその内容を空にしたところであり、信号φＨ１Ａ
及びφＨ１Ｂは高いままである。φＶ１は低くなり（そ
してφＶ２は高くなる）、各電荷の新たなラインを転送
領域７６内へ駆動する。その後φＶ１が時刻Ｔ２で高く
なりφＶ２が低くなると、各電荷のラインがφＨ１Ａに
よって制御された領域８０内へ転送される。時刻Ｔ３に
おいて、φＨ１Ａ及びφＶ１は共に低くなり、領域８０
からの電荷を領域８４へ駆動してレジスタ２８を充填
し、そして領域７２内の電荷を領域７６へ駆動する。そ
して、φＨ１Ａはその後高くなり、時刻Ｔ４でφＶ２が
低くなると、領域７６からの電荷が領域８０へ入り、レ
ジスタ２６を充填する。そのようにして、各水平レジス
タは、φＨ１及びφＨ２が交互に高くなったり低くなっ
たりするに従って逐次的に読み出すためのピクセル情報
ラインを含む。
【００２０】図４は、リアルタイム視認モードのための
インターリーブＮＴＳＣタイプ信号を発生するために使
用されるタイミングチャートを示す。図４は、必ずしも
寸法通りではなく、サイクル時間は必ずしも図３のそれ
らと関連づけられてはいない。このモードにおいて、レ
ジスタ２８は使用されておらず、ＥＣＧゲート２４が使
用されている。従って、図４は、第１フィールドを生成
するための信号φ１ＥＣＧのタイミングと、第２のイン
ターリーブフィールドを生成するためのφ２ＥＣＧのタ
イミングをφＨ１Ａ及びφＶ１と共に示す。φＨ１Ａの
相補信号φＨ２、及びφＶ１の相補信号であるφＶ２は
図示されていない。時刻Ｔ５において、レジスタ２６が
完全に空になった後、φＶ１は４完全サイクルを開始す
るが、一方φＨ１Ａは高いままである。これらのサイク
ルの最初の２サイクルの間、ＥＣＧゲート２４を制御す
る信号φ１ＥＣＧは低い。この結果、情報の最初の２ラ
インが水平レジスタ２６内へシフトされ、該レジスタ２
６内でそれらは自動的に総和される。時刻Ｔ７におい
て、その次のサイクル中φＶ１が低いが、φ１ＥＣＧは
高くなりφＶ１の４つのサイクルの終端にいたるまで高
いままである。これによって、ピクセル情報の第３及び
第４ラインはダンプダイオード７８を介して廃棄され
る。レジスタ２６がその後時刻Ｔ８を起点として読み出
されると、捕捉された情報の最初の２ラインを表すピク
セル情報の１ラインは、ビデオチャンネル３４へ読み出
される。各４ラインのうちの最初の２ラインを総和し最
後の２ラインを廃棄するこのパターンは、垂直レジスタ
が空になるまで繰り返され、捕捉された情報の各４ライ
ンに対して１ラインを含むフィールドを形成する。
【００２１】その後のフィールドに対して、レジスタ２
６が空になった後、φＶ１は再び４完全サイクルを開始
し、垂直シフトレジスタ内で４ラインをシフトダウンす
る。しかしながら、この場合、時刻Ｔ６において、ゲー
ト２４を制御するφ２ＥＣＧが高くなり、φＶ１の最初
の２サイクルの終端まで高いままであり、最後の２サイ
クルに対して低くなる。この結果、ライン１及び２は廃
棄され、ライン３及び４はフィールドの最初のラインと
して出力される。各４連続ラインの最初の２ラインを廃
棄し第３及び第４ラインを総和するパターンは、全ての
レジスタが空になってビデオ信号の第２フィールドを形
成するまで継続する。各フィールドを交互に繰り返すこ
とによって、各フィールドに２５６ライン、各フレーム
に５１２ラインをもつインターリーブ信号が形成され
る。走査信号のタイミングは、容易に形成することがで
き、これによって同期挿入器４０によって同期パルス及
びブランキングパルスを挿入するための余裕を残しなが
らラインレート及びフレームレートをＮＴＳＣ規格に近
づけることができる。
【００２２】このようにして、付加費用が極めて少ない
ノンインターレース出力を発生する高解像度カメラシス
テムから通常のテレビスクリーン視認のためのＮＴＳＣ
コンパチブル信号を発生する方法及び装置を説明した。
【００２３】前述の視認信号を発生するための特定の方
法は極めて効果的であるが、多くの他の変形でも充足す
ることができることは明らかである。例えば、偶数フィ
ールドを形成するための第３及び第４列及び奇数フィー
ルドを形成するためのピクセル電荷の第１及び第２列を
総和する代わりに、一つのフィールドに対する任意の２
個の列を総和し、次のフィールドに対して他の２列を総
和することが可能である。更に、総和の代わりに電荷の
任意の単一列を使用可能である。更に、各フォトセンサ
の各４列に対して一つのビデオラインを読み出すことに
よって１０２４×１０２４センサアレイからＮＴＳＣ信
号へ便宜的減少が行われる一方、特にフォトセンサの列
数が著しく異なる場合には、そういう場合でも作動可能
なインターリーブ信号を発生させるために、４列に１本
の比に限らず他の比を使用可能である。これらの変形の
いずれか一を実行するため、変更されなければならない
全てのものは走査信号及びＥＣＧゲート信号である。更
に、本発明は、上述したインターライン型の他のＣＣＤ
センサでも、それがＥＣＧゲート２４及び減衰ダイオー
ド７８の等価手段を有する限り使用可能である。
【００２４】
【発明の効果】以上説明したとおり、本発明によれば、
ノンインターレースで記録を行う高解像度ＣＣＤカメラ
システムからインターレース視認信号を発生させること
ができる。このインターレース信号により、例えば通常
のＮＴＳＣ規格のテレビにおいても、前記ノンインター
レース高解像度ＣＣＤカメラの映像の視認が可能とな
る。
【図面の簡単な説明】
【図１】本発明の実施例のカメラシステムのブロック図
である。
【図２】図１のカメラシステムに使用されるＣＣＤセン
サの一部を示す図である。
【図３】記録モードにおける図１のシステムの作用説明
に有用なタイミングチャートである。
【図４】視認モードにおける図１のシステムの作用説明
に有用なタイミングチャートである。
【符号の説明】
１０ カメラシステム １２ 照射物体 １４ レンズシステム １６ ＣＣＤセンサ １８ シャッタ ３０ 垂直走査発生器 ３２ 水平走査発生器 ３８ ビデオ増幅器 ４０ 同期挿入回路 ４２ ビデオディスプレイ ４６ クランピングサンプルホールド回路 ４８ Ａ／Ｄコンバータ ５０ ＦＩＦＯバッファ ５２ マルチプレクサ

Claims (10)

    【特許請求の範囲】
  1. 【請求項１】 イメージを連続列で表すピクセル情報を
    生成する高解像度ＣＣＤカメラシステムから交互に奇数
    フィールドと偶数フィールドとを有するインターレース
    信号を発生するインターレース信号発生装置において、 ビデオチャンネルと、 ピクセル情報の生成列を選択的に廃棄する減衰手段と、 生成されたピクセル情報列を前記ビデオチャンネル内へ
    転送するシフトレジスタ手段と、 前記減衰手段を駆動し、奇数イメージを表すピクセル情
    報のｎ個の連続した列から成るグループから所定の第１
    組の列を廃棄する第１駆動手段と、 前記減衰手段を駆動し、偶数イメージを表すピクセル情
    報のｎ個の連続した列から成るグループから所定の第２
    組の列を繰り返し廃棄する第２駆動手段と、 前記シフトレジスタ手段を駆動して、前記減衰手段によ
    って廃棄されなかったピクセル情報列を、生成された順
    序で前記ビデオチャンネルへ転送する第３駆動手段と、 を含み、 前記前記ビデオチャンネルへ転送された奇数イメージを
    表すピクセル情報列は前記インターレース信号の奇数フ
    ィールドを構成し、前記ビデオチャンネルへ転送された
    前記偶数イメージを表すピクセル情報列は前記ビデオ信
    号の偶数フィールドを構成することを特徴とするインタ
    ーレース信号発生装置。
  2. 【請求項２】 請求項１に記載の装置において、ｎは４
    であり、前記所定の第１組は第３及び第４列であり、前
    記少なくとも一つの所定の第２組は第１及び第２列であ
    ることを特徴とするインターレース信号発生装置。
  3. 【請求項３】 請求項１に記載の装置において、前記第
    ３駆動手段は前記シフトレジスタ手段を駆動し、ビデオ
    チャンネルへ転送する前にピクセル情報のｎ個の連続し
    た列のグループにおいて廃棄されなかったピクセル情報
    列を総和することを特徴とするインターレース信号発生
    装置。
  4. 【請求項４】 請求項３に記載の装置において、ｎは４
    であり、前記所定の第１組は第３及び第４列であり、前
    記少なくとも一つの所定の第２組は第１及び２列である
    ことを特徴とするインターレース信号発生装置。
  5. 【請求項５】 請求項１に記載の装置において、更に、
    フィールドの連続ラインの各対間に水平ブランキングパ
    ルス及び水平同期パルスを挿入すると共に、連続フィー
    ルド間に垂直ブランキングパルス及び垂直同期パルスを
    挿入し、これによって前記インターレース信号を完成さ
    せる同期挿入手段を含むことを特徴とするインターレー
    ス信号発生装置。
  6. 【請求項６】 連続列でイメージを表すピクセル情報を
    生成する高解像度ＣＣＤカメラシステムから交互に奇数
    フィールド及び偶数フィールドを有するインターレース
    信号を発生する方法において、 （ａ）ピクセル情報列の少なくとも一つの所定の第１組
    を表すビデオ情報ラインをビデオチャンネル内へ繰り返
    し転送すると共に、第１イメージを表すピクセル情報の
    ｎ個の連続した列のグループから、前記所定の第１組以
    外の列を廃棄して奇数フィールドを形成するステップ
    と； （ｂ）前記所定の第１組とは異なる少なくとも一つのピ
    クセル情報列の所定の第２組を表すビデオ情報のライン
    を前記ビデオチャンネル内へ繰り返し転送すると共に、
    第２イメージを表すピクセル情報のｎ個の連続した列の
    グループから、前記所定の第２組以外の列を廃棄して偶
    数フィールドを形成するステップと； （ｃ）上記ステップ（ａ）と（ｂ）とを交互に実行する
    ステップと； を含むことを特徴とするインターレース信号発生方法。
  7. 【請求項７】 請求項６に記載の方法において、ｎは４
    であり、前記少なくとも一つの所定の第１組は第１及び
    第２列であり、前記少なくとも一つの所定の第２組は第
    ３及び第４列であることを特徴とするインターレース信
    号発生方法。
  8. 【請求項８】 請求項７に記載の方法において、更に、
    前記ステップ（ａ）の前に、 （ｄ）第１イメージを表す生成されたピクセル情報の連
    続した４列から成るグループの第１及び第２列を総和す
    るステップ、を含み、そしてステップ（ａ）の後に、 （ｅ）第２イメージを表す生成されたピクセル情報の連
    続した４列から成るグループの第３及び第４列を総和す
    るステップと、 を含むことを特徴とするインターレース信号発生方法。
  9. 【請求項９】 請求項６に記載の方法において、更に、 （ｄ）フィールドの連続ラインの各対間に水平同期パル
    ス及び水平ブランキングパルスを、そして連続フィール
    ド間に垂直ブランキングパルス及び垂直同期パルスを、
    それぞれ挿入し、前記インターレース信号を完成するス
    テップを含むことを特徴とするインターレース信号発生
    方法。
  10. 【請求項１０】 高解像度ＣＣＤセンサから交互に奇数
    フィールド及び偶数フィールドを有するインターレース
    信号を発生する方法であって、前記ＣＣＤセンサは、列
    と行に配列されたフォトセンサアレイと、前記フォトセ
    ンサの各行に対応して配置された垂直シフトレジスタ
    と、前記フォトセンサにより蓄積された電荷を前記垂直
    シフトレジスタの各セル内へ転送する第１転送手段と、
    水平シフトレジスタと、前記垂直シフトレジスタの各出
    力端において各垂直シフトレジスタの最終セル内の電荷
    を前記水平シフトレジスタの各セル内へ転送する第２転
    送手段と、前記各垂直シフトレジスタの出力セル内の電
    荷を減衰する減衰手段と、を含み、前記方法は、 （ａ）前記フォトセンサアレイを集束光イメージに所定
    の期間露光させるステップと； （ｂ）前記フォトセンサにより蓄積された電荷を対応す
    る前記垂直シフトレジスタの各セル内へ転送するステッ
    プと； （ｃ）前記垂直シフトレジスタ内の電荷を前方へ一列ず
    つ繰り返しシフトするステップと； （ｄ）前記垂直シフトレジスタからの第１列の電荷を前
    記水平シフトレジスタの各セル内へ転送するステップ
    と； （ｅ）上記ステップ（ｄ）を第２列の電荷に対して繰り
    返して総和電荷の列を形成するステップと； （ｆ）前記各垂直シフトレジスタからの第３列及び第４
    列の電荷を減衰するステップと； （ｇ）前記水平シフトレジスタから読み出しを行い、前
    記ビデオ信号のラインを形成するステップと； （ｈ）水平同期パルス及び水平ブランキングパルスを前
    記ビデオ信号へ付加するステップと； （ｉ）前記垂直シフトレジスタが空になるまでステップ
    （ｄ），（ｅ），（ｆ），（ｇ）及び（ｈ）を繰り返
    し、前記奇数フィールドを形成するステップと； （ｊ）垂直同期パルス及び垂直ブランキングパルスを前
    記ビデオ信号へ付加するステップと； （ｋ）ステップ（ａ）、（ｂ）及び（ｃ）を繰り返すス
    テップと； （ｌ）前記垂直シフトレジスタからの第１列及び第２列
    の電荷を減衰するステップと； （ｍ）前記垂直シフトレジスタからの第３列内の電荷を
    前記水平シフトレジスタの各セル内へ転送するステップ
    と； （ｎ）ステップ（ｍ）を第４列の電荷に対して繰り返
    し、これによって総和電荷の列を形成するステップと； （ｏ）ステップ（ｇ）及び（ｈ）を繰り返すステップ
    と； （ｐ）前記垂直シフトレジスタが空になるまでステップ
    （ｌ）、（ｍ）、（ｎ）及び（ｏ）を繰り返し、前記偶
    数フィールドを形成するステップと； （ｑ）ステップ（ｊ）を繰り返すステップと； を含むことを特徴とするインターレース信号発生方法。
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