JPH064066A - フリーパターン型表示装置のスクロール回路 - Google Patents
フリーパターン型表示装置のスクロール回路Info
- Publication number
- JPH064066A JPH064066A JP4181660A JP18166092A JPH064066A JP H064066 A JPH064066 A JP H064066A JP 4181660 A JP4181660 A JP 4181660A JP 18166092 A JP18166092 A JP 18166092A JP H064066 A JPH064066 A JP H064066A
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- display data
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- Pending
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】
【目的】制御データ線数が少ない(経済性のある)各段
毎のデータ走査方法を生かしたまま、表示の切り換え速
度を上げることができ、しかも通常の一方向のレジスタ
を使用できるフリーパターン型表示装置のスクロール回
路を提供する。 【構成】表示する全ての表示データを格納する表示デー
タメモリ2からシフトレジスタ3、及び予備シフトレジ
スタ5のそれぞれに、表示データをパラレル入力し、1
6−sビット数上にシフトした後、n行×m列のドット
マトリックス状に配列された表示素子を有し、列にそっ
て、表示データが順次入力され、かつ、その表示データ
が順次記憶される複数の表示ブロック1に転送する。こ
の操作をm列分行い、表示する。さらに、表示データを
入力し、sをs=s+1とし、上にシフトし、同様の操
作を繰り返す。
毎のデータ走査方法を生かしたまま、表示の切り換え速
度を上げることができ、しかも通常の一方向のレジスタ
を使用できるフリーパターン型表示装置のスクロール回
路を提供する。 【構成】表示する全ての表示データを格納する表示デー
タメモリ2からシフトレジスタ3、及び予備シフトレジ
スタ5のそれぞれに、表示データをパラレル入力し、1
6−sビット数上にシフトした後、n行×m列のドット
マトリックス状に配列された表示素子を有し、列にそっ
て、表示データが順次入力され、かつ、その表示データ
が順次記憶される複数の表示ブロック1に転送する。こ
の操作をm列分行い、表示する。さらに、表示データを
入力し、sをs=s+1とし、上にシフトし、同様の操
作を繰り返す。
Description
【0001】
【産業上の利用分野】本発明は、例えば自動車道路等に
設置されて交通情報等を表示する表示装置のスクロール
回路に関し、特に複数の表示ランプをマトリックス状に
配列したフリーパターン型表示装置のスクロール回路に
関する。
設置されて交通情報等を表示する表示装置のスクロール
回路に関し、特に複数の表示ランプをマトリックス状に
配列したフリーパターン型表示装置のスクロール回路に
関する。
【0002】
【従来の技術】前述のようなフリーパターン型表示装置
には、発光ダイオード(以下、「LED」という)を縦
横に多数配列した表示面を有しており、LEDの選択的
発光によって所望の文字・図形等を表示するものであ
る。図8に示すフリーパターン型表示装置は、例えば道
路情報表示板として用いられるものである。全体図中に
破線で示すように、縦横8列づつ合計64ブロックから
なる。また、拡大図中に示すように、各ブロックは16
×16ドットのLEDで構成されている。なお、LED
の各ドットを色彩の異なる2個又は3個のLEDで構成
すれば、カラー表示を行うことができる。
には、発光ダイオード(以下、「LED」という)を縦
横に多数配列した表示面を有しており、LEDの選択的
発光によって所望の文字・図形等を表示するものであ
る。図8に示すフリーパターン型表示装置は、例えば道
路情報表示板として用いられるものである。全体図中に
破線で示すように、縦横8列づつ合計64ブロックから
なる。また、拡大図中に示すように、各ブロックは16
×16ドットのLEDで構成されている。なお、LED
の各ドットを色彩の異なる2個又は3個のLEDで構成
すれば、カラー表示を行うことができる。
【0003】従来、このようなフリーパターン型表示装
置は、図6に示すように表示ブロックを縦(段)、横に
組み合わせ、各段毎個別にデータを走査する。また、図
7に示すようにフリーパターン型表示装置は、表示デー
タを記憶、編集する制御部と、データを表示する表示部
から構成される。動作の流れは、制御部内の表示メモリ
にある表示データを、各段に対応する各走査データ毎に
一括編集し、格納メモリに記憶する。表示データ全体の
編集が終了した後、その走査データを、表示部の表示ブ
ロックへ出力している。また、近年、表示内容の多様化
が求められている中で、表示を上下にスクロール表示す
る場合が多くなってきた。
置は、図6に示すように表示ブロックを縦(段)、横に
組み合わせ、各段毎個別にデータを走査する。また、図
7に示すようにフリーパターン型表示装置は、表示デー
タを記憶、編集する制御部と、データを表示する表示部
から構成される。動作の流れは、制御部内の表示メモリ
にある表示データを、各段に対応する各走査データ毎に
一括編集し、格納メモリに記憶する。表示データ全体の
編集が終了した後、その走査データを、表示部の表示ブ
ロックへ出力している。また、近年、表示内容の多様化
が求められている中で、表示を上下にスクロール表示す
る場合が多くなってきた。
【0004】
【発明が解決しようとする課題】しかしながら、従来の
フリーパターン型表示装置においては、「表示データの
編集→走査データの編集→各表示ブロックへデータ出
力」方式は、全ての操作を一括に行っていた。つまり、
表示を上下左右に1ドット動かす(表示のスクロール
等)場合でも、表示の書換えデータを編集した後、走査
データを再編集して出力している。そのため、表示の切
り換え速度を速くすることができなかった。また、表示
部に対してパラレル転送でデータを送出すれば、表示の
切り換え速度は向上するが、表示部へ延びる制御線の数
は莫大に多くなり、そのため表示部が小さければ制御線
の数を無闇の増加させることはできない。さらに、双方
向にシフト可能な、レジスタを用いれば可能となるが、
この双方向レジスタを実現するためには複雑な回路が必
要となる。本発明は、このような事情に鑑みてなされた
ものであり、制御データ線数が少ない(経済性のある)
各段毎のデータ走査方法を生かしたまま、表示の切り換
え速度を上げることができ、しかも通常の一方向のレジ
スタを使用できるフリーパターン型表示装置のスクロー
ル回路を提供することを課題とする。
フリーパターン型表示装置においては、「表示データの
編集→走査データの編集→各表示ブロックへデータ出
力」方式は、全ての操作を一括に行っていた。つまり、
表示を上下左右に1ドット動かす(表示のスクロール
等)場合でも、表示の書換えデータを編集した後、走査
データを再編集して出力している。そのため、表示の切
り換え速度を速くすることができなかった。また、表示
部に対してパラレル転送でデータを送出すれば、表示の
切り換え速度は向上するが、表示部へ延びる制御線の数
は莫大に多くなり、そのため表示部が小さければ制御線
の数を無闇の増加させることはできない。さらに、双方
向にシフト可能な、レジスタを用いれば可能となるが、
この双方向レジスタを実現するためには複雑な回路が必
要となる。本発明は、このような事情に鑑みてなされた
ものであり、制御データ線数が少ない(経済性のある)
各段毎のデータ走査方法を生かしたまま、表示の切り換
え速度を上げることができ、しかも通常の一方向のレジ
スタを使用できるフリーパターン型表示装置のスクロー
ル回路を提供することを課題とする。
【0005】
【課題を解決するための手段】上記課題を解決するため
に本発明のフリーパターン型表示装置のスクロール回路
においては、図3に示すように、シフトレジスタ、及び
予備シフトレジスタのそれぞれに、表示データをパラレ
ル入力(図3(c))し、例えば16−1ビット上にシ
フトした後、表示する(図3(d))。これは、前回の
表示データ(図3(b))を1ビット下にシフトしたの
と同等となる。この操作を図4に示すように「16ビッ
ト単位で表示データ編集→表示ブロックに出力」という
操作を時分割に繰り返し、m列行うこと構成とした。
に本発明のフリーパターン型表示装置のスクロール回路
においては、図3に示すように、シフトレジスタ、及び
予備シフトレジスタのそれぞれに、表示データをパラレ
ル入力(図3(c))し、例えば16−1ビット上にシ
フトした後、表示する(図3(d))。これは、前回の
表示データ(図3(b))を1ビット下にシフトしたの
と同等となる。この操作を図4に示すように「16ビッ
ト単位で表示データ編集→表示ブロックに出力」という
操作を時分割に繰り返し、m列行うこと構成とした。
【0006】具体的には、n行×m列のドットマトリッ
クス状に配列された表示素子を有し、列(または行)に
そって、表示データが順次入力され、かつ、その表示デ
ータが順次記憶される複数の表示ブロックと、表示する
全ての表示データを格納する表示データメモリとを備え
たフリーパターン型表示装置のスクロール回路に、以下
〜の手段を備えた構成とした。 出力が次段の入力に接続され、かつ前記複数の表示ブ
ロックの列(または行)にそれぞれ接続されていて、接
続された前記列(または行)のドットと同数のkビット
を有する複数のシフトレジスタと、 出力が前記シフトレジスタの初段の入力に接続され、
kビットを有する予備シフトレジスタと、 前記表示データメモリからそれぞれの所望のkビット
を選び、その表示データを前記複数のシフトレジスタ及
び予備シフトレジスタのそれぞれに入力し、次段のシフ
トレジスタにk−s(s:整数)ビットシフト後、それ
ぞれの表示ブロックに転送する操作を表示する列分繰り
返す第1の制御装置と、 前記sを加算(s=s+x(x:整数))し、第1の
制御装置の動作を繰り返す第2の制御装置とを備えた。
クス状に配列された表示素子を有し、列(または行)に
そって、表示データが順次入力され、かつ、その表示デ
ータが順次記憶される複数の表示ブロックと、表示する
全ての表示データを格納する表示データメモリとを備え
たフリーパターン型表示装置のスクロール回路に、以下
〜の手段を備えた構成とした。 出力が次段の入力に接続され、かつ前記複数の表示ブ
ロックの列(または行)にそれぞれ接続されていて、接
続された前記列(または行)のドットと同数のkビット
を有する複数のシフトレジスタと、 出力が前記シフトレジスタの初段の入力に接続され、
kビットを有する予備シフトレジスタと、 前記表示データメモリからそれぞれの所望のkビット
を選び、その表示データを前記複数のシフトレジスタ及
び予備シフトレジスタのそれぞれに入力し、次段のシフ
トレジスタにk−s(s:整数)ビットシフト後、それ
ぞれの表示ブロックに転送する操作を表示する列分繰り
返す第1の制御装置と、 前記sを加算(s=s+x(x:整数))し、第1の
制御装置の動作を繰り返す第2の制御装置とを備えた。
【0007】
【作用】このように構成されたフリーパターン型表示装
置のスクロール回路によれば、通常の上の一方向のシフ
トレジスタを使用して、表示データをシフト方向と逆の
下にスクロールすることができる。なお、16ビットと
いう単位は、通常メモリの表示データをワードデータ
(16ビット)で扱っていることと、表示ブロックの構
成が16×16ドットであることから一例として挙げて
いる。
置のスクロール回路によれば、通常の上の一方向のシフ
トレジスタを使用して、表示データをシフト方向と逆の
下にスクロールすることができる。なお、16ビットと
いう単位は、通常メモリの表示データをワードデータ
(16ビット)で扱っていることと、表示ブロックの構
成が16×16ドットであることから一例として挙げて
いる。
【0008】
【実施例】以下、本発明の一実施例を図面を用いて説明
する。 (第1の実施例)図1は本発明の第1の実施例を示す構
成を示す概念図である。ここで1a〜1fは図6に示す
表示データの走査を行う、16×16ドットの表示ブロ
ックである。シフトレジスタ3a〜3f、予備シフトレ
ジスタ5はパラレルイン且つシリアルイン・シリアルア
ウトの16ビットシフトレジスタである(SN74LS165
等)。シフトクロック制御部4aは、1ワードパラレル
データを表示データメモリ2からシフトレジスタ3a〜
3f、予備シフトレジスタ5に入力し、所定数シフト
し、シリアルデータSD1を表示ブロック1に転送す
る。さらに、それらを制御するデータシフトクロック信
号〜を発生する。
する。 (第1の実施例)図1は本発明の第1の実施例を示す構
成を示す概念図である。ここで1a〜1fは図6に示す
表示データの走査を行う、16×16ドットの表示ブロ
ックである。シフトレジスタ3a〜3f、予備シフトレ
ジスタ5はパラレルイン且つシリアルイン・シリアルア
ウトの16ビットシフトレジスタである(SN74LS165
等)。シフトクロック制御部4aは、1ワードパラレル
データを表示データメモリ2からシフトレジスタ3a〜
3f、予備シフトレジスタ5に入力し、所定数シフト
し、シリアルデータSD1を表示ブロック1に転送す
る。さらに、それらを制御するデータシフトクロック信
号〜を発生する。
【0009】表示データを表示ブロック1にセットする
シーケンスを以下に示す。 (1)表示データメモリ2から、1ワードデータを各シ
フトレジスタ3a〜3f、予備シフトレジスタ5に入力
する。 (2)データシフトクロック信号〜を発生し、その
シリアルデータSD2をカスケード接続されたシフトレ
ジスタ3a〜3f、予備シフトレジスタ5に所定ビット
シフトする。 (3)必要に応じて、再び表示データメモリ2から、1
ワードデータを各シフトレジスタ3a〜3f、予備シフ
トレジスタ5に入力する。 (4)上記(2)、(3)の操作は、個々のシフトレジ
スタ3a〜3f、予備シフトレジスタ5で行い、所定の
内容になるまで繰り返す。 (5)データシフトクロック信号により、各シフトレ
ジスタ3a〜3fのシリアルデータSD1を表示ブロッ
ク1a〜1fに転送する。
シーケンスを以下に示す。 (1)表示データメモリ2から、1ワードデータを各シ
フトレジスタ3a〜3f、予備シフトレジスタ5に入力
する。 (2)データシフトクロック信号〜を発生し、その
シリアルデータSD2をカスケード接続されたシフトレ
ジスタ3a〜3f、予備シフトレジスタ5に所定ビット
シフトする。 (3)必要に応じて、再び表示データメモリ2から、1
ワードデータを各シフトレジスタ3a〜3f、予備シフ
トレジスタ5に入力する。 (4)上記(2)、(3)の操作は、個々のシフトレジ
スタ3a〜3f、予備シフトレジスタ5で行い、所定の
内容になるまで繰り返す。 (5)データシフトクロック信号により、各シフトレ
ジスタ3a〜3fのシリアルデータSD1を表示ブロッ
ク1a〜1fに転送する。
【0010】(下スクロールのシーケンス1)図4によ
り、表示部の表示ブロック1aにB、表示ブロック1b
にAが表示されいる状態から、上から下にCが表示され
る形態を説明する。 (1)表示データメモリ2から、シフトレジスタ3aに
C1、シフトレジスタ3bにB1、予備シフトレジスタ
5にA1を、それぞれパラレル入力する(図4
(a))。 (2)シフトレジスタ3a、シフトレジスタ3b、予備
シフトレジスタ5を上方向に、所定数、例えば15ビッ
トシフトする(図4(b))。この操作により、シフト
レジスタ3aには、B1の上部のb2−4と、C1の下
部であるc1が記憶される。 (3)シフトレジスタ3aのシリアルデータ(b2−
4、c1)を表示ブロック1aに、シフトレジスタ3b
のシリアルデータ(a2−4、b1)を表示ブロック1
aにシリアル転送する(図4(c))。 (4)(1)〜(3)の操作をm列分繰り返し行い、表
示する(図4(d))。
り、表示部の表示ブロック1aにB、表示ブロック1b
にAが表示されいる状態から、上から下にCが表示され
る形態を説明する。 (1)表示データメモリ2から、シフトレジスタ3aに
C1、シフトレジスタ3bにB1、予備シフトレジスタ
5にA1を、それぞれパラレル入力する(図4
(a))。 (2)シフトレジスタ3a、シフトレジスタ3b、予備
シフトレジスタ5を上方向に、所定数、例えば15ビッ
トシフトする(図4(b))。この操作により、シフト
レジスタ3aには、B1の上部のb2−4と、C1の下
部であるc1が記憶される。 (3)シフトレジスタ3aのシリアルデータ(b2−
4、c1)を表示ブロック1aに、シフトレジスタ3b
のシリアルデータ(a2−4、b1)を表示ブロック1
aにシリアル転送する(図4(c))。 (4)(1)〜(3)の操作をm列分繰り返し行い、表
示する(図4(d))。
【0011】(下スクロールのシーケンス2)次に、表
示データがsビット単位(例えば、1ビット)に下スク
ロールするシーケンスを、図5により説明する。 (1)シフトレジスタ3aにDを、シフトレジスタ3
b、3c、及び予備シフトレジスタ5にクリアデータを
セットする(図5(b))。 (2)シフトレジスタ3a、シフトレジスタ3b、3
c、及び予備シフトレジスタ5のシリアルデータを上に
16−s=15ビットシフトする(s=1)。 (3)(1)、(2)の操作をm列分行い、1回目の表
示出力とする。 (4)第2の制御装置により、(2)の上にシフトする
所定数を14ビットとし、(1)〜(3)の操作を行う
(図5(d)、図5(e))。 (5)第2の制御装置のより、sを1ビット単位で増や
すことにより、表示部の表示データ(画面)が下にスク
ロールすることとなる。なお、s=16で上のシフト数
は0となり、(1)で入力したデータをそのまま、16
回目の表示出力とする。 (6)シフトレジスタ3aにCを、シフトレジスタ3b
にDを、3c、及び予備シフトレジスタ5にクリアデー
タをセットする(図5(g))。 (7)シフトレジスタ3a、シフトレジスタ3b、3
c、及び予備シフトレジスタ5のシリアルデータを上に
16−s=15ビットシフトする(s=1)。 (8)(1)、(2)の操作を列分行い、17回目の表
示出力とする(図5(h))。 (9)同様の操作により、Dが2ビット消えた16×3
+2回目の表示出力がえられる(図5(j))。
示データがsビット単位(例えば、1ビット)に下スク
ロールするシーケンスを、図5により説明する。 (1)シフトレジスタ3aにDを、シフトレジスタ3
b、3c、及び予備シフトレジスタ5にクリアデータを
セットする(図5(b))。 (2)シフトレジスタ3a、シフトレジスタ3b、3
c、及び予備シフトレジスタ5のシリアルデータを上に
16−s=15ビットシフトする(s=1)。 (3)(1)、(2)の操作をm列分行い、1回目の表
示出力とする。 (4)第2の制御装置により、(2)の上にシフトする
所定数を14ビットとし、(1)〜(3)の操作を行う
(図5(d)、図5(e))。 (5)第2の制御装置のより、sを1ビット単位で増や
すことにより、表示部の表示データ(画面)が下にスク
ロールすることとなる。なお、s=16で上のシフト数
は0となり、(1)で入力したデータをそのまま、16
回目の表示出力とする。 (6)シフトレジスタ3aにCを、シフトレジスタ3b
にDを、3c、及び予備シフトレジスタ5にクリアデー
タをセットする(図5(g))。 (7)シフトレジスタ3a、シフトレジスタ3b、3
c、及び予備シフトレジスタ5のシリアルデータを上に
16−s=15ビットシフトする(s=1)。 (8)(1)、(2)の操作を列分行い、17回目の表
示出力とする(図5(h))。 (9)同様の操作により、Dが2ビット消えた16×3
+2回目の表示出力がえられる(図5(j))。
【0012】
【発明の効果】以上説明したように本発明のフリーパタ
ーン型表示装置のスクロール回路によれば、表示データ
をパラレル入力するシフトレジスタ、及び予備シフトレ
ジスタと、各レジスタのシリアルデータをk−sビット
上にシフトした後、表示ブロックに転送し、表示する第
1の制御装置と、そのsを表示毎に、インクリメントす
る第2の制御装置を備えた。そのため、各段毎のデータ
走査方法を生かしたまま、表示の切り換え速度を上げる
ことができ、しかも通常の一方向のレジスタを使用でき
る。
ーン型表示装置のスクロール回路によれば、表示データ
をパラレル入力するシフトレジスタ、及び予備シフトレ
ジスタと、各レジスタのシリアルデータをk−sビット
上にシフトした後、表示ブロックに転送し、表示する第
1の制御装置と、そのsを表示毎に、インクリメントす
る第2の制御装置を備えた。そのため、各段毎のデータ
走査方法を生かしたまま、表示の切り換え速度を上げる
ことができ、しかも通常の一方向のレジスタを使用でき
る。
【図1】本発明の第1の実施例の構成図である。
【図2】本発明の第1の実施例による下スクロール表示
を示す図である。
を示す図である。
【図3】本発明の一実施例のデータの流れを示す図であ
る。
る。
【図4】本発明の下スクロールのデータの流れを示す図
である。
である。
【図5】下スクロールのアルゴリズムを示す図である。
【図6】表示装置のデータの走査方向を示す図である。
【図7】従来の表示装置のデータの表示方法を示す図で
ある。
ある。
【図8】フリーパターン表示型の表示装置の表示例を示
した図であり、ドット単位を説明するためのものであ
る。
した図であり、ドット単位を説明するためのものであ
る。
1 表示ブロック。 2 表示データメモリ。 3 シフトレジスタ。 4 第1の制御装置。 5 予備シフトレジスタ。 6 第2の制御装置。
Claims (1)
- 【請求項1】 n行×m列のドットマトリックス状に配
列された表示素子を有し、列(または行)にそって、表
示データが順次入力され、かつ、その表示データが順次
記憶される複数の表示ブロック(1)と、表示する全て
の表示データを格納する表示データメモリ(2)とを備
えたフリーパターン型表示装置のスクロール回路におい
て、 出力が次段の入力に接続され、かつ前記複数の表示ブロ
ックの列(または行)にそれぞれ接続されていて、接続
された前記列(または行)のドットと同数のkビットを
有する複数のシフトレジスタ(3)と、出力が前記シフ
トレジスタの初段の入力に接続され、kビットを有する
予備シフトレジスタ(5)と、前記表示データメモリか
らそれぞれの所望のkビットを選び、その表示データを
前記複数のシフトレジスタ及び予備シフトレジスタのそ
れぞれに入力し、次段のシフトレジスタにk−s(s:
整数)ビットシフト後、それぞれの表示ブロックに転送
する操作を表示する列分繰り返す第1の制御装置(4)
と、前記sを加算(s=s+x(x:整数))し、第1
の制御装置の動作を繰り返す第2の制御装置(6)とを
備えたことを特徴とするフリーパターン型表示装置のス
クロール回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4181660A JPH064066A (ja) | 1992-06-16 | 1992-06-16 | フリーパターン型表示装置のスクロール回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4181660A JPH064066A (ja) | 1992-06-16 | 1992-06-16 | フリーパターン型表示装置のスクロール回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH064066A true JPH064066A (ja) | 1994-01-14 |
Family
ID=16104641
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4181660A Pending JPH064066A (ja) | 1992-06-16 | 1992-06-16 | フリーパターン型表示装置のスクロール回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH064066A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3001975U (ja) * | 1994-03-14 | 1994-09-06 | 日本デンヨー株式会社 | 通行制御用表示器 |
-
1992
- 1992-06-16 JP JP4181660A patent/JPH064066A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3001975U (ja) * | 1994-03-14 | 1994-09-06 | 日本デンヨー株式会社 | 通行制御用表示器 |
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