JPH06343165A - Transmitter - Google Patents
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- JPH06343165A JPH06343165A JP5130750A JP13075093A JPH06343165A JP H06343165 A JPH06343165 A JP H06343165A JP 5130750 A JP5130750 A JP 5130750A JP 13075093 A JP13075093 A JP 13075093A JP H06343165 A JPH06343165 A JP H06343165A
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- Synchronisation In Digital Transmission Systems (AREA)
- Television Receiver Circuits (AREA)
Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明は、例えば映像及び音声信
号をシリアルインターフェースを用いて伝送する伝送装
置に適用して好適な伝送装置に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a transmission device suitable for application to, for example, a transmission device for transmitting video and audio signals using a serial interface.
【0002】[0002]
【従来の技術】映像及び音声信号を例えばAS/EBU
等のシリアルインターフェースを用いて伝送する伝送装
置としては例えば図5に示すようなものがある。この図
5に示す伝送装置は図示しない信号源から入力端子1を
介して供給される映像及び音声データを受信回路2で受
信した後に、映像データを映像処理回路3に、音声デー
タを音声処理回路4に供給し、映像処理回路3において
映像データに各種処理を施し、音声処理回路4において
音声データに各種処理を施し、この後これら映像及び音
声データを送信回路5でシリアルデータに変換して出力
端子6を介して送信する。2. Description of the Related Art Video and audio signals are transmitted, for example, to AS / EBU.
As a transmission device for transmission using a serial interface such as the one shown in FIG. The transmission device shown in FIG. 5 receives video and audio data supplied from a signal source (not shown) through the input terminal 1 at the receiving circuit 2, and then sends the video data to the video processing circuit 3 and the audio data to the audio processing circuit. 4, the video processing circuit 3 performs various types of processing on the video data, the audio processing circuit 4 performs various types of processing on the audio data, and then the transmission circuit 5 converts the video and audio data into serial data and outputs the serial data. Transmit via terminal 6.
【0003】このとき、送信回路5は図6に示すよう
に、音声データAdを水平ブランキング期間Hbtの区
間に挿入して送信する。つまり、水平走査線期間Ht内
に映像データVdとこれに対応する音声データAdが含
まれる。At this time, the transmission circuit 5 inserts the voice data Ad into the section of the horizontal blanking period Hbt and transmits it, as shown in FIG. That is, the video data Vd and the audio data Ad corresponding thereto are included in the horizontal scanning line period Ht.
【0004】また、図6に示すように、映像データVd
には、映像データVdの先頭を示すSAV(Start
of Active Video)及び映像データの
終わりを示すEAV(End of Active V
ideo)が付加される。また、図7に示すように、映
像データのタイムコードTcがフィールド期間Vtの垂
直ブランキング期間Vbtに付加される。Further, as shown in FIG. 6, video data Vd
Indicates SAV (Start) indicating the beginning of the video data Vd.
of Active Video) and EAV (End of Active V) indicating the end of video data
video) is added. Further, as shown in FIG. 7, the time code Tc of the video data is added to the vertical blanking period Vbt of the field period Vt.
【0005】ところで、シリアルインターフェース規格
としてはSMPTE 259Mがあるが、これにおいて
は伝送誤りを検出する方法は定められていなかった。し
かしながら、最近になってEDH(エラー検出ハンドリ
ング)と称して映像1フィール単位でチェックワードを
補助データとして付加する方法が提案されて規格化され
ている。By the way, there is SMPTE 259M as a serial interface standard, but a method for detecting a transmission error has not been defined therein. However, recently, a method called EDH (Error Detection Handling) for adding a check word as auxiliary data in units of one image field has been proposed and standardized.
【0006】[0006]
【発明が解決しようとする課題】ところで、上述のよう
なシリアルインターフェースを用いて映像及び音声デー
タを伝送する際に、回路での処理によって映像と音声の
位相がずれてしまうという不都合が生じる。By the way, when transmitting video and audio data using the serial interface as described above, there is a problem that the phase of the video and the audio is deviated by the processing in the circuit.
【0007】図7に示すように、元の映像及び音声デー
タの位相の関係が映像データVdの先頭に対して音声デ
ータAs1のような関係になっていた場合、映像処理回
路3及び音声処理回路4での処理時間の違いにより、伝
送する際に映像データVdと音声データAs2の関係の
ように元の位相関係がずれたものとなってしまう。As shown in FIG. 7, when the relationship between the phases of the original video and audio data is such that the head of the video data Vd is the audio data As1, the video processing circuit 3 and the audio processing circuit. Due to the difference in the processing time in No. 4, the original phase relationship, such as the relationship between the video data Vd and the audio data As2, is shifted during transmission.
【0008】この映像と音声の位相差が大きくなった場
合に生じる問題として最も分かりやすい例としては、人
が会話を行ったり、歌を歌ったりしているときの映像及
び音声の関係、即ち、リップシンクというものがある。
リップシンクが合っていないと人の口の動きと実際に出
力される音声の関係が一致しない等の不都合が生じる。The most obvious example of the problem that occurs when the phase difference between the image and the sound becomes large is the relationship between the image and the sound when a person is having a conversation or singing, that is, There is something called lip sync.
If the lip sync does not match, there arises inconvenience such as the relationship between the movement of the person's mouth and the voice actually output does not match.
【0009】また、上述した伝送装置において映像1フ
ィールド単位でチェックワードを補助データとして付加
する方法を採用した場合、あくまで補助データとしての
規定であるので、全ての機器で用いられる可能性は低い
ので、これについての機器間の互換性をとることができ
ない。また、チェックワードが1フィールド単位であ
り、従って誤りが検出されてもフィールド内での誤りの
位置を検出することができないので、伝送誤りを含む映
像データを修整することができない等の不都合があっ
た。Further, when the method of adding a check word as auxiliary data in video 1 field unit is adopted in the above-mentioned transmission apparatus, since it is defined as auxiliary data, it is unlikely to be used in all devices. , It is not possible to take compatibility between devices on this. Further, since the check word is in units of one field, and therefore, even if an error is detected, the position of the error in the field cannot be detected, so that there is a disadvantage that the video data including the transmission error cannot be corrected. It was
【0010】更に、上述した伝送装置においては、タイ
ムコードを1フィールドに1回だけ伝送するようにして
いるので、伝送エラーが発生してタイムコードが破壊さ
れると、このタイムコードに対応する映像及び音声デー
タを正しく伝送できなくなる等の不都合があった。Further, in the above-mentioned transmission device, since the time code is transmitted only once in one field, when a transmission error occurs and the time code is destroyed, the video corresponding to this time code is transmitted. Also, there are inconveniences such that the audio data cannot be transmitted correctly.
【0011】本発明はこのような点を考慮してなされた
もので、映像及び音声データの位相が元の位相関係を維
持できるようにすると共に、伝送誤りを含む映像データ
を修整することができ、しかもタイムコードに対応する
映像及び音声データを正しく伝送することのできる伝送
装置を提案しようとするものである。The present invention has been made in consideration of the above points, and makes it possible to maintain the original phase relationship between the phases of video and audio data and to correct video data including transmission errors. Moreover, the present invention is intended to propose a transmission device capable of correctly transmitting video and audio data corresponding to a time code.
【0012】[0012]
【課題を解決するための手段】本発明は、映像及び音声
信号発生源11及び13と、音声信号発生源13からの
音声信号に映像信号発生源11からの映像信号のフィー
ルド或いはフレームの先頭を示すフラグを付加するフラ
グ付加手段15と、映像及び音声信号発生源11及び1
3からの映像及び音声信号をシリアル化するシリアル化
手段12と、シリアル化手段12からのシリアル信号中
の映像信号及びフラグに基いて遅延量を制御する制御手
段25と、この制御手段25の出力に基いて音声信号の
位相を映像信号の位相に合わせる位相制御手段21、2
4とを有するものである。According to the present invention, video and audio signal sources 11 and 13 and the beginning of the field or frame of the video signal from the video signal source 11 are added to the audio signal from the audio signal source 13. Flag adding means 15 for adding the indicated flag, and video and audio signal generation sources 11 and 1
3, serializing means 12 for serializing the video and audio signals, the control means 25 for controlling the delay amount based on the video signal and the flag in the serial signal from the serializing means 12, and the output of the control means 25. Phase control means 21, 2 for adjusting the phase of the audio signal to the phase of the video signal based on
4 and.
【0013】また本発明は、映像及び音声信号発生源1
1及び13と、映像及び音声信号発生源11及び13か
らの映像及び音声信号をシリアル化するシリアル化手段
12と、このシリアル化手段12からのシリアル信号の
内の映像信号に対して少なくとも1水平周期毎にエラー
検出用の信号を付加するエラー検出信号付加手段16
と、エラー検出信号付加手段16によって付加されたエ
ラー検出信号によってシリアル化手段12からのシリア
ルデータの内の映像信号のエラー検出を行うエラー検出
手段20、23とを有するものである。The present invention also provides a video and audio signal generator 1
1 and 13, a serializing means 12 for serializing the video and audio signals from the video and audio signal generating sources 11 and 13, and at least one horizontal to the video signal of the serial signals from the serializing means 12. Error detection signal adding means 16 for adding a signal for error detection every cycle
And error detecting means 20 and 23 for detecting an error in the video signal in the serial data from the serializing means 12 based on the error detecting signal added by the error detecting signal adding means 16.
【0014】また本発明は、映像及び音声信号発生源1
1及び13と、映像及び音声信号発生源11及び13か
らの映像及び音声信号をシリアル化するシリアル化手段
12と、映像信号発生源11からの映像信号の再生位置
に応じてタイムコードを1フィールドに少なくとも2回
以上出力するタイムコード発生手段10とを有するもの
である。The present invention also provides a video and audio signal generator 1
1 and 13, a serializing means 12 for serializing the video and audio signals from the video and audio signal generation sources 11 and 13, and a time code of one field according to the reproduction position of the video signal from the video signal generation source 11. And a time code generating means 10 for outputting at least twice.
【0015】[0015]
【作用】上述せる本発明の構成によれば、音声信号発生
源13からの音声信号にフラグ付加手段15で映像信号
発生源11からの映像信号のフィールド或いはフレーム
の先頭を示すフラグを付加し、この映像及び音声信号を
シリアル化手段12でシリアル化し、このシリアル信号
中の映像信号及びフラグに基いて制御手段25で遅延量
を制御し、位相制御手段21、24で音声信号の位相を
映像信号の位相に合わせる。According to the structure of the present invention described above, the flag adding means 15 adds a flag indicating the beginning of the field or frame of the video signal from the video signal generating source 11 to the audio signal from the audio signal generating source 13. The video and audio signals are serialized by the serialization means 12, the delay amount is controlled by the control means 25 based on the video signal and the flag in the serial signal, and the phase of the audio signals is controlled by the phase control means 21, 24. Match the phase of.
【0016】また上述せる本発明の構成によれば、映像
及び音声信号発生源11及び13からの映像及び音声信
号をシリアル化手段12でシリアル化し、このシリアル
信号の内の映像信号に対してエラー検出信号付加手段1
6で少なくとも1水平周期毎にエラー検出用の信号を付
加し、このエラー検出信号によって映像信号のエラー検
出をエラー検出手段20、23で行う。Further, according to the above-described configuration of the present invention, the video and audio signals from the video and audio signal generation sources 11 and 13 are serialized by the serializing means 12, and an error is generated with respect to the video signal of the serial signals. Detection signal adding means 1
At 6, an error detection signal is added at least every horizontal period, and the error detection means 20 and 23 detect an error in the video signal based on the error detection signal.
【0017】また上述せる本発明の構成によれば、映像
及び音声信号発生源11及び13からの映像及び音声信
号をシリアル化手段12でシリアル化し、タイムコード
発生手段10で映像信号発生源11からの映像信号の再
生位置に応じてタイムコードを1フィールドに少なくと
も2回以上出力する。According to the configuration of the present invention described above, the video and audio signals from the video and audio signal sources 11 and 13 are serialized by the serializing means 12 and the time code generating means 10 outputs the video and audio signals from the video signal generating source 11. The time code is output at least twice in one field according to the reproduction position of the video signal.
【0018】[0018]
【実施例】以下に、図1及び図2を参照して本発明伝送
装置の一実施例について詳細に説明する。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of the transmission apparatus of the present invention will be described in detail below with reference to FIGS.
【0019】先ず図1を参照して送信側から説明する。
この図1において図5と対応する部分には同一符号を付
し、その詳細説明を省略する。First, the transmission side will be described with reference to FIG.
In FIG. 1, parts corresponding to those in FIG. 5 are designated by the same reference numerals, and detailed description thereof will be omitted.
【0020】図において、10はタイムコード発生回路
で、例えば1水平期間(水平ブランキング期間)毎、或
いは1フィールド期間(垂直ブランキング期間)に3回
以上マルチプレクス動作によって発生したタイムコード
をシリアル化回路12に供給する。In the figure, 10 is a time code generation circuit, which serially outputs a time code generated by multiplex operation three or more times in one horizontal period (horizontal blanking period) or in one field period (vertical blanking period). Supply to the digitization circuit 12.
【0021】11は映像処理部で、例えばこの送信側が
VTRの場合、図示しないビデオテープカセットに映像
信号や音声信号を記録するための機構で再生した映像信
号に所定の信号処理を施した後、フラグ付加回路15及
びシリアル化回路12に夫々供給する。ここで、シリア
ルインターフェースとしてはAS/EBUを用いるもの
とする。Reference numeral 11 denotes a video processing unit, for example, when the transmitting side is a VTR, after subjecting the video signal reproduced by a mechanism for recording a video signal or an audio signal to a video tape cassette (not shown) to a predetermined signal processing, It is supplied to the flag addition circuit 15 and the serialization circuit 12, respectively. Here, AS / EBU is used as the serial interface.
【0022】13は音声処理部で、例えばこの送信側が
VTRの場合、図示しないビデオテープカセットに映像
データや音声データを記録するための機構で再生した音
声データに所定の信号処理を施した後、パケット化回路
14に供給する。このパケット化回路14は音声処理部
13からの音声データを圧縮してパケット化する。この
パケット化された音声データはフラグ付加回路15に供
給される。Reference numeral 13 denotes an audio processing unit, for example, when the transmitting side is a VTR, after performing a predetermined signal processing on the audio data reproduced by a mechanism for recording video data and audio data in a video tape cassette (not shown), It is supplied to the packetizing circuit 14. The packetizing circuit 14 compresses the audio data from the audio processing unit 13 into packets. The packetized voice data is supplied to the flag addition circuit 15.
【0023】フラグ付加回路15は映像処理部11から
の映像信号から(映像信号の垂直同期信号から)フィー
ルドを検出し、映像データのフィールドの先頭に対応す
る音声処理部13からの音声データにフィールドの先頭
を示すフラグを付加し、このフラグを付加した音声デー
タをシリアル化回路12に供給する。The flag adding circuit 15 detects a field from the video signal from the video processing unit 11 (from the vertical synchronizing signal of the video signal), and adds the field to the audio data from the audio processing unit 13 corresponding to the beginning of the field of the video data. Is added to the serialization circuit 12. The audio data to which the flag is added is supplied to the serialization circuit 12.
【0024】シリアル化回路12は映像処理部11から
の映像データ及びフラグ付加回路15からのフィールド
の先頭を示すフラグが付加された音声データをシリアル
化する。このときシリアル化回路12は、タイムコード
発生回路10からのタイムコードを映像データのライン
毎、或いは垂直ブランキング期間内に3回以上付加した
後にCRC付加回路16に供給する。The serializing circuit 12 serializes the video data from the video processing section 11 and the audio data to which the flag indicating the head of the field from the flag adding circuit 15 is added. At this time, the serialization circuit 12 supplies the time code from the time code generation circuit 10 to the CRC addition circuit 16 after adding the time code for each line of the video data or three times or more within the vertical blanking period.
【0025】CRC(Cyclic Redundan
cy Check)付加回路16はシリアル化回路12
からのシリアルデータに対して後述するCRC計算回路
で得たCRCコードを付加した後に出力端子17を介し
て伝送する。CRC (Cyclic Redundan)
The cy check) addition circuit 16 is a serialization circuit 12
A CRC code obtained by a CRC calculation circuit, which will be described later, is added to the serial data from and then transmitted through the output terminal 17.
【0026】ここで、図3を参照してCRC付加回路1
6内のCRC計算回路構成の一例について説明する。図
3に示すように、CRC付加回路16内部のCRC計算
回路はレジスタR0〜R3をカスケード接続し、レジス
タR4〜R10をカスケード接続し、レジスタR11〜
R15をカスケード接続し、レジスタR0の出力端を加
算回路(エクスクルーシブ・オア回路)28の一方の入
力端に接続し、レジスタR3の入力端を加算回路(エク
スクルーシブ・オア回路)29の出力端に接続し、加算
回路29の一方の入力端をレジスタR4の出力端に接続
し、レジスタR10の入力端を加算回路(エクスクルー
シブ・オア回路)30の出力端に接続し、加算回路30
の一方の入力端にレジスタR11の出力端を接続し、レ
ジスタR15の入力端、加算回路29及び30の他方の
入力端に夫々加算回路28の出力端を接続し、加算回路
28の他方の入力端に図1に示したシリアル化回路12
からのシリアルデータが供給される入力端子27を接続
し、レジスタR0〜R15の他方の出力端をパラレル−
シリアル変換回路31の入力端に接続し、このパラレル
−シリアル変換回路31の出力端を図1にも示した出力
端子32に接続して構成する。Here, referring to FIG. 3, the CRC adding circuit 1
An example of the CRC calculation circuit configuration in 6 will be described. As shown in FIG. 3, the CRC calculation circuit in the CRC adding circuit 16 cascades the registers R0 to R3, cascades the registers R4 to R10, and registers R11 to R11.
R15 is connected in cascade, the output end of the register R0 is connected to one input end of the adder circuit (exclusive OR circuit) 28, and the input end of the register R3 is connected to the output end of the adder circuit (exclusive OR circuit) 29. Then, one input end of the adder circuit 29 is connected to the output end of the register R4, the input end of the register R10 is connected to the output end of the adder circuit (exclusive OR circuit) 30, and the adder circuit 30 is connected.
The output end of the register R11 is connected to one input end of the register R15, the output end of the adder circuit 28 is connected to the other input end of the adder circuits 29 and 30, and the other input of the adder circuit 28 is connected. At the end, the serialization circuit 12 shown in FIG.
Connected to the input terminal 27 to which serial data is supplied, and the other output terminals of the registers R0 to R15 are connected in parallel-
The input terminal of the serial conversion circuit 31 is connected, and the output terminal of the parallel-serial conversion circuit 31 is connected to the output terminal 32 also shown in FIG.
【0027】次に、図1に示した伝送装置の送信側の動
作について説明する。ビデオ処理部11からの映像デー
タがシリアル化回路12及びフラグ付加回路15に供給
されると共に、ライン毎、或いは1フィールド毎にタイ
ムコード発生回路10からのタイムコードが少なくとも
3回以上(連続しても所定間隔離れていても良い)シリ
アル化回路12に供給される。Next, the operation of the transmission side of the transmission device shown in FIG. 1 will be described. The video data from the video processing unit 11 is supplied to the serialization circuit 12 and the flag addition circuit 15, and the time code from the time code generation circuit 10 is at least three times (continuously) for each line or each field. May be separated by a predetermined distance) to the serialization circuit 12.
【0028】一方、音声処理回路13からの音声信号が
パケット化回路14に供給され、このパケット化回路1
4において圧縮処理によってパケット化された後にフラ
グ付加回路15に供給される。フラグ付加回路15にお
いては映像処理部11からの映像信号に基いてフィール
ドの先頭が検出され、その検出されたフィールドの先頭
に対応する音声データの前にフラグを付加し、フラグを
付加した音声データをシリアル化回路12に供給する。On the other hand, the voice signal from the voice processing circuit 13 is supplied to the packetizing circuit 14, and the packetizing circuit 1
After being packetized by compression processing in 4, the data is supplied to the flag addition circuit 15. In the flag adding circuit 15, the head of the field is detected based on the video signal from the video processing unit 11, the flag is added before the audio data corresponding to the detected head of the field, and the flag-added audio data is added. Is supplied to the serialization circuit 12.
【0029】シリアル化回路12においては映像処理部
11からの映像データと音声処理部13からの音声デー
タをシリアルデータにすると共に、タイムコード発生回
路10からのタイムコードを付加した後にCRC付加回
路16に供給する。In the serialization circuit 12, the video data from the video processing unit 11 and the audio data from the audio processing unit 13 are converted into serial data, and the time code from the time code generation circuit 10 is added and then the CRC adding circuit 16 is added. Supply to.
【0030】シリアルデータは図3に示した例えば16
個のレジスタR0〜R15と加算回路28、29及び3
0とパラレル−シリアル変換回路31からなるCRC付
加回路16内のCRC計算回路に入力端子27を介して
供給される。入力端子27を介してCRC付加回路16
内のCRC計算回路に供給されたシリアルデータは加算
回路28で加算された後に加算回路29、30及びレジ
スタR15に夫々供給される。レジスタR15に供給さ
れたシリアルデータは順次レジスタR14〜R11に供
給され、更に加算回路30において加算処理され、次に
レジスタR10〜R4に順次供給された後に加算回路2
9に供給されて加算処理され、更にレジスタR3〜R0
に順次供給された後に再び加算回路28に供給される。The serial data is, for example, 16 data shown in FIG.
Individual registers R0 to R15 and adder circuits 28, 29 and 3
0 and the CRC calculation circuit in the CRC addition circuit 16 including the parallel-serial conversion circuit 31 are supplied via the input terminal 27. CRC addition circuit 16 via input terminal 27
The serial data supplied to the CRC calculation circuit therein is added by the adder circuit 28 and then supplied to the adder circuits 29 and 30 and the register R15, respectively. The serial data supplied to the register R15 is sequentially supplied to the registers R14 to R11, further subjected to addition processing in the adding circuit 30, and then sequentially supplied to the registers R10 to R4, and then to the adding circuit 2.
9 and is subjected to addition processing, and further registers R3 to R0
Are sequentially supplied to the adder circuit 28 and then to the adder circuit 28 again.
【0031】そしてこの処理が一定時間繰り返され各レ
ジスタR0〜R15の出力がパラレル−シリアル変換回
路31に供給される。このパラレル−シリアル変換回路
31に供給されたパラレルデータはシリアルデータに変
換され、これがCRCコードとされる。生成されたCR
Cコードは出力端子32を介して出力され、CRC付加
回路16内において映像データに付加される。このCR
Cコードが付加された映像データは出力端子17を介し
て図2に示す受信側に伝送される。Then, this process is repeated for a fixed time, and the outputs of the registers R0 to R15 are supplied to the parallel-serial conversion circuit 31. The parallel data supplied to the parallel-serial conversion circuit 31 is converted into serial data, which is used as a CRC code. Generated CR
The C code is output through the output terminal 32 and added to the video data in the CRC adding circuit 16. This CR
The video data to which the C code is added is transmitted to the receiving side shown in FIG. 2 via the output terminal 17.
【0032】図4は図1に示した送信側でのフォーマッ
トを示し、この図4に示すように、水平走査線期間Ht
内において、映像データVdの先頭にはSAVが付加さ
れ、その末尾にはEAVが付加され、更にCRCコード
が付加される。図3に示したCRC付加回路16におけ
るCRCコードの計算処理は、先ず、この図4に示す時
点aで全てのレジスタR0〜R15のリセットが行われ
た後、上述のような処理が行われ、時点bで水平走査線
期間Htに対するCRCコードの計算を終了するという
ものである。FIG. 4 shows the format on the transmitting side shown in FIG. 1. As shown in FIG. 4, the horizontal scanning line period Ht
In the figure, SAV is added to the head of the video data Vd, EAV is added to the end thereof, and a CRC code is further added. In the CRC code calculation process in the CRC addition circuit 16 shown in FIG. 3, first, at a time point a shown in FIG. 4, all the registers R0 to R15 are reset, and then the process described above is performed. The calculation of the CRC code for the horizontal scanning line period Ht is completed at the time point b.
【0033】また、この図4に示すように、例えばライ
ン毎にタイムコードTcを付加するのであれば、水平ブ
ランキング期間Hbt間に付加される。また、音声デー
タAdもこの期間Hbtに挿入される垂直ブランキング
期間でも良い)。また、タイムコードを垂直ブランキン
グ期間内に挿入する場合は、例えば音声データの前に3
つずつ、または前に1つ、後ろに2つ(またはこの逆)
挿入すれば良い。Further, as shown in FIG. 4, if the time code Tc is added for each line, for example, it is added during the horizontal blanking period Hbt. Further, the audio data Ad may also be a vertical blanking period inserted in this period Hbt). Also, when the time code is inserted within the vertical blanking period, for example, 3 before the audio data.
One at a time, or one at the front and two at the back (or vice versa)
Just insert it.
【0034】さて、図4に示すような構成のシリアルデ
ータは図2に示す受信側の入力端子18を介して受信回
路19に供給される。The serial data having the structure shown in FIG. 4 is supplied to the receiving circuit 19 through the input terminal 18 on the receiving side shown in FIG.
【0035】次に、図2を参照して受信側について説明
する。この図2において20は映像処理回路で各種映像
処理を行う回路の他に図示せずも内部に図3に示した回
路と同様のCRC計算回路、エラー修整回路及びタイム
コード多数決回路を有する。この映像処理回路20では
受信回路19からの映像データから内部のCRC計算回
路で図3で説明した処理と同様の処理によってCRCコ
ードを計算し、計算で得たCRCコードと、受信回路1
9からのCRCコードとを比較することで、映像データ
に伝送エラーがあるか否かを検出する。Next, the receiving side will be described with reference to FIG. In FIG. 2, reference numeral 20 includes a circuit for performing various kinds of video processing in the video processing circuit, and internally has a CRC calculation circuit, an error correction circuit and a time code majority decision circuit which are similar to the circuit shown in FIG. In this video processing circuit 20, a CRC code is calculated from the video data from the reception circuit 19 by the internal CRC calculation circuit by the same processing as described in FIG. 3, and the CRC code obtained by the calculation and the reception circuit 1
By comparing with the CRC code from No. 9, it is detected whether or not the video data has a transmission error.
【0036】そして伝送エラーがある場合にはエラー修
整回路によってエラーの修整を1ライン毎に行う。その
ラインのデータにエラーがあった場合、例えば前後のラ
インのデータを平均して得た新たなラインのデータで置
き換えたり、前のラインのデータで置き換えたりするこ
とによってエラーが出力されないようにする。If there is a transmission error, the error correction circuit corrects the error line by line. If there is an error in the data of that line, for example, replace the data of the previous and next lines with the data of the new line obtained by averaging, or replace with the data of the previous line to prevent the error from being output. .
【0037】また、伝送されてくるタイムコードをフィ
ールド毎に多数決を取り、最も多く受信した値のタイム
コードを正しいタイムコードとして採用する。尚、この
受信側から更に送信を行う場合においては、誤っている
タイムコードを全て正しいタイムコードに置き換えるよ
うにしても良い。実際に使用される伝送路は伝送エラー
レートが非常に低いので、複数回伝送した補助データと
してのタイムコードが2回以上エラーとなる確率は非常
に低い。従って、実際にはフィールド毎のタイムコード
の伝送回数を3回とし、2回以上伝送されたデータを正
しいデータとして採用することにより、実用上伝送エラ
ーのないタイムコードの伝送が可能となる。In addition, the majority of the transmitted time code is determined for each field, and the time code of the most received value is adopted as the correct time code. In the case of further transmitting from the receiving side, all erroneous time codes may be replaced with correct time codes. The transmission path actually used has a very low transmission error rate, and therefore the probability that the time code as auxiliary data transmitted a plurality of times will make an error more than once is very low. Therefore, by actually setting the number of times of transmitting the time code for each field to be three and adopting the data transmitted two or more times as correct data, it is possible to transmit the time code practically without a transmission error.
【0038】尚、この例ではタイムコードとしている
が、補助データであれば各種フラグやパラメータ等でも
良い。Although the time code is used in this example, various flags and parameters may be used as long as they are auxiliary data.
【0039】こうして処理された映像データは遅延回路
21及び制御回路24に夫々供給される。23は音声処
理回路で、図示せずも内部に図3に示した回路と同様の
CRC計算回路及びエラー修整回路を有する。この音声
処理回路23では受信回路19からの音声データから内
部のCRC計算回路で図3で説明した処理と同様の処理
によってCRCコードを計算し、計算で得たCRCコー
ドと、受信回路19からのCRCコードとを比較するこ
とで、音声データに伝送エラーがあるか否かを検出す
る。そして伝送エラーがある場合にはエラー修整回路に
よってエラーの修整を1ライン毎或いは1フィールドに
行う。そのラインのデータにエラーがあった場合、例え
ば前後のラインのデータを平均して得た新たなラインの
データで置き換えたり、前のラインのデータで置き換え
たりすることによってエラーが出力されないようにす
る。The video data processed in this way is supplied to the delay circuit 21 and the control circuit 24, respectively. Reference numeral 23 is a voice processing circuit, which has a CRC calculation circuit and an error correction circuit, which are similar to the circuit shown in FIG. In the voice processing circuit 23, a CRC code is calculated from the voice data from the receiving circuit 19 by the internal CRC calculating circuit by the same process as described in FIG. 3, and the CRC code obtained by the calculation and the receiving circuit 19 By comparing with the CRC code, it is detected whether or not the voice data has a transmission error. If there is a transmission error, the error correction circuit corrects the error line by line or field by field. If there is an error in the data of that line, for example, replace the data of the previous and next lines with the data of the new line obtained by averaging, or replace with the data of the previous line to prevent the error from being output. .
【0040】この音声処理回路23からの音声データは
遅延回路24及び制御回路25に夫々供給される。遅延
回路24は例えばFIFO(ファースト・イン・ファー
スト・アウト)等のメモリであり、遅延量を固定とす
る。つまり、書き込みに対する読み出しのタイミングを
固定とする。The audio data from the audio processing circuit 23 is supplied to the delay circuit 24 and the control circuit 25, respectively. The delay circuit 24 is, for example, a memory such as a FIFO (first in first out), and has a fixed delay amount. That is, the timing of reading with respect to writing is fixed.
【0041】遅延回路21は例えばFIFO等のメモリ
であり、遅延量を可変とする。つまり、書き込みに対す
る読み出しのタイミングを可変とする。The delay circuit 21 is, for example, a memory such as a FIFO and has a variable delay amount. That is, the timing of reading with respect to writing is variable.
【0042】制御回路25は映像処理回路20からの映
像データ及び音声処理回路23からの音声データに付加
されたフラグに基いて上述の遅延回路21の遅延時間、
つまり、書き込みに対する読み出しのタイミングを可変
する。The control circuit 25 determines the delay time of the delay circuit 21 based on the flags added to the video data from the video processing circuit 20 and the audio data from the audio processing circuit 23.
That is, the timing of reading with respect to writing is changed.
【0043】つまり、制御回路25は音声データのフラ
グを検出するまでは遅延回路21に書き込んだデータの
読み出しを停止しておき、フラグを検出した時に遅延回
路21に対して読み出しを開始するよう制御する。これ
によって遅延回路24から出力される音声データと遅延
回路21から出力される映像データの位相を合わせるこ
とができる。これら遅延回路21及び24からの映像及
び音声データは夫々送信回路22に供給され、この後出
力端子26を介して図示しない他の機器、或いはこの受
信側の回路を有する機器の他の回路に供給される。That is, the control circuit 25 stops the reading of the data written in the delay circuit 21 until the flag of the audio data is detected, and controls the delay circuit 21 to start the reading when the flag is detected. To do. As a result, the phases of the audio data output from the delay circuit 24 and the video data output from the delay circuit 21 can be matched. The video and audio data from the delay circuits 21 and 24 are respectively supplied to the transmission circuit 22 and then supplied to another device (not shown) or another circuit of a device having a circuit on the receiving side through the output terminal 26. To be done.
【0044】尚、出力端子26に接続された機器が映像
及び音声をモニタできる機器の場合、或いは出力端子2
6が映像用と2つの音声用の合計3つの端子とした場
合、或いは送信回路22の代わりに映像及び音声をモニ
タするための回路とした場合は、その映像と音声の位相
が合っているので、例えば人が話をしている映像とその
音声をモニタした場合、リップシンクが合っているの
で、映像と音声が一致し、非常に良好な視聴を行うこと
ができる。If the device connected to the output terminal 26 is a device capable of monitoring video and audio, or if the device connected to the output terminal 2
If 6 is a total of 3 terminals for video and 2 audio, or if it is a circuit for monitoring video and audio instead of the transmission circuit 22, the phases of the video and audio match. For example, when a video of a person talking and its audio are monitored, since the lip sync is matched, the video and the audio are matched, and very good viewing can be performed.
【0045】このように、本例においては、タイムコー
ドのような補助データをライン毎、或いはフィールド毎
に少なくとも3回以上付加し、ライン毎にCRCコード
を付加し、更に、フィールドの先頭に対応する音声デー
タにフラグを付加して伝送し、受信側でCRCコードに
よるエラー検出及びその修整を行い、また、タイムコー
ドの多数決によって正しいタイムコードを検出するよう
にし、更に音声データに付加したフラグを用いて映像デ
ータの遅延時間を可変して音声データと映像データの位
相を合わせるようにしたので、正しいタイムコードを得
ることによって正しいデータを伝送することができ、伝
送エラーを修整することができ、しかもリップシンクを
合わせることができ、これによって良好な映像及び音声
の伝送、再現を実現することができる。As described above, in this example, auxiliary data such as a time code is added to each line or each field at least three times or more, and a CRC code is added to each line. A flag is added to the voice data to be transmitted, the error is detected and corrected by the CRC code on the receiving side, and the correct time code is detected by majority decision of the time code. By using the variable delay time of the video data to match the phase of the audio data and the video data, the correct data can be transmitted by obtaining the correct time code and the transmission error can be corrected. In addition, the lip sync can be adjusted to achieve good video and audio transmission and reproduction. It can be.
【0046】また、上述の実施例は本発明の一例であ
り、本発明の要旨を逸脱しない範囲でその他様々な構成
が取り得ることは勿論である。The above-described embodiment is an example of the present invention, and it goes without saying that various other configurations can be adopted without departing from the gist of the present invention.
【0047】[0047]
【発明の効果】上述せる本発明によれば、音声信号発生
源からの音声信号にフラグ付加手段で映像信号発生源か
らの映像信号のフィールド或いはフレームの先頭を示す
フラグを付加し、この映像及び音声信号をシリアル化手
段でシリアル化し、このシリアル信号中の映像信号及び
フラグに基いて制御手段で遅延量を制御し、位相制御手
段で音声信号の位相を映像信号の位相に合わせるように
したので、リップシンクを合わせることができ、これに
よって良好な映像及び音声の伝送、再現を実現すること
ができる。According to the present invention described above, the flag indicating the beginning of the field or the frame of the video signal from the video signal source is added to the audio signal from the audio signal source by the flag adding means, and this video and Since the audio signal is serialized by the serialization means, the delay amount is controlled by the control means based on the video signal and the flag in the serial signal, and the phase of the audio signal is matched with the phase of the video signal by the phase control means. , And the lip sync can be adjusted, which enables good transmission and reproduction of video and audio.
【0048】また上述せる本発明によれば、映像及び音
声信号発生源からの映像及び音声信号をシリアル化手段
でシリアル化し、このシリアル信号の内の映像信号に対
してエラー検出信号付加手段で少なくとも1水平周期毎
にエラー検出用の信号を付加し、このエラー検出信号に
よって映像信号のエラー検出をエラー検出手段で行うよ
うにしたので、エラーを修整でき、これによって映像及
び音声の良好な伝送、再現を実現することができる。Further, according to the present invention described above, the video and audio signals from the video and audio signal generating source are serialized by the serializing means, and at least the error detection signal adding means is added to the video signal of the serial signals. A signal for error detection is added for each horizontal period, and the error detection means performs error detection of the video signal based on this error detection signal, so that the error can be corrected, and thereby good transmission of video and audio, Reproduction can be realized.
【0049】また上述せる本発明によれば、映像及び音
声信号発生源からの映像及び音声信号をシリアル化手段
でシリアル化し、タイムコード発生手段で映像信号発生
源からの映像信号の再生位置に応じてタイムコードを1
フィールドに少なくとも2回以上出力するようにしたの
で、データを正しく伝送できると共に、受信側で正しい
タイムコードを用いて正確な処理を行うことができる。Further, according to the present invention described above, the video and audio signals from the video and audio signal source are serialized by the serializing means, and the time code generating means determines the reproduction position of the video signal from the video signal source. And time code 1
Since the data is output at least twice in the field, the data can be transmitted correctly and the receiving side can perform the accurate processing by using the correct time code.
【図1】本発明伝送装置の一実施例の送信側を示す構成
図である。FIG. 1 is a configuration diagram showing a transmission side of an embodiment of a transmission device of the present invention.
【図2】本発明伝送装置の一実施例の受信側を示す構成
図である。FIG. 2 is a block diagram showing a receiving side of an embodiment of a transmission apparatus of the present invention.
【図3】本発明伝送装置の一実施例の一部を示す構成図
である。FIG. 3 is a configuration diagram showing a part of an embodiment of a transmission device of the present invention.
【図4】本発明伝送装置の一実施例の説明に供する伝送
フォーマットの一例を示す説明図である。FIG. 4 is an explanatory diagram showing an example of a transmission format used for explaining an embodiment of the transmission device of the present invention.
【図5】従来の伝送装置の例を示す構成図である。FIG. 5 is a configuration diagram showing an example of a conventional transmission device.
【図6】従来の伝送装置の例の説明に供する伝送フォー
マットの一例を示す説明図である。FIG. 6 is an explanatory diagram showing an example of a transmission format used for explaining an example of a conventional transmission device.
【図7】従来の伝送装置の例の説明に供する説明図であ
る。FIG. 7 is an explanatory diagram for explaining an example of a conventional transmission device.
10 タイムコード発生回路 11 映像処理部 12 シリアル化回路 13 音声処理部 14 パケット化回路 15 フラグ付加回路 16 CRC付加回路 19 受信回路 20 映像処理回路 21、24 遅延回路 22 送信回路 23 音声処理回路 25 制御回路 10 time code generation circuit 11 video processing unit 12 serialization circuit 13 audio processing unit 14 packetization circuit 15 flag addition circuit 16 CRC addition circuit 19 reception circuit 20 video processing circuit 21, 24 delay circuit 22 transmission circuit 23 audio processing circuit 25 control circuit
Claims (3)
源からの映像信号のフィールド或いはフレームの先頭を
示すフラグを付加するフラグ付加手段と、 上記映像及び音声信号発生源からの映像及び音声信号を
シリアル化するシリアル化手段と、 上記シリアル化手段からのシリアル信号中の上記映像信
号及びフラグに基いて遅延量を制御する制御手段と、 この制御手段の出力に基いて上記音声信号の位相を上記
映像信号の位相に合わせる位相制御手段とを有すること
を特徴とする伝送装置。1. A video and audio signal generation source, and flag addition means for adding a flag indicating the beginning of a field or frame of the video signal from the video signal generation source to the audio signal from the audio signal generation source, Serializing means for serializing the video and audio signals from the video and audio signal source; control means for controlling the delay amount based on the video signal and the flag in the serial signal from the serializing means; Phase control means for adjusting the phase of the audio signal to the phase of the video signal based on the output of the means.
シリアル化するシリアル化手段と、 このシリアル化手
段からのシリアル信号の内の映像信号に対して少なくと
も1水平周期毎にエラー検出用の信号を付加するエラー
検出信号付加手段と、 上記エラー検出信号付加手段によって付加されたエラー
検出信号によって上記シリアル化手段からのシリアルデ
ータの内の上記映像信号のエラー検出を行うエラー検出
手段とを有することを特徴とする伝送装置。2. A video and audio signal generation source, a serialization means for serializing the video and audio signals from the video and audio signal generation source, and a video signal of the serial signals from the serialization means. Error detection signal adding means for adding an error detection signal at least every horizontal period, and the video signal of the serial data from the serializing means by the error detection signal added by the error detection signal adding means. And an error detecting means for detecting the error.
シリアル化するシリアル化手段と、 上記映像信号発生源からの映像信号の再生位置に応じて
タイムコードを1フィールドに少なくとも2回以上出力
するタイムコード発生手段とを有することを特徴とする
伝送装置。3. A video and audio signal generation source, serializing means for serializing the video and audio signals from the video and audio signal generation source, and a reproduction position of the video signal from the video signal generation source. A transmission device, comprising: a time code generation means for outputting a time code at least twice in one field.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5130750A JPH06343165A (en) | 1993-06-01 | 1993-06-01 | Transmitter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5130750A JPH06343165A (en) | 1993-06-01 | 1993-06-01 | Transmitter |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH06343165A true JPH06343165A (en) | 1994-12-13 |
Family
ID=15041751
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5130750A Pending JPH06343165A (en) | 1993-06-01 | 1993-06-01 | Transmitter |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH06343165A (en) |
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1993
- 1993-06-01 JP JP5130750A patent/JPH06343165A/en active Pending
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