JPH05292740A - スイッチングレギュレータ - Google Patents
スイッチングレギュレータInfo
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- JPH05292740A JPH05292740A JP8433492A JP8433492A JPH05292740A JP H05292740 A JPH05292740 A JP H05292740A JP 8433492 A JP8433492 A JP 8433492A JP 8433492 A JP8433492 A JP 8433492A JP H05292740 A JPH05292740 A JP H05292740A
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- circuit
- pnp transistor
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Abstract
(57)【要約】
【目的】 入力電源の瞬断復電時にスイッチング制御回
路が誤動作するのを防止する。 【構成】 交流電圧検出回路７は交流電圧の有無を検出
し、スイッチング制御回路４のデッドタイム制御端子５
６に制御電圧を供給する。ここで、入力電源が瞬断する
と、起動回路５のコンデンサＣ2 も徐々に放電するが、
スイッチング制御回路４はまだ動作状態であるため、ス
イッチングパルスのＯＮデューティは最大となる。そし
て、ＰＮＰトランジスタＱ1 がＯＦＦに、また、ＰＮＰ
トランジスタＱ2 がＯＮになるため、ソフトスタート回
路のコンデンサＣ1 の充電電圧ＶCが急速に放電し、ス
イッチングパルスのＯＮデューティは０％になる。従っ
て、このとき交流電圧Ｖ1 を再投入しても、交流電源ラ
インには定格以上の電流は流れない。
路が誤動作するのを防止する。 【構成】 交流電圧検出回路７は交流電圧の有無を検出
し、スイッチング制御回路４のデッドタイム制御端子５
６に制御電圧を供給する。ここで、入力電源が瞬断する
と、起動回路５のコンデンサＣ2 も徐々に放電するが、
スイッチング制御回路４はまだ動作状態であるため、ス
イッチングパルスのＯＮデューティは最大となる。そし
て、ＰＮＰトランジスタＱ1 がＯＦＦに、また、ＰＮＰ
トランジスタＱ2 がＯＮになるため、ソフトスタート回
路のコンデンサＣ1 の充電電圧ＶCが急速に放電し、ス
イッチングパルスのＯＮデューティは０％になる。従っ
て、このとき交流電圧Ｖ1 を再投入しても、交流電源ラ
インには定格以上の電流は流れない。
Description
【０００１】
【産業上の利用分野】本発明はスイッチングレギュレー
タに関し、特に交流電圧を検出してスイッチングパルス
のＯＮデューティを制御するスイッチングレギュレータ
に関する。
タに関し、特に交流電圧を検出してスイッチングパルス
のＯＮデューティを制御するスイッチングレギュレータ
に関する。
【０００２】
【従来の技術】従来のスイッチングレギュレータは、図
５に示すように、整流平滑回路１，駆動回路２，出力平
滑回路３，スイッチング制御回路４，起動回路５，ソフ
トスタート回路６とからなっており、整流平滑回路１の
入力端子５０，５１に交流電圧が投入されると、スイッ
チング制御回路４を動作させる為の電源電圧ＶCCは、整
流スタックＲＣ1 ，コンデンサＣ3 からなる整流平滑回
路１から起動回路５より供給され、起動抵抗器Ｒ8 から
コンデンサＣ2 に充電された電源電圧ＶCCがスイッチン
グ制御回路４の最低動作電源電圧ＶCCL を越えると、ス
イッチング制御回路４が動作を開始し、スイッチング制
御回路４の基準電圧ＶREF は、コンデンサＣ1 及び抵抗
器Ｒ6 ，Ｒ7 よりなるソフトスタート回路６を介して、
スイッチング制御回路４のデッドタイム制御端子５６に
入力され、一定時間後、スイッチングパルスが出力端子
５７から出力される様になる。
５に示すように、整流平滑回路１，駆動回路２，出力平
滑回路３，スイッチング制御回路４，起動回路５，ソフ
トスタート回路６とからなっており、整流平滑回路１の
入力端子５０，５１に交流電圧が投入されると、スイッ
チング制御回路４を動作させる為の電源電圧ＶCCは、整
流スタックＲＣ1 ，コンデンサＣ3 からなる整流平滑回
路１から起動回路５より供給され、起動抵抗器Ｒ8 から
コンデンサＣ2 に充電された電源電圧ＶCCがスイッチン
グ制御回路４の最低動作電源電圧ＶCCL を越えると、ス
イッチング制御回路４が動作を開始し、スイッチング制
御回路４の基準電圧ＶREF は、コンデンサＣ1 及び抵抗
器Ｒ6 ，Ｒ7 よりなるソフトスタート回路６を介して、
スイッチング制御回路４のデッドタイム制御端子５６に
入力され、一定時間後、スイッチングパルスが出力端子
５７から出力される様になる。
【０００３】スイッチングパルスが出力されると、駆動
回路２の抵抗器Ｒ9 を通じてパワーＭＯＳＦＥＴである
Ｑ3 に駆動電圧が加わり、トランスＴ1 が起動すると、
起動回路５のダイオードＤ1 と、コンデンサＣ2 とによ
って電源電圧ＶCCが得られる様になる。一方、トランス
Ｔ1 が起動することによって、パワーＭＯＳＦＥＴＱ3
がＯＮの時、出力平滑回路３の整流ダイオードＤ2 ，チ
ョークコイルＬ1 ，平滑コンデンサＣ4 を介して、出力
電圧が出力端子５２，５３より出力される。また、パワ
ーＭＯＳＦＥＴＱ3 がＯＦＦの時は、出力平滑回路３の
フライホイールダイオードＤ3 ，チョークコイルＬ1 ，
平滑コンデンサＣ4 を介して、出力電圧が出力端子５
２，５３より出力される様になる。
回路２の抵抗器Ｒ9 を通じてパワーＭＯＳＦＥＴである
Ｑ3 に駆動電圧が加わり、トランスＴ1 が起動すると、
起動回路５のダイオードＤ1 と、コンデンサＣ2 とによ
って電源電圧ＶCCが得られる様になる。一方、トランス
Ｔ1 が起動することによって、パワーＭＯＳＦＥＴＱ3
がＯＮの時、出力平滑回路３の整流ダイオードＤ2 ，チ
ョークコイルＬ1 ，平滑コンデンサＣ4 を介して、出力
電圧が出力端子５２，５３より出力される。また、パワ
ーＭＯＳＦＥＴＱ3 がＯＦＦの時は、出力平滑回路３の
フライホイールダイオードＤ3 ，チョークコイルＬ1 ，
平滑コンデンサＣ4 を介して、出力電圧が出力端子５
２，５３より出力される様になる。
【０００４】
【発明が解決しようとする課題】この従来のスイッチン
グレギュレータは、交流電圧の瞬断、もしくはサーキッ
トブレーカを短時間切断すると、整流平滑回路１の出力
電圧Ｖ1 は低下する。しかしながら、スイッチング制御
回路４は起動回路５の起動コンデンサが放電し、電源電
圧ＶCCがスイッチング制御回路４の最低動作電源電圧Ｖ
CCL 以下になるまでは動作状態にある。そのため、スイ
ッチングレギュレータの出力電圧を維持しようとスイッ
チングパルスのＯＮデューティは最大となる。
グレギュレータは、交流電圧の瞬断、もしくはサーキッ
トブレーカを短時間切断すると、整流平滑回路１の出力
電圧Ｖ1 は低下する。しかしながら、スイッチング制御
回路４は起動回路５の起動コンデンサが放電し、電源電
圧ＶCCがスイッチング制御回路４の最低動作電源電圧Ｖ
CCL 以下になるまでは動作状態にある。そのため、スイ
ッチングレギュレータの出力電圧を維持しようとスイッ
チングパルスのＯＮデューティは最大となる。
【０００５】従って、この状態で瞬断が回復、もしくは
サーキットブレーカを再びＯＮにすると、スイッチング
パルスのＯＮデューティが最大の状態で規定以下の交流
電圧が投入されたことになり、交流電源ラインに規定以
上の電流が流れ、スイッチングレギュレータの前段に設
けられているヒューズの溶断、またはサーキットブレー
カが作動して電源が遮断されるという欠点がある。
サーキットブレーカを再びＯＮにすると、スイッチング
パルスのＯＮデューティが最大の状態で規定以下の交流
電圧が投入されたことになり、交流電源ラインに規定以
上の電流が流れ、スイッチングレギュレータの前段に設
けられているヒューズの溶断、またはサーキットブレー
カが作動して電源が遮断されるという欠点がある。
【０００６】
【課題を解決するための手段】本発明は、交流電圧の入
力により動作を開始し、一次側に基準電圧端子，制御端
子，電源電圧端子の持つスイッチング制御回路を有する
スイッチングレギュレータであって、前記交流電圧の整
流平滑回路出力の正極端子の一端を接続する第１の抵抗
器と、前記第１の抵抗器の他端にエミッタを接続する第
１のＰＮＰトランジスタと、前記第１のＰＮＰトランジ
スタのベースに一端を接続する第２の抵抗器と、一端を
前記第１のＰＮＰトランジスタのコレクタに接続し、か
つ他端を前記整流平滑回路出力の負極端子に接続する第
３の抵抗器と、カソードを前記第２の抵抗器の他端に接
続し、かつアノードを前記整流平滑回路出力の負極端子
に接続するツェナーダイオードと、前記スイッチング制
御回路の前記基準電圧端子にエミッタを接続し、かつベ
ースを前記第１のＰＮＰトランジスタのコレクタに接続
する第２のＰＮＰトランジスタと、一端を第２のＰＮＰ
トランジスタのコレクタに接続し、他端を前記スイッチ
ング制御回路の前記制御端子に接続する第４の抵抗器と
を含む交流電圧検出回路を備えている。
力により動作を開始し、一次側に基準電圧端子，制御端
子，電源電圧端子の持つスイッチング制御回路を有する
スイッチングレギュレータであって、前記交流電圧の整
流平滑回路出力の正極端子の一端を接続する第１の抵抗
器と、前記第１の抵抗器の他端にエミッタを接続する第
１のＰＮＰトランジスタと、前記第１のＰＮＰトランジ
スタのベースに一端を接続する第２の抵抗器と、一端を
前記第１のＰＮＰトランジスタのコレクタに接続し、か
つ他端を前記整流平滑回路出力の負極端子に接続する第
３の抵抗器と、カソードを前記第２の抵抗器の他端に接
続し、かつアノードを前記整流平滑回路出力の負極端子
に接続するツェナーダイオードと、前記スイッチング制
御回路の前記基準電圧端子にエミッタを接続し、かつベ
ースを前記第１のＰＮＰトランジスタのコレクタに接続
する第２のＰＮＰトランジスタと、一端を第２のＰＮＰ
トランジスタのコレクタに接続し、他端を前記スイッチ
ング制御回路の前記制御端子に接続する第４の抵抗器と
を含む交流電圧検出回路を備えている。
【０００７】また、前記第２のＰＮＰトランジスタのエ
ミッタは前記スイッチング制御回路の前記電源電圧端子
に接続し、前記第４の抵抗器の前記他端は前記整流平滑
回路出力の負極端子に接続してもよい。
ミッタは前記スイッチング制御回路の前記電源電圧端子
に接続し、前記第４の抵抗器の前記他端は前記整流平滑
回路出力の負極端子に接続してもよい。
【０００８】
【実施例】次に、本発明について図面を参照して説明す
る。
る。
【０００９】図１は本発明の第１の実施例を示すブロッ
ク図であり、図２は本発明の第２の実施例を示すブロッ
ク図である。
ク図であり、図２は本発明の第２の実施例を示すブロッ
ク図である。
【００１０】第１及び第２の実施例は、それぞれ整流平
滑回路１，駆動回路２，出力平滑回路３，スイッチング
制御回路４，起動回路５，ソフトスタート回路６，交流
電圧検出回路７を備えている。また、図３は図１の主要
部の信号波形を示すタイムチャートであり、図４は図２
の主要部の信号波形を示すタイムチャートである。
滑回路１，駆動回路２，出力平滑回路３，スイッチング
制御回路４，起動回路５，ソフトスタート回路６，交流
電圧検出回路７を備えている。また、図３は図１の主要
部の信号波形を示すタイムチャートであり、図４は図２
の主要部の信号波形を示すタイムチャートである。
【００１１】なお、本実施例の交流電圧検出回路７を除
く他の各回路の構成及び機能は従来例と同様であり、そ
れらに関する説明は省略する。
く他の各回路の構成及び機能は従来例と同様であり、そ
れらに関する説明は省略する。
【００１２】まず、第１の実施例について図１及び図３
を参照して説明する。図１において、交流電圧Ｖi が図
３に示す時刻ｔ1 に整流平滑回路１の入力端子５０，５
１に投入されると、整流平滑回路の出力電圧は上昇を始
め、交流電圧検出回路７において抵抗器Ｒ1 により分圧
されたＶx が立ち上がる。また、起動抵抗器Ｒ8 を通し
てスイッチング制御回路４の電源電圧ＶCCが上昇を始
め、同時にスイッチング制御回路４の基準電圧ＶREF も
上昇を始める。そして、基準電圧ＶREF が上昇を始める
と、ＰＮＰトランジスタＱ2 は抵抗Ｒ3 を通してベース
電流が流れてＯＮになる。
を参照して説明する。図１において、交流電圧Ｖi が図
３に示す時刻ｔ1 に整流平滑回路１の入力端子５０，５
１に投入されると、整流平滑回路の出力電圧は上昇を始
め、交流電圧検出回路７において抵抗器Ｒ1 により分圧
されたＶx が立ち上がる。また、起動抵抗器Ｒ8 を通し
てスイッチング制御回路４の電源電圧ＶCCが上昇を始
め、同時にスイッチング制御回路４の基準電圧ＶREF も
上昇を始める。そして、基準電圧ＶREF が上昇を始める
と、ＰＮＰトランジスタＱ2 は抵抗Ｒ3 を通してベース
電流が流れてＯＮになる。
【００１３】次に、時刻ｔ2 において、Ｖx がツェナー
ダイオードＺ1 のツェナー電圧ＶZ1（ＶCCL 〉ＶZ1〉Ｖ
REF ）を超えると、ＰＮＰトランジスタＱ1 はベース電
流が流れてＯＮになる。
ダイオードＺ1 のツェナー電圧ＶZ1（ＶCCL 〉ＶZ1〉Ｖ
REF ）を超えると、ＰＮＰトランジスタＱ1 はベース電
流が流れてＯＮになる。
【００１４】ここで、ツェナー電圧ＶZ1をスイッチング
制御回路４の基準電圧ＶREF よりも高く（ＶZ1〉
ＶREF ）することにより、ＰＮＰトランジスタＱ1 がＯ
Ｎになると、ＰＮＰトランジスタＱ2 のベース電圧ＶB2
とエミッタ電圧ＶE2との関係は、ＶB2〉ＶE2となる為、
ＰＮＰトランジスタＱ2 はベース電流が流れなくなりＯ
ＦＦとなる。この時刻ｔ1 〜ｔ2 の間、ＰＮＰトランジ
スタＱ2 がＯＮになる為、ソフトスタート回路６に抵抗
Ｒ4 が接続された状態になり、ソフトスタート回路６が
正常に動作しない様になるが、スイッチング制御回路７
の電源電圧ＶCCの立ち上がり時間は、起動コンデンサＣ
3 の充電時間分、交流電圧検出回路７の検出電圧Ｖx の
立ち上がり時間よりも遅く、また、交流電圧検出回路７
のツェナーダイオードＺ1 のツェナー電圧ＶZ1をスイッ
チング制御回路４の最低動作電源電圧ＶCCL 以下（Ｖ
CCL 〉ＶZ1）にすることにより、スイッチング制御回路
４を動作しない様にできる為、この時刻ｔ1 〜ｔ2 の
間、ＰＮＰトランジスタＱ2 がＯＮになっても無視でき
る。
制御回路４の基準電圧ＶREF よりも高く（ＶZ1〉
ＶREF ）することにより、ＰＮＰトランジスタＱ1 がＯ
Ｎになると、ＰＮＰトランジスタＱ2 のベース電圧ＶB2
とエミッタ電圧ＶE2との関係は、ＶB2〉ＶE2となる為、
ＰＮＰトランジスタＱ2 はベース電流が流れなくなりＯ
ＦＦとなる。この時刻ｔ1 〜ｔ2 の間、ＰＮＰトランジ
スタＱ2 がＯＮになる為、ソフトスタート回路６に抵抗
Ｒ4 が接続された状態になり、ソフトスタート回路６が
正常に動作しない様になるが、スイッチング制御回路７
の電源電圧ＶCCの立ち上がり時間は、起動コンデンサＣ
3 の充電時間分、交流電圧検出回路７の検出電圧Ｖx の
立ち上がり時間よりも遅く、また、交流電圧検出回路７
のツェナーダイオードＺ1 のツェナー電圧ＶZ1をスイッ
チング制御回路４の最低動作電源電圧ＶCCL 以下（Ｖ
CCL 〉ＶZ1）にすることにより、スイッチング制御回路
４を動作しない様にできる為、この時刻ｔ1 〜ｔ2 の
間、ＰＮＰトランジスタＱ2 がＯＮになっても無視でき
る。
【００１５】時刻ｔ２において、ＰＮＰトランジスタＱ
1 がＯＮになると、ＰＮＰトランジスタＱ2 はベース電
流が流れなくなりＯＦＦになる。そして、ＰＮＰトラン
ジスタＱ2 がＯＦＦになると、ソフトスタート回路６が
動作を開始し、スイッチング制御回路４の出力端子５７
にスイッチングパルスが出力される。
1 がＯＮになると、ＰＮＰトランジスタＱ2 はベース電
流が流れなくなりＯＦＦになる。そして、ＰＮＰトラン
ジスタＱ2 がＯＦＦになると、ソフトスタート回路６が
動作を開始し、スイッチング制御回路４の出力端子５７
にスイッチングパルスが出力される。
【００１６】次に、時刻ｔ3 において、交流電圧Ｖi が
切断されると、交流電圧検出回路７のＶx とスイッチン
グ制御回路４の電源電圧ＶCCと基準電圧ＶREF とは低下
し始める。
切断されると、交流電圧検出回路７のＶx とスイッチン
グ制御回路４の電源電圧ＶCCと基準電圧ＶREF とは低下
し始める。
【００１７】続いて、時刻ｔ4 において、Ｖx がツェナ
ー電圧ＶZ1以下になると、ＰＮＰトランジスタＱ1 はＯ
ＦＦになる。そして、ＰＮＰトランジスタＱ1 がＯＦＦ
になると、ＰＮＰトランジスタＱ2 がＯＮになり、ソフ
トスタート回路６のコンデンサＣ1 の充電電圧ＶC は急
速に放電する。一般に、交流電圧Ｖi が切断されると、
起動回路５の起動コンデンサＣ2 は徐々に放電し、スイ
ッチング制御回路４の最低動作電源電圧ＶCCL になるま
では、スイッチング制御回路４は動作状態にあり、この
時出力平滑回路６の出力端子５２，５３の直流出力電圧
は低下している為、スイッチング制御回路４のスイッチ
ングパルスのＯＮデューティは最大となる。
ー電圧ＶZ1以下になると、ＰＮＰトランジスタＱ1 はＯ
ＦＦになる。そして、ＰＮＰトランジスタＱ1 がＯＦＦ
になると、ＰＮＰトランジスタＱ2 がＯＮになり、ソフ
トスタート回路６のコンデンサＣ1 の充電電圧ＶC は急
速に放電する。一般に、交流電圧Ｖi が切断されると、
起動回路５の起動コンデンサＣ2 は徐々に放電し、スイ
ッチング制御回路４の最低動作電源電圧ＶCCL になるま
では、スイッチング制御回路４は動作状態にあり、この
時出力平滑回路６の出力端子５２，５３の直流出力電圧
は低下している為、スイッチング制御回路４のスイッチ
ングパルスのＯＮデューティは最大となる。
【００１８】しかしながら、本実施例ではＰＮＰトラン
ジスタＱ2 がＯＮになり、ソフトスタート回路６のコン
デンサＣ1 の充電電圧ＶC が放電するため、スイッチン
グパルスのＯＮデューティは０％になる。従って、ここ
で交流電圧Ｖi が時刻ｔ5 において再投入されても、交
流電源ラインに定格以上の電流が流れることはない。
尚、抵抗器Ｒ5 はＰＮＰトランジスタＱ1 がツェナーダ
イオードＺ1 の漏れ電流によってＯＮになるのを防止す
る為のバイパス抵抗である。
ジスタＱ2 がＯＮになり、ソフトスタート回路６のコン
デンサＣ1 の充電電圧ＶC が放電するため、スイッチン
グパルスのＯＮデューティは０％になる。従って、ここ
で交流電圧Ｖi が時刻ｔ5 において再投入されても、交
流電源ラインに定格以上の電流が流れることはない。
尚、抵抗器Ｒ5 はＰＮＰトランジスタＱ1 がツェナーダ
イオードＺ1 の漏れ電流によってＯＮになるのを防止す
る為のバイパス抵抗である。
【００１９】次に、第２の実施例について図２及び図４
を参照して説明する。図２において、交流電圧Ｖi が図
４に示す時刻ｔ1 に整流平滑回路１の入力端子５０，５
１に投入されると、整流平滑回路１の出力電圧は上昇を
始め、交流電圧検出回路７において抵抗Ｒ1 により分圧
されたＶx が立ち上がる。また、起動抵抗器Ｒ8 を通し
てスイッチング制御回路４の電源電圧ＶCCが上昇を始
め、同時にスイッチング制御回路４の基準電圧ＶREF も
上昇を始める。電源電圧ＶCCが上昇を始めるとＰＮＰト
ランジスタＱ2 は抵抗Ｒ3 を通してベース電流が流れて
ＯＮになる。
を参照して説明する。図２において、交流電圧Ｖi が図
４に示す時刻ｔ1 に整流平滑回路１の入力端子５０，５
１に投入されると、整流平滑回路１の出力電圧は上昇を
始め、交流電圧検出回路７において抵抗Ｒ1 により分圧
されたＶx が立ち上がる。また、起動抵抗器Ｒ8 を通し
てスイッチング制御回路４の電源電圧ＶCCが上昇を始
め、同時にスイッチング制御回路４の基準電圧ＶREF も
上昇を始める。電源電圧ＶCCが上昇を始めるとＰＮＰト
ランジスタＱ2 は抵抗Ｒ3 を通してベース電流が流れて
ＯＮになる。
【００２０】次に、時刻ｔ2 において、Ｖx がツェナー
ダイオードＺ1 のツェナー電圧ＶZ1を超えると、ＰＮＰ
トランジスタＱ1 は、ベース電流が流れてＯＮになる。
ここで、ツェナー電圧ＶZ1をスイッチング制御回路４の
電源電圧ＶCCよりも高く（ＶZ1〉ＶCC）することによ
り、ＰＮＰトランジスタＱ1 がＯＮになると、ＰＮＰト
ランジスタＱ2 はベース電流が流れなくなりＯＦＦにな
る。この時刻ｔ1 〜ｔ2の間、ＰＮＰトランジスタＱ2
はＯＮになるが、抵抗器Ｒ4 ，Ｒ8 により分圧される電
圧をＶCCL 以下にすることによって、スイッチング制御
回路４を動作しない様にできる為、この時刻ｔ1 〜ｔ2
の間、ＰＮＰトランジスタＱ2 がＯＮになっても無視で
きる。
ダイオードＺ1 のツェナー電圧ＶZ1を超えると、ＰＮＰ
トランジスタＱ1 は、ベース電流が流れてＯＮになる。
ここで、ツェナー電圧ＶZ1をスイッチング制御回路４の
電源電圧ＶCCよりも高く（ＶZ1〉ＶCC）することによ
り、ＰＮＰトランジスタＱ1 がＯＮになると、ＰＮＰト
ランジスタＱ2 はベース電流が流れなくなりＯＦＦにな
る。この時刻ｔ1 〜ｔ2の間、ＰＮＰトランジスタＱ2
はＯＮになるが、抵抗器Ｒ4 ，Ｒ8 により分圧される電
圧をＶCCL 以下にすることによって、スイッチング制御
回路４を動作しない様にできる為、この時刻ｔ1 〜ｔ2
の間、ＰＮＰトランジスタＱ2 がＯＮになっても無視で
きる。
【００２１】次に、時刻ｔ3 において、交流電圧Ｖi が
切断されると、交流電圧検出回路７のＶx とスイッチン
グ制御回路４の電源電圧ＶCCとは低下し始める。続い
て、時刻ｔ4 において、Ｖx がツェナー電圧ＶZ1以下に
なると、ＰＮＰトランジスタＱ1 はＯＦＦになる。そし
て、ＰＮＰトランジスタＱ1 がＯＦＦになるとＰＮＰト
ランジスタＱ2 はＯＮになる。交流電圧Ｖi が切断され
ると起動回路５の起動コンデンサＣ2 は徐々に放電し、
スイッチング制御回路４の最低動作電源電圧ＶCCL にな
るまでは、スイッチング制御回路４は動作状態にあり、
この時出力平滑回路３の出力端子５２，５３の直流出力
電圧は低下している為、スイッチング制御回路４のスイ
ッチングパルスのＯＮデューティは最大となる。
切断されると、交流電圧検出回路７のＶx とスイッチン
グ制御回路４の電源電圧ＶCCとは低下し始める。続い
て、時刻ｔ4 において、Ｖx がツェナー電圧ＶZ1以下に
なると、ＰＮＰトランジスタＱ1 はＯＦＦになる。そし
て、ＰＮＰトランジスタＱ1 がＯＦＦになるとＰＮＰト
ランジスタＱ2 はＯＮになる。交流電圧Ｖi が切断され
ると起動回路５の起動コンデンサＣ2 は徐々に放電し、
スイッチング制御回路４の最低動作電源電圧ＶCCL にな
るまでは、スイッチング制御回路４は動作状態にあり、
この時出力平滑回路３の出力端子５２，５３の直流出力
電圧は低下している為、スイッチング制御回路４のスイ
ッチングパルスのＯＮデューティは最大となる。
【００２２】しかしながら、本実施例ではＰＮＰトラン
ジスタＱ2 がＯＮになることによって、起動回路５の起
動コンデンサＣ2 の充電電圧は、抵抗器Ｒ4 を通して急
速に放電し、スイッチング制御回路４は動作しなくな
り、スイッチングパルスのＯＮデューティは０％になる
為、こので交流電圧Ｖi が時刻ｔ5 において再投入され
ても、交流電源ラインに定格以上の電流が流れることは
ない。尚、抵抗器Ｒ5 はＰＮＰトランジスタＱ1 がツェ
ナーダイオードＺ1 の漏れ電流によってＯＮになるのを
防止する為のバイパス抵抗である。
ジスタＱ2 がＯＮになることによって、起動回路５の起
動コンデンサＣ2 の充電電圧は、抵抗器Ｒ4 を通して急
速に放電し、スイッチング制御回路４は動作しなくな
り、スイッチングパルスのＯＮデューティは０％になる
為、こので交流電圧Ｖi が時刻ｔ5 において再投入され
ても、交流電源ラインに定格以上の電流が流れることは
ない。尚、抵抗器Ｒ5 はＰＮＰトランジスタＱ1 がツェ
ナーダイオードＺ1 の漏れ電流によってＯＮになるのを
防止する為のバイパス抵抗である。
【００２３】
【発明の効果】以上説明したように本発明は、交流電圧
の有無を検出してスイッチングパルスを制御することに
より、交流電圧の瞬断復電時に、定格以上の電流が流れ
てスイッチングレギュレータの前段に設けたヒューズの
溶断、又はブレーカが作動して電源が遮断することを防
止できるという効果がある。
の有無を検出してスイッチングパルスを制御することに
より、交流電圧の瞬断復電時に、定格以上の電流が流れ
てスイッチングレギュレータの前段に設けたヒューズの
溶断、又はブレーカが作動して電源が遮断することを防
止できるという効果がある。
【図１】本発明の第１の実施例を示すブロック図であ
る。
る。
【図２】本発明の第２の実施例を示すブロック図であ
る。
る。
【図３】図１の主要部の信号波形を示すタイムチャート
である。
である。
【図４】図２の主要部の信号波形を示すタイムチャート
である。
である。
【図５】従来例を示すブロック図である。
１ 整流平滑回路 ２ 駆動回路 ３ 出力平滑回路 ４ スイッチング制御回路 ５ 起動回路 ６ ソフトスタート回路 ７ 交流電圧検出回路 ５０，５１ 整流平滑回路の入力端子 ５２，５３ スイッチングレギュレータの出力端子 ５４ 電源電圧端子 ５５ 基準電圧端子 ５６ デッドタイム制御端子 ５７ スイッチング制御回路の出力端子 Ｒ1 〜Ｒ9 抵抗器 Ｚ1 ツェナーダイオード Ｑ1 〜Ｑ2 ＰＮＰトランジスタ Ｑ3 ＭＯＳ ＦＥＴ ＲＣ1 整流スタック Ｃ1 〜Ｃ4 コンデンサ Ｄ1 〜Ｄ3 ダイオード Ｔ1 トランス Ｌ1 チョークコイル
Claims (2)
- 【請求項１】 交流電圧の入力により動作を開始し、一
次側に基準電圧端子，制御端子，電源電圧端子の持つス
イッチング制御回路を有するスイッチングレギュレータ
であって、前記交流電圧の整流平滑回路出力の正極端子
の一端を接続する第１の抵抗器と、前記第１の抵抗器の
他端にエミッタを接続する第１のＰＮＰトランジスタ
と、前記第１のＰＮＰトランジスタのベースに一端を接
続する第２の抵抗器と、一端を前記第１のＰＮＰトラン
ジスタのコレクタに接続し、かつ他端を前記整流平滑回
路出力の負極端子に接続する第３の抵抗器と、カソード
を前記第２の抵抗器の他端に接続し、かつアノードを前
記整流平滑回路出力の負極端子に接続するツェナーダイ
オードと、前記スイッチング制御回路の前記基準電圧端
子にエミッタを接続し、かつベースを前記第１のＰＮＰ
トランジスタのコレクタに接続する第２のＰＮＰトラン
ジスタと、一端を第２のＰＮＰトランジスタのコレクタ
に接続し、他端を前記スイッチング制御回路の前記制御
端子に接続する第４の抵抗器とを含む交流電圧検出回路
を備えることを特徴とするスイッチングレギュレータ。 - 【請求項２】 前記第２のＰＮＰトランジスタのエミッ
タは前記スイッチング制御回路の前記電源電圧端子に接
続し、前記第４の抵抗器の前記他端は前記整流平滑回路
出力の負極端子に接続していることを特徴とする請求項
１記載のスイッチングレギュレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8433492A JPH05292740A (ja) | 1992-04-07 | 1992-04-07 | スイッチングレギュレータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8433492A JPH05292740A (ja) | 1992-04-07 | 1992-04-07 | スイッチングレギュレータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05292740A true JPH05292740A (ja) | 1993-11-05 |
Family
ID=13827615
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8433492A Withdrawn JPH05292740A (ja) | 1992-04-07 | 1992-04-07 | スイッチングレギュレータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05292740A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN101615852A (zh) * | 2008-06-25 | 2009-12-30 | 三美电机株式会社 | 直流电源装置 |
| JP6298994B1 (ja) * | 2017-09-14 | 2018-03-28 | パナソニックＩｐマネジメント株式会社 | 電源回路とモータ駆動装置 |
-
1992
- 1992-04-07 JP JP8433492A patent/JPH05292740A/ja not_active Withdrawn
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN101615852A (zh) * | 2008-06-25 | 2009-12-30 | 三美电机株式会社 | 直流电源装置 |
| JP2010011563A (ja) * | 2008-06-25 | 2010-01-14 | Mitsumi Electric Co Ltd | 直流電源装置 |
| JP6298994B1 (ja) * | 2017-09-14 | 2018-03-28 | パナソニックＩｐマネジメント株式会社 | 電源回路とモータ駆動装置 |
| JP2019054608A (ja) * | 2017-09-14 | 2019-04-04 | パナソニックＩｐマネジメント株式会社 | 電源回路とモータ駆動装置 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990608 |