JPH0510422Y2 - - Google Patents
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- JPH0510422Y2 JPH0510422Y2 JP1985199257U JP19925785U JPH0510422Y2 JP H0510422 Y2 JPH0510422 Y2 JP H0510422Y2 JP 1985199257 U JP1985199257 U JP 1985199257U JP 19925785 U JP19925785 U JP 19925785U JP H0510422 Y2 JPH0510422 Y2 JP H0510422Y2
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Description
【考案の詳細な説明】
〔産業上の利用分野〕
本考案は、スイツチングトランジスタの発振回
路に関するもので、特に、スイツチングスピード
および効率の改善に関するものである。[Detailed Description of the Invention] [Industrial Field of Application] The present invention relates to an oscillation circuit for switching transistors, and particularly to improvements in switching speed and efficiency.
従来のスイツチングトランジスタの発振回路
は、第4図に示すように、スイツチングトランジ
スタ1の駆動用のパルス発生回路2とこのパルス
発生回路2の出力パルスをスイツチングトランジ
スタ1のベースへ供給するための抵抗3とコンデ
ンサ4の並列回路からなるパルス印加回路からな
つていた。
As shown in FIG. 4, the conventional switching transistor oscillation circuit includes a pulse generation circuit 2 for driving the switching transistor 1 and a pulse generation circuit 2 for supplying the output pulse of the pulse generation circuit 2 to the base of the switching transistor 1. It consisted of a pulse application circuit consisting of a parallel circuit of a resistor 3 and a capacitor 4.
パルス発生回路2で発生されるパルスは、第3
図aに示すようにスイツチングトランジスタをオ
ンさせるためのパルス(ここでは正パルス)と、
オフさせるための逆電位のパルス(ここでは負パ
ルス)からなつている。 The pulse generated by the pulse generation circuit 2 is
As shown in figure a, a pulse (positive pulse here) for turning on the switching transistor,
It consists of a pulse with an opposite potential (here, a negative pulse) to turn it off.
パルス発生回路2から正パルスが出力されると
抵抗3とコンデンサ4を介して、スイツチングト
ランジスタ1にベース電流が流れ、コレクタエミ
ツタに電流が流れる。この状態で、パルス発生回
路2から負パルスが出力されると、スイツチング
トランジスタ1のベース・エミツタ蓄積キヤリア
が抵抗3とコンデンサ4を介して抜かれ、スイツ
チングトランジスタ1がオフとなる。かくして、
コレクタにパルス電流が流れ、負荷5に供給され
る。 When a positive pulse is output from the pulse generating circuit 2, a base current flows through the switching transistor 1 via a resistor 3 and a capacitor 4, and a current flows through the collector-emitter. In this state, when a negative pulse is output from the pulse generating circuit 2, the base-emitter storage carrier of the switching transistor 1 is extracted via the resistor 3 and the capacitor 4, and the switching transistor 1 is turned off. Thus,
A pulse current flows through the collector and is supplied to the load 5.
ところで、第4図に示す従来の発振回路におい
ては、第3図aに示す正負の駆動パルスに対し
て、ベース電流は第3図bの実線で示すように変
化する。即ち、コンデンサ4の存在のため、正お
よび負のいずれのパルスの場合も、パルスの立上
り時に急激にベース電流が流れ、コンデンサ4が
充電されると、ベース電流は急激に減少する。こ
のため、オン、オフ動作が不安定となる。電流増
幅率の高いトランジスタを用いれば、オン時にお
ける問題は解決できるが、負パルスによるオフ動
作の場合、トランジスタのベース蓄積キヤリアが
充分抜けきらないので、ターンオフスピードが遅
くなる。
By the way, in the conventional oscillation circuit shown in FIG. 4, the base current changes as shown by the solid line in FIG. 3b in response to the positive and negative drive pulses shown in FIG. 3a. That is, due to the presence of the capacitor 4, in both positive and negative pulses, the base current flows rapidly at the rise of the pulse, and when the capacitor 4 is charged, the base current rapidly decreases. Therefore, the on/off operation becomes unstable. If a transistor with a high current amplification factor is used, the on-time problem can be solved, but in the case of an off-operation using a negative pulse, the carriers accumulated in the base of the transistor cannot be sufficiently removed, resulting in a slow turn-off speed.
これを解決するために、抵抗3やコンデンサ4
のインピーダンスを小さくすることが考えられる
が、ターンオン時にオーバードライブが発生して
損失を招く不都合や、負パルス印加時に、トラン
ジスタのベースエミツタ間に逆耐圧をオーバーし
た大きな逆電圧がかかり、トランジスタを破壊す
る恐れがある。 To solve this problem, resistor 3 and capacitor 4
It is possible to reduce the impedance of the transistor, but overdrive occurs at turn-on, resulting in loss, and when a negative pulse is applied, a large reverse voltage that exceeds the reverse breakdown voltage is applied between the base and emitter of the transistor, which may destroy the transistor. There is a fear.
本考案は、上記問題点を解決し、スイツチング
スピードを早く、しかも低損失でスイツチングト
ランジスタを駆動できるスイツチングトランジス
タ発振回路を提供することを目的とするものであ
る。
SUMMARY OF THE INVENTION An object of the present invention is to solve the above-mentioned problems and provide a switching transistor oscillation circuit that can drive a switching transistor at high switching speed and with low loss.
本考案のスイツチングトランジスタの発振回路
は、一次巻線から二次巻線に誘起される正負のパ
ルスを発生させるトランスと、スイツチングトラ
ンシスタと、並列に配置したコンデンサと第1の
抵抗を含み、前記二次巻線と前記スイツチングト
ランジスタのベースの間に配設したパルス印加回
路と、前記一次巻線に電流を供給すると共に前記
スイツチングトランジスタのベースに第2の抵抗
を介して順方向電流を供給する電流供給手段とを
有するスイツチングトランジスタの発振回路にお
いて、前記パルス印加回路が、前記コンデンサ
と、第1のダイオードとツエナダイオードを互い
に逆向きに接続した第1の接続回路と、前記第1
の抵抗に前記第1のダイオードとは逆向きの第2
のダイオードを直列に接続した第2の直列回路と
を、前記第1の直列回路が逆方向に、前記第2の
直列回路が順方向に能動的になるように並列に配
置したことを特徴とする。 The switching transistor oscillation circuit of the present invention includes a transformer that generates positive and negative pulses induced from a primary winding to a secondary winding, a switching transistor, a capacitor and a first resistor arranged in parallel. , a pulse application circuit disposed between the secondary winding and the base of the switching transistor, and a pulse application circuit that supplies current to the primary winding and applies a current to the base of the switching transistor in the forward direction via a second resistor. A switching transistor oscillation circuit having current supply means for supplying current, wherein the pulse application circuit includes the capacitor, a first connection circuit in which a first diode and a Zener diode are connected in opposite directions, 1st
A second diode opposite to the first diode is connected to the resistor.
diodes connected in series are arranged in parallel such that the first series circuit is active in the opposite direction and the second series circuit is active in the forward direction. do.
上記において、ダイオードの向きの順方向と
は、スイツチングトランジスタのターンオフ時の
ベース電流の向きにこのダイオードが順方向に成
ることを意味する。 In the above, the forward direction of the diode means that the diode is oriented in the forward direction of the base current when the switching transistor is turned off.
以下、本考案の実施例を図面を参照して説明す
る。 Embodiments of the present invention will be described below with reference to the drawings.
第1図は、本考案の一実施例を示す回路図で、
第4図の回路に本考案を適用したものである。第
4図と同様の回路素子は同一の参照符号をもつて
示した。 FIG. 1 is a circuit diagram showing an embodiment of the present invention.
The present invention is applied to the circuit shown in FIG. Circuit elements similar to those in FIG. 4 are designated with the same reference numerals.
第1図の回路が第4図の回路と異なる点は、コ
ンデンサ4と並列に、ダイオード7とツエナーダ
イオード8の直列回路を接続してあることであ
る。 The circuit of FIG. 1 differs from the circuit of FIG. 4 in that a series circuit of a diode 7 and a Zener diode 8 is connected in parallel with the capacitor 4.
ダイオード7とツエナーダイオード8とは、互
いに逆向きに接続され、しかもダイオード7は、
その順方向が、トランジスタ1のターンオフ時の
ベース電流の向きとなつている。 The diode 7 and the Zener diode 8 are connected in opposite directions, and the diode 7 is
The forward direction is the direction of the base current when the transistor 1 is turned off.
この構成においては、パルス発生回路2から正
パルスが出力されるときは、ダイオード7の存在
のため、抵抗3とコンデンサ4のみを介してベー
ス電流が流れ、トランジスタ1がターンオンす
る。この動作は、第4図の従来例と同様である。 In this configuration, when a positive pulse is output from the pulse generating circuit 2, due to the presence of the diode 7, the base current flows only through the resistor 3 and the capacitor 4, turning on the transistor 1. This operation is the same as in the conventional example shown in FIG.
一方、パルス発生回路2から負パルスが出力す
ると、ベース電流は抵抗3とコンデンサ4だけで
なく、ダイオード7およびツエナーダイオード8
を通つて流れるので、コンデンサ4が充電されて
しまつた後も、ダイオード7の回路を通つて大き
な電流が流れる。即ち、第3図bに点線で示すよ
うに、ベース電流は従来のように激減することは
ない。従つて、トランジスタ1の蓄積キヤリアが
急速に減少し、トランジスタ1のターンオフ時間
が短かくなる。 On the other hand, when a negative pulse is output from the pulse generating circuit 2, the base current flows not only through the resistor 3 and capacitor 4 but also through the diode 7 and Zener diode 8.
Since the current flows through the diode 7 circuit, even after the capacitor 4 has been charged, a large current flows through the circuit of the diode 7. That is, as shown by the dotted line in FIG. 3b, the base current does not decrease drastically as in the conventional case. Therefore, the accumulated carriers of transistor 1 are rapidly reduced and the turn-off time of transistor 1 is shortened.
なお、ツエナーダイオード8は、パルス発生回
路2から負パルスが出力されているとき、ダイオ
ード7を介して、トランジスタ1のベースエミツ
タ間に大きな逆電圧がかかることを阻止するため
のものである。 The Zener diode 8 is provided to prevent a large reverse voltage from being applied between the base and emitter of the transistor 1 via the diode 7 when a negative pulse is output from the pulse generating circuit 2.
第2図は、第1図のスイツチング回路を発振部
に用いたDC/DCコンバータに本考案を適用した
実施例である。ここで、トランス9がパルス発生
回路2を構成している。 FIG. 2 shows an embodiment in which the present invention is applied to a DC/DC converter using the switching circuit of FIG. 1 in the oscillation section. Here, the transformer 9 constitutes the pulse generation circuit 2.
トランス9の一次巻線N1から二次巻線N2に誘
起させる正、負のパルスによつて、抵抗3、コン
デンサ4を介してトランジスタ1へベース電流が
流れる。また、+電源からは起動抵抗10を介し
て順方向電流をトランジスタ1のベースへ供給す
る。 A base current flows through the resistor 3 and capacitor 4 to the transistor 1 by positive and negative pulses induced from the primary winding N 1 to the secondary winding N 2 of the transformer 9 . Further, a forward current is supplied from the + power supply to the base of the transistor 1 via the starting resistor 10.
ここで、ダイオード7とツエナーダイオード8
の直列回路がコンデンサ4と並列に接続されてい
るので、二次巻線N2に負パルスが発生したとき、
第1図の実施例の場合と同様にコンデンサ4が充
電されてしまつた後でも、ダイオード7を介して
ベース電流が流れるので、トランジスタ1のター
ンオフ動作が急速に行なわれる。 Here, diode 7 and Zener diode 8
Since the series circuit of is connected in parallel with capacitor 4, when a negative pulse occurs in the secondary winding N 2 ,
Even after the capacitor 4 has been charged, as in the embodiment of FIG. 1, the base current flows through the diode 7, so that the transistor 1 is rapidly turned off.
またダイオード6は、起動抵抗10を介する流
入電流をベース電流としてのみ役立つよう機能
し、発振の安定性に寄与する。さらに、ツエナー
ダイオード8とダイオード7の直列回路によつて
安定な負バイアスが得られるため、オフ時のトラ
ンジスタのコレクタの暗電流を極めて小さくする
ことが出来る。 Furthermore, the diode 6 functions so that the current flowing through the starting resistor 10 serves only as a base current, contributing to the stability of oscillation. Furthermore, since a stable negative bias can be obtained by the series circuit of the Zener diode 8 and the diode 7, the dark current in the collector of the transistor when it is off can be made extremely small.
上記実施例の説明から明らかなように、本考案
によれば、スイツチングトランジスタの発振回路
において、該トランジスタのベースへ駆動パルス
を供給する抵抗とコンデンサの並列回路あるいは
抵抗とダイオードの直列回路へコンデンサを並列
接続した回路に対して、ダイオードとツエナーダ
イオードと逆向きに接続した直列回路をコンデン
サと並列に接続したので、スイツチングトランジ
スタのターンオフ時にコンデンサが充電されてし
まつた後も、ダイオードツエナーダイオードの直
列回路を通して、トランジスタの蓄積キヤリアが
抜かれる。したがつて、ターンオフ時間が短縮さ
れ、トランジスタのスイツチングスピードが早く
なると共に、オフ時のコレクタの暗電流が極めて
小さくなるので、この種の電池を電源とする装置
においては、待機電力の低減に絶大な効果を奏す
る利点がある。
As is clear from the description of the above embodiments, according to the present invention, in an oscillation circuit of a switching transistor, a capacitor is connected to a parallel circuit of a resistor and a capacitor or a series circuit of a resistor and a diode to supply a driving pulse to the base of the transistor. A series circuit with a diode and a Zener diode connected in the opposite direction was connected in parallel with a capacitor, so that even after the capacitor was charged when the switching transistor was turned off, the diode and Zener diode were connected in parallel. The stored carriers of the transistors are removed through a series circuit. Therefore, the turn-off time is shortened, the switching speed of the transistor is increased, and the dark current in the collector when the transistor is off is extremely small, which makes it possible to reduce standby power in devices using this type of battery as a power source. It has the advantage of being extremely effective.
第1図は、本考案の一実施例を示す回路図、第
2図は、他の実施例の回路図、第3図a,bは、
それぞれ駆動パルスとベース電流波形を示す図、
第4図は従来のスイツチングトランジスタ発振回
路の異なる例を示す図である。
1……スイツチングトランジスタ、2……パル
ス発生回路、3……抵抗、4……コンデンサ、6
……ダイオード、7……ダイオード、8……ツエ
ナーダイオード。
FIG. 1 is a circuit diagram showing one embodiment of the present invention, FIG. 2 is a circuit diagram of another embodiment, and FIGS. 3a and 3b are
Diagrams showing the drive pulse and base current waveforms, respectively.
FIG. 4 is a diagram showing a different example of a conventional switching transistor oscillation circuit. 1... Switching transistor, 2... Pulse generation circuit, 3... Resistor, 4... Capacitor, 6
...Diode, 7...Diode, 8...Zener diode.
Claims (1)
スを発生させるトランスと、スイツチングトラン
シスタと、並列に配置したコンデンサと第1の抵
抗を含み、前記二次巻線と前記スイツチングトラ
ンジスタのベースの間に配設したパルス印加回路
と、前記一次巻線に電流を供給すると共に前記ス
イツチングトランジスタのベースに第2の抵抗を
介して順方向電流を供給する電流供給手段とを有
するスイツチングトランジスタの発振回路におい
て、 前記パルス印加回路が、前記コンデンサと、第
1のダイオードとツエナダイオードを互いに逆向
きに接続した第1の接続回路と、前記第1の抵抗
に前記第1のダイオードとは逆向きの第2のダイ
オードを直列に接続した第2の直列回路とを、前
記第1の直列回路が逆方向に、前記第2の直列回
路が順方向に能動的になるように並列に配置した
ことを特徴とする、スイツチングトランジスタの
発振回路。[Claims for Utility Model Registration] The utility model includes a transformer that generates positive and negative pulses induced from a primary winding to a secondary winding, a switching transistor, a capacitor and a first resistor arranged in parallel; a pulse application circuit disposed between a secondary winding and the base of the switching transistor; supplying current to the primary winding and supplying forward current to the base of the switching transistor via a second resistor; In the oscillation circuit of a switching transistor, the pulse application circuit includes the capacitor, a first connection circuit in which the first diode and the Zener diode are connected in opposite directions, and the first and a second series circuit in which a second diode having a direction opposite to that of the first diode is connected in series to a resistor, the first series circuit being connected in a reverse direction and the second series circuit being connected in a forward direction. An oscillation circuit of switching transistors, characterized in that they are arranged in parallel so that they are active.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1985199257U JPH0510422Y2 (en) | 1985-12-26 | 1985-12-26 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1985199257U JPH0510422Y2 (en) | 1985-12-26 | 1985-12-26 |
Publications (2)
Publication Number | Publication Date |
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JPS62109523U JPS62109523U (en) | 1987-07-13 |
JPH0510422Y2 true JPH0510422Y2 (en) | 1993-03-15 |
Family
ID=31160711
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1985199257U Expired - Lifetime JPH0510422Y2 (en) | 1985-12-26 | 1985-12-26 |
Country Status (1)
Country | Link |
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JP (1) | JPH0510422Y2 (en) |
Families Citing this family (1)
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---|---|---|---|---|
JP2008130950A (en) * | 2006-11-24 | 2008-06-05 | Denso Corp | Semiconductor device |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60212027A (en) * | 1984-04-06 | 1985-10-24 | Mitsubishi Electric Corp | Overvoltage protecting circuit of transistor |
JPS60249420A (en) * | 1984-05-25 | 1985-12-10 | Hitachi Metals Ltd | Driving circuit of switching transistor |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60180122U (en) * | 1985-04-15 | 1985-11-29 | 沖電気工業株式会社 | High efficiency high frequency power amplifier circuit |
-
1985
- 1985-12-26 JP JP1985199257U patent/JPH0510422Y2/ja not_active Expired - Lifetime
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Publication number | Priority date | Publication date | Assignee | Title |
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JPS60212027A (en) * | 1984-04-06 | 1985-10-24 | Mitsubishi Electric Corp | Overvoltage protecting circuit of transistor |
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Also Published As
Publication number | Publication date |
---|---|
JPS62109523U (en) | 1987-07-13 |
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