JPH0431794Y2 - - Google Patents
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- JPH0431794Y2 JPH0431794Y2 JP1984097777U JP9777784U JPH0431794Y2 JP H0431794 Y2 JPH0431794 Y2 JP H0431794Y2 JP 1984097777 U JP1984097777 U JP 1984097777U JP 9777784 U JP9777784 U JP 9777784U JP H0431794 Y2 JPH0431794 Y2 JP H0431794Y2
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Landscapes
- Protection Of Static Devices (AREA)
Description
【考案の詳細な説明】
〔産業上の利用分野〕
本考案は、バツテリ用過放電防止装置に係り、
とくに、自動車その他の自走車輌に搭載され使用
されるバツテリ用に好適なバツテリ用過放電防止
装置に関する。
とくに、自動車その他の自走車輌に搭載され使用
されるバツテリ用に好適なバツテリ用過放電防止
装置に関する。
一般に、バツテリは、ガソリン車,ジーゼル車
を問わず自走車輌の大多数に搭載され、エンジン
の始動および点火用電源として、また照明その他
の電装品の電源として、多用されている。そし
て、これら車輌に搭載されるバツテリには、特に
当該車輌の電源スイツチの切り忘れにより生じる
不必要な放電を防止するため、その出力段に、例
えば第5図に示すようなスイツチ回路が装備され
ている。
を問わず自走車輌の大多数に搭載され、エンジン
の始動および点火用電源として、また照明その他
の電装品の電源として、多用されている。そし
て、これら車輌に搭載されるバツテリには、特に
当該車輌の電源スイツチの切り忘れにより生じる
不必要な放電を防止するため、その出力段に、例
えば第5図に示すようなスイツチ回路が装備され
ている。
これを更に詳述すると、第3図において、電源
スイツチ部2は、電源投入用の第1の作動スイツ
チ10と、この第1の作動スイツチ10の接動作
で導通するスイツチング用のNPN形トランジス
タ12と、このトランジスタ12の導通により自
己の有する二つの接点14A,14Bを同時に閉
じると共にトランジスタ12の導通状態を保持す
るリレー回路14と、トランジスタ12の導通状
態を必要に応じて阻止することにより接点14A
を強制的に開放する電源開放用の第2の作動スイ
ツチ16等により構成されている。
スイツチ部2は、電源投入用の第1の作動スイツ
チ10と、この第1の作動スイツチ10の接動作
で導通するスイツチング用のNPN形トランジス
タ12と、このトランジスタ12の導通により自
己の有する二つの接点14A,14Bを同時に閉
じると共にトランジスタ12の導通状態を保持す
るリレー回路14と、トランジスタ12の導通状
態を必要に応じて阻止することにより接点14A
を強制的に開放する電源開放用の第2の作動スイ
ツチ16等により構成されている。
そして、この従来例においては、例えばエンジ
ンの始動に際し第1の作動スイツチ10を接とす
ると、前述したトランジスタ12およびリレー回
路14が作動してスイツチ手段を成す接点14A
が接となり、これによつて負荷回路(主制御回
路)にバツテリ1が接続され、同時にかかる接続
状態がリレー回路14の自己保持機能により保持
されるようになつている。
ンの始動に際し第1の作動スイツチ10を接とす
ると、前述したトランジスタ12およびリレー回
路14が作動してスイツチ手段を成す接点14A
が接となり、これによつて負荷回路(主制御回
路)にバツテリ1が接続され、同時にかかる接続
状態がリレー回路14の自己保持機能により保持
されるようになつている。
一方、車輌の稼動停止等により負荷回路からバ
ツテリ1を開放するには、外部操作によつて第2
の作動スイツチ16を作動させればよい。すなわ
ち、この作動スイツチ16の導通によりトランジ
スタ12がオフ状態となることから、リレー回路
14の自己保持機能が解除され、これによつてス
イツチ手段である接点14Aが開放動作をし、電
源がオフになり、過放電が防止されるようになつ
ている。
ツテリ1を開放するには、外部操作によつて第2
の作動スイツチ16を作動させればよい。すなわ
ち、この作動スイツチ16の導通によりトランジ
スタ12がオフ状態となることから、リレー回路
14の自己保持機能が解除され、これによつてス
イツチ手段である接点14Aが開放動作をし、電
源がオフになり、過放電が防止されるようになつ
ている。
しかしながら、前述した従来例において、過放
電を防止するためには、電源開放用の第2の作動
スイツチ16を手動にて確実に操作する必要があ
つた。そして、もし、この操作を忘れた場合には
負荷回路が接続されたままの状態となつているこ
とから、主制御回路等での励磁電流等による電力
消費が行われ、放電状態が生じる。
電を防止するためには、電源開放用の第2の作動
スイツチ16を手動にて確実に操作する必要があ
つた。そして、もし、この操作を忘れた場合には
負荷回路が接続されたままの状態となつているこ
とから、主制御回路等での励磁電流等による電力
消費が行われ、放電状態が生じる。
この放電状態が小電流によるものであつても長
時間継続されると、このバツテリ1は、やがて放
電終止電圧を越えて低下し過放電状態となる。こ
のことは、運転時に電力の供給ができなくなると
いう不都合を招来する。又、放電深度の大きい過
放電状態に至ると、充電に際しても元の状態に回
復しない所謂サルフエーシヨンを起こし、バツテ
リ交換等を余儀なくされるという不都合が生じ
る。
時間継続されると、このバツテリ1は、やがて放
電終止電圧を越えて低下し過放電状態となる。こ
のことは、運転時に電力の供給ができなくなると
いう不都合を招来する。又、放電深度の大きい過
放電状態に至ると、充電に際しても元の状態に回
復しない所謂サルフエーシヨンを起こし、バツテ
リ交換等を余儀なくされるという不都合が生じ
る。
一方、上述のようなバツテリの過放電に対する
他の防止策として、一定時間,アクセルがオン
(ON)にならない場合、或いは運転者が一定時
間運転席から離れた場合に、自動的に電源スイツ
チをオフにする等の手法もあるが、これらは複雑
な検知回路や高精度な外部センサが必要になるこ
とから経済性に欠けるという欠点がある。
他の防止策として、一定時間,アクセルがオン
(ON)にならない場合、或いは運転者が一定時
間運転席から離れた場合に、自動的に電源スイツ
チをオフにする等の手法もあるが、これらは複雑
な検知回路や高精度な外部センサが必要になるこ
とから経済性に欠けるという欠点がある。
本考案の目的は、かかる従来例の有する不都合
を改善し、電源スイツチの切り忘れによるバツテ
リの過放電を事前にしかも確実に防止することを
可能としたバツテリ用過放電防止装置を提供する
ことにある。
を改善し、電源スイツチの切り忘れによるバツテ
リの過放電を事前にしかも確実に防止することを
可能としたバツテリ用過放電防止装置を提供する
ことにある。
本考案では、電源投入用の第1の作動スイツチ
と、この第1の作動スイツチに応動してバツテリ
を負荷回路に接続するスイツチ手段と、このスイ
ツチ手段の作動状態を保持せしめる自己保持手段
と、この自己保持手段の作動状態を解除せしめる
電源開放用の第2の作動スイツチとを備えた電源
スイツチ部を有している。電源スイツチ部には、
バツテリの出力電圧が一定値以下に低下した場合
にこれを検出して自己保持手段の作動状態を自動
的に解除せしめる解除制御手段と、バツテリ稼動
中の負荷電流を検出するとともに該検出電流値が
予め定めた値以下の場合に限定して前記解除制御
手段の動作を許容する誤動作防止回路とが併設さ
れる、という構成を採つている。これによつて前
述した目的を達成しようとするものである。
と、この第1の作動スイツチに応動してバツテリ
を負荷回路に接続するスイツチ手段と、このスイ
ツチ手段の作動状態を保持せしめる自己保持手段
と、この自己保持手段の作動状態を解除せしめる
電源開放用の第2の作動スイツチとを備えた電源
スイツチ部を有している。電源スイツチ部には、
バツテリの出力電圧が一定値以下に低下した場合
にこれを検出して自己保持手段の作動状態を自動
的に解除せしめる解除制御手段と、バツテリ稼動
中の負荷電流を検出するとともに該検出電流値が
予め定めた値以下の場合に限定して前記解除制御
手段の動作を許容する誤動作防止回路とが併設さ
れる、という構成を採つている。これによつて前
述した目的を達成しようとするものである。
以下、本考案の一実施例を第1図ないし第2図
に基づいて説明する。ここで、従来型の電源スイ
ツチ部を示した第3図と同一の構成部材について
は同一符号を付すことにする。
に基づいて説明する。ここで、従来型の電源スイ
ツチ部を示した第3図と同一の構成部材について
は同一符号を付すことにする。
第1図に示す実施例は、バツテリ1と、このバ
ツテリ1を図示しない負荷及び主制御回路に接続
する電源スイツチ部2と、この電源スイツチ部2
内に装備されているスイツチ手段としてのリレー
接点14Aを必要に応じて自動的に開放するため
の解除制御手段5と、この解除制御手段5の誤動
作を防止する誤動作防止回路9とを有している。
ツテリ1を図示しない負荷及び主制御回路に接続
する電源スイツチ部2と、この電源スイツチ部2
内に装備されているスイツチ手段としてのリレー
接点14Aを必要に応じて自動的に開放するため
の解除制御手段5と、この解除制御手段5の誤動
作を防止する誤動作防止回路9とを有している。
電源スイツチ部2は、本実施例では前述した従
来例と同様に、電源投入用の第1の作動スイツチ
10と、この第1の作動スイツチ10の接で導通
するスイツチング用のNPN形トランジスタ12
と、このトランジスタ12の導通により自己の有
する二つの接点14A,14Bを閉じるとともに
これを保持する自己保持手段の要部をなすリレー
回路14と、トランジスタ12の導通状態を必要
に応じて阻止することにより接点14Aを強制的
に開放する電源開放用の第2の作動スイツチ16
等により構成されている。符号20はノイズ除去
用のコンデンサを示し、符号22は逆起電力吸収
用のダイオードを示す。
来例と同様に、電源投入用の第1の作動スイツチ
10と、この第1の作動スイツチ10の接で導通
するスイツチング用のNPN形トランジスタ12
と、このトランジスタ12の導通により自己の有
する二つの接点14A,14Bを閉じるとともに
これを保持する自己保持手段の要部をなすリレー
回路14と、トランジスタ12の導通状態を必要
に応じて阻止することにより接点14Aを強制的
に開放する電源開放用の第2の作動スイツチ16
等により構成されている。符号20はノイズ除去
用のコンデンサを示し、符号22は逆起電力吸収
用のダイオードを示す。
次に、解除制御手段5につき説明する。この解
除制御手段5では、まず、電源スイツチ部2内の
スイツチ手段であるリレー接点14Aの負荷側か
ら並列に引き出されたバツテリ1の端子電圧が、
電圧調整用の抵抗62を介して、コンパレータ6
0の非反転入力端子3と基準電圧発生のためのツ
エナーダイオード64のカソードとに、それぞれ
印加されるようになつている。そして、該ツエナ
ーダイオード64のアノードは、アースされ逆方
向にバイアスされている。
除制御手段5では、まず、電源スイツチ部2内の
スイツチ手段であるリレー接点14Aの負荷側か
ら並列に引き出されたバツテリ1の端子電圧が、
電圧調整用の抵抗62を介して、コンパレータ6
0の非反転入力端子3と基準電圧発生のためのツ
エナーダイオード64のカソードとに、それぞれ
印加されるようになつている。そして、該ツエナ
ーダイオード64のアノードは、アースされ逆方
向にバイアスされている。
一方、バツテリ1の端子電圧は、バイアス用抵
抗66,68を介してアースされている。そし
て、これら各抵抗66,68の接続点は、ドライ
ブ用ダイオード70及びこれに並列接続された抵
抗74を介してコンパレータ60の反転入力端子
2に接続されている。
抗66,68を介してアースされている。そし
て、これら各抵抗66,68の接続点は、ドライ
ブ用ダイオード70及びこれに並列接続された抵
抗74を介してコンパレータ60の反転入力端子
2に接続されている。
また、このコンパレータ60反転入力端子2
は、誤動作防止用のコンデンサ72を介して接地
されている。そして、該コンパレータ60の出力
端子6は、誤動作防止回路9を介して電源スイツ
チ部2のスイツチング用のトランジスタ12のベ
ース端子に接続されている。
は、誤動作防止用のコンデンサ72を介して接地
されている。そして、該コンパレータ60の出力
端子6は、誤動作防止回路9を介して電源スイツ
チ部2のスイツチング用のトランジスタ12のベ
ース端子に接続されている。
誤動作防止回路9は、前述したツエナーダイオ
ード64に並列接続された分圧抵抗84,86
と、この各抵抗84,86により分圧された中間
点電圧を基準電圧として非反転入力端子3に入力
するコンパレータ80とを備えている。同時に、
バツテリ1から負荷(主制御回路)に流れる電流
は図示しない制御回路から引き込まれ、端子Aか
ら抵抗88を介してコンパレータ80の反転入力
端子2に導かれている。ここで、符号90はノイ
ズ等によるコンパレータ80の誤動作防止用のコ
ンデンサである。
ード64に並列接続された分圧抵抗84,86
と、この各抵抗84,86により分圧された中間
点電圧を基準電圧として非反転入力端子3に入力
するコンパレータ80とを備えている。同時に、
バツテリ1から負荷(主制御回路)に流れる電流
は図示しない制御回路から引き込まれ、端子Aか
ら抵抗88を介してコンパレータ80の反転入力
端子2に導かれている。ここで、符号90はノイ
ズ等によるコンパレータ80の誤動作防止用のコ
ンデンサである。
更に、このコンパレータ80の出力端子6は、
前述した解除制御手段5のコンパレータ60の出
力端子6とインバータ82に各々接続されてい
る。そして、インバータ82による反転出力は、
図示の如く、ダイオード94を介してスイツチン
グ用トランジスタ12のベース端子に接続されて
いる。ここで、インバータ82の入力端は、抵抗
92を介して前述した電源スイツチ部2の負荷側
に接続されている。
前述した解除制御手段5のコンパレータ60の出
力端子6とインバータ82に各々接続されてい
る。そして、インバータ82による反転出力は、
図示の如く、ダイオード94を介してスイツチン
グ用トランジスタ12のベース端子に接続されて
いる。ここで、インバータ82の入力端は、抵抗
92を介して前述した電源スイツチ部2の負荷側
に接続されている。
次に、この実施例の全体的動作について説明す
る。
る。
まず、電源投入用の作動スイツチ10をオンに
するとトランジスタ12のベース電位が上がり、
該トランジスタ12は導通状態になる。この導通
に付勢されてリレー回路14が作動して二つの接
点14A,14Bを閉じるため、バツテリ1と負
荷(主制御回路)とが導通し、該バツテリ1が稼
動状態に入る。ここで、上記接点14Bが閉じて
いるため、第1の作動スイツチ10を離しても
(オフ状態)、トランジスタ12の導通が保持さ
れ、従つて当該リレー回路14はオン状態を保持
する自己保持型の回路として機能している。この
電源スイツチ部2のオン状態を解除するには、解
除用の第2の作動スイツチ16を押すと(オン状
態)、トランジスタ12のベース電位が下がり、
これによつて該トランジスタ12はオフになるた
め、リレー回路14もオフになり、従つてバツテ
リ1と負荷状態とが切り離されるように成つてい
る。
するとトランジスタ12のベース電位が上がり、
該トランジスタ12は導通状態になる。この導通
に付勢されてリレー回路14が作動して二つの接
点14A,14Bを閉じるため、バツテリ1と負
荷(主制御回路)とが導通し、該バツテリ1が稼
動状態に入る。ここで、上記接点14Bが閉じて
いるため、第1の作動スイツチ10を離しても
(オフ状態)、トランジスタ12の導通が保持さ
れ、従つて当該リレー回路14はオン状態を保持
する自己保持型の回路として機能している。この
電源スイツチ部2のオン状態を解除するには、解
除用の第2の作動スイツチ16を押すと(オン状
態)、トランジスタ12のベース電位が下がり、
これによつて該トランジスタ12はオフになるた
め、リレー回路14もオフになり、従つてバツテ
リ1と負荷状態とが切り離されるように成つてい
る。
次に、解除用の第2の作動スイツチ16を何ら
かの理由で切り忘れ、バツテリ1を稼動状態のま
ま放置した場合を考える。この状態にあつては、
コンパレータ60の非反転入力端子3の基準電圧
よりも、反転入力端子2の方がハイレベル「H」
に設定されているので、その出力はローレベル
「L」である。
かの理由で切り忘れ、バツテリ1を稼動状態のま
ま放置した場合を考える。この状態にあつては、
コンパレータ60の非反転入力端子3の基準電圧
よりも、反転入力端子2の方がハイレベル「H」
に設定されているので、その出力はローレベル
「L」である。
一方、この稼動状態にあつては、負荷電流が流
れている状態であり、コンパレータ80の非反転
入力端子3の基準電位よりも反転入力端子2の方
がハイレベルに設定されている。従つて、このと
きの該コンパレータ80の出力はローレベル
(L)となり、インバータ82の入力段にはこれ
ら二つのレベル「L」と「L」のアンド(AND)
であるローレベル「L」が印加される。このた
め、該インバータ82の出力はハイレベルとな
り、ダイオード94は逆バイアスされるため解除
制御手段5は働かない。この様子を第2図1に示
す。
れている状態であり、コンパレータ80の非反転
入力端子3の基準電位よりも反転入力端子2の方
がハイレベルに設定されている。従つて、このと
きの該コンパレータ80の出力はローレベル
(L)となり、インバータ82の入力段にはこれ
ら二つのレベル「L」と「L」のアンド(AND)
であるローレベル「L」が印加される。このた
め、該インバータ82の出力はハイレベルとな
り、ダイオード94は逆バイアスされるため解除
制御手段5は働かない。この様子を第2図1に示
す。
次に、バツテリ1の端子電圧が徐々に低下して
設定値よりも下がると、コンパレータ60の出力
は反転してハイレベルになる。一方、このときの
電流は所定の設定値より下回つて、コンパレータ
80の出力も反転しハイレベルとなる。しかる
に、インバータ82の入力はハイレベル,出力は
ローレベルとなり、ダイオード94は順方向にバ
イアスされる。このため、スイツチングトランジ
スタ12のベース電位はエミツタ電位よりも下が
つてオフとなり、結局、リレー接点14Aが開
き、バツテリ1は移動状態から開放され、深度の
過放電が防止される〔第2図4参照〕。
設定値よりも下がると、コンパレータ60の出力
は反転してハイレベルになる。一方、このときの
電流は所定の設定値より下回つて、コンパレータ
80の出力も反転しハイレベルとなる。しかる
に、インバータ82の入力はハイレベル,出力は
ローレベルとなり、ダイオード94は順方向にバ
イアスされる。このため、スイツチングトランジ
スタ12のベース電位はエミツタ電位よりも下が
つてオフとなり、結局、リレー接点14Aが開
き、バツテリ1は移動状態から開放され、深度の
過放電が防止される〔第2図4参照〕。
更に、バツテリ1の稼動中にモータ等を駆動さ
せて、大きなドライブ電流を一時的に流した場合
は、時定数決定用のコンデンサ72と抵抗74等
によつて、このような場合の誤動作を防止する
が、そのほかコンパレータ80によつても、後述
するように、その機能を倍加させることができ
る。すなわち、バツテリ1の端子電圧が急激に低
下するため、コンパレータ60の出力はハイレベ
ルになるが、設定値以上の大電流が負荷へ流れて
いるから、コンパレータ80の出力はローレベル
である。この場合は、結局、ダイオード94には
逆方向のバイアスが施されるから、解除は掛から
ず、従つて解除制御手段5の誤動作は防止される
〔第2図2参照〕。
せて、大きなドライブ電流を一時的に流した場合
は、時定数決定用のコンデンサ72と抵抗74等
によつて、このような場合の誤動作を防止する
が、そのほかコンパレータ80によつても、後述
するように、その機能を倍加させることができ
る。すなわち、バツテリ1の端子電圧が急激に低
下するため、コンパレータ60の出力はハイレベ
ルになるが、設定値以上の大電流が負荷へ流れて
いるから、コンパレータ80の出力はローレベル
である。この場合は、結局、ダイオード94には
逆方向のバイアスが施されるから、解除は掛から
ず、従つて解除制御手段5の誤動作は防止される
〔第2図2参照〕。
最後に、通常の稼動状態において、バツテリ1
の端子電圧は解除電圧値以上でありながら負荷が
軽くなり負荷電流が小さくなつたときは、コンパ
レータ60の出力はローレベルのままである。一
方、コンパレータ80の出力はハイレベルに設定
されるため、結局インバータ82の出力はハイレ
ベルであり、解除されることなく稼動状態が保持
され続ける。〔第2図3参照〕。
の端子電圧は解除電圧値以上でありながら負荷が
軽くなり負荷電流が小さくなつたときは、コンパ
レータ60の出力はローレベルのままである。一
方、コンパレータ80の出力はハイレベルに設定
されるため、結局インバータ82の出力はハイレ
ベルであり、解除されることなく稼動状態が保持
され続ける。〔第2図3参照〕。
また、本実施例においては、バツテリ1の端子
電圧の解除電圧値をより高く設定可能なことか
ら、放電によるエネルギ損失をより少なくできる
のみならず、一時的な大電流等による解除制御手
段の誤動作を略完全に防止せしめることができる
という利点がある。
電圧の解除電圧値をより高く設定可能なことか
ら、放電によるエネルギ損失をより少なくできる
のみならず、一時的な大電流等による解除制御手
段の誤動作を略完全に防止せしめることができる
という利点がある。
以上のように、本考案によると、解除制御手段
の作用によつて、バツテリの出力端子電圧が一定
値以下に低下した場合にこれを検出するととも
に、自己保持手段の作動状態を自動的に解除せし
めることが可能となり、さらにバツテリの稼動中
における該解除制御手段の誤動作防止用の誤動作
防止回路をるとともに、この誤動作防止回路を、
負荷回路に一定値以下の低電圧が流れている場合
のみ前述した解除制御手段の動作を許容するよう
に構成したことから、この瞬間的な異常変化によ
る電圧降下若しくは通常負荷時におけるバツテリ
の電圧降下によつて誤動作し易い解除制御手段に
対し、かかる誤動作を電流チエツクによつて有効
に防止せしめることができ、以上のように構成さ
れ機能するので、電源スイツチの切り忘れによる
バツテリの過放電を確実に防止し得るという実用
的なバツテリ用過放電防止装置を提供することが
できる。
の作用によつて、バツテリの出力端子電圧が一定
値以下に低下した場合にこれを検出するととも
に、自己保持手段の作動状態を自動的に解除せし
めることが可能となり、さらにバツテリの稼動中
における該解除制御手段の誤動作防止用の誤動作
防止回路をるとともに、この誤動作防止回路を、
負荷回路に一定値以下の低電圧が流れている場合
のみ前述した解除制御手段の動作を許容するよう
に構成したことから、この瞬間的な異常変化によ
る電圧降下若しくは通常負荷時におけるバツテリ
の電圧降下によつて誤動作し易い解除制御手段に
対し、かかる誤動作を電流チエツクによつて有効
に防止せしめることができ、以上のように構成さ
れ機能するので、電源スイツチの切り忘れによる
バツテリの過放電を確実に防止し得るという実用
的なバツテリ用過放電防止装置を提供することが
できる。
第1図は本考案にかかる一実施例の構成を示す
回路図、第2図は第1図に示す実施例の動作説明
のための真理値表図、第3図は従来例の構成を示
す回路図である。 1……バツテリ、2……電源スイツチ部、5…
…解除制御手段、9……誤動作防止回路、10…
…電源投入用の第1の作動スイツチ、14……自
己保持手段の要部を成すリレー回路、14A……
スイツチ手段としてのリレー接点、16……電源
開放用の第2の作動スイツチ。
回路図、第2図は第1図に示す実施例の動作説明
のための真理値表図、第3図は従来例の構成を示
す回路図である。 1……バツテリ、2……電源スイツチ部、5…
…解除制御手段、9……誤動作防止回路、10…
…電源投入用の第1の作動スイツチ、14……自
己保持手段の要部を成すリレー回路、14A……
スイツチ手段としてのリレー接点、16……電源
開放用の第2の作動スイツチ。
Claims (1)
- 【実用新案登録請求の範囲】 電源投入用の第1の作動スイツチと、この第1
の作動スイツチに応動してバツテリを負荷回路に
接続するスイツチ手段と、このスイツチ手段の作
動状態を保持せしめる自己保持手段と、この自己
保持手段の作動状態を解除せしめる電源開放用の
第2の作動スイツチとを備えた電源スイツチ部を
有するバツテリ用過放電防止装置において、 前記電源スイツチ部に、前記バツテリの出力電
圧が一定値以下に低下した場合にこれを検出して
前記自己保持手段の作動状態を自動的に解除せし
める解除制御手段と、前記バツテリ稼動中の負荷
電流を検出するとともにこの検出電流値が予め定
めた値以下の場合に限定して前記解除制御手段の
動作を許容する誤動作防止回路とを併設したこと
を特徴とするバツテリー用過放電防止装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9777784U JPS6114839U (ja) | 1984-06-29 | 1984-06-29 | バツテリ用過放電防止装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9777784U JPS6114839U (ja) | 1984-06-29 | 1984-06-29 | バツテリ用過放電防止装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6114839U JPS6114839U (ja) | 1986-01-28 |
JPH0431794Y2 true JPH0431794Y2 (ja) | 1992-07-30 |
Family
ID=30657337
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP9777784U Granted JPS6114839U (ja) | 1984-06-29 | 1984-06-29 | バツテリ用過放電防止装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6114839U (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06315427A (ja) * | 1993-05-07 | 1994-11-15 | Iwatani Internatl Corp | 商品の輸送陳列棚 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5576578A (en) * | 1978-12-06 | 1980-06-09 | Anritsu Corp | Overdischarge-preventing circuit for battery |
JPS5761924B2 (ja) * | 1979-03-12 | 1982-12-27 | Uchida Seisakusho Kk |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5761924U (ja) * | 1980-09-30 | 1982-04-13 |
-
1984
- 1984-06-29 JP JP9777784U patent/JPS6114839U/ja active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5576578A (en) * | 1978-12-06 | 1980-06-09 | Anritsu Corp | Overdischarge-preventing circuit for battery |
JPS5761924B2 (ja) * | 1979-03-12 | 1982-12-27 | Uchida Seisakusho Kk |
Also Published As
Publication number | Publication date |
---|---|
JPS6114839U (ja) | 1986-01-28 |
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