JPH0430531A - 半導体集積回路 - Google Patents

半導体集積回路

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Publication number
JPH0430531A
JPH0430531A JP13875290A JP13875290A JPH0430531A JP H0430531 A JPH0430531 A JP H0430531A JP 13875290 A JP13875290 A JP 13875290A JP 13875290 A JP13875290 A JP 13875290A JP H0430531 A JPH0430531 A JP H0430531A
Authority
JP
Japan
Prior art keywords
wiring
potential
insulating film
side wiring
low
Prior art date
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Pending
Application number
JP13875290A
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English (en)
Inventor
Kazuo Kaneko
和夫 金子
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sanyo Electric Co Ltd
Original Assignee
Sanyo Electric Co Ltd
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Publication date
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  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (イ)産業上の利用分野 本発明はアルミ配線の電解腐食による不良発生を防止で
きる半導体集積回路に関する。
(ロ)従来の技術 半導体素子の配線金属として、アルミニウムはオーミッ
ク性が容易に得られる、電気伝導性が良い、低コストで
あるなどの点でもっとも多く用いられている。素子内部
の構造は、第3図に示す如< Sin、やポリイミド系
樹脂から成る絶縁膜(1)表面をアルミ(Al)又はア
ルミ・シリフン(Al−5i)から成る配線(2)(3
)を延在きせたもので、配線(2)(3)は絶縁膜(1
)に開けられたコンタクトホールを介してその下の基板
表面に設けられた拡散領域とオーミックコンタクトし、
所望の回路接続を行なうようになっている。多層配線構
造では、配線(2)(3)の絶縁膜(1)に開けられた
スルーホールを介してその下の配線層と電気接続するこ
とになる。そして、配線(2>(3)の表面はSin、
やポリイミド系樹脂等のパッシベーション被膜(4)で
覆われている。
(ハ〉発明が解決しようとする課題 しかしながら、隣接する配線(2)(3)間に例えばy
 ccとGNDの如きバイアス電圧が印加された場合、
樹脂中に含まれる又は外部より侵入した水分と、樹脂中
に含まれる可動イオンにより配線り2)(3)間に電解
質溶液が生じ、前記バイアス印加に伴うリーク電流の作
用によって電気分解が生じることに起因し、 高電位側配線(3)では AN +4C1−→AjICj24−+3eAIC1m
−+5uzo−Affi (OH)、+3H“+4C!
−・・・(1)なる反応式で、低電位側配線(2)では
Aj!+3(OH>−=Aj!(OH)s+3e  ・
=・”・””・”<2)なる反応式で電解腐食が発生す
るのである。このようなAffiの腐食は、ポンディン
グパッド部の例であるが例えば特開昭63−17953
8号に記載されている。
また、絶縁膜(1)やパッシベーション被膜(4)とし
て段差の被覆性、コスト、および工程の簡素化に優れた
ポリイミド系樹脂を用いると、上述した腐食が著しい。
理由は、第1にポリイミド系樹脂の耐湿性自体がシリコ
ン窒化膜(SiN)等のものより劣ること、第2にポリ
イミド系樹脂表面にアルミとの密着性を向上する目的で
アルミ堆積前に処す粗面処理(逆スパッタ等)によって
絶縁膜(1〉表面に導電層(カーボン等)が形成され、
前記電解イオンが移動しやすい状態であること、である
このような電解腐食による断線を防止するため、従来は
低電位側配線(2〉と高電位側配線(3)との距離を広
くとることで対応していたが、チップサイズが大きくな
る欠点を有していた。
(ニ)課題を解決するための手段 本発明は上記従来の欠点に鑑み成されたもので、低電位
側配線(2)と高電位側配線(3〉との間の絶縁膜(1
〉上に、何の電位も印加しないフローティング状態とし
た遮断配線(5)を配置することにより、腐食による断
線を防止できる半導体集積回路を提供するものである。
(*〉作用 本発明によれば、遮断配線(5)のA2表面は通常の条
件下で表面が酸化物被膜で不働態化されており、且つ絶
縁膜(1)との密着力は絶縁膜(1)とパッシベーショ
ン被膜(4)のものより強固である。そのため、主に絶
縁膜(1)表面を流れるリーク電流の導通路に遮断配線
(5)による絶縁物が配置きれたのに等しく、前記リー
ク電流を抑制できるので、腐食反応も抑制できる。
〈へ)実施例 以下に本発明の一実施例を図面を参照しながら詳細に説
明する。
第1図と第2図は夫々本発明の配線構造を示す平面図と
断面図である。以下、配線層が多層配線の2層目配線で
ある構造を例にとる。
図示せぬ半導体チップの表面には選択拡散によって多数
の回路素子(トランジスタ、抵抗等)が作り込まれ、チ
ップ表面を覆う酸化膜を開孔したコンタクトホールを介
して第1層の配線層が不純物拡散領域とフンタクトする
。前記第1層目配線を覆うようにして層間絶縁膜(1)
が形成され、層間絶縁膜(1)上に第2の配線層によっ
て低電位側配線(2)と高電位側配線(3)とが形成き
れる。前記第1の配線層と第2の配線層とは、層間絶縁
膜(1)を開口したスルーホールを介してコンタクトし
、前記回路素子の相互接続をとる。前記第2の配線層の
表面は、パッシベーション被膜(4)で覆われる。
前記層間絶縁膜(1)は、CVD法によるシリコン酸化
膜を用いる他、スピンオン塗布法によるポリイミド系絶
縁膜を用いることもできる。この場合、アルミとの密着
性を向上する目的で層間絶縁膜(1)表面に粗面化処理
を処す。手法は逆スパッタ等である。そして粗面化いれ
た層間絶縁膜(1)上に蒸着又はスパッタ法により八!
又はAN −5iを堆積し、これをバターニングするこ
とで前記第2の配線層を形成する。層間絶縁膜(1)が
ポリイミドであれば、最終パッシベーション被膜(4〉
もボッイミド系絶縁膜とする。
上記第2の配線による低電位側配線(2)と高電位側配
線(3)は、動作時に夫々接地電位(GND)と電源電
位(VcC)の如き電位が印加され、両者間に電位差が
生ずるものである。このように電位差がある配線が近接
配置されることは、半導体チップのパターン設計上比較
的多くみられる。
近接配置を全く無くすことは、パターン設計に多大な制
約を与えることになる。
そして、近接配置された低電位側配線(2)と高電位側
配線(3)との間の絶縁膜(1)表面に、前記第2の配
線層のパターニングと同時に遮断配線(5)を形成する
。遮断配線(5)はどこにも結線せず、何の電位も印加
しないフローティング状態とする。線幅は任意である。
また、低電位側配線(2)と高電位側配線(3)とが近
接した部分にのみ延在させれば良い。
上述した本発明の配線構造においては、低電位側配線(
2)と高電位側配線(3)とのバイアス印加に伴い電解
質溶液中の可動イオン((J−、Na′″等)が夫々に
移動しようとする。移動ルートは絶縁膜(1)表面の界
面が主である。ところが、低電位側配線(2〉と高電位
側配線(3)との間には遮断配線(5)が配置され、遮
断配線(5)はアニール処理によって絶縁膜(1)とパ
ッシベーション被膜(4)との密着より強固に絶縁膜(
1)と密着しているので、前記可動イオンは遮断配線(
5)と絶縁膜(1)との界面を移動できない0分子径が
大き過ぎるのである。又電位的にフローティングされた
遮断配線の表面は、酸化物被膜で不働態化きれているた
め、電気的反応が行なわれにくい。このため、低電位側
配線(2)と高電位側配線(3)の間は、その電解質溶
液中に、不働態ギブサイトに保護された遮断配線で、絶
縁された状態になっている。従って、画電極(2)(3
)間の可動イオンの移動を阻止できるので、(1)(2
)式の電解腐食を抑制し、配線(2)(3)の劣化、断
線を防止できるのである。高温高湿状態で動作試験を行
なうTHB試験においても、本願発明は優れた効果をも
たらすことが確認された。
(ト)発明の効果 以上に説明した通り、本発明は遮断配線(5)をダムと
して可動イオンの界面での移動を阻止できるので、腐食
反応を抑制し配、1(2)(3)の劣化、断線を防止で
きる利点を有する。従って、耐湿性の高い半導体装置を
提供できる利点をも有する。また、低電位側配線(2)
と高電位側配線(3)との間を広くする必要がないので
、チップサイズの縮手にも寄与できる利点をも有する。
【図面の簡単な説明】
第1図と第2図は夫々本発明を説明する為の平面図と断
面図、第3図は従来例を説明する為の断面図である。

Claims (3)

    【特許請求の範囲】
  1. (1)アルミニウムを主体とする導電材料から成り、異
    った電位が与えられる2つの配線が互いに隣接して絶縁
    膜上を延在する半導体集積回路において、 前記2つの配線の高電位側配線と低電位側配線との間の
    前記絶縁膜上に、前記導電材料から成り何の電位も印加
    しないフローティング状態とした遮断配線を配置したこ
    とを特徴とする半導体集積回路。
  2. (2)前記絶縁膜はポリイミド系樹脂であることを特徴
    とする請求項第1項に記載の半導体集積回路。
  3. (3)前記ポリイミド系樹脂の表面は逆スパッタによる
    粗面化処理が処されていることを特徴とする請求項第1
    項に記載の半導体集積回路。
JP13875290A 1990-05-28 1990-05-28 半導体集積回路 Pending JPH0430531A (ja)

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JPH0430531A true JPH0430531A (ja) 1992-02-03

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5472305B2 (ja) * 2009-08-19 2014-04-16 日本電気株式会社 給電線構造及びそれを用いた回路基板、emiノイズ低減方法

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JP5472305B2 (ja) * 2009-08-19 2014-04-16 日本電気株式会社 給電線構造及びそれを用いた回路基板、emiノイズ低減方法

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