JPH04188723A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH04188723A JPH04188723A JP31755690A JP31755690A JPH04188723A JP H04188723 A JPH04188723 A JP H04188723A JP 31755690 A JP31755690 A JP 31755690A JP 31755690 A JP31755690 A JP 31755690A JP H04188723 A JPH04188723 A JP H04188723A
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- layer
- conductive layer
- contact hole
- insulating film
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Links
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Landscapes
- Electrodes Of Semiconductors (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野]
本発明は半導体装置の導電層間のコンタクト形成方法に
関する。
関する。
[従来の技術]
従来技術においては、半導体基板上の第1の導電層上に
設けられた絶縁膜上にコンタクトホールを形成後、層構
成が少なくとも一層以上である第2の導電層を形成する
方法が一般的であった。
設けられた絶縁膜上にコンタクトホールを形成後、層構
成が少なくとも一層以上である第2の導電層を形成する
方法が一般的であった。
[発明が解決しようとする課題]
しかしながら前述の従来技術においては、微細加工技術
の進展とともにコンタクトホールのサイズがサブミクロ
ンと極端に小さくなってきた場合、コシタクト抵蹴が増
大し、かつ大きなばらつきを持つ。そこで本発明はこの
ような問題点を解決するもので、その目的とするところ
はコンタクト抵抗値とそのばらつきを低減させることに
ある。
の進展とともにコンタクトホールのサイズがサブミクロ
ンと極端に小さくなってきた場合、コシタクト抵蹴が増
大し、かつ大きなばらつきを持つ。そこで本発明はこの
ような問題点を解決するもので、その目的とするところ
はコンタクト抵抗値とそのばらつきを低減させることに
ある。
[11題を解決するための手段]
本発明の半導体装置は、半導体基板上の第1の導電層上
に設けられた絶縁膜にコンタクトホールを形成後、レー
ザー光を照射してアニール処理し、しかる後に層構成が
少なくとも一層以上である第2の導電層を形成すること
を特徴とする。
に設けられた絶縁膜にコンタクトホールを形成後、レー
ザー光を照射してアニール処理し、しかる後に層構成が
少なくとも一層以上である第2の導電層を形成すること
を特徴とする。
[実施例]
以下本発明について実施例に基づき説明する。第1図は
本発明の実施例を工程順に示す断面図である。第1図(
a)において1はシリコン基板、2は第1の導電層であ
る不純物拡散層、3は絶縁膜であり、4は絶縁膜に開口
したコンタクトホールであり、5はアニール処理のため
照射したエキシマレーザ−光である。第1図(b)は1
例としてエキシマレーザ−光によりアニール処理を実施
した後、層構成が少なくとも一層以上である第2の導電
層として、6に示す1%シリコンを含有するアルミニウ
ムをスッパッタリング法にて堆積後、バターニングした
ものである。第2図は従来技術と本実施例によるコンタ
クト抵抗の測定結果をヒストグラムに示したものである
。これらはコンタクトサイズ1ミクロン角のコンタクト
抵抗をケルビン法にて測定した結果であり、第1の導電
層はN型拡散層、また第2の導電層は1%シリコンを含
有するアルミニウムである。第2図(a)は従来技術に
よるコンタクト抵抗の測定結果、また第2図(b)は本
実施例によるコンタクト抵抗の測定結果である。第2図
から、明かのように、本発明によればコンタクト抵抗の
平均値とばらつきを大幅に低減することが可能となる。
本発明の実施例を工程順に示す断面図である。第1図(
a)において1はシリコン基板、2は第1の導電層であ
る不純物拡散層、3は絶縁膜であり、4は絶縁膜に開口
したコンタクトホールであり、5はアニール処理のため
照射したエキシマレーザ−光である。第1図(b)は1
例としてエキシマレーザ−光によりアニール処理を実施
した後、層構成が少なくとも一層以上である第2の導電
層として、6に示す1%シリコンを含有するアルミニウ
ムをスッパッタリング法にて堆積後、バターニングした
ものである。第2図は従来技術と本実施例によるコンタ
クト抵抗の測定結果をヒストグラムに示したものである
。これらはコンタクトサイズ1ミクロン角のコンタクト
抵抗をケルビン法にて測定した結果であり、第1の導電
層はN型拡散層、また第2の導電層は1%シリコンを含
有するアルミニウムである。第2図(a)は従来技術に
よるコンタクト抵抗の測定結果、また第2図(b)は本
実施例によるコンタクト抵抗の測定結果である。第2図
から、明かのように、本発明によればコンタクト抵抗の
平均値とばらつきを大幅に低減することが可能となる。
ところで本実施例においては、第1の導電層としてシリ
コン基板上の不純物拡散層を例として用いたが、これは
多結晶シリコン、またはチタン、タングステン、モリブ
デン等のポリサイドまたはシリサイド、またはチタン、
タングステン、モリブデン等の高融点金属においてもま
ったく同様に適用可能である。
コン基板上の不純物拡散層を例として用いたが、これは
多結晶シリコン、またはチタン、タングステン、モリブ
デン等のポリサイドまたはシリサイド、またはチタン、
タングステン、モリブデン等の高融点金属においてもま
ったく同様に適用可能である。
また層構成が少なくとも一層以上である第2の導電層と
して、1%シリコンを含有するアルミニウムを例として
説明したが、これは多結晶シリコン、またはチタン、タ
ングステン、モリブデン等のポリサイドまたはシリサイ
ド、またはチタン、タングステン、モリブデン等の高融
点金属、または銅やパラジウムを含むアルミニウム、ま
たはチタン、チタンナイトライド、チタンタングステン
等の高融点金属並びにその化合物等とアルミニウム並び
にアルミニウム合金との積層配線においてもまったく同
様に適用可能である。
して、1%シリコンを含有するアルミニウムを例として
説明したが、これは多結晶シリコン、またはチタン、タ
ングステン、モリブデン等のポリサイドまたはシリサイ
ド、またはチタン、タングステン、モリブデン等の高融
点金属、または銅やパラジウムを含むアルミニウム、ま
たはチタン、チタンナイトライド、チタンタングステン
等の高融点金属並びにその化合物等とアルミニウム並び
にアルミニウム合金との積層配線においてもまったく同
様に適用可能である。
[発明の効果]
以上述べてきたように本発明によれば、コンタクトホー
ル形成後、レーザー光を照射することによりアニール処
理を実施し、コンタクト抵抗の低減とばらつきの減少が
可能となる
ル形成後、レーザー光を照射することによりアニール処
理を実施し、コンタクト抵抗の低減とばらつきの減少が
可能となる
第1図は本発明の実施例を工程順に示す断面図であり、
第2図は従来技術と本実施例によるコンタクト抵抗の測
定結果を示すヒストグラムである。 1 シリコン基板 2 不純物拡散層 3 絶縁膜 4 コンタクトホール 5 レーザー光 61%シリコンを含有するアルミニウム以上 出願人 セイコーエプソン株式会社 代理人 弁理士 鈴木喜三部(他1名)第1図(b)
第2図は従来技術と本実施例によるコンタクト抵抗の測
定結果を示すヒストグラムである。 1 シリコン基板 2 不純物拡散層 3 絶縁膜 4 コンタクトホール 5 レーザー光 61%シリコンを含有するアルミニウム以上 出願人 セイコーエプソン株式会社 代理人 弁理士 鈴木喜三部(他1名)第1図(b)
Claims (1)
- 半導体基板上の第1の導電層上に設けられた絶縁膜にコ
ンタクトホールを形成後、レーザー光を照射してアニー
ル処理し、しかる後に層構成が少なくとも一層以上であ
る第2の導電層を形成することを特徴とする半導体装置
の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP31755690A JPH04188723A (ja) | 1990-11-21 | 1990-11-21 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP31755690A JPH04188723A (ja) | 1990-11-21 | 1990-11-21 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04188723A true JPH04188723A (ja) | 1992-07-07 |
Family
ID=18089576
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP31755690A Pending JPH04188723A (ja) | 1990-11-21 | 1990-11-21 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04188723A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7554055B2 (en) | 2005-05-03 | 2009-06-30 | Hitachi Global Storage Technologies Netherlands B.V. | Method for making ohmic contact to silicon structures with low thermal loads |
-
1990
- 1990-11-21 JP JP31755690A patent/JPH04188723A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7554055B2 (en) | 2005-05-03 | 2009-06-30 | Hitachi Global Storage Technologies Netherlands B.V. | Method for making ohmic contact to silicon structures with low thermal loads |
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