JPH03276245A - 中央処理装置の障害処理方式 - Google Patents

中央処理装置の障害処理方式

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JPH03276245A
JPH03276245A JP2073302A JP7330290A JPH03276245A JP H03276245 A JPH03276245 A JP H03276245A JP 2073302 A JP2073302 A JP 2073302A JP 7330290 A JP7330290 A JP 7330290A JP H03276245 A JPH03276245 A JP H03276245A
Authority
JP
Japan
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input
output device
address
fault
channel
Prior art date
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Pending
Application number
JP2073302A
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English (en)
Inventor
Shuichi Yamano
修一 山野
Hideki Iwao
岩尾 秀樹
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は複数のチャネルを持つ中央処理装置及び入出力
装置の制御に関する。
〔従来の技術〕
従来、マシンチエツク割込みが発生すると、チャネルの
入出力命令実行状態を調べ、チャネルの入出力命令実行
中ならば、該当チャネルを切離し、チャネル状態語に異
常を示すビットをセソ1−するとともにコンデイション
コードをセットして該当チャネルの入出力命令を終了し
、マシンチエツク割込みを回避する方式になっている。
これに関連するものとして、特公昭64−8379号公
報等があげられる。
〔発明が解決しようとする課題〕
上記公知例は、中央処理装置のマシンチエツク割込みに
ついての回避例であり、入出力装置及び、入出力装置と
チャネルとのインタフェース上の障害については考慮さ
れていない。
本発明は、入出力装置及び入出力装置とチャネルとのイ
ンタフェース部の障害が発生した時にも、情報処理を継
続できるようにすることを目的とする。
〔発明が解決するための手段〕
上記目的を達成するために、中央処理装置に、入出力装
置の現用、交替アドレスのテーブル及びそれぞれの入出
力装置に対応する障害フラグを設けたものである。
〔作用〕
障害フラグは、入出力装置からの報告及び入出力装置と
チャネルとのインタフェース部分での障害により、1に
セントされ、ハードウェアリセット命令によりOにリセ
ットされる。
また、アドレスのテーブルは、現用アドレスと交替アド
レスが、中央処理装置の準備完了状態の時にセットされ
、ハードウェアリセット命令実行時に障害フラグが1の
時、現用アドレスと交換アドレスが交換される。
〔実施例〕
以下、本発明の一実施例を第1図により説明する。中央
処理装置の記録装置に入出力装置の現用アドレスと予備
の入出力装置を示す交替アドレスとをテーブルとして記
憶しておく。また、現用、交替アドレスに障害フラグも
同時に設定しておく。
システム動作中に、入出力装置あるいは入出力装置とチ
ャネルとのインタフェース部分に障害が発生した場合、
チャネルが障害フラグを1にセットし、対応する入出力
命令に対するチャネル状態語に異常を示すビットをセッ
トする。上位ソフトウェアは、チャネル状態語の異常を
示すビットを判定し、ハードウェアリセット命令を発行
する。このハードウェアリセット命令により、障害フラ
グが1の対応するアドレステーブルの現用アドレスと交
替アドレスを交換し、障害フラグを0にリセットする。
本実施例によれば、入出力装置あるいは入出力装置とチ
ャネルとのインタフェース部分に障害が発生した場合に
上位ソフトウェアのハードウェアリセット命令により、
障害装置と予備の入出力装置との交換を行なうことがで
き、システムダウンの回復を自動的にできる。
〔発明の効果〕
本発明によれば、入出力装置あるいは入出力装置とチャ
ネルとのインタフェース部分に障害が発生した場合に、
上位ソフトウェアのハードウェアリセット命令により、
予備の入出力装置と現用の入出力装置とのアドレスを中
央処理装置の記憶装置上で交換し、システムダウンの回
復を自動的に行なうことができる。
【図面の簡単な説明】
第1図は本発明の一実施例の中央処理装置回路図である
。 1・・・命令語レジスタ 2・・・記憶装置 3・・現用入出力アドレステーブル 4・・・交替入出力アドレステーブル 5・・・選択回路 6・・・選択信号制御回路 7・・・フラグレジスタ 8−1〜8−n・・・入出力制御部 α・・・オペランドアドレスデータ b・・・現用入出力アドレスデータ C・・・交替入出力アドレスデータ d・・・入出力アドレスバス e・・・ハードウェアリセット信号 f・・・フラグセット信号

Claims (1)

    【特許請求の範囲】
  1. 1、複数のチャネルを持つ情報処理装置において、チャ
    ネルの制御下にある入出力装置の現用アドレス,交替ア
    ドレス及びそれぞれの入出力装置毎に障害が発生すると
    1にセットされる障害フラグを記憶する記憶手段を設け
    、入出力装置及び入出力装置とチャネルとのインタフェ
    ース部分に障害が発生すると、障害フラグを1にセット
    し、その後のソフトウェアのハードウェアリセット命令
    により、障害フラグが1の場合のみ、現用アドレスと交
    替アドレスとを交換することにより、障害時のシステム
    ダウンを回避することを特徴とする中央処理装置の障害
    処理方式。
JP2073302A 1990-03-26 1990-03-26 中央処理装置の障害処理方式 Pending JPH03276245A (ja)

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JPH03276245A true JPH03276245A (ja) 1991-12-06

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