JPH025078B2 - - Google Patents
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- JPH025078B2 JPH025078B2 JP5703683A JP5703683A JPH025078B2 JP H025078 B2 JPH025078 B2 JP H025078B2 JP 5703683 A JP5703683 A JP 5703683A JP 5703683 A JP5703683 A JP 5703683A JP H025078 B2 JPH025078 B2 JP H025078B2
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- JP
- Japan
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- highway
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- 230000015654 memory Effects 0.000 claims description 45
- 238000010586 diagram Methods 0.000 description 7
- 230000005540 biological transmission Effects 0.000 description 5
- 230000006870 function Effects 0.000 description 3
- 238000000034 method Methods 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 2
- 230000010355 oscillation Effects 0.000 description 2
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q1/00—Details of selecting apparatus or arrangements
- H04Q1/18—Electrical details
- H04Q1/30—Signalling arrangements; Manipulation of signalling currents
- H04Q1/44—Signalling arrangements; Manipulation of signalling currents using alternate current
- H04Q1/444—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies
- H04Q1/446—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using one signalling frequency
- H04Q1/448—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using one signalling frequency with conversion of a single frequency signal into a digital signal
- H04Q1/4485—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using one signalling frequency with conversion of a single frequency signal into a digital signal which is transmitted in digital form
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Devices For Supply Of Signal Current (AREA)
- Sub-Exchange Stations And Push- Button Telephones (AREA)
Description
【発明の詳細な説明】
(1) 発明の技術分野
本発明は交換機のトーン発生機能に関するもの
である。
である。
(2) 従来技術とその問題点
デジタル交換機の交換機能を行うハイウエイス
イツチは、通常メモリを用いて読出しの順序を制
御している。図１は、片方向からのチヤンネル
A1の入力音をチヤンネA2に出力する通話バスに
ついて図示したものである。今チヤンネルA1，
A2の送信信号が通話路メモリ１の１番地，２番
地にそれぞれ記憶されているものとする。これを
読出す際、通話路メモリ１のアドレスを与えるア
ドレスメモリ２の内容を＃２，＃１の順に記録し
ておくと、まず始めに通話路メモリ１の２番地の
内容が読出されるので、受けハイウエイ上ではチ
ヤンネルA2，A1の順に信号の順序が変更される。
これが最も基本的な交換の原理である。
イツチは、通常メモリを用いて読出しの順序を制
御している。図１は、片方向からのチヤンネル
A1の入力音をチヤンネA2に出力する通話バスに
ついて図示したものである。今チヤンネルA1，
A2の送信信号が通話路メモリ１の１番地，２番
地にそれぞれ記憶されているものとする。これを
読出す際、通話路メモリ１のアドレスを与えるア
ドレスメモリ２の内容を＃２，＃１の順に記録し
ておくと、まず始めに通話路メモリ１の２番地の
内容が読出されるので、受けハイウエイ上ではチ
ヤンネルA2，A1の順に信号の順序が変更される。
これが最も基本的な交換の原理である。
さて、交換機では、発信音，リングバツクトー
ン、その他の各種トーンが資源として用意されて
いる。さらに、高度な機能の可聴表示としてトー
ンの断続が種々用意されている。通常の断続を与
えるのに、従来はトーン発振回路１３，１４に断
続回路９，１０，１１を設けてシステムに入力し
ていた。また、図２において、３，４は電話機、
５はハイブリツド回路(H)、６，１２はアナログ・
デジタル変換回路（Ａ／Ｄ）、７はデジタル・ア
ナログ変換回路（Ｄ／Ａ）、８はハイウエイスイ
ツチ（HWS）である。図２において、電話機３
がトーン１を聞く場合の信号経路は、矢印のよう
に〔13→９→12→送りハイウエイ→ハイウエイ・
スイツチ８→受けハイウエイ→７→５→３〕であ
る。
ン、その他の各種トーンが資源として用意されて
いる。さらに、高度な機能の可聴表示としてトー
ンの断続が種々用意されている。通常の断続を与
えるのに、従来はトーン発振回路１３，１４に断
続回路９，１０，１１を設けてシステムに入力し
ていた。また、図２において、３，４は電話機、
５はハイブリツド回路(H)、６，１２はアナログ・
デジタル変換回路（Ａ／Ｄ）、７はデジタル・ア
ナログ変換回路（Ｄ／Ａ）、８はハイウエイスイ
ツチ（HWS）である。図２において、電話機３
がトーン１を聞く場合の信号経路は、矢印のよう
に〔13→９→12→送りハイウエイ→ハイウエイ・
スイツチ８→受けハイウエイ→７→５→３〕であ
る。
このような構成は最もわかりやすいが、次のよ
うな欠点がある。
うな欠点がある。
１ 断続パターンがハードウエアによつて固定さ
れる。
れる。
２ 同一音源でも断続パターンが異なるとそれぞ
れＡ／Ｄ機能を付加しなければならない。
れＡ／Ｄ機能を付加しなければならない。
以上のように１では機能上、２ではコスト上の
欠点がある。
欠点がある。
(3) 発明の目的
本発明は、マイクロプロセツサを用いて断続パ
ターンをハイウエイスイツチ回路の工夫により作
り出すことにより、ハードウエアを容易にしコス
トを下げることのできるハイウエイを用いる交換
機におけるトーン断続方式を提供するものであ
る。
ターンをハイウエイスイツチ回路の工夫により作
り出すことにより、ハードウエアを容易にしコス
トを下げることのできるハイウエイを用いる交換
機におけるトーン断続方式を提供するものであ
る。
(4) 発明の構成
この目的を達成するために、本発明によるハイ
ウエイを用いる交換機におけるトーン断続方式
は、送りハイウエイに接続されたハイウエイ通話
メモリのチヤネル対応の複数の記憶領域には該送
りハイウエイからのデジタル化された複数のチヤ
ネルの音声周波信号が予め定めた順序で記憶さ
れ、 ハイウエイアドレスメモリに記憶されたアドレ
スの内容により指定された順序で該ハイウエイ通
話メモリから前記複数の音声周波信号を受けハイ
ウエイに送出することにより、 前記送りハイウエイの複数のチヤネルを前記受
けハイウエイの複数のチヤネルに適宜に交換接続
するように制御される交換機において、 前記ハイウエイ通話メモリ内の前記複数の記憶
領域のうちの一つの記憶領域には前記送りハイウ
エイの一つのチヤネルからの可聴周波の連続トー
ンをデジタル化した信号が記憶されるとともに他
の特定の記憶領域に無音を指定するデジタル符号
を記憶させ、前記一つの記憶領域に該当する前記
送りハイウエイ上のチヤネルに交換接続された前
記受けハイウエイ上のチヤネルに対して前記ハイ
ウエイアドレスメモリが前記一つの記憶領域と前
記特定の記憶領域とを交互に指定して読み出して
前記可聴周波の断続トーンを送出するようにした
ことを特徴とする構成を有している。
ウエイを用いる交換機におけるトーン断続方式
は、送りハイウエイに接続されたハイウエイ通話
メモリのチヤネル対応の複数の記憶領域には該送
りハイウエイからのデジタル化された複数のチヤ
ネルの音声周波信号が予め定めた順序で記憶さ
れ、 ハイウエイアドレスメモリに記憶されたアドレ
スの内容により指定された順序で該ハイウエイ通
話メモリから前記複数の音声周波信号を受けハイ
ウエイに送出することにより、 前記送りハイウエイの複数のチヤネルを前記受
けハイウエイの複数のチヤネルに適宜に交換接続
するように制御される交換機において、 前記ハイウエイ通話メモリ内の前記複数の記憶
領域のうちの一つの記憶領域には前記送りハイウ
エイの一つのチヤネルからの可聴周波の連続トー
ンをデジタル化した信号が記憶されるとともに他
の特定の記憶領域に無音を指定するデジタル符号
を記憶させ、前記一つの記憶領域に該当する前記
送りハイウエイ上のチヤネルに交換接続された前
記受けハイウエイ上のチヤネルに対して前記ハイ
ウエイアドレスメモリが前記一つの記憶領域と前
記特定の記憶領域とを交互に指定して読み出して
前記可聴周波の断続トーンを送出するようにした
ことを特徴とする構成を有している。
以下本発明を詳細に説明する。
図３は本発明の実施例であつて、１は通話メモ
リ、２はアドレスメモリ、１５は制御回路
（CTL）、１６は中央処理装置（CPU）である。
この実施例において、送りハイウエイで多重化さ
れている２つの送話信号は、通話路メモリ１の
１，２番地に記憶される。この通話路メモリ１の
３番地には、無音に相当するコード00が予め記憶
されている。アドレスメモリ２は制御回路１５に
よつて書き込まれるが、初めは１番地，２番地に
＃２，＃１がそれぞれ書かれている。この状態に
おいては、図１のようにチヤンネルA2，A1の順
に受けハイウエイ上に送話信号が出てくる。この
時、制御回路１５がアドレスメモリ２の１番地の
内容を無音を示す＃３が書き換えると、その時は
受けハイウエイ上には無音、チヤンネルA1の順
に出力が現われる。すなわちチヤンネルA2が無
音に変更されたことになる。再びアドレスメモリ
２の１番地を＃２に書き換えれば、もとの状態に
もどる。このように制御することを可能にするに
は、制御回路１５は中央処理装置１６より図４の
ような情報を受け取ればよい。
リ、２はアドレスメモリ、１５は制御回路
（CTL）、１６は中央処理装置（CPU）である。
この実施例において、送りハイウエイで多重化さ
れている２つの送話信号は、通話路メモリ１の
１，２番地に記憶される。この通話路メモリ１の
３番地には、無音に相当するコード00が予め記憶
されている。アドレスメモリ２は制御回路１５に
よつて書き込まれるが、初めは１番地，２番地に
＃２，＃１がそれぞれ書かれている。この状態に
おいては、図１のようにチヤンネルA2，A1の順
に受けハイウエイ上に送話信号が出てくる。この
時、制御回路１５がアドレスメモリ２の１番地の
内容を無音を示す＃３が書き換えると、その時は
受けハイウエイ上には無音、チヤンネルA1の順
に出力が現われる。すなわちチヤンネルA2が無
音に変更されたことになる。再びアドレスメモリ
２の１番地を＃２に書き換えれば、もとの状態に
もどる。このように制御することを可能にするに
は、制御回路１５は中央処理装置１６より図４の
ような情報を受け取ればよい。
制御信号１５は、で指定されたアドレスメモ
リの番地にの内容を書き込むが、で示される
断続パターンの情報に従い、予め定められた周期
での内容と無音の記憶アドレスとを書き換え
る。
リの番地にの内容を書き込むが、で示される
断続パターンの情報に従い、予め定められた周期
での内容と無音の記憶アドレスとを書き換え
る。
図６は本発明の他の実施例となる。この実施例
において、制御回路１５は中央処理装置１６より
図５のフオーマツトのデータを受信すると、アド
レスメモリ２―１，２―２，２―３ので指定さ
れたアドレスにそれぞれ B1 メモリ２―１用ラ
イトデータ、 B1 メモリ２―２用ライトデータ
及び断続パターン情報を（同時に）書込む。ハ
イウエイ通話路メモリ１からの音声周波信号の読
出し順序を記憶するアドレスメモリ２―１，２―
２及び２―３は常時同時に読出され、この時アド
レスメモリ２―３にて指定される情報に従つてス
イツチ１７がアドレスメモリ２―１かアドレスメ
モリ２―２かを選択する。スイツチ１７をスイツ
チ制御回路１８によりスイツチングするパターン
は、トーンの断続パターンと同じである。
において、制御回路１５は中央処理装置１６より
図５のフオーマツトのデータを受信すると、アド
レスメモリ２―１，２―２，２―３ので指定さ
れたアドレスにそれぞれ B1 メモリ２―１用ラ
イトデータ、 B1 メモリ２―２用ライトデータ
及び断続パターン情報を（同時に）書込む。ハ
イウエイ通話路メモリ１からの音声周波信号の読
出し順序を記憶するアドレスメモリ２―１，２―
２及び２―３は常時同時に読出され、この時アド
レスメモリ２―３にて指定される情報に従つてス
イツチ１７がアドレスメモリ２―１かアドレスメ
モリ２―２かを選択する。スイツチ１７をスイツ
チ制御回路１８によりスイツチングするパターン
は、トーンの断続パターンと同じである。
図７は図３の実施例において、チヤンネルA1
の受話器にチヤンネルA2で指定されるトーンを
10：５の割合で断続する時の動作フローの１例で
ある。
の受話器にチヤンネルA2で指定されるトーンを
10：５の割合で断続する時の動作フローの１例で
ある。
また、図８は図６の実施例における動作フロー
の１例である。
の１例である。
以下、図７と図８に示された動作について詳細
に説明する。
に説明する。
図７は、図３の実施例において、チヤンネル
A1の受話器にチヤンネルA2で指定されるトーン
を10：５の割合で断続する時の動作フローを示
す。７０１接続要求が発生すると、７０２中央処
理装置１６は、図４で示されるフオーマツトに従
い、制御回路１５にデータを送出する。７０３制
御回路１５は、受信したデータを管理バツフアに
一旦収容した後、予め定められた順序で、管理バ
ツフアのデータ分析を行う。
A1の受話器にチヤンネルA2で指定されるトーン
を10：５の割合で断続する時の動作フローを示
す。７０１接続要求が発生すると、７０２中央処
理装置１６は、図４で示されるフオーマツトに従
い、制御回路１５にデータを送出する。７０３制
御回路１５は、受信したデータを管理バツフアに
一旦収容した後、予め定められた順序で、管理バ
ツフアのデータ分析を行う。
７０４アドレスメモリ２の１番地に対応するチ
ヤンネル用のバツフアを分析するタイミングにな
つた時に、７０５まず接続形態を指示する断続パ
ターンの分析を行う。７０６断続パターン情報と
して受信したデータは“01”であり、これは、予
め10：５の割で断続するビジートーン接続である
ことが定められている。７０８従つて：制御回路
１５は、トーンの送出時間を定めるためのソフト
ウエアカウンタを“10”にセツトした後、７０９
チヤンネルA1に対応するアドレスメモリ２の１
番地に、送出すべきトーンの音源であるチヤンネ
ルA2に対応する通話路メモリ１のアドレスであ
る＃２を書き込む。その後、ソフトウエアカウン
タを、７１２予め定められたデイレ毎に、７１０
デイクリメントし、７１１カウント値が０になる
と、７１３トーンの送出停止時間を定めるため
に、ソフトウエアカウンタを５にセツトする。本
発明においては、トーン送出停止は、通話路メモ
リ１に予め記憶された無音を表わすコードを送出
することであるので、アドレスメモリ２の１番地
には、前記＃２にかえて、７１４無音コードのた
めの特定アドレス＃３を書き込む。７１５カウン
タ値を１デイクリメントし、７１６カウンタ値が
“０”でなければ、７１７予め定められたデイレ
イを確保し、７１５またカウンタ値を１デイクリ
メントし、７１６カウンタ値が“０”となれば、
７０４接続形態に変更が発生したか否か再度バツ
フア分析を行いにゆく。７０５〜７０６断続パタ
ーンに変更がない限り、７０８〜７１６前記同様
の動作を繰り返す。
ヤンネル用のバツフアを分析するタイミングにな
つた時に、７０５まず接続形態を指示する断続パ
ターンの分析を行う。７０６断続パターン情報と
して受信したデータは“01”であり、これは、予
め10：５の割で断続するビジートーン接続である
ことが定められている。７０８従つて：制御回路
１５は、トーンの送出時間を定めるためのソフト
ウエアカウンタを“10”にセツトした後、７０９
チヤンネルA1に対応するアドレスメモリ２の１
番地に、送出すべきトーンの音源であるチヤンネ
ルA2に対応する通話路メモリ１のアドレスであ
る＃２を書き込む。その後、ソフトウエアカウン
タを、７１２予め定められたデイレ毎に、７１０
デイクリメントし、７１１カウント値が０になる
と、７１３トーンの送出停止時間を定めるため
に、ソフトウエアカウンタを５にセツトする。本
発明においては、トーン送出停止は、通話路メモ
リ１に予め記憶された無音を表わすコードを送出
することであるので、アドレスメモリ２の１番地
には、前記＃２にかえて、７１４無音コードのた
めの特定アドレス＃３を書き込む。７１５カウン
タ値を１デイクリメントし、７１６カウンタ値が
“０”でなければ、７１７予め定められたデイレ
イを確保し、７１５またカウンタ値を１デイクリ
メントし、７１６カウンタ値が“０”となれば、
７０４接続形態に変更が発生したか否か再度バツ
フア分析を行いにゆく。７０５〜７０６断続パタ
ーンに変更がない限り、７０８〜７１６前記同様
の動作を繰り返す。
以上のように、アドレスメモリ２の各アドレス
毎に、制御回路１５が通話路メモリ１の任意のア
ドレスと、無音の為の特定アドレスとを、予め定
められたインターバルで交互に書き換えることに
よりトーンの断続を実現することができる。
毎に、制御回路１５が通話路メモリ１の任意のア
ドレスと、無音の為の特定アドレスとを、予め定
められたインターバルで交互に書き換えることに
よりトーンの断続を実現することができる。
図８は、本発明の他の実施例である図６の動作
フローの１例である。８０１今、チヤンネルA1
の受話器に、チヤンネルA2で指定されるトーン
を10：５の割合で断続するビジートーン接続の要
求が発生すると、８０２中央処理装置１６は、制
御回路１５に図５で示されるフオーマツトに従つ
て， B1 ， B2 ，に対応する（01，02，03，
01）のデータを送出する。
フローの１例である。８０１今、チヤンネルA1
の受話器に、チヤンネルA2で指定されるトーン
を10：５の割合で断続するビジートーン接続の要
求が発生すると、８０２中央処理装置１６は、制
御回路１５に図５で示されるフオーマツトに従つ
て， B1 ， B2 ，に対応する（01，02，03，
01）のデータを送出する。
８０３制御回路１５は、受信データのうちに
指定されるアドレス用のデータ受信フラグをセツ
トし、８０４同アドレス用に予め割当てられてい
るバツフアに B1 〜のデータを記録する。制
御回路１５は、その後受信フラグのスキヤンを行
い、８０５アドレス01用フラグをチエツクした時
リセツトされていれば、８０６次のアドレス０２
用のフラグチエツクを行う。８０５今アドレス０
１用フラグがセツトされているので、８０７制御
回路１５はバツフアより B1 〜のデータをチ
エツクし、８０８アドレスメモリ２―１の１番地
に B1 のデータを書込み、８１０更にアドレス
メモリ２―３の１番地にのデータを書き込む。
８１１制御回路１５は、前記書き込み動作完了後
アドレス０１用のデータ受信フラグをリセツトす
る。その後は、受信フラグのスキヤンを行いなが
ら新規の接続要求に対し待機する。
指定されるアドレス用のデータ受信フラグをセツ
トし、８０４同アドレス用に予め割当てられてい
るバツフアに B1 〜のデータを記録する。制
御回路１５は、その後受信フラグのスキヤンを行
い、８０５アドレス01用フラグをチエツクした時
リセツトされていれば、８０６次のアドレス０２
用のフラグチエツクを行う。８０５今アドレス０
１用フラグがセツトされているので、８０７制御
回路１５はバツフアより B1 〜のデータをチ
エツクし、８０８アドレスメモリ２―１の１番地
に B1 のデータを書込み、８１０更にアドレス
メモリ２―３の１番地にのデータを書き込む。
８１１制御回路１５は、前記書き込み動作完了後
アドレス０１用のデータ受信フラグをリセツトす
る。その後は、受信フラグのスキヤンを行いなが
ら新規の接続要求に対し待機する。
以上のように本実施例においては、一度アドレ
スメモリ２―１〜３に書き込みを行えば、所要の
断続パターンを実現出来、断続のオン／オフのイ
ンターバル毎にアドレスメモリの内容を書き替え
る必要を省いている。
スメモリ２―１〜３に書き込みを行えば、所要の
断続パターンを実現出来、断続のオン／オフのイ
ンターバル毎にアドレスメモリの内容を書き替え
る必要を省いている。
(5) 発明の効果
以上のように、本発明によれば、断続パターン
の変更も容易で、かつトーン音源は周波数と信号
レベルが同一であれば断続パターンが異なつても
同一音源を使用できるという利点がある。
の変更も容易で、かつトーン音源は周波数と信号
レベルが同一であれば断続パターンが異なつても
同一音源を使用できるという利点がある。
図１は交換機の原理を説明するためのブロツク
図、図２は従来のトーン断続方式の構造例を示す
ブロツク図、図３は本発明の１実施例を示すブロ
ツク図、図４は図３の実施例に用いられる制御信
号フオーマツト例を示す図、図５は本発明に用い
られる他の制御信号フオーマツト例を示す図、図
６は本発明の他の実施例を示すブロツク図、図７
と図８は本発明方式の動作例を示すフローチヤー
トである。 １……通話路メモリ、２，２―１，２―２，２
―３……アドレスメモリ、３，４……電話機、５
……ハイブリツド回路、６，１２……アナログ・
デジタル変換器、７……デジタルアナログ変換
器、８……ハイウエイ・スイツチ、９，１０，１
１……デジタル・アナログ変換器、１３，１４…
…トーン発振回路、１５……制御回路、１６……
中央処理装置、１７……スイツチ、１８……スイ
ツチ制御回路。
図、図２は従来のトーン断続方式の構造例を示す
ブロツク図、図３は本発明の１実施例を示すブロ
ツク図、図４は図３の実施例に用いられる制御信
号フオーマツト例を示す図、図５は本発明に用い
られる他の制御信号フオーマツト例を示す図、図
６は本発明の他の実施例を示すブロツク図、図７
と図８は本発明方式の動作例を示すフローチヤー
トである。 １……通話路メモリ、２，２―１，２―２，２
―３……アドレスメモリ、３，４……電話機、５
……ハイブリツド回路、６，１２……アナログ・
デジタル変換器、７……デジタルアナログ変換
器、８……ハイウエイ・スイツチ、９，１０，１
１……デジタル・アナログ変換器、１３，１４…
…トーン発振回路、１５……制御回路、１６……
中央処理装置、１７……スイツチ、１８……スイ
ツチ制御回路。
Claims (1)
- 【特許請求の範囲】 １ 送りハイウエイに接続されたハイウエイ通話
メモリのチヤネル対応の複数の記憶領域には該送
りハイウエイからのデジタル化された複数のチヤ
ネルの音声周波信号が予め定めた順序で記憶さ
れ、 ハイウエイアドレスメモリに記憶されたアドレ
スの内容により指定された順序で該ハイウエイ通
話メモリから前記複数の音声周波信号を受けハイ
ウエイに送出することにより、 前記送りハイウエイの複数のチヤネルを前記受
けハイウエイの複数のチヤネルに適宜に交換接続
するように制御される交換機において、 前記ハイウエイ通話メモリ内の前記複数の記憶
領域のうちの一つの記憶領域には前送りハイウエ
イの一つのチヤネルからの可聴周波の連続トーン
をデジタル化した信号が記憶されるとともに他の
特定の記憶領域に無音を指定するデジタル符号を
記憶させ、前記一つの記憶領域に該当する前記送
りハイウエイ上のチヤネルに交換接続された前記
受けハイウエイ上のチヤネルに対して前記ハイウ
エイアドレスメモリが前記一つの記憶領域と前記
特定の記憶領域とを交互に指定して読み出して前
記可聴周波の断続トーンを送出するようにしたこ
とを特徴とするハイウエイを用いる交換機におけ
るトーン断続方式。 ２ 前記アドレスメモリが単一であり、前記可聴
周波の連続トーンの記憶領域と前記特定の記憶領
域の交互指定は該アドレスメモリのアドレスの書
き替えにより行われるように構成されたことを特
徴とする特許請求の範囲第１項記載のハイウエイ
を用いる交換機におけるトーン断続方式。 ３ 前記アドレスメモリが複数個であり、前記可
聴周波の連続トーンの記憶領域と前記特定の記憶
領域の交互指定は該複数個のアドレスメモリの切
換により行われるように構成されたことを特徴と
する特許請求の範囲第１項記載のハイウエイを用
いる交換機におけるトーン断続方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5703683A JPS59183571A (ja) | 1983-04-01 | 1983-04-01 | ハイウェイを用いる交換機におけるトーン断続方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5703683A JPS59183571A (ja) | 1983-04-01 | 1983-04-01 | ハイウェイを用いる交換機におけるトーン断続方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59183571A JPS59183571A (ja) | 1984-10-18 |
| JPH025078B2 true JPH025078B2 (ja) | 1990-01-31 |
Family
ID=13044210
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5703683A Granted JPS59183571A (ja) | 1983-04-01 | 1983-04-01 | ハイウェイを用いる交換機におけるトーン断続方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59183571A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2615581B2 (ja) * | 1987-01-14 | 1997-05-28 | 松下電器産業株式会社 | 構内自動交換機 |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5793770A (en) * | 1980-12-02 | 1982-06-10 | Fujitsu Ltd | Digital audible signal tone generation system |
| JPS5842395A (ja) * | 1981-09-08 | 1983-03-11 | Nec Corp | テストトランク機能の実現方法 |
-
1983
- 1983-04-01 JP JP5703683A patent/JPS59183571A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59183571A (ja) | 1984-10-18 |
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