JPH0145265Y2 - - Google Patents
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- Publication number
- JPH0145265Y2 JPH0145265Y2 JP1050283U JP1050283U JPH0145265Y2 JP H0145265 Y2 JPH0145265 Y2 JP H0145265Y2 JP 1050283 U JP1050283 U JP 1050283U JP 1050283 U JP1050283 U JP 1050283U JP H0145265 Y2 JPH0145265 Y2 JP H0145265Y2
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- winding
- circuit
- control
- capacitor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000004804 winding Methods 0.000 claims description 37
- 239000003990 capacitor Substances 0.000 claims description 17
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Dc-Dc Converters (AREA)
Description
【考案の詳細な説明】
本考案はトランジスタコンバータの駆動回路に
関するもので特に入出力変動に係わらず駆動され
るスイツチング用主トランジスタに安定したバイ
アス電流を供給し、スイツチング損失を軽減した
有効な駆動回路を提供するものである。第１図は
この種の従来回路で図においてＡはコンバータを
形成する主回路、Ｂは制御回路で先ず主回路にお
いてV1は直流電源、Ｃは電源用コンデンサ、T1
は出力トランス、n1，n2はその１次（入力）及び
２次（出力）巻線、Q1は前記１次巻線n1に直列
に接続されたスイツチング用主トランジスタ、
R2，R3は抵抗、C2はコンデンサ、Ｄは整流用ダ
イオード、次に制御回路Ｂにおいて、V2は制御
回路に給電する補助電源、T2はパルストランス、
n11，n12は１次巻線、n20は２次（出力）巻線、
R1，C1は補助電源V2より充電回路を形成する抵
抗及びコンデンサ、Q2，Q3は制御器IC１（制御
用IC）により交互にオン、オフ動作する制御用
トランジスタで、該トランジスタQ2は、抵抗R4
を介して前記パルストランス１次巻線n12と直列
に接続されて補助電源V2間に接続され、又トラ
ンジスタQ3は１次巻線n11と直列接続されてコン
デンサC1と抵抗R1の接続点と電源V2の他端間に
接続されている。次にこの回路の動作について第
２図を参照して説明する。先ず主トランジスタ
Q1は制御用トランジスタQ2のオン時にパルスト
ランスT2を介して順バイアス電流が供給されて
オン動作を行い、又制御用トランジスタQ3がオ
ン時に逆バイアス電流が供給されてオフ動作を行
うよう設定されている。第２図ａ又、制御用トラ
ンジスタQ2，Q3はコンバータの出力等を検出す
る制御器IC1の力により交互にオン動作を行い同
時のオン動作は行わないよう設定されている。第
２図ｂ，ｃ又、第２図ｄは主トランジスタQ1の
オン、オフ、スイツチング動作時のスイツチング
損失を軽減できる理想的なベース電流波形を示す
もので、IB1はトランジスタQ2がオンした時に
R2，C2とR3の合計電流であり、IB2は同抵抗R3を
流れる電流である。またIB3はトランジスタQ3が
オフしている時（Q2オン時）にR1を通してC1に
充電された電荷をトランジスタQ3のオンと同時
に放電する時R2，C2とR3の合計電流（逆バイア
ス電流）である。ここでコンデンサC1の充電さ
れる時間はトランジスタQ1にオン信号がかかつ
ている間だけなので、スイツチング周期の０〜50
％の間にしかない。つまり軽負荷時等でトランジ
スタQ1のオン信号が短くなると第２図ｆのVC′に
示す如くコンデンサC1に十分な量の電荷が充電
されず、IB3が不足する事になる。（第２図ｅ−
IB３′）このことよりトランジスタQ1のオフ時の
損失の増大を招き、またトランジスタR1のスト
レージが長いとコンデンサC1の電荷だけでは不
十分となりそのオフ時間が短縮できず、オフ時の
損失の増大になる欠点がある。（なお、抵抗R1は
トランジスタQ3のオン時間がスイツチング周期
の50〜100％になるので、あまり小さな抵抗値に
する事は出来ない。）本考案は出力トランスの補
助巻線を利用した簡単な充電回路を付加すること
により叙上の欠点を一挙に解消し、入出力条件に
係わりなく又、主トランジスタのストレージ時間
に応じた所要の安定したバイアス電流を供給し得
る駆動回路を提供するもので、直流電源と、出力
トランスの１次巻線間に直列に接続されたスイツ
チング用主トランジスタと、前記出力トランスの
２次巻線側に接続された整流用ダイオードより形
成された主回路と、制御回路に給電する補助電源
と、第１、第２の１次巻線及び２次巻線をもつパ
ルストランスと、前記補助電源間に接続された抵
抗とコンデンサの直列回路と、前記補助電源間に
前記パルストランスの第１の１次巻線を介して接
続された第１の制御用トランジスタと、前記抵抗
とコンデンサの接続点と前記補助電源の一端間に
前記パルストランスの第２の１次巻線を介して接
続された第２の制御用トランジスタと、前記第
１、第２の制御用トランジスタに交互にオン、オ
フ信号を与える制御器を備え前記パルストランス
の２次巻線を通して前記主トランジスタをオン、
オフ制御する制御回路を有するトランジスタコン
バータの駆動回路において、前記出力トランスに
１次巻線と同一極性の補助巻線を設けると共に、
前記補助巻線の電圧を利用して直接もしくは増巾
電流により前記コンデンサを充電する回路を設け
たことを特徴とする。第３図、第４図、第５図は
本考案の一実施例を示す回路図及び動作説明図で
従来例と同一符号は同等部分を示す。図中Nsは
出力トランスT1に１次巻線n1と同一極性に設け
た補助巻線で、該補助巻線nsに発生する電圧を利
用してコンデンサC1を充電するものである。即
ち第３図においては更に充電用トランジスタQ4
を設けこのベースをダイオードD1を介して補助
巻線nsの電圧により制御し、その増幅された電流
により補助電源V2→トランジスタQ4→コンデン
サC1の経路で急速充電する。（第５図ａ−VC）
又、第４図では補助巻線nsの電圧によりダイオー
ドD1を介して直接充電せしめるようにしたもの
である。このように構成すれば主トランジスタ
Q1のオン期間即ち制御用トランジスタQ2のオン
期間の短い軽負荷時或は高入力時においてもコン
デンサC1は常に正常値に充電されるため第５図
ｂに示すように十分な逆バイアス電流IB3が供給
でき、又主トランジスタQ1のストレージ時間の
大きいものであつても制御用トランジスタQ3の
オン動作によりコンデンサC1の放電電流と相ま
つて補助巻線nsに電圧が発生する間トランジスタ
Q4、又はダイオードD1を介して十分な逆バイア
ス電流が供給され、そのオフ時間の短縮が可能で
ある。以上の説明から明らかなように本考案によ
れば簡単な回路を付加するのみで主トランジスタ
のオフ時間を短縮でき、しかもオフ特性の安定し
た広範な制御ができ特にコンバータ等の駆動用と
して好適である等実用上の効果は大きい。
関するもので特に入出力変動に係わらず駆動され
るスイツチング用主トランジスタに安定したバイ
アス電流を供給し、スイツチング損失を軽減した
有効な駆動回路を提供するものである。第１図は
この種の従来回路で図においてＡはコンバータを
形成する主回路、Ｂは制御回路で先ず主回路にお
いてV1は直流電源、Ｃは電源用コンデンサ、T1
は出力トランス、n1，n2はその１次（入力）及び
２次（出力）巻線、Q1は前記１次巻線n1に直列
に接続されたスイツチング用主トランジスタ、
R2，R3は抵抗、C2はコンデンサ、Ｄは整流用ダ
イオード、次に制御回路Ｂにおいて、V2は制御
回路に給電する補助電源、T2はパルストランス、
n11，n12は１次巻線、n20は２次（出力）巻線、
R1，C1は補助電源V2より充電回路を形成する抵
抗及びコンデンサ、Q2，Q3は制御器IC１（制御
用IC）により交互にオン、オフ動作する制御用
トランジスタで、該トランジスタQ2は、抵抗R4
を介して前記パルストランス１次巻線n12と直列
に接続されて補助電源V2間に接続され、又トラ
ンジスタQ3は１次巻線n11と直列接続されてコン
デンサC1と抵抗R1の接続点と電源V2の他端間に
接続されている。次にこの回路の動作について第
２図を参照して説明する。先ず主トランジスタ
Q1は制御用トランジスタQ2のオン時にパルスト
ランスT2を介して順バイアス電流が供給されて
オン動作を行い、又制御用トランジスタQ3がオ
ン時に逆バイアス電流が供給されてオフ動作を行
うよう設定されている。第２図ａ又、制御用トラ
ンジスタQ2，Q3はコンバータの出力等を検出す
る制御器IC1の力により交互にオン動作を行い同
時のオン動作は行わないよう設定されている。第
２図ｂ，ｃ又、第２図ｄは主トランジスタQ1の
オン、オフ、スイツチング動作時のスイツチング
損失を軽減できる理想的なベース電流波形を示す
もので、IB1はトランジスタQ2がオンした時に
R2，C2とR3の合計電流であり、IB2は同抵抗R3を
流れる電流である。またIB3はトランジスタQ3が
オフしている時（Q2オン時）にR1を通してC1に
充電された電荷をトランジスタQ3のオンと同時
に放電する時R2，C2とR3の合計電流（逆バイア
ス電流）である。ここでコンデンサC1の充電さ
れる時間はトランジスタQ1にオン信号がかかつ
ている間だけなので、スイツチング周期の０〜50
％の間にしかない。つまり軽負荷時等でトランジ
スタQ1のオン信号が短くなると第２図ｆのVC′に
示す如くコンデンサC1に十分な量の電荷が充電
されず、IB3が不足する事になる。（第２図ｅ−
IB３′）このことよりトランジスタQ1のオフ時の
損失の増大を招き、またトランジスタR1のスト
レージが長いとコンデンサC1の電荷だけでは不
十分となりそのオフ時間が短縮できず、オフ時の
損失の増大になる欠点がある。（なお、抵抗R1は
トランジスタQ3のオン時間がスイツチング周期
の50〜100％になるので、あまり小さな抵抗値に
する事は出来ない。）本考案は出力トランスの補
助巻線を利用した簡単な充電回路を付加すること
により叙上の欠点を一挙に解消し、入出力条件に
係わりなく又、主トランジスタのストレージ時間
に応じた所要の安定したバイアス電流を供給し得
る駆動回路を提供するもので、直流電源と、出力
トランスの１次巻線間に直列に接続されたスイツ
チング用主トランジスタと、前記出力トランスの
２次巻線側に接続された整流用ダイオードより形
成された主回路と、制御回路に給電する補助電源
と、第１、第２の１次巻線及び２次巻線をもつパ
ルストランスと、前記補助電源間に接続された抵
抗とコンデンサの直列回路と、前記補助電源間に
前記パルストランスの第１の１次巻線を介して接
続された第１の制御用トランジスタと、前記抵抗
とコンデンサの接続点と前記補助電源の一端間に
前記パルストランスの第２の１次巻線を介して接
続された第２の制御用トランジスタと、前記第
１、第２の制御用トランジスタに交互にオン、オ
フ信号を与える制御器を備え前記パルストランス
の２次巻線を通して前記主トランジスタをオン、
オフ制御する制御回路を有するトランジスタコン
バータの駆動回路において、前記出力トランスに
１次巻線と同一極性の補助巻線を設けると共に、
前記補助巻線の電圧を利用して直接もしくは増巾
電流により前記コンデンサを充電する回路を設け
たことを特徴とする。第３図、第４図、第５図は
本考案の一実施例を示す回路図及び動作説明図で
従来例と同一符号は同等部分を示す。図中Nsは
出力トランスT1に１次巻線n1と同一極性に設け
た補助巻線で、該補助巻線nsに発生する電圧を利
用してコンデンサC1を充電するものである。即
ち第３図においては更に充電用トランジスタQ4
を設けこのベースをダイオードD1を介して補助
巻線nsの電圧により制御し、その増幅された電流
により補助電源V2→トランジスタQ4→コンデン
サC1の経路で急速充電する。（第５図ａ−VC）
又、第４図では補助巻線nsの電圧によりダイオー
ドD1を介して直接充電せしめるようにしたもの
である。このように構成すれば主トランジスタ
Q1のオン期間即ち制御用トランジスタQ2のオン
期間の短い軽負荷時或は高入力時においてもコン
デンサC1は常に正常値に充電されるため第５図
ｂに示すように十分な逆バイアス電流IB3が供給
でき、又主トランジスタQ1のストレージ時間の
大きいものであつても制御用トランジスタQ3の
オン動作によりコンデンサC1の放電電流と相ま
つて補助巻線nsに電圧が発生する間トランジスタ
Q4、又はダイオードD1を介して十分な逆バイア
ス電流が供給され、そのオフ時間の短縮が可能で
ある。以上の説明から明らかなように本考案によ
れば簡単な回路を付加するのみで主トランジスタ
のオフ時間を短縮でき、しかもオフ特性の安定し
た広範な制御ができ特にコンバータ等の駆動用と
して好適である等実用上の効果は大きい。
第１図、第２図は従来回路図及びその動作説明
図、第３図、第４図及び第５図は本考案の一実施
例回路図、及びその動作説明図である。Ａ……主
回路、Ｂ……制御回路、T1……主トランジスタ、
n1……１次巻線、n2……２次巻線、ns……補助巻
線、T2……パルストランス、n11，n12……１次巻
線、n20……２次巻線、IC1……制御器、Q1……主
トランジスタ、Q2，Q3……制御用トランジスタ、
Q4……充電用トランジスタ、D1……充電用ダイ
オード、C1，C2，Ｃ……コンデンサ、R1……充
電用抵抗、R2，R3……バイアス用抵抗。
図、第３図、第４図及び第５図は本考案の一実施
例回路図、及びその動作説明図である。Ａ……主
回路、Ｂ……制御回路、T1……主トランジスタ、
n1……１次巻線、n2……２次巻線、ns……補助巻
線、T2……パルストランス、n11，n12……１次巻
線、n20……２次巻線、IC1……制御器、Q1……主
トランジスタ、Q2，Q3……制御用トランジスタ、
Q4……充電用トランジスタ、D1……充電用ダイ
オード、C1，C2，Ｃ……コンデンサ、R1……充
電用抵抗、R2，R3……バイアス用抵抗。
Claims (1)
- 直流電源と、出力トランスの１次巻線間に直列
に接続されたスイツチング用主トランジスタと、
前記出力トランスの２次巻線側に接続された整流
用ダイオードより形成された主回路と、制御回路
に給電する補助電源と、第１、第２の１次巻線及
び２次巻線をもつパルストランスと、前記補助電
源間に接続された抵抗とコンデンサの直列回路
と、前記補助電源間に、前期パルストランスの第
１の１次巻線を介して接続された第１の制御用ト
ランジスタと、前記抵抗とコンデンサの接続点と
前記補助電源の一端間に前記パルストランスの第
２の１次巻線を介して接続された第２の制御用ト
ランジスタと、前記第１、第２の制御用トランジ
スタに交互にオン、オフ信号を与える制御器を備
え、前記パルストランスの２次巻線を通して前記
主トランジスタをオン、オフ制御する制御回路を
有するトランジスタコンバータの駆動回路におい
て、前記出力トランスに１次巻線と同一極性の補
助巻線を設けると共に、前記補助巻線の電圧を利
用して直接もしくは増巾電流により前記コンデン
サを充電する回路を設けたことを特徴とするトラ
ンジスタコンバータの駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1050283U JPS59117295U (ja) | 1983-01-27 | 1983-01-27 | トランジスタコンバ−タの駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1050283U JPS59117295U (ja) | 1983-01-27 | 1983-01-27 | トランジスタコンバ−タの駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59117295U JPS59117295U (ja) | 1984-08-08 |
| JPH0145265Y2 true JPH0145265Y2 (ja) | 1989-12-27 |
Family
ID=30141936
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1050283U Granted JPS59117295U (ja) | 1983-01-27 | 1983-01-27 | トランジスタコンバ−タの駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59117295U (ja) |
-
1983
- 1983-01-27 JP JP1050283U patent/JPS59117295U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59117295U (ja) | 1984-08-08 |
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