JP7398162B2 - テスト対象モジュールのテスト回路、方法及び装置 - Google Patents
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Description
本開示は、2021年4月30日に中国国家知的財産局に提出された、出願番号が202110487704.6であり、発明名称が「テスト対象モジュールのテスト回路、方法及び装置」である中国特許出願の優先権を主張し、その内容の全てが参照により本開示に組み込まれる。
前記テストデータ発生モジュールは、前記機能安全モジュールとそれぞれ電気的に接続される複数のテストデータ発生ユニットを含み、
各前記テストデータ発生ユニットは、当該テストデータ発生ユニットがサポートするデータ類型と一致する原データに基づいて、前記データ類型と一致するテストデータを生成し、
前記機能安全モジュールは、前記テスト対象モジュールと電気的に接続され、前記テストデータに対して検査演算処理を行って第1の処理結果を得、前記テストデータに対して検査演算処理及びフォールトインジェクション処理を行って第2の処理結果を得、
前記テスト対象モジュールは、前記テストデータ、前記第1の処理結果及び前記第2の処理結果に基づいて、テスト結果を生成する。
前記テスト回路における各テストデータ発生ユニットを呼び出し、当該テストデータ発生ユニットがサポートするデータ類型と一致する原データに基づいて、前記データ類型と一致するテストデータを生成するステップと、
前記テストデータに対して検査演算処理を行って第1の処理結果を得るステップと、
前記テストデータに対して検査演算処理及びフォールトインジェクション処理を行って第2の処理結果を得るステップと、
前記テストデータ、前記第1の処理結果及び前記第2の処理結果に基づいて、前記テスト対象モジュールのテスト結果を生成するステップと、を含む。
前記テスト回路における各テストデータ発生ユニットを呼び出し、当該テストデータ発生ユニットがサポートするデータ類型と一致する原データに基づいて、前記データ類型と一致するテストデータを生成するための第1の生成モジュールと、
前記第1の生成モジュールが生成した前記テストデータに対して検査演算処理を行って第1の処理結果を得るための第1の処理モジュールと、
前記第1の生成モジュールが生成した前記テストデータに対して検査演算処理及びフォールトインジェクション処理を行って第2の処理結果を得るための第2の処理モジュールと、
前記第1の生成モジュールが生成した前記テストデータ、前記第1の処理モジュールが得た前記第1の処理結果及び前記第2の処理モジュールが得た前記第2の処理結果に基づいて、前記テスト対象モジュールのテスト結果を生成するための第2の生成モジュールと、を含む。
前記プロセッサは、前記メモリから前記実行可能な命令を読み取り、前記命令を実行して、上記テスト対象モジュールのテスト方法を実現する。
本開示の上記及び他の目的、特徴、及び優位性は、図面と結び付けて本開示の実施例をより詳細に説明することから、より明らかになる。図面は、本開示の実施例へのさらなる理解を提供し、明細書の一部として、本開示の実施例とともに本開示を解釈し、本開示を制限するものではない。図面では、同じ参照番号は、通常、同じ部材又はステップを示す。
画像処理分野では、常に画像パス、ISPユニットなどのテスト対象モジュールのテストをテスト回路で実現する必要があり、従来のテスト手段では、一般にカラーテストデータストリーム又は静的グレースケールテストデータストリームをシングルパス形態でテスト対象モジュールに出力し、しかしながら、この手段においては、シングルパスのテストのみを実現することができ、マルチパスのテストは実現することができないので、マルチパスに対して処理を行うというユーザの利用需要に応えることができなかった。
上記出願の概要で言及された従来のテスト手段がマルチパスに対して処理を行うというユーザの利用需要に応えることができなかったという問題を解決するために、テスト対象モジュールに対して本開示の実施例に係るテスト対象モジュールのテスト回路を設置することができ、テスト対象モジュールのテスト回路は、テスト対象モジュールと電気的に接続することができ、ハードウェアの初期化が完了した後、テスト対象モジュールのテスト回路が自動的に動作してマルチパスのテストを実現することができ、それによりマルチパスに対して処理を行うというユーザの利用需要に応えることができる。
図1は、本開示の例示的な一実施例に係るテスト対象モジュール100のテスト回路の構造を示す図である。図1に示すように、テスト対象モジュール100のテスト回路は、テストデータ発生モジュール11と、機能安全モジュール12と、を含む。
機能安全モジュール12は、いずれか1つのテストデータ発生ユニット111からのテストデータを取得した後、取得したテストデータに対して、予め設定されたフォールトインジェクション形態に従ってフォールトインジェクション処理を行うことができる。例えば、取得したテストデータにおける少なくとも1つの文字を他の文字に修正して、フォールトインジェクション処理済みのテストデータを得る。次に、機能安全モジュール12は、フォールトインジェクション処理済みのテストデータに対して、予め設定された検査アルゴリズムに従って検査演算処理を行うことができ、例えば、機能安全モジュール12は、フォールトインジェクション処理済みのテストデータに対して、予め設定されたCRC多項式に従ってCRC演算を行って相応のCRC数値を得ることができ、得られたCRC数値を第2の処理結果とすることができる。
機能安全モジュール12は、いずれか1つのテストデータ発生ユニット111からのテストデータを取得した後、取得したテストデータに対して、予め設定された検査アルゴリズムに従って検査演算処理を行うことができる。例えば、機能安全モジュール12は、フォールトインジェクション処済みのテストデータに対して、予め設定されたCRC多項式に従ってCRC演算を行って相応のCRC数値を得ることができ、得られたCRC数値を検査演算処理結果とすることができる。次に、機能安全モジュール12は、得られた検査演算処理結果に対して、予め設定されたフォールトインジェクション形態に従ってフォールトインジェクション処理を行うことができ、例えば、得られた検査演算処理結果における少なくとも1つの文字を他の文字に修正して、フォールトインジェクション処理済みの検査演算処理結果を得ることができ、フォールトインジェクション処理済みの検査演算処理結果を第2の処理結果とすることができる。
機能安全モジュール12は、いずれか1つのテストデータ発生ユニット111からのテストデータを取得した後、予め設定された検査アルゴリズムのアルゴリズム引数に対してフォールトインジェクション処理を行うことができる。例えば、予め設定された検査アルゴリズムがCRCアルゴリズムである場合、CRCアルゴリズムを用いるとき、一般に、伝送対象データの後に特定ビットの冗長ビットを追加する必要があるため、当該特定ビットの数値をCRCアルゴリズムのアルゴリズム引数とすることができる。そうすると、特定のビットを他のビットに修正して、アルゴリズム引数に対するフォールトインジェクション処理済みの予め設定された検査アルゴリズムを得ることができる。
テストデータ発生ユニット111に対応するゲイン値セットにそれぞれゲイン値1、ゲイン値2、ゲイン値3との3つのゲイン値があり、且つその初期の対応するゲイン値がゲイン値1であるとすると、予め設定された時間(例えば、1秒、2秒、5秒など)が経過した後、その対応するゲイン値をゲイン値2に切り替え、また、予め設定された時間が経過した後、その対応するゲイン値をゲイン値3に切り替え、さらに、予め設定された時間が経過した後、その対応するゲイン値をゲイン値1に切り替えるようにすることができ、このように類推することができるので、その説明を省略する。
テストデータ発生ユニット111に対応するゲイン値セットにそれぞれゲイン値1、ゲイン値2、ゲイン値3との3つのゲイン値があり、且つその初期の対応するゲイン値がゲイン値1であるとすると、ゲイン値1に従って予め設定された回数(例えば、3回、4回、5回など)のテストデータ生成を行った後、その対応するゲイン値をゲイン値2に切り替え、ゲイン値2に従って予め設定された回数のテストデータ生成を行った後、その対応するゲイン値をゲイン値3に切り替え、ゲイン値3に従って予め設定された回数テストデータ生成を行った後、その対応するゲイン値をゲイン値1に切り替えるようにすることができ、このように類推することができるので、その説明を省略する。
図3は、本開示の例示的な一実施例に係るテスト対象モジュールのテスト方法のフローを示す図である。図3に示す方法は、上記の例示的な回路部分のテスト対象モジュールのテスト回路に適用され、図3に示す方法は、ステップ301と、ステップ302と、ステップ303と、ステップ304と、を含む。
図4は、本開示の例示的な一実施例に係るテスト対象モジュールのテスト装置の構造を示す図である。図4に示す装置は、上記の例示的な回路部分のテスト対象モジュールのテスト回路に適用され、図4に示す装置は、第1の生成モジュール401と、第1の処理モジュール402と、第2の処理モジュール403と、第2の生成モジュール403と、を含む。
以下、図5を参照して、本開示の実施例に係る電子機器について説明する。当該電子機器は、第1の機器及び第2の機器のいずれか1つ若しくは両方、又はそれらとは別個のスタンドアロン機器であってもよく、当該スタンドアロン機器は、第1の機器及び第2の機器と通信して、それらから収集された入力信号を受信することができる。
上記の方法及び機器に加えて、本開示の実施例は、コンピュータプログラム命令を含むコンピュータプログラム製品であることもでき、当該コンピュータプログラム命令がプロセッサにより実行されると、プロセッサに、本明細書の上記の「例示的な方法」部分で説明された本開示の様々な実施例に係るテスト対象モジュールのテスト方法のステップを実行させる。
Claims (13)
- テスト対象モジュールのテスト回路であって、
テストデータ発生モジュールと、機能安全モジュールと、を含み、
前記テストデータ発生モジュールは、それぞれ前記機能安全モジュールに電気的に接続される複数のテストデータ発生ユニットを含み、
各前記テストデータ発生ユニットは、当該テストデータ発生ユニットがサポートするデータ類型と一致する原データに基づいて、前記データ類型と一致するテストデータを生成し、
前記機能安全モジュールは、前記テスト対象モジュールと電気的に接続され、前記テストデータに対して検査演算処理を行って第1の処理結果を得、前記テストデータに対してフォールトインジェクション処理を行い、フォールトインジェクション処理済みのテストデータに対して、予め設定された検査アルゴリズムに従って検査演算処理を行うことにより、あるいは、前記テストデータに対して、予め設定された検査アルゴリズムに従って検査演算処理を行い、得られた検査演算処理結果に対してフォールトインジェクション処理を行うことにより、あるいは、予め設定された検査アルゴリズムのアルゴリズム引数に対してフォールトインジェクション処理を行い、前記テストデータに対して、アルゴリズム引数に対するフォールトインジェクション処理済みの前記予め設定された検査アルゴリズムに従って検査演算処理を行うことにより、第2の処理結果を得、
前記テスト対象モジュールは、前記テストデータ、前記第1の処理結果及び前記第2の処理結果に基づいて、テスト結果を生成する、
ことを特徴とするテスト対象モジュールのテスト回路。 - 前記テスト回路は、前記テスト対象モジュールと電気的に接続されるメタデータ発生モジュールをさらに含み、
前記メタデータ発生モジュールは、前記テストデータ発生モジュールにおける1つの前記テストデータ発生ユニットに対応し、
前記メタデータ発生モジュールは、それに対応する前記テストデータ発生ユニットが生成した前記テストデータに対応するメタデータを生成し、
前記テスト対象モジュールは、前記テストデータ、前記第1の処理結果、前記第2の処理結果及び前記メタデータに基づいて、前記テスト結果を生成する、
ことを特徴とする請求項1に記載のテスト対象モジュールのテスト回路。 - 前記テスト回路は、前記機能安全モジュールと電気的に接続される付加データ発生モジュールをさらに含み、
前記付加データ発生モジュールは、前記テストデータに対応する付加データを生成し、
前記機能安全モジュールは、さらに、前記付加データに対して検査演算処理を行って第3の処理結果を得、前記付加データに対して検査演算処理及びフォールトインジェクション処理を行って第4の処理結果を得、
前記テスト対象モジュールは、前記テストデータ、前記第1の処理結果、前記第2の処理結果、前記付加データ、前記第3の処理結果及び前記第4の処理結果に基づいて前記テスト結果を生成する、
ことを特徴とする請求項1に記載のテスト対象モジュールのテスト回路。 - 前記テスト回路は、コンフィギュレーションモジュールと、シーケンス信号発生モジュールと、をさらに含み、
前記コンフィギュレーションモジュールには、各前記テストデータ発生ユニット、前記機能安全モジュール、メタデータ発生モジュール、付加データ発生モジュール、及び前記シーケンス信号発生モジュールのそれぞれのコンフィギュレーション情報が記憶され、
前記シーケンス信号発生モジュールは、各前記テストデータ発生ユニット、前記メタデータ発生モジュール及び前記付加データ発生モジュールのそれぞれのコンフィギュレーション情報に基づいて、各前記テストデータ発生ユニット、前記メタデータ発生モジュール及び前記付加データ発生モジュールのそれぞれのシーケンス信号を生成し、
各前記テストデータ発生ユニット、前記メタデータ発生モジュール及び前記付加データ発生モジュールは、それぞれ、自身の前記シーケンス信号に基づいてデータを生成する、
ことを特徴とする請求項1に記載のテスト対象モジュールのテスト回路。 - 前記機能安全モジュールは、さらに、前記シーケンス信号に対してフォールトインジェクション処理を行い、
前記テスト対象モジュールは、前記テストデータ、前記第1の処理結果、前記第2の処理結果及びフォールトインジェクション処理を行われた前記シーケンス信号に基づいて、前記テスト結果を生成する、
ことを特徴とする請求項4に記載のテスト対象モジュールのテスト回路。 - 前記コンフィギュレーションモジュールは、記憶ユニットと、複数のレジスタと、を含み、
各前記レジスタには、前記コンフィギュレーション情報が記憶され、各前記テストデータ発生ユニット、前記機能安全モジュール、前記メタデータ発生モジュール、前記付加データ発生モジュール、前記シーケンス信号発生モジュールは、前記コンフィギュレーションモジュールにおける異なる前記レジスタにそれぞれ対応し、
各前記テストデータ発生ユニット、前記機能安全モジュール、前記メタデータ発生モジュール、前記付加データ発生モジュール及び前記シーケンス信号発生モジュールは、それぞれ、前記コンフィギュレーションモジュールにおける相応の前記レジスタ内の前記コンフィギュレーション情報に基づいて、自身をコンフィギュレーションし、
前記機能安全モジュールは、さらに、前記第1の処理結果を前記記憶ユニットに記憶させる、
ことを特徴とする請求項4に記載のテスト対象モジュールのテスト回路。 - 前記テスト回路は、データ出力モジュールをさらに含み、
前記データ出力モジュールは、それぞれ、前記機能安全モジュール、前記メタデータ発生モジュール及び前記テスト対象モジュールと電気的に接続され、
前記データ出力モジュールは、現在メタデータを出力しているかを表現する情報、現在付加データを出力しているかを表現する情報、現在前記テストデータを出力しているかを表現する情報、現在出力している前記テストデータに対応する前記シーケンス信号、現在出力している前記テストデータに対応する前記テストデータ発生ユニットを示す情報、前記メタデータ、前記テストデータ、前記付加データ、及び、現在出力している前記テストデータのデータ類型を示す情報のうちの少なくとも1つを前記テスト対象モジュールに出力する、
ことを特徴とする請求項4に記載のテスト対象モジュールのテスト回路。 - 異なる前記テストデータ発生ユニットは、異なるゲイン値に対応し、
各前記テストデータ発生ユニットは、当該テストデータ発生ユニットがサポートするデータ類型と一致する原データに、相応のゲイン値を与えて、前記データ類型と一致するテストデータを生成する、
ことを特徴とする請求項1に記載のテスト対象モジュールのテスト回路。 - 異なる前記テストデータ発生ユニットは、異なるゲイン値セットに対応し、
各前記テストデータ発生ユニットに対応するゲイン値は、相応のゲイン値セットから選択され、各前記テストデータ発生ユニットに対応するゲイン値は、予め設定された方式で繰り返して切り替える、
ことを特徴とする請求項8に記載のテスト対象モジュールのテスト回路。 - 請求項1から9のいずれか1項に記載のテスト対象モジュールのテスト回路に適用されるテスト対象モジュールのテスト方法であって、
前記テスト方法は、
前記テスト回路における各テストデータ発生ユニットを呼び出し、当該テストデータ発生ユニットがサポートするデータ類型と一致する原データに基づいて、前記データ類型と一致するテストデータを生成するステップと、
前記テストデータに対して検査演算処理を行って第1の処理結果を得るステップと、
前記テストデータに対してフォールトインジェクション処理を行い、フォールトインジェクション処理済みのテストデータに対して、予め設定された検査アルゴリズムに従って検査演算処理を行うことにより、あるいは、前記テストデータに対して、予め設定された検査アルゴリズムに従って検査演算処理を行い、得られた検査演算処理結果に対してフォールトインジェクション処理を行うことにより、あるいは、予め設定された検査アルゴリズムのアルゴリズム引数に対してフォールトインジェクション処理を行い、前記テストデータに対して、アルゴリズム引数に対するフォールトインジェクション処理済みの前記予め設定された検査アルゴリズムに従って検査演算処理を行うことにより、第2の処理結果を得るステップと、
前記テストデータ、前記第1の処理結果及び前記第2の処理結果に基づいて、前記テスト対象モジュールのテスト結果を生成するステップと、を含む、
ことを特徴とするテスト対象モジュールのテスト方法。 - 請求項1から9のいずれか1項に記載のテスト対象モジュールのテスト回路に適用されるテスト対象モジュールのテスト装置であって、
前記テスト装置は、
前記テスト回路における各テストデータ発生ユニットを呼び出し、当該テストデータ発生ユニットがサポートするデータ類型と一致する原データに基づいて、前記データ類型と一致するテストデータを生成するための第1の生成モジュールと、
前記第1の生成モジュールが生成した前記テストデータに対して検査演算処理を行って第1の処理結果を得るための第1の処理モジュールと、
前記第1の生成モジュールが生成した前記テストデータに対してフォールトインジェクション処理を行い、フォールトインジェクション処理済みのテストデータに対して、予め設定された検査アルゴリズムに従って検査演算処理を行うことにより、あるいは、前記テストデータに対して、予め設定された検査アルゴリズムに従って検査演算処理を行い、得られた検査演算処理結果に対してフォールトインジェクション処理を行うことにより、あるいは、予め設定された検査アルゴリズムのアルゴリズム引数に対してフォールトインジェクション処理を行い、前記テストデータに対して、アルゴリズム引数に対するフォールトインジェクション処理済みの前記予め設定された検査アルゴリズムに従って検査演算処理を行うことにより、第2の処理結果を得るための第2の処理モジュールと、
前記第1の生成モジュールが生成した前記テストデータ、前記第1の処理モジュールが得た前記第1の処理結果及び前記第2の処理モジュールが得た前記第2の処理結果に基づいて、前記テスト対象モジュールのテスト結果を生成するための第2の生成モジュールと、を含む、
ことを特徴とするテスト対象モジュールのテスト装置。 - コンピュータ読み取り可能な記憶媒体であって、
前記記憶媒体には、コンピュータプログラムが記憶され、
前記コンピュータプログラムは、請求項10に記載のテスト対象モジュールのテスト方法を実行する、
ことを特徴とするコンピュータ読み取り可能な記憶媒体。 - プロセッサと、
前記プロセッサにより実行可能なコンピュータプログラム命令を記憶するためのメモリと、
を含み、
前記プロセッサは、前記メモリから前記コンピュータプログラム命令を読み取り、この命令を実行して、請求項10に記載のテスト対象モジュールのテスト方法を実現する、
ことを特徴とする電子機器。
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Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
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Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017215665A (ja) | 2016-05-30 | 2017-12-07 | ルネサスエレクトロニクス株式会社 | 半導体装置、電子制御システムおよび電子制御システムの評価方法 |
US20180164369A1 (en) | 2016-12-13 | 2018-06-14 | Taiwan Semiconductor Manufacturing Co., Ltd. | Device and method for robustness verification |
US20190113572A1 (en) | 2017-10-18 | 2019-04-18 | International Business Machines Corporation | Determination and correction of physical circuit event related errors of a hardware design |
CN113295943A (zh) | 2021-04-30 | 2021-08-24 | 地平线征程(杭州)人工智能科技有限公司 | 待测试模块的测试电路、方法及装置 |
Family Cites Families (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6971045B1 (en) * | 2002-05-20 | 2005-11-29 | Cyress Semiconductor Corp. | Reducing tester channels for high pinout integrated circuits |
US8914687B2 (en) * | 2011-04-15 | 2014-12-16 | Advanced Micro Devices, Inc. | Providing test coverage of integrated ECC logic en embedded memory |
US8868989B2 (en) * | 2012-07-12 | 2014-10-21 | Freescale Semiconductor, Inc. | System for testing error detection circuits |
US10625752B2 (en) * | 2017-12-12 | 2020-04-21 | Qualcomm Incorporated | System and method for online functional testing for error-correcting code function |
CN108600047B (zh) * | 2018-04-04 | 2021-04-27 | 天津芯海创科技有限公司 | 串行传输芯片及serdes电路测试方法 |
US11335428B2 (en) * | 2018-10-09 | 2022-05-17 | Intel Corporation | Methods, systems and apparatus for in-field testing for generic diagnostic components |
CN112242177A (zh) * | 2019-07-16 | 2021-01-19 | 北京地平线机器人技术研发有限公司 | 存储器测试方法、装置、计算机可读存储介质及电子设备 |
CN110634530B (zh) * | 2019-09-10 | 2021-05-25 | 珠海博雅科技有限公司 | 芯片的测试***和测试方法 |
CN111400116A (zh) * | 2020-03-10 | 2020-07-10 | 珠海全志科技股份有限公司 | 芯片测试验证方法、计算机装置及计算机可读存储介质 |
CN111445115B (zh) * | 2020-03-20 | 2023-10-17 | Oppo(重庆)智能科技有限公司 | 测试项校验方法、装置、电子设备和计算机可读存储介质 |
CN111624477A (zh) * | 2020-05-31 | 2020-09-04 | 西南电子技术研究所(中国电子科技集团公司第十研究所) | 智能诊断高集成数字信号处理***故障的测试*** |
CN111856258B (zh) * | 2020-07-24 | 2023-05-09 | 北京百度网讯科技有限公司 | 用于芯片的测试的方法、设备、存储介质和相应的芯片 |
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Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017215665A (ja) | 2016-05-30 | 2017-12-07 | ルネサスエレクトロニクス株式会社 | 半導体装置、電子制御システムおよび電子制御システムの評価方法 |
US20180164369A1 (en) | 2016-12-13 | 2018-06-14 | Taiwan Semiconductor Manufacturing Co., Ltd. | Device and method for robustness verification |
US20190113572A1 (en) | 2017-10-18 | 2019-04-18 | International Business Machines Corporation | Determination and correction of physical circuit event related errors of a hardware design |
CN113295943A (zh) | 2021-04-30 | 2021-08-24 | 地平线征程(杭州)人工智能科技有限公司 | 待测试模块的测试电路、方法及装置 |
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