JP6798866B2 - マルチプレクサ - Google Patents
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Description
(基本的構成)
図1は、本発明の第1実施形態に係るマルチプレクサ1の構成を示す回路図である。マルチプレクサ1は、アンテナ端子ANT,接続点10,第1端子S1,第2端子S2,第3端子S3を備える。
容量素子C1は、容量素子C1が第1フィルタF1に接続される側のポートp1と、接続点10側のポートp2とを備える。ここで、容量素子C1を基準に回路的にみると、ポートp1側に位置するフィルタ(この例では第1フィルタF1)と、ポートp2側に位置するフィルタ(この例では第2フィルタ,第3フィルタF3)とがある。ポートp2側に位置するフィルタとは、ポートp1側に位置するフィルタに対してアンテナ端子ANTからみて並列接続されているフィルタということもできる。以後、ポートp1側に位置するフィルタを後段に位置するフィルタ、ポートp2側に位置するフィルタを前段に位置するフィルタと呼ぶことがある。
上述の例では、1つのフィルタに1つの容量素子C1を設けた例について説明したが、2以上のフィルタに対して1つの容量素子を設けてもよい。このようなマルチフィルタ1Aの一例の回路図を図4に示す。
以下、上述のマルチプレクサ1,1Aを構成する各構成要素について図5を用いて説明する。図5において、いずれの方向が上方または下方とされてもよいものであるが、以下では、便宜的に、D1軸、D2軸およびD3軸からなる直交座標系を定義し、D3軸の正側(図5の紙面手前側)を上方として、上面等の語を用いることがあるものとする。
第2容量素子C2:容量値 10pF,1GHzにおけるQ値 60
インダクタL :インダクタンス 1.6nH,1GHzにおけるQ値 62
容量素子C1,第2容量素子C2,インダクタL:いずれも不図示の実装基板に実装しチップ素子
フィルタF1〜F4の通過帯域:1.7GHz〜2.2GHz
このような構成の実施例2および比較例の周波数特性について図7に示す。図7(a)に、比較例のマルチプレクサについて各フィルタの周波数と反射係数Γの大きさとの相関を示す。図7(b)に実施例2のルチプレクサについて各フィルタの周波数と反射係数Γの大きさとの相関を示す。
Claims (8)
- それぞれが少なくとも1つの共振子を含み、互いに通過帯域の異なる第1フィルタ,第2フィルタおよび第3フィルタと、
前記第1フィルタ、前記第2フィルタおよび前記第3フィルタが電気的に共通に接続されている接続点と、
第1ポートと第2ポートとを備え、前記第1ポートを前記第1フィルタの側に接続し、前記第2ポートを前記接続点の側に接続することで、前記接続点と前記第1フィルタとの間に直列接続された容量素子と、を備え、
前記第1フィルタは、前記少なくとも1つの共振子のうち最も前記容量素子の側に接続された第1共振子を備え、
前記接続点と前記第1フィルタとの間には基準電位への分岐路を備えず、
前記容量素子は、前記第2フィルタおよび前記第3フィルタのうち、前記第2ポートの側に位置するフィルタの通過帯域の周波数帯において、前記第1フィルタの前記第1共振子よりも損失が少なく、
前記第2フィルタは、前記第2ポートの側に位置しており、
第3ポートと第4ポートとを備え、前記第3ポートを前記第2フィルタの側に接続し、前記第4ポートを前記接続点の側に接続することで、前記接続点と前記第2フィルタとの間に直列接続された第2容量素子をさらに備え、
前記第2容量素子は、前記第1フィルタおよび前記第3フィルタのうち、前記第4ポートの側に位置するフィルタの通過帯域の周波数帯において、前記第2フィルタの前記少なくとも1つの共振子のうち最も前記第2容量素子の側に接続された第2共振子よりも損失が少ない、
マルチプレクサ。 - 前記第1フィルタの通過帯域は、前記第2フィルタおよび前記第3フィルタのうち、前記第2ポートの側に位置するフィルタの通過帯域よりも低周波数側である、請求項1に記載のマルチプレクサ。
- 前記第1フィルタの前記少なくとも1つの共振子は、弾性波共振子を含む、請求項1または2に記載のマルチプレクサ。
- 前記容量素子は、チップコンデンサである、請求項1乃至3のいずれかに記載のマルチプレクサ。
- 前記容量素子は、前記弾性波共振子よりも共振周波数が高い1対の櫛歯状電極で構成される、請求項3に記載のマルチプレクサ。
- 複数の共振子を含み、前記第1フィルタ、前記第2フィルタおよび前記第3フィルタのいずれとも通過帯域が異なる第4フィルタをさらに備え、
前記第1フィルタと前記第3フィルタとを共通に接続する第1接続点と、
前記第2フィルタと前記第4フィルタとを共通に接続する第2接続点と、を備え、
前記接続点は、前記第1接続点と前記第2接続点とが配線を介しそれぞれ電気的に接続されており、
前記容量素子は、前記第1接続点と前記接続点との間に接続され、
前記第2容量素子は、前記第2接続点と前記接続点との間に接続されている、請求項1乃至5のいずれかに記載のマルチプレクサ。 - 前記接続点が電気的に接続されるアンテナ端子をさらに備え、
前記接続点と前記アンテナ端子との間に整合回路が接続されている、請求項1乃至6のいずれかに記載のマルチプレクサ。 - 前記第1フィルタと、前記第2フィルタおよび前記第3フィルタの通過帯域を周波数順に並べたときに、隣接する通過帯域同士の間隔が通過帯域幅の5倍以下である、請求項1乃至5のいずれかに記載のマルチプレクサ。
Priority Applications (1)
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JP2016243166A JP6798866B2 (ja) | 2016-12-15 | 2016-12-15 | マルチプレクサ |
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JP2016243166A JP6798866B2 (ja) | 2016-12-15 | 2016-12-15 | マルチプレクサ |
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Family Applications (1)
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JP2016243166A Active JP6798866B2 (ja) | 2016-12-15 | 2016-12-15 | マルチプレクサ |
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Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
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KR102134087B1 (ko) * | 2016-06-14 | 2020-07-14 | 가부시키가이샤 무라타 세이사쿠쇼 | 멀티플렉서, 고주파 프론트 엔드 회로 및 통신 장치 |
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2016
- 2016-12-15 JP JP2016243166A patent/JP6798866B2/ja active Active
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