JP6669104B2 - 半導体装置 - Google Patents

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Description

本発明は、半導体装置およびその製造方法に関するものである。
半導体チップが接着剤で基板に固定された構成の半導体装置について、例えば特許文献1では、半導体チップが基板に対して傾くことを抑制するために、球状粒子を含む接着剤を用いて半導体チップを基板に固定する方法が提案されている。
特許第4299685号公報
接着剤の粘度が高い場合には、接着剤と球状粒子との攪拌が困難であるため、接着剤中の球状粒子の分布に偏りが生じることがある。そのため、特許文献1に記載の方法では、半導体チップが球状粒子によって十分に支持されず、基板に対して傾くおそれがある。
本発明は上記点に鑑みて、半導体チップが基板に対して傾くことを抑制することができる半導体装置およびその製造方法を提供することを目的とする。
上記目的を達成するため、請求項1に記載の発明では、基板(1)と、基板の表面側に配置された半導体チップ(2)と、半導体チップの裏面を基板の表面に固定する接着剤(3)と、基板と半導体チップとの距離を規定する複数のスペーサ(4)と、を備え、スペーサは、基板の表面、または、半導体チップの裏面に接合され、半導体チップの裏面の面内方向において、半導体チップの重心を囲む多角形の各頂点に位置しており、半導体チップの表面に接続されたボンディングワイヤ(5)を備え、ボンディングワイヤは、スペーサに対応する位置において半導体チップに接続されており、スペーサは、接着剤よりも硬い。
このように、半導体チップの重心を囲むようにスペーサを配置することにより、半導体チップが重心の両側で支持されるようになり、半導体チップが自身の重さによって基板に対して傾くことが抑制される。
なお、上記各手段の括弧内の符号は、後述する実施形態に記載の具体的手段との対応関係の一例を示すものである。
第1実施形態にかかる半導体装置の断面図である。 第1実施形態にかかる半導体装置の平面図である。 図1の半導体装置の製造工程を示す断面図である。 第1実施形態の変形例の断面図である。 第1実施形態の変形例の製造工程を示す平面図である。 第2実施形態にかかる半導体装置の断面図である。 第3実施形態にかかる半導体装置の断面図である。 第4実施形態にかかる半導体装置の断面図である。 第5実施形態にかかる半導体装置の断面図である。 他の実施形態にかかる半導体装置の平面図である。
以下、本発明の実施形態について図に基づいて説明する。なお、以下の各実施形態相互において、互いに同一もしくは均等である部分には、同一符号を付して説明を行う。
(第1実施形態)
第1実施形態について説明する。図1に示すように、本実施形態の半導体装置は、基板1と、半導体チップ2と、接着剤3と、複数のスペーサ4と、ボンディングワイヤ5と、封止樹脂6とを備えている。
基板1は、エポキシ樹脂やガラスエポキシ樹脂等の樹脂をベースとして構成されるプリント基板で構成されている。半導体チップ2は、Si等で構成された基板に半導体素子が形成されたものであり、基板1の表面側に配置されている。半導体チップ2は、矩形板状とされており、裏面が接着剤3によって基板1の表面に固定されている。接着剤3は、例えばシリコン樹脂、エポキシ樹脂等で構成される。基板1と半導体チップ2との間には、接着剤3と、スペーサ4とが配置されている。
スペーサ4は、基板1と半導体チップ2との距離を規定するものである。本実施形態では、スペーサ4は、半導体チップ2の裏面に接合されている。また、スペーサ4は、半導体チップ2の裏面の面内方向において、半導体チップ2の重心を囲む多角形の各頂点に位置している。このような構成により、半導体チップ2が自身の重さで傾くことが抑制され、基板1と半導体チップ2との間の距離が一定に保たれる。
なお、スペーサ4は少なくとも3つあればよい。半導体装置がスペーサ4を3つ備える場合には、半導体チップ2の裏面の面内方向において、半導体チップ2の重心を囲む三角形の各頂点にスペーサ4を配置すればよい。また、複数のスペーサ4の一部によって半導体チップ2の重心が囲まれていてもよい。
また、複数のスペーサ4は、半導体チップ2の裏面の面内方向において、半導体チップ2の中心に対して対称に配置されている。スペーサ4をこのように配置することで、基板1と半導体チップ2との線膨張係数の差による半導体チップ2の変形を緩和することができる。
本実施形態では、図1、図2に示すように、スペーサ4は、半導体チップ2の裏面に8つ形成されている。なお、図2は、スペーサ4が形成された半導体チップ2を裏面側から見た平面図である。
8つのスペーサ4のうち4つは、それぞれ、半導体チップ2の裏面の4つの角部に形成されており、半導体チップ2の重心を囲む四角形の各頂点に位置している。そして、他の4つのスペーサ4は、半導体チップ2の裏面の内周部に形成されており、半導体チップ2の重心を囲む四角形の各頂点に位置している。
また、本実施形態では、スペーサ4は、熱や紫外線によって硬化する樹脂で構成されている。なお、スペーサ4の材料は、半導体装置の用途によっては、低応力、低線膨張係数のものが望ましい。また、スペーサ4をAgペースト、ハンダボール等の金属、または、接着剤と同様の材料で構成してもよい。
複数のスペーサ4は、それぞれ、半導体チップ2の裏面における円形状の領域に塗布されており、この領域の径を大きくすることにより、スペーサ4の高さを大きくすることができる。スペーサ4を塗布する領域の径、および、スペーサ4の高さは、材料の粘度やチクソ値により制御される。
ボンディングワイヤ5は、半導体チップ2を基板1に電気的に接続するためのものであり、半導体チップ2の表面に形成された図示しないパッドに接続されている。図1に示すように、ボンディングワイヤ5は、スペーサ4に対応する位置において半導体チップ2に接続されている。ボンディングワイヤ5をこのように配置すると、半導体チップ2のうちワイヤボンディングの際に荷重が加わる部分がスペーサ4によって支持されるので、接着剤3が軟らかい場合にも、安定したワイヤボンディングを行うことができる。
封止樹脂6は、基板1の表面において、半導体チップ2、接着剤3、スペーサ4、ボンディングワイヤ5を覆うように形成されている。
本実施形態の半導体装置の製造方法について図3を用いて説明する。図3(a)に示す工程では、ジェットディスペンサ等を用いて、半導体チップ2の裏面に樹脂を塗布する。具体的には、半導体チップ2の裏面の面内方向において、半導体チップ2の重心を囲む多角形の各頂点に位置するように樹脂を点状に塗布する。そして、塗布した樹脂を熱や紫外線によって硬化させる。これにより、半導体チップ2の裏面に接合されたスペーサ4が形成される。
なお、本実施形態では、半導体素子が形成されたウェハをダイシングカットによってチップ単位に分割した後にスペーサ4を形成しているが、半導体素子が形成されたウェハにスペーサ4を形成し、その後にダイシングカットを行って半導体チップ2を形成してもよい。
図3(b)に示す工程では、接着剤3を用いて、半導体チップ2の裏面を基板1の表面に固定する。このとき、半導体チップ2の裏面に形成されたスペーサ4の先端が基板1に接触するようにする。これにより、基板1と半導体チップ2との距離がスペーサ4の高さと等しくなる。すなわち、スペーサ4によって基板1と半導体チップ2との距離が規定される。半導体チップ2を基板1に固定する際には、半導体チップ2に接合されたスペーサ4をアライメントマークとして使用することが可能である。
なお、図3(b)に示す工程では、基板1に接着剤3を塗布した後に半導体チップ2を基板1に固定してもよいし、半導体チップ2に接着剤3を塗布した後に半導体チップ2を基板1に固定してもよい。
図3(c)に示す工程では、半導体チップ2の表面に形成された図示しないパッドと基板1とを電気的に接続するワイヤボンディングを行う。このとき、ボンディングワイヤ5を、スペーサ4に対応する位置において半導体チップ2に接続することにより、接着剤3が軟らかい場合にも、安定したワイヤボンディングを行うことができる。
図3(d)に示す工程では、半導体チップ2、接着剤3、スペーサ4、ボンディングワイヤ5を覆うように樹脂を塗布し、封止樹脂6を形成する。このようにして、本実施形態の半導体装置が製造される。
スペーサ4が上記のように配置された本実施形態では、半導体チップ2がスペーサ4によって重心の両側から支えられるため、半導体チップ2が自身の重さによって基板1に対して傾くことが抑制される。
また、特許文献1に記載の方法では、接着剤と球状粒子とを攪拌する工程が必要であるが、本実施形態では、この攪拌工程が必要でないため、半導体装置の製造工程を簡略化することができる。また、接着剤の粘度が高い場合には、接着剤と球状粒子との攪拌が困難になるが、本実施形態では、接着剤3として粘度が高い材料を用いても、粘度が低い材料を用いる場合と同様に半導体装置を製造することができる。
なお、本実施形態では、スペーサ4は半導体チップ2の裏面に接合されているが、図4に示すように、スペーサ4が基板1の表面に接合されていてもよい。このような構成においても、本実施形態と同様に、半導体チップ2が基板1に対して傾くことを抑制することができる。なお、図4、および、後述する図6〜図9では、封止樹脂6の図示を省略している。
また、このような構成では、図3(b)に示す工程において基板1に接着剤3を塗布する場合に、半導体チップ2を基板1に固定する際に、接着剤3が過度に広がることをスペーサ4によって抑制することができる。例えば、接着剤3を半導体チップ2が置かれる領域の中央部に塗布することで、図5の破線で囲まれた領域、すなわち、半導体チップ2が配置される領域のうち、スペーサ4の近傍およびスペーサ4よりも内周側の部分に接着剤3を留まらせることができる。なお、図5はスペーサ4が形成された基板1を表面側から見た平面図であり、一点鎖線で囲まれた領域に半導体チップ2が配置される。
また、スペーサ4を基板1の表面に接合する場合にも、半導体チップ2を基板1に固定する際に、スペーサ4をアライメントマークとして使用することが可能である。
(第2実施形態)
第2実施形態について説明する。第2実施形態は、第1実施形態に対してスペーサ4の構成を変更したものであり、その他については第1実施形態と同様であるため、第1実施形態と異なる部分についてのみ説明する。
図6に示すように、本実施形態のスペーサ4は、半導体チップ2の裏面に形成された第1層4aと、第1層4aの表面に形成された第2層4bとで構成されている。第1層4a、第2層4bは、樹脂で形成されている。
このようなスペーサ4は、半導体チップ2の裏面に第1層4aを構成する樹脂を塗布し、硬化させて第1層4aを形成した後、第1層4aの表面に第2層4bを構成する樹脂を塗布し、硬化させることにより形成される。
一度の樹脂の塗布で形成されるスペーサ4の高さは表面張力等で定まるが、このように、第1層4aの表面にさらに樹脂を塗布して第2層4bを形成することにより、一度の樹脂の塗布でスペーサ4を形成する場合に比べて、スペーサ4を高くすることができる。また、これにより、基板1と半導体チップ2との線膨張係数の差による応力を低減することが可能となる。
(第3実施形態)
第3実施形態について説明する。第3実施形態は、第1実施形態に対してスペーサ4の構成を変更したものであり、その他については第1実施形態と同様であるため、第1実施形態と異なる部分についてのみ説明する。
図7に示すように、本実施形態のスペーサ4は、基板1の表面、および、半導体チップ2の裏面の両方に形成されており、基板1の表面、半導体チップ2の裏面に形成されたスペーサ4は、それぞれ、基板1の表面、半導体チップ2の裏面に接合されている。そして、基板1の表面に形成されたスペーサ4と、半導体チップ2の裏面に形成されたスペーサ4とが積み重なることにより、基板1と半導体チップ2との距離が規定されている。
このように、基板1と半導体チップ2の両方に形成されたスペーサ4が積み重なることにより、基板1と半導体チップ2との距離を大きくすることができる。また、基板1と半導体チップ2との線膨張係数の差による応力を低減することが可能となる。
(第4実施形態)
第4実施形態について説明する。第4実施形態は、第1実施形態に対してスペーサ4の構成を変更したものであり、その他については第1実施形態と同様であるため、第1実施形態と異なる部分についてのみ説明する。
図8に示すように、本実施形態では、半導体チップ2に、半導体チップ2を厚さ方向に貫通するTSV(シリコン貫通ビア)であるビア7が形成されている。そして、スペーサ4は、ビア7の内部および半導体チップ2の裏面に形成された金属層8で構成されている。なお、ビア7および金属層8は、半導体チップ2と基板1に形成された回路等とを電気的に接続するものではなく、これらを電気的に接続する配線等とは別に形成される。
このような半導体装置を製造するには、例えばSi基板の表面に半導体素子を形成し、Si基板を貫通するビア7を形成し、メッキによってビア7の内部に金属層8を埋め込んだ後、Si基板の裏面側の一部をエッチングにより除去して金属層8を突出させる。そして、第1実施形態と同様に接着、ワイヤボンディング、樹脂封止を行う。
このように、スペーサ4を金属層8で構成した本実施形態においても、第1実施形態と同様に、半導体チップ2が基板1に対して傾くことが抑制される。
(第5実施形態)
第5実施形態について説明する。第5実施形態は、第1実施形態に対して半導体チップ2の数を変更したものであり、その他については第1実施形態と同様であるため、第1実施形態と異なる部分についてのみ説明する。
図9に示すように、本実施形態の半導体装置は、半導体チップ2を複数備えており、複数の半導体チップ2は、積層されて配置されている。
また、接着剤3は、複数の半導体チップ2のうち1つの裏面を基板1の表面に固定するとともに、隣り合う2つの半導体チップ2のうち一方の裏面を他方の表面に固定している。
また、複数のスペーサ4の一部が基板1の表面に接合されており、他のスペーサ4は、隣り合う2つの半導体チップ2の間に配置されている。隣り合う2つの半導体チップ2の間に配置されたスペーサ4は、2つの半導体チップ2のうち基板1に近い一方の表面に接合されており、他方の裏面の面内方向において、他方の重心を囲む多角形の各頂点に位置している。そして、スペーサ4は、隣り合う2つの半導体チップ2の間の距離を規定している。
このように複数の半導体チップ2が積層された構成では、隣り合う2つの半導体チップ2の間に第1実施形態と同様にスペーサ4を配置することにより、隣り合う2つの半導体チップ2のうち一方が他方に対して傾くことが抑制される。
(他の実施形態)
なお、本発明は上記した実施形態に限定されるものではなく、特許請求の範囲に記載した範囲内において適宜変更が可能である。
例えば、上記第2実施形態において、スペーサ4を基板1の表面に形成してもよい。また、上記第5実施形態において、基板1と半導体チップ2との距離を規定するスペーサ4を半導体チップ2の裏面に接合させてもよい。また、上記第5実施形態において、隣り合う2つの半導体チップ2のうち基板1から遠い方の半導体チップ2の裏面にスペーサ4を接合させてもよい。
また、上記第3、第5実施形態において、第2実施形態と同様に、スペーサ4を第1層4aと第2層4bで構成してもよい。
また、上記第1実施形態において、スペーサ4を半導体チップ2の裏面の面内方向において他の位置に形成してもよい。例えば、図10に示すように、スペーサ4が、半導体チップ2の裏面に6つ形成されており、6つのスペーサ4が、半導体チップ2の重心を囲む長方形の各頂点と、対向する2つの辺の中点に位置していてもよい。なお、図10は、スペーサ4が形成された半導体チップ2を裏面側から見た平面図である。
1 基板
2 半導体チップ
3 接着剤
4 スペーサ

Claims (9)

  1. 基板(1)と、
    前記基板の表面側に配置された半導体チップ(2)と、
    前記半導体チップの裏面を前記基板の表面に固定する接着剤(3)と、
    前記基板と前記半導体チップとの距離を規定する複数のスペーサ(4)と、を備え、
    前記スペーサは、前記基板の表面、または、前記半導体チップの裏面に接合され、前記半導体チップの裏面の面内方向において、前記半導体チップの重心を囲む多角形の各頂点に位置しており、
    前記半導体チップの表面に接続されたボンディングワイヤ(5)を備え、
    前記ボンディングワイヤは、前記スペーサに対応する位置において前記半導体チップに接続されており、
    前記スペーサは、前記接着剤よりも硬い、半導体装置。
  2. 一部の前記スペーサは、前記基板の表面に接合されており、他の前記スペーサは、前記半導体チップの裏面に接合されており、
    前記基板の表面に接合された前記スペーサと、前記半導体チップの裏面に接合された前記スペーサとが積み重なることにより、前記基板と前記半導体チップとの距離が規定されている請求項1に記載の半導体装置。
  3. 前記半導体チップには、前記半導体チップを貫通するビア(7)が形成されており、
    前記スペーサは、前記ビアの内部および前記半導体チップの裏面に形成された金属層(8)で構成されている請求項1に記載の半導体装置。
  4. 基板(1)と、
    前記基板の表面側に配置された半導体チップ(2)と、
    前記半導体チップの裏面を前記基板の表面に固定する接着剤(3)と、
    前記基板と前記半導体チップとの距離を規定する複数のスペーサ(4)と、を備え、
    前記スペーサは、前記基板の表面、または、前記半導体チップの裏面に接合され、前記半導体チップの裏面の面内方向において、前記半導体チップの重心を囲む多角形の各頂点に位置しており、
    一部の前記スペーサは、前記基板の表面に接合されており、他の前記スペーサは、前記半導体チップの裏面に接合されており、
    前記基板の表面に接合された前記スペーサと、前記半導体チップの裏面に接合された前記スペーサとが積み重なることにより、前記基板と前記半導体チップとの距離が規定されている半導体装置。
  5. 前記スペーサは、樹脂で構成された第1層(4a)と、前記第1層の表面に形成された第2層(4b)とで構成されている請求項1、2、および4のいずれか1つに記載の半導体装置。
  6. 基板(1)と、
    前記基板の表面側に配置された半導体チップ(2)と、
    前記半導体チップの裏面を前記基板の表面に固定する接着剤(3)と、
    前記基板と前記半導体チップとの距離を規定する複数のスペーサ(4)と、を備え、
    前記スペーサは、前記基板の表面、または、前記半導体チップの裏面に接合され、前記半導体チップの裏面の面内方向において、前記半導体チップの重心を囲む多角形の各頂点に位置しており、
    前記半導体チップには、前記半導体チップを貫通するビア(7)が形成されており、
    前記スペーサは、前記ビアの内部および前記半導体チップの裏面に形成された金属層(8)で構成されている半導体装置。
  7. 前記スペーサは、前記半導体チップの裏面の面内方向において、前記半導体チップの重心を囲む三角形の各頂点に位置している請求項1ないし6のいずれか1つに記載の半導体装置。
  8. 前記スペーサは、前記半導体チップの裏面の面内方向において、前記半導体チップの中心に対して対称に配置されている請求項1ないし7のいずれか1つに記載の半導体装置。
  9. 積層配置された複数の前記半導体チップを備え、
    前記接着剤を第1接着剤として、隣り合う2つの前記半導体チップのうち一方の裏面を他方の表面に固定する第2接着剤(3)を備え、
    前記スペーサを第1スペーサとして、隣り合う2つの前記半導体チップのうち一方の表面、または、他方の裏面に接合され、他方の裏面の面内方向において、他方の重心を囲む多角形の各頂点に位置しており、隣り合う2つの前記半導体チップの間の距離を規定する第2スペーサ(4)を備える請求項1ないし8のいずれか1つに記載の半導体装置。
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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2018125255A1 (en) * 2016-12-31 2018-07-05 Intel Corporation Electronic device package
WO2020175619A1 (ja) * 2019-02-28 2020-09-03 京セラ株式会社 電子部品搭載用パッケージ、電子装置及び発光装置
CN112420625A (zh) * 2020-10-29 2021-02-26 光华临港工程应用技术研发(上海)有限公司 芯片贴放封装结构及方法

Family Cites Families (19)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0438859A (ja) * 1990-06-04 1992-02-10 Hitachi Ltd 電子部品組立構造及びその組立方法
JPH10303345A (ja) * 1997-04-28 1998-11-13 Shinko Electric Ind Co Ltd 半導体チップの基板への実装構造
DE10006447A1 (de) 2000-02-14 2001-08-16 Epcos Ag Bauelement mit konstant verspannter Verklebung und Verfahren zur Verklebung
TW445610B (en) * 2000-06-16 2001-07-11 Siliconware Precision Industries Co Ltd Stacked-die packaging structure
US7518223B2 (en) * 2001-08-24 2009-04-14 Micron Technology, Inc. Semiconductor devices and semiconductor device assemblies including a nonconfluent spacer layer
US6784555B2 (en) * 2001-09-17 2004-08-31 Dow Corning Corporation Die attach adhesives for semiconductor applications utilizing a polymeric base material with inorganic insulator particles of various sizes
US6906425B2 (en) * 2002-03-05 2005-06-14 Resolution Performance Products Llc Attachment of surface mount devices to printed circuit boards using a thermoplastic adhesive
JP4299685B2 (ja) * 2004-01-27 2009-07-22 積水化学工業株式会社 半導体装置
JP2005216972A (ja) 2004-01-27 2005-08-11 Sekisui Chem Co Ltd 積層配線基板
US20050224959A1 (en) * 2004-04-01 2005-10-13 Chippac, Inc Die with discrete spacers and die spacing method
JP2006228809A (ja) 2005-02-15 2006-08-31 Taiyo Yuden Co Ltd 半導体装置およびその製造方法
US7663232B2 (en) * 2006-03-07 2010-02-16 Micron Technology, Inc. Elongated fasteners for securing together electronic components and substrates, semiconductor device assemblies including such fasteners, and accompanying systems
KR100809701B1 (ko) * 2006-09-05 2008-03-06 삼성전자주식회사 칩간 열전달 차단 스페이서를 포함하는 멀티칩 패키지
US8178976B2 (en) * 2008-05-12 2012-05-15 Texas Instruments Incorporated IC device having low resistance TSV comprising ground connection
JP2012074636A (ja) * 2010-09-29 2012-04-12 Sumitomo Bakelite Co Ltd 接合方法、半導体装置、多層回路基板および電子部品
JP2012243906A (ja) * 2011-05-18 2012-12-10 Elpida Memory Inc 半導体装置
JP2014099584A (ja) * 2012-10-18 2014-05-29 Denso Corp 半導体装置及びその製造方法
CN105280621B (zh) * 2014-06-12 2019-03-19 意法半导体(格勒诺布尔2)公司 集成电路芯片的堆叠和电子器件
WO2018116785A1 (ja) 2016-12-20 2018-06-28 株式会社デンソー 半導体装置およびその製造方法

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