JP6599229B2 - 低電圧マルチステージ増幅器 - Google Patents
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Description
以下に、本願出願の当初の特許請求の範囲に記載された発明を付記する。
[C1]
1つまたは複数の前段のステージと、
供給ステージと、
出力ステージ中の第1のトランジスタのしきい値電圧と、前記供給ステージの第2のトランジスタの飽和電圧との合計と同じ低さの供給電圧で動作する前記出力ステージと、ここにおいて前記供給ステージは前記出力ステージを供する、
を具備する低電圧マルチステージ増幅器。
[C2]
前記供給ステージは減衰ステージとしても動作する、C1の低電圧マルチステージ増幅器。
[C3]
バイアス回路を更に具備し、
ここにおいて、前記バイアス回路は、前記供給ステージを介して前記出力ステージの適切な動作のための静止電流を設定する、C1の低電圧マルチステージ増幅器。
[C4]
前記バイアス回路は、
複製した電流ステージと、
最少セレクタと、
エラー増幅器とを具備するC3の低電圧マルチステージ増幅器。
[C5]
前記複製した電流ステージは、前記最少セレクタに第1のバイアス電圧と第2のバイアス電圧とを供給し、ここにおいて前記最少セレクタは、前記エラー増幅器に所定の電圧を供給し、ここにおいて前記エラー増幅器は、前記出力ステージの静止電流を設定する前記供給ステージを制御する、
C4の低電圧マルチステージ増幅器。
[C6]
所定の電圧は、仮に第1のバイアス電圧と第2のバイアス電圧とが互いの最少セレクタトランジスタ内での飽和電圧内であれば、前記第1のバイアス電圧と前記第2のバイアス電圧との平均であり、ここにおいて、前記所定の電圧は、仮に前記第1のバイアス電圧と前記第2のバイアス電圧とが、互いの前記最少セレクタトランジスタ内での飽和電圧内でない場合、前記第1のバイアス電圧と前記第2のバイアス電圧のうち小さい方である、
C5の低電圧マルチステージ増幅器。
[C7]
前記エラー増幅器は、前記供給ステージに第1の制御電圧と第2の制御電圧とを出力する、C5の低電圧マルチステージ増幅器。
[C8]
前記第1のトランジスタは、pチャネル型トランジスタであり、ここにおいて前記第2のトランジスタは、nチャネル型トランジスタである、C1の低電圧マルチステージ増幅器。
[C9]
前記第1のトランジスタのソースは、可変の正の供給電圧に結合され、ここにおいて前記第1のトランジスタのゲートは、前記第2のトランジスタのドレインに結合され、ここにおいて前記第2のトランジスタのソースは、可変の負の供給電圧に結合される、C8の低電圧マルチステージ増幅器。
[C10]
前記1つまたは複数の前段のステージは、第1のステージと第2のステージとを具備し、
ここにおいて前記第1のステージは入力信号を受信し、ここにおいて前記第1のステージの出力は、前記第2のステージに結合され、ここにおいて前記第2のステージの出力は、前記出力ステージに結合され、ここにおいて前記出力ステージは出力信号を出力する、C1の低電圧マルチステージ増幅器。
[C11]
第2のステージ内の電流が再利用されるので、供給ステージをサポートするための更なるバイアス電流は、必要とされない、C10の低電圧マルチステージ増幅器。
[C12]
前記低電圧マルチステージ増幅器は、クラスGの増幅器である、C1の低電圧マルチステージ増幅器。
[C13]
前記低電圧マルチステージ増幅器は、クラスHの増幅器である、C1の低電圧マルチステージ増幅器。
[C14]
前記低電圧マルチステージ増幅器は、前記出力ステージの出力信号に前記出力ステージの供給電圧を一致させるよう構成される、C1の低電圧マルチステージ増幅器。
[C15]
前記出力ステージは、±0.45Vの供給電圧で動作する、C1の低電圧マルチステージ増幅器。
[C16]
増幅に関する方法であって、前記方法は、入力信号を取得することと、
低電圧マルチステージ増幅器に用いる前記入力信号を増幅することとは、
1つまたは複数の前段のステージと、
供給ステージと、
出力ステージ内の第1のトランジスタのしきい値電圧と前記供給ステージの第2のトランジスタの飽和電圧と、の合計と同じくらい低い供給電圧で動作する前記出力ステージと、ここにおいて前記供給ステージは前記出力ステージを供する、を具備する、増幅に関する方法。
[C17]
前記供給ステージは減衰ステージとしても動作する、C16の方法。
[C18]
前記低電圧マルチステージ増幅器は、バイアス回路を更に具備し、ここにおいて前記バイアス回路は、前記供給ステージを介して前記出力ステージの適切な動作に関する静止電流を設定する、C16の方法。
[C19]
前記バイアス回路は、
複製した電流ステージと、
最少セレクタと、
エラー増幅器とを具備するC18の方法。
[C20]
前記複製した電流ステージは、前記最少セレクタに第1のバイアス電圧と第2のバイアス電圧とを供給し、ここにおいて、前記最少セレクタは、所定の電圧を前記エラー増幅器に供給し、ここにおいて前記エラー増幅器は前記出力ステージの静止電流を設定する前記供給ステージを制御する、C19の方法。
[C21]
前記所定の電圧は、仮に前記第1のバイアス電圧と前記第2のバイアス電圧が、互いの最少セレクタトランジスタの飽和電圧内であれば、前記第1のバイアス電圧と前記第2のバイアス電圧との平均であり、
ここにおいて、前記所定の電圧は、仮に前記第1のバイアス電圧と前記第2のバイアス電圧とが、互いの前記最少セレクタトランジスタの飽和電圧内でないと、前記第1のバイアス電圧と前記第2のバイアスのうちより小さい方である、C20の方法。
[C22]
前記エラー増幅器は、第1の制御電圧及び第2の制御電圧を前記供給ステージに出力する、C20の方法。
[C23]
前記第1のトランジスタは、pチャネル型トランジスタであり、ここにおいて、前記第2のトランジスタは、nチャネル型トランジスタである、C16の方法。
[C24]
前記第1のトランジスタのソースは、可変の正の供給電圧に結合され、ここにおいて前記第1のトランジスタのゲートは、前記第2のトランジスタのドレインに結合され、ここにおいて前記第2のトランジスタのソースは可変の負の供給電圧に結合される、C23の方法。
[C25]
前記1つまたは複数の前段のステージは、第1のステージと第2のステージとを具備し、ここにおいて前記第1のステージは、入力信号を受信し、ここにおいて前記第1のステージの出力は前記第2のステージに結合され、ここにおいて前記第2のステージの出力は、前記出力ステージに結合され、ここにおいて前記出力ステージは出力信号を出力する、C16の方法。
[C26]
前記第2のステージ内の電流が再利用するので、前記供給ステージをサポートするための更なるバイアス電流は、必要とされない、C25の方法。
[C27]
前記低電圧マルチステージ増幅器は、クラスGの増幅器である、C16の方法。
[C28]
前記低電圧マルチステージ増幅器は、クラスHの増幅器である、C16の方法。
[C29]
前記低電圧マルチステージ増幅器は、前記出力ステージの供給電圧を前記出力ステージの出力信号に一致させるよう構成される、C16の方法。
[C30]
前記出力ステージは、±0.45Vの供給電圧で動作する、C16の方法。
[C31]
入力信号を取得する手段と、
前記入力信号を増幅する手段と、ここにおいて、前記入力信号を増幅する前記手段は、
1つまたは複数の前段のステージと、
供給ステージと、
出力ステージ内の第1のトランジスタのしきい値電圧と、前記供給ステージの第2のトランジスタの飽和電圧と、の合計と同じくらい低い供給電圧で動作する前記出力ステージと、ここにおいて前記供給ステージは前記出力ステージを供する、を具備する、デバイス。
[C32]
前記入力信号を増幅する前記手段は、バイアス回路を更に具備し、ここにおいて前記バイアス回路は、前記供給ステージを介して前記出力ステージの適切な動作に関する静止電流を設定する、C31のデバイス。
[C33]
前記バイアス回路は、
複製した電流ステージと、
最少セレクタと、
ミラー増幅器とを具備するC32のデバイス。
[C34]
前記デバイスは、出力ステージの供給電圧を、前記出力ステージの出力信号に一致させるよう構成される、C31のデバイス。
[C35]
前記出力ステージは±0.45Vの供給電圧で動作する、C31のデバイス。
[C36]
入力信号の増幅することに関して構成されたコンピュータプログラム製品であって、前記コンピュータプログラム製品は、それに命令を有する非一時的なコンピュータ可読媒体を具備し、
前記命令は、
低電圧マルチステージ増幅器に入力信号を取得するためのコードと、
前記低電圧マルチステージ増幅器に前記入力信号を増幅させるコードと、
ここにおいて前記低電圧マルチステージ増幅器は、1つまたは複数の前段のステージと、
供給ステージと、
出力ステージにおける第1のトランジスタのしきい値電圧と、前記供給ステージの第2のトランジスタの飽和電圧と、の合計と同じくらい低い供給電圧で動作する前記出力ステージと、ここにおいて前記供給ステージは前記出力ステージを供する、を具備するコンピュータプログラム製品。
[C37]
前記低電圧マルチステージ増幅器は、バイアス回路を更に具備し、ここにおいて前記バイアス回路は、前記供給ステージを介して前記出力ステージの適切な動作に関して静止電流を設定する、C36のコンピュータプログラム製品。
[C38]
前記バイアス回路は、
複製した電流ステージと、
最少セレクタと、
エラー増幅器と
を具備するC37のコンピュータプログラム製品。
[C39]
前記低電圧マルチステージ増幅器は、出力ステージの供給電圧を、前記出力ステージの出力信号に一致させるよう構成された、C36のコンピュータプログラム製品。
[C40]
前記出力ステージは、±0.45Vの供給電圧で動作する、C36のコンピュータプログラム製品。
Claims (36)
- 入力信号を受信する第1のステージと、
前記第1のステージの出力に結合された第2のステージと、
前記第2のステージの出力に結合された供給ステージと、
出力信号を出力する出力ステージと、ここにおいて、前記出力ステージは、第1のトランジスタ347と第2のトランジスタ346を具備し、前記第1のトランジスタ347のドレインは、前記第2のトランジスタ346のドレインに結合され、前記出力信号を出力し、ここにおいて、前記供給ステージは、前記出力ステージの静止電流を生成し、前記第2のステージの出力は、前記出力ステージに結合される、
前記供給ステージの入力に結合され、前記供給ステージを介して前記出力ステージの適切な動作のための静止電流を設定するバイアス回路と、ここにおいて、前記バイアス回路は、複製した電流ステージと、最少セレクタと、エラー増幅器とを具備し、ここにおいて、前記複製した電流ステージは、第1のトランジスタ455a、第2のトランジスタ455b、第3のトランジスタ457、第4のトランジスタ454、及び第5のトランジスタ453を具備し、前記第1のトランジスタ455aのゲートと前記第2のトランジスタ455bのゲートは、前記第1のトランジスタ455aのドレイン及び前記第4のトランジスタ454のドレインに結合され、前記第1のトランジスタ455aのソースと前記第2のトランジスタ455bのソースは、互いに正の供給電圧に結合され、前記第4のトランジスタ454のソースは、前記第5のトランジスタ453のドレインに結合され、前記第3のトランジスタ457のサイズは、前記出力ステージの前記第1のトランジスタ347のサイズと関連し得、前記第5のトランジスタ453のサイズは、前記出力ステージの前記第2のトランジスタ346のサイズと関連し得、前記第5のトランジスタ453のソースと前記第2のトランジスタ455bのドレインと前記第3のトランジスタ457のドレインは、互いに可変の負の供給電圧に結合され、ここにおいて、前記第2のトランジスタ455bの前記ドレインは、抵抗456aを介して前記可変の負の供給電圧に結合され、前記第3のトランジスタ457の前記ドレインは、抵抗456bを介して前記可変の負の供給電圧に結合され、前記複製した電流ステージは、前記最少セレクタに前記複製した電流ステージの前記第2のトランジスタ455bのドレイン電圧である第1のバイアス電圧と、前記複製した電流ステージの前記第3のトランジスタ457のドレイン電圧である第2のバイアス電圧とを供給し、前記最少セレクタは、前記第1のバイアス電圧と前記第2のバイアス電圧とを比較することに基づいて、前記エラー増幅器に所定の電圧を供給し、ここにおいて、前記エラー増幅器は、前記供給ステージを制御し、ここにおいて、前記複製した電流ステージの前記第3のトランジスタ457のゲート電圧は、前記出力ステージの前記第1のトランジスタ347のゲート電圧になり得、前記複製した電流ステージの前記第5のトランジスタ453のゲート電圧は、前記出力ステージの前記第2のトランジスタ346のゲート電圧になり得る、
を具備する、低電圧マルチステージ増幅器。 - 前記供給ステージは、前記低電圧マルチステージ増幅器に関する必要な減衰を供給する減衰ステージとしても動作する、請求項1の低電圧マルチステージ増幅器。
- 前記所定の電圧は、前記第1のバイアス電圧と前記第2のバイアス電圧とが互いの最少セレクタトランジスタの飽和電圧内である場合、前記第1のバイアス電圧と前記第2のバイアス電圧との平均であり、前記所定の電圧は、前記第1のバイアス電圧と前記第2のバイアス電圧とが、互いの前記最少セレクタトランジスタの飽和電圧内でない場合、前記第1のバイアス電圧と前記第2のバイアス電圧のうち小さい方であり、前記最少セレクタトランジスタの飽和電圧は、前記最少セレクタ中で使用されるトランジスタの飽和電圧である、請求項1の低電圧マルチステージ増幅器。
- 前記エラー増幅器は、前記供給ステージに第1の制御電圧と第2の制御電圧とを出力する、請求項1の低電圧マルチステージ増幅器。
- 前記第2のステージ内の電流が再利用されるので、前記供給ステージをサポートするための更なるバイアス電流は、必要とされない、請求項1の低電圧マルチステージ増幅器。
- 前記低電圧マルチステージ増幅器は、クラスGの増幅器である、請求項1の低電圧マルチステージ増幅器。
- 前記低電圧マルチステージ増幅器は、クラスHの増幅器である、請求項1の低電圧マルチステージ増幅器。
- 前記低電圧マルチステージ増幅器は、前記出力ステージの出力信号に前記出力ステージの供給電圧を一致させるよう構成される、請求項1の低電圧マルチステージ増幅器。
- 前記出力ステージは、±0.45Vの供給電圧で動作する、請求項1の低電圧マルチステージ増幅器。
- 前記出力ステージは、nチャネル型トランジスタとpチャネル型トランジスタとを備える、請求項1の低電圧マルチステージ増幅器。
- 前記nチャネル型トランジスタは、第1の電圧に結合され、前記pチャネル型トランジスタは、第2の電圧に結合される、請求項10の低電圧マルチステージ増幅器。
- 第1の電圧および前記第2の電圧は、前記バイアス回路によって前記出力ステージに供給される、請求項11の低電圧マルチステージ増幅器。
- 前記出力ステージは、前記第1のトランジスタ347を備え、前記供給ステージは、第2のトランジスタ344を備える、請求項1の低電圧マルチステージ増幅器。
- 前記出力ステージは、前記出力ステージにおける前記第1のトランジスタ347のしきい値電圧と、前記供給ステージの前記第2のトランジスタ344の飽和電圧と、の合計と同じくらい低い供給電圧で動作する、請求項13の低電圧マルチステージ増幅器。
- 前記第1のトランジスタ347は、pチャネル型トランジスタであり、ここにおいて、前記第2のトランジスタ344は、nチャネル型トランジスタである、請求項13の低電圧マルチステージ増幅器。
- 前記第1のトランジスタ347のソースは、可変の正の供給電圧に結合され、ここにおいて、前記第1のトランジスタ347のゲートは、前記第2のトランジスタ344のドレインに結合され、ここにおいて、前記第2のトランジスタ344のソースは、可変の負の供給電圧に結合される、請求項15の低電圧マルチステージ増幅器。
- 増幅に関する方法であって、前記方法は、
入力信号を取得することと、
入力信号を受信する第1のステージと、
前記第1のステージの出力に結合された第2のステージと、
前記第2のステージの出力に結合された供給ステージと、
出力信号を出力する出力ステージと、ここにおいて、前記出力ステージは、第1のトランジスタ347と第2のトランジスタ346を具備し、前記第1のトランジスタ347のドレインは、前記第2のトランジスタ346のドレインに結合され、前記出力信号を出力し、ここにおいて、前記供給ステージは、前記出力ステージの静止電流を生成し、前記第2のステージの出力は、前記出力ステージに結合される、
前記供給ステージの入力に結合され、前記供給ステージを介して前記出力ステージの適切な動作のための静止電流を設定するバイアス回路と、ここにおいて、前記バイアス回路は、複製した電流ステージと、最少セレクタと、エラー増幅器とを具備し、ここにおいて、前記複製した電流ステージは、第1のトランジスタ455a、第2のトランジスタ455b、第3のトランジスタ457、第4のトランジスタ454、及び第5のトランジスタ453を具備し、前記第1のトランジスタ455aのゲートと前記第2のトランジスタ455bのゲートは、前記第1のトランジスタ455aのドレイン及び前記第4のトランジスタ454のドレインに結合され、前記第1のトランジスタ455aのソースと前記第2のトランジスタ455bのソースは、互いに正の供給電圧に結合され、前記第4のトランジスタ454のソースは、前記第5のトランジスタ453のドレインに結合され、前記第3のトランジスタ457のサイズは、前記出力ステージの前記第1のトランジスタ347のサイズと関連し得、前記第5のトランジスタ453のサイズは、前記出力ステージの前記第2のトランジスタ346のサイズと関連し得、前記第5のトランジスタ453のソースと前記第2のトランジスタ455bのドレインと前記第3のトランジスタ457のドレインは、互いに可変の負の供給電圧に結合され、ここにおいて、前記第2のトランジスタ455bの前記ドレインは、抵抗456aを介して前記可変の負の供給電圧に結合され、前記第3のトランジスタ457の前記ドレインは、抵抗456bを介して前記可変の負の供給電圧に結合され、前記複製した電流ステージは、前記最少セレクタに前記複製した電流ステージの前記第2のトランジスタ455bのドレイン電圧である第1のバイアス電圧と、前記複製した電流ステージの前記第3のトランジスタ457のドレイン電圧である第2のバイアス電圧とを供給し、前記最少セレクタは、前記第1のバイアス電圧と前記第2のバイアス電圧とを比較することに基づいて、前記エラー増幅器に所定の電圧を供給し、ここにおいて、前記エラー増幅器は、前記供給ステージを制御し、ここにおいて、前記複製した電流ステージの前記第3のトランジスタ457のゲート電圧は、前記出力ステージの前記第1のトランジスタ347のゲート電圧になり得、前記複製した電流ステージの前記第5のトランジスタ453のゲート電圧は、前記出力ステージの前記第2のトランジスタ346のゲート電圧になり得る、
を具備する、低電圧マルチステージ増幅器を用いて前記入力信号を増幅することと、
を具備する、方法。 - 前記供給ステージは、前記低電圧マルチステージ増幅器に関する必要な減衰を供給する減衰ステージとしても動作する、請求項17の方法。
- 前記所定の電圧は、前記第1のバイアス電圧と前記第2のバイアス電圧が、互いの最少セレクタトランジスタの飽和電圧内である場合、前記第1のバイアス電圧と前記第2のバイアス電圧との平均であり、前記所定の電圧は、前記第1のバイアス電圧と前記第2のバイアス電圧とが、互いの前記最少セレクタトランジスタの飽和電圧内でない場合、前記第1のバイアス電圧と前記第2のバイアス電圧のうちより小さい方であり、前記最少セレクタトランジスタの飽和電圧は、前記最少セレクタ中で使用されるトランジスタの飽和電圧である、請求項17の方法。
- 前記エラー増幅器は、第1の制御電圧及び第2の制御電圧を前記供給ステージに出力する、請求項17の方法。
- 前記出力ステージは、第1のトランジスタ347を備え、前記供給ステージは、第2のトランジスタ344を備え、ここにおいて、前記第1のトランジスタ347は、pチャネル型トランジスタであり、ここにおいて、前記第2のトランジスタ344は、nチャネル型トランジスタである、請求項17の方法。
- 前記第1のトランジスタ347のソースは、可変の正の供給電圧に結合され、ここにおいて、前記第1のトランジスタ347のゲートは、前記第2のトランジスタ344のドレインに結合され、ここにおいて、前記第2のトランジスタ344のソースは可変の負の供給電圧に結合される、請求項21の方法。
- 前記第2のステージ内の電流が再利用されるので、前記供給ステージをサポートするための更なるバイアス電流は、必要とされない、請求項17の方法。
- 前記低電圧マルチステージ増幅器は、クラスGの増幅器である、請求項17の方法。
- 前記低電圧マルチステージ増幅器は、クラスHの増幅器である、請求項17の方法。
- 前記低電圧マルチステージ増幅器は、前記出力ステージの供給電圧を前記出力ステージの出力信号に一致させるよう構成される、請求項17の方法。
- 前記出力ステージは、±0.45Vの供給電圧で動作する、請求項17の方法。
- 前記出力ステージは、nチャネル型トランジスタとpチャネル型トランジスタとを備える、請求項17の方法。
- 前記nチャネル型トランジスタに第1の電圧を供給することと、前記pチャネル型トランジスタに第2の電圧を供給することとをさらに備える、請求項28の方法。
- 入力信号を取得する手段と、
前記入力信号を増幅する手段と、
を具備し、ここにおいて、前記入力信号を増幅する前記手段は、
入力信号を受信する第1のステージと、
前記第1のステージの出力に結合された第2のステージと、
前記第2のステージの出力に結合された供給ステージと、
出力信号を出力する出力ステージと、ここにおいて、前記出力ステージは、第1のトランジスタ347と第2のトランジスタ346を具備し、前記第1のトランジスタ347のドレインは、前記第2のトランジスタ346のドレインに結合され、前記出力信号を出力し、ここにおいて、前記供給ステージは、前記出力ステージの静止電流を生成し、前記第2のステージの出力は、前記出力ステージに結合される、
前記供給ステージの入力に結合され、前記供給ステージを介して前記出力ステージの適切な動作のための静止電流を設定するバイアス回路と、ここにおいて、前記バイアス回路は、複製した電流ステージと、最少セレクタと、エラー増幅器とを具備し、ここにおいて、前記複製した電流ステージは、第1のトランジスタ455a、第2のトランジスタ455b、第3のトランジスタ457、第4のトランジスタ454、及び第5のトランジスタ453を具備し、前記第1のトランジスタ455aのゲートと前記第2のトランジスタ455bのゲートは、前記第1のトランジスタ455aのドレイン及び前記第4のトランジスタ454のドレインに結合され、前記第1のトランジスタ455aのソースと前記第2のトランジスタ455bのソースは、互いに正の供給電圧に結合され、前記第4のトランジスタ454のソースは、前記第5のトランジスタ453のドレインに結合され、前記第3のトランジスタ457のサイズは、前記出力ステージの前記第1のトランジスタ347のサイズと関連し得、前記第5のトランジスタ453のサイズは、前記出力ステージの前記第2のトランジスタ346のサイズと関連し得、前記第5のトランジスタ453のソースと前記第2のトランジスタ455bのドレインと前記第3のトランジスタ457のドレインは、互いに可変の負の供給電圧に結合され、ここにおいて、前記第2のトランジスタ455bの前記ドレインは、抵抗456aを介して前記可変の負の供給電圧に結合され、前記第3のトランジスタ457の前記ドレインは、抵抗456bを介して前記可変の負の供給電圧に結合され、前記複製した電流ステージは、前記最少セレクタに前記複製した電流ステージの前記第2のトランジスタ455bのドレイン電圧である第1のバイアス電圧と、前記複製した電流ステージの前記第3のトランジスタ457のドレイン電圧である第2のバイアス電圧とを供給し、前記最少セレクタは、前記第1のバイアス電圧と前記第2のバイアス電圧とを比較することに基づいて、前記エラー増幅器に所定の電圧を供給し、ここにおいて、前記エラー増幅器は、前記供給ステージを制御し、ここにおいて、前記複製した電流ステージの前記第3のトランジスタ457のゲート電圧は、前記出力ステージの前記第1のトランジスタ347のゲート電圧になり得、前記複製した電流ステージの前記第5のトランジスタ453のゲート電圧は、前記出力ステージの前記第2のトランジスタ346のゲート電圧になり得る、
を具備する、装置。 - 前記装置は、出力ステージの供給電圧を、前記出力ステージの出力信号に一致させるよう構成される、請求項30の装置。
- 前記出力ステージは±0.45Vの供給電圧で動作する、請求項30の装置。
- 前記出力ステージは、nチャネル型トランジスタとpチャネル型トランジスタとを備える、請求項30の装置。
- 入力信号の増幅することに関して構成された、命令を有するコンピュータ可読記憶媒体あって、前記命令は、
低電圧マルチステージ増幅器に入力信号を取得させるためのコードと、
前記低電圧マルチステージ増幅器に前記入力信号を増幅させるためのコードと、
を具備し、ここにおいて、前記低電圧マルチステージ増幅器は、
入力信号を受信する第1のステージと、
前記第1のステージの出力に結合された第2のステージと、
前記第2のステージの出力に結合された供給ステージと、
出力信号を出力する出力ステージと、ここにおいて、前記出力ステージは、第1のトランジスタ347と第2のトランジスタ346を具備し、前記第1のトランジスタ347のドレインは、前記第2のトランジスタ346のドレインに結合され、前記出力信号を出力し、ここにおいて、前記供給ステージは、前記出力ステージの静止電流を生成し、前記第2のステージの出力は、前記出力ステージに結合される、
前記供給ステージの入力に結合され、前記供給ステージを介して前記出力ステージの適切な動作のための静止電流を設定するバイアス回路と、ここにおいて、前記バイアス回路は、複製した電流ステージと、最少セレクタと、エラー増幅器とを具備し、ここにおいて、前記複製した電流ステージは、第1のトランジスタ455a、第2のトランジスタ455b、第3のトランジスタ457、第4のトランジスタ454、及び第5のトランジスタ453を具備し、前記第1のトランジスタ455aのゲートと前記第2のトランジスタ455bのゲートは、前記第1のトランジスタ455aのドレイン及び前記第4のトランジスタ454のドレインに結合され、前記第1のトランジスタ455aのソースと前記第2のトランジスタ455bのソースは、互いに正の供給電圧に結合され、前記第4のトランジスタ454のソースは、前記第5のトランジスタ453のドレインに結合され、前記第3のトランジスタ457のサイズは、前記出力ステージの前記第1のトランジスタ347のサイズと関連し得、前記第5のトランジスタ453のサイズは、前記出力ステージの前記第2のトランジスタ346のサイズと関連し得、前記第5のトランジスタ453のソースと前記第2のトランジスタ455bのドレインと前記第3のトランジスタ457のドレインは、互いに可変の負の供給電圧に結合され、ここにおいて、前記第2のトランジスタ455bの前記ドレインは、抵抗456aを介して前記可変の負の供給電圧に結合され、前記第3のトランジスタ457の前記ドレインは、抵抗456bを介して前記可変の負の供給電圧に結合され、前記複製した電流ステージは、前記最少セレクタに前記複製した電流ステージの前記第2のトランジスタ455bのドレイン電圧である第1のバイアス電圧と、前記複製した電流ステージの前記第3のトランジスタ457のドレイン電圧である第2のバイアス電圧とを供給し、前記最少セレクタは、前記第1のバイアス電圧と前記第2のバイアス電圧とを比較することに基づいて、前記エラー増幅器に所定の電圧を供給し、ここにおいて、前記エラー増幅器は、前記供給ステージを制御し、ここにおいて、前記複製した電流ステージの前記第3のトランジスタ457のゲート電圧は、前記出力ステージの前記第1のトランジスタ347のゲート電圧になり得、前記複製した電流ステージの前記第5のトランジスタ453のゲート電圧は、前記出力ステージの前記第2のトランジスタ346のゲート電圧になり得る、
を具備するコンピュータ可読記憶媒体。 - 前記低電圧マルチステージ増幅器は、前記出力ステージの供給電圧を、前記出力ステージの出力信号に一致させるよう構成された、請求項34のコンピュータ可読記憶媒体。
- 前記出力ステージは、±0.45Vの供給電圧で動作する、請求項34のコンピュータ可読記憶媒体。
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