JP6539372B2 - 液晶表示装置 - Google Patents
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Description
第1及び第2スイッチング素子と、第1方向に延出し前記第1及び第2スイッチング素子と電気的に接続されるゲート配線と、前記第1方向と交差する第2方向に延出し前記第1スイッチング素子と電気的に接続される第1ソース配線と、前記第2方向に延出し前記第1ソース配線と前記第1方向に間隔をあけて配置され前記第2スイッチング素子と電気的に接続される第2ソース配線と、前記第1スイッチング素子と電気的に接続された第1コンタクト部及び前記第1コンタクト部から前記第2方向に延出した第1長さの第1帯状電極を有する第1画素電極と、前記第2スイッチング素子と電気的に接続された第2コンタクト部及び前記第2コンタクト部から前記第2方向に延出し前記第1長さと異なる第2長さの第2帯状電極を有する第2画素電極と、を備えた第1基板と、前記第1基板と対向する第2基板と、を備え、前記ゲート配線は、前記第2画素電極に対応する位置において、前記第2帯状電極から離れる側に屈曲している屈曲部を有し、前記第2ソース配線は、前記第1コンタクト部と前記第2コンタクト部との間に位置し、前記第1コンタクト部及び前記第2コンタクト部は、平面視において、前記第2方向にずれて配置されている、表示装置が提供される。
本実施形態によれば、
第1方向に延出する第1ゲート配線と、前記第1方向に延出し前記第1ゲート配線と前記第1方向と交差する第2方向に間隔をあけて配置される第2ゲート配線と、前記第2方向に延出するソース配線と、前記第1ゲート配線及び前記ソース配線に電気的に接続する第1スイッチング素子と、前記第2ゲート配線及び前記ソース配線に電気的に接続する第2スイッチング素子と、前記第1スイッチング素子に電気的に接続された第1コンタクト部及び前記第1コンタクト部から前記第2方向に延出した第1長さの第1帯状電極を有する第1画素電極と、前記第2スイッチング素子と電気的に接続された第2コンタクト部及び前記第2コンタクト部から前記第2方向に延出し前記第1長さと異なる第2長さの第2帯状電極を有する第2画素電極と、を備えた第1基板と、前記第1基板と対向する第2基板と、を備え、前記第1ゲート配線は、前記第1画素電極と前記第2画素電極との間に配置され、前記第2画素電極に向かって屈曲している屈曲部を有し、前記第1長さは、前記第2長さよりも長い、表示装置が提供される。
画素電極PE1乃至PE3は、それぞれ第1延出方向D1に延出した画素形状に対応した島状に形成されている。画素電極PE1は、スイッチング素子SW1と電気的に接続されたコンタクト部CT1及びコンタクト部CT1から延出した少なくとも一本の帯状電極PA1を有している。画素電極PE2は、スイッチング素子SW2と電気的に接続されたコンタクト部CT2及びコンタクト部CT2から延出した少なくとも一本の帯状電極PA2を有している。画素電極PE3は、スイッチング素子SW3と電気的に接続されたコンタクト部CT3及びコンタクト部CT3から延出した少なくとも一本の帯状電極PA3を有している。
画素電極PEと共通電極CEとの間に電位差を形成するような電圧が印加されていないオフ時には、液晶層LQに電圧が印加されない。つまり、画素電極PEと共通電極CEとの間に電界が形成されていない。このため、液晶層LQに含まれる液晶分子LMは、図2に実線で示したように、第1配向膜AL1及び第2配向膜AL2の配向規制力によりX−Y平面内において第2方向Yに初期配向している。つまり、液晶分子LMの初期配向方向は第2方向Yに平行である。オフ時には、バックライトBLからのバックライト光の一部は、第1偏光板PL1を透過し、液晶表示パネルLPNに入射する。液晶表示パネルLPNに入射した光は、例えば第1偏光板PL1の第1吸収軸と直交する直線偏光である。このような直線偏光の偏光状態は、OFF時の液晶表示パネルLPNを通過した際にほとんど変化しない。このため、液晶表示パネルLPNを透過した直線偏光のほとんどが、第2偏光板PL2によって吸収される(黒表示)。
上記の通り、2行×3列の6個の色画素で単位画素UPを構成した場合、これらの6個の色画素は、赤色画素、緑色画素、青色画素、及び、白色画素のいずれかに割り当てられている。例えば、赤色画素としては同列の2個の色画素が割り当てられ、緑色画素としては同列の2個の色画素が割り当てられている。また、青色画素及び白色画素としては、同列の色画素がそれぞれ割り当てられている。
図6は、図1に示したアレイ基板ARにおける画素の第2構成例を対向基板の側から見た概略平面図である。
G…ゲート配線 S…ソース配線 SW…スイッチング素子
PE…画素電極 PA、PB…帯状電極 CE…共通電極 CF…カラーフィルタ
Claims (13)
- 第1及び第2スイッチング素子と、第1方向に延出し前記第1及び第2スイッチング素子と電気的に接続されるゲート配線と、前記第1方向と交差する第2方向に延出し前記第1スイッチング素子と電気的に接続される第1ソース配線と、前記第2方向に延出し前記第1ソース配線と前記第1方向に間隔をあけて配置され前記第2スイッチング素子と電気的に接続される第2ソース配線と、前記第1スイッチング素子と電気的に接続された第1コンタクト部及び前記第1コンタクト部から前記第2方向に延出した第1長さの第1帯状電極を有する第1画素電極と、前記第2スイッチング素子と電気的に接続された第2コンタクト部及び前記第2コンタクト部から前記第2方向に延出し前記第1長さと異なる第2長さの第2帯状電極を有する第2画素電極と、を備えた第1基板と、
前記第1基板と対向する第2基板と、
前記第1基板と前記第2基板との間に保持された液晶層と、を備え、
前記ゲート配線は、前記第2画素電極に対応する位置において、前記第2帯状電極から離れる側に屈曲している屈曲部を有し、
前記第2ソース配線は、前記第1コンタクト部と前記第2コンタクト部との間に位置し、
前記第1コンタクト部及び前記第2コンタクト部は、平面視において、前記第2方向にずれて配置されている、表示装置。 - 前記第2長さは前記第1長さよりも長い、請求項1に記載の表示装置。
- 前記第2帯状電極の本数は前記第1帯状電極の本数よりも多い、請求項1又は2に記載の表示装置。
- 前記第1基板は、さらに、第3スイッチング素子と、前記第3スイッチング素子と電気的に接続された第3コンタクト部及び前記第3コンタクト部から延出し前記第1及び第2長さとは異なる第3長さの第3帯状電極を有する第3画素電極と、を備えた、請求項1乃至3のいずれか1項に記載の表示装置。
- 前記第3画素電極は、前記第2画素電極と前記第2方向に並んで配置されており、
前記ゲート配線は、前記第2画素電極と前記第3画素電極との間に位置している、請求項4に記載の表示装置。 - 前記第3長さは、前記第1及び前記第2長さよりも短い、請求項4に記載の表示装置。
- 前記屈曲部は、前記第2画素電極に対応する位置において、前記第3画素電極側に屈曲している、請求項4に記載の表示装置。
- 第1方向に延出する第1ゲート配線と、前記第1方向に延出し前記第1ゲート配線と前記第1方向と交差する第2方向に間隔をあけて配置される第2ゲート配線と、前記第2方向に延出するソース配線と、前記第1ゲート配線及び前記ソース配線に電気的に接続する第1スイッチング素子と、前記第2ゲート配線及び前記ソース配線に電気的に接続する第2スイッチング素子と、前記第1スイッチング素子に電気的に接続された第1コンタクト部及び前記第1コンタクト部から前記第2方向に延出した第1長さの第1帯状電極を有する第1画素電極と、前記第2スイッチング素子と電気的に接続された第2コンタクト部及び前記第2コンタクト部から前記第2方向に延出し前記第1長さと異なる第2長さの第2帯状電極を有する第2画素電極と、を備えた第1基板と、
前記第1基板と対向する第2基板と、
前記第1基板と前記第2基板との間に保持された液晶層と、を備え、
前記第1ゲート配線は、前記第1画素電極と前記第2画素電極との間に配置され、前記第2画素電極に向かって屈曲している屈曲部を有し、
前記第1長さは、前記第2長さよりも長い、表示装置。 - 前記第1基板は、さらに、前記第1ゲート配線に電気的に接続された第3スイッチング素子と、前記第3スイッチング素子と電気的に接続された第3コンタクト部及び前記第3コンタクト部から延出し前記第1及び第2長さとは異なる第3長さの第3帯状電極を有する第3画素電極と、を備えた、請求項8に記載の表示装置。
- 前記第3画素電極は、前記第1画素電極と前記第1方向に並んで配置され、
前記第1コンタクト部と前記第3コンタクト部は、平面視において、前記第2方向にずれて配置されている、請求項9に記載の表示装置。 - 前記第3長さは、前記第1長さよりも短く、前記第2長さよりも長い、請求項9に記載の表示装置。
- 前記第1スイッチング素子、前記第2スイッチング素子、及び、前記第3スイッチング素子は、同一構造を有している、請求項4に記載の表示装置。
- 前記第1スイッチング素子、前記第2スイッチング素子、及び、前記第3スイッチング素子は、同一構造を有している、請求項9に記載の表示装置。
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