JP6529081B2 - Harmonic compensator - Google Patents
Harmonic compensator Download PDFInfo
- Publication number
- JP6529081B2 JP6529081B2 JP2016037248A JP2016037248A JP6529081B2 JP 6529081 B2 JP6529081 B2 JP 6529081B2 JP 2016037248 A JP2016037248 A JP 2016037248A JP 2016037248 A JP2016037248 A JP 2016037248A JP 6529081 B2 JP6529081 B2 JP 6529081B2
- Authority
- JP
- Japan
- Prior art keywords
- axis output
- output value
- value
- axis
- unit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 238000006243 chemical reaction Methods 0.000 claims description 50
- 238000013459 approach Methods 0.000 claims description 18
- 230000010354 integration Effects 0.000 claims description 15
- 238000010586 diagram Methods 0.000 description 3
- 230000004043 responsiveness Effects 0.000 description 1
- 230000009466 transformation Effects 0.000 description 1
Images
Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02E—REDUCTION OF GREENHOUSE GAS [GHG] EMISSIONS, RELATED TO ENERGY GENERATION, TRANSMISSION OR DISTRIBUTION
- Y02E40/00—Technologies for an efficient electrical power generation, transmission or distribution
- Y02E40/40—Arrangements for reducing harmonics
Landscapes
- Supply And Distribution Of Alternating Current (AREA)
- Control Of Electrical Variables (AREA)
- Power Conversion In General (AREA)
Description
本発明は、高調波補償装置に関する。 The present invention relates to a harmonic compensator.
高調波補償装置としては、例えば、特許文献1に記載のものが知られている。特許文献1に記載の高調波補償装置は、フーリエ変換により交流信号(負荷電流)の高調波を求め、インバータに上記高調波を打ち消す電流を出力させるようにインバータの出力電流を制御することができる。
As a harmonic compensation device, for example, one described in
しかしながら、従来の高調波補償装置は、フーリエ変換により高調波を求めるので、必要な計算資源が増えるといった問題があった。また、瞬時的に高調波を補償する装置においては、高い応答性が必要なため、制御遅れの許容範囲に対する要求が高く(制御遅れの許容範囲が狭く)、システム設計が困難になるという問題があった。 However, since the conventional harmonic compensation device obtains harmonics by Fourier transform, there is a problem that the required computational resources increase. In addition, in a device that compensates harmonics instantaneously, high responsiveness is required, so the demand for the control delay tolerance is high (the control delay tolerance is narrow), making system design difficult. there were.
本発明は上記事情に鑑みてなされたものであって、その課題とするところは、比較的簡易な構成で制御遅れの許容範囲が広い高調波補償装置を提供することにある。 The present invention has been made in view of the above circumstances, and an object of the present invention is to provide a harmonic compensation device having a relatively simple configuration and a wide allowable range of control delay.
上記課題を解決するために、本発明に係る高調波補償装置は、
d軸出力指令値およびq軸出力指令値に応じた交流出力信号を出力する出力装置を制御し、負荷に入力される交流信号のn次高調波およびn+2次高調波(nは1以上の整数)を補償する高調波補償装置であって、
前記交流信号に対してdq変換を行いd軸出力値d0およびq軸出力値q0を出力する第1dq変換部と、
前記d軸出力値d0および前記q軸出力値q0の直流成分を除去したd軸出力値dおよびq軸出力値qを出力するハイパスフィルタと、
前記d軸出力値dに対してdq変換を行い、d軸出力値ddおよびq軸出力値dqを出力するとともに、前記q軸出力値qに対してdq変換を行い、d軸出力値qdおよびq軸出力値qqを出力する第2dq変換部と、
前記d軸出力値ddおよび前記q軸出力値dqがゼロに近づくように、前記d軸出力値ddおよび前記q軸出力値dqに基づいて生成したn+1逓倍位相の第1交流信号を前記d軸出力指令値に重畳するとともに、前記d軸出力値qdおよび前記q軸出力値qqがゼロに近づくように、前記d軸出力値qdおよび前記q軸出力値qqに基づいて生成したn+1逓倍位相の第2交流信号を前記q軸出力指令値に重畳するフィードバック制御部と、を備えたことを特徴とする。
In order to solve the above-mentioned subject, the harmonic compensation device concerning the present invention is:
An output device that outputs an AC output signal according to the d-axis output command value and the q-axis output command value is controlled, and the n-th harmonic and n + 2-th harmonic of the AC signal input to the load (n is an integer greater than or equal to 1 A harmonic compensation device that compensates
A first dq conversion unit that performs dq conversion on the AC signal and outputs d-axis output value d 0 and q-axis output value q 0 ;
A high-pass filter that outputs a d-axis output value d and a q-axis output value q obtained by removing direct-current components of the d-axis output value d 0 and the q-axis output value q 0 ;
The d-axis output value d is subjected to dq conversion to output the d-axis output value dd and the q-axis output value dq, and the d-axis output value q is subjected to the dq conversion to obtain the d-axis output value qd and a second dq conversion unit that outputs a q-axis output value qq;
The first alternating current signal of n + 1 multiplication phase generated based on the d-axis output value dd and the q-axis output value dq such that the d-axis output value dd and the q-axis output value dq approach zero, the d-axis Of an n + 1 multiplication phase generated based on the d-axis output value qd and the q-axis output value qq so as to be superimposed on the output command value so that the d-axis output value qd and the q-axis output value qq approach zero. And a feedback control unit that superposes a second alternating current signal on the q-axis output command value.
この構成によれば、2回のdq変換により高調波を求めているので、フーリエ変換により高調波を求める従来の構成と比較して必要な計算資源が少なくなる。さらに、この構成によれば、d軸出力値dd、qdおよびq軸出力値dq、qqがゼロに近づくようにフィードバック制御を行っているので、従来の構成と比較して制御遅れの許容範囲が広くなる。 According to this configuration, since the harmonics are obtained by the two dq conversions, the required computational resources are reduced compared to the conventional configuration for obtaining the harmonics by Fourier transform. Furthermore, according to this configuration, feedback control is performed so that the d-axis output values dd and qd and the q-axis output values dq and qq approach zero, so the allowable range of control delay is smaller than that of the conventional configuration. Become wider.
上記高調波補償装置では、
前記フィードバック制御部は、
前記d軸出力値ddおよび前記q軸出力値dqの極性を反転させる第1反転部と、
前記d軸出力値ddおよび前記q軸出力値dqがゼロに近づくように、前記d軸出力値ddおよび前記q軸出力値dqに対して積分制御を行う第1積分制御部と、
前記第1積分制御部の出力信号を前記n+1逓倍位相の交流信号に変換する第1変換部と、
前記第1変換部の出力信号に基づいて前記第1交流信号を生成し、前記第1交流信号を前記d軸出力指令値に重畳する第1重畳部と、
前記d軸出力値qdおよび前記q軸出力値qqの極性を反転させる第2反転部と、
前記d軸出力値qdおよび前記q軸出力値qqがゼロに近づくように、前記d軸出力値qdおよび前記q軸出力値qqに対して積分制御を行う第2積分制御部と、
前記第2積分制御部の出力信号を前記n+1逓倍位相の交流信号に変換する第2変換部と、
前記第2変換部の出力信号に基づいて前記第2交流信号を生成し、前記第2交流信号を前記q軸出力指令値に重畳する第2重畳部と、を備えた構成にしてもよい。
In the above harmonic compensation device,
The feedback control unit
A first inverting unit that inverts the polarities of the d-axis output value dd and the q-axis output value dq;
A first integral control unit that performs integral control on the d-axis output value dd and the q-axis output value dq such that the d-axis output value dd and the q-axis output value dq approach zero;
A first conversion unit for converting an output signal of the first integration control unit into an alternating current signal of the n + 1 multiplication phase;
A first superimposing unit that generates the first alternating current signal based on the output signal of the first conversion unit, and superimposes the first alternating current signal on the d-axis output command value;
A second inverting unit that inverts the polarities of the d-axis output value qd and the q-axis output value qq;
A second integral control unit that performs integral control on the d-axis output value qd and the q-axis output value qq such that the d-axis output value qd and the q-axis output value qq approach zero;
A second conversion unit that converts the output signal of the second integration control unit into an alternating current signal of the n + 1 multiplied phase;
The second alternating current signal may be generated based on an output signal of the second conversion unit, and a second overlapping unit may be provided to overlap the second alternating current signal on the q-axis output command value.
上記高調波補償装置では、
前記第2dq変換部は、
前記d軸出力値dの位相をπ/2遅延させたd軸出力値d’を生成する第1遅延部と、
前記q軸出力値qの位相をπ/2遅延させたq軸出力値q’を生成する第2遅延部と、
前記d軸出力値dおよび前記d軸出力値d’に基づいて前記d軸出力値ddを生成する第1演算部と、
前記d軸出力値dおよび前記d軸出力値d’に基づいて前記q軸出力値dqを生成する第2演算部と、
前記q軸出力値qおよび前記q軸出力値q’に基づいて前記d軸出力値qdを生成する第3演算部と、
前記q軸出力値qおよび前記q軸出力値q’に基づいて前記q軸出力値qqを生成する第4演算部と、を備えた構成にしてもよい。
In the above harmonic compensation device,
The second dq conversion unit
A first delay unit that generates a d-axis output value d ′ obtained by delaying the phase of the d-axis output value d by π / 2;
A second delay unit that generates a q-axis output value q ′ obtained by delaying the phase of the q-axis output value q by π / 2;
A first operation unit that generates the d-axis output value dd based on the d-axis output value d and the d-axis output value d ′;
A second operation unit that generates the q-axis output value dq based on the d-axis output value d and the d-axis output value d ′;
A third operation unit that generates the d-axis output value qd based on the q-axis output value q and the q-axis output value q ′;
The fourth operation unit may be configured to generate the q-axis output value qq based on the q-axis output value q and the q-axis output value q ′.
本発明によれば、比較的簡易な構成で制御遅れの許容範囲が広い高調波補償装置を提供することができる。 According to the present invention, it is possible to provide a harmonic compensation device having a wide tolerance range of control delay with a relatively simple configuration.
以下、添付図面を参照して、本発明に係る高調波補償装置の実施形態について説明する。 Hereinafter, an embodiment of a harmonic compensation device according to the present invention will be described with reference to the attached drawings.
図1に、本発明の一実施形態に係る高調波補償装置1の使用例を示す。高調波補償装置1は、d軸出力指令値およびq軸出力指令値に応じた交流出力電流(本発明の「交流出力信号」に相当)を出力するインバータ2(本発明の「出力装置」に相当)を制御し、三相交流電源3から高調波発生源となる負荷4に入力される三相交流電流(本発明の「交流信号」に相当)に対して高調波補償を行う。
FIG. 1 shows an example of use of the
具体的には、インバータ2は、高調波補償装置1により変更されたd軸出力指令値およびq軸出力指令値に基づいて、逆位相の高調波電流を出力し、当該高調波電流により三相交流電流に含まれる高調波を打ち消すことで三相交流電流を正弦波に近付ける。なお、以下では、三相交流電流に5次高調波および7次高調波が含まれているものとする。
Specifically, the
図2に、高調波補償装置1のブロック図を示す。高調波補償装置1は、第1dq変換部11と、ハイパスフィルタ12と、第2dq変換部13と、フィードバック制御部14とを備える。
FIG. 2 shows a block diagram of the
第1dq変換部11は、入力された三相交流電流に対してdq変換を行い、d軸出力値d0、q軸出力値q0および位相θnを算出する。算出されたd軸出力値d0およびq軸出力値q0は、ハイパスフィルタ12に、位相θnは第2dq変換部13とフィードバック制御部14に入力される。5次高調波および7次高調波を含む三相交流電流に対してdq変換を行った場合、6次高調波に対応したd軸出力値d0、q軸出力値q0および位相θ6が算出される。
The first
ハイパスフィルタ12は、入力されたd軸出力値d0およびq軸出力値q0の直流成分を除去する。直流成分が除去されたd軸出力値dおよびq軸出力値qは第2dq変換部13に入力される。
The
第2dq変換部13は、入力されたd軸出力値dに対してdq変換を行い、d軸出力値ddおよびq軸出力値dqを出力するとともに、入力されたq軸出力値qに対してもdq変換を行い、d軸出力値qdおよびq軸出力値qqを出力する。
The second
第2dq変換部13は、d軸出力値dおよびq軸出力値qに対してdq変換を行うための、第1遅延部15と、第2遅延部16と、第1〜第4演算部17〜20とを備える。
The second
第1遅延部15は、d軸出力値dの位相をπ/2遅延させたd軸出力値d’を生成する。一方、第2遅延部16は、q軸出力値qの位相をπ/2遅延させたq軸出力値q’を生成する。
The
第1演算部17は、d軸出力値dにcosθ6を乗算した値とd軸出力値d’にsinθ6を乗算した値とを加算してd軸出力値ddを生成する。第2演算部18は、d軸出力値dにsinθ6を乗算した値とd軸出力値d’に{−cosθ6}を乗算した値とを加算してq軸出力値dqを生成する。第3演算部19は、q軸出力値qにcosθ6を乗算した値とq軸出力値q’にsinθ6を乗算した値とを加算してd軸出力値qdを生成する。第4演算部20は、q軸出力値qにsinθ6を乗算した値とq軸出力値q’に{−cosθ6}を乗算した値とを加算してq軸出力値qqを生成する。 The first operation unit 17 adds the value obtained by multiplying the d-axis output value d by cos θ 6 and the value obtained by multiplying the d-axis output value d ′ by sin θ 6 to generate a d-axis output value dd. The second arithmetic unit 18 adds the value obtained by multiplying the {-cos 6} to a value and the d-axis output value d 'obtained by multiplying the sin [theta 6 to the d-axis output value d to generate a q-axis output value dq. The third operation unit 19 adds the value obtained by multiplying the q-axis output value q by cos θ 6 and the value obtained by multiplying the q-axis output value q ′ by sin θ 6 to generate a d-axis output value qd. The fourth arithmetic unit 20 adds the value obtained by multiplying the {-cos 6} in q-axis output value obtained by multiplying the sin [theta 6 to q and q-axis output value q 'generates a q-axis output qq.
すなわち、第2dq変換部13では、下記の演算が行われる。
dd=dcosθ6+d’sinθ6
dq=dsinθ6+d’{−cosθ6}
qd=qcosθ6+q’sinθ6
qq=qsinθ6+q’{−cosθ6}
ここで、θ6は、第1dq変換部11で算出された基本波位相を6逓倍した位相である。
That is, in the second
dd = dcosθ 6 + d'sinθ 6
dq = dsinθ 6 + d '{ - cosθ 6}
qd = q cos θ 6 + q 'sin θ 6
qq = qsinθ 6 + q '{-cosθ 6 }
Here, θ 6 is a phase obtained by multiplying the fundamental wave phase calculated by the first
フィードバック制御部14は、d軸出力値dd、qdおよびq軸出力値dq、qqがゼロに近づくようにフィードバック制御を行い、入力されたd軸出力指令値およびq軸出力指令値を変更してインバータ2に出力する。ここで、フィードバック制御部14に入力されるd軸出力指令値およびq軸出力指令値はオペレータが任意に設定することができる。本実施形態では、インバータ2に逆位相の高調波電流のみを出力させるので、d軸出力指令値は有効電流の指令値に相当し、q軸出力指令値は無効電流の指令値に相当し、両者はともにゼロに設定される。
The
図3に示すように、フィードバック制御部14は、第1反転部21と、第1積分制御部22と、第1変換部23と、第1重畳部24と、第2反転部25と、第2積分制御部26と、第2変換部27と、第2重畳部28とを備える。
As shown in FIG. 3, the
第1反転部21は、d軸出力値ddおよびq軸出力値dqに−1を乗算して、d軸出力値ddおよびq軸出力値dqの極性を反転させる。第1積分制御部22は、d軸出力値ddおよびq軸出力値dqがゼロに近づくように、より詳しくは、極性を反転させたd軸出力値ddおよびq軸出力値dqがゼロに近づくように、積分制御(I制御)を行う。
The
第1変換部23は、第1積分制御部22の出力信号をn+1逓倍位相(本実施形態では、6逓倍位相)の交流信号に変換する。具体的には、第1変換部23は、第1積分制御部22の出力信号のうちd軸出力値ddをI制御したものに対してcosθ6を乗算する一方、q軸出力値dqをI制御したものに対してsinθ6を乗算する。なお、θ6は、第1dq変換部11で算出された基本波位相を6逓倍した位相である。
The
第1重畳部24は、第1変換部23の出力信号を加算したもの(本発明の「第1交流信号」に相当)をd軸出力指令値に加算して出力する。これにより、第1重畳部24からは、d軸出力指令値に逆位相の6次高調波電流に関する指令値を重畳したものが出力される。本実施形態では、第1重畳部24に入力されるd軸出力指令値はゼロであるから、インバータ2には、逆位相の6次高調波電流に関する指令値のみがd軸出力指令値として入力される。
The
第2反転部25は、d軸出力値qdおよびq軸出力値qqに−1を乗算して、d軸出力値qdおよびq軸出力値qqの極性を反転させる。第2積分制御部26は、d軸出力値qdおよびq軸出力値qqがゼロに近づくように、より詳しくは、極性を反転させたd軸出力値qdおよびq軸出力値qqがゼロに近づくように、積分制御(I制御)を行う。
The
第2変換部27は、第2積分制御部26の出力信号をn+1逓倍位相(本実施形態では、6逓倍位相)の交流信号に変換する。具体的には、第2変換部27は、第2積分制御部26の出力信号のうちd軸出力値qdをI制御したものに対してcosθ6を乗算する一方、q軸出力値qqをI制御したものに対してsinθ6を乗算する。なお、θ6は、第1dq変換部11で算出された基本波位相を6逓倍した位相である。
The
第2重畳部28は、第2変換部27の出力信号を加算したもの(本発明の「第2交流信号」に相当)をq軸出力指令値に加算して出力する。これにより、第2重畳部28からは、q軸出力指令値に逆位相の6次高調波電流に関する指令値を重畳したものが出力される。本実施形態では、第2重畳部28に入力されるq軸出力指令値はゼロであるから、インバータ2には、逆位相の6次高調波電流に関する指令値のみがq軸出力指令値として入力される。
The second superposition unit 28 adds the output signal of the second conversion unit 27 (corresponding to the “second alternating current signal” of the present invention) to the q-axis output command value and outputs the result. As a result, the second superimposing unit 28 outputs the q-axis output command value obtained by superposing the command value on the sixth harmonic current in the reverse phase. In the present embodiment, since the q-axis output command value input to the second superimposing unit 28 is zero, only the command value related to the sixth harmonic current in reverse phase is input to the
結局、高調波補償装置1は、d軸出力指令値およびq軸出力指令値として逆位相の6次高調波電流に関する指令値をインバータ2に出力して、インバータ2に逆位相の6次高調波電流を出力させることができる。その結果、三相交流電流に含まれる5次高調波および7次高調波を打ち消すことができ、負荷4に入力される三相交流電流を正弦波に近付けることができる。
After all, the
また、高調波補償装置1では、2回のdq変換により6次高調波を求めているので、フーリエ変換により6次高調波を求める従来の構成と比較して必要な計算資源が少なくなる。さらに、高調波補償装置1では、第1積分制御部22および第2積分制御部26で、d軸出力値dd、qdおよびq軸出力値dq、qqがゼロに近づくようにフィードバック制御(本実施形態では、I制御)を行っているので、従来の構成と比較して制御遅れの許容範囲が広くなる。
Further, in the
以上、本発明に係る高調波補償装置の実施形態について説明したが、本発明は上記実施形態に限定されるものではない。 As mentioned above, although the embodiment of the harmonic compensation device concerning the present invention was described, the present invention is not limited to the above-mentioned embodiment.
上記実施形態では、6次高調波により5次高調波および7次高調波を補償しているが、本発明は、n+1次高調波によりn次高調波およびn+2次高調波(nは1以上の整数)を補償することができる。例えば、12次高調波により11次高調波および13次高調波を補償してもよいし、2次高調波により1次高調波(基本波)および3次高調波を補償してもよい。また、2つ以上の高調波を同時に制御して、4つ以上の高調波を同時に補償してもよい。 In the above embodiment, the fifth harmonic and the seventh harmonic are compensated by the sixth harmonic, but the present invention can be applied to the n th harmonic and the n + 2 harmonic (where n is 1 or more) by the n + 1 harmonic. Integer) can be compensated. For example, the eleventh harmonic and the thirteenth harmonic may be compensated by the twelfth harmonic, or the first harmonic (fundamental wave) and the third harmonic may be compensated by the second harmonic. Also, two or more harmonics may be controlled simultaneously to compensate for four or more harmonics simultaneously.
上記実施形態では、補償する交流信号として三相交流電流を例に挙げて説明したが、高調波が含まれる物理量であれば、本発明の交流信号として扱うことができる。d軸出力指令値およびq軸出力指令値は、補償する物理量の指令値となる。 In the above embodiment, a three-phase alternating current has been described as an example of the alternating current signal to be compensated, but any physical quantity that includes harmonics can be treated as the alternating current signal of the present invention. The d-axis output command value and the q-axis output command value are command values of the physical quantity to be compensated.
例えば、図4に示すように、インバータ2を電圧源として発生させた三相交流電圧を不平衡負荷5に供給する場合、三相交流電圧に歪が生じて電圧不平衡が発生する。この場合、高調波補償装置1は、フィードバック制御部14に入力されるd軸出力指令値およびq軸出力指令値に逆位相の2次高調波電圧に関する指令値を加算し、新たに生成したd軸出力指令値およびq軸出力指令値をインバータ2に出力する。これにより、インバータ2は、逆位相の2次高調波電圧を重畳した三相交流電圧を出力することになり、電圧不平衡は解消される。
For example, as shown in FIG. 4, when the three-phase AC voltage generated by using the
第2dq変換部13は、d軸出力値dに対してdq変換を行いd軸出力値ddおよびq軸出力値dqを出力するとともに、q軸出力値qに対してdq変換を行いd軸出力値qdおよびq軸出力値qqを出力するのであれば、その構成を適宜変更することができる。
The second
フィードバック制御部14は、d軸出力値ddおよびq軸出力値dqがゼロに近づくように、d軸出力値ddおよびq軸出力値dqに基づいて生成したn+1逓倍位相の第1交流信号をd軸出力指令値に重畳するとともに、d軸出力値qdおよびq軸出力値qqがゼロに近づくように、d軸出力値qdおよびq軸出力値qqに基づいて生成したn+1逓倍位相の第2交流信号をq軸出力指令値に重畳するのであれば、その構成を適宜変更することができる。
The
1 高調波補償装置
2 インバータ
3 三相交流電源
4 負荷
5 不平衡負荷
11 第1dq変換部
12 ハイパスフィルタ
13 第2dq変換部
14 フィードバック制御部
21 第1反転部
22 第1積分制御部
23 第1変換部
24 第1重畳部
25 第2反転部
26 第2積分制御部
27 第2変換部
28 第2重畳部
Claims (3)
前記交流信号に対してdq変換を行いd軸出力値d0およびq軸出力値q0を出力する第1dq変換部と、
前記d軸出力値d0および前記q軸出力値q0の直流成分を除去したd軸出力値dおよびq軸出力値qを出力するハイパスフィルタと、
前記d軸出力値dに対してdq変換を行い、d軸出力値ddおよびq軸出力値dqを出力するとともに、前記q軸出力値qに対してdq変換を行い、d軸出力値qdおよびq軸出力値qqを出力する第2dq変換部と、
前記d軸出力値ddおよび前記q軸出力値dqがゼロに近づくように、前記d軸出力値ddおよび前記q軸出力値dqに基づいて生成したn+1逓倍位相の第1交流信号を前記d軸出力指令値に重畳するとともに、前記d軸出力値qdおよび前記q軸出力値qqがゼロに近づくように、前記d軸出力値qdおよび前記q軸出力値qqに基づいて生成したn+1逓倍位相の第2交流信号を前記q軸出力指令値に重畳するフィードバック制御部と、を備えた
ことを特徴とする高調波補償装置。 An output device that outputs an AC output signal according to the d-axis output command value and the q-axis output command value is controlled, and the n-th harmonic and n + 2-th harmonic of the AC signal input to the load (n is an integer greater than or equal to 1 A harmonic compensation device that compensates
A first dq conversion unit that performs dq conversion on the AC signal and outputs d-axis output value d 0 and q-axis output value q 0 ;
A high-pass filter that outputs a d-axis output value d and a q-axis output value q obtained by removing direct-current components of the d-axis output value d 0 and the q-axis output value q 0 ;
The d-axis output value d is subjected to dq conversion to output the d-axis output value dd and the q-axis output value dq, and the d-axis output value q is subjected to the dq conversion to obtain the d-axis output value qd and a second dq conversion unit that outputs a q-axis output value qq;
The first alternating current signal of n + 1 multiplication phase generated based on the d-axis output value dd and the q-axis output value dq such that the d-axis output value dd and the q-axis output value dq approach zero, the d-axis Of an n + 1 multiplication phase generated based on the d-axis output value qd and the q-axis output value qq so as to be superimposed on the output command value so that the d-axis output value qd and the q-axis output value qq approach zero. And a feedback control unit that superimposes a second alternating current signal on the q-axis output command value.
前記d軸出力値ddおよび前記q軸出力値dqの極性を反転させる第1反転部と、
前記d軸出力値ddおよび前記q軸出力値dqがゼロに近づくように、前記d軸出力値ddおよび前記q軸出力値dqに対して積分制御を行う第1積分制御部と、
前記第1積分制御部の出力信号を前記n+1逓倍位相の交流信号に変換する第1変換部と、
前記第1変換部の出力信号に基づいて前記第1交流信号を生成し、前記第1交流信号を前記d軸出力指令値に重畳する第1重畳部と、
前記d軸出力値qdおよび前記q軸出力値qqの極性を反転させる第2反転部と、
前記d軸出力値qdおよび前記q軸出力値qqがゼロに近づくように、前記d軸出力値qdおよび前記q軸出力値qqに対して積分制御を行う第2積分制御部と、
前記第2積分制御部の出力信号を前記n+1逓倍位相の交流信号に変換する第2変換部と、
前記第2変換部の出力信号に基づいて前記第2交流信号を生成し、前記第2交流信号を前記q軸出力指令値に重畳する第2重畳部と、を備えた
ことを特徴とする請求項1に記載の高調波補償装置。 The feedback control unit
A first inverting unit that inverts the polarities of the d-axis output value dd and the q-axis output value dq;
A first integral control unit that performs integral control on the d-axis output value dd and the q-axis output value dq such that the d-axis output value dd and the q-axis output value dq approach zero;
A first conversion unit for converting an output signal of the first integration control unit into an alternating current signal of the n + 1 multiplication phase;
A first superimposing unit that generates the first alternating current signal based on the output signal of the first conversion unit, and superimposes the first alternating current signal on the d-axis output command value;
A second inverting unit that inverts the polarities of the d-axis output value qd and the q-axis output value qq;
A second integral control unit that performs integral control on the d-axis output value qd and the q-axis output value qq such that the d-axis output value qd and the q-axis output value qq approach zero;
A second conversion unit that converts the output signal of the second integration control unit into an alternating current signal of the n + 1 multiplied phase;
And a second superimposing unit that generates the second alternating current signal based on the output signal of the second conversion unit, and superimposes the second alternating current signal on the q-axis output command value. The harmonic compensation device according to Item 1.
前記d軸出力値dの位相をπ/2遅延させたd軸出力値d’を生成する第1遅延部と、
前記q軸出力値qの位相をπ/2遅延させたq軸出力値q’を生成する第2遅延部と、
前記d軸出力値dおよび前記d軸出力値d’に基づいて前記d軸出力値ddを生成する第1演算部と、
前記d軸出力値dおよび前記d軸出力値d’に基づいて前記q軸出力値dqを生成する第2演算部と、
前記q軸出力値qおよび前記q軸出力値q’に基づいて前記d軸出力値qdを生成する第3演算部と、
前記q軸出力値qおよび前記q軸出力値q’に基づいて前記q軸出力値qqを生成する第4演算部と、を備えた
ことを特徴とする請求項1または2に記載の高調波補償装置。 The second dq conversion unit
A first delay unit that generates a d-axis output value d ′ obtained by delaying the phase of the d-axis output value d by π / 2;
A second delay unit that generates a q-axis output value q ′ obtained by delaying the phase of the q-axis output value q by π / 2;
A first operation unit that generates the d-axis output value dd based on the d-axis output value d and the d-axis output value d ′;
A second operation unit that generates the q-axis output value dq based on the d-axis output value d and the d-axis output value d ′;
A third operation unit that generates the d-axis output value qd based on the q-axis output value q and the q-axis output value q ′;
The harmonic according to claim 1 or 2, further comprising: a fourth operation unit that generates the q-axis output value qq based on the q-axis output value q and the q-axis output value q '. Compensator.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016037248A JP6529081B2 (en) | 2016-02-29 | 2016-02-29 | Harmonic compensator |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016037248A JP6529081B2 (en) | 2016-02-29 | 2016-02-29 | Harmonic compensator |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2017158234A JP2017158234A (en) | 2017-09-07 |
JP6529081B2 true JP6529081B2 (en) | 2019-06-12 |
Family
ID=59810794
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016037248A Active JP6529081B2 (en) | 2016-02-29 | 2016-02-29 | Harmonic compensator |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP6529081B2 (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN107834559B (en) * | 2017-11-13 | 2020-12-01 | 湖南大学 | Transformer integrated power quality intelligent adjusting system and control method thereof |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0880052A (en) * | 1994-09-05 | 1996-03-22 | Meidensha Corp | Active filter for power |
JP4247357B2 (en) * | 2001-05-30 | 2009-04-02 | 国立大学法人東京工業大学 | Filter device |
JP5025295B2 (en) * | 2007-03-20 | 2012-09-12 | 東芝三菱電機産業システム株式会社 | Semiconductor power converter |
US20130181654A1 (en) * | 2012-01-18 | 2013-07-18 | Hamilton Sundstrand Corporation | Motor drive system employing an active rectifier |
-
2016
- 2016-02-29 JP JP2016037248A patent/JP6529081B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
JP2017158234A (en) | 2017-09-07 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
Qasim et al. | Artificial-neural-network-based phase-locking scheme for active power filters | |
EP3396850B1 (en) | Signal processor, filter, control circuit for power converter circuit, interconnection inverter system and pwm converter system | |
JP2020014350A5 (en) | ||
US20140211522A1 (en) | Apparatus and method for controlling circulating current in an inverter system | |
US20100259280A1 (en) | Apparatus for testing transformers | |
JP2009038885A5 (en) | ||
JP6145300B2 (en) | Inverter device and inverter generator | |
JP2009038885A (en) | Signal extracting device and reactive power compensator containing the same | |
JPWO2007119855A1 (en) | Power converter and control method thereof | |
JP6529081B2 (en) | Harmonic compensator | |
JP2002354815A (en) | Pwm cycloconverter and method of controlling input current thereof | |
JP5988911B2 (en) | Inverter control device | |
JP2013150459A (en) | Control circuit of power conversion circuit, interconnection inverter system using the same, and single-phase pwm converter system | |
JP5419656B2 (en) | Power conversion control device | |
WO2019082316A1 (en) | Power conversion device | |
JP3266966B2 (en) | Positive / negative phase component detection circuit for three-phase electricity | |
JP2009195059A (en) | Power conversion method and power conversion apparatus | |
JP2005003530A (en) | Phase detector | |
Khramshin et al. | Mathematical model of the static reactive power compensator | |
JP4989499B2 (en) | Power converter | |
JP5061343B2 (en) | Power conversion control method | |
JP2019009968A (en) | Polyphase motor drive device | |
US20230006599A1 (en) | Method and device for regulating an electric machine | |
US20220407441A1 (en) | Method and device for regulating an electric machine | |
Miskovic et al. | Synchronous frame and resonant adaptive observers as disturbance estimators and their applications in power electronics |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20180810 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20190424 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20190508 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20190509 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6529081 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |