JP6451890B1 - 駆動装置およびスイッチング装置 - Google Patents
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Abstract
Description
特許文献1 特開2016−158478号公報
特許文献2 特許第5939908号明細書
特許文献3 特開2017−51049号公報
閾値電圧は0Vでよい。
還流ダイオードは、主スイッチング素子の寄生ダイオードであってよい。
図1は、本実施形態に係るスイッチング装置100を示す。
主スイッチング素子1、2は、それぞれドレイン端子およびソース端子の間を電気的に接続または切断する。例えば、主スイッチング素子1、2は、後述の駆動装置5、6によってオン(接続とも称する)/オフ(切断とも称する)を切り換える。ここで、本実施形態では一例として、主スイッチング素子1、2は負側電源線102および正側電源線101の間に直列に順次接続され、電力変換装置における上アームおよび下アームを構成している。主スイッチング素子1、2の中点には電源出力端子105が接続される。
還流ダイオード3、4は、主スイッチング素子1、2に逆並列に接続される。還流ダイオード3、4は、ショットキーバリアダイオードでもよいし、MOSFETの寄生ダイオードでもよい。還流ダイオード3、4は、シリコン半導体素子でもよいし、ワイドバンドギャップ半導体素子でもよい。
駆動装置5、6は、外部から入力される入力信号に基づいて、対応する主スイッチング素子1、2のゲートを駆動する。ここで、入力信号は図示しない信号源から供給され、主スイッチング素子1、2に同期整流方式でスイッチングを行わせる。例えば、入力信号は、主スイッチング素子1、2の両方がオフ状態となるデッドタイム(上下アームのデッドタイムとも称する)を挟んで主スイッチング素子1、2を択一的に(一例として交互に)オン状態とするよう設定される。上下アームのデッドタイムは、入力信号が主スイッチング素子1、2をそれぞれオフ状態に維持するよう指示する期間(入力信号のデッドタイムとも称する)を設けることによって実現される。入力信号は、PWM制御により主スイッチング素子1、2を制御して、電源出力端子105から概ね正弦波の交流電流を出力させてよい。入力信号は主スイッチング素子1と、主スイッチング素子2とに対して別々に入力されてよい。なお、本実施形態では一例として、入力信号はハイ(オン指令信号)の場合に主スイッチング素子2をオン状態にすることを指示し、ロー(オフ指令信号)の場合に主スイッチング素子2をオフ状態にすることを指示する。
駆動装置6は、検出部61と、判定部63と、駆動制御部65とを備える。
検出部61は、主スイッチング素子2のドレイン端子およびソース端子の間の電圧を検出する。例えば、検出部61は、ドレイン端子およびソース端子の間に直列に接続されて、ドレイン端子およびソース端子の間の電圧を分圧する抵抗611、612を有する。抵抗611、612の中点は判定部63に接続されており、検出される電圧を判定部63に供給する。
判定部63は、検出部61が検出した検出電圧に基づいて、ソース端子側からドレイン端子側へと還流電流が流れているかを示す判定信号を出力する。判定部63は、予め定められた閾値電圧と検出電圧を比較して還流電流が流れているか否かを判定する。例えば、判定部63は、検出電圧が閾値電圧未満になったことに応じて、還流電流が流れていると判定する。これにより、還流電流が流れていることが確実に検出される。閾値電圧は一例として0Vであり、この場合には、ドレイン端子の電位よりもソース端子の電位が高くなることに応じて還流電流が流れていると判定される。なお、本実施形態では、検出電圧は還流ダイオード4の順方向の電圧、つまりアノード側よりもカソード側の電位が高い場合の電圧(図中の白抜き矢印を参照)を正電圧とする。閾値電圧は0Vよりも小さい負の電圧でもよく、例えば還流ダイオード4の閾値電圧(一例として0.6V)よりも絶対値の大きい負の電圧(−0.8V)でもよい。
駆動制御部65は主スイッチング素子2を制御し、例えば還流電流が流れていることを示す判定信号が出力されたこと、および、主スイッチング素子2に対してオン指令信号が入力されたことのそれぞれを条件として、主スイッチング素子2をオン状態とする制御を行う。本実施形態では一例として、駆動制御部65は、対向側の主スイッチング素子1がオフ状態とされた場合に判定信号がハイになったこと、および、主スイッチング素子2に対してオン指令信号が入力されたことのそれぞれを条件として、主スイッチング素子2をオン状態とする。駆動制御部65は、第1スイッチング素子651、第2スイッチング素子652、ゲート抵抗654、IF(インターフェイス)回路650、パルス出力回路655、および、OR回路656を有する。
第1スイッチング素子651および第2スイッチング素子652は、主スイッチング素子2のゲート端子にオン/オフを指示するゲート駆動信号(オン指令信号/オフ指令信号)を供給する。
ゲート抵抗654は、主スイッチング素子2のゲート端子に接続される。なお、本実施形態では一例として、ゲート抵抗654は第1スイッチング素子651および第2スイッチング素子652の中点と主スイッチング素子2のゲート端子との間に配置されているが、第1スイッチング素子651および第2スイッチング素子652のそれぞれのコレクタ端子側に配置されてもよい。
IF回路650は、駆動装置6の外部から入力信号を受信する。本実施形態では一例として、IF回路650は、OR回路656に入力信号を供給する。
パルス出力回路655は、判定部63により還流電流が流れていると判定されたことを条件としてハイとなるパルス信号を第1スイッチング素子651に供給する。本実施形態では一例として、パルス出力回路655は、判定信号がハイとなるエッジをトリガとしてパルス信号を出力してよい。パルス出力回路655は、OR回路656を介して第1スイッチング素子651のベース端子にパルス信号を供給する。
OR回路656は、IF回路650およびパルス出力回路655に接続された入力端子と、第1スイッチング素子651および第2スイッチング素子652のそれぞれのベース端子に接続された出力端子とを有する。これにより、OR回路656は、主スイッチング素子2に対する入力信号と、パルス出力回路655からのパルス信号との論理和をとったゲート制御信号を第1スイッチング素子651、第2スイッチング素子652に供給し、主スイッチング素子2のゲート端子に対するゲート駆動信号を出力させる。その結果、入力信号によりオンが指示されたこと、および、還流電流が流れていると判定されたこと(本実施形態ではパルス信号が立ち上がっていること)の少なくとも一方を条件としてゲート制御信号、ひいてはゲート駆動信号がハイとなり、主スイッチング素子2がオン状態とされる。また、入力信号によりオフが指示され、かつ、還流電流が流れたことを示す判定信号が出力されていないこと(一例としてパルス信号が立ち下がっていること)を条件としてゲート制御信号、ひいてはゲート駆動信号がローとなり、主スイッチング素子2がオフ状態とされる。
また、還流電流が流れていると判定されたこと、および、オン指令信号が入力されたことのそれぞれを条件として主スイッチング素子2をオン状態とするので、オン指令信号の入力のみを条件として主スイッチング素子2をオン状態とする場合、つまり入力信号で設定されるデッドタイムの経過を待って主スイッチング素子2をオン状態とする場合と比較して、実際のデッドタイムを短縮することができる。従って、デッドタイム期間中の電圧降下による損失を低減することができる。また、還流電流が流れる時間を短縮し、還流ダイオードの劣化、破壊を防止することができる。
図2は、本実施形態のスイッチング装置100の動作モードを示す。図中、破線の矢印は電流の流れを示し、破線円は主スイッチング素子1、2のうちオン状態(接続状態)の素子を示す。スイッチング装置100は、主スイッチング素子1、2のオンオフの状態、および、電流の向きによって8つの動作モード(1)〜(8)をとりうる。
図3は、本実施形態のスイッチング装置100の動作波形を示す。この例では、上述の動作モード(1)〜(3)の移行時の動作波形を示す。つまり、対向側スイッチング素子である主スイッチング素子1に対して時点t1でターンオフする入力信号(オフ指令信号)が供給された後、時点t1〜t5の期間での入力信号のデッドタイムを挟み、還流側である主スイッチング素子2に対して時点t5でターンオンする入力信号(オン指令信号)が供給される。なお、動作モード(7)、(8)、(5)の移行時の動作波形も同様である。また、図中の横軸は時間を示し、縦軸は主スイッチング素子1、2の入力信号、ゲートソース間電圧Vgs、ドレインソース間電圧Vds、ドレイン電流Id、還流電流Ifなどを示す。また、図中の「Ed」は正側電源線101および負側電源線102の間の直流電圧を示す。
図4は、本実施形態に係るスイッチング装置200を示す。スイッチング装置200の駆動制御部65Aは、第3スイッチング素子653と、ゲート抵抗6541〜6543を有する。
R=1/(1/R1+1/R3)<R1 (1)
Claims (16)
- ダイオードが逆並列接続されている主スイッチング素子をオンオフ駆動する駆動装置であって、
ドレイン端子およびソース端子の間の電圧を検出する検出部と、
前記検出部が検出した検出電圧に基づいて、前記ソース端子側から前記ドレイン端子側へと還流電流が流れているかを示す判定信号を出力する判定部と、
前記主スイッチング素子をオンにするオン指令信号が入力されたことを条件として前記主スイッチング素子をオン状態とし、かつ、前記還流電流が流れていることを示す前記判定信号が出力されたことを条件として前記主スイッチング素子をオン状態とする制御を行う駆動制御部と
を備える駆動装置。 - 前記判定部は、前記検出電圧を予め定められた閾値電圧と比較して、前記還流電流が流れているかを判定する、請求項1に記載の駆動装置。
- 前記閾値電圧は0Vである、請求項2に記載の駆動装置。
- ダイオードが逆並列接続されている主スイッチング素子をオンオフ駆動する駆動装置であって、
前記主スイッチング素子のソース端子側からドレイン端子側に向かって流れる電流を検出する検出部と、
前記検出部が検出した検出電流に基づいて、前記ソース端子側から前記ドレイン端子側へと還流電流が流れているかを示す判定信号を出力する判定部と、
前記主スイッチング素子をオンにするオン指令信号が入力されたことを条件として前記主スイッチング素子をオン状態とし、かつ、前記還流電流が流れていることを示す前記判定信号が出力されたことを条件として前記主スイッチング素子をオン状態とする制御を行う駆動制御部と
を備える駆動装置。 - 前記判定部は、前記検出電流を予め定められた閾値電流と比較して、前記還流電流が流れているかを判定する請求項4に記載の駆動装置。
- 前記判定部は、前記検出電流の時間変化を予め定められた値と比較して、前記還流電流が流れているかを判定する請求項5に記載の駆動装置。
- 前記判定部は、前記主スイッチング素子に直列に接続される対向スイッチング素子が当該対向スイッチング素子をオフにするオフ指令信号によりオフ状態とされた場合に前記還流電流が前記主スイッチング素子に流れているか否かを判定する、請求項1から6のいずれか一項に記載の駆動装置。
- 前記駆動制御部は、前記還流電流が流れていると判定されたことに応じて前記主スイッチング素子をオン状態とする速度を、前記オン指令信号が入力されたことに応じて前記主スイッチング素子をオン状態とする速度よりも早くする、請求項1から7のいずれか一項に記載の駆動装置。
- 前記駆動制御部は、前記主スイッチング素子のゲートに接続されるゲート抵抗を有し、前記還流電流が流れていると判定されたことに応じて前記主スイッチング素子をオン状態とする場合の前記ゲート抵抗の抵抗値を、前記オン指令信号が入力されたことに応じて前記主スイッチング素子をオン状態とする場合の前記ゲート抵抗の抵抗値よりも小さくする、請求項8に記載の駆動装置。
- 前記主スイッチング素子に直列に接続される対向スイッチング素子がオフ状態とされてから前記判定部により前記還流電流が流れていると判定された時点までの時間を記憶する記憶部を更に備え、
前記判定部は、前記時間が記憶された場合に、前記対向スイッチング素子がオフ状態とされてから前記時間が経過するタイミングで前記還流電流が流れていることを示す前記判定信号を出力する請求項1から9のいずれか一項に記載の駆動装置。 - 前記オン指令信号は、前記主スイッチング素子と、前記主スイッチング素子に直列に接続される対向スイッチング素子とがいずれもオフ状態となるデッドタイムを挟んで前記主スイッチング素子をオン状態とするよう設定され、
前記駆動制御部は、前記還流電流が流れていると判定されたことを条件として、前記主スイッチング素子をオンにするオン指令信号により前記主スイッチング素子がオン状態とされる時点以降まで、前記判定信号による前記主スイッチング素子のオン状態を維持する、請求項1から10のいずれか一項に記載の駆動装置。 - 前記還流電流が流れていることを示す前記判定信号が出力されたことを条件として予め定められた時間幅を有するパルス信号を出力するパルス出力部を備え、前記駆動制御部は、前記パルス信号が出力されたことを条件として、前記主スイッチング素子をオン状態とする、請求項11に記載の駆動装置。
- 前記パルス信号の時間幅は、前記デッドタイムよりも長く、かつ、次回の前記オン指令信号により前記主スイッチング素子がオン状態に維持される時間幅よりも短い、請求項12に記載の駆動装置。
- 請求項1から13のいずれか一項に記載の駆動装置と、
前記駆動装置によってゲートが駆動される前記主スイッチング素子と、
前記主スイッチング素子に逆並列に接続された還流ダイオードと、
を備えるスイッチング装置。 - 前記主スイッチング素子は、ワイドバンドギャップ半導体素子である請求項14に記載のスイッチング装置。
- 前記還流ダイオードは、前記主スイッチング素子の寄生ダイオードである請求項14または15に記載のスイッチング装置。
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