JP6171505B2 - 情報処理装置およびプログラム - Google Patents

Description

本発明は、情報処理装置およびプログラムに関する。

公報記載の従来技術として、不揮発性メモリで構成される記憶部と、外部記憶媒体を着脱可能に構成された外部Ｉ／Ｆと、装置の内部情報を記録したログおよび画像データを、記憶部に記憶するか外部記憶媒体に記憶するかを判断し、記憶部に記憶する場合はログおよび画像データを暗号化せず、外部媒体に記憶する場合はログおよび画像データを暗号化する制御部とを備えた画像形成装置が存在する（特許文献１参照）。

また、他の公報記載の従来技術として、制御装置に設けられるとともに機密情報を記憶する揮発性メモリと、制御装置の近傍の建造物等に内蔵される負荷と信号線を用いて接続され、信号線を介して負荷に継続して盗難検知信号の電流を流す電流検出部と、信号線を流れる電流を監視し、信号線を流れる電流が途絶えたことを検知すると、揮発性メモリへの給電を停止することで揮発性メモリに記憶される機密情報を消去する情報消去部とを備えた情報管理装置が存在する（特許文献２参照）。

特開２０１１−１０４７９６号公報 特開２０１２−２０３８０５号公報

本発明は、主記憶装置として不揮発性メモリおよび揮発性メモリを併用する場合に、不揮発性メモリを介したデータの漏洩を抑制することを目的とする。

請求項１記載の発明は、読み書き可能であって電源を供給しなくても記憶している情報を保持することが可能な不揮発性メモリを有し、当該不揮発性メモリにはプログラムが記憶される主記憶手段と、
前記主記憶手段の前記不揮発性メモリから読み出した前記プログラムを実行することで、接続された機器を制御する制御手段と、
前記プログラムよりも機密性が高く且つ前記制御手段による前記機器の制御に伴って当該機器に送る送信データまたは当該機器から送られてくる受信データを記憶させるための第１記憶領域と、当該プログラムよりも機密性が高く且つ当該プログラムの実行に伴って発生する作業データを記憶させるための第２記憶領域とを、前記主記憶手段の前記不揮発性メモリに設定する設定手段とを含み、
前記設定手段は、前記送信データまたは前記受信データに関連する処理が終了する毎に、前記不揮発性メモリに設定された前記第１記憶領域の記憶内容を消去し、電源オフの指示があった後であってシャットダウン処理が開始される前に、当該不揮発性メモリに設定された前記第２記憶領域の記憶内容を消去することを特徴とする情報処理装置である。
請求項２記載の発明は、前記主記憶手段における前記不揮発性メモリは、圧縮されていない前記プログラムを記憶していることを特徴とする請求項１記載の情報処理装置である。
請求項３記載の発明は、前記設定手段は、前記不揮発性メモリを有する前記主記憶手段に、読み書き可能であって電源を供給しないと記憶している情報を保持することが不可能な揮発性メモリが取り付けられた場合には、前記第１記憶領域および前記第２記憶領域の設定を当該不揮発性メモリから当該揮発性メモリに変更し、当該主記憶手段から当該揮発性メモリが取り外されると、当該第１記憶領域および当該第２記憶領域の設定を当該揮発性メモリから当該不揮発性メモリに変更することを特徴とする請求項１または２記載の情報処理装置である。
請求項４記載の発明は、コンピュータに、読み書き可能であって電源を供給しなくても記憶している情報を保持することが可能な不揮発性メモリを有し、当該不揮発性メモリにはプログラムが記憶される主記憶手段の当該不揮発性メモリから、当該プログラムを読み出して実行することで、接続された機器を制御する機能と、前記プログラムよりも機密性が高く且つ前記機器の制御に伴って当該機器に送る送信データまたは当該機器から送られてくる受信データを記憶させるための第１記憶領域と、当該プログラムよりも機密性が高く且つ当該プログラムの実行に伴って発生する作業データを記憶させるための第２記憶領域とを、前記主記憶手段の前記不揮発性メモリに設定する機能と、前記送信データまたは前記受信データに関連する処理が終了する毎に、前記不揮発性メモリに設定された前記第１記憶領域の記憶内容を消去し、電源オフの指示があった後であってシャットダウン処理が開始される前に、当該不揮発性メモリに設定された前記第２記憶領域の記憶内容を消去する機能とを実現させるプログラムである。

請求項１記載の発明によれば、本構成を有していない場合と比較して、不揮発性メモリを介した機密性の高いデータの漏洩を抑制することができる。
請求項２記載の発明によれば、本構成を有していない場合と比較して、起動処理に要する時間を短くすることができる。
請求項３記載の発明によれば、本構成を有していない場合と比較して、主記憶装置の構成の変更に対応することができる。
請求項４記載の発明によれば、本構成を有していない場合と比較して、不揮発性メモリを介した機密性の高いデータの漏洩を抑制することができる。

本実施の形態が適用される画像形成システムの構成の一例を示す図である。 画像形成装置に設けられた制御部の内部構成の一例を示すハードウェアブロック図である。 第１のメモリ構成が設定された場合における、メモリマップの構成の一例を示す図である。 第２のメモリ構成が設定された場合における、メモリマップの構成の一例を示す図である。 画像形成装置における起動処理の手順を説明するためのフローチャートである。 第１のメモリ構成が設定された場合における、起動後の制御処理（第１の制御処理）の手順を説明するためのフローチャートである。 第２のメモリ構成が設定された場合における、起動後の制御処理（第２の制御処理）の手順を説明するためのフローチャートである。

以下、添付図面を参照して、本発明の実施の形態について詳細に説明する。
図１は、本実施の形態が適用される画像形成システムの構成の一例を示す図である。
この画像形成システムは、スキャン機能、プリント機能、コピー機能およびファクシミリ機能を備えた所謂複合機として動作する画像形成装置１と、画像形成装置１に接続されるネットワーク２と、ネットワーク２に接続される端末装置３と、ネットワーク２に接続されるファクシミリ装置４と、ネットワーク２に接続されるサーバ装置５とを有している。

ここで、ネットワーク２は、インターネット回線や電話回線等によって構成されている。また、端末装置３は、ネットワーク２を介して、画像形成装置１に画像の形成等を指示するものであり、例えばＰＣ（Personal Computer）で構成される。さらに、ファクシミリ装置４は、ネットワーク２を介して、画像形成装置１との間でファクシミリを送受信する。さらにまた、サーバ装置５は、ネットワーク２を介して、画像形成装置１との間でデータ（プログラムを含む）を送受信する。

また、画像形成装置１は、紙等の記録媒体に記録された画像を読み取る画像読取部１０と、紙等の記録媒体（記録材）に画像を形成する画像形成部２０と、ユーザから電源のオン／オフ、スキャン機能、プリント機能、コピー機能およびファクシミリ機能を用いた動作に関連する指示を受け付けるとともに、ユーザに対してメッセージを表示するユーザインタフェース（ＵＩ）３０と、ネットワーク２を介して端末装置３、ファクシミリ装置４およびサーバ装置５との間でデータの送受信を行う送受信部４０と、これら画像読取部１０、画像形成部２０、ＵＩ３０および送受信部４０の動作を制御する制御部５０とを備えている。そして、この画像形成装置１では、画像読取部１０によってスキャン機能が実現され、画像形成部２０によってプリント機能が実現され、画像読取部１０および画像形成部２０によってコピー機能が実現され、画像読取部１０、画像形成部２０および送受信部４０によってファクシミリ機能が実現される。以下の説明においては、スキャン機能を用いたスキャン動作、プリント機能を用いたプリント動作、コピー機能を用いたコピー動作およびファクシミリ機能を用いたファクシミリ送受信動作を、まとめて「ジョブ」と呼ぶ。なお、送受信部４０は、例えばインターネット回線用のものと電話回線用のものとを、別々に設けるようにしてもかまわない。また、本実施の形態では、画像形成装置１に設けられた画像読取部１０、画像形成部２０、ＵＩ３０および送受信部４０が、それぞれ機器としての機能を有している。

図２は、図１に示す画像形成装置１に設けられた制御部５０の内部構成の一例を示すハードウェアブロック図である。
制御部５０は、種々の演算を実行することによって画像形成装置１の各部を制御するＣＰＵ（Central Processing Unit：中央処理装置）５１と、ＣＰＵ５１に接続され、各種データの読み出しおよび書き込みが行われるメインメモリ５２とを備えており、これらＣＰＵ５１およびメインメモリ５２は、共通の回路基板（図示せず）に装着されている。

ここで、ＣＰＵ５１は、メインメモリ５２から読み出したプログラムにしたがって種々の演算を実行するＣＰＵコア５１１と、ＣＰＵコア５１１とメインメモリ５２との間でデータの送受信を制御するメモリコントローラ５１２と、これらＣＰＵコア５１１、メインメモリ５２およびＣＰＵ５１に内蔵される他の構成要素（図示せず）を相互に接続するＣＰＵ内部バス５１３とを備えている。本実施の形態では、ＣＰＵコア５１１が実行手段あるいは制御手段の一例として機能しており、メモリコントローラ５１２が設定手段の一例として機能している。

なお、ＣＰＵ５１が実行するプログラムは、予めメインメモリ５２に記憶させておく形態の他、例えばＣＤ−ＲＯＭ等の記憶媒体に格納してＣＰＵ５１に提供したり、あるいは、サーバ装置５からネットワーク２を介してＣＰＵ５１に提供したりすることも可能である。

一方、主記憶手段の一例としてのメインメモリ５２は、メモリデバイスとしてＭＲＡＭ（Magnetoresistive Random Access Memory）を備えたＭＲＡＭモジュール５２１と、メモリデバイスとしてＤＲＡＭ（Dynamic Random Access Memory）を備えたＤＲＡＭモジュール５２２とを有している。なお、これらＭＲＡＭモジュール５２１およびＤＲＡＭモジュール５２２は、それぞれ、例えばＤＩＭＭ（Dual Inline Memory Module）規格に準じた構造を有しており、制御部５０に設けられた回路基板（図示せず）に対し着脱可能となっている。

メインメモリ５２を構成するＭＲＡＭモジュール５２１は、書き換え可能であって電源を供給しなくても記憶している情報を保持することが可能な不揮発性メモリの一例としての機能を有している。なお、本実施の形態の不揮発性メモリに要求される特性は、ＤＲＡＭと同等の速度でデータの読み書きが行えることであり、ＭＲＡＭ以外に、ＦｅＲＡＭ（Ferroelectric RAM）、ＰＲＡＭ（Phase change RAM）、あるいはＲｅＲＡＭ（Resistance RAM）などを用いてもよい。

また、メインメモリ５２を構成するＤＲＡＭモジュール５２２は、書き換え可能であって電源を供給しないと記憶している情報を保持することが不可能な揮発性メモリの一例としての機能を有している。なお、ＤＲＡＭ以外に、ＳＲＡＭ（Static Random Access Memory）などを用いてもよい。

本実施の形態では、メインメモリ５２を構成するＭＲＡＭモジュール５２１およびＤＲＡＭモジュール５２２が、共通のクロック周波数でデータの読み書きを行う。このため、ＭＲＡＭモジュール５２１は、ＤＲＡＭモジュール５２２と同等の読み書き性能を有していることになる。また、本実施の形態では、ＭＲＡＭモジュール５２１の記憶容量に対し、ＤＲＡＭモジュール５２２の記憶容量がより大きくなっている。これは、ＭＲＡＭモジュール５２１の単位容量あたりの単価が、ＤＲＡＭモジュール５２２の単位容量あたりの単価に比べて高価となっていることによる。本実施の形態において、ＭＲＡＭモジュール５２１の記憶容量は例えば５１２ＭＢであり、ＤＲＡＭモジュール５２２の記憶容量は例えば８ＧＢである。

そして、本実施の形態の画像形成装置１は、制御部５０にメインメモリ５２としてＭＲＡＭモジュール５２１およびＤＲＡＭモジュール５２２の両者が装着された状態での動作が可能であるとともに、制御部５０にメインメモリ５２としてＭＲＡＭモジュール５２１のみが装着された状態での動作も可能となっている。本実施の形態の制御部５０において、ＭＲＡＭモジュール５２１は標準装着されるメモリとなっており、ＤＲＡＭモジュール５２２はオプション装着されるメモリとなっている。なお、以下の説明においては、メインメモリ５２としてＭＲＡＭモジュール５２１およびＤＲＡＭモジュール５２２の両者が装着されている状態を「第１のメモリ構成」と呼び、メインメモリ５２としてＭＲＡＭモジュール５２１のみが装着されている状態を「第２のメモリ構成」と呼ぶ。

図３は、上述した第１のメモリ構成が設定された場合における、メモリマップの構成の一例を示す図である。第１のメモリ構成が設定された場合において、ＣＰＵ５１は、図３に示すメモリマップに基づいて、メインメモリ５２に対するデータの読み書きを行う。

図３に示すメモリマップにおいて、メインメモリ５２全体としての記憶領域Ａ０は、基本的にＲＯＭ（Read Only Memory）として使用される第１記憶領域Ａ１と、基本的にＲＡＭ（Random Access Memory）として使用される第２記憶領域Ａ２とを含んでいる。第１のメモリ構成が設定されている場合、すなわち、メインメモリ５２がＭＲＡＭモジュール５２１とＤＲＡＭモジュール５２２とを含む場合、ＭＲＡＭモジュール５２１に第１記憶領域Ａ１が配置され、ＤＲＡＭモジュール５２２に第２記憶領域Ａ２が配置される。

ここで、第１のメモリ構成における第１記憶領域Ａ１は、リセットベクタ記憶領域Ａ１１と、ＯＳ記憶領域Ａ１２と、アプリケーション記憶領域Ａ１３と、空き領域Ａ１４とを有している。

リセットベクタ記憶領域Ａ１１は、画像形成装置１を起動するにあたり、制御部５０においてＣＰＵ５１が最初に実行するプログラムである、イニシャル・プログラム・ローダ（Initial Program Loader：ＩＰＬ）を記憶する。
ＯＳ記憶領域Ａ１２は、画像形成装置１を起動するにあたり、制御部５０においてＣＰＵ５１がＩＰＬに続いて実行するプログラムであり、後述する各種アプリケーションプログラムを動作させるためのベースとなるオペレーティングシステム（Operating System：ＯＳ）を、未圧縮の状態（展開された状態）で記憶する。
アプリケーション記憶領域Ａ１３は、画像形成装置１に実装され得る各構成および各機能に対応した複数のアプリケーションプログラムを、未圧縮の状態（展開された状態）で記憶する。
空き領域Ａ１４は、第１のメモリ構成においてデータを記憶していない領域である。

一方、第１のメモリ構成における第２記憶領域Ａ２は、システムデータ記憶領域Ａ２１と、ジョブデータ記憶領域Ａ２２とを有している。

システムデータ記憶領域Ａ２１は、ＣＰＵ５１によるプログラムの実行に伴って発生する作業データを一時的に記憶するワークエリアとしての機能を有している。また、システムデータ記憶領域Ａ２１には、これに加えて、ファクシミリ送信動作を行う際に設定される送信先（例えばファクシミリ装置４の電話番号）やプリント動作を指示する送信元（例えば端末装置３のＩＰアドレス）などの個人情報を含むデータを一時的に記憶する機能を有している。なお、以下の説明においては、システムデータ記憶領域Ａ２１に記憶される上記各データを、まとめて「システムデータ」と呼ぶ。このシステムデータ記憶領域Ａ２１は、「実行手段によるプログラムの実行に伴って発生する作業データを記憶させるための記憶領域」に対応するものである。

ジョブデータ記憶領域Ａ２２は、スキャン動作、コピー動作およびファクシミリ送信動作を行う際に取得されるスキャン画像データ、プリント動作、コピー動作およびファクシミリ受信動作を行う際に取得されるプリント用画像データなどを記憶する。なお、以下の説明では、各種ジョブの実行に伴って生じる上記各データを、まとめて「ジョブデータ」と呼ぶ。このジョブデータ記憶領域Ａ２２は、「制御手段による機器の制御に伴って機器に送る送信データまたは機器から送られてくる受信データを記憶させるための記憶領域」に対応するものである。したがって、上記スキャン画像データや上記プリント用画像データが、送信データや受信データに対応していることになる。

図４は、上述した第２のメモリ構成が設定された場合における、メモリマップの構成の一例を示す図である。第２のメモリ構成が設定された場合において、ＣＰＵ５１は、図４に示すメモリマップに基づいて、メインメモリ５２に対するデータの読み書きを行う。

図４に示すメモリマップにおいても、メインメモリ５２全体としての記憶領域Ａ０は、基本的にＲＯＭ（Read Only Memory）のように使用される第１記憶領域Ａ１と、基本的にＲＡＭ（Random Access Memory）のように使用される第２記憶領域Ａ２とを含んでいる。第２のメモリ構成が設定されている場合、すなわち、メインメモリ５２がＭＲＡＭモジュール５２１のみを含む場合、ＭＲＡＭモジュール５２１に第１記憶領域Ａ１および第２記憶領域Ａ２の両者が配置される。

ここで、第２のメモリ構成における第１記憶領域Ａ１は、リセットベクタ記憶領域Ａ１１と、ＯＳ記憶領域Ａ１２と、アプリケーション記憶領域Ａ１３とを有している。なお、リセットベクタ記憶領域Ａ１１、ＯＳ記憶領域Ａ１２およびアプリケーション記憶領域Ａ１３のそれぞれの機能は、第１のメモリ構成において説明した通りである。

一方、第２のメモリ構成における第２記憶領域Ａ２は、システムデータ記憶領域Ａ２１と、ジョブデータ記憶領域Ａ２２とを有している。なお、システムデータ記憶領域Ａ２１およびジョブデータ記憶領域Ａ２２のそれぞれの機能は、第１のメモリ構成において説明した通りである。

図４に示す第２のメモリ構成においては、図３に示す第１のメモリ構成において第１記憶領域Ａ１の空き領域Ａ１４となっていた部位に、第２記憶領域Ａ２（システムデータ記憶領域Ａ２１およびジョブデータ記憶領域Ａ２２）が配置されるようになっている。

したがって、第１のメモリ構成および第２のメモリ構成は、ＭＲＡＭモジュール５２１に第１記憶領域Ａ１が配置されている点で共通する。一方、第１のメモリ構成では、ＤＲＡＭモジュール５２２に第２記憶領域Ａ２が配置されているのに対し、第２のメモリ構成では、ＭＲＡＭモジュール５２１に第２記憶領域Ａ２が配置されている点で相違する。

また、図４に示す第２のメモリ構成においては、図３に示す第１のメモリ構成と比較して、第２記憶領域Ａ２の記憶容量が小さくなっている。これは、ＭＲＡＭモジュール５２１の記憶容量が、ＤＲＡＭモジュール５２２の記憶容量よりも小さくなっていることに起因する。

なお、本実施の形態の制御部５０は、上述したＯＳやアプリケーションプログラムをそれぞれ圧縮した状態で記憶しておき、必要時にそれを展開（解凍）してメインメモリ５２に書き込むのに用いられるＲＯＭを備えていない。このため、本実施の形態のＣＰＵ５１は、後述する起動処理において、起動当初よりメインメモリ５２にアクセスして各種プログラム（ＩＰＬ、ＯＳ、アプリケーションプログラム）を実行することになる。

図５は、図１に示す画像形成装置１の起動処理を説明するためのフローチャートである。この起動処理は、例えばＵＩ３０を介して画像形成装置１の電源が投入されることに伴ってＣＰＵ５１にリセット指示が入力されたとき、また、画像形成装置１の電源が投入された後に何らかの理由によりＣＰＵ５１にリセット指示が入力されたとき、などに実行される。

制御部５０に設けられたＣＰＵ５１がリセット指示を受け付けると（ステップ１０１）、ＣＰＵ５１（より具体的にはＣＰＵコア５１１）は自身のリセット（ＣＰＵリセット）を実行する。ここで、メインメモリ５２が第１のメモリ構成となっている場合、ＣＰＵリセットに伴って、メインメモリ５２を構成するＤＲＡＭモジュール５２２の記憶内容は消去されるが、メインメモリ５２を構成するＭＲＡＭモジュール５２１の記憶内容は消去されず、ＣＰＵリセット前の記憶内容がそのまま保持される。一方、メインメモリ５２が第２のメモリ構成となっている場合、ＣＰＵリセットに伴って、メインメモリ５２を構成するＭＲＡＭモジュール５２１の記憶内容は消去されず、ＣＰＵリセット前の記憶内容がそのまま保持される。

続いて、ＣＰＵ５１では、ＣＰＵコア５１１が、ＣＰＵ内部バス５１３およびメモリコントローラ５１２を介して、メインメモリ５２においてＭＲＡＭモジュール５２１に配置された第１記憶領域Ａ１のリセットベクタ記憶領域Ａ１１からイニシャル・プログラム・ローダ（ＩＰＬ）を読み出すとともに、読み出したＩＰＬを実行する（ステップ１０２）。ＩＰＬの実行に伴い、ＣＰＵ５１は、メインメモリ５２としてＤＲＡＭモジュール５２２が接続されているか否かの検出を行う（ステップ１０３）。

ステップ１０３において肯定の判断（ＹＥＳ）を行った場合、すなわち、メインメモリ５２が第１のメモリ構成（ＭＲＡＭモジュール５２１およびＤＲＡＭモジュール５２２）となっていた場合、ＣＰＵ５１は、ＤＲＡＭモジュール５２２に第２記憶領域Ａ２（システムデータ記憶領域Ａ２１およびジョブデータ記憶領域Ａ２２）を確保する（ステップ１０４）。一方、ステップ１０３において否定の判断（ＮＯ）を行った場合、すなわち、メインメモリ５２が第２のメモリ構成（ＭＲＡＭモジュール５２１のみ）となっていた場合、ＣＰＵ５１は、ＭＲＡＭモジュール５２１に第２記憶領域Ａ２（システムデータ記憶領域Ａ２１およびジョブデータ記憶領域Ａ２２）を確保する（ステップ１０５）。

そして、ステップ１０４においてＤＲＡＭモジュール５２２に第２記憶領域Ａ２が確保され、あるいは、ステップ１０５においてＭＲＡＭモジュール５２１に第２記憶領域Ａ２が確保された後、ＣＰＵ５１は、ＣＰＵ内部バス５１３およびメモリコントローラ５１２を介して、メインメモリ５２においてＭＲＡＭモジュール５２１に配置された第１記憶領域Ａ１のＯＳ記憶領域Ａ１２からオペレーティングシステム（ＯＳ）を読み出すとともに、読み出したＯＳを実行する（ステップ１０６）。ステップ１０６のＯＳの実行に続いて、ＣＰＵ５１は、メインメモリ５２においてＭＲＡＭモジュール５２１に配置された第１記憶領域Ａ１のアプリケーション記憶領域Ａ１３から、複数のアプリケーションプログラムを順次読み出して実行する（ステップ１０７）ことで、画像形成装置１が動作可能な状態へと移行し、一連の起動処理を完了する。

次に、上述した起動処理が完了した後の、画像形成装置１の制御処理について説明を行う。なお、本実施の形態では、メインメモリ５２が第１のメモリ構成となっている場合と第２のメモリ構成となっている場合とで、起動処理完了後の制御処理の手法が異なる。そこで、以下では、メインメモリ５２が第１のメモリ構成となっている場合の制御処理（以下では「第１の制御処理」と呼ぶ）と第２のメモリ構成となっている場合の制御処理（以下では「第２の制御処理」と呼ぶ）とに分けて説明を行う。

＜第１の制御処理＞
図６は、第１のメモリ構成が設定された場合における、起動後の制御処理（第１の制御処理）の手順を説明するためのフローチャートである。
第１の制御処理においては、制御部５０に設けられたＣＰＵ５１が、ＵＩ３０や送受信部４０を介して、ジョブ（スキャン動作、プリント動作、コピー動作あるいはファクシミリ送受信動作）の実行指示を受け付けたか否かを判断する（ステップ２０１）。ステップ２０１において肯定の判断（ＹＥＳ）を行った場合、ＣＰＵ５１は、対応する動作に関わるアプリケーションプログラムを実行することにより、指示に対応するジョブ処理を実行する（ステップ２０２）。ステップ２０２では、アプリケーションプログラムの実行に伴って、メインメモリ５２においてＤＲＡＭモジュール５２２に配置された第２記憶領域Ａ２のシステムデータ記憶領域Ａ２１には、今回のジョブ処理の実行に伴うシステムデータが書き込まれ、且つ、メインメモリ５２においてＤＲＡＭモジュール５２２に配置された第２記憶領域Ａ２のジョブデータ記憶領域Ａ２２には、今回のジョブ処理の実行に伴うジョブデータが書き込まれる。一方、ステップ２０１において否定の判断（ＮＯ）を行った場合は、そのままステップ２０３へと進む。

ステップ２０２においてジョブ処理を実行した場合およびステップ２０１において否定の判断（ＮＯ）を行った場合、ＣＰＵ５１は、次に、ＵＩ３０等を介して、画像形成装置１の電源をオフする指示を受け付けたか否かを判断する（ステップ２０３）。

ステップ２０３において否定の判断（ＮＯ）を行った場合、ＣＰＵ５１は、ステップ２０１に戻る。一方、ステップ２０３において肯定の判断（ＹＥＳ）を行った場合、ＣＰＵ５１は、画像形成装置１の動作を終了させるためのシャットダウン処理を実行し（ステップ２０４）、その後、画像形成装置１の電源をオフする（ステップ２０５）ことで、第１の制御処理を完了する。

このように、第１のメモリ構成が設定された場合に実行される第１の制御処理では、ＩＰＬ、ＯＳおよび各種アプリケーションプログラム（以下では、これらをまとめて各種プログラムと呼ぶ）を、ＭＲＡＭモジュール５２１に記憶させるとともに、各種アプリケーションプログラムの実行に伴って生じるシステムデータおよびジョブデータを、ＤＲＡＭモジュール５２２に記憶させるようにしている。ここで、第２のデータの一例としてのシステムデータおよびジョブデータは、個人情報や画像データを含み得る分、第１のデータの一例としての各種プログラムに比べて、機密性が高いといえる。

システムデータおよびジョブデータを、ＭＲＡＭモジュール５２１に記憶させるようにした場合、シャットダウン処理の完了に伴って画像形成装置１の電源をオフにした後も、ＭＲＡＭモジュール５２１にこれらシステムデータおよびジョブデータが記憶されたままとなってしまう懸念がある。

これに対し、第１の制御処理では、シャットダウン処理の完了に伴って画像形成装置１の電源をオフにすると、ＤＲＡＭモジュール５２２に記憶されたシステムデータおよびジョブデータは、自動的に消去されることになる。したがって、画像形成装置１の電源がオフにされた状態で、仮に、制御部５０からＭＲＡＭモジュール５２１あるいはＤＲＡＭモジュール５２２が取り外されることがあったとしても、ＭＲＡＭモジュール５２１およびＤＲＡＭモジュール５２２の両者に、機密性の高いデータは記憶されていないことになる。それゆえ、ＭＲＡＭモジュール５２１あるいはＤＲＡＭモジュール５２２の取り外しに起因する機密性の高いデータの漏洩を抑制することが可能になる。

＜第２の制御処理＞
図７は、第２のメモリ構成が設定された場合における、起動後の制御処理（第２の制御処理）の手順を説明するためのフローチャートである。
第２の制御処理においても、制御部５０に設けられたＣＰＵ５１が、ＵＩ３０や送受信部４０を介して、ジョブの実行指示を受け付けたか否かを判断する（ステップ３０１）。ステップ３０１において肯定の判断（ＹＥＳ）を行った場合、ＣＰＵ５１は、対応する動作に関わるアプリケーションプログラムを実行することにより、指示に対応するジョブ処理を実行する（ステップ３０２）。ステップ３０２では、アプリケーションプログラムの実行に伴って、メインメモリ５２においてＭＲＡＭモジュール５２１に配置された第２記憶領域Ａ２のシステムデータ記憶領域Ａ２１には、今回のジョブ処理の実行に伴うシステムデータが書き込まれ、且つ、メインメモリ５２においてＭＲＡＭモジュール５２１に配置された第２記憶領域Ａ２のジョブデータ記憶領域Ａ２２には、今回のジョブ処理の実行に伴うジョブデータが書き込まれる。そして、ステップ３０２におけるジョブ処理の実行が完了すると、ＣＰＵ５１は、ステップ３０２にて第２記憶領域Ａ２のジョブデータ記憶領域Ａ２２に書き込まれたジョブデータを消去する（ステップ３０３）。一方、ステップ３０１において否定の判断（ＮＯ）を行った場合は、そのままステップ３０４へと進む。

ステップ３０３においてジョブデータを消去した場合およびステップ３０１において否定の判断（ＮＯ）を行った場合、ＣＰＵ５１は、次に、ＵＩ３０等を介して、画像形成装置１の電源をオフする指示を受け付けたか否かを判断する（ステップ３０４）。

ステップ３０４において否定の判断（ＮＯ）を行った場合、ＣＰＵ５１は、ステップ３０１に戻る。一方、ステップ３０４において肯定の判断（ＹＥＳ）を行った場合、ＣＰＵ５１は、ステップ３０２にて第２記憶領域Ａ２のシステムデータ記憶領域Ａ２１に書き込まれたシステムデータを消去する（ステップ３０５）。続いて、ＣＰＵ５１は、画像形成装置１の動作を終了させるためのシャットダウン処理を実行し（ステップ３０６）、その後、画像形成装置１の電源をオフする（ステップ３０７）ことで、第２の制御処理を完了する。

このように、第２のメモリ構成が採用された場合に実行される第２の制御処理では、各種プログラム、システムデータおよびジョブデータを、ＭＲＡＭモジュール５２１に記憶させるようにしている。ただし、ジョブデータについては、そのジョブデータが発生したジョブ処理が終了する毎に消去を行うようにし、システムデータについては、電源オフの指示があった後であってシャットダウン処理が開始される前に消去を行うようにしている。

したがって、画像形成装置１の電源がオフにされた状態で、仮に、制御部５０からＭＲＡＭモジュール５２１が取り外されることがあったとしても、ＭＲＡＭモジュール５２１に、機密性の高いデータは記憶されていないことになる。それゆえ、ＭＲＡＭモジュール５２１の取り外しに起因する機密性の高いデータの漏洩を抑制することが可能になる。

１…画像形成装置、２…ネットワーク、３…端末装置、４…ファクシミリ装置、５…サーバ装置、１０…画像読取部、２０…画像形成部、３０…ＵＩ、４０…送受信部、５０…制御部、５１…ＣＰＵ、５２…メインメモリ、５１１…ＣＰＵコア、５１２…メモリコントローラ、５１３…ＣＰＵ内部バス、５２１…ＭＲＡＭモジュール、５２２…ＤＲＡＭモジュール、Ａ０…記憶領域、Ａ１…第１記憶領域、Ａ２…第２記憶領域、Ａ１１…リセットベクタ記憶領域、Ａ１２…ＯＳ記憶領域、Ａ１３…アプリケーション記憶領域、Ａ１４…空き領域、Ａ２１…システムデータ記憶領域、Ａ２２…ジョブデータ記憶領域

Claims (4)

1. 読み書き可能であって電源を供給しなくても記憶している情報を保持することが可能な不揮発性メモリを有し、当該不揮発性メモリにはプログラムが記憶される主記憶手段と、
   前記主記憶手段の前記不揮発性メモリから読み出した前記プログラムを実行することで、接続された機器を制御する制御手段と、
   前記プログラムよりも機密性が高く且つ前記制御手段による前記機器の制御に伴って当該機器に送る送信データまたは当該機器から送られてくる受信データを記憶させるための第１記憶領域と、当該プログラムよりも機密性が高く且つ当該プログラムの実行に伴って発生する作業データを記憶させるための第２記憶領域とを、前記主記憶手段の前記不揮発性メモリに設定する設定手段とを含み、
   前記設定手段は、前記送信データまたは前記受信データに関連する処理が終了する毎に、前記不揮発性メモリに設定された前記第１記憶領域の記憶内容を消去し、電源オフの指示があった後であってシャットダウン処理が開始される前に、当該不揮発性メモリに設定された前記第２記憶領域の記憶内容を消去することを特徴とする情報処理装置。
2. 前記主記憶手段における前記不揮発性メモリは、圧縮されていない前記プログラムを記憶していることを特徴とする請求項１記載の情報処理装置。
3. 前記設定手段は、前記不揮発性メモリを有する前記主記憶手段に、読み書き可能であって電源を供給しないと記憶している情報を保持することが不可能な揮発性メモリが取り付けられた場合には、前記第１記憶領域および前記第２記憶領域の設定を当該不揮発性メモリから当該揮発性メモリに変更し、当該主記憶手段から当該揮発性メモリが取り外されると、当該第１記憶領域および当該第２記憶領域の設定を当該揮発性メモリから当該不揮発性メモリに変更することを特徴とする請求項１または２記載の情報処理装置。
4. コンピュータに、
   読み書き可能であって電源を供給しなくても記憶している情報を保持することが可能な不揮発性メモリを有し、当該不揮発性メモリにはプログラムが記憶される主記憶手段の当該不揮発性メモリから、当該プログラムを読み出して実行することで、接続された機器を制御する機能と、
   前記プログラムよりも機密性が高く且つ前記機器の制御に伴って当該機器に送る送信データまたは当該機器から送られてくる受信データを記憶させるための第１記憶領域と、当該プログラムよりも機密性が高く且つ当該プログラムの実行に伴って発生する作業データを記憶させるための第２記憶領域とを、前記主記憶手段の前記不揮発性メモリに設定する機能と、
   前記送信データまたは前記受信データに関連する処理が終了する毎に、前記不揮発性メモリに設定された前記第１記憶領域の記憶内容を消去し、電源オフの指示があった後であってシャットダウン処理が開始される前に、当該不揮発性メモリに設定された前記第２記憶領域の記憶内容を消去する機能と
   を実現させるプログラム。

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