JP6160604B2 - Δς変調器およびそのプログラム - Google Patents
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- Theoretical Computer Science (AREA)
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Description
2 入力端子
3 出力端子
4 ループフィルタ
5 n値量子化器
6 セレクタ
11、14 減算器
12、15 加算器
13、16、17 遅延器
Claims (4)
- m値(m:3以上の整数)デジタル信号をn値(n:mより小さい2以上の整数)デジタル信号に変換して出力するΔΣ変調器であって、
それぞれの入力に減算器を有する複数の縦続接続される積分器を含み、該m値デジタル信号が縦続接続された最初の該積分器の該減算器に入力されるループフィルタと、
該ループフィルタから出力される複数の縦続接続された該積分器のうちの最後の積分器からの出力に基づく第1出力信号を入力されて該n値デジタル信号である第2出力信号を出力するn値量子化器と、
該第1出力信号および該第2出力信号が入力されて、該第1出力信号と該第2出力信号との間で帰還する方を、複数の縦続接続された該積分器のうちの最初から最後の一つ前の積分器からの出力では無く該第1出力信号に基づいて選択し、該第1出力信号の絶対値が所定値以上の場合に該第1出力信号を該ループフィルタの全ての該減算器に帰還し、該第1出力信号の絶対値が所定値未満の場合に該第2出力信号を該ループフィルタの全ての該減算器に帰還する切換器と、
を備え、
該切換器の該所定値が、該n値デジタル信号が取り得る量子化値の絶対値の最大値よりも大きく設定されている、
ΔΣ変調器。 - 前記n値量子化器が、前記n=2の場合に、出力する2値デジタル信号の信号値を第1の量子化値または第2の量子化値のいずれかに定める入力信号に対する閾値を、ゼロ値に設定されている、
請求項1に記載のΔΣ変調器。 - 前記n=2の場合に、前記n値量子化器の前記第1の量子化値および前記第2の量子化値が、絶対値の等しい正および負の量子化値として設定されている、
請求項2に記載のΔΣ変調器。 - m値(m:3以上の整数)デジタル信号をn値(n:mより小さい2以上の整数)デジタル信号に変換して出力するΔΣ変調の信号処理をコンピュータに実行させるプログラムであって、
該プログラムは、該コンピュータのプロセッサに、
それぞれの入力に減算器を有する複数の縦続接続される積分器を含み、該m値デジタル信号が縦続接続された最初の該積分器の該減算器に入力されるループフィルタの信号処理を実行させるステップと、
該ループフィルタから出力される複数の縦続接続された該積分器のうちの最後の積分器からの出力に基づく第1出力信号を入力されて該n値デジタル信号である第2出力信号を出力するn値量子化の信号処理を実行させるステップと、
該第1出力信号および該第2出力信号が入力されて、該第1出力信号と該第2出力信号との間で帰還する方を、複数の縦続接続された該積分器のうちの最初から最後の一つ前の積分器からの出力では無く該第1出力信号に基づいて選択し、該第1出力信号の絶対値が所定値以上の場合に該第1出力信号を該ループフィルタの全ての該減算器に帰還し、該第1出力信号の絶対値が所定値未満の場合に該第2出力信号を該ループフィルタの全ての該減算器に帰還する切換処理を実行させるステップと、
を含み、
該切換処理の該所定値が、該n値デジタル信号が取り得る量子化値の絶対値の最大値よりも大きく設定されている、
プログラム。
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JP2014258600A JP6160604B2 (ja) | 2014-12-22 | 2014-12-22 | Δς変調器およびそのプログラム |
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JP2014258600A Active JP6160604B2 (ja) | 2014-12-22 | 2014-12-22 | Δς変調器およびそのプログラム |
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2015
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