JP5780768B2 - 情報処理装置、その制御方法、およびプログラム - Google Patents
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Description
3 コントローラ(制御装置)
4 プリンタ装置
8 LAN I/F(ネットワークインタフェース部)
201,221 CPU
203 メモリ
801 I/F部
808 マイクロプロセッサ
804〜807 FIFO
809 MAC(メディアアクセス制御部)
Claims (10)
- 省電力モードで動作可能な情報処理装置であって、
パケットを受信する受信手段と、
前記受信手段で受信した受信パケットを受信バッファに格納する格納手段と、
前記格納手段によって受信バッファに格納されたパケットに対する処理を実行する処理手段とを備え、
前記省電力モードから通常電力モードに移行する要因となる特定のパケットを前記受信手段で受信した場合、前記格納手段は、第1の受信バッファ群に含まれるいずれかの受信バッファに前記特定のパケットを格納し、
前記特定のパケットに対して前記処理手段で実行する処理が完了するまでの間に前記受信手段で新たなパケットを受信した場合、前記格納手段は、前記第1の受信バッファ群とは異なる第2の受信バッファ群に含まれるいずれかの受信バッファに前記新たなパケットを格納し、
前記特定のパケットに対して前記処理手段で実行する処理が完了した後に前記受信手段で新たなパケットを受信した場合、前記格納手段は、前記第1の受信バッファ群に含まれるいずれかの受信バッファに前記新たなパケットを格納することを特徴とする情報処理装置。 - 前記格納手段が受信パケットを格納する格納先を切り替える切替手段を更に備え、
前記第1の受信バッファ群に含まれるいずれかの受信バッファに前記格納手段が前記特定のパケットを格納した場合に、前記切替手段は、前記格納先を前記第1の受信バッファ群から前記第2の受信バッファ群に切り替え、
前記特定のパケットに対して前記処理手段が実行する処理が完了した場合に、前記切替手段は、格納先を前記第2の受信バッファ群から前記第1の受信バッファ群に切り替えることを特徴とする請求項1に記載の情報処理装置。 - 少なくともインタフェース部とコントローラとを含み、
前記受信手段と前記格納手段とは前記インタフェース部に備えられ、
前記第1の受信バッファ群及び前記第2の受信バッファ群は、前記コントローラに備えられたメモリに配置されることを特徴とする請求項1又は2に記載の情報処理装置。 - 前記インタフェース部と前記コントローラに加えて、更に印刷部を含むことを特徴とする請求項3に記載の情報処理装置。
- 省電力モードで動作可能な情報処理装置であって、
パケットを受信する受信手段と、
前記受信手段が受信した受信パケットを記憶手段に格納する格納手段と、
前記格納手段によって記憶手段に格納されたパケットに対する処理を実行する処理手段とを備え、
前記省電力モードから通常電力モードに移行する要因となる特定のパケットを前記受信手段で受信した場合、前記格納手段は、第1の記憶手段に前記特定のパケットを格納し、 前記特定のパケットに対して前記処理手段で実行する処理が完了するまでの間に前記受信手段で新たなパケットを受信した場合、前記格納手段は、前記第1の記憶手段とは異なる第2の記憶手段に前記新たなパケットを格納し、
前記特定のパケットに対して前記処理手段で実行する処理が完了した後に前記受信手段で新たなパケットを受信した場合、前記格納手段は、前記第1の記憶手段に前記新たなパケットを格納することを特徴とする情報処理装置。 - 前記格納手段が受信パケットを格納する格納先を切り替える切替手段を更に備え、
前記第1の記憶手段に前記格納手段が前記特定のパケットを格納した場合に、前記切替手段は、前記格納先を前記第1の記憶手段から前記第2の記憶手段に切り替え、
前記特定のパケットに対して前記処理手段が実行する処理が完了した場合に、前記切替手段は、前記格納先を前記第2の記憶手段から前記第1の記憶手段に切り替えることを特徴とする請求項5に記載の情報処理装置。 - 前記処理手段は、前記格納手段によって格納されたパケットに対する応答パケットをネットワークに送信することを特徴とする請求項1乃至6のいずれか1項に記載の情報処理装置。
- 省電力モードで動作可能な情報処理装置の制御方法であって、
パケットを受信する受信ステップと、
前記受信ステップで受信した受信パケットを受信バッファに格納する格納ステップと、
前記格納ステップによって受信バッファに格納されたパケットに対する処理を実行する処理ステップとを備え、
前記省電力モードから通常電力モードに移行する要因となる特定のパケットを前記受信ステップで受信した場合、前記格納ステップでは、第1の受信バッファ群に含まれるいずれかの受信バッファに前記特定のパケットを格納し、
前記特定のパケットに対して前記処理ステップで実行する処理が完了するまでの間に前記受信ステップで新たなパケットを受信した場合、前記格納ステップでは、前記第1の受信バッファ群とは異なる第2の受信バッファ群に含まれるいずれかの受信バッファに前記新たなパケットを格納し、
前記特定のパケットに対して前記処理ステップで実行する処理が完了した後に前記受信ステップで新たなパケットを受信した場合、前記格納ステップでは、前記第1の受信バッファ群に含まれるいずれかの受信バッファに前記新たなパケットを格納することを特徴とする制御方法。 - 省電力モードで動作可能な情報処理装置の制御方法であって、
パケットを受信する受信ステップと、
前記受信ステップで受信した受信パケットを記憶手段に格納する格納ステップと、
前記格納ステップによって記憶手段に格納されたパケットに対する処理を実行する処理ステップとを備え、
前記省電力モードから通常電力モードに移行する要因となる特定のパケットを前記受信ステップで受信した場合、前記格納ステップでは、第1の記憶手段に前記特定のパケットを格納し、
前記特定のパケットに対して前記処理ステップで実行する処理が完了するまでの間に前記受信ステップで新たなパケットを受信した場合、前記格納ステップでは、前記第1の記憶手段とは異なる第2の記憶手段に前記新たなパケットを格納し、
前記特定のパケットに対して前記処理ステップで実行する処理が完了した後に前記受信ステップで新たなパケットを受信した場合、前記格納ステップでは、前記第1の記憶手段に前記新たなパケットを格納することを特徴とする制御方法。 - 請求項8又は9に記載の情報処理装置の制御方法をコンピュータに実行させるためのプログラム。
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