JP5584092B2 - Dc−dcコンバータ - Google Patents
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Description
<降圧型DC−DCコンバータ>
図4は本発明の降圧型DC−DCコンバータの動作を説明するための回路図である。以下に、図4に示す降圧型DC−DCコンバータに基づいて具体的な動作を説明する。
非軽負荷時とは、入力端子101からコンバータ部100に流れる電流が大きく、DCM制御信号S3が出力されない場合を意味する。非軽負荷時には、フィードフォワード信号S1は基準信号S2よりも常に大きく、第1のコンパレータ220からはDCM制御信号S3は出力されない。
軽負荷時とは、入力端子101からコンバータ部100に流れる電流が小さくなり、DCM制御が開始される時を意味する。
図2(b)の昇圧型DC−DCコンバータは、図2(a)の降圧型DC−DCコンバータとは、コンバータ部100および誘導素子Lの配置が異なる。図2(b)の昇圧型DC−DCコンバータに関しても、図4の降圧型DC−DCコンバータと同様に、ドライバ部200のフィードフォワード信号(S1)を出力する回路210、PWM信号(S5)を出力する回路230、駆動信号生成回路240が図3(a)、(b)、(c)それぞれの回路図からなるとして、以下に降圧型DC−DCコンバータの動作を説明する。
非軽負荷時には、降圧型DC−DCコンバータの場合と同様にデューティー比を制御し、スイッチングトランジスタM1およびM2のオン、オフ状態を相補的に繰り返す。
非軽負荷時には、図2(b)のスイッチングトランジスタM2を動作させずに、スイッチングトランジスタM2のバックダイオードのみで昇圧し、スイッチングトランジスタM2のスイッチングロス(すなわちゲートの充放電電流)を無くす事で効率を向上させる。
101 入力端子
102 出力端子
200 ドライバ部
210 フィードフォワード信号(S1)を出力する回路
220 第1のコンパレータ
230 PWM信号(S5)を出力する回路
231 第2のコンパレータ
232 第2のオシレータ
233 第2のフリップフロップ
240 駆動信号生成回路
241 第1のオシレータ
242 第1のフリップフロップ
243 インバータ
244 AND回路
902 出力端子
L 誘導素子
S901 出力端子902の電圧に基づく信号
S902 誘導素子Lに流れる電流ILに基づく信号
M901、M902 スイッチングトランジスタ
M1 第1のスイッチングトランジスタ
M2 第2のスイッチングトランジスタ
M3、M4 トランジスタ
S1 フィードフォワード信号
S2 基準信号
S3 DCM制御信号
S4 出力端子102の信号
S5 PWM信号
S6 第1のオシレータ241からのクロック信号
S7 ランプ信号
S8 第2のコンパレータ231からの出力信号
S9 第2のオシレータ232からのクロック信号
S10 第1の駆動信号
S20 第2の駆動信号
Claims (5)
- DC−DCコンバータであって、電源電圧が接続される入力端子と出力端子との間に、
誘導素子と、
第1のスイッチングトランジスタと第2のスイッチングトランジスタからなるコンバータ部と、
前記コンバータ部に第1の駆動信号および第2の駆動信号を出力するドライバ部と
を備え、
前記ドライバ部が、
前記入力端子から前記コンバータ部に流れる電流に基づくフィードフォワード信号を出力する回路と、
前記フィードフォワード信号と基準信号とが入力され、DCM制御信号を出力する第1のコンパレータと、
前記出力端子の信号に基づいて定まるデューティー比のPWM信号を出力する回路と、
前記PWM信号に基づいて前記コンバータ部の前記第1のスイッチングトランジスタに前記第1の駆動信号を、前記第2のスイッチングトランジスタに前記第2の駆動信号をそれぞれ出力する機能と、前記DCM制御信号に基づいて前記第2の駆動信号を所定の期間LOWにする機能と、を有する駆動信号生成回路と、
を有し、
前記駆動信号生成回路が、
セットに第1のオシレータからのクロック信号が入力され、リセットに前記DCM制御信号が入力される第1のフリップフロップと、
前記PWM信号を反転させた信号を第1の駆動信号として出力するインバータと、
前記第1のフリップフロップの出力と前記PWM信号が入力され、前記第2の駆動信号を出力するAND回路と
からなることを特徴とするDC−DCコンバータ。 - 前記フィードフォワード信号を出力する回路が、カレントミラー回路であることを特徴とする請求項1に記載のDC−DCコンバータ。
- 前記PWM信号を出力する回路が、
前記出力端子の信号とランプ信号とが入力される第2のコンパレータと、
セットに第2のオシレータからのクロック信号が入力され、リセットに前記第2のコンパレータからの出力信号が入力され、前記PWM信号を出力する第2のフリップフロップからなることを特徴とする請求項1または2に記載のDC−DCコンバータ。 - DC−DCコンバータであって、電源電圧が接続される入力端子と出力端子との間に、
誘導素子と、
第1のスイッチングトランジスタと第2のスイッチングトランジスタからなるコンバータ部と、
前記コンバータ部に第1の駆動信号および第2の駆動信号を出力するドライバ部と
を備え、
前記ドライバ部が、
前記入力端子から前記コンバータ部に流れる電流に基づくフィードフォワード信号を出力する回路と、
前記フィードフォワード信号と基準信号とが入力され、DCM制御信号を出力する第1のコンパレータと、
前記出力端子の信号に基づいて定まるデューティー比のPWM信号を出力する回路と、
前記PWM信号に基づいて前記コンバータ部の前記第1のスイッチングトランジスタに前記第1の駆動信号を、前記第2のスイッチングトランジスタに前記第2の駆動信号をそれぞれ出力する機能と、前記DCM制御信号に基づいて前記第2の駆動信号を所定の期間LOWにする機能と、を有する駆動信号生成回路と、
を有し、
前記PWM信号を出力する回路が、
前記出力端子の信号とランプ信号とが入力される第2のコンパレータと、
セットに第2のオシレータからのクロック信号が入力され、リセットに前記第2のコンパレータからの出力信号が入力され、前記PWM信号を出力する第2のフリップフロップからなることを特徴とするDC−DCコンバータ。 - 前記フィードフォワード信号を出力する回路が、カレントミラー回路であることを特徴とする請求項4に記載のDC−DCコンバータ。
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Application Number | Priority Date | Filing Date | Title |
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JP2010244478A JP5584092B2 (ja) | 2010-10-29 | 2010-10-29 | Dc−dcコンバータ |
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