JP4545907B2 - 化合物半導体装置 - Google Patents

化合物半導体装置 Download PDF

Info

Publication number
JP4545907B2
JP4545907B2 JP2000273483A JP2000273483A JP4545907B2 JP 4545907 B2 JP4545907 B2 JP 4545907B2 JP 2000273483 A JP2000273483 A JP 2000273483A JP 2000273483 A JP2000273483 A JP 2000273483A JP 4545907 B2 JP4545907 B2 JP 4545907B2
Authority
JP
Japan
Prior art keywords
layer
semiconductor device
compound semiconductor
channel layer
mesfet
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP2000273483A
Other languages
English (en)
Other versions
JP2002083823A (ja
Inventor
俊英 吉川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP2000273483A priority Critical patent/JP4545907B2/ja
Priority to US09/818,646 priority patent/US6501105B2/en
Publication of JP2002083823A publication Critical patent/JP2002083823A/ja
Application granted granted Critical
Publication of JP4545907B2 publication Critical patent/JP4545907B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/10Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode not carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
    • H01L29/1025Channel region of field-effect devices
    • H01L29/1029Channel region of field-effect devices of field-effect transistors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • H01L29/201Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds including two or more compounds, e.g. alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/80Field effect transistors with field effect produced by a PN or other rectifying junction gate, i.e. potential-jump barrier
    • H01L29/812Field effect transistors with field effect produced by a PN or other rectifying junction gate, i.e. potential-jump barrier with a Schottky gate

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Ceramic Engineering (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Junction Field-Effect Transistors (AREA)

Description

【0001】
【発明の属する技術分野】
本発明は、化合物半導体装置に関し、より詳しくは、MESFET(Metal-Semiconductor FET) を有する化合物半導体装置に関する。
【0002】
【従来の技術】
携帯電話基地局用パワーアンプは、近年、電源電圧の向上とパワー特性の向上の要求が高くなり、パワーアンプに使用されるトランジスタは高耐圧化が必須となる。
しかし、GaAsチャネル層を有するMESFETは、電界集中によりGaAsチャネル層が破壊され易いために電源電圧の向上に対応することが難しく、パワーアンプには不向きとなってきている。
【0003】
そこで、MESFETの高耐圧化が望まれることになる。
MESFETの破壊耐圧を向上するために、図1に示すように、チャネル層をGaAsからInGaP に変えた構造のものがある。
図1において、半絶縁性のGaAs基板101 上にはAlGaAsよりなるバッファ層102 が形成され、さらにバッファ層102 の上にはn型In0.52Ga0.48P よりなるチャネル層103 とアンドープAlGaAsよりなる障壁層104 が順に形成されている。
【0004】
また、障壁層104 の上には、アンドープのGaAs層よりなるコンタクト層105 が形成されている。そのコンタクト層105 には障壁層104 を露出する開口105aが形成され、その開口105aを通して障壁層104 にゲート電極106 が接続されている。
ゲート電極106 と障壁層104 はショットキー接合される。
さらに、ゲート電極106 の両側では、コンタクト層105 にソース電極107 とドレイン電極108 が接続されている。コンタクト層105 のうちのソース電極107 とドレイン電極108 の下には高濃度でn型不純物がイオン注入されており、これによりソース電極107 とドレイン電極108 はそれぞれキャップ層105 と抵抗(オーミック)接触している。
【0005】
以上のようなInGaP チャネル層を有するMESFETは、GaAsチャネル層を有するMESFETに比べて破壊耐圧が2〜3倍程度高くなる。
【0006】
【発明が解決しようとする課題】
以上のように、チャネル層がInGaP から構成されたMESFETは、従来に比べて、破壊耐圧が高いが、チャネル層103 中の移動度は低いので、抵抗が高く、相互コンダクタンス(gm )が低い。これにより、利得が従来よりも低くなってしまい、破壊耐圧の向上という利点が生かせない。
【0007】
本発明の目的は、従来よりも利得が高くなるトランジスタを有する化合物半導体装置を提供することにある。
【0008】
【課題を解決するための手段】
上記した課題は、MESFETのチャネル層をInGaPSb から構成することによって解決される。
InGaPSb から構成されたチャネル層を有するMESFETは、従来のMESFETに比べ、浅い閾値電圧で低いシート抵抗とすることができるために、破壊耐圧を下げることなく相互コンダクタンスや利得を大きくすることができる。
【0009】
【発明の実施の形態】
以下に本発明の実施形態を図面に基づいて説明する。
図2は、本発明の実施形態に係るMESFETを示す断面図である。
図2において、半絶縁性のGaAs基板1上にはアンドープAl0.3Ga0.7Asよりなるバッファ層2が例えば300nmの厚さに形成され、さらにバッファ層2の上にはn型のInx Ga1-x P y Sb1-y (但し、0.3<x<0.7、0.9<y<0.999999)よりなるチャネル層3が例えば150nmの厚さに形成されている。このチャネル層3の中には、濃度1.5×1017cm-3のシリコンが含有されている。
【0010】
チャネル層3上には、アンドープAl0.3Ga0.7Asよりなるショットキー障壁層4が例えば20nmの厚さに形成されている。さらに、ショットキー障壁層4の上には、アンドープGaAs又はn型GaAsよりなるコンタクト層5が形成されている。そのコンタクト層5には、ショットキー障壁層4を露出する開口5aが形成され、その開口5aを通してショットキー障壁層4にゲート電極6が接続されている。ゲート電極6とショットキー障壁層4は、ショットキー接合される。ゲート電極6は、タングステン膜、タングステンシリサイド膜、アルミニウム膜等から形成される。
【0011】
さらに、ゲート電極6の両側においては、コンタクト層5にシリコンをイオン注入することによりオーミックコンタクト領域が形成され、その上にソース電極7とドレイン電極8がそれぞれオーミック接合されている。ソース電極7,ドレイン電極8は、例えば金膜から形成される。
上記したバッファ層2からコンタクト層5までの各層は、例えばMOCVD法によって形成される。そして、III 族元素のガリウム(Ga)、インジウム(In)、アルミニウム(Al)、アンチモン(Sb)と、V族元素の砒素(As)、リン(P)のそれぞれのソースガスとして例えば次のようなものが使用される。
【0012】
例えば、ガリウムのソースガスとしてトリメチルガリウム(TMG)又はトリエチルガリウム(TEG)があり、アルミニウムのソースガスとしてトリメチルアルミニウム(TMAl)があり、インジウムのソースガスとしてトリメチルインジウム(TMI)があり、アンチモンのソースガスとしてトリメチルアンチモン(TMSb)がある。また、砒素のソースガスとしてアルシン(AsH3)があり、リンのガスとしてホスフィン(PH3)がある。また、n型ドーパント用のガスとしてジシラン(Si2H6 )が使用される。
【0013】
各III-V族半導体層2〜5までを成長する成長炉として、減圧横型CVD炉を使用する。そして、その減圧横型CVD炉を使用してIII-V族半導体層2〜5を形成するためには、成長温度を例えば600〜750℃に設定し、成長雰囲気を減圧して76Torr程度の圧力となるように調整する。
なお、GaAs基板1は、(100)から2度オフした面を有し、その面の上にバッファ層2等が形成される。
【0014】
次に、図2に示した本実施形態のMESFETの構造において、GaAs基板1上にInGaPSb チャネル層3までを成長して、チャネル層3のキャリア濃度プロファイルを評価したところ、図3の実線に示す結果が得られた。この実験で使用したチャネル層3を構成するInx Ga1-x P y Sb1-y の組成比x、yは、それぞれx=0.52、y=0.999999である。図3のInGaPSb チャネル層3のキャリア濃度プロファイルは、破線で示した従来のInGaP チャネルの構造のキャリア濃度プロファイルと比較して示されている。従来のInGaP チャネル層の場合は、Al0.3Ga0.7Asバッファ層との界面にキャリアの蓄積が見られる。これに対して、InGaPSb チャネル層3の場合は、キャリアの蓄積が見られない。
【0015】
それらのキャリア濃度プロファイルの差は、得られるデバイスの閾値電圧の差として現れる。チャネル層としてInGaPSb を用いた場合は閾値電圧が−2.5Vであるが、チャネル層としてInGaP を用いた場合は−5.7Vと深くなる。
図4は、図1、図2の構造におけるシート抵抗とデバイスの閾値電圧の関係を示す。同じシート抵抗では、InGaPSb チャネル層3の方がInGaP チャネル層103 よりも閾値電圧が1V浅い。この結果、同じ電流駆動能力を有するMESFETにおいて、相互コンダクタンスgm が異なることになる。それらの相互コンダクタンスの差を表1に示す。
【0016】
【表1】
Figure 0004545907
【0017】
表1によれば、InGaP チャネル層103 と比較して、InGaPSb チャネル層3を採用することにより同じ耐圧を維持しながら相互コンダクタンスgm を40%向上することができた。
なお、上記した実施形態における障壁層4上にコンタクト層5を形成せずに、障壁層4上にソース電極7とドレイン電極8を形成してもよい。また、上記実施形態では、n型不純物としてシリコンを用いたがセレンを用いてもよい。
(付記1)基板の上に不純物がドープされて形成されたInx Ga1-x P y Sb1-y (但し0.3<x<0.7、0.9<y<0.999999)よりなるチャネル層と、 前記チャネル層上に形成された障壁層と、
前記障壁層上に形成されたゲート電極と、
前記障壁層の上であってゲート電極の両側に離れて形成されたソース電極とドレイン電極と
を有するMESFETを備えたことを特徴とする化合物半導体装置。
(付記2)前記基板はGaAs基板であることを特徴とする付記1に記載の化合物半導体装置。
(付記3)前記基板と前記チャネル層の間にはAlGaAsからなるバッファ層が形成されていることを特徴とする付記1、付記2のいずれかに記載の化合物半導体装置。
(付記4)前記障壁層はアンドープAlGaAs層であることを特徴とする付記1に記載の化合物半導体装置。
(付記5)前記AlGaAs層において、Gaの組成はAlの組成より多いことを特徴とする付記4に記載の化合物半導体装置。
(付記6)前記ソース電極と前記障壁層の間と、前記ドレイン電極と前記障壁層の間には、コンタクト層が形成されていることを特徴とする付記1に記載の化合物半導体装置。
(付記7)前記コンタクト層は、不純物がドープされたGaAsから構成されていることを特徴とする付記6に記載の化合物半導体装置。
(付記8)前記不純物は、シリコン、セレンのいずれかであることを特徴とする付記1又は付記7に記載の化合物半導体装置。
【0018】
【発明の効果】
以上述べたように本発明によれば、MESFETのチャネル層をInGaPSb から形成したので、相互コンダクタンスを従来よりも高くすることができる。
【図面の簡単な説明】
【図1】従来のMESFETを示す断面図である。
【図2】本発明の第1実施形態のMESFETを示す断面図である。
【図3】本発明の第1実施形態のMESFETと従来のMESFETのそれぞれのチャネル層のキャリア濃度プロファイルを示す図である。
【図4】本発明の第1実施形態のMESFETと従来のMESFETのそれぞれのシート抵抗と閾値電圧(Vth)の関係を示す図である。
【符号の説明】
1…GaAs基板、2…バッファ層、3…InGaPSb チャネル層、4…障壁層、5…コンタクト層、6…ゲート電極、7…ソース電極、8…ドレイン電極、101…がh基板、102…バッファ層、103…InGaP チャネル層、104…障壁層、105…コンタクト層、106…ゲート電極、107…ソース電極、108…ドレイン電極。

Claims (3)

  1. 基板の上に不純物がドープされて形成されたInx Ga1-x P y Sb1-y (但し、0.3<x<0.7、0.9<y<0.999999)よりなるチャネル層と、
    前記チャネル層上に形成された障壁層と、
    前記障壁層上に形成されたゲート電極と、
    前記障壁層の上であってゲート電極の両側に離れて形成されたソース電極とドレイン電極と
    を有するMESFETを備えたことを特徴とする化合物半導体装置。
  2. 前記基板はGaAs基板であることを特徴とする請求項1に記載の化合物半導体装置。
  3. 前記基板と前記チャネル層の間にはAlGaAsからなるアンドープバッファ層が形成されていることを特徴とする請求項1、請求項2のいずれかに記載の化合物半導体装置。
JP2000273483A 2000-09-08 2000-09-08 化合物半導体装置 Expired - Lifetime JP4545907B2 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP2000273483A JP4545907B2 (ja) 2000-09-08 2000-09-08 化合物半導体装置
US09/818,646 US6501105B2 (en) 2000-09-08 2001-03-28 Compound semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2000273483A JP4545907B2 (ja) 2000-09-08 2000-09-08 化合物半導体装置

Publications (2)

Publication Number Publication Date
JP2002083823A JP2002083823A (ja) 2002-03-22
JP4545907B2 true JP4545907B2 (ja) 2010-09-15

Family

ID=18759419

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2000273483A Expired - Lifetime JP4545907B2 (ja) 2000-09-08 2000-09-08 化合物半導体装置

Country Status (2)

Country Link
US (1) US6501105B2 (ja)
JP (1) JP4545907B2 (ja)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100595899B1 (ko) * 2003-12-31 2006-06-30 동부일렉트로닉스 주식회사 이미지 센서 및 그 제조방법

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001203215A (ja) * 2000-01-21 2001-07-27 Fujitsu Ltd 半導体装置及びその製造方法

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5595370A (en) * 1979-01-10 1980-07-19 Nec Corp Compound semiconductor field-effect transistor
JPS55120167A (en) * 1979-03-08 1980-09-16 Nippon Telegr & Teleph Corp <Ntt> Field effect type semiconductor device
JPS60251666A (ja) * 1984-05-28 1985-12-12 Seiko Epson Corp 薄膜トランジスタ
JPS62183176A (ja) * 1986-02-07 1987-08-11 Hitachi Ltd 半導体装置
JPH01186672A (ja) * 1988-01-14 1989-07-26 Nec Corp ショットキー接合構造
JPH03241840A (ja) * 1990-02-20 1991-10-29 Fujitsu Ltd 半導体装置及びその製造方法
JPH04273447A (ja) * 1991-02-28 1992-09-29 Fujitsu Ltd 半導体装置
JP3200142B2 (ja) * 1991-03-28 2001-08-20 旭化成株式会社 電界効果型トランジスタ
JPH0815213B2 (ja) 1993-01-14 1996-02-14 日本電気株式会社 電界効果トランジスタ
JP2581452B2 (ja) * 1994-06-06 1997-02-12 日本電気株式会社 電界効果トランジスタ
JPH08306909A (ja) * 1995-04-28 1996-11-22 Asahi Chem Ind Co Ltd InGaAs電界効果型トランジスタ
US5767539A (en) * 1996-04-05 1998-06-16 Nec Corporation Heterojunction field effect transistor having a InAlAs Schottky barrier layer formed upon an n-InP donor layer
JP3373386B2 (ja) * 1997-03-19 2003-02-04 富士通株式会社 半導体装置及びその製造方法
US6232624B1 (en) * 1999-07-12 2001-05-15 Hughes Electronics Corporation InPSb channel HEMT on InP for RF application

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001203215A (ja) * 2000-01-21 2001-07-27 Fujitsu Ltd 半導体装置及びその製造方法

Also Published As

Publication number Publication date
US6501105B2 (en) 2002-12-31
JP2002083823A (ja) 2002-03-22
US20020050604A1 (en) 2002-05-02

Similar Documents

Publication Publication Date Title
KR101656531B1 (ko) 반도체 장치 및 그 제조 방법
JP3428962B2 (ja) GaN系高移動度トランジスタ
US9362389B2 (en) Polarization induced doped transistor
KR100642191B1 (ko) 헤테로 접합 전계 효과 트랜지스터 및 그 제조 방법
KR100707324B1 (ko) 반도체 장치 및 이의 제조 방법
US20010015437A1 (en) GaN field-effect transistor, inverter device, and production processes therefor
JP3790500B2 (ja) 電界効果トランジスタ及びその製造方法
US8872231B2 (en) Semiconductor wafer, method of producing semiconductor wafer, and electronic device
US7786509B2 (en) Field-effect transistor and method of making same
US8698202B2 (en) Semiconductor device
US5682040A (en) Compound semiconductor device having a reduced resistance
JP3449116B2 (ja) 半導体装置
JP2001308196A (ja) 絶縁ゲート型半導体装置
JP4545907B2 (ja) 化合物半導体装置
JP5119644B2 (ja) Iii−v族化合物半導体エピタキシャルウェハ
JP2002009253A (ja) 半導体装置およびその製造方法
US20050189565A1 (en) Bipolar transistor and method of manufacturing the same
JPH02111073A (ja) 絶縁ゲート電界効果トランジスタおよびその集積回路装置
JP2000022135A (ja) 電界効果トランジスタ
JP2001111037A (ja) 半導体ウェハ及び電界効果トランジスタ
JP2800770B2 (ja) 電界効果トランジスタ及びその製造方法
JP2002025922A (ja) Iii−v族化合物半導体の製造方法
JP2001326345A (ja) 化合物半導体エピタキシャルウェハ及びhemt
Lin et al. Improved InAlGaP-based heterostructure field-effect transistors
JP2728121B2 (ja) 電界効果トランジスタ、及びその製造方法

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20060817

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20091228

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20100629

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20100701

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130709

Year of fee payment: 3

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

Ref document number: 4545907

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

EXPY Cancellation because of completion of term