JP4248403B2 - 誘導センサ用評価回路 - Google Patents
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Description
電磁センサを備え、該電磁センサは定電流を用いた外部励磁部を持っており、
相互コンダクタンス増幅器を備え、該増幅器の反転入力側には前記センサの出力信号が供給され、かつ該増幅器の出力信号は反転形低域通過フィルタにおいて参照電圧に変換され、該参照電圧は相互コンダクタンス増幅器の非反転入力側に供給され、
デジタル化回路を備え、該デジタル化回路はシュミットトリガーとこれに対して並列である電圧コンパレータとを有しており、該シュミットトリガーおよび電圧コンパレータともに相互コンダクタンス増幅器の出力信号および参照電圧が供給され、ここでシュミットトリガーはヒステリスを伴った出力信号を送出しかつ電圧コンパレータはヒステリスを伴わない出力信号を送出し、
論理回路を備え、該論理回路はデジタル化回路の2つの出力信号から評価回路のヒステリスを伴わない出力信号を形成しかつ後続の処理のために使用できるようにする
ことによって解決される。
図1は本発明の評価回路の基本的な回路構成を示し、かつ
図2はこの回路の種々の信号経過を示している。
ヒステリス遅延を有していない、かつ
マルチトリガーが生じていない。
Claims (4)
- 誘導センサ(1)、例えば自動車の内燃機関のクランク軸の回転特性を捕捉検出するためのセンサ用の評価回路であって、
電磁センサ(1)を備え、該電磁センサは定電流を用いた外部励磁部(2)を持っており、
相互コンダクタンス増幅器(3,A1)を備え、該増幅器の反転入力側には前記センサ(1)の出力信号(s1)が供給され、かつ該増幅器の出力信号は反転形低域通過フィルタ(A2)において参照電圧(Vref)に変換され、該参照電圧は相互コンダクタンス増幅器(A1)の非反転入力側に供給され、
デジタル化回路(4)を備え、該デジタル化回路はシュミットトリガー(K1)とこれに対して並列である電圧コンパレータ(K2)とを有しており、該シュミットトリガーおよび電圧コンパレータともに相互コンダクタンス増幅器(A1)の出力信号(s2)および参照電圧(Vref)が供給され、ここでシュミットトリガー(K1)は該シュミットトリガーにより規定される時間遅延を伴った出力信号(k1)を送出しかつ電圧コンパレータ(K2)はを時間遅延を伴わない出力信号(k2)を送出し、かつ
論理回路(5)を備え、該論理回路はデジタル化回路(4)の2つの出力信号(k1,k2)から評価回路の時間遅延を伴わない出力信号(Out)を形成し、該時間遅延を伴わない出力信号は前記相互コンダクタンス増幅器(A1)の出力信号(s2)の、前記参照電圧(Vref)のレベルに対する、上昇するおよび下降する通過に位相同期して切り替わりかつ後続の処理のために使用できるようにする
評価回路。 - 前記論理回路(5)は2つのインバータ(N1,N2)および4つのNANDゲート(U1〜U4)を有しており、
このうち1つのインバータ(N1)の入力側およびこのうち1つのNANDゲート(U2)の入力側は前記シュミットトリガー(K1)の出力側に接続されており、
別のインバータ(N2)の入力側および前記NANDゲート(U2)の他方の入力側は電圧コンパレータ(K2)の出力側に接続されており、
前記最初のインバータ(N1)の出力側は別のNANDゲート(U1)の1つの入力側に接続されており、かつ前記別のインバータ(N2)の出力側は該別のNANDゲート(U1)の別の入力側に接続されており、
該別のNANDゲート(U1)の出力側は更に別のNANDゲート(U3)の入力側に接続されておりかつ前記最初のNANDゲート(U2)の出力側は更にもう1つ別のNANDゲート(U4)の入力側に接続されており、かつ
該2つの更に別のNANDゲート(U3)および更にもう1つ別のNANDゲート(U4)は、該更にもう1つ別のNANDゲート(U4)の出力側を更に別のNANDゲート(U3)の前記とは別の入力側に接続しかつセンサシステムの出力信号(Out)が引き続く処理のために取り出される、前記更に別のNANDゲート(U3)の出力側を該更にもう1つ別のNANDゲート(U4)の前記とは別の入力側に接続することによってトランスペアレントなRSフリップフロップを形成している
請求項1記載の評価回路。 - 上側の電圧しきい値(oS)、中位の電圧しきい値(mS)および下側の電圧しきい値(uS)が前以て決められており、
前記参照電圧(Vref)が中位の電圧しきい値(mS)を上回るとき、断線が識別され、
前記参照電圧(Vref)が上側の電圧しきい値(oS)を上回るとき、バッテリー電圧電位への短絡が識別され、
前記参照電圧(Vref)が下側の電圧しきい値(uS)を下回るとき、基準電圧電位(GND)への短絡が識別される
請求項1記載の評価回路。 - 給電電圧(Vcc)と基準電圧電位(GND)との間に、上側の電圧しきい値(oS)、中位の電圧しきい値(mS)および下側の電圧しきい値(uS)を形成するための分圧器(R13〜R16)が設けられており、
電圧コンパレータ(K3)が設けられており、該電圧コンパレータにおいて参照電圧(Vref)が上側の電圧しきい値(oS)と比較され、
電圧コンパレータ(K4)が設けられており、該電圧コンパレータにおいて参照電圧(Vref)が中位の電圧しきい値(mS)と比較され、かつ
参照電圧(Vref)が中位の電圧しきい値(mS)および上側の電圧しきい値(oS)を上回っていないまたは下側の電圧しきい値(uS)を下回っていないときローである、電圧コンパレータ(K3〜K5)の出力信号のレベルが保持回路(H)に記憶され、該保持回路から該レベルを引き続く処理のために呼び出すことができかつ該記憶されたレベルはリセット信号(Reset)によって消去可能である
請求項3記載の評価回路。
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