JP4228020B2 - 受光増幅回路、光ピックアップ装置および光ディスク装置 - Google Patents
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Description
フォーカスエラー信号=Va+Vc−(Vb+Vd) …(2)
トラッキングエラー信号=Ve−Vf …(3)
上記のフォトダイオードPDAを含む受光増幅回路101aを一例として、信号光電流−電圧変換の動作原理を説明する。
Vsig=Von−Vod …(4)
と表される。ここで、光電流をIaとし、ゲイン抵抗をR1とすると、出力電圧Vonは、
Von=R1×Ia+Vref …(5)
と表される。ここで、Vrefは、外部より与えられる基準電源電位である。
Vod=Vref−R2×Ib2−VBE2+VBE1+R1×Ib1 …(6)
と表される。これにより、信号電圧Vsigは、
Vsig=R1×Ia−(−R2×Ib2−VBE2+VBE1+R1×Ib1) …(7)
と表される。式(7)における第2項以降が誤差となる。受光増幅回路では、式(2)に示すようなフォーカス信号での演算信号の精度の高いことが重要であるので、上記の誤差(オフセット電圧)によって演算信号の精度が低下することが問題となる。つまりVod≒Vrefであることが重要な条件であり、これを満たすには、無信号光時に、
R1×Ib1≒R2×Ib2 …(8)
VBE1≒VBE2 …(9)
という条件を満たすことが必要である。
Voff=Vod−Vref …(10)
と表される。受光増幅回路におけるオフセット電圧は、±15mV以下の精度が要求される。したがって、この精度を満たすには、式(8)より、従来の受光増幅回路においては、リファレンス抵抗R2の抵抗値をゲイン抵抗R1の抵抗値と等しくする必要がある。
Vn=√(Ni12+Ni22+Nr12+Nr22) …(11)
と表される。ここで、Ni1,Ni2は、トランジスタTr101,Tr102より発生するショットノイズに起因するノイズを示し、Nr1,Nr2は、抵抗R1,R2より発生する熱雑音に起因するノイズを表し、それぞれ素子が起因するノイズの二乗平均となる。
R1>R5 …(12)
と表される。信号再生時は、信号光量が小さいために、高いゲインを必要とするので、スイッチSW101をOFF状態とする。これにより、ゲイン抵抗R1のみが駆動されるので、再生信号がI−V変換される。信号記録時は、信号光量が大きいために、大光量信号での回路飽和を防止することから、ゲインは低くなければならない。したがって、信号書込み時には、スイッチSW101がON状態となることにより、ゲイン抵抗R1,R5が駆動される。このときのゲインGonは、
Gon=R1×R5/(R1+R5) …(13)と表される。
本発明の一実施形態について図1ないし図3に基づいて説明すると、以下の通りである。
Is1=(Rf1/Rref1−1)×Ib …(14)
と表される。ここで、Ibは、差動回路DEFにおける差動トランジスタ対(トランジスタTr1,Tr2)のベースに流れるベース電流である。
Ic5=Ic4=(Ic3/2)×(Rf1/Rref1) …(15)
Ib5=Ic5/hfe=(Ic3/2)×(Rf1/Rref1)/hfe …(16)
Ic6=Ic7=Ic3/2 …(17)
Ib7=Ic7/hfe=Ic3/2/hfe …(18)
Is1=Ib5−Ib7=(Ic3/2)×(Rf1/Rref1)/hfe
−Ic3/2/hfe
=Ic3/2/hfe×(Rf1/Rref1−1) …(19)
と表される。
Ib1≒Ib2=Ic3/2/hfe …(20)
と表される。
VRf1=Rf1×Ib1=Rf1×Ic3/2/hfe …(21)
と表される。また、リファレンス抵抗Rref1の端子間で発生する電圧VRref1は、補償回路2がない場合、
VRref1=Rref1×Ib2=Rref1×Ic3/2/hfe …(22)
と表される。したがって、帰還抵抗Rf1およびリファレンス抵抗Rref1の抵抗対で発生する電圧差Vdef1は、
Vdef1=VRf1−VRref1
=Rf1×Ic3/2/hfe−Rref1×Ic3/2/hfe
=Ic3/2/hfe×(Rf1−Rref1) …(23)
と表される。したがって、この電圧差Vdef1(=VRf1−VRref1)がオフセット電圧となる。
VRref1=Rref1×(Ib2+Is1)
=Rref1×
(Ic3/2/hfe+Ic3/2/hfe×(Rf1/Rref1−1))
=Rf1×Ic3/2/hfe …(24)
と表される。したがって、電圧差Vdef1は、
Vdef1=VRf1−VRref1
=Rf1×Ic3/2/hfe−Rf1×Ic3/2/hfe=0 …(25)
と表される。このように、補償回路2によって、リファレンス抵抗Rref1に流れる電流が補償電流Is1だけ増大する。これにより、帰還抵抗Rf1の端子間電圧とリファレンス抵抗Rref1の端子間電圧との差がなくなるので、オフセット電圧が0となる。
本発明の一実施形態について図4ないし図6に基づいて説明すると、以下の通りである。なお、前述の実施の形態1における構成要素と同等の機能を有する本実施の形態における構成要素については、同一の符号を付記してその説明を省略する。
Is11=(1−Rref1/Rf1)×Ib …(26)
と表される。
Ic14=Ic15=Ic13/2 …(27)
Ib15=Ic15/hfe=Ic13/2 …(28)
Ic16=Ic17=Ic13/2×Rref1/Rf1 …(29)
Ib17=Ic17/hfe=Ic13/2×Rref1/Rf1/hfe …(30)
Is11=Ib15−Ib17
=Ic13/2/hfe−Ic13/2×Rref1/Rf1/hfe
=Ic13/2/hfe×(1−Rref1/Rf1) …(31)
と表される。
Ib11≒Ib12=Ic13/2/hfe …(32)
と表される。これにより、リファレンス抵抗Rref1の端子間で発生する電圧VRref1は、
VRref1=Rref1×Ib12=Rref1×Ic13/2/hfe …(33)
と表される。
VRf11=Rf1×Ib1=Rf1×Ic13/2/hfe …(34)
と表される。また、帰還抵抗Rf1とリファレンス抵抗Rref1との抵抗対で発生する電圧差Vdef11は、
Vdef11=VRf11−VRref11
=Rf1×Ic13/2/hfe−Rref1×Ic13/2/hfe
=Ic13/2/hfe×(Rf1−Rref1) …(35)
と表される。したがって、この電圧差Vdef11(=VRf11−VRref11)がオフセット電圧となる。
VRf11=Rf1×(Ib11−Is11)
=Rf1×(Ic13/2/hfe
−Ic13/2/hfe×(1−Rref1/Rf1))
=Rref1×Ic13/2/hfe …(36)
と表される。したがって、電圧差Vdef11は、
Vdef11=VRf11−VRref11
=Rref1×Ic13/2/hfe−Rref1×Ic13/2/hfe
=0 …(37)
と表される。このように、補償回路12によって、リファレンス抵抗Rref1に流れる電流が補償電流Is11だけ増大する。これにより、帰還抵抗Rf1の端子間電圧とリファレンス抵抗Rref1の端子間電圧との差がなくなるので、オフセット電圧が0となる。
本発明の一実施形態について図7および図8に基づいて説明すると、以下の通りである。なお、前述の実施の形態1における構成要素と同等の機能を有する本実施の形態における構成要素については、同一の符号を付記してその説明を省略する。
Is21=(Rf21/Rref21−1)×Ib21 …(38)
Is22=(Rf22/Rref22−1)×Ib22 …(39)
と表される。ここで、Ib21は、差動回路DEF21における差動トランジスタ対(トランジスタTr21,Tr22)のベースに流れるベース電流である。また、Ib22は、差動回路DEF22における差動トランジスタ対(トランジスタTr23,Tr24)のベースに流れるベース電流である。
本発明の一実施形態について図9および図10に基づいて説明すると、以下の通りである。なお、前述の実施の形態3における構成要素と同等の機能を有する本実施の形態における構成要素については、同一の符号を付記してその説明を省略する。
Is31=(1−Rref21/Rf21)×Ib21 …(40)
Is32=(1−Rref22/Rf22)×Ib22 …(41)
と表される。
本発明の一実施形態について図11および図12に基づいて説明すると、以下の通りである。なお、前述の実施の形態3における構成要素と同等の機能を有する本実施の形態における構成要素については、同一の符号を付記してその説明を省略する。
Is41=(Rf21/Rref41−1)×Ib41 …(42)
Is42=(Rf22/Rref42−1)×Ib42 …(43)
と表される。ここで、Ib41は、差動回路DEF21における差動トランジスタ対(トランジスタTr21,Tr22)のベースに流れるベース電流である。また、Ib42は、差動回路DEF22における差動トランジスタ対(トランジスタTr23,Tr24)のベースに流れるベース電流である。
本発明の一実施形態について図13に基づいて説明すると、以下の通りである。なお、前述の実施の形態1における構成要素と同等の機能を有する本実施の形態における構成要素については、同一の符号を付記してその説明を省略する。
Rf53=Rf1×Rf51/(Rf1+Rf51) …(44)
と表される。
Is51=(Rf1/Rref1−1)×Ib …(45)
Is52=(Rf53/Rref1−1)×Ib …(46)
と表される。ここで、Ibは、差動回路DEFにおける差動トランジスタ対(トランジスタTr1,Tr2)のベースに流れるベース電流である。
本発明の一実施形態について図14に基づいて説明すると、以下の通りである。なお、前述の実施の形態1における構成要素と同等の機能を有する本実施の形態における構成要素については、同一の符号を付記してその説明を省略する。
Ic64=Ic63×Rf61/Rref61 …(48)
Ib61=Ic63/hfe …(49)
Ib62=Ic64/hfe=Ic63×Rf61/Rref61/hfe …(50)
と表される。
VRf61=Rf61×Ib61=Rf61×Ic63/hfe …(51)
と表される。また、リファレンス抵抗Rref61の端子間で発生する電圧VRref61は、
能動負荷AL61が補償手段としての機能を備えている場合、
VRref61=Rref61×Ib62
=Rref61×(Ic63×Rf61/Rref61/hfe)
=Rf61×Ic63/hfe …(52)
と表される。よって、両端子間電圧の差は、
VRf61−VRref61=0 …(53)
と表される。このように、帰還抵抗Rf61の端子間電圧とリファレンス抵抗Rref61の端子間電圧の差がなくなるので、オフセット電圧が0となる。
本発明の一実施形態について図24および図25に基づいて説明すると、以下の通りである。なお、前述の実施の形態1における構成要素と同等の機能を有する本実施の形態における構成要素については、同一の符号を付記してその説明を省略する。
Ib2×Rref1=Ib1×Rf1 …(54)
を満たす必要がある。ここで、hfeはNPNトランジスタのhfeであるので、式(54)より、
Ic2/hfe×Rref1=Ic1/hfe×Rf1 …(55)
という関係が成り立つ。したがって、式(54)を満たすには、差動対を構成するトランジスタTr1,Tr2のコレクタ電流Ic1,Ic2を調整する必要がある。
VT×ln(Ic2/Isat)+Re2×Ic2=VT×ln(Ic1/Isat)+Re1×Ic1 …(56)
という関係が成り立つ。
本発明の一実施形態について図26および図27に基づいて説明すると、以下の通りである。なお、前述の実施の形態3における構成要素と同等の機能を有する本実施の形態における構成要素については、同一の符号を付記してその説明を省略する。
Ib22×Rref21=Ib21×Rf21 …(57)
を満たす必要がある。ここで、hfeはNPNトランジスタのhfeであるので、式(57)より、
Ic2/hfe×Rref21=Ic1/hfe×Rf21 …(58)
という関係が成り立つ。したがって、式(57)を満たすには、トランジスタTr21のコレクタ電流とトランジスタTr22のコレクタ電流とを調整する必要がある。
Ib24×Rref23=Ib23×Rf23 …(59)
を満たすように、トランジスタTr23のコレクタ電流とトランジスタTr24のコレクタ電流とを調整する必要がある。
VT×ln(Ic2/Isat)+Re2×Ic2=VT×ln(Ic1/Isat)+Re1×Ic1 …(60)
式(58)および式(60)を満たす抵抗値Re1,Re2を調整する。これにより、帰還抵抗Rf21の端子間電圧とリファレンス抵抗Rref21の端子間電圧との間に生じている電圧差を補正し、良好なオフセット特性を同様に得ることができる。
本発明の一実施形態について図15に基づいて説明すると、以下の通りである。
2,2A,12,21,21A,22,31,32,41,42,51,52 補償回路
DEF,DEF21,DEF22 差動回路
AL61 能動負荷(電流供与回路)
Is1,Is11,Is21,Is22,Is41,Is42,Is51,Is52 補償電流
PD1,PD21,PD22,PD61 フォトダイオード(受光素子)
Re1,Re2 抵抗(第1および第2抵抗)
Rf1,Rf21,Rf41,Rf51,Rf61 帰還抵抗
Rf52 合成帰還抵抗(帰還抵抗)
Rref1,Rref21,Rref23,Rref61 リファレンス抵抗
SW21,SW22 スイッチ(第1選択手段)
SW23,SW24,SW31,SW32,SW41,SW42 スイッチ(第2選択手段)
Tr1,Tr21,Tr23,Tr61 トランジスタ(第1トランジスタ)
Tr2,Tr22,Tr24,Tr62 トランジスタ(第2トランジスタ)
Tr4,Tr14 トランジスタ(第5トランジスタ)
Tr6,Tr16 トランジスタ(第3トランジスタ)
Tr7,Tr17 トランジスタ(第4トランジスタ)
Claims (16)
- 受光素子と、帰還抵抗と、リファレンス抵抗と、前記受光素子および帰還抵抗がベースに接続された第1トランジスタおよび外部基準電位が前記リファレンス抵抗を介してベースに付与される第2トランジスタからなる差動トランジスタ対を含む差動回路とを備え、
前記帰還抵抗の端子間電圧と前記リファレンス抵抗の端子間電圧との差を補償する補償手段を備え、
前記帰還抵抗の抵抗値が前記リファレンス抵抗の抵抗値より大きい受光増幅回路において、
前記補償手段は、前記リファレンス抵抗と前記第2トランジスタのベースとが接続される接続部に前記差を補償する補償電流を供与する電流源であることを特徴とする受光増幅回路。 - 受光素子と、帰還抵抗と、リファレンス抵抗と、前記受光素子および帰還抵抗がベースに接続された第1トランジスタおよび外部基準電位が前記リファレンス抵抗を介してベースに付与される第2トランジスタからなる差動トランジスタ対を含む差動回路とを備え、
前記帰還抵抗の端子間電圧と前記リファレンス抵抗の端子間電圧との差を補償する補償手段を備え、
前記帰還抵抗の抵抗値が前記リファレンス抵抗の抵抗値より大きい受光増幅回路において、
前記補償手段は、前記帰還抵抗と前記第1トランジスタのベースとが接続される接続部に前記差を補償する補償電流を供与する電流源であることを特徴とする受光増幅回路。 - 前記補償電流は、前記帰還抵抗の抵抗値をRfとし、前記リファレンス抵抗の抵抗値をRrefとし、前記第2トランジスタのベース電流をIbとすると、
(Rf/Rref−1)×Ib
と表されることを特徴とする請求項1記載の受光増幅回路。 - 前記補償電流は、前記帰還抵抗の抵抗値をRfとし、前記リファレンス抵抗の抵抗値をRrefとし、前記第1トランジスタのベース電流をIbとすると、
(1―Rref/Rf)×Ib
と表されることを特徴とする請求項2記載の受光増幅回路。 - 前記補償手段は、
カレントミラー回路と、
前記差動トランジスタ対を駆動するバイアス電流に、前記帰還抵抗と前記リファレンス抵抗との抵抗比の1/2を乗じた大きさのバイアス電流を供与する第3トランジスタと、
前記第3トランジスタのコレクタにエミッタが接続されるとともに、ベースが前記カレントミラー回路の入力に接続される第4トランジスタと、
前記差動トランジスタ対を駆動するバイアス電流の1/2倍のバイアス電流を供与し、前記カレントミラー回路の出力にベースが接続される第5トランジスタとを有することを特徴とする請求項1または3記載の受光増幅回路。 - 前記補償手段は、
カレントミラー回路と、
前記差動トランジスタ対を駆動するバイアス電流の1/2倍のバイアス電流を供与する第3トランジスタと、
前記第3トランジスタのコレクタにエミッタが接続されるとともに、前記カレントミラー回路の入力に接続される第4トランジスタと、
前記差動トランジスタ対を駆動するバイアス電流に、前記帰還抵抗と前記リファレンス抵抗との抵抗比の1/2を乗じた大きさのバイアス電流を供与し、前記カレントミラー回路の出力にベースが接続される第5トランジスタとを有することを特徴とする請求項2または4記載の受光増幅回路。 - 異なる波長の光を受光する複数の受光素子と、異なる波長の光に応じて設けられる複数の帰還抵抗と、当該複数の帰還抵抗に応じて設けられる複数のリファレンス抵抗と、各受光素子および各帰還抵抗がベースに接続された複数の第1トランジスタおよび外部基準電位が各リファレンス抵抗を介してベースに付与される複数の第2トランジスタの対応する一対からなる差動トランジスタ対を一つずつ含む複数の差動回路とを備え、
前記複数の差動回路のうち一つを選択して動作させる第1選択手段と、
各帰還抵抗の端子間電圧と各帰還抵抗と対応する各リファレンス抵抗の端子間電圧との差を補償する複数の補償手段と、
前記複数の補償手段のうち前記第1選択手段によって選択された前記差動回路に対応する補償手段を選択して動作させる第2選択手段とを備え、
各帰還抵抗の抵抗値が対応する各リファレンス抵抗の抵抗値より大きい受光増幅回路において、
各補償手段は、互いに対応する前記リファレンス抵抗と前記第2トランジスタのベースとが接続される接続部に前記差を補償する補償電流を供与する電流源であることを特徴とする受光増幅回路。 - 各補償手段が供与する前記補償電流は、互いに対応する各帰還抵抗の抵抗値、各リファレンス抵抗の抵抗値、各第2トランジスタのベース電流をそれぞれRf、Rref、Ibとすると、
(Rf/Rref−1)×Ib
と表されることを特徴とする請求項7記載の受光増幅回路。 - 異なる波長の光を受光する複数の受光素子と、異なる波長の光に応じて設けられる複数の帰還抵抗と、当該複数の帰還抵抗に応じて設けられる複数のリファレンス抵抗と、各受光素子および各帰還抵抗がベースに接続された複数の第1トランジスタおよび外部基準電位が各リファレンス抵抗を介してベースに付与される複数の第2トランジスタの対応する一対からなる差動トランジスタ対を一つずつ含む複数の差動回路とを備え、
前記複数の差動回路のうち一つを選択して動作させる第1選択手段と、
各帰還抵抗の端子間電圧と各帰還抵抗と対応する各リファレンス抵抗の端子間電圧との差を補償する複数の補償手段と、
前記複数の補償手段のうち前記第1選択手段によって選択された前記差動回路に対応する補償手段を選択して動作させる第2選択手段とを備え、
各帰還抵抗の抵抗値が対応する各リファレンス抵抗の抵抗値より大きい受光増幅回路において、
各補償手段は、互いに対応する前記帰還抵抗と前記第1トランジスタのベースとが接続される接続部に前記差を補償する補償電流を供与する電流源であることを特徴とする受光増幅回路。 - 各補償手段が供与する前記補償電流は、互いに対応する各帰還抵抗の抵抗値、各リファレンス抵抗の抵抗値、各第1トランジスタのベース電流をそれぞれRf、Rref、Ibとすると、
(1―Rref/Rf)×Ib
と表されることを特徴とする請求項9記載の受光増幅回路。 - 異なる波長の光を受光する複数の受光素子と、異なる波長の光に応じて設けられる複数の帰還抵抗と、当該複数の帰還抵抗に共通に設けられる単一のリファレンス抵抗と、各受光素子および各帰還抵抗がベースに接続された複数の第1トランジスタおよび外部基準電位が前記リファレンス抵抗を介してベースに付与される複数の第2トランジスタの対応する一対からなる差動トランジスタ対を一つずつ含む複数の差動回路とを備えた受光増幅回路において、
前記複数の差動回路のうち一つを選択して動作させる第1選択手段と、
各帰還抵抗の端子間電圧と各帰還抵抗に共通に設けられる単一の前記リファレンス抵抗の端子間電圧との差を補償する複数の補償手段と、
前記複数の補償手段のうち前記第1選択手段によって選択された前記差動回路に対応する補償手段を選択して動作させる第2選択手段とを備え、
各帰還抵抗の抵抗値が前記リファレンス抵抗の抵抗値より大きいことを特徴とする受光増幅回路。 - 単一の受光素子と、複数の帰還抵抗と、当該複数の帰還抵抗に共通に設けられる単一のリファレンス抵抗と、前記受光素子および各帰還抵抗がベースに接続された第1トランジスタおよび外部基準電位が前記リファレンス抵抗を介してベースに付与される第2トランジスタからなる差動トランジスタ対を含む差動回路とを備えた受光増幅回路において、
前記複数の帰還抵抗のうち一つを選択して前記差動回路に接続する第1選択手段と、
各帰還抵抗の端子間電圧と前記リファレンス抵抗の端子間電圧との差を補償する複数の補償手段と、
前記複数の補償手段のうち前記第1選択手段によって選択された前記帰還抵抗に対応する補償手段を選択して動作させる第2選択手段とを備え、
各帰還抵抗の抵抗値が前記ファレンス抵抗の抵抗値より大きいことを特徴とする受光増幅回路。 - 受光素子と、帰還抵抗と、リファレンス抵抗と、前記受光素子および帰還抵抗がベースに接続された第1トランジスタおよび外部基準電位が前記リファレンス抵抗を介してベースに付与される第2トランジスタからなる差動トランジスタ対を含む差動回路とを備え、
前記帰還抵抗の端子間電圧と前記リファレンス抵抗の端子間電圧との差を補償する補償手段を備え、
前記帰還抵抗の抵抗値が前記リファレンス抵抗の抵抗値より大きい受光増幅回路において、
前記第1トランジスタに直列に接続される第1負荷トランジスタと、前記第2トランジスタに直列に接続される第2負荷トランジスタとを有する能動負荷を備え、
前記補償手段は、前記第1負荷トランジスタのエミッタと電源電位との間に介在する第1抵抗と、前記第2負荷トランジスタのエミッタと電源電位との間に介在する第2抵抗とを有し、該第1および第2抵抗が、前記帰還抵抗と前記リファレンス抵抗との抵抗値差に基づく電圧差を補償するように、前記第1および第2トランジスタのコレクタ電流を決定するための抵抗値に設定されていることを特徴とする受光増幅回路。 - 異なる波長の光を受光する複数の受光素子と、異なる波長の光に応じて設けられる複数の帰還抵抗と、当該複数の帰還抵抗に応じて設けられる複数のリファレンス抵抗と、各受光素子および各帰還抵抗がベースに接続された複数の第1トランジスタおよび外部基準電位が各リファレンス抵抗を介してベースに付与される複数の第2トランジスタの対応する一対からなる差動トランジスタ対を一つずつ含む複数の差動回路とを備えた受光増幅回路において、
前記複数の差動回路のうち一つを選択して動作させる選択手段と、
各帰還抵抗の端子間電圧と各帰還抵抗と対応する各リファレンス抵抗の端子間電圧との差を補償する補償手段とを備え、
前記第1トランジスタに直列に接続される第1負荷トランジスタと、前記第2トランジスタに直列に接続される第2負荷トランジスタとを有する能動負荷を備え、
前記補償手段は、前記第1負荷トランジスタのエミッタと電源電位との間に介在する第1抵抗と、前記第2負荷トランジスタのエミッタと電源電位との間に介在する第2抵抗とを有し、該第1および第2抵抗が、前記帰還抵抗と前記リファレンス抵抗との抵抗値差に基づく電圧差を補償するように、前記第1および第2トランジスタのコレクタ電流を決定するための抵抗値に設定され、
各帰還抵抗の抵抗値が対応する各リファレンス抵抗の抵抗値より大きく設定され、
各帰還抵抗の端子電圧と各帰還抵抗に対応する各リファレンス抵抗の端子間電圧との差が同一となるように、各帰還抵抗および各リファレンス抵抗の抵抗値が設定されていることを特徴とする受光増幅回路。 - 請求項1〜14のいずれか1項に記載の受光増幅回路を備えていることを特徴とする光ピックアップ装置。
- 請求項15に記載の光ピックアップ装置を備えていることを特徴とする光ディスク装置。
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