JP4219341B2 - アナログデジタル変換器、それを用いた信号処理システム、および撮像装置 - Google Patents
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Description
第1実施形態は、本発明の信号処理システムを画像信号の処理に適用した例である。図1は、一般的な画像信号処理システムの基本的な構成を示す。CCD(Charge Coupled Device)12は、被写体からの光を取り込んで電気信号に変換し、これをワンチップ化された画像処理用のシステムLSI10へ入力する。このシステムLSI10には、CDS(Correlated Double Sampling)14、可変増幅器16、AD変換器20、DSP(Digital Signal Processor)18が内蔵されている。
第2実施形態は、本発明の信号処理システムを通信システムに適用した例である。図8は、第2実施形態における信号処理システムの基本的な構成を示す。ここでは、地上波デジタルTV信号を受信するシステムを例に挙げる。アンテナ160は、UHF帯のRF(Radio Frequency:無線周波数)信号を受信し、チューナIC170に出力する。チューナIC170は、図示しないミキサを備え、ダイレクトコンバージョン方式でRF信号を直接ベースバンド信号に変換する。チューナIC170には、可変増幅器172が搭載されており、DSP182からのフィードバック制御により指定される利得にしたがい、ベースバンド信号を増幅する。復調用のシステムLSI180は、AD変換器20およびDSP182を備える。上記ベースバンド信号は、AD変換器20に入力される。AD変換器20は、8または10ビットの分解能でデジタル値に変換し、DSP182に出力する。DSP182は、主に復調処理、可変増幅器172の利得制御、および後述するAD変換器20のモード切替処理を行う。
Claims (4)
- 自己のステージの入力アナログ信号を所定ビット数のデジタル値に変換するアナログデジタル変換回路と、
前記アナログデジタル変換回路の出力をアナログ信号に変換するDA変換回路と、
前記自己のステージの入力アナログ信号から、または前記自己のステージの入力アナログ信号を所定の増幅率で増幅する増幅回路の出力アナログ信号から、前記デジタルアナログ変換回路の出力を減算する減算回路と、を含むステージの基本ユニットを有し、この基本ユニットを1回または繰り返して使用することにより、所定のデジタル信号を得るアナログデジタル変換器であって、
搭載されるシステムの状態に応じて、前記ステージの少なくとも1つに与える動作周波数を変更し、変換ビット数を動的に変化させることを特徴とするアナログデジタル変換器。 - 自己のステージの出力が自己のステージの入力にフィードバックするステージを含んで構成され、アナログ信号を所定ビット数のデジタル信号に変換するアナログデジタル変換器を含む信号処理システムであって、
前記アナログデジタル変換器の変換ビット数を動的に変化させる制御部を備え、
前記制御部は、前記ステージに与える動作周波数を動的に変化させ、前記アナログデジタル変換器のサンプリング周波数に対する動作周波数の比を変更することで、前記変換ビット数を変化させることを特徴とする信号処理システム。 - 自己のステージの出力が自己のステージの入力にフィードバックするステージを含んで構成され、アナログ信号を所定ビット数のデジタル信号に変換するアナログデジタル変換器を含む信号処理システムであって、
前記アナログデジタル変換器の変換ビット数を動的に変化させる制御部を備え、
前記制御部は、利得調整に応じて、前記制御部は、前記ステージに与える動作周波数を動的に変化させ、前記アナログデジタル変換器の変換ビット数を変化させることを特徴とする信号処理システム。 - 自己のステージの出力が自己のステージの入力にフィードバックするステージを含んで構成され、アナログ信号を所定ビット数のデジタル信号に変換するアナログデジタル変換器を含む信号処理システムであって、
前記アナログデジタル変換器の変換ビット数を動的に変化させる制御部を備え、
前記制御部は、オフセット調整に応じて、前記制御部は、前記ステージに与える動作周波数を動的に変化させ、前記アナログデジタル変換器の変換ビット数を変化させることを特徴とする信号処理システム。
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