JP3805108B2 - 半導体装置及びその製造方法 - Google Patents
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Description
【発明の属する技術分野】
本発明は半導体チップの主面上にインナーリード部が延在するLOC(リード・オン・チップ)構造を有する半導体装置及びその製造方法に関するものであり、特に半導体チップとリードとの接着構造に関するものである。
【0002】
【従来の技術】
近年、主としてメモリーチップなどに代表される半導体チップのパッケージング技術としては、リードフレームのインナーリード部が半導体チップの主面上に延在し、そのインナーリード部と半導体チップの主面とを接着固定して半導体チップを保持する、いわゆるLOC技術が開発されている。従来のLOC型半導体装置としては、半導体チップ主面とインナーリード部の一部とを絶縁テープを介して接着して固定しているものがあるが、最近は、前記のように半導体チップとインナーリードとを接着剤により固定するタイプのLOC型半導体装置が主流である。
【0003】
以下、従来のLOC型半導体装置の製造方法について図面を参照しながら説明する。図7の(a)は、従来の半導体装置の製造過程における半製品の平面図、(b)は、(a)のE−E1線断面図を示す。図において、1は半導体チップ1を示し、この半導体チップ1の主面に、接着剤3によってリードフレーム5が接着固定されている。8はインナーリード部を示し、このインナーリード部8は半導体チップ1の端子1aと金属細線(図示せず)によってワイヤーボンディングされる。5bは、保持部分を示し、複数のインナーリード部8の内、接着剤3によって、半導体チップ1の主面に接着されたインナーリード部8を特に名付けたものである。
【0004】
次に、従来の半導体装置における製造方法の断面図を図8、図9、図10に示す。
まず、チップ接着工程(ダイスボンド工程)について説明する。図8(a)に示すように半導体チップ1を真空取り付け可能なステージ2上に載置する。ここでは半導体チップ1が不要な移動を起こさないように真空吸着する。固定ステージ2の両側上部にはリードフレーム5の位置を規制するピン2aが突設している。
【0005】
そして、図8(b)に示すように、半導体チップ1上の所定の位置、すなわちインナーリード部の保持部分5bを接着箇所するために接着剤3をノズル4により塗布する。
【0006】
次に図8(c)に示すように、接着剤3が塗布された半導体チップ1とリードフレーム5とを位置合わせして、インナーリード部5の保持部分5bと半導体チップ1とを接着する。そして、図8(d)に示すように、リードフレーム5を接着した半導体チップ1を固定ステージ2に載置したまま、硬化炉ステージ17にセットし、一定時間加熱処理を行うことにより、接着剤3を硬化させる。なお、リードフレーム5はその外側の位置規制孔にステージ2に設けたピン2aを挿通することにより規制される。
【0007】
次にワイヤーボンド工程について説明する。
図9(a)に示すように、リードフレーム5を接着した半導体チップ1をヒーターブロック7上に真空吸着により固定する。なお、図中半導体チップ1とリードフレーム5とは分離しているように示しているが、前記した保持部分5bは半導体チップ1と接着しているものであり、図示している箇所は、リードフレーム5の半導体チップ1の端子1aと電気的な接続を行うインナーリード部8の部分の断面図である。
【0008】
そして図9(b)に示すように、リードフレーム5の外周部を押さえるクランパー9aと、インナーリード部8を押さえるクランパー9bによりリードフレーム5及びインナーリード部8を押さえ、半導体チップ1の主面上にインナーリード部8を接触させる。そしてワイヤーボンダーのキャピラリー10により金属細線11でインナーリード部8と半導体チップ1の端子1aとを接続する。ここで半導体チップ1の主面上にインナーリード部8を接触させる目的は、金属細線11の接続を安定に行うためである。
【0009】
次に図9(c)に示すように、クランパー9a,9bを除去する事によりインナーリード部8が元の状態に戻り、図9(d)に示すようにインナーリード部8と半導体チップ1とが金属細線11により電気的に接続される。
【0010】
次に樹脂封止工程について説明する。
図10(a)に示すように、半導体チップ1と保持部分5bとが接着剤3により接着された図9(d)の半製品をリードフレーム封止用の金型12内にセットする。そして図10(b)に示すように、金型12のゲート口13より封止樹脂14を注入する。樹脂注入後の状態を図10(c)に示す。以上のような工程により、図10(d)に示すような半導体チップ1とインナーリード部の保持部分5bとを接着剤3により固定し、外周を封止樹脂14で封止したLOC型の半導体装置が製造されるものである。図10(d)の状態からリードフレーム8の不要な箇所を裁断して半導体装置が完成する。
【0011】
【発明が解決しようとする課題】
しかしながら従来の半導体装置製造方法では、半導体チップ1とインナーリード部の保持部分5bとを接着剤により接着固定していたが、接着剤が必要以上に保持部分からはみ出したり、または接着剤3がインナーリード部と半導体チップ主面との隙間を伝って浸延するという課題があった。すなわち接着剤の余分なはみ出し、または浸延によって、保持部分の表面にまで接着剤が被覆し、外囲を封止樹脂により封止した際には熱衝撃等の信頼性に悪影響を及ぼすという問題と、保持部分5bの先端部まで接着剤が浸延し、インナーリード部のボンディング箇所に接着剤が被覆することになり、後工程の金属細線による接続時に金属細線が接続できないという問題があった。また接着強度の面では保持部分毎にはみ出しや浸延が発生することにより接着強度に差が生じ、信頼性に問題があった。
【0012】
さらに、従来構造の半導体装置でワイヤーボンドを行う際、インナーリード部先端をクランパーで押さえて、半導体チップ1の主面上の端子1aとインナーリード部8との間を金属細線11で接続する方法を取る。従って、従来のインナーリード部の位置を接着剤で接着した場合、クランパーと接着点との距離が短くなる為に、インナーリード部の塑性変形が生じ、リード先端付近が半導体チップ主面と近接することでリードの入力容量が増加するという問題点があった。
【0013】
本発明は、前記従来の課題を解決するものであり、半導体チップを接着剤を介してリード部分で保持する構造の半導体装置において、半導体チップとリードの保持部分との接着構造に着目して、接着強度を向上させつつ接着剤の余分なはみ出しや浸延を防止した半導体装置及びその製造方法を提供することを目的とする。
【0014】
さらに、本発明は、リードフレームを半導体チップの主面に取り付けるためにインナーリード部の側方から枝分かれした分岐部の先端に設けた分岐パッド部を半導体チップのコーナー近傍に接着固定することで樹脂封止の際の流動抵抗のアンバランスにより発生する半導体チップの正規の位置からのズレや半導体チップの傾きを防止することを目的とする。
【0015】
前記課題を解決するために本発明の半導体装置は、半導体チップと、リードフレームを前記半導体チップの主面に設けるためにインナーリード部から枝分かれした分岐部の先端に設けられた分岐パッド部と、前記半導体チップと分岐パッド部との間に設けられた接着剤と、前記半導体チップの端子と前記インナーリード部とを電気的に接続する接続手段と、少なくとも前記半導体チップの外周を封止した封止樹脂と、前記封止樹脂から露出し、前記インナーリード部と接続したアウターリードとよりなり、前記分岐パッド部は、1箇所以上の貫通孔を有する。かかる構成によって、光熱硬化型接着剤により前記分岐パッド部を半導体チップ表面と接続する際に、光を照射することによって予め仮硬化をすることができる。
【0016】
また、具体的にはインナーリード部から枝分かれした分岐部の先端に設けられた分岐パッド部の被接着面は、錫もしくは銅を5μm以下の厚みにメッキする。また、前記半導体チップの主面と前記分岐パッド部との間を接続する接着剤は、290nm〜436nmの波長の光および/または熱で硬化反応が進行し、硬化後の硬化収縮率は3%以下である。また、接着剤に光熱硬化型接着剤を用い、この光熱硬化型接着剤の粘度が、50poise〜500poiseのものを使用している。また、前記分岐パッド部から成る接着部は、少なくとも半導体チップ主面の3箇所以上に位置する。分岐パッド部が半導体チップ部に接着された接着位置において、分岐パッド部は、半導体チップの4つのコーナーの対角線に対して±30゜内に配置する。また、前記分岐パッド部は、その中心が前記半導体チップのエッジから3mm以内の点に設けている。
【0017】
さらに接着固定に使用する接着剤は硬化収縮率が3%以下のものとする。
また半導体装置の製造方法は、絶縁層がその表面に形成された半導体チップを供給する工程と、半導体チップを所定の位置に所望の精度で再配置する工程と、半導体チップ主面の絶縁膜上に光熱硬化型接着剤を所定の厚みに塗布する工程と、インナーリード部の側方から枝分かれした分岐部の先端に設けられた分岐パッド部を有するリードフレームを半導体チップ上に供給する工程と、半導体チップ主面の所定の位置に分岐パッド部が配置されるようにリードフレームを合わせる工程と、半導体チップ主面と分岐パッド部との間に設けられた接着剤に光(290nm〜436nmの波長)を照射して接着剤を仮硬化する工程と、さらに前記接着剤を加熱硬化(120℃〜300℃)することにより最終硬化する工程と、半導体チップの端子とインナーリード部先端とを金属細線で接続し電気的に導通させる工程と、アウターリード部を露出させて半導体チップの外囲を封止樹脂で封止する工程とより成るものである。
【0018】
【発明の実施の形態】
以下、本発明の一実施形態について図面を参照しながら説明する
まず本実施形態の半導体装置の構成について説明する。図1〜図3に本実施形態の半導体装置の半製品を示す。各図において、(a)は平面図であり、(b)及び(c)は各A−A1、B−B1、C−C1、D−D1箇所の断面図である。なお、図1、図2、図3では、図面を簡略化するために、金属細線を省略し、各図の(b)において、インナーリード部先端と半導体チップの端子を省略している。
【0019】
図1(a)、図1(b)、図1(c)に示す構成は、最上層が絶縁層15を有する半導体チップ1と、インナーリード部8と、リードフレーム5を半導体チップ1主面に取り付けるためにインナーリード部8の側方から分岐する分岐部5bの先端に設けられ、少なくとも一箇所以上の貫通孔16を有する4個の分岐パッド部5aと、半導体チップ1に分岐パッド5aを接着するために塗布された光熱硬化型接着剤3とにより構成されている。
【0020】
分岐パッド部5aは、半導体チップ1の端子1aとインナーリード部8先端とを電気的に接続する接続手段(金属細線)がボンディングしている箇所から離れた所に位置する。すなわち、分岐パッド5aは、インナーリード部8のつけ根側方から分岐した分岐部5bの先端で、インナーリード部8の先端から離れた位置に形成されたものである。したがって、光熱硬化型接着剤3は、インナーリード部8の先端から離れた分岐パッド5aに塗布される。
【0021】
なお、分岐パッド部5aの数は前記のように4個には限定されないが、2箇所しか無い場合、樹脂成形工程の樹脂注入時に溶融樹脂の流動バランスの崩れから、半導体チップが回転して実用に耐えないので、少なくとも3個以上必要である。
【0022】
接着固定に使用する接着剤は硬化収縮率が3%以下のものが好ましい。すなわち、半導体チップ1の主面で複数の分岐パッド部5aを支持した場合、収縮率の大きい接着剤を使用すると、各支持した支点の収縮バランスが崩れた時、半導体チップ1が傾斜する不都合が生じる。したがって、接着剤は硬化収縮率が3%以下のものが好ましい。
【0023】
光熱硬化型接着剤3は、例えば、エポキシ系樹脂や感光性樹脂等を主成分とする液状樹脂に、SiO2 (二酸化珪素)の微粉末を前記液状樹脂に対して重量比で50〜80%を混合してものを用いる。ただし、この光熱硬化型接着剤3は、かかる成分や配合割合に限定されない。
【0024】
なお、エポキシ系の樹脂を主成分とする接着剤は、リードフレーム材(Fe−Ni合金)や銀メッキ面との接着力が弱く、銅や錫とは強く接着するので、分岐パッド部の被接着面は、錫もしくは銅を5μm以下の厚みにメッキしてある。
【0025】
図2(a)、図2(b)は、図1(a)、図1(b)の分岐パッド部5aの配置数が異なる場合の他の実施の形態である。図2の実施の形態は、分岐パッド部5aの構成が、図1の実施の形態より一対多く形成され、中央部のインナーリード部8に分岐パッド部5aが形成されている。この実施の形態の分岐パッド5aもインナーリード部8の先端部から離れた位置にある。
【0026】
図3(a)、図3(b)は、分岐パッド部面に設けた貫通孔の数が図1(a)、図1(b)の分岐パッド部の面に設けた貫通孔16の数と異なる場合の他の実施の形態である。この図3の実施の形態の分岐パッド部5aは、先端部が三角形をし、基端部が矩形をしており、この分岐パッド部5aに三角形と矩形の貫通孔がそれぞれ1個づつ形成されている。もちろん、分岐パッド部5aの形状や貫通孔の形状、数量等は本実施の形態に限定されないことは言うまでもない。
【0027】
上記実施の形態のように、分岐パッド5aがインナーリード部8の先端部から離れて設けられ、しかも、本発明の構造のインナーリード部8先端が半導体チップ1主面から30〜190μm上に浮いた状態で位置することで、このインナーリード部8の先端と半導体チップ1の端子間に金属細線でワイヤーボンディングする際に、インナーリード部8の先端を押さえることにより生じるインナーリード部8先端の塑性変形が防止できる。
【0028】
さらに、光熱硬化型接着剤3の粘度は、余分な浸延やタレ下がりを防止する観点から50poise〜500poiseのものを使用することが好ましい。しかし、接着剤に粘度の低い光熱硬化型接着剤3を使用して浸延が生じた場合でも、分岐パッド5aがインナーリード部8の先端部から離れて設けられているため、インナーリード部8の先端部にまで光熱硬化型接着剤3が及ぶことはなく、後工程の金属細線による接続にも支障を生じない。
【0029】
また、本発明のリードフレームを構成する分岐パッド5aのパターンは、分岐パッド5aの中心点が樹脂封止される半導体チップ1主面の各辺のエッジから3mm以内の点に配置することが好ましい。
【0030】
また、本発明は、配置された分岐パッド部5aの面には少なくとも1箇所以上の貫通孔16を設ける。前記貫通孔16の形成は、本発明半導体装置を組み立てるに当り、半導体チップ主面と分岐パッド部5aを接着剤3により接着する際に、設備の時間当りの処理数量の向上を図るために設けてたものである。即ち、光熱硬化型接着剤3を用いた硬化は、光による短時間仮硬化と、熱によるバッチ処理もしくはインライン硬化から成りる。仮硬化は分岐パッド部5aでリードフレーム5が取り付けられた半導体チップを次工程に送る際、半導体チップ1からリードフレームが脱落するのを防止することが目的であり、前記条件を満たす接着強化を必要とする。貫通孔は、以上の理由から光照射面積を確保し、接着強化の維持に貢献することを狙いとして形成されたものである。
【0031】
さらに、分岐パッド部5aは、具体的には少なくとも半導体チップ1の4つのコーナーの対角線に対して±30゜内に配置する。この角度、すなわち接着位置は次のような理由から重要になる。即ち、樹脂封止工程で熱硬化型樹脂を用いて金型内に溶融樹脂を注入する時、樹脂は注入時間の経過と共に粘度上昇が生じる。その時、金型内に配置される半導体チップ1は、チップ主面の接着点と前記接着点の支持部分が前記角度範囲から外れた場合、半導体チップ1の上側と下側の溶融樹脂の流れの不均衡等で、その時の半導体チップ上下面での流動抵抗の不均衡増幅により、金型内半導体チップ1が元の位置から大きく上下に逸脱する。すなわち、半導体チップ1の上側または下側の各面と、金型壁面との間隔に違いがあれば、樹脂が流動する圧力に差が生じ、圧力の大きい流れが小さい流れの方に半導体チップ1を押し動かすことになる。これを防止するために、分岐パッド部5aは、半導体チップ1の4つのコーナーの対角線上に配置し、その有効範囲として±30゜を設定した。
【0032】
また、半導体チップ1主面と分岐パッド5aの接着固定は、光熱硬化型接着剤3の使用で分岐パッド5aの貫通孔16から照射される290nm〜436nmの波長の光による仮硬化と、熱による最終硬化を採用する。その結果、仮硬化の採用は設備当たりの組立能力が飛躍的に増加する。
【0033】
次に本実施形態の半導体装置の製造方法について図面を参照しながら説明する。
図4〜図6は本発明の半導体装置の製造方法を示す断面図である。
【0034】
まず、図4を用いて、半導体チップ1の主面に分岐パッド部5aを介してリードフレームを接着する半導体チップ1接着工程(ダイスボンド工程)について説明する。
【0035】
図4(a)に示すように半導体チップ1を真空取り付け可能なステージ6上に載置する。ここでは半導体チップ1が不要な移動を起こさないように真空吸着により固定する。ステージ6にはリードフレーム5の位置を規制するピン2aが設けられている。
【0036】
そして図4(b)に示すように、半導体チップ1上の所定の位置に、光熱硬化型接着剤3をノズル4により塗布する。所定の位置とは、リードフレーム5を半導体チップ1主面に取り付けるために、分岐部5bの先端に形成された分岐パッド部5aを、半導体チップ主面に接着する箇所を言う。
【0037】
つぎに、図4(c)に示すように、光熱硬化型接着剤3が塗布された半導体チップ1と、リードフレーム5とを位置合わせする。リードフレーム5はその外側の位置規制孔にステージ2に設けたピン2aを挿通することにより規制される。
【0038】
そして、図4(d)に示すように290nm〜436nmの波長の光をリードフレーム5の分岐パッド部5a上から貫通孔16を介して1〜10秒照射し、光が浸入する深さまで仮硬化を行う。
【0039】
前記のように、分岐パッド部5aと半導体チップ1とを仮接着した後、図4(e)に示すように、120℃〜300℃の温度で30分〜60分間硬化炉ステージ17で最終硬化を行って光熱硬化型接着剤3を硬化させる。光熱硬化型接着剤3の硬化は光と加熱で順次処理する方法と、加熱のみで処理する方法の2通りがある。
【0040】
次にワイヤーボンド工程について説明する。
図5(a)に示すように、ヒーターブロック7上に、リードフレーム5を取り付けた半導体チップ1を真空吸着により固定する。なお図中、半導体チップ1とリードフレーム5とは分離しているように示しているが、前記した分岐パッド部5aは、半導体チップと接続しているものであり、図示している箇所は、リードフレーム5の半導体チップ1と電気的な接続を行うインナーリード部8の断面である。
【0041】
次に、図5(b)に示すように、クランパー9a、9bによりインナーリード部8及びリードフレーム5を押さえ、絶縁層15で保護された半導体チップ1主面上にインナーリード部8を接触させる。そして、ワイヤーボンダーのキャピラリー10を用いて金属細線11によってインナーリード部8と半導体チップ1の端子1aとを接続する。ここで半導体チップ1主面上にインナーリード部8を接触させる目的は、金属細線11の接続を安定に行うためである。
【0042】
さらに、図5(c)に示すようにクランパー9a、9bを除去することにより、インナーリード部8が元の状態に戻り、図5(d)に示すようにインナーリード部8と半導体チップ1とが金属細線11により電気的に接続される。
【0043】
次に樹脂封止工程について説明する。
図6(a)に示すように、分岐パッド部5aを介してリードフレーム5が光熱硬化型接着剤3により接着固定された半導体チップ1を封止用の金型12内にセットする。
【0044】
そして図6(b)に示すように、金型12のゲート口13より封止樹脂14を注入する。樹脂注入後の状態を図6(c)に示す。
以上のような工程により図6(d)に示すように、半導体チップ1にリードフレーム5の分岐パッド部5aを光熱硬化型接着剤3により固定し、外周を封止樹脂14で封止したLOC型の半導体装置が製造される。
【0045】
以上、本実施形態の半導体装置の製造方法は、少なくとも、半導体チップ1にリードフレーム5を取り付ける分岐パッド部5aを有し、分岐パッド部5aの面は1箇所以上の貫通孔16を有し、半導体チップ1の端子1aと電気的に接続する部分が分岐パッド部5aから離れているインナーリード部8と、インナーリード部8と接続したアウターリード部とを有するリードフレーム5を用いて、半導体チップ1をリードで接着固定したタイプの半導体装置を製造する場合に用いる。
【0046】
分岐パッド部5aが貫通孔16を有することより、貫通孔16を通して光熱硬化型接着剤3を硬化させるために必要な(波長290nm〜436nmの)光を直接光熱硬化型接着剤3に照射することが出来る。このため、分岐パッド部5aの貫通孔16から露出した光熱硬化型接着剤3に光が当り、光が侵入した深さまで接着剤3が硬化する。従って、本発明の製造方法により、接着強度の向上と共に製造工程におけるインデックスの時間短縮が図れて製造効率を向上させる事が出来るものである。
【0047】
なお、本実施形態で用いる光熱硬化型接着剤3は、超高圧水銀灯のg線やi線または290nmの波長及びハロゲンランプの発光波長に感光感度を有し、粘度は光熱硬化型接着剤3の余分な浸延やタレ下がりを防止する観点から50poise〜500poiseのものとする。
【0048】
以上、本実装形態ではインナーリード部8から枝分かれした分岐パッド部5aと、半導体チップ1主面とを光熱硬化型接着剤3により接着固定する際、インナーリード部8は、分岐パッド部5aのボンディング箇所から離れて設けられているので、光熱硬化型接着剤3が余分に浸延してもインナーリード部8まで延在する危険性がなく金属細線11の接続不良誘発を防止する。
【0049】
【発明の効果】
以上、本発明の半導体装置は、インナーリード部と枝分かれして形成される分岐パッド部と、半導体チップ主面とを光熱硬化型接着剤により接着固定するタイプの半導体装置であって、前記分岐パッド部はインナーリード部の先端部から離されて設けられているので、半導体チップ主面に分岐パッド部を接着した際に光熱硬化型接着剤が余分にはみ出しても、はみ出した光熱硬化型接着剤はインナーリード部の先端部まで延在することなく、接続不良を防止できるものである。
【0050】
また、本発明の半導体装置は、インナーリード部の先端部が半導体チップ主面と所定の間隔を保って浮いている構造となる。一方、インナーリード部は分岐パッド部と分岐し、金属細線で半導体チップの端子と接続されるインナーリード部の先端は、半導体チップの主面に光熱硬化型接着剤により接着固定されている分岐パッド部と離れている。従って、ワイヤーボンディング時にインナーリード部先端近傍をクランパーで押さえてもインナーリード部は塑性変形を起こさず元の状態に復帰できるものである。
【0051】
さらに、本発明の半導体装置は搭載する半導体チップコーナーの対角線近傍の少なくとも3箇所以上に分岐パッド部を設けることで、樹脂封止の際の半導体チップ傾きや正規の位置からの上下への移動が防止出来るものである。
【図面の簡単な説明】
【図1】(a)は本発明の一実施形態の半導体装置の半製品を示す平面図、(b)は図1(a)のA−A1線断面図、(c)は同、B−B1線断面図である。
【図2】(a)は本発明の他の実施形態の半導体装置の半製品を示す平面図、(b)は図2(a)のC−C1線断面図である。
【図3】(a)は本発明のさらに他の実施形態の半導体装置の半製品を示す平面図、(b)は図3(a)のD−D1線断面図である。
【図4】本発明の一実施形態の半導体装置の製造方法(チップ接着工程)を示す断面図である。
【図5】本発明の一実施形態の半導体装置の製造方法(ワイヤーボンド工程)を示す断面図である。
【図6】本発明の一実施形態の半導体装置の製造方法(樹脂封止工程)を示す断面図である。
【図7】(a)は従来の半導体装置の半製品を示す平面図、(b)は図7(a)のE−E1部断面図である。
【図8】従来の半導体装置の製造方法(チップ接着工程)を示す断面図である。
【図9】従来の半導体装置の製造方法(ワイヤーボンド工程)を示す断面図である。
【図10】従来の半導体装置の製造方法(樹脂封止工程)を示す断面図である。
【符号の説明】
1 半導体チップ
1a 端子
2 ステージ(チップ接着装置)
2a ピン
3 光熱硬化型接着剤(接着剤)
4 ノズル
5 リードフレーム
5a 分岐パッド部
5b インナーリード部の保持部分
5c 分岐部
6 ステージ
7 ヒーターブロック(ワイヤーボンダー)
8 インナーリード部
9a クランパー(フレーム)
9b クランパー(インナーリード部)
10 キャピラリー
11 金属細線
12 金型
13 ゲート口
14 封止樹脂
15 絶縁層
16 貫通孔
17 硬化炉ステージ
Claims (8)
- 半導体チップと、
リードフレームを前記半導体チップの主面に設けるためにインナーリード部から枝分かれした分岐部の先端に設けられた分岐パッド部と、
前記半導体チップと前記分岐パッド部との間に設けられた接着剤と、
前記半導体チップの端子と前記インナーリード部とを電気的に接続する接続手段と、
少なくとも前記半導体チップの外周を封止した封止樹脂と、
前記封止樹脂から露出し、前記インナーリード部と接続したアウターリードと、よりなり、
前記分岐パッド部は、1箇所以上の貫通孔を有することを特徴とする半導体装置。 - 半導体チップと、
リードフレームを前記半導体チップの主面に設けるためにインナーリード部から枝分かれした分岐部の先端に設けられた分岐パッド部と、
前記半導体チップと前記分岐パッド部との間に設けられた接着剤と、
前記半導体チップの端子と前記インナーリード部とを電気的に接続する接続手段と、
少なくとも前記半導体チップの外周を封止した封止樹脂と、
前記封止樹脂から露出し、前記インナーリード部と接続したアウターリードと、よりなり、
前記分岐パッド部の被接着面は、錫もしくは銅を5μm以下の厚みにメッキすることを特徴とする半導体装置。 - 前記半導体チップの主面と前記分岐パッド部との間を接続する接着剤は、290nm〜436nmの波長の光および/または熱で硬化反応が進行し、硬化後の硬化収縮率は3%以下であることを特徴とする請求項1または2に記載の半導体装置。
- 接着剤は光熱硬化型接着剤を用い、この光熱硬化型接着剤の粘度が、50poise〜500poiseのものを使用したことを特徴とする請求項3に記載の半導体装置。
- 前記分岐パッド部から成る接着部は、少なくとも半導体チップ主面の3箇所以上に位置することを特徴とする請求項1または2に記載の半導体装置。
- 分岐パッド部が半導体チップ部に接着された接着位置において、分岐パッド部は、半導体チップの4つのコーナーの対角線に対して±30゜内に配置することを特徴とする請求項1または2に記載の半導体装置。
- 前記分岐パッド部は、その中心が前記半導体チップのエッジから3mm以内の点に設けることを特徴とする請求項1または6に記載の半導体装置。
- チップ接着工程において、290nm〜436nmの波長の光および/または熱で硬化反応が進行し、硬化後の硬化収縮率は3%以下である光熱硬化型接着剤を用い、リードフレームを半導体チップの主面に設けるために、インナーリード部から枝分かれした分岐部の先端に設けられた分岐パッド部と、半導体チップ主面とを接着するに当り、予め光による仮硬化を行った後、熱による最終硬化を行うことを特徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19640798A JP3805108B2 (ja) | 1998-07-13 | 1998-07-13 | 半導体装置及びその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19640798A JP3805108B2 (ja) | 1998-07-13 | 1998-07-13 | 半導体装置及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2000031200A JP2000031200A (ja) | 2000-01-28 |
JP3805108B2 true JP3805108B2 (ja) | 2006-08-02 |
Family
ID=16357356
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19640798A Expired - Fee Related JP3805108B2 (ja) | 1998-07-13 | 1998-07-13 | 半導体装置及びその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3805108B2 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100652517B1 (ko) | 2004-03-23 | 2006-12-01 | 삼성전자주식회사 | 리드-칩 직접 부착형 반도체 패키지, 그 제조 방법 및 장치 |
JP6127651B2 (ja) | 2013-03-29 | 2017-05-17 | セイコーエプソン株式会社 | 電子デバイス、電子機器、移動体および電子デバイスの製造方法 |
-
1998
- 1998-07-13 JP JP19640798A patent/JP3805108B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2000031200A (ja) | 2000-01-28 |
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|
TRDD | Decision of grant or rejection written | ||
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FPAY | Renewal fee payment (event date is renewal date of database) |
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