JP3435185B2 - 映像信号の同時化装置 - Google Patents
映像信号の同時化装置Info
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Description
【０００１】
【産業上の利用分野】本発明は、遅延回路を使用しない
で映像信号を同時化する同時化装置およびその方法に関
する。
で映像信号を同時化する同時化装置およびその方法に関
する。
【０００２】
【従来技術およびその問題点】スチルビデオカメラなど
のスチルビデオ装置では、カラー撮像素子により得られ
る輝度信号Ｙおよび色信号Ｒ、Ｇ、Ｂを、例えば輝度信
号Ｙおよび色差線順次信号ＬＳＣに分離して記録し、再
生している。輝度信号Ｙおよび色差線順次信号ＬＳＣ
は、異なる周波数の搬送波によりＦＭ変調され、所定の
同期信号、ＩＤ信号等とともに多重記録されている。再
生の際には、ローパスフィルタ、ハイパスフィルタによ
り輝度信号Ｙおよび色差線順次信号ＬＳＣを分離し、復
調等の所定の処理を施してから所定のビデオ信号として
出力している。
のスチルビデオ装置では、カラー撮像素子により得られ
る輝度信号Ｙおよび色信号Ｒ、Ｇ、Ｂを、例えば輝度信
号Ｙおよび色差線順次信号ＬＳＣに分離して記録し、再
生している。輝度信号Ｙおよび色差線順次信号ＬＳＣ
は、異なる周波数の搬送波によりＦＭ変調され、所定の
同期信号、ＩＤ信号等とともに多重記録されている。再
生の際には、ローパスフィルタ、ハイパスフィルタによ
り輝度信号Ｙおよび色差線順次信号ＬＳＣを分離し、復
調等の所定の処理を施してから所定のビデオ信号として
出力している。
【０００３】ここで、輝度信号Ｙと色信号Ｃとは変調周
波数が異なるので、フィルターにより分離すると色信号
Ｃの方が遅延する。そこで、映像をモニタ等で再生する
際には、遅延を補正して輝度信号Ｙと色信号Ｃとを同時
に出力（同時化）する必要がある。そこで従来の同時化
回路では、例えば図６に示すように、輝度信号Ｙの再生
回路中に遅延線８３を入れて、輝度信号Ｙと色信号Ｃの
同時化を図っていた。
波数が異なるので、フィルターにより分離すると色信号
Ｃの方が遅延する。そこで、映像をモニタ等で再生する
際には、遅延を補正して輝度信号Ｙと色信号Ｃとを同時
に出力（同時化）する必要がある。そこで従来の同時化
回路では、例えば図６に示すように、輝度信号Ｙの再生
回路中に遅延線８３を入れて、輝度信号Ｙと色信号Ｃの
同時化を図っていた。
【０００４】また、輝度信号Ｙおよび色差信号Ｃをメモ
リするメモリ手段を備えた同時化回路では、図７に示す
ように、輝度信号Ｙは輝度信号メモリ９１Ｙに、色信号
Ｃは色信号メモリ９１Ｃに出力順にそれぞれメモリし、
一画面分の信号がメモリされたら、同一水平線、同一画
素に対応する輝度信号および色信号をメモリ９１Ｙ、９
１Ｃから同時に順次読み出すことにより、輝度信号Ｙと
色信号Ｃの同時化を図っていた。ここで、この従来のメ
モリの書込み読出しをコントロールするメモリコントロ
ーラ９３は、Ｙメモリ９１Ｙ、Ｃメモリ９１Ｃのそれぞ
れのアドレスをコントロールするＹアドレスカウンタ９
３ＹおよびＣアドレスカウンタ９３Ｃを必要としてい
た。
リするメモリ手段を備えた同時化回路では、図７に示す
ように、輝度信号Ｙは輝度信号メモリ９１Ｙに、色信号
Ｃは色信号メモリ９１Ｃに出力順にそれぞれメモリし、
一画面分の信号がメモリされたら、同一水平線、同一画
素に対応する輝度信号および色信号をメモリ９１Ｙ、９
１Ｃから同時に順次読み出すことにより、輝度信号Ｙと
色信号Ｃの同時化を図っていた。ここで、この従来のメ
モリの書込み読出しをコントロールするメモリコントロ
ーラ９３は、Ｙメモリ９１Ｙ、Ｃメモリ９１Ｃのそれぞ
れのアドレスをコントロールするＹアドレスカウンタ９
３ＹおよびＣアドレスカウンタ９３Ｃを必要としてい
た。
【０００５】
【発明の目的】本発明は、上記従来技術に鑑みてなされ
たもので、時間的にずれを生じた二以上の信号、例えば
輝度信号及び色信号を含む映像信号の同時化を遅延回路
を使用せずに、より簡単な構成で実現する装置を提供す
ることを目的とする。
たもので、時間的にずれを生じた二以上の信号、例えば
輝度信号及び色信号を含む映像信号の同時化を遅延回路
を使用せずに、より簡単な構成で実現する装置を提供す
ることを目的とする。
【０００６】
【発明の概要】この目的を達成する本願発明は、基準時
から時間的なずれをもって入力される輝度信号および色
信号を、それぞれの信号に対応するメモリ手段に、一画
面分の信号が入力される毎に１信号づつ順次書込み、一
画面分の書き込みが終了した後に上記輝度信号および色
信号を同時に順次読み出して時間的に同時の映像信号に
変換する同時化装置であって、上記輝度信号および色信
号の上記各メモリ手段への書き込みおよび該メモリ手段
からの読み出しを制御する単一のメモリコントロール手
段を備え、上記各メモリ手段は、少なくとも、上記輝度
信号および色信号を、１水平走査期間と上記ずれ時間の
和に相当する時間分単位で書込む領域を一画面分備え、
上記メモリコントロール手段は、上記輝度信号および色
信号の上記各メモリ手段への書き込み処理において、基
準時が来る毎に該基準時から計時して、時間的に早く入
力される方の信号のときは、所定の初期位置よりも上記
ずれ時間に相当する時間分ずれた読み出し開始位置から
順次書込みを開始し、時間的に遅く入力される他方の信
号のときは、上記所定の初期位置から順次書込みを開始
し、一画面分の輝度信号および色信号の書込みが終了し
た後に、基準時が来る毎に上記各メモリ手段の上記読み
出し開始位置から同時に順次読み出して輝度信号および
色信号を同時化すること、を特徴とする。
から時間的なずれをもって入力される輝度信号および色
信号を、それぞれの信号に対応するメモリ手段に、一画
面分の信号が入力される毎に１信号づつ順次書込み、一
画面分の書き込みが終了した後に上記輝度信号および色
信号を同時に順次読み出して時間的に同時の映像信号に
変換する同時化装置であって、上記輝度信号および色信
号の上記各メモリ手段への書き込みおよび該メモリ手段
からの読み出しを制御する単一のメモリコントロール手
段を備え、上記各メモリ手段は、少なくとも、上記輝度
信号および色信号を、１水平走査期間と上記ずれ時間の
和に相当する時間分単位で書込む領域を一画面分備え、
上記メモリコントロール手段は、上記輝度信号および色
信号の上記各メモリ手段への書き込み処理において、基
準時が来る毎に該基準時から計時して、時間的に早く入
力される方の信号のときは、所定の初期位置よりも上記
ずれ時間に相当する時間分ずれた読み出し開始位置から
順次書込みを開始し、時間的に遅く入力される他方の信
号のときは、上記所定の初期位置から順次書込みを開始
し、一画面分の輝度信号および色信号の書込みが終了し
た後に、基準時が来る毎に上記各メモリ手段の上記読み
出し開始位置から同時に順次読み出して輝度信号および
色信号を同時化すること、を特徴とする。
【０００７】
【実施例】以下図示実施例に基づいて本発明を説明す
る。図１は、本発明を適用したスチルビデオ装置の回路
構成を示すブロック図である。まず、図１を参照して本
発明を適用したスチルビデオ装置の概要について説明す
る。
る。図１は、本発明を適用したスチルビデオ装置の回路
構成を示すブロック図である。まず、図１を参照して本
発明を適用したスチルビデオ装置の概要について説明す
る。
【０００８】磁気ディスク１１には、所定のフォーマッ
トで記録トラックが形成され、これらのトラックに、輝
度信号Ｙおよび色信号Ｃ（色差線順次信号ＬＳＣ）が所
定の同期信号とともにＦＭ変調されて多重記録されてい
る。磁気ディスク１１に記録された多重ＦＭ変調信号は
磁気ヘッド２１により読み取られ、ヘッドアンプ２３で
増幅され、輝度信号Ｙがハイパスフィルタ２５で抽出さ
れ、色信号Ｃ（色差線順次信号ＬＳＣ）がローパスフィ
ルタ２７で抽出される。
トで記録トラックが形成され、これらのトラックに、輝
度信号Ｙおよび色信号Ｃ（色差線順次信号ＬＳＣ）が所
定の同期信号とともにＦＭ変調されて多重記録されてい
る。磁気ディスク１１に記録された多重ＦＭ変調信号は
磁気ヘッド２１により読み取られ、ヘッドアンプ２３で
増幅され、輝度信号Ｙがハイパスフィルタ２５で抽出さ
れ、色信号Ｃ（色差線順次信号ＬＳＣ）がローパスフィ
ルタ２７で抽出される。
【０００９】輝度信号Ｙは、輝度信号ＦＭ復調回路２９
により復調される。復調された輝度信号は、A/D 変換器
３１でディジタル信号に変換されて輝度信号メモリ３３
に第１の書込み位置（アドレス）から順次書込まれる。
一方、同期信号分離・パルス発生回路５７は、復調輝度
信号に含まれる水平、垂直同期信号を検出してこれらを
メモリコントローラ６１に送ると共にパルス信号を発生
する。サンプリングクロック発生器５９は、上記パルス
信号に基づいてＰＬＬ回路等を経てサンプリングクロッ
クｆs を発生する。A/D 変換器３１は、このサンプリン
グクロックｆs に同期して輝度信号をA/D 変換する。ま
た、このサンプリングクロックｆs は、メモリコントロ
ーラ６１およびシステムコントローラ６７に出力され
る。そしてサンプリングクロックｆs は、メモリコント
ローラ６１内のアドレスカウンタの動作に利用される。
により復調される。復調された輝度信号は、A/D 変換器
３１でディジタル信号に変換されて輝度信号メモリ３３
に第１の書込み位置（アドレス）から順次書込まれる。
一方、同期信号分離・パルス発生回路５７は、復調輝度
信号に含まれる水平、垂直同期信号を検出してこれらを
メモリコントローラ６１に送ると共にパルス信号を発生
する。サンプリングクロック発生器５９は、上記パルス
信号に基づいてＰＬＬ回路等を経てサンプリングクロッ
クｆs を発生する。A/D 変換器３１は、このサンプリン
グクロックｆs に同期して輝度信号をA/D 変換する。ま
た、このサンプリングクロックｆs は、メモリコントロ
ーラ６１およびシステムコントローラ６７に出力され
る。そしてサンプリングクロックｆs は、メモリコント
ローラ６１内のアドレスカウンタの動作に利用される。
【００１０】ローパスフィルタ２７で抽出されたＦＭ変
調色信号は、色信号ＦＭ復調回路３０により復調され、
色差信号同時化回路３１に出力される。本実施例におい
て、色信号Ｃは色差線順次信号ＬＳＣであって、色差信
号Ｒ−Ｙ、Ｂ−Ｙが１Ｈごとに交互に出力される。ま
た、復調された色信号Ｃは、同期信号分離・パルス発生
回路５７に入力される。同期信号分離・パルス発生回路
５７は、色差線順次信号ＬＳＣのレベルを検出して色差
信号Ｒ−Ｙ、Ｂ−Ｙかを判別するラインインデックス信
号ＩＤをメモリコントローラ６１および色差信号同時化
回路３１に出力する。色差信号同時化回路３１は、入力
される色差順次線信号ＬＳＣをインデックス信号ＩＤに
基づいて、同時化した２つの色差信号Ｒ−Ｙ、Ｂ−Ｙと
して出力する。同時化された色差信号Ｒ−Ｙ、Ｂ−Ｙ
は、色信号メモリ４５内の対応するメモリの第２の書込
み位置（第２の初期アドレス）から順次書込まれる。色
信号メモリ４５の内部には、色差信号Ｒ−Ｙ用メモリ及
び色差信号Ｂ−Ｙ用メモリを備えているが、両者のアド
レスフォーマット、及びメモリコントローラ、アドレス
カウンタによる書込み、読出しのアドレス指定番地は同
一であり、動作上相違がない。そこで、説明を簡単化す
るために、図１及び図５においてはあえて色差信号Ｒ−
Ｙ、Ｂ−Ｙを区別せず、これらを色信号Ｃとして処理回
路も１個で処理しているものとして説明する。
調色信号は、色信号ＦＭ復調回路３０により復調され、
色差信号同時化回路３１に出力される。本実施例におい
て、色信号Ｃは色差線順次信号ＬＳＣであって、色差信
号Ｒ−Ｙ、Ｂ−Ｙが１Ｈごとに交互に出力される。ま
た、復調された色信号Ｃは、同期信号分離・パルス発生
回路５７に入力される。同期信号分離・パルス発生回路
５７は、色差線順次信号ＬＳＣのレベルを検出して色差
信号Ｒ−Ｙ、Ｂ−Ｙかを判別するラインインデックス信
号ＩＤをメモリコントローラ６１および色差信号同時化
回路３１に出力する。色差信号同時化回路３１は、入力
される色差順次線信号ＬＳＣをインデックス信号ＩＤに
基づいて、同時化した２つの色差信号Ｒ−Ｙ、Ｂ−Ｙと
して出力する。同時化された色差信号Ｒ−Ｙ、Ｂ−Ｙ
は、色信号メモリ４５内の対応するメモリの第２の書込
み位置（第２の初期アドレス）から順次書込まれる。色
信号メモリ４５の内部には、色差信号Ｒ−Ｙ用メモリ及
び色差信号Ｂ−Ｙ用メモリを備えているが、両者のアド
レスフォーマット、及びメモリコントローラ、アドレス
カウンタによる書込み、読出しのアドレス指定番地は同
一であり、動作上相違がない。そこで、説明を簡単化す
るために、図１及び図５においてはあえて色差信号Ｒ−
Ｙ、Ｂ−Ｙを区別せず、これらを色信号Ｃとして処理回
路も１個で処理しているものとして説明する。
【００１１】上記A/D 変換器３１、４３の変換処理およ
びメモリ３３、４５への書込み処理は、サンプリングク
ロック発生器５９から出力されるサンプリングクロック
ｆsに同期して、メモリコントローラ６１によりコント
ロールされる。メモリコントローラ６１は、１フィール
ド分の映像信号のメモリ３３、４５への書込みが終了す
ると、メモリ３３、４５から、輝度信号Ｙおよび色信号
Ｃを同時に同一の読出し位置（アドレス）から順番に読
み出して、輝度信号Ｙ及び色信号Ｃを同時化する。
びメモリ３３、４５への書込み処理は、サンプリングク
ロック発生器５９から出力されるサンプリングクロック
ｆsに同期して、メモリコントローラ６１によりコント
ロールされる。メモリコントローラ６１は、１フィール
ド分の映像信号のメモリ３３、４５への書込みが終了す
ると、メモリ３３、４５から、輝度信号Ｙおよび色信号
Ｃを同時に同一の読出し位置（アドレス）から順番に読
み出して、輝度信号Ｙ及び色信号Ｃを同時化する。
【００１２】輝度信号メモリ３３から読み出された輝度
信号Ｙは、D/A 変換器３５によりアナログ信号に変換さ
れ、ローパスフィルタ３７により高域成分が除去され、
同期信号がミックスされてエンコーダ回路６９に出力さ
れる。一方、色信号Ｃも、D/A 変換器４９でアナログ信
号に変換され、ローパスフィルタ５１で高域成分が除去
されてからエンコーダ回路６９に出力される。エンコー
ダ回路６９では、輝度信号Ｙ及び２つの色差信号Ｒ−
Ｙ、Ｂ−Ｙとから、モニタ装置や接続されるパーソナル
コンピュータ等に適合した規格のビデオ信号を生成し、
出力する。
信号Ｙは、D/A 変換器３５によりアナログ信号に変換さ
れ、ローパスフィルタ３７により高域成分が除去され、
同期信号がミックスされてエンコーダ回路６９に出力さ
れる。一方、色信号Ｃも、D/A 変換器４９でアナログ信
号に変換され、ローパスフィルタ５１で高域成分が除去
されてからエンコーダ回路６９に出力される。エンコー
ダ回路６９では、輝度信号Ｙ及び２つの色差信号Ｒ−
Ｙ、Ｂ−Ｙとから、モニタ装置や接続されるパーソナル
コンピュータ等に適合した規格のビデオ信号を生成し、
出力する。
【００１３】また、磁気ディスク１１は、システムコン
トローラ６７により制御されるスピンドルモータ１５に
より所定回転速度、本実施例では3600rpm で回転駆動さ
れる。システムコントローラ６７は、磁気ディスク１１
上のＰＧヨーク１３の通過をＰＧコイル１７で検知して
磁気ディスク１１の１回転検出および回転位相を制御
し、スピンドルモータ１５の回転に連動して出力される
ＦＧパルスにより磁気ディスク１１の回転速度を制御す
る。
トローラ６７により制御されるスピンドルモータ１５に
より所定回転速度、本実施例では3600rpm で回転駆動さ
れる。システムコントローラ６７は、磁気ディスク１１
上のＰＧヨーク１３の通過をＰＧコイル１７で検知して
磁気ディスク１１の１回転検出および回転位相を制御
し、スピンドルモータ１５の回転に連動して出力される
ＦＧパルスにより磁気ディスク１１の回転速度を制御す
る。
【００１４】以上は本スチルビデオ装置の概要である
が、本発明の特徴について、さらに図２〜図５を参照し
てより詳細に説明する。図２にはメモリ３３、４５及び
メモリコントローラ６１の構成を、図３には、輝度信号
ＦＭ復調回路２９から出力される輝度信号Ｙと色信号復
調回路３０から出力される色信号Ｃの出力タイミングチ
ャートを示し、図４には、メモリ３３、４５のメモリ態
様を模式的に示してある。本実施例は、メモリコントロ
ーラ６１の１個のアドレスカウンタ６２で２個のメモリ
３３、４５のアドレスを管理している。再生に際して
は、磁気ディスク１１の１回転目で輝度信号をメモリ３
３に第１の初期アドレスから書込み、２回転目で色信号
Ｃ（Ｒ−Ｙ、Ｂ−Ｙ）をメモリ４５に、第２の初期アド
レスから書込むことに特徴の一つがある。
が、本発明の特徴について、さらに図２〜図５を参照し
てより詳細に説明する。図２にはメモリ３３、４５及び
メモリコントローラ６１の構成を、図３には、輝度信号
ＦＭ復調回路２９から出力される輝度信号Ｙと色信号復
調回路３０から出力される色信号Ｃの出力タイミングチ
ャートを示し、図４には、メモリ３３、４５のメモリ態
様を模式的に示してある。本実施例は、メモリコントロ
ーラ６１の１個のアドレスカウンタ６２で２個のメモリ
３３、４５のアドレスを管理している。再生に際して
は、磁気ディスク１１の１回転目で輝度信号をメモリ３
３に第１の初期アドレスから書込み、２回転目で色信号
Ｃ（Ｒ−Ｙ、Ｂ−Ｙ）をメモリ４５に、第２の初期アド
レスから書込むことに特徴の一つがある。
【００１５】図３のタイミングチャートから明らかな通
り、輝度信号Ｙは、水平同期信号の立ち下がり時刻ｔ1
から所定時間後の時刻Ｔ2 に出力されるが、色信号Ｃ
は、時刻ｔ2 の時間Δｔ後の時刻ｔ3 に出力される。つ
まり、輝度信号Ｙよりもずれ時間Δｔだけ遅れて色信号
Ｃが出力される。したがって、このずれ時間Δｔが、遅
延調整時間となる。したがって、第１の初期アドレスｎ
を、輝度信号Ｙに対するずれ時間Δｔに相当する値、つ
まり、アドレス０〜ｎに輝度信号Ｙを書込むのに要する
時間がずれ時間Δｔと等しくなる値に設定するが、この
値は、ΔｔとA/D変換時のサンプリングクロックの周波
数とから適時決定される。
り、輝度信号Ｙは、水平同期信号の立ち下がり時刻ｔ1
から所定時間後の時刻Ｔ2 に出力されるが、色信号Ｃ
は、時刻ｔ2 の時間Δｔ後の時刻ｔ3 に出力される。つ
まり、輝度信号Ｙよりもずれ時間Δｔだけ遅れて色信号
Ｃが出力される。したがって、このずれ時間Δｔが、遅
延調整時間となる。したがって、第１の初期アドレスｎ
を、輝度信号Ｙに対するずれ時間Δｔに相当する値、つ
まり、アドレス０〜ｎに輝度信号Ｙを書込むのに要する
時間がずれ時間Δｔと等しくなる値に設定するが、この
値は、ΔｔとA/D変換時のサンプリングクロックの周波
数とから適時決定される。
【００１６】メモリ３３、４５は、水平アドレスおよび
垂直アドレスを備え、１Ｈ＋Δｔ時間のサンプリングデ
ータ分の信号を同一垂直アドレスの行にメモリする構成
としてある。これらの水平、垂直アドレスは、メモリコ
ントローラ６１のアドレスカウンタ６２で管理される
が、理解を容易にするためにアドレスカウンタ６２は、
水平アドレスカウンタ６２Ｈおよび垂直アドレスカウン
タ６２Ｖにより管理するものとする。
垂直アドレスを備え、１Ｈ＋Δｔ時間のサンプリングデ
ータ分の信号を同一垂直アドレスの行にメモリする構成
としてある。これらの水平、垂直アドレスは、メモリコ
ントローラ６１のアドレスカウンタ６２で管理される
が、理解を容易にするためにアドレスカウンタ６２は、
水平アドレスカウンタ６２Ｈおよび垂直アドレスカウン
タ６２Ｖにより管理するものとする。
【００１７】本実施例のメモリコントローラ６１は、再
生が開始されると、最初に垂直同期信号Ｖを検知した後
に輝度信号Ｙのみを書込む。つまり、垂直同期信号Ｖが
出力された後に水平同期信号Ｈを検知すると、所定時間
ｔ後に輝度信号Ｙの書込みを第１の初期アドレス（例え
ば水平アドレス＝ｎ、垂直アドレス＝０）から開始し、
輝度信号Ｙが出力される毎に水平アドレスカウンタ６２
Ｈをカウントアップして１水平ライン分の輝度信号Ｙを
書込む。そして、水平同期信号Ｈが出力されると、垂直
アドレスカウンタ６２Ｖをカウントアップし、水平アド
レスカウンタ６２Ｈを第１の初期アドレスｎにセットし
てから、同様の書込みを開始する。
生が開始されると、最初に垂直同期信号Ｖを検知した後
に輝度信号Ｙのみを書込む。つまり、垂直同期信号Ｖが
出力された後に水平同期信号Ｈを検知すると、所定時間
ｔ後に輝度信号Ｙの書込みを第１の初期アドレス（例え
ば水平アドレス＝ｎ、垂直アドレス＝０）から開始し、
輝度信号Ｙが出力される毎に水平アドレスカウンタ６２
Ｈをカウントアップして１水平ライン分の輝度信号Ｙを
書込む。そして、水平同期信号Ｈが出力されると、垂直
アドレスカウンタ６２Ｖをカウントアップし、水平アド
レスカウンタ６２Ｈを第１の初期アドレスｎにセットし
てから、同様の書込みを開始する。
【００１８】以上の処理を、次の垂直同期信号Ｖが出力
されるまで、つまり、トラック１周分、一画面分の書込
みが終了するまで繰り返す。以上の処理により、図４の
（Ａ）に示すように、書込み開始アドレス（第１の初期
アドレス）以降に輝度信号Ｙが書込まれる。この書込み
領域を、左下がり斜線で示した。なお、フィールド記録
の場合には１トラック（１フィールド）分の輝度信号が
記録され、フレーム記録の場合には２トラック（２フィ
ールド）分の輝度信号が記録されるが、理解を容易にす
るために本実施例は、フィールド記録とする。
されるまで、つまり、トラック１周分、一画面分の書込
みが終了するまで繰り返す。以上の処理により、図４の
（Ａ）に示すように、書込み開始アドレス（第１の初期
アドレス）以降に輝度信号Ｙが書込まれる。この書込み
領域を、左下がり斜線で示した。なお、フィールド記録
の場合には１トラック（１フィールド）分の輝度信号が
記録され、フレーム記録の場合には２トラック（２フィ
ールド）分の輝度信号が記録されるが、理解を容易にす
るために本実施例は、フィールド記録とする。
【００１９】１周目における輝度信号Ｙの書込みが終了
すると、２周目の再生で色信号Ｃの書込を行なう。色信
号Ｃの書込みは、第２の初期アドレス（水平アドレス
０、垂直アドレス０）から開始する。メモリコントロー
ラ６１は、水平アドレスカウンタ６２Ｈをカウントアッ
プしながら順次書込みを続ける。１水平ライン分の書込
みが終了するとメモリコントローラ６１は、垂直アドレ
スカウンタ６２Ｖをカウントアップし、水平アドレスカ
ウンタ６２Ｈに第２の初期アドレス０をセットして上記
同様の書込みを続ける。
すると、２周目の再生で色信号Ｃの書込を行なう。色信
号Ｃの書込みは、第２の初期アドレス（水平アドレス
０、垂直アドレス０）から開始する。メモリコントロー
ラ６１は、水平アドレスカウンタ６２Ｈをカウントアッ
プしながら順次書込みを続ける。１水平ライン分の書込
みが終了するとメモリコントローラ６１は、垂直アドレ
スカウンタ６２Ｖをカウントアップし、水平アドレスカ
ウンタ６２Ｈに第２の初期アドレス０をセットして上記
同様の書込みを続ける。
【００２０】この書込み処理を１画面分繰り返すと、色
信号メモリ４５には、水平アドレス０から色信号Ｃが書
込まれる。ただし、水平アドレス０〜（ｎ−１）には、
実質的に何も書き込まれない。つまり、水平アドレス０
〜（ｎ−１）には時刻ｔ2 〜ｔ3 の間に出力される無信
号が書込まれ、水平アドレスｎから色信号Ｃが書込まれ
ている。
信号メモリ４５には、水平アドレス０から色信号Ｃが書
込まれる。ただし、水平アドレス０〜（ｎ−１）には、
実質的に何も書き込まれない。つまり、水平アドレス０
〜（ｎ−１）には時刻ｔ2 〜ｔ3 の間に出力される無信
号が書込まれ、水平アドレスｎから色信号Ｃが書込まれ
ている。
【００２１】上記書込みが終了すると、上記輝度信号メ
モリ３３および色信号メモリ４５から、各行の読出し開
始アドレス（第１の初期アドレス、水平アドレスｎ）か
ら同一アドレスの信号を順番に読み出す。この読出しに
より、輝度信号Ｙおよび色信号Ｃの同時化が図られる。
モリ３３および色信号メモリ４５から、各行の読出し開
始アドレス（第１の初期アドレス、水平アドレスｎ）か
ら同一アドレスの信号を順番に読み出す。この読出しに
より、輝度信号Ｙおよび色信号Ｃの同時化が図られる。
【００２２】以上のメモリ処理を、図５に示したフロー
チャートを参照してより詳細に説明する。なお、スピン
ドルモータ１５の制御など装置全体の制御はシステムコ
ントローラ６７により行なわれる。
チャートを参照してより詳細に説明する。なお、スピン
ドルモータ１５の制御など装置全体の制御はシステムコ
ントローラ６７により行なわれる。
【００２３】再生が始まると、メモリコントローラ６１
は、アドレスカウンタ（水平、垂直アドレスカウンタ６
２Ｖ）に第１の初期アドレスをセットし（Ｓ１０１）、
輝度信号メモリ３３を書込可能状態にする（Ｓ１０
３）。そして、A/D 変換器３１から出力される輝度信号
Ｙの輝度信号メモリ３３への順次書込（格納）を開始す
る（Ｓ１０５）。つまり、水平同期信号Ｈが出力されて
から所定時間ｔ経過後に輝度信号Ｙの輝度信号メモリ３
３への書込を行なう。１水平ライン分の輝度信号を書き
込んだら、垂直アドレスカウンタ６２Ｖをカウントアッ
プし、水平アドレスカウンタ６２Ｈに第１の初期アドレ
スをセットして、次の１水平ライン分の輝度信号Ｙの書
込を行なう（Ｓ１０３、Ｓ１０５、Ｓ１０７）。以上の
書込み処理は、１画面分繰り返す（Ｓ１０３、Ｓ１０
５、Ｓ１０７）。つまり、フィールド記録の場合には１
トラック（１フィールド）分、フレーム記録の場合には
２トラック（２フィールド）分の輝度信号が記録される
が、本実施例は、フィールド記録なので１回転１トラッ
ク分の輝度信号Ｙを記録する。
は、アドレスカウンタ（水平、垂直アドレスカウンタ６
２Ｖ）に第１の初期アドレスをセットし（Ｓ１０１）、
輝度信号メモリ３３を書込可能状態にする（Ｓ１０
３）。そして、A/D 変換器３１から出力される輝度信号
Ｙの輝度信号メモリ３３への順次書込（格納）を開始す
る（Ｓ１０５）。つまり、水平同期信号Ｈが出力されて
から所定時間ｔ経過後に輝度信号Ｙの輝度信号メモリ３
３への書込を行なう。１水平ライン分の輝度信号を書き
込んだら、垂直アドレスカウンタ６２Ｖをカウントアッ
プし、水平アドレスカウンタ６２Ｈに第１の初期アドレ
スをセットして、次の１水平ライン分の輝度信号Ｙの書
込を行なう（Ｓ１０３、Ｓ１０５、Ｓ１０７）。以上の
書込み処理は、１画面分繰り返す（Ｓ１０３、Ｓ１０
５、Ｓ１０７）。つまり、フィールド記録の場合には１
トラック（１フィールド）分、フレーム記録の場合には
２トラック（２フィールド）分の輝度信号が記録される
が、本実施例は、フィールド記録なので１回転１トラッ
ク分の輝度信号Ｙを記録する。
【００２４】１フィールド分の輝度信号Ｙの記録が終了
すると、輝度信号メモリ３３の書込みを禁止し、水平、
垂直アドレスカウンタ６２Ｖに第２の初期アドレスをセ
ットする（Ｓ１０９、Ｓ１１１）。そして、水平同期信
号Ｈが出力されると、所定時間ｔ後に第２の初期アドレ
スから色信号Ｃを順次色信号メモリ４５に書き込む（Ｓ
１１３）。１水平ライン分の色信号Ｃを書込んだら、垂
直アドレスカウンタ６２Ｖをカウントアップし、水平ア
ドレスカウンタ６２Ｈに第２の初期アドレス０をセット
してＳ１１３に戻る（Ｓ１１３、Ｓ１１５、Ｓ１１
７）。同様の書込処理を、垂直同期信号Ｖが出力される
まで、つまり、１画面分繰り返す。
すると、輝度信号メモリ３３の書込みを禁止し、水平、
垂直アドレスカウンタ６２Ｖに第２の初期アドレスをセ
ットする（Ｓ１０９、Ｓ１１１）。そして、水平同期信
号Ｈが出力されると、所定時間ｔ後に第２の初期アドレ
スから色信号Ｃを順次色信号メモリ４５に書き込む（Ｓ
１１３）。１水平ライン分の色信号Ｃを書込んだら、垂
直アドレスカウンタ６２Ｖをカウントアップし、水平ア
ドレスカウンタ６２Ｈに第２の初期アドレス０をセット
してＳ１１３に戻る（Ｓ１１３、Ｓ１１５、Ｓ１１
７）。同様の書込処理を、垂直同期信号Ｖが出力される
まで、つまり、１画面分繰り返す。
【００２５】以上の処理により、メモリ３３、４５に
は、図４に左下がり斜線で示した態様で、輝度信号Ｙ及
び色信号Ｃが書き込まれる。なお、図４において、左下
がり斜線は書込みに利用する領域、右下り斜線は読出し
に利用する領域であるから、これらの二方向の斜線が交
差する領域は書込み及び読出しの双方に利用された領域
である。
は、図４に左下がり斜線で示した態様で、輝度信号Ｙ及
び色信号Ｃが書き込まれる。なお、図４において、左下
がり斜線は書込みに利用する領域、右下り斜線は読出し
に利用する領域であるから、これらの二方向の斜線が交
差する領域は書込み及び読出しの双方に利用された領域
である。
【００２６】輝度信号Ｙ及び色信号Ｃの書込が終了する
と、メモリコントローラ６１は、サンプリングクロック
発生回路６３が出力するサンプリングクロックｆｓ′に
同期して、輝度信号メモリ３３及び色信号メモリ４５か
ら同時に同一アドレスの信号を読み出す（Ｓ１１９）。
つまり、第１の初期アドレスから同時に順次読み出す。
この読出し処理により、輝度信号Ｙ及び色信号Ｃの同時
化が図られる。
と、メモリコントローラ６１は、サンプリングクロック
発生回路６３が出力するサンプリングクロックｆｓ′に
同期して、輝度信号メモリ３３及び色信号メモリ４５か
ら同時に同一アドレスの信号を読み出す（Ｓ１１９）。
つまり、第１の初期アドレスから同時に順次読み出す。
この読出し処理により、輝度信号Ｙ及び色信号Ｃの同時
化が図られる。
【００２７】以上の通り本実施例では、輝度信号Ｙと色
信号Ｃとを異なる時間帯にメモリ処理することにより単
一のアドレスカウンタにより処理が可能になり、さらに
輝度信号Ｙに対する色信号Ｃの遅延を、輝度信号Ｙの書
込開始アドレスを遅延時間Δｔに相当する量だけ飛ばし
た第１の初期アドレスｎにするとともに、読出しをこの
第１の初期アドレスから開始することで輝度信号Ｙと色
信号Ｃの同時化を実現している。以上輝度信号Ｙ及び色
信号Ｃとを同時化する実施例について説明したが、本発
明はこれに限定されず、例えば入力される２つの色差信
号Ｒ−Ｙ、Ｂ−Ｙの同時化回路に適用できることは当業
者に明らかである。
信号Ｃとを異なる時間帯にメモリ処理することにより単
一のアドレスカウンタにより処理が可能になり、さらに
輝度信号Ｙに対する色信号Ｃの遅延を、輝度信号Ｙの書
込開始アドレスを遅延時間Δｔに相当する量だけ飛ばし
た第１の初期アドレスｎにするとともに、読出しをこの
第１の初期アドレスから開始することで輝度信号Ｙと色
信号Ｃの同時化を実現している。以上輝度信号Ｙ及び色
信号Ｃとを同時化する実施例について説明したが、本発
明はこれに限定されず、例えば入力される２つの色差信
号Ｒ−Ｙ、Ｂ−Ｙの同時化回路に適用できることは当業
者に明らかである。
【００２８】
【発明の効果】以上の通り本発明は、時間的なずれをも
って入力される輝度信号および色信号を、異なる時間
に、それぞれ対応するメモリ手段にそのずれ時間に応じ
た異なる書込み開始位置から順次書込み、一画面分の書
込み終了後、各メモリ手段から同時に読み出し開始位置
から順次読み出して同時化するので、遅延回路が不要に
なり、しかも、異なる書込み位置に書込む時には時間的
に重ならず、同時に読出す時には同一の読出し位置から
読出すので、単独の書込み位置、読出し位置制御機能し
か有しない単一のメモリコントロール手段により同時化
を図ることが可能になった。
って入力される輝度信号および色信号を、異なる時間
に、それぞれ対応するメモリ手段にそのずれ時間に応じ
た異なる書込み開始位置から順次書込み、一画面分の書
込み終了後、各メモリ手段から同時に読み出し開始位置
から順次読み出して同時化するので、遅延回路が不要に
なり、しかも、異なる書込み位置に書込む時には時間的
に重ならず、同時に読出す時には同一の読出し位置から
読出すので、単独の書込み位置、読出し位置制御機能し
か有しない単一のメモリコントロール手段により同時化
を図ることが可能になった。
【図１】本発明の映像信号同時化装置を搭載したスチル
ビデオ装置の構成を示すブロック図である。
ビデオ装置の構成を示すブロック図である。
【図２】同実施例のメモリ及びメモリコントロールの構
造を示すブロック図である。
造を示すブロック図である。
【図３】輝度信号および色信号の入力状態を示すタイミ
ングチャートである。
ングチャートである。
【図４】信号メモリ後の輝度信号メモリのメモリマップ
及び色信号メモリのメモリマップを示す図である。
及び色信号メモリのメモリマップを示す図である。
【図５】本実施例の同時化処理に関するフローチャート
である。
である。
【図６】従来の遅延線を使用した同時化回路を示すブロ
ック図である。
ック図である。
【図７】従来のメモリを使用した同時化回路を示すブロ
ック図である。
ック図である。
１１ 磁気ディスク
１５ スピンドルモータ
２５ ハイパスフィルタ
２７ ローパスフィルタ
３０ 色差信号同時化回路
３３ 輝度信号Ｙメモリ
４５ 色信号Ｃメモリ
６１ メモリコントローラ
Claims (2)
- 【請求項１】 基準時から時間的なずれをもって入力さ
れる輝度信号および色信号を、それぞれの信号に対応す
るメモリ手段に、一画面分の信号が入力される毎に１信
号づつ順次書込み、一画面分の書き込みが終了した後に
上記輝度信号および色信号を同時に順次読み出して時間
的に同時の映像信号に変換する同時化装置であって、 上記輝度信号および色信号の上記各メモリ手段への書き
込みおよび該メモリ手段からの読み出しを制御する単一
のメモリコントロール手段を備え、 上記各メモリ手段は、少なくとも、上記輝度信号および
色信号を、１水平走査期間と上記ずれ時間の和に相当す
る時間分単位で書込む領域を一画面分備え、 上記メモリコントロール手段は、上記輝度信号および色
信号の上記各メモリ手段への書き込み処理において、基
準時が来る毎に該基準時から計時して、時間的に早く入
力される方の信号のときは、所定の初期位置よりも上記
ずれ時間に相当する領域分ずれた読み出し開始位置から
順次書込みを開始し、時間的に遅く入力される他方の信
号のときは、上記所定の初期位置から順次書込みを開始
し、一画面分の輝度信号および色信号の書込みが終了し
た後に、基準時が来る毎に上記各メモリ手段の上記読み
出し開始位置から同時に順次読み出して輝度信号および
色信号を同時化すること、を特徴とする映像信号の同時
化装置。 - 【請求項２】 請求項１記載の映像信号の同時化装置に
おいて、上記一画面の上記輝度信号および色信号は、１
フィールド分が磁気ディスクの１トラック１周分に記録
され、上記メモリコントロール手段は、該トラック１周
分の上記輝度信号または上記色信号が読み出されるとき
に、上記輝度信号または上記色信号毎にそれぞれ対応す
る上記書き込み処理をする映像信号の同時化装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP08351793A JP3435185B2 (ja) | 1993-04-09 | 1993-04-09 | 映像信号の同時化装置 |
| US08/224,776 US5528380A (en) | 1993-04-09 | 1994-04-08 | Apparatus and method for synchronizing picture signals |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP08351793A JP3435185B2 (ja) | 1993-04-09 | 1993-04-09 | 映像信号の同時化装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06303644A JPH06303644A (ja) | 1994-10-28 |
| JP3435185B2 true JP3435185B2 (ja) | 2003-08-11 |
Family
ID=13804682
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP08351793A Expired - Fee Related JP3435185B2 (ja) | 1993-04-09 | 1993-04-09 | 映像信号の同時化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3435185B2 (ja) |
-
1993
- 1993-04-09 JP JP08351793A patent/JP3435185B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH06303644A (ja) | 1994-10-28 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |