JP3433274B2 - マルチプレクサ - Google Patents
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/60—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors
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- H—ELECTRICITY
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- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
- H03K19/02—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components
- H03K19/173—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using elementary logic circuits as components
- H03K19/1731—Optimisation thereof
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Description
端子を選択するマルチプレクサに関するものである。
信号を入力するための多数の信号入力端子を備え、それ
らの信号入力端子を択一的に選択するマルチプレクサを
内蔵しているものがある。そして選択した信号入力端子
の信号を内部回路へ入力するようにしている。
コンピュータの要部の構成図である。ワンチップマイク
ロコンピュータMに設けている信号入力端子AN0 , AN1
…AN n-2 , ANn-1 は、スイッチ素子21,22 …23,24 の一
側端子と各別に接続される。スイッチ素子21,22 …23,2
4 の夫々の他側端子は共通接続されてアナログ/デジタ
ルコンバータ1と接続される。スイッチ素子21,22 …2
3,24 によりマルチプレクサが構成される。
ッチ素子21,22 …23,24 のオン,オフ動作により選択し
た信号入力端子AN0 , AN1 …ANn-2 , ANn-1 のいずれか
のアナログ信号をアナログ/デジタル変換する。そして
アナログ/デジタルコンバータ1は、電源電圧等により
予め定められる最適な電位振幅の入力信号に対して高精
度にアナログ/デジタル変換を行なう。
タMの複数の信号入力端子AN0 , AN 1 …ANn-2 , ANn-1
にアナログ/デジタル変換対象のアナログ信号が入力さ
れる場合に、例えば信号入力端子AN1 及びANn-2 に入力
されるアナログ信号の振幅が、最適な電位振幅より小さ
い場合には、図8に示すように小振幅のアナログ信号が
入力される信号入力端子AN1 , ANn-2 夫々に、アナログ
増幅器51,52 を外部接続して、それらにアナログ信号を
入力して最適振幅になるよう増幅して、信号入力端子AN
0 , AN1 …ANn-2 , ANn-1 に入力された全てのアナログ
信号がアナログ/デジタルコンバータ1に最適な電位振
幅で入力されるように、ユーザ側においてアナログ増幅
器51,52 を付加している。
チップマイクロコンピュータの信号入力端子にアナログ
増幅器を外部接続する場合には、アナログ増幅器の付加
によるコストアップが生じる。また接続したアナログ増
幅器の増幅度を、アナログ信号の振幅に応じて高精度に
調整する必要がある。そのためワンチップマイクロコン
ピュータのユーザ側ではアナログ増幅器のコスト及びそ
の増幅度を調整する手間によってワンチップマイクロコ
ンピュータを搭載した製品のコストアップが余儀なくさ
れるという問題がある。
ログ増幅器の増幅度の調整作業を削減すべく、図9に示
すように信号入力端子AN1 にのみアナログ増幅器5を外
部接続し、このアナログ増幅器5の入力側に単一のマル
チプレクサ11を外部接続して、振幅が小さいアナログ信
号をマルチプレクサ11により選択してアナログ増幅器5
へ入力することが考えられる。
度の調整作業を削減できるが、新たな外部回路としてマ
ルチプレクサが必要になる。そしてワンチップマイクロ
コンピュータの外部のマルチプレクサと、ワンチップマ
イクロコンピュータの内部のマルチプレクサとの両方を
選択制御する必要が生じて、アナログ信号を選択する制
御が複雑になり、結局、ワンチップマイクロコンピュー
タを搭載する製品のコストダウンが図れないという問題
がある。
端子の信号を他の信号端子へ出力できるマルチプレクサ
を提供することを目的とする。
サは、複数の信号が各別に入力される複数の第1信号端
子と、該第1信号端子以外の第2信号端子及び第3信号
端子と、第1信号端子夫々に一端子が各別に接続されて
いる複数の第1開閉部と、第1信号端子とともに選択で
きる第2信号端子に一端子が接続されている第2開閉部
と、第3信号端子に一端子が接続されている第3開閉部
と、第1開閉部及び第2開閉部夫々の他端子と第3開閉
部の他端子との間に介装された第4開閉部とを備える。
が各別に入力される複数の第1信号端子と、該第1信号
端子以外の第2信号端子及び第3信号端子と、第1信号
端子夫々に一端子が各別に接続されている複数の第1開
閉部と、第1信号端子とともに選択できる第2信号端子
に一端子が接続されている第2開閉部と、第3信号端子
に一端子が接続されている第3開閉部と、第1開閉部及
び第2開閉部夫々の他端子と第3開閉部の他端子との間
に介装された第4開閉部とを備え、第4開閉部を開路し
た場合に第2開閉部を閉路すべく構成する。
が各別に入力される複数の第1信号端子と、該第1信号
端子以外の第2信号端子及び第3信号端子と、第1信号
端子夫々に一端子が各別に接続されている複数の第1開
閉部と、第1信号端子とともに選択できる第2信号端子
に一端子が接続されている第2開閉部と、第1信号端子
とともに選択できる第3信号端子に一端子が接続されて
いる第3開閉部と、第1開閉部及び第2開閉部夫々の他
端子と第3開閉部の他端子との間に介装された第4開閉
部とを備え、第4開閉部を開路した場合に第2開閉部及
び第3開閉部を閉路すべく構成する。
が各別に入力される複数の第1信号端子と、該第1信号
端子以外の単一の第2信号端子と、第1信号端子夫々に
一端子が各別に接続されている複数の第1開閉部と、第
1信号端子とともに選択できる第2信号端子に一端子が
接続されている単一の第2開閉部と、第1開閉部及び第
2開閉部の各他端子と一端子が接続されている第4開閉
部とからなり、該第4開閉部が開路した場合に第2開閉
部が閉路する回路ブロックを複数設けるとともに、第1
信号端子以外の第3信号端子と、第1信号端子とともに
選択できる該第3信号端子と一端子が接続されている第
3開閉部とを備え、一回路ブロックの第4開閉部の他端
子と他の一回路ブロックの第4開閉部の一端子とを接続
し、第3開閉部の他端子に第4開閉部の他端子が接続さ
れた回路ブロックの第4開閉部が開路した場合に、第3
開閉部を閉路すべく構成する。
が各別に入力される複数の第1信号端子と、該第1信号
端子以外の単一の第2信号端子と、第1信号端子夫々に
一端子が各別に接続されている複数の第1開閉部と、第
1信号端子とともに選択できる第2信号端子に一端子が
接続されている単一の第2開閉部と、第1開閉部及び第
2開閉部の各他端子に一端子が接続されている第4開閉
部とからなり、該第4開閉部が開路した場合に第2開閉
部が閉路する回路ブロックを複数設けるとともに、第1
信号端子以外の第3信号端子と、第1信号端子とともに
選択できる該第3信号端子に一端子が接続されている第
3開閉部とを備え、各回路ブロックの第4開閉部の他端
子と第3開閉部の他端子とを接続しており、この第4開
閉部が全て開路した場合に第3開閉部を閉路すべく構成
する。
閉部を閉路すると、いずれかの第1開閉部、第2開閉部
及び第3開閉部のいずれかを閉路することで、閉路した
開閉部に接続された信号端子を選択できる。第4開閉部
を開路すると第2開閉部及び第3開閉部が閉路する。い
ずれかの第1開閉部を閉路すると、閉路した第1開閉部
と接続された信号端子と第2開閉部と接続されている信
号端子とを短絡でき、このとき第3開閉部を閉路するこ
とで第3開閉部と接続されている信号端子を所定回路の
接続端子として選択できる。これにより、複数の信号端
子の信号を択一的に選択できる。また信号端子に入力さ
れた信号を、他の信号端子へ出力できる。
を閉路すると、その回路ブロックのいずれかの第1開閉
部、第2開閉部のいずれかを閉路することで、閉路した
開閉部に接続されている信号端子を、第4開閉部が次回
路ブロックの第4開閉部と接続されている回路ブロック
のときは、次回路ブロックの第4開閉部の接続端子とし
て選択でき、第4開閉部が第3開閉部と接続されている
回路ブロックのときは、所定回路の接続端子として選択
できる。回路ブロックの第4開閉部を開路すると、その
回路ブロックの第2開閉部が閉路する。その回路ブロッ
クのいずれかの第1開閉部を閉路すると、閉路した第1
開閉部と接続されている信号端子と、第2開閉部に接続
されている信号端子とを短絡できる。このとき第3開閉
部を閉路することで第3開閉部と接続されている信号端
子を所定回路の接続端子として選択できる。これによ
り、全ての回路ブロックの信号端子の信号を択一的に選
択できる。また回路ブロックごとに、信号端子に入力さ
れた信号を、その回路ブロックの他の信号端子へ出力で
きる。
を閉路すると、その回路ブロックのいずれかの第1開閉
部、第2開閉部を閉路することで、閉路した開閉部に接
続されている信号端子を所定回路の接続端子として選択
できる。回路ブロックの第4開閉部を開路すると、第2
開閉部が閉路する。各回路ブロックの第4開閉部のすべ
てを開路すると、第3開閉部が閉路する。回路ブロック
のいずれかの第1開閉部を閉路すると、閉路した第1開
閉部と接続されている信号端子と、第2開閉部に接続さ
れている信号端子とを短絡でき、また第3開閉部と接続
されている信号端子を所定回路の接続端子として選択で
きる。これにより、全ての回路ブロックの信号端子の信
号を択一的に選択できる。また回路ブロックごとに、信
号端子に入力された信号を、その回路ブロックの他の信
号端子へ出力できる。
述する。図1は本発明に係るマルチプレクサを内蔵して
いるマイクロコンピュータの構成を示すブロック図であ
る。ワンチップマイクロコンピュータ (以下マイクロコ
ンピュータという) Mに、信号の入出力が可能な信号端
子AN0 , AN1 …ANn-3 ,ANn-2 , ANn-1 が設けられてい
る。信号端子AN0 ( AN1 …ANn-3 ) は、第1開閉部たる
スイッチ素子21 (22…23) の一端子と接続される。信号
端子ANn-2 は第2開閉部たるスイッチ素子24の一端子と
接続される。信号端子ANn-1 は第3開閉部たるスイッチ
素子25の一端子と接続される。スイッチ素子21,22 …2
3,24 の他端子はノード41に共通接続される。ノード41
は第4開閉部たるスイッチ素子31の一端子と接続され
る。スイッチ素子31の他端子及びスイッチ素子25の他端
子は共通に接続されてアナログ/デジタルコンバータ1
の入力側と接続される。これらのスイッチ素子21,22 …
23,24,25,31 によりマルチプレクサが構成される。そし
て、スイッチ素子31が開路した場合は、スイッチ素子2
4,25 がともに閉路するよう制御される。
いるマイクロコンピュータMの使用方法を説明する。図
2はマイクロコンピュータMの使用状態の説明図であ
る。マイクロコンピュータMに入力するアナログ信号の
振幅がアナログ/デジタルコンバータ1に規定している
最適振幅より小さい場合は図2に示すように、信号端子
ANn-2 と信号端子ANn-1 との間に、入力側を信号端子AN
n-2 に接続したアナログ増幅器5を介装させる。この場
合、信号端子AN0 , AN1 …ANn-3 , ANn-1 は信号入力端
子となり、信号端子ANn-2 は信号出力端子となる。
より小さい振幅のアナログ信号を入力する場合には、ス
イッチ素子31を開路させる。それによりスイッチ素子2
4,25がともに閉路する。そしてスイッチ素子22を閉路す
ると、信号端子AN1 のアナログ信号がスイッチ素子22,2
4 を介して信号端子ANn-2 へ出力され、アナログ増幅器
5へ入力されて最適振幅に増幅される。そして増幅され
たアナログ信号は信号端子ANn-1 へ入力され、スイッチ
素子25を介してアナログ/デジタルコンバータ1へ入力
されて、高精度にアナログ/デジタル変換される。
ログ信号を例えば信号端子AN0 に入力する場合は、スイ
ッチ素子31を閉路し、スイッチ素子25を開路する。そこ
でスイッチ素子21,22 …23のうちスイッチ素子21のみを
閉路すれば、信号端子AN0 に入力されたアナログ信号が
スイッチ素子21及び31を介してアナログ/デジタルコン
バータ1へ入力され、アナログ信号は高精度にアナログ
/デジタル変換される。
タ1に規定している最適振幅に比較して、小さい振幅の
アナログ信号及び同程度の振幅のアナログ信号をマイク
ロコンピュータMへ入力する場合でも、マイクロコンピ
ュータMにアナログ増幅器5を1個外部接続すればよ
く、マイクロコンピュータMを使用したシステムにおい
てマイクロコンピュータに接続するアナログ増幅器の数
を最小限にできる。また、アナログ増幅器の数を最小限
にできることにより、アナログ増幅器の増幅度の調整手
間を大幅に減少させることができる。更に、アナログ信
号の選択はスイッチ素子21,22 …23,24,25,31 の開閉で
実現できるため、スイッチ素子を容易に開閉制御でき
る。
おいて、アナログ/デジタルコンバータ及びマルチプレ
クサの性能をテストする場合には、例えば信号端子AN0
にアナログ信号を入力してスイッチ素子31を介してアナ
ログ/デジタルコンバータ1へ入力し、そのアナログ/
デジタル変換結果でアナログ/デジタルコンバータの性
能をテストできる。またスイッチ素子31を開路して例え
ばスイッチ素子21と22とを閉路し、信号端子AN0 にアナ
ログ信号を入力し、そのアナログ信号を信号端子AN1 に
出力させて、入力したアナログ信号の振幅と出力したア
ナログ信号の振幅とを比較して、マルチプレクサの性能
をテストできる。そのためマルチプレクサの性能をテス
トする場合には、アナログ/デジタルコンバータによる
アナログ/デジタル変換動作を必要とせず、そのテスト
時間が短縮し、アナログ/デジタルコンバータ及びマル
チプレクサ夫々の性能をテストする時間を大幅に短縮さ
せることができる。
しているマイクロコンピュータの他の構成及びその使用
状態を示すブロック図である。マイクロコンピュータM
にタイマ用信号端子TIM が設けられ、このタイマ用信号
端子TIM は、マイクロコンピュータMに内蔵しているタ
イマ6と接続される。それ以外のマイクロコンピュータ
Mの構成は図1に示したマイクロコンピュータの構成と
同様であり、同一構成部分には同一符号を付している。
このマイクロコンピュータMは、それに入力されるアナ
ログ信号が単一である場合に使用される。
法を説明する。このマイクロコンピュータMの場合は図
3に示すように、信号端子ANn-2 とタイマ用信号端子TI
M とを外部で直結する。そして、この場合はスイッチ素
子31を常に開路させ、スイッチ素子24,25 を常に閉路す
るよう制御される。いま、信号端子ANn-1 にアナログ信
号を入力すると、そのアナログ信号がスイッチ素子25を
介して常にアナログ/デジタルコンバータ1に入力さ
れ、アナログ/デジタル変換される。また、スイッチ素
子21,22 …23,24 はタイマ6へ入力するデジタル信号を
選択するマルチプレクサとして動作し、即ちスイッチ素
子24を常に閉路し、信号端子AN0 , AN1 …ANn-3 に夫々
対応するスイッチ素子21,22 …23のいずれか一つを閉路
する。そうすると、信号端子AN0 , AN1 …ANn-3 に入力
されている異なるデジタル信号を択一的に選択してタイ
マ用信号端子TIM に入力し、そのデジタル信号がタイマ
6に入力されて、タイマ6は入力されたデジタル信号を
カウントして計時し、デジタル信号のカウント値が所定
値に達するまでの時間を計時する。
Mの外部に新たな回路を付加することなく、タイマ6が
カウントするデジタル信号のチャネル数を増加すること
ができ、マイクロコンピュータの応用範囲を拡大でき
る。
蔵しているマイクロコンピュータの他の構成及び使用状
態を示すブロック図である。マイクロコンピュータM
に、シリアルクロック端子 SIOclk 及びシリアルデータ
端子 SIOtxd が設けられ、シリアルクロック端子 SIO
clk 及びシリアルデータ端子 SIOtxd はシリアル入出力
回路7のクロック出力端子及びシリアルデータ出力端子
と接続される。それ以外のマイクロコンピュータMの構
成は図1に示したマイクロコンピュータの構成と同様で
あり、同一構成部分には同一符号を付している。この場
合もアナログ/デジタルコンバータ1へ入力するアナロ
グ信号は、単一である。
法を説明する。このマイクロコンピュータMの場合は、
信号端子AN0 が外部のマイクロコンピュータ81の信号入
力端子と、信号端子AN1 が外部のマイクロコンピュータ
82の信号入力端子と接続される。またシリアルクロック
端子 SIOclk は、信号端子ANn-2 と外部で直結される。
シリアルデータ端子 SIOtxd はマイクロコンピュータ8
1,82 夫々のデータ入力端子と接続される。この場合、
信号端子ANn-2 ,ANn-1 は信号入力端子、信号端子A
N0 , AN1 …ANn-3 及びシリアルクロック端子 SIOclk ,
シリアルデータ端子SIOtxd は信号出力端子となる。
ンピュータMから外部のマイクロコンピュータ81,82 へ
データを転送するようにしている。そのためスイッチ素
子31を開路して、スイッチ素子24,25 をともに閉路させ
る。またスイッチ素子21を閉路する。そうするとシリア
ル入出力回路7が出力するシリアルクロックがマイクロ
コンピュータ81に入力され、外部のマイクロコンピュー
タ81は入力されたシリアルクロックに同期してシリアル
データ端子 SIOtxd から入力されるデータをサンプリン
グして受取る。
定) している場合、シリアルデータ端子 SIOtxd から入
力されるデータのサンプリングを行わない。またスイッ
チ素子31を常に開路し、スイッチ素子24を常に閉路し、
信号端子AN0 , AN1 …ANn-3に夫々対応するスイッチ素
子21,22 …23のいずれか一つを閉路することによりマル
チプレクサとして動作させて、シリアルクロック端子 S
IOclk からのシリアルクロックをマイクロコンピュータ
81,82 又は信号端子ANn-3 に選択的に供給される。その
ため、このような構成にすれば、マイクロコンピュータ
Mの外部に新たな外部回路を付加することなく、シリア
ル入出力回路7から出力されるデータを受け取るマイク
ロコンピュータMの数を増加させることができて、マイ
クロコンピュータMの応用範囲を拡大できる。
内蔵したマイクロコンピュータの構成を示すブロック図
である。マイクロコンピュータMに複数の信号端子AN0
…からなる第1信号端子群と、単一の信号端子ANm-1 と
が設けられ、また複数の信号端子ANm …ANn-3 からなる
第2信号端子群と、単一信号端子ANn-2 とが設けられ、
更に単一の信号端子ANn-1 が設けられる。信号端子AN0
…は、スイッチ素子21A …の一端子と各別に接続され、
信号端子ANm-1 はスイッチ素子24A の一端子と接続され
る。信号端子ANm …ANn-3 はスイッチ素子21B …23B の
一端子と各別に接続され、信号端子ANn-2 はスイッチ素
子24B の一端子と接続され、信号端子AN n-1 はスイッチ
素子25の一端子と接続される。
ノード42と接続され、スイッチ素子21B …23B,24B の各
他端子はともにノード41と接続される。ノード42とノー
ド41との間にスイッチ素子31A が介装される。スイッチ
素子25の他端子は、スイッチ素子31B を介してノード41
と接続され、直接にアナログ/デジタルコンバータ1の
入力側と接続される。スイッチ素子31A が開路した場合
はスイッチ素子24A が閉路し、スイッチ素子31B が開路
した場合はスイッチ素子24B が閉路するように制御され
る。
を説明する。図5においては、信号端子AN0 に、アナロ
グ/デジタルコンバータ1に規定する最適振幅に近い振
幅のアナログ信号が入力される場合であって、スイッチ
素子21A,31A,31B を閉路すれば、信号端子AN0 に入力さ
れたアナログ信号がアナログ/デジタルコンバータ1へ
入力されて、そのアナログ信号が高精度にアナログ/デ
ジタル変換される。
ログ信号の振幅が、アナログ/デジタルコンバータに規
定する最適振幅に比較して小さい場合であって、アナロ
グ増幅器の増幅度をアナログ信号ごとに変更するときに
は、図6に示す構成にする。図6は単一のアナログ増幅
器を用いるマイクロコンピュータMの使用状態を示すブ
ロック図であって、マイクロコンピュータMの外部に増
幅度設定用抵抗91,92,93及びオペアンプ10が付加され
る。
てオペアンプ10の出力端子10a と、信号端子AN1 は増幅
度設定用抵抗92を介してオペアンプ10の出力端子10a と
接続され、オペアンプの出力端子10a は信号端子ANn-1
と接続される。信号端子AN2は増幅度設定用抵抗93を介
して接地され、また直接にオペアンプ10の反転入力端子
−と接続される。信号端子ANn-2 はオペアンプ10の非反
転入力端子+と接続される。この場合、信号端子AN0 ,
AN1 ,AN3 …ANn-3 ,ANn-1 は、信号入力端子となり、
信号端子AN2 ,ANn-2 は信号出力端子となる。そしてオ
ペアンプ10と増幅度設定用抵抗91,92,93の組合せにより
構成される非反転増幅器でアナログ増幅器が構成され
る。
アナログ信号が入力される場合は、スイッチ素子31A,31
B を開路し、それによりスイッチ素子24A,24B が閉路す
る。またスイッチ素子21A,21B を閉路する。そして信号
端子AN3 にアナログ信号が入力されると、そのアナログ
信号はスイッチ素子21B 及び24B を介して信号端子AN
n-2 へ出力されて、オペアンプ10の非反転入力端子+へ
入力される。そしてオペアンプ10、増幅度設定用抵抗9
1,93 で構成される非反転増幅器で増幅され、アナログ
/デジタルコンバータ1に規定する最適振幅に増幅され
た後、信号端子ANn- 1 を介してアナログ/デジタルコン
バータ1へ入力され、高精度にアナログ/デジタル変換
される。
用抵抗91と93との抵抗比で決定されるので、増幅度を変
更する場合はスイッチ素子21A を開路し、スイッチ素子
22Aを閉路してオペアンプ10、増幅度設定用抵抗92,93
により非反転増幅器を構成する。またアナログ信号の振
幅が適正であってオペアンプ10を介さずにアナログ信号
を直接にアナログ/デジタルコンバータ1へ入力する場
合は、スイッチ素子31B を閉路して、スイッチ素子25を
開路させれば、アナログ信号を増幅せずにアナログ/デ
ジタルコンバータ1へ入力できる。
信号端子AN0 , AN1 , AN2 が不使用になるので、スイッ
チ素子31A を閉路することで信号端子AN0 , AN1 , A
N2 , AN 3 …ANn-3 に入力されるアナログ信号を択一的
に選択するマルチプレクサとして使用できる。
ピュータを使用する場合は、アナログ信号の振幅が異な
る複数のアナログ信号であっても、マイクロコンピュー
タMの外部に、単一のアナログ増幅器を備えればよく、
外部に付加するアナログ増幅器の数を最小限にすること
ができる。また、アナログ信号を選択する制御及びアナ
ログ増幅器の増幅度を変更する制御は、スイッチ素子21
A,22A,24A 、スイッチ素子31A,31B の開閉で実現できる
ため、制御動作が簡単である。
とを、スイッチ素子31A を介して接続しているが、ノー
ド42をスイッチ素子31A を介してスイッチ素子25と31B
とアナログ/デジタルコンバータ1との接続中間点と接
続することができる。つまり、スイッチ素子21A,…24A,
31A からなる回路と、スイッチ素子21B …23B,24B,31B
からなる回路を並列的に接続するようにしても同様の効
果を得ることができる。この場合は、スイッチ素子31A,
31B が共に開路した場合には、スイッチ素子25を開路さ
せる。
ンピュータに内蔵した場合について説明したが、マイク
ロコンピュータに内蔵するものに限定されるものではな
い。また本実施例ではマルチプレクサによりアナログ/
デジタルコンバータへ入力するアナログ信号を選択する
場合について説明したが、それは例示であり、アンプ又
は制御回路に入力するアナログ信号を選択する場合であ
っても同様に適用でき、同様の効果を得ることは勿論で
ある。
明,第3発明のマルチプレクサは、複数の信号端子の信
号を択一的に選択でき、また信号端子の信号を他の信号
端子へ出力することができる。そのため、マルチプレク
サの性能テストを、マルチプレクサが選択した信号の転
送先の回路を動作させずに短時間に行える。そしてマル
チプレクサ及び転送先の回路の性能テストのテスト時間
を短縮できる。更にマルチプレクサを、例えばワンチッ
プマイクロコンピュータに内蔵した場合は、そのワンチ
ップマイクロコンピュータを製品に組み込むユーザ側に
おいて、ワンチップマイクロコンピュータの外部に設け
る増幅器等の外部回路の数を最小限にできて、ユーザ側
におけるコストダウンが図れる。また、付加する外部回
路を少なくできるから、その回路動作を調整する作業時
間が短くなり、これによってもコストダウンが図れる。
は、複数の信号端子の信号を択一的に選択でき、また信
号端子の信号を他の信号端子へ出力することができる。
マルチプレクサの性能テストを、マルチプレクサが選択
した信号の転送先の回路を動作させずに短時間に行え
る。そしてマルチプレクサ及び転送先の回路の性能テス
トのテスト時間を短縮できる。更にマルチプレクサを例
えばワンチップマイクロコンピュータに内蔵した場合
は、そのワンチップマイクロコンピュータの外部に設け
る増幅器の外部回路の数を最小限にでき、ユーザ側にお
けるコストダウンが図れる。また付加する外部回路を少
なくできるから、その回路動作を調整する作業時間が短
くなり、それによってもコストダウンが図れる。
号数、又はマルチプレクサから出力される信号数、即ち
信号のチャネル数を多くすることができて、マルチプレ
クサを用いる製品の使用範囲を拡大できる。
チップマイクロコンピュータの構成図である。
使用状態のブロック図である。
及び使用状態のブロック図である。
及び使用状態のブロック図である。
ワンチップマイクロコンピュータの構成図である。
の説明図である。
マイクロコンピュータの構成図である。
ある。
図である。
子、41,42 ノード、AN0 , AN1 , ANn-3 , ANn-2 , AN
n-1 , ANm-1 , ANm 信号端子。
Claims (5)
- 【請求項1】 複数の信号が各別に入力される複数の第
1信号端子を択一的に選択するマルチプレクサにおい
て、 前記第1信号端子以外の第2信号端子及び第3信号端子
と、前記第1信号端子夫々に一端子が各別に接続されて
いる複数の第1開閉部と、前記第1信号端子とともに選
択できる前記第2信号端子に一端子が接続されている第
2開閉部と、前記第3信号端子に一端子が接続されてい
る第3開閉部と、第1開閉部及び第2開閉部夫々の他端
子と第3開閉部の他端子との間に介装された第4開閉部
とを備えることを特徴とするマルチプレクサ。 - 【請求項2】 複数の信号が各別に入力される複数の第
1信号端子を択一的に選択するマルチプレクサにおい
て、 前記第1信号端子以外の第2信号端子及び第3信号端子
と、前記第1信号端子夫々に一端子が各別に接続されて
いる複数の第1開閉部と、前記第1信号端子とともに選
択できる前記第2信号端子に一端子が接続されている第
2開閉部と、前記第3信号端子に一端子が接続されてい
る第3開閉部と、第1開閉部及び第2開閉部夫々の他端
子と第3開閉部の他端子との間に介装された第4開閉部
とを備え、第4開閉部が開路した場合に第2開閉部を閉
路すべく構成してあることを特徴とするマルチプレク
サ。 - 【請求項3】 複数の信号が各別に入力される複数の第
1信号端子を択一的に選択するマルチプレクサにおい
て、 前記第1信号端子以外の第2信号端子及び第3信号端子
と、前記第1信号端子夫々に一端子が各別に接続されて
いる複数の第1開閉部と、前記第1信号端子とともに選
択できる前記第2信号端子に一端子が接続されている第
2開閉部と、前記第1信号端子とともに選択できる前記
第3信号端子に一端子が接続されている第3開閉部と、
第1開閉部及び第2開閉部夫々の他端子と第3開閉部の
他端子との間に介装された第4開閉部とを備え、第4開
閉部が開路した場合に第2開閉部及び第3開閉部を閉路
すべく構成してあることを特徴とするマルチプレクサ。 - 【請求項4】 複数の信号が各別に入力される複数の第
1信号端子を択一的に選択するマルチプレクサにおい
て、 前記第1信号端子以外の単一の第2信号端子と、前記第
1信号端子夫々に一端子が各別に接続されている複数の
第1開閉部と、前記第1信号端子とともに選択できる前
記第2信号端子に一端子が接続されている単一の第2開
閉部と、第1開閉部及び第2開閉部の各他端子に一端子
が接続されている第4開閉部とからなり、該第4開閉部
が開路した場合に第2開閉部が閉路する回路ブロックを
複数設けるとともに、第1信号端子以外の第3信号端子
と、該第3信号端子に一端子が接続されている第3開閉
部とを備え、一回路ブロックの第4開閉部の他端子と、
他の一回路ブロックの第4開閉部の一端子とを接続して
おり、第3開閉部の他端子に第4開閉部の他端子が接続
された回路ブロックの第4開閉部が開路した場合に前記
第3開閉部が閉路する構成にしてあることを特徴とする
マルチプレクサ。 - 【請求項5】 複数の信号が各別に入力される複数の第
1信号端子を択一的に選択するマルチプレクサにおい
て、 前記第1信号端子以外の単一の第2信号端子と、前記第
1信号端子夫々に一端子が各別に接続されている複数の
第1開閉部と、前記第1信号端子とともに選択できる前
記第2信号端子に一端子が接続されている単一の第2開
閉部と、第1開閉部及び第2開閉部の各他端子に一端子
が接続されている第4開閉部とからなり、第4開閉部が
開路した場合に第2開閉部が閉路する回路ブロックを複
数設けるとともに、第1信号端子以外の第3信号端子
と、該第3信号端子に一端子が接続されている第3開閉
部とを備え、各回路ブロックの第4開閉部の他端子と、
第3開閉部の他端子とを接続しており、この第4開閉部
が全て開路した場合に、前記第3開閉部が閉路する構成
にしてあることを特徴とするマルチプレクサ。
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Application Number | Priority Date | Filing Date | Title |
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JP30519294A JP3433274B2 (ja) | 1994-12-08 | 1994-12-08 | マルチプレクサ |
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Application Number | Priority Date | Filing Date | Title |
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Family
ID=17942164
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Application Number | Title | Priority Date | Filing Date |
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Country Status (4)
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