JP3405008B2 - 垂直同期信号回路 - Google Patents
垂直同期信号回路Info
- Publication number
- JP3405008B2 JP3405008B2 JP24572595A JP24572595A JP3405008B2 JP 3405008 B2 JP3405008 B2 JP 3405008B2 JP 24572595 A JP24572595 A JP 24572595A JP 24572595 A JP24572595 A JP 24572595A JP 3405008 B2 JP3405008 B2 JP 3405008B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- vertical
- output
- delay
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Landscapes
- Synchronizing For Television (AREA)
Description
【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、テレビジョン受像器及
びモニター受像器に適用される、安定して垂直同期信号
を得るこがのできる垂直同期信号回路に関するものであ
る。
びモニター受像器に適用される、安定して垂直同期信号
を得るこがのできる垂直同期信号回路に関するものであ
る。
【0002】
【従来の技術】従来のテレビジョン受像器及びモニター
受像器の垂直同期信号回路は、図4のような構成になっ
ている。ビデオ信号あるいはRGBコンポジット信号が
同期分離回路1に加えられ、その出力である垂直同期信
号が垂直発振回路6に入力され、その出力パルスが垂直
偏向回路7を駆動し垂直走査を行う。
受像器の垂直同期信号回路は、図4のような構成になっ
ている。ビデオ信号あるいはRGBコンポジット信号が
同期分離回路1に加えられ、その出力である垂直同期信
号が垂直発振回路6に入力され、その出力パルスが垂直
偏向回路7を駆動し垂直走査を行う。
【0003】特願平3ー20159号公報において、垂
直発振回路6を設ける代わりに水平周波数を分周して垂
直同期信号を得るカウントダウン方式が提案されてい
る。
直発振回路6を設ける代わりに水平周波数を分周して垂
直同期信号を得るカウントダウン方式が提案されてい
る。
【0004】
【発明が解決しようとする課題】しかしながら、このよ
うな従来の技術では、垂直同期信号が1つでも欠落する
と正常な垂直走査が行われなくなり、映像が乱れるとい
う問題を有していた。
うな従来の技術では、垂直同期信号が1つでも欠落する
と正常な垂直走査が行われなくなり、映像が乱れるとい
う問題を有していた。
【0005】本発明は上記課題を解決するもので、テレ
ビジョン受像器及びモニター受像器において、例えばA
PL変動により垂直同期信号が欠落した時でも安定して
同期信号を得ることのできる垂直同期信号回路を提供す
ることを目的としている。
ビジョン受像器及びモニター受像器において、例えばA
PL変動により垂直同期信号が欠落した時でも安定して
同期信号を得ることのできる垂直同期信号回路を提供す
ることを目的としている。
【0006】
【課題を解決するための手段】本発明は上記目的を達成
するために、垂直同期信号を抽出するための同期分離回
路とその出力をトリガとし二垂直期間遅延させる遅延回
路と、その遅延回路が動作している間の同期分離回路の
出力をトリガとし二垂直期間遅延させるもう一つの遅延
回路と、2つの遅延回路が同出力の場合には比較回路に
より一方の遅延回路の動作をクリアーするリセット回路
と、同期分離回路と2つの遅延回路の出力を合成する加
算回路と、垂直発振回路、垂直偏向回路により構成され
る。
するために、垂直同期信号を抽出するための同期分離回
路とその出力をトリガとし二垂直期間遅延させる遅延回
路と、その遅延回路が動作している間の同期分離回路の
出力をトリガとし二垂直期間遅延させるもう一つの遅延
回路と、2つの遅延回路が同出力の場合には比較回路に
より一方の遅延回路の動作をクリアーするリセット回路
と、同期分離回路と2つの遅延回路の出力を合成する加
算回路と、垂直発振回路、垂直偏向回路により構成され
る。
【0007】ここで、各遅延回路で一垂直期間遅延させ
ずに二垂直期間遅延させているのは、例えばVTR機器
においては、一度録画した映像信号を再生する際に1フ
レームの長さは一定であるが、1フィールド目と2フィ
ールド目の垂直期間の長さが等しくなく、本来の垂直期
間の長さに対して長短の繰り返しに置き換えられること
がある。
ずに二垂直期間遅延させているのは、例えばVTR機器
においては、一度録画した映像信号を再生する際に1フ
レームの長さは一定であるが、1フィールド目と2フィ
ールド目の垂直期間の長さが等しくなく、本来の垂直期
間の長さに対して長短の繰り返しに置き換えられること
がある。
【0008】長さを長短に置き換えられたその信号を一
垂直期間遅延すると同期信号と映像信号の位置関係がず
れることになり、映像が上下に揺れることになる。そこ
で二垂直期間遅延させて、フレームの1フィールド目の
同期信号で、その次のフレームの1フィールド目の垂直
発振を行い、2フィールド目の同期信号で、その次のフ
レームの2フィールド目の垂直発振を行う構成としてい
る。
垂直期間遅延すると同期信号と映像信号の位置関係がず
れることになり、映像が上下に揺れることになる。そこ
で二垂直期間遅延させて、フレームの1フィールド目の
同期信号で、その次のフレームの1フィールド目の垂直
発振を行い、2フィールド目の同期信号で、その次のフ
レームの2フィールド目の垂直発振を行う構成としてい
る。
【0009】
【作用】本発明は上記した構成により、例えばAPL変
動により同期分離回路出力の垂直同期信号が欠落したと
しても、同期分離回路の出力と、2つの遅延回路の出力
を合成することで安定して垂直同期信号を得るとができ
る。
動により同期分離回路出力の垂直同期信号が欠落したと
しても、同期分離回路の出力と、2つの遅延回路の出力
を合成することで安定して垂直同期信号を得るとができ
る。
【0010】
【実施例】以下、本発明の一実施例について図1、2、
3を参照しながら説明する。
3を参照しながら説明する。
【0011】図1は安定して垂直同期信号を得るための
垂直同期信号回路のブロック図である。図2は正常動作
時の各部波形図、図3は誤動作時の各部波形図である。
垂直同期信号回路のブロック図である。図2は正常動作
時の各部波形図、図3は誤動作時の各部波形図である。
【0012】図1中、符号1は垂直同期信号を抽出する
ための同期分離回路、2と3は遅延回路、4は遅延回路
2、3の出力波形を比較する比較回路、5は加算回路、
6は垂直発振回路、7は垂直偏向回路である。
ための同期分離回路、2と3は遅延回路、4は遅延回路
2、3の出力波形を比較する比較回路、5は加算回路、
6は垂直発振回路、7は垂直偏向回路である。
【0013】次に、上記構成回路の動作について説明す
る。ビデオ信号あるいはRGBコンポジット信号を同期
分離回路1に入力し、垂直同期信号を抽出する。その出
力を2つの遅延回路2、3と加算回路5に入力する。遅
延回路2は、同期分離回路1の出力を二垂直期間遅延し
たパルスを出力し、遅延回路3は、遅延回路2が動作し
ている間の同期分離回路1の出力をトリガとして二垂直
期間遅延したパルスを出力する。
る。ビデオ信号あるいはRGBコンポジット信号を同期
分離回路1に入力し、垂直同期信号を抽出する。その出
力を2つの遅延回路2、3と加算回路5に入力する。遅
延回路2は、同期分離回路1の出力を二垂直期間遅延し
たパルスを出力し、遅延回路3は、遅延回路2が動作し
ている間の同期分離回路1の出力をトリガとして二垂直
期間遅延したパルスを出力する。
【0014】同期分離回路1と遅延回路2、3から得ら
れた各出力を加算回路5により加算する。そこで加算さ
れた波形を、疑似垂直同期信号として垂直発振回路6に
入力し、垂直偏向回路を駆動し垂直走査を行う。
れた各出力を加算回路5により加算する。そこで加算さ
れた波形を、疑似垂直同期信号として垂直発振回路6に
入力し、垂直偏向回路を駆動し垂直走査を行う。
【0015】図2において、(a)は同期分離回路1の
出力である垂直同期信号波形図、(b)は遅延回路2の
出力波形図、(c)は遅延回路3の出力波形図、(d)
は加算回路5の出力波形図である。
出力である垂直同期信号波形図、(b)は遅延回路2の
出力波形図、(c)は遅延回路3の出力波形図、(d)
は加算回路5の出力波形図である。
【0016】ここで、同期分離回路1の出力である垂直
同期信号が1つ欠落した場合の回路動作を説明する。
同期信号が1つ欠落した場合の回路動作を説明する。
【0017】図2において、同期分離回路1出力
(a)、遅延回路2出力(b)、遅延回路3出力(c)
の各パルスの振幅は1とする。仮に図2において、同期
分離回路1出力(a)のt2時の波形が欠落したとす
る。
(a)、遅延回路2出力(b)、遅延回路3出力(c)
の各パルスの振幅は1とする。仮に図2において、同期
分離回路1出力(a)のt2時の波形が欠落したとす
る。
【0018】遅延回路2は同期分離回路1出力(a)の
t1、t3、t5のときのパルスをトリガとして動作し
ているので、影響はない。遅延回路3は同期分離回路1
出力(a)のt2、t4、t6のときのパルスをトリガ
として動作しているため、t4のときに出力しない。同
期分離回路1出力(a)、遅延回路2出力(b)、遅延
回路3出力(c)の各パルスを加算回路5により加算す
ると加算回路5出力(d)のようなパルスとなる。垂直
発振回路6の動作可能入力振幅レベルを1以上にしてお
くと加算回路5出力(d)のt1、t2、t3、t4、
t5、t6のときのパルスにより垂直発振回路6は安定
して動作する。
t1、t3、t5のときのパルスをトリガとして動作し
ているので、影響はない。遅延回路3は同期分離回路1
出力(a)のt2、t4、t6のときのパルスをトリガ
として動作しているため、t4のときに出力しない。同
期分離回路1出力(a)、遅延回路2出力(b)、遅延
回路3出力(c)の各パルスを加算回路5により加算す
ると加算回路5出力(d)のようなパルスとなる。垂直
発振回路6の動作可能入力振幅レベルを1以上にしてお
くと加算回路5出力(d)のt1、t2、t3、t4、
t5、t6のときのパルスにより垂直発振回路6は安定
して動作する。
【0019】次に遅延回路2と3が同じ時間に出力した
ときの動作を説明する。図3において、(a)は同期分
離回路1の出力である垂直同期信号波形図、(b)は遅
延回路2の出力波形図、(c)は遅延回路3の出力波形
図、(d)は比較回路4の出力波形図である。
ときの動作を説明する。図3において、(a)は同期分
離回路1の出力である垂直同期信号波形図、(b)は遅
延回路2の出力波形図、(c)は遅延回路3の出力波形
図、(d)は比較回路4の出力波形図である。
【0020】遅延回路2、3が同期分離回路1出力
(a)のt1のときのパルスをトリガとして動作したと
すると遅延回路2出力(b)、遅延回路3出力(c)に
示すようにどちらもt3のときにパルスを発生する。こ
の遅延回路2、3の出力を比較回路で同じか否かを判別
し、違っていれば比較回路4は遅延回路3に対しリセッ
ト信号を与えないが、同じあればパルス(d)を発生す
る。このパルス(d)により遅延回路3の動作を一時中
断させると、遅延回路3は、同期分離回路1より与えら
れたt4のときの垂直同期信号をトリガとして動作し、
t6のときにパルスを出力する。よって遅延回路2と3
は交互にパルスを出力することになる。
(a)のt1のときのパルスをトリガとして動作したと
すると遅延回路2出力(b)、遅延回路3出力(c)に
示すようにどちらもt3のときにパルスを発生する。こ
の遅延回路2、3の出力を比較回路で同じか否かを判別
し、違っていれば比較回路4は遅延回路3に対しリセッ
ト信号を与えないが、同じあればパルス(d)を発生す
る。このパルス(d)により遅延回路3の動作を一時中
断させると、遅延回路3は、同期分離回路1より与えら
れたt4のときの垂直同期信号をトリガとして動作し、
t6のときにパルスを出力する。よって遅延回路2と3
は交互にパルスを出力することになる。
【0021】
【発明の効果】以上の実施例から明らかなように、本発
明の垂直同期信号回路によれば、例えばAPL変動によ
り同期分離回路出力に垂直同期信号が欠落したとして
も、同期分離回路の出力と、その出力をトリガとして動
作する2つの遅延回路の各出力を合成することで安定し
て垂直同期信号を得るとができる。
明の垂直同期信号回路によれば、例えばAPL変動によ
り同期分離回路出力に垂直同期信号が欠落したとして
も、同期分離回路の出力と、その出力をトリガとして動
作する2つの遅延回路の各出力を合成することで安定し
て垂直同期信号を得るとができる。
【図面の簡単な説明】
【図1】本発明の一実施例における垂直同期信号回路の
ブロック構成図
ブロック構成図
【図2】図1における誤動作時の各部波形図
【図3】図1における正常動作時の各部波形図
【図4】従来の垂直同期信号回路のブロック構成図
1 同期分離回路
2 遅延回路
3 遅延回路
4 比較回路
5 加算回路
6 垂直発振回路
7 垂直偏向回路
Claims (2)
- 【請求項1】 垂直同期信号を抽出するための同期分離
回路とその出力をトリガとし二垂直期間遅延させる遅延
回路と、その遅延回路が動作している間の同期分離回路
の出力をトリガとし二垂直期間遅延させる遅延回路と、
2つの遅延回路が同出力の場合には比較回路により一方
の遅延回路の動作をクリアーするリセット回路を有し、
同期分離回路の出力と2つの遅延回路の出力を加算回路
により合成することで安定して垂直同期信号を得る垂直
同期信号回路。 - 【請求項2】 同期分離回路で抽出した垂直同期信号を
トリガとして動作する遅延回路において、二垂直期間遅
延した信号を疑似垂直同期信号とする垂直同期信号回
路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24572595A JP3405008B2 (ja) | 1995-09-25 | 1995-09-25 | 垂直同期信号回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24572595A JP3405008B2 (ja) | 1995-09-25 | 1995-09-25 | 垂直同期信号回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0993460A JPH0993460A (ja) | 1997-04-04 |
JP3405008B2 true JP3405008B2 (ja) | 2003-05-12 |
Family
ID=17137880
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP24572595A Expired - Fee Related JP3405008B2 (ja) | 1995-09-25 | 1995-09-25 | 垂直同期信号回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3405008B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP2905952A1 (en) * | 2011-03-10 | 2015-08-12 | Panasonic Intellectual Property Management Co., Ltd. | Video processing device and synchronization signal output method |
-
1995
- 1995-09-25 JP JP24572595A patent/JP3405008B2/ja not_active Expired - Fee Related
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP2905952A1 (en) * | 2011-03-10 | 2015-08-12 | Panasonic Intellectual Property Management Co., Ltd. | Video processing device and synchronization signal output method |
Also Published As
Publication number | Publication date |
---|---|
JPH0993460A (ja) | 1997-04-04 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100639522B1 (ko) | 복합 동기 신호를 사용하는 외부 동기 시스템 및 이 외부 동기 시스템을 사용하는 카메라 시스템 | |
RU2128888C1 (ru) | Система для генерирования сигнала синхронизации для телевизионного приемника со строчной разверткой, система для генерирования сигнала тактовых импульсов в телевизионном приемнике со строчной разверткой, система для генерирования синхронизированного с устройством отображения тактового сигнала в телевизионной аппаратуре | |
JP3405008B2 (ja) | 垂直同期信号回路 | |
EP0454153B1 (en) | Synchronizing circuit | |
US6275265B1 (en) | Video signal synchronizing apparatus | |
US6108043A (en) | Horizontal sync pulse minimum width logic | |
JP3316519B2 (ja) | ディジタル同期分離回路 | |
JPH09135461A (ja) | クロック発生回路 | |
JP3211685B2 (ja) | テレビジョン映像信号の水平アドレス発生回路 | |
JPH0834569B2 (ja) | デジタル信号処理撮像装置 | |
JPH0628382B2 (ja) | 垂直同期信号作成回路 | |
JPS625515B2 (ja) | ||
JP3019310B2 (ja) | 自動周波数制御回路 | |
JP2523010B2 (ja) | クランプパルス制御回路 | |
KR200374292Y1 (ko) | 고화질보상 증폭장치 | |
JP3114180B2 (ja) | 同期不連続検知装置 | |
JP2997013B2 (ja) | 垂直同期再生回路 | |
JPS637078B2 (ja) | ||
JPH09215005A (ja) | 標本化信号処理装置 | |
JPS63122366A (ja) | テレビジヨン受信機の水平同期用pll回路 | |
JPH04250777A (ja) | 水平同期分離回路及びテレビジョン受像機 | |
JPH0630295A (ja) | 映像信号の同期回路 | |
JPS63227280A (ja) | 同期分離回路 | |
JPH0856368A (ja) | ディジタルテレビジョン信号処理装置 | |
JPH01132285A (ja) | 画像メモリ制御装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |