JP3401767B2 - 多層セラミック基板およびその製造方法 - Google Patents

多層セラミック基板およびその製造方法

Info

Publication number
JP3401767B2
JP3401767B2 JP2000210777A JP2000210777A JP3401767B2 JP 3401767 B2 JP3401767 B2 JP 3401767B2 JP 2000210777 A JP2000210777 A JP 2000210777A JP 2000210777 A JP2000210777 A JP 2000210777A JP 3401767 B2 JP3401767 B2 JP 3401767B2
Authority
JP
Japan
Prior art keywords
ceramic
layer
green sheet
pad
metal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2000210777A
Other languages
English (en)
Other versions
JP2001068857A (ja
Inventor
ベンジャミン・ヴィー・ファザーノ
デービッド・エイチ・ガブリエルズ
リチャード・エフ・エンディク
スンダル・エム・カマート
スコット・アイ・ランゲンタール
スリーニヴァサ・エス・エヌ・レッディー
ラーオ・ヴィー・ヴァンラバネニ
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
International Business Machines Corp
Original Assignee
International Business Machines Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Family has litigation
First worldwide family litigation filed litigation Critical https://patents.darts-ip.com/?family=23403624&utm_source=***_patent&utm_medium=platform_link&utm_campaign=public_patent_search&patent=JP3401767(B2) "Global patent litigation dataset” by Darts-ip is licensed under a Creative Commons Attribution 4.0 International License.
Application filed by International Business Machines Corp filed Critical International Business Machines Corp
Publication of JP2001068857A publication Critical patent/JP2001068857A/ja
Application granted granted Critical
Publication of JP3401767B2 publication Critical patent/JP3401767B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/40Forming printed elements for providing electric connections to or between printed circuits
    • H05K3/4092Integral conductive tabs, i.e. conductive parts partly detached from the substrate
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/11Printed elements for providing electric connections to or between printed circuits
    • H05K1/111Pads for surface mounting, e.g. lay-out
    • H05K1/112Pads for surface mounting, e.g. lay-out directly combined with via connections
    • H05K1/113Via provided in pad; Pad over filled via
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/03Use of materials for the substrate
    • H05K1/0306Inorganic insulating substrates, e.g. ceramic, glass
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/09Shape and layout
    • H05K2201/09209Shape and layout details of conductors
    • H05K2201/09654Shape and layout details of conductors covering at least two types of conductors provided for in H05K2201/09218 - H05K2201/095
    • H05K2201/09781Dummy conductors, i.e. not used for normal transport of current; Dummy electrodes of components
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/09Shape and layout
    • H05K2201/09209Shape and layout details of conductors
    • H05K2201/09654Shape and layout details of conductors covering at least two types of conductors provided for in H05K2201/09218 - H05K2201/095
    • H05K2201/0979Redundant conductors or connections, i.e. more than one current path between two points
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/40Forming printed elements for providing electric connections to or between printed circuits
    • H05K3/4038Through-connections; Vertical interconnect access [VIA] connections
    • H05K3/4053Through-connections; Vertical interconnect access [VIA] connections by thick-film techniques
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/46Manufacturing multilayer circuits
    • H05K3/4611Manufacturing multilayer circuits by laminating two or more circuit boards
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/46Manufacturing multilayer circuits
    • H05K3/4611Manufacturing multilayer circuits by laminating two or more circuit boards
    • H05K3/4626Manufacturing multilayer circuits by laminating two or more circuit boards characterised by the insulating layers or materials
    • H05K3/4629Manufacturing multilayer circuits by laminating two or more circuit boards characterised by the insulating layers or materials laminating inorganic sheets comprising printed circuits, e.g. green ceramic sheets
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10TTECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
    • Y10T428/00Stock material or miscellaneous articles
    • Y10T428/24Structurally defined web or sheet [e.g., overall dimension, etc.]
    • Y10T428/24802Discontinuous or differential coating, impregnation or bond [e.g., artwork, printing, retouched photograph, etc.]
    • Y10T428/24917Discontinuous or differential coating, impregnation or bond [e.g., artwork, printing, retouched photograph, etc.] including metal layer
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10TTECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
    • Y10T428/00Stock material or miscellaneous articles
    • Y10T428/24Structurally defined web or sheet [e.g., overall dimension, etc.]
    • Y10T428/24802Discontinuous or differential coating, impregnation or bond [e.g., artwork, printing, retouched photograph, etc.]
    • Y10T428/24926Discontinuous or differential coating, impregnation or bond [e.g., artwork, printing, retouched photograph, etc.] including ceramic, glass, porcelain or quartz layer

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Manufacturing & Machinery (AREA)
  • Production Of Multi-Layered Print Wiring Board (AREA)
  • Printing Elements For Providing Electric Connections Between Printed Circuits (AREA)

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は多層セラミック基板
およびその製造に関するものであり、さらに具体的に
は、機械的および電気的信頼性が改善された、導電性パ
ッドを有する、多層セラミック基板およびその製造方法
に関するものである。
【0002】
【従来の技術】多層セラミック基板は通常、コンピュー
タ、制御システム、回路板などの情報処理システムに使
用される集積回路装置間を相互接続するのに用いられ、
従来から2つの方法により製造される。古い方の方法は
積層法で、焼成したセラミック層から出発し、それにパ
ターン形成した誘電体の層と金属の導電層を交互にスク
リーニング操作により順に付着させて、多層構造を形成
する方法である。これを付着させるたびに焼結するか、
すべての層を付着させた後に焼結する。十分高温で焼結
すると、金属、セラミック、および通常ガラス粒子が一
体化して、セラミック誘電体中に形成された電気的に連
続する回路を機械的に支持する、高密度の不浸透性モノ
リスになる。
【0003】多層セラミック基板を製造するもう一つの
方法は、注型法を用いて誘電体をテープの形状にし、こ
のテープを打ち抜いて、穴すなわち「バイア」を形成
し、この中に配線として機能する金属トレースと共に導
電性の金属ペーストを付着させる方法である。打ち抜き
およびメタライゼーションを行ったこれらの何本かのテ
ープを位置合わせし、積み重ね、加圧して積層品とした
後、焼成を行う。このような方法が共焼成法で、セラミ
ックと金属粉が通常は単一の工程で、時には複雑な加熱
工程で一体化される。
【0004】焼結工程の重要な要素は、導電性の表面フ
ィーチャの形成であり、場合によっては後のはんだ接続
工程の準備としてこれにニッケル、金などの金属メッキ
が施される。これらの表面フィーチャにより、セラミッ
ク中の導体への接続が行われ、その機械的、電気的性能
が多層セラミック基板および情報処理システム全体の信
頼性にとって非常に重要である。
【0005】従来のセラミック基板は、酸化アルミニウ
ム(すなわちアルミナ)により形成され、これは通常は
焼結後に溶融した粉末ガラスにより接着される。このよ
うな酸化アルミニウム・セラミック基板は通常、150
0℃を超える温度を要する高温処理で焼結される。モリ
ブデンおよびタングステン金属粉は、導電性が高く、し
かもこの高い焼結温度に溶融することなく耐えるため、
導体として用いられる。これらの金属はまた、焼結から
常温以下の試験温度範囲、通常1600℃から−150
℃の温度範囲で、アルミナとの熱膨張係数がよく一致す
る。アルミナ、モリブデン、およびタングステンの熱膨
張係数(CTE)は、それぞれ約7、5、および4pp
mで、類似している。
【0006】これらの金属を使用して作成した表面フィ
ーチャは、パターン形成した表面フィーチャを形成する
ために使用する、粉末ガラスを混合した厚膜ペーストを
用いる共焼成法で、セラミックに通常良好に接着する。
表面フィーチャは良好に接着し、表面フィーチャとセラ
ミックとのCTEが一致しているため、またアルミナ・
セラミックの強度が非常に高いため、熱サイクル中に下
層のセラミックには応力がほとんどかからない。
【0007】通常はアレイとして存在する表面フィーチ
ャが、セラミック・ボール・グリッド・アレイ(CBG
A)やセラミック・カラム・グリッド・アレイ(CCG
A)などのはんだ付け技術により、印刷回路板に電気的
に接続される場合、表面の金属フィーチャとセラミック
の間の接着強度が重要である。CBGA取り付け技術で
は、ソルダ・ボールを基板と印刷回路板との間のスタン
ドオフとして使用する。ソルダ・ボールは、ボールをセ
ラミック基板および回路板に取り付けるのに用いるはん
だより融点が高い。同様に、CCGA取り付け技術で
は、ソルダ・ワイヤのカラムをセラミック基板と回路板
の接続に使用する。
【0008】セラミック基板と回路板との電気接続の信
頼性は、セラミック基板と回路板とのCTEの違い、両
者の剛性、ソルダ・アレイの大きさ、はんだ接合部の高
さなど、いくつかのパラメータの影響を受ける。熱サイ
クル中、回路板はセラミック基板より膨張収縮が大き
い。この動きが回路板とセラミック基板との間のはんだ
接続に大きなひずみを生じさせ、ひずみは最外側の接続
で最大となり、ソルダ・アレイの中央で最小となる。熱
サイクルが繰り返されると、最終的にはんだ接続に疲労
が生じて故障し、セラミック基板と回路板との間にある
電気的通路が開となる。
【0009】通常、ソルダ・カラムが長いほど、はんだ
の耐疲労性が大きくなる。CCGAは他のすべてのパラ
メータが等しければCBGAよりも故障するまで多くの
サイクルに耐えるが、CCGAは取り扱い時に容易に損
傷し、またはんだの長さが長いためインダクタンスが増
大して電気的特性が損なわれるため、CBGAより好ま
しくない。
【0010】情報処理システムは、次第に高速、大電
力、高信頼性に移行しつつある。この移行の一環とし
て、半導体装置の部品のパッケージングにより高性能の
セラミック誘電体の使用が広まりつつある。特に、シリ
カのレベルが高まり、他のセラミック酸化物と適切に組
み合わせると、電子回路の遅れの伝播を減少させる、低
誘電率の材料が得られるセラミック基板の使用が望まし
い。従来のアルミナ含有量の高いセラミックと異なり、
これらのセラミック基板は強度が低く、はんだ接合時に
受ける負荷によって破壊しやすい。
【0011】これらの高性能セラミックの代表的なもの
は、銀または銅を導体として使用する低温共焼成セラミ
ック系である。このような高性能セラミックには、軟化
点の低いガラスで接着したアルミナ、およびガラス・セ
ラミック系がある。高温共焼成システムと異なり、これ
らのセラミックと金属とのCTEの違いが大きい場合が
多い。たとえば、これらの大部分のセラミックのCTE
は、6ppm未満であるのに対して、銀および銅のCT
Eはそれぞれ20および17ppmである。これらのC
TEが低いセラミック表面上に金属含有量の高い表面フ
ィーチャを共焼成しようと試みると、セラミックと表面
フィーチャとの境界面が弱くなり、工程中または使用中
の熱サイクル中に分離することがある。
【0012】したがって、共焼成中に、CTEが低い大
量の補償フィラー(filler)材料、しばしば誘電体を製
造するのに用いるのと同一のセラミックまたはガラスを
混合することによってしか、これらの金属をセラミック
に接着して、強度の高い接合部を形成できないことにな
る。この表面フィーチャ中の非導電性フィラー材料は、
フィーチャの導電性に多大の影響を与え、パッドの非導
電部分が通常は従来のメッキ浴ではメッキされないた
め、ランド・グリッド・アレイ(LGA)や、CBGA
またはCCGAによるはんだ接合のための、容易にメッ
キできる表面フィーチャを形成するのが極めて困難にな
る。
【0013】金属含有量の高い表面フィーチャは、CT
Eの不一致が著しいため熱サイクル中に下層のセラミッ
クに多大の応力を与えることが多い。高性能セラミック
は高温焼成アルミナほどの強度がないため、セラミック
に亀裂を生じ、最終的に表面フィーチャの下の電気的接
続が故障する傾向がある。
【0014】金属含有量の高い表面フィーチャと、下層
のセラミック材料との接着の欠如は、他の人も認識して
いる。たとえば、米国特許第5549778号明細書、
およびヘロン(Herron)他、アイ・ビー・エム・テクニ
カル・ディスクロージャ・ブルテン(IBM Technical Di
sclosure Bulletin)、27、No.8、p.4765
(1985年1月)は、表面フィーチャを下層のセラミ
ックにアンカリングするための「ダミー」バイアを提案
している。これらのダミー・バイアは、機能性がなく、
単に表面フィーチャのアンカリングを機械的に補助して
いるに過ぎない。
【0015】
【発明が解決しようとする課題】表面フィーチャをアン
カリングし、同時に電気的および機械的信頼性を向上さ
せる、改善された方法が望まれる。
【0016】
【課題を解決するための手段】本発明の第1の態様によ
れば、複数の充填されたバイアと外部表面を有する第1
セラミック層と、第1セラミック層の外部表面に隣接
し、第1セラミック層の複数の充填されたバイアに接着
された少なくとも1個の外部パッドと、第1セラミック
層に隣接し、第1セラミック層の少なくとも1個の充填
されたバイアと接触する少なくとも1個の充填されたバ
イアを有する、第2セラミック層と、第1および第2セ
ラミック層の間に配置され、第1セラミック層の複数の
充填されたバイアと接触する少なくとも1個の内部パッ
ドとを具備し、第1セラミック層の複数の充填されたバ
イアのそれぞれが、第2セラミック層のバイアまたは内
部パッドと接触する、多層セラミック基板が開示され
る。
【0017】本発明の第2の態様によれば、充填された
バイアと外部表面とを有する第1セラミック層と、第1
セラミック層の外部表面に隣接し、少なくとも1個の充
填されたバイアに接着された外部パッドと、第1セラミ
ック層に隣接し、第1セラミック層の充填されたバイア
と接触する少なくとも1個の充填されたバイアを有する
第2セラミック層と、第1および第2セラミック層の間
に配置され、第1および第2層の充填されたバイアと接
触する内部パッドとを具備し、第1セラミック層のバイ
アが、第2セラミック層のバイアより断面積が大きく、
第1セラミック層が、第2セラミック層より厚い、多層
セラミック基板が開示される。
【0018】本発明の第3の態様によれば、複数の充填
されたバイアと外部表面を有する第1セラミック層と、
第1セラミック層に隣接し、少なくとも1個の充填され
たバイアを有する第2セラミック層と、第1および第2
セラミック層の間に配置され、第1セラミック層の複数
の充填されたバイア、および第2セラミック層の少なく
とも1個の充填されたバイアと接触する少なくとも1個
の内部パッドと、第1セラミック層の外部表面から延
び、第1セラミック層の複数の充填されたバイアに接触
する複数のバイア・カラムと、複数のバイア・カラムに
接着された少なくとも1個のパッドとを具備する、多層
セラミック基板が開示される。
【0019】本発明の第4の態様によれば、少なくとも
1個の充填されたバイアと外部表面とを有する第1セラ
ミック層と、第1セラミック層の外部表面に接着され、
第1セラミック層の少なくとも1個の充填されたバイア
と接触する内部パッドと、内部パッドから延びる複数の
バイア・カラムと、複数のバイア・カラムに接着する外
部パッドとを具備する、多層セラミック基板が開示され
る。
【0020】本発明の第5の態様によれば、複数のバイ
アを有する第1のセラミック・グリーンシートを形成す
るステップと、ペースト材料の固形分に対し、少なくと
も80体積%の金属材料を含有し、残部がセラミック材
料である金属ペースト材料を、少なくとも1個のバイア
にスクリーニングするステップと、ペースト材料の固形
分に対し、少なくとも80体積%の金属材料を含有し、
残部がセラミック材料である金属ペースト材料を、第1
のセラミック・グリーンシート上にスクリーニングして
入出力パッドを形成するステップと、少なくとも1個の
バイアを有する第2のセラミック・グリーンシートを形
成するステップと、ペースト材料の固形分に対し、30
〜70体積%の金属材料を含有し、残部がセラミック材
料である金属ペースト材料を、第2のセラミック・グリ
ーンシートの少なくとも1個のバイアにスクリーニング
するステップと、ペースト材料の固形分に対し、30〜
70体積%の金属材料を含有し、残部がセラミック材料
である金属ペースト材料を、第1または第2のセラミッ
ク・グリーンシート上にスクリーニングして入出力パッ
ドを形成するステップと、入出力パッドが未焼結の多層
セラミック基板の外側になり、内部パッドが第1および
第2セラミック・グリーンシートの間に配置され、第1
セラミック・グリーンシート中にある複数のバイアのそ
れぞれが、第2セラミック・グリーンシートのバイア、
または内部コンタクト・パッドと接触するように、第1
および第2セラミック・グリーンシートを積層して、未
焼結の多層セラミック基板を形成するステップと、入出
力パッドを有する焼結した多層セラミック基板が、第1
セラミック層の少なくとも1個のバイアに接着される
が、多層セラミック基板のセラミック材料には接着され
ないように、未焼結の多層セラミック基板を焼結するス
テップとを含む、多層セラミック基板を形成する方法が
開示される。
【0021】本発明の第6の態様によれば、少なくとも
1個のバイアを有し、多層セラミック基板の所定の焼結
温度では焼結されないように選択されたセラミック材料
を含む第1のセラミック・グリーンシートを形成するス
テップと、ペースト材料の固形分に対し、少なくとも8
0体積%の金属材料を含有し、残部がセラミック材料で
ある金属ペースト材料を、第1のセラミック・グリーン
シートの少なくとも1個のバイアにスクリーニングする
ステップと、ペースト材料の固形分に対し、少なくとも
80体積%の金属材料を含有し、残部がセラミック材料
である金属ペースト材料を、第1のセラミック・グリー
ンシート上にスクリーニングして外部パッドを形成する
ステップと、少なくとも1個のバイアを有する第2のセ
ラミック・グリーンシートを形成するステップと、ペー
スト材料の固形分に対し、80体積%の金属材料を含有
し、残部がセラミック材料である金属ペースト材料を、
第2のセラミック・グリーンシートの少なくとも1個の
バイアにスクリーニングするステップと、少なくとも1
個のバイアを有する第3のセラミック・グリーンシート
を形成するステップと、ペースト材料の固形分に対し、
30〜70体積%の金属材料を含有し、残部がセラミッ
ク材料である金属ペースト材料を、第3のセラミック・
グリーンシートの少なくとも1個のバイアにスクリーニ
ングするステップと、ペースト材料の固形分に対し、3
0〜70体積%の金属材料を含有し、残部がセラミック
材料である金属ペースト材料を、第2または第3のセラ
ミック・グリーンシート上にスクリーニングして内部パ
ッドを形成するステップと、外部パッドが未焼結の多層
セラミック基板の外側になり、内部パッドが第2および
第3セラミック・グリーンシートの間に配置されるよう
に、第1、第2、および第3セラミック・グリーンシー
トを積層して、未焼結の多層セラミック基板を形成する
ステップと、第1セラミック・グリーンシートは焼結さ
れないが、第2および第3セラミック・グリーンシート
は焼結されるように、未焼結の多層セラミック基板を所
定の温度で焼結するステップと、焼結前に、焼結された
パッドを有する多層セラミック基板が、第1セラミック
・グリーンシートの少なくとも1個のバイアにのみ接着
され、多層セラミック基板のセラミック材料との間には
空間ができるように、第1セラミック・グリーンシート
の少なくとも1個のバイアを残して、未焼結のセラミッ
ク材料を除去するステップとを含む、多層セラミック基
板を形成する方法が開示される。
【0022】本発明の第7の態様によれば、少なくとも
1個のバイアを有し、多層セラミック基板の所定の焼結
温度では焼結されないように選択されたセラミック材料
を含む第1のセラミック・グリーンシートを形成するス
テップと、ペースト材料の固形分に対し、少なくとも8
0体積%の金属材料を含有し、残部がセラミック材料で
ある金属ペースト材料を、第1のセラミック・グリーン
シートの少なくとも1個のバイアにスクリーニングする
ステップと、ペースト材料の固形分に対し、少なくとも
80体積%の金属材料を含有し、残部がセラミック材料
である金属ペースト材料を、第1のセラミック・グリー
ンシート上にスクリーニングして外部パッドを形成する
ステップと、少なくとも1個のバイアを有する第2のセ
ラミック・グリーンシートを形成するステップと、ペー
スト材料の固形分に対し、30〜70体積%の金属材料
を含有し、残部がセラミック材料である金属ペースト材
料を、第2のセラミック・グリーンシートの少なくとも
1個のバイアにスクリーニングするステップと、ペース
ト材料の固形分に対し、30〜70体積%の金属材料を
含有し、残部がセラミック材料である金属ペースト材料
を、第1または第2のセラミック・グリーンシート上に
スクリーニングして内部パッドを形成するステップと、
外部入出力パッドが未焼結の多層セラミック基板の外側
になり、内部パッドが第1および第2セラミック・グリ
ーンシートの間に配置されるように、第1および第2セ
ラミック・グリーンシートを積層して、未焼結の多層セ
ラミック基板を形成するステップと、第1セラミック・
グリーンシートは焼結されないが、第2セラミック・グ
リーンシートは焼結されるように、未焼結の多層セラミ
ック基板を焼結するステップと、焼結前に、パッドを有
する焼結された多層セラミック基板が、第1セラミック
・グリーンシートの少なくとも1個のバイアにのみ接着
され、内部パッドおよび多層セラミック基板のセラミッ
ク材料との間には空間ができるように、第1セラミック
・グリーンシートの少なくとも1個のバイアを残して、
未焼結のセラミック材料を除去するステップとを含む、
多層セラミック基板を形成する方法が開示される。
【0023】
【発明の実施の形態】本発明の新規であると考えられる
諸特徴および本発明に特徴的な諸要素は、頭記の特許請
求の範囲に詳細に記載してある。図は例示のためのもの
にすぎず、かつ原寸に比例していない。しかし、本発明
自体は、編成に関しても動作方法に関しても、以下の詳
細な説明を添付の図面と併せて参照すれば最もよく理解
できよう。
【0024】本発明の発明者は、セラミック基板内の回
路を他の装置に接続するのに使用される表面実装フィー
チャ(たとえばパッド)の、機械的、およびさらに重要
であるが電気的信頼性を改善するために設計された、メ
タラジ構造を開発した。この接続は通常、低温はんだに
より行われるが、LGAソケットで実施されているよう
に、圧着により行うこともできる。
【0025】この新規のメタラジ構造により、信頼性の
高い接続を形成するのに重要ないくつかの機能が得られ
る。第一に、複数の導電性表面フィーチャを、普通なら
確実に取り付けることができないセラミックに取り付け
る手段が得られる。たとえば、セラミックと表面フィー
チャ・メタラジとの熱膨張係数(CTE)の大きな差に
より生じる応力、またはメッキ工程により発生すること
がある非常に大きい応力あるいはその両方で、加熱冷却
サイクルおよび使用中に、セラミックから表面フィーチ
ャがはく離したり、さらにはセラミックの接続部に亀裂
を生じたりすることがある。本発明で提案される構造
は、これらの応力をセラミックの表面層から分離し、こ
れらの応力に耐える下の層に移動させる。
【0026】第二に、この構造により、セラミック基板
の表面フィーチャとメタラジ・フィーチャとの高度にフ
レキシブルな電気的接続が可能になり、さらに、通常は
セラミックよりCTEがかなり大きい印刷回路板に、は
んだを用いて接合されるセラミック・パッケージの電気
的信頼性を改善する、表面フィーチャへの冗長電気的接
続も可能になる。電源をオン・オフするサイクルで実際
に使用する場合に生じる応力をシミュレートするため、
セラミック基板を印刷回路板にはんだで取り付け、アセ
ンブリに熱サイクルを繰り返すと、この構造の電気的信
頼性性能は、CTEのみに基づくどのような推定値より
優れている。
【0027】第三に、本発明のメタラジ構造により、通
常は熱サイクル信頼性の改善にソルダ・カラムが必要と
なる場合に、ソルダ・ボールの高さを利用してセラミッ
ク基板を回路板に接続するための、さらに確実な方法が
得られる。これにより、高性能パッケージングに、イン
ダクタンスのさらに低いソルダ・ボールを使用すること
が可能となる。
【0028】最後に、本発明のメタラジ構造により、金
属含有量の高い(最高100%)表面フィーチャを得る
ため、従来のメッキ薬品を用いて容易にメッキできる、
高導電性の金属組成物を使用することが可能となる。こ
れらの金属含有量の高い表面フィーチャにより、はんだ
の濡れを完全にすることができ、はんだ接合の信頼性を
改善し、電流を通す能力を高める。
【0029】図をさらに詳細に、特に図1ないし図4を
参照すると、本発明の第1の実施形態が示されている。
図1に示すように、複数のバイア12が第1のグリーン
シート10に設けられている。これらのバイア12は通
常、後に形成する表面フィーチャ、すなわちこの場合は
パッドの領域内に入るだけの数のバイア12が設けられ
るように配置される。通常、これらのバイアは1.3m
m(50ミル)ピッチのCBGAはんだ接続に使用す
る、直径約850μmのいわゆる入出力(I/O)パッ
ド用では50〜150μmである。後に行う厚膜ペース
トによるバイアの充填によって、機械的アンカリング
と、導電性バイアの内部厚膜パッドへの電気的接続がも
たらされるため、バイア端部の形状は重要である。レー
ザ・ドリリングまたは他の穴あけ工程により得られる真
っ直ぐな側壁は、バイアからのひずみをバイアと内部パ
ッドとの境界面に集中させるので、最も望ましくない。
理想的には、バイアの内縁部に、バイアと内部パッドと
の接触面積を増大し、そこまで焼結されるテーパが存在
することが望ましい。このため、バイア・ホール12の
テーパ付き縁部11は、バイア・ホール12の他の縁部
15より大きい。このようなテーパ付きの穴は通常、第
1グリーンシート10の機械的打ち抜き中に形成され
る。
【0030】バイア12は、図2に示すように、好まし
くは導電性および延性を高めるため、金属含有量の高い
金属ペースト14で充填する。
【0031】好ましい金属は銅であるが、ニッケル、
銅、銀などの合金を使用してもよい。バイアと表面パッ
ドの金属含有量は、少なくとも80体積%、好ましくは
100%である。全体を通して、金属含有量が高いペー
ストとは、金属がペーストの固形分に対して80〜10
0体積%のものであると理解されたい。
【0032】次に、図2に示すように、表面パッド16
を、第1のグリーンシート10の外部表面17にスクリ
ーニングする。表面パッド16の寸法は、焼結後の表面
に必要なI/Oパッドの寸法により決まる。
【0033】次に、図3に示すように、第2のグリーン
シート20も打ち抜き、金属ペーストで充填して、金属
充填バイア22を形成する。内部パッド24を、第2の
グリーンシート20上にスクリーニングする。内部パッ
ド24は、第1のグリーンシート10の裏面19にも容
易にスクリーニングすることができたことを理解された
い。金属充填バイア22と内部パッド24は、セラミッ
クとの接着を良好にするためのものなので、ペーストの
金属含有量は中程度、たとえば30〜70体積%、好ま
しくは40〜50体積%で、残部はセラミック材料であ
る。これらの体積比率はペーストの固形分に対するもの
であり、バインダ、可塑剤、その他焼結中に揮発するペ
ーストの成分は含まないことを理解されたい。さらに、
ペーストの金属含有量が中程度であるということは、ペ
ーストの固形分に対してペーストが30〜70体積%、
好ましくは40〜50体積%の金属を含有するという意
味であることを理解されたい。この場合も、金属は銅で
あるが、ニッケル、銅、銀などの合金を使用してもよ
い。
【0034】組立の最後の段階は、第1および第2のグ
リーンシート10および20を、図4に示す順序で積み
重ね、積層して、表面パッド16が積層品40の外側に
ある多層グリーンシート積層品40を形成することであ
る。内部パッド24はバイア14に隣接し、バイアを積
層品40にアンカリングする。第1のグリーンシート1
0中の、バイア14の1個は、電気連続性をもたらすた
め第2のグリーンシート20中のバイア22と位置合わ
せしなければならない。通常、積層品40を完成させる
ために、バイア32を有する、少なくとも1個の追加の
グリーンシート層30がある(このような追加のグリー
ンシート層30が多数ある場合が多い)。バイア32は
通常100体積%の金属で形成されるが、電気的に連続
性をもたらすために、バイア22と位置合わせさせる。
次にグリーンシート積層品40を焼結すると、図4に示
すものとほぼ同一の多層セラミック基板が得られる。
【0035】金属含有量が高い表面パッド16およびバ
イア14は、多層セラミック基板のセラミックに良好に
接着しない。セラミック含有量が高いパッド24および
バイア22は、多層セラミック基板のセラミックに良好
に接着する。表面パッド16の多層セラミック構造への
接着および機械的信頼性は、バイア14と内部パッド2
4の間の接着を通して達成される。
【0036】多層セラミック基板を構成するセラミック
は、前に言及した高性能の、低温で共焼成するセラミッ
クが最も好ましい。しかし、本発明は表面パッドの信頼
性が問題になるすべてのセラミック系に適用できること
を理解されたい。
【0037】次に図5ないし図9を参照すると、本発明
の第2の実施形態が示されている。本発明の第2の実施
形態は、図1ないし図4を参照して前に説明した本発明
の第1の実施形態と同一であるが、図8に示すように、
さらにセラミック層34を有する点が異なる。セラミッ
ク層34は、表面パッド16と一致するが、わずかに小
さい少なくとも1個の開口36を有する。多層グリーン
シート積層品50を形成する積み重ねおよび積層中に、
図9に示すように、開口36が表面パッド16と位置合
わせされる。スタンド・アローン層としてセラミック層
34を形成する代わりに、グリーンシート積層品50上
に直接スクリーニングすることもできる。セラミック層
34は、2つの目的に使用される。第一は、焼結中にセ
ラミック層34が高密度化して、表面パッド16の外周
がセラミックに保持されるようにするためである。第二
は、セラミック層34がソルダ・ダムとして機能し、接
合中のはんだの流れを阻止し、はんだが表面パッド16
の外周まで行かないようにするためである。
【0038】次に図10ないし図14を参照すると、本
発明の第3の実施形態が示されている。図10に示すよ
うに、バイア112を有する第1のグリーンシート11
0を形成し、金属含有量の高い(すなわち金属が80〜
100体積%)ペーストで充填して図11に示すような
金属充填バイア114を形成する。第1のグリーンシー
ト110の外側表面117となる面に、表面パッド11
6をスクリーニングする。第1のグリーンシート110
は前述の第1のグリーンシート10とほぼ同一である。
【0039】次に図12に示すように、第2のグリーン
シート120も打ち抜いてバイアを形成し、金属ペース
トで充填して図13に示すような金属充填バイア122
を形成する。これらのバイア122は、第1のグリーン
シート110上のパッド116と位置合わせされ、層1
10と120を積み重ねた時に完全にパッド116の範
囲に入るようにする。バイア122をスクリーニングす
るのに使用する金属ペーストは、バイア122とセラミ
ックが良好に接着するように選択される。通常、これら
は前述のような中程度の含有量を有するメタライゼーシ
ョン・ペーストである。図13に示すように、パッド1
24をバイア122の上に付着させる。このバイアス1
22は第1のグリーンシート110中のバイア112と
位置合わされ、それを取り込む。パッド124は第2の
グリーンシート120上に付着されるように示されてい
るが、代替方法として第1のグリーンシート110の裏
面119上に付着させてもよい。パッド124は、金属
充填バイア122と第2のグリーンシート120のセラ
ミックの両方と良好に接着し、電気的に接続される。金
属ペーストでスクリーニングする通常これらも中程度の
含有量を有するメタライゼーション・ペーストである。
【0040】その後、第1および第2のグリーンシート
110および120を、特に内部パッド124と第1の
グリーンシート層110中の金属充填バイア114の位
置合わせに注意しながら積み重ね、積層して、図14に
示すような多層グリーンシート積層品140を形成す
る。この積み重ねおよび積層工程中に、金属、好ましく
は100体積%の銅で充填したバイア132を有し、セ
ラミック基板内の配線を行う、追加の誘電層130を組
み入れる。第1および第2のグリーンシート層110お
よび120のバイア114、122、およびパッド11
6、124は、完全に高密度化した金属構造である。金
属含有量の高いパッド116とバイア114は、セラミ
ックに接着するにしても、弱く接着するに過ぎない。し
かし、パッド116は金属含有量の高いバイア114を
介して内部パッド124にアンカリングされている。内
部パッド124は中程度の金属含有量であるため、セラ
ミックに良好に接着する。このように、各バイア114
は、内部パッド124と外部パッド116との間の電気
的および機械的な冗長接続を行う。
【0041】本発明の第4の実施形態を図15ないし図
20に示す。この実施形態では、積層直前に、金属パッ
ド116を焼結後のセラミックに保持するのに役立つ、
セラミックの追加の層134を、第1グリーンシート層
110の外側に形成する。図15ないし図20の工程
は、図10ないし図14の工程と類似している。追加の
グリーンシート層134は、第1グリーンシート層11
0上に付着させたパッド116の位置と一致させた開口
部136を、グリーンシート層134に打ち抜きまたは
切断により作成する。これらの開口部136は、パッド
116の直径よりわずかに小さい。グリーンシート層1
34中の開口部136は、積層中に第1グリーンシート
層110のパッド116と位置合わせし、各パッド11
6の縁部をその外周でセラミックに対してシールする。
焼結中、層134は高密度化し、パッド116の外周を
セラミックに接着して、パッド116の接着を改善す
る。層134は、必要であればスクリーニング可能な誘
電ペーストの形態で塗布してもよい。
【0042】本発明の第5の実施形態を図21ないし図
25に示す。図21に示すように、金属充填バイア21
2および表面パッド216を有する第1のグリーンシー
ト210を形成する。次に金属充填バイア222および
内部パッド224を有する第2のグリーンシート220
を形成する。内部パッド224は、第2のグリーンシー
ト層220の上に形成しても、代替方法として後述する
任意のグリーンシート層230の上に形成してもよい。
金属充填バイア222および表面パッド216は金属含
有量が高く、セラミックとの接着が悪いが、内部パッド
224は金属含有量が中程度で、セラミックとの接着が
良い。次に第1および第2のグリーンシート層210お
よび220を、金属、好ましくは100体積%の銅を充
填したバイアを有する任意の追加グリーンシート層23
0とともに積み重ね、積層して、多層グリーンシート積
層品240を形成する。次にこの多層グリーンシート積
層品240を従来の方法により焼結する。第1のグリー
ンシート層210のセラミック材料は、焼結中に高密度
化しないものが選択される。多層セラミック基板242
を形成する焼結の後、超音波洗浄など金属フィーチャを
損傷させない方法により、第1のグリーンシート層21
0のセラミックを除去する。残った部分はバイア212
と、セラミック材料であった開口部234である。その
後、金属フィーチャをメッキし、外部パッド216の露
出した表面を、後で基板を回路カードまたは他の装置に
取り付けるため、ソルダ・ボールまたはカラムを接合す
るのに使用する。この場合も、表面パッド216は、セ
ラミックと良好に接着したバイア212および内部パッ
ド224により、多層セラミック基板242にアンカリ
ングされることを理解されたい。
【0043】本発明の第6の実施形態を図26ないし図
30に示す。金属の表面パッドはセラミック基板に良好
に接着している。最初に、バイアを打ち抜き、金属含有
量の高い金属ペーストを充填して金属充填バイア212
を形成することにより、グリーンシート層210を形成
する。第1グリーンシート層210のセラミックは、焼
結中に著しく高密度化しないものを選択する。次に金属
含有量の高いペーストを使用して、パッド216をグリ
ーンシート上に形成する。バイア212とパッド216
の金属含有量は、焼結後100体積%であることが好ま
しい。第2のグリーンシート層220を打ち抜き、金属
含有量が中程度のペーストをスクリーニングして金属充
填バイア222を形成し、次に第2のグリーンシート層
220上にパッド224をスクリーニングする。パッド
224の金属組成およびセラミック・フィラーは、焼結
後パッド224がセラミックに良好に接着するように選
択する。パッド224は、図27に示すように第2のグ
リーンシート層220上にスクリーニングしても、代替
方法として第1のグリーンシート層210の側面219
にスクリーニングしてもよい。バイア212とパッド2
16は、焼結すると密度が90%を超える、金属含有量
の高いペーストを使用する。メタライズした追加のグリ
ーンシート230を、第1および第2のグリーンシート
層210、220と位置合わせし、積み重ね、積層して
多層グリーンシート積層品250を形成する。この多層
グリーンシート積層品250を積層して多層電子基板を
形成する。多層セラミック基板252を形成するため焼
結した後、第1のグリーンシート層210を、超音波洗
浄などの金属フィーチャを損傷させない方法により除去
する。残った部分はバイア212と、セラミック材料で
あった開口部234である。その後、金属フィーチャを
メッキし、外部パッド216の露出した表面を、後で基
板を回路カードまたは他の装置に取り付けるため、ソル
ダ・ボールまたはカラムを接合するのに使用する。この
場合、セラミック表面上のパッド224は良好に接着す
る。必要があれば、外部パッド216とパッド224と
の間の空間234を重合体で充填し、パッド216をさ
らにセラミックへアンカリングさせるとともに、構造を
支持し、取り扱いによる損傷を最少にすることができ
る。この用途に使用する重合体には、ポリイミド、エポ
キシなどがある。
【0044】本発明による最後の実施形態は、図1ない
し図20を参照して説明したどの方法によっても達成さ
れ、信頼性をさらに大幅に改善する。次に図31を参照
すると、単一の大きい金属充填バイア314と外部パッ
ド316を有する第1層310と、金属充填バイア32
2を有する第2層320とを備える多層セラミック基板
40が示されている。内部パッド324が、第1層31
0と第2層320との間に置かれている。さらに、金属
充填バイア332を有する任意の1層または複数の層3
30がある。大きいバイア314と外部パッド316の
金属含有量は高く、好ましくは金属100体積%であ
る。この大きいバイア314の直径は、パッド316お
よび324の直径より小さく、層310の厚みは大きい
バイア314の直径の2倍より大きい。パッド324お
よびバイア322は金属含有量が中程度で、多層セラミ
ック基板340のセラミック材料と良好に接着するよう
に選択する。バイア332は通常、従来と同様金属10
0体積%である。
【0045】前述のように、構造の形成時に最高の性能
と信頼性の改善を得るために行わなければならないいく
つかのパラメータがある。
【0046】金属含有量の高いバイアの長さは、モジュ
ールの電気的性能の制約内で、できるだけ長くすべきで
ある。バイアが長いほど、耐疲労性が大きくなる。バイ
アの長さは、誘電層を厚くするか、または複数のスルー
バイアを積み重ねて長いバイア・カラムを形成するかあ
るいはその両方によって、長くすることができる。
【0047】表面I/Oパッド内に配置できる最大数の
バイアを使用すべきである。パッドの電気的機能性は、
少なくとも1個のバイアの、パッドへの接続によって決
まる。パッドに接続されたバイアの数が多いほど、電気
的接続が長時間維持され、電気的信頼性が増大する。
【0048】アンカリング機能を有するバイアの延性お
よび耐疲労性が大きいほど、バイアが熱サイクルによっ
てひずみを生じるため、信頼性が高くなる。したがっ
て、Cu、Ag、Au、およびこれらの合金のように延
性の高い金属が、多くのひずみサイクルに耐える。
【0049】セラミックがCTEの整合性が悪いメタラ
イゼーションに使用される場合、たとえば銅、ニッケ
ル、金、銀などのメタライゼーションと、CTEが2〜
6ppmのガラス・セラミックのようなCTEの低いセ
ラミックからなるシステムでは、外部誘電層(たとえば
図1ないし図4の層10)中または上にある金属はセラ
ミックと接着すべきではない。通常、1〜10μmの非
常に狭い間隙が、この金属と隣接するセラミックの表面
との間に存在することができる。外部層中の金属は、セ
ラミックとは化学的に接着しないため、外部セラミック
層中には極めてわずかな応力しか発生しない。外部層の
バイアは、第2層(たとえば図1ないし図4の層20)
のメタライゼーションと化学的に良好に接着し、電気的
に接続される。第2層(たとえば層20)のメタライゼ
ーションは通常、セラミックと良好に接着し、これはか
なりの量の誘電体材料を添加することによって作成され
ることが多い。この誘電体フィラーは通常、セラミック
・グリーンシート層に使用される誘電体と同一または非
常に類似したものである。
【0050】前記に開示した構造は、いくつかの取り付
け方法に利用することができる。これらには、セラミッ
クへのLGA、BGA、およびCGA第2レベル接続が
ある。図1ないし図20および図31に開示した構造
は、表面金属の接着の信頼性に問題があるセラミックに
特に有用であり、ソケットへの差込み・取り外しや使用
中に圧縮負荷がパッドにかかるLGA用途にも使用する
ことができる。同様に、後で表面パッドの間に誘電体を
充填する処理を行う図21ないし図30に示す構造も、
圧縮LGA用途に使用することができる。図1ないし図
31に開示した構造は、はんだを用いてセラミック基板
を回路板または他のセラミックに接合するBGAおよび
CGA用途に使用することができる。これらの用途で、
外部表面パッドとアンカリング機能を有するバイアは、
セラミックとは接着しない。アンカリング機能を有する
バイアは、セラミックに直接接着したパッドと比較し
て、機械的および電気的信頼性が向上し、熱サイクル中
にセラミックと回路板との間のはんだ接合から、さらに
ひずみを緩和する。図21ないし図30に開示した構造
は、共融金属、ソルダ・ボール、ソルダ・カラム接続な
どの従来のはんだ接続法の耐疲労性を増大させる表面フ
ィーチャを形成することによって、良好に接着した表面
パッド(たとえば上述のアルミナ・システム)を有する
従来のセラミックの、第2レベル接続の熱サイクル信頼
性を増大するのに使用することができる。
【0051】従来の取り付け方法に対して信頼性を改善
する例として、いくつかのデイジー・チェイン接続を有
する試験ビヒクルを、CTEが3ppm、厚みが約1.
9mmの、銅をメタライズした32mm角のガラス・セ
ラミック基板から作成した。焼結およびメッキ後、共融
スズ・鉛はんだで取り付けた鉛90%+スズ10%のソ
ルダ・ボールを用いて各試験ビヒクルを作成した後、再
び共融スズ・鉛はんだを用いてCTEが約18ppmの
FR4印刷回路板に取り付けた。次にこの基板と回路板
を、毎時約2サイクルの速度で−55℃から+110℃
の熱サイクルにかけた。最初に故障が生じたのは、常に
基板の周縁部のデイジー・チェイン接続内であったが、
そのサイクル数を記録した。良好に接着したモリブデン
金属を主成分とするパッドを有し、CTEが約6ppm
の、同一厚みの高アルミナ・セラミック製の対照セラミ
ック基板をこの試験に加えた。CTEが低いセラミック
に良好に取り付けられ、メッキおよびはんだ付けができ
る表面金属パッドの作成を試みたが、変動が大きく、全
体として結果は不良であった。熱サイクル100回未満
で表面金属パッドがセラミックから分離することが多か
った。
【0052】図10ないし図14に示す構造を用いて、
バイア114および外部パッド116には銅90%、ニ
ッケル10%のメタライゼーション、バイア122およ
び内部パッド124には銅50%+誘電体50%の複合
メタライゼーションにより作成した同様な試験ビヒクル
は、通常約450〜500回の熱サイクルで最初の電気
的故障を生じた。これらの結果は、約350〜400サ
イクル回の熱で最初の電気的故障を生じるアルミナの対
照基板に匹敵する。
【0053】熱サイクルの間に、アンカリング機能を有
するバイアは、CTEがセラミックの3ppmに対して
回路板が18ppmであるという不整合のため、かなり
のひずみを受ける。本発明によれば、各はんだ接続の電
気的連続性は、最後のアンカリング機能を有する導電性
バイアが故障するまで維持され、その故障時にデイジー
・チェイン回路が開き、基板は電気的に故障したと考え
られる。
【0054】まとめとして、本発明の構成に関して以下
の事項を開示する。
【0055】(1)複数の充填されたバイアと外部表面
を有する第1セラミック層と、前記第1セラミック層の
前記外部表面に隣接し、前記第1セラミック層の前記複
数の充填されたバイアに接着された少なくとも1個の外
部パッドと、前記第1セラミック層に隣接し、前記第1
セラミック層の少なくとも1個の充填されたバイアと接
触する少なくとも1個の充填されたバイアを有する前記
第2セラミック層と、前記第1および第2セラミック層
の間に配置され、前記第1セラミック層の前記複数の充
填されたバイアと接触する少なくとも1個の内部パッド
とを具備し、前記第1セラミック層の前記複数の充填さ
れたバイアのそれぞれが、前記第2セラミック層のバイ
アまたは前記内部パッドと接触する、多層セラミック基
板。 (2)前記第1セラミック層および前記少なくとも1個
の外部パッドの周辺を覆うセラミック・カバー層をさら
に具備する、上記(1)に記載の多層セラミック基板。 (3)前記第2セラミック層の少なくても1個の充填さ
れたバイアが、30〜70体積%の金属材料を含有し、
残部がセラミック材料である、上記(1)に記載の多層
セラミック基板。 (4)前記内部パッドが、30〜70体積%の金属材料
を含有し、残部がセラミック材料である、上記(1)に
記載の多層セラミック基板。 (5)前記第2層に、前記少なくとも1個の内部パッド
と接触する複数の充填されたバイアがある、上記(1)
に記載の多層セラミック基板。 (6)各外部パッドごとに、複数の内部パッドがある、
上記(1)に記載の多層セラミック基板。 (7)前記複数の内部パッドの1個に接触する前記第1
セラミック層の複数のバイアの少なくとも1個が、電気
的機能を行わない、上記(6)に記載の多層セラミック
基板。 (8)前記第1セラミック層の前記複数のバイア少なく
とも1個が、電気的機能を行う、上記(1)に記載の多
層セラミック基板。 (9)充填されたバイアと外部表面とを有する第1セラ
ミック層と、前記第1セラミック層の前記外部表面に隣
接し、少なくとも1個の前記充填されたバイアに接着さ
れた外部パッドと、前記第1セラミック層に隣接し、前
記第1セラミック層の前記充填されたバイアと接触する
少なくとも1個の充填されたバイアを有する第2セラミ
ック層と、前記第1および第2セラミック層の間に配置
され、前記第1および第2層の前記充填されたバイアと
接触する内部パッドとを具備し、前記第1セラミック層
のバイアが、前記第2セラミック層のバイアより断面積
が大きく、前記第1セラミック層が、前記第2セラミッ
ク層より厚い、多層セラミック基板。 (10)前記第1セラミック層の前記充填されたバイア
が、少なくとも80体積%の金属材料を含有し、残部が
セラミック材料である、上記(1)または(9)に記載
の多層セラミック基板。 (11)前記金属材料が、銅、銅合金、ニッケル、およ
び銀からなる群から選択されたものである、上記(1
0)に記載の多層セラミック基板。 (12)前記外部パッドが、少なくとも80体積%の金
属材料を含有し、残部がセラミック材料である、上記
(1)または(9)に記載の多層セラミック基板。 (13)前記金属材料が、銅、銅合金、ニッケル、およ
び銀からなる群から選択されたものである、上記(1
2)に記載の多層セラミック基板。 (14)前記第2セラミック層に、前記第1セラミック
層のバイアに接触する複数のバイアがある、上記(9)
に記載の多層セラミック基板。 (15)複数の充填されたバイアと外部表面を有する第
1セラミック層と、前記第1セラミック層に隣接し、少
なくとも1個の充填されたバイアを有する第2セラミッ
ク層と、前記第1および第2セラミック層の間に配置さ
れ、前記第1セラミック層の前記複数の充填されたバイ
ア、および前記第2セラミック層の前記少なくとも1個
の充填されたバイアと接触する少なくとも1個の内部パ
ッドと、前記第1セラミック層の前記外部表面から延
び、前記第1セラミック層の前記複数の充填されたバイ
アに接触する複数のバイア・カラムと、前記複数のバイ
ア・カラムに接着された少なくとも1個の外部パッドと
を具備する、多層セラミック基板。 (16)前記複数の充填されたバイアが、30〜70体
積%の金属材料を含有し、残部がセラミック材料であ
る、上記(15)に記載の多層セラミック基板。 (17)前記第1セラミック層と、前記複数のバイア・
カラムに接着された前記少なくとも1個の外部パッドと
の間の空間に、セラミック材料が存在しない、上記(1
5)に記載の多層セラミック基板。 (18)少なくとも1個の充填されたバイアと外部表面
とを有する第1セラミック層と、前記第1セラミック層
の前記外部表面に接着され、前記第1セラミック層の前
記少なくとも1個の充填されたバイアと接触する内部パ
ッドと、前記内部パッドから延びる複数のバイア・カラ
ムと、前記複数のバイア・カラムに接触された外部パッ
ドとを具備する多層セラミック基板。 (19)前記バイア・カラムが、少なくとも80体積%
の金属材料を含有し、残部がセラミック材料である、上
記(15)または(18)に記載の多層セラミック基
板。 (20)前記金属材料が、銅、銅合金、ニッケル、およ
び銀からなる群から選択されたものである、上記(1
9)に記載の多層セラミック基板。 (21)前記外部パッドが、少なくとも80体積%の金
属材料を含有し、残部がセラミック材料である、上記
(15)または(18)に記載の多層セラミック基板。 (22)前記第1セラミック層の前記少なくとも1個の
充填されたバイアが、30〜70体積%の金属材料を含
有し、残部がセラミック材料である、上記(18)に記
載の多層セラミック基板。 (23)前記内部パッドが、30〜70体積%の金属材
料を含有し、残部がセラミック材料である、上記(1
5)または(18)に記載の多層セラミック基板。 (24)前記内部パッドと外部パッドとの間の空間に、
セラミック材料が存在しない、上記(18)に記載の多
層セラミック基板。 (25)複数のバイアを有する第1のセラミック・グリ
ーンシートを形成するステップと、ペースト材料の固形
分に対し、少なくとも80体積%の金属材料を含有し、
残部がセラミック材料である金属ペースト材料を、少な
くとも1個の前記バイアにスクリーニングするステップ
と、ペースト材料の固形分に対し、少なくとも80体積
%の金属材料を含有し、残部がセラミック材料である金
属ペースト材料を、前記第1のセラミック・グリーンシ
ート上にスクリーニングして入出力パッドを形成するス
テップと、少なくとも1個のバイアを有する第2のセラ
ミック・グリーンシートを形成するステップと、ペース
ト材料の固形分に対し、30〜70体積%の金属材料を
含有し、残部がセラミック材料である金属ペースト材料
を、前記第2のセラミック・グリーンシートの少なくと
も1個のバイアにスクリーニングするステップと、ペー
スト材料の固形分に対し、30〜70体積%の金属材料
を含有し、残部がセラミック材料である金属ペースト材
料を、前記第1または第2のセラミック・グリーンシー
ト上にスクリーニングして内部入出力パッドを形成する
ステップと、前記入出力パッドが未焼結の多層セラミッ
ク基板の外側になり、前記内部パッドが前記第1および
第2セラミック・グリーンシートの間に配置され、前記
第1セラミック・グリーンシート中にある前記複数のバ
イアのそれぞれが、前記第2セラミック・グリーンシー
トのバイア、または前記内部コンタクト・パッドと接触
するように、前記第1および第2セラミック・グリーン
シートを積層して、未焼結の多層セラミック基板を形成
するステップと、入出力パッドを有する焼結した多層セ
ラミック基板が、前記第1セラミック層の前記少なくと
も1個のバイアに接着されるが、前記多層セラミック基
板のセラミック材料には接着されないように、前記未焼
結の多層セラミック基板を焼結するステップとを含む、
多層セラミック基板を形成する方法。 (26)少なくとも1個のバイアを有し、多層セラミッ
ク基板の所定の焼結温度では焼結されないように選択さ
れたセラミック材料を含む第1のセラミック・グリーン
シートを形成するステップと、ペースト材料の固形分に
対し、少なくとも80体積%の金属材料を含有し、残部
がセラミック材料である金属ペースト材料を、前記第1
のセラミック・グリーンシートの前記少なくとも1個の
バイアにスクリーニングするステップと、ペースト材料
の固形分に対し、少なくとも80体積%の金属材料を含
有し、残部がセラミック材料である金属ペースト材料
を、前記第1のセラミック・グリーンシート上にスクリ
ーニングして外部パッドを形成するステップと、少なく
とも1個のバイアを有する第2のセラミック・グリーン
シートを形成するステップと、ペースト材料の固形分に
対し、80体積%の金属材料を含有し、残部がセラミッ
ク材料である金属ペースト材料を、前記第2のセラミッ
ク・グリーンシートの前記少なくとも1個のバイアにス
クリーニングするステップと、少なくとも1個のバイア
を有する第3のセラミック・グリーンシートを形成する
ステップと、ペースト材料の固形分に対し、30〜70
体積%の金属材料を含有し、残部がセラミック材料であ
る金属ペースト材料を、前記第3のセラミック・グリー
ンシートの前記少なくとも1個のバイアにスクリーニン
グするステップと、ペースト材料の固形分に対し、30
〜70体積%の金属材料を含有し、残部がセラミック材
料である金属ペースト材料を、前記第2または第3のセ
ラミック・グリーンシート上にスクリーニングして内部
パッドを形成するステップと、前記外部パッドが前記未
焼結の多層セラミック基板の外側になり、前記内部パッ
ドが前記第2および第3セラミック・グリーンシートの
間に配置されるように、前記第1、第2、および第3セ
ラミック・グリーンシートを積層して、未焼結の多層セ
ラミック基板を形成するステップと、前記第1セラミッ
ク・グリーンシートは焼結されないが、前記第2および
第3セラミック・グリーンシートは焼結されるように、
未焼結の多層セラミック基板を焼結するステップと、焼
結前に、パッドを有する焼結された多層セラミック基板
が、前記第1セラミック・グリーンシートの前記少なく
とも1個のバイアにのみ接着され、前記多層セラミック
基板のセラミック材料との間には空間ができるように、
前記第1セラミック・グリーンシートの前記少なくとも
1個のバイアを残して、未焼結のセラミック材料を除去
するステップとを含む、多層セラミック基板を形成する
方法。 (27)少なくとも1個のバイアを有し、多層セラミッ
ク基板の所定の焼結温度では焼結されないように選択さ
れたセラミック材料を含む第1のセラミック・グリーン
シートを形成するステップと、ペースト材料の固形分に
対し、少なくとも80体積%の金属材料を含有し、残部
がセラミック材料である金属ペースト材料を、前記第1
のセラミック・グリーンシートの前記少なくとも1個の
バイアにスクリーニングするステップと、ペースト材料
の固形分に対し、少なくとも80体積%の金属材料を含
有し、残部がセラミック材料である金属ペースト材料
を、前記第1のセラミック・グリーンシート上にスクリ
ーニングして外部パッドを形成するステップと、少なく
とも1個のバイアを有する第2のセラミック・グリーン
シートを形成するステップと、ペースト材料の固形分に
対し、30〜70体積%の金属材料を含有し、残部がセ
ラミック材料である金属ペースト材料を、前記第2のセ
ラミック・グリーンシートの前記少なくとも1個のバイ
アにスクリーニングするステップと、ペースト材料の固
形分に対し、30〜70体積%の金属材料を含有し、残
部がセラミック材料である金属ペースト材料を、前記第
1または第2のセラミック・グリーンシート上にスクリ
ーニングして内部パッドを形成するステップと、前記外
部パッドが未焼結の多層セラミック基板の外側になり、
前記内部パッドが前記第1および第2セラミック・グリ
ーンシートの間に配置されるように、前記第1および第
2セラミック・グリーンシートを積層して、未焼結の多
層セラミック基板を形成するステップと、前記第1セラ
ミック・グリーンシートは焼結されないが、前記第2セ
ラミック・グリーンシートは焼結されるように、前記未
焼結の多層セラミック基板を所定の温度で前記焼結する
ステップと、焼結前に、パッドを有する焼結された多層
セラミック基板が、前記第1セラミック・グリーンシー
トの少なくとも1個のバイアにのみ接着され、内部パッ
ドおよび前記多層セラミック基板のセラミック材料との
間から離れる空間ができるように、前記第1セラミック
・グリーンシートの前記少なくとも1個のバイアを残し
て、未焼結のセラミック材料を除去するステップとを含
む、多層セラミック基板を形成する方法。
【図面の簡単な説明】
【図1】本発明の第1の実施形態、および第1の実施形
態の製法を示す図である。
【図2】本発明の第1の実施形態、および第1の実施形
態の製法を示す図である。
【図3】本発明の第1の実施形態、および第1の実施形
態の製法を示す図である。
【図4】本発明の第1の実施形態、および第1の実施形
態の製法を示す図である。
【図5】本発明の第2の実施形態、および第2の実施形
態の製法を示す図である。
【図6】本発明の第2の実施形態、および第2の実施形
態の製法を示す図である。
【図7】本発明の第2の実施形態、および第2の実施形
態の製法を示す図である。
【図8】本発明の第2の実施形態、および第2の実施形
態の製法を示す図である。
【図9】本発明の第2の実施形態、および第2の実施形
態の製法を示す図である。
【図10】本発明の第3の実施形態、および第3の実施
形態の製法を示す図である。
【図11】本発明の第3の実施形態、および第3の実施
形態の製法を示す図である。
【図12】本発明の第3の実施形態、および第3の実施
形態の製法を示す図である。
【図13】本発明の第3の実施形態、および第3の実施
形態の製法を示す図である。
【図14】本発明の第3の実施形態、および第3の実施
形態の製法を示す図である。
【図15】本発明の第4の実施形態、および第4の実施
形態の製法を示す図である。
【図16】本発明の第4の実施形態、および第4の実施
形態の製法を示す図である。
【図17】本発明の第4の実施形態、および第4の実施
形態の製法を示す図である。
【図18】本発明の第4の実施形態、および第4の実施
形態の製法を示す図である。
【図19】本発明の第4の実施形態、および第4の実施
形態の製法を示す図である。
【図20】本発明の第4の実施形態、および第4の実施
形態の製法を示す図である。
【図21】本発明の第5の実施形態、および第5の実施
形態の製法を示す図である。
【図22】本発明の第5の実施形態、および第5の実施
形態の製法を示す図である。
【図23】本発明の第5の実施形態、および第5の実施
形態の製法を示す図である。
【図24】本発明の第5の実施形態、および第5の実施
形態の製法を示す図である。
【図25】本発明の第5の実施形態、および第5の実施
形態の製法を示す図である。
【図26】本発明の第6の実施形態、および第6の実施
形態の製法を示す図である。
【図27】本発明の第6の実施形態、および第6の実施
形態の製法を示す図である。
【図28】本発明の第6の実施形態、および第6の実施
形態の製法を示す図である。
【図29】本発明の第6の実施形態、および第6の実施
形態の製法を示す図である。
【図30】本発明の第6の実施形態、および第6の実施
形態の製法を示す図である。
【図31】本発明の第7の実施形態を示す図である。
【符号の説明】
10 第1グリーンシート 110 第1グリーンシート 210 第1グリーンシート 310 第1グリーンシート 11 バイアの傾斜端部 12 バイア 212 バイア 14 バイアの端部 314 バイアの端部 16 表面パッド 17 第1グリーンシートの外側表面 19 第1グリーンシートの裏面 119 第1グリーンシートの裏面 219 第1グリーンシートの裏面 20 第2グリーンシート 120 第2グリーンシート 220 第2グリーンシート 320 第2グリーンシート 22 バイア 122 バイア 222 バイア 322 バイア 24 内部パッド 124 内部パッド 224 内部パッド 324 内部パッド 30 誘電層 130 誘電層 230 誘電層 330 誘電層 32 バイア 132 バイア 232 バイア 332 バイア 34 セラミック層 134 セラミック層 234 セラミック層 36 開口部 136 開口部 40 グリーンシート積層物 140 グリーンシート積層物 240 グリーンシート積層物 340 グリーンシート積層物 50 グリーンシート積層物 150 グリーンシート積層物 250 グリーンシート積層物 350 グリーンシート積層物
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 FI H05K 3/40 H01L 23/12 N D (72)発明者 デービッド・エイチ・ガブリエルズ アメリカ合衆国12516 ニューヨーク州 コールド・スプリング マリオン・アベ ニュー 3 (72)発明者 リチャード・エフ・エンディク アメリカ合衆国12590 ニューヨーク州 ワッピンガーズ・フォールズ ブレイ・ ファーム・レーン 9 (72)発明者 スンダル・エム・カマート アメリカ合衆国95129 カリフォルニア 州サンノゼ オークトリー・ドライブ 1085 (72)発明者 スコット・アイ・ランゲンタール アメリカ合衆国12538 ニューヨーク州 ハイドパーク ウィリアム・ペン・コー ト 3 (72)発明者 スリーニヴァサ・エス・エヌ・レッディ ー アメリカ合衆国12540 ニューヨーク州 ラグランジェヴィル ボウ・レーン 17 (72)発明者 ラーオ・ヴィー・ヴァンラバネニ アメリカ合衆国12590 ニューヨーク州 ワッピンガーズ・フォールズ ブレイ・ ファーム・レーン 9 (56)参考文献 特開 平10−93227(JP,A) 特開 平10−41626(JP,A) (58)調査した分野(Int.Cl.7,DB名) H05K 3/46 H01L 23/12 H05K 1/11 H05K 3/40

Claims (27)

    (57)【特許請求の範囲】
  1. 【請求項1】複数の充填されたバイアと外部表面を有す
    る第1セラミック層と、 前記第1セラミック層の前記外部表面に隣接し、前記第
    1セラミック層の前記複数の充填されたバイアに接着さ
    れた少なくとも1個の外部パッドと、 前記第1セラミック層に隣接し、前記第1セラミック層
    の少なくとも1個の充填されたバイアと接触する少なく
    とも1個の充填されたバイアを有する前記第2セラミッ
    ク層と、 前記第1および第2セラミック層の間に配置され、前記
    第1セラミック層の前記複数の充填されたバイアと接触
    する少なくとも1個の内部パッドとを具備し、 前記第1セラミック層の前記複数の充填されたバイアの
    それぞれが、前記第2セラミック層のバイアまたは前記
    内部パッドと接触する、 多層セラミック基板。
  2. 【請求項2】前記第1セラミック層および前記少なくと
    も1個の外部パッドの周辺を覆うセラミック・カバー層
    をさらに具備する、請求項1に記載の多層セラミック基
    板。
  3. 【請求項3】前記第2セラミック層の少なくても1個の
    充填されたバイアが、30〜70体積%の金属材料を含
    有し、残部がセラミック材料である、請求項1に記載の
    多層セラミック基板。
  4. 【請求項4】前記内部パッドが、30〜70体積%の金
    属材料を含有し、残部がセラミック材料である、請求項
    1に記載の多層セラミック基板。
  5. 【請求項5】前記第2層に、前記少なくとも1個の内部
    パッドと接触する複数の充填されたバイアがある、請求
    項1に記載の多層セラミック基板。
  6. 【請求項6】各外部パッドごとに、複数の内部パッドが
    ある、請求項1に記載の多層セラミック基板。
  7. 【請求項7】前記複数の内部パッドの1個に接触する前
    記第1セラミック層の複数のバイアの少なくとも1個
    が、電気的機能を行わない、請求項6に記載の多層セラ
    ミック基板。
  8. 【請求項8】前記第1セラミック層の前記複数のバイア
    少なくとも1個が、電気的機能を行う、請求項1に記載
    の多層セラミック基板。
  9. 【請求項9】充填されたバイアと外部表面とを有する第
    1セラミック層と、 前記第1セラミック層の前記外部表面に隣接し、少なく
    とも1個の前記充填されたバイアに接着された外部パッ
    ドと、 前記第1セラミック層に隣接し、前記第1セラミック層
    の前記充填されたバイアと接触する少なくとも1個の充
    填されたバイアを有する第2セラミック層と、 前記第1および第2セラミック層の間に配置され、前記
    第1および第2層の前記充填されたバイアと接触する内
    部パッドとを具備し、 前記第1セラミック層のバイアが、前記第2セラミック
    層のバイアより断面積が大きく、前記第1セラミック層
    が、前記第2セラミック層より厚い、 多層セラミック基板。
  10. 【請求項10】前記第1セラミック層の前記充填された
    バイアが、少なくとも80体積%の金属材料を含有し、
    残部がセラミック材料である、請求項1または9に記載
    の多層セラミック基板。
  11. 【請求項11】前記金属材料が、銅、銅合金、ニッケ
    ル、および銀からなる群から選択されたものである、請
    求項10に記載の多層セラミック基板。
  12. 【請求項12】前記外部パッドが、少なくとも80体積
    %の金属材料を含有し、残部がセラミック材料である、
    請求項1または9に記載の多層セラミック基板。
  13. 【請求項13】前記金属材料が、銅、銅合金、ニッケ
    ル、および銀からなる群から選択されたものである、請
    求項12に記載の多層セラミック基板。
  14. 【請求項14】前記第2セラミック層に、前記第1セラ
    ミック層のバイアに接触する複数のバイアがある、請求
    項9に記載の多層セラミック基板。
  15. 【請求項15】複数の充填されたバイアと外部表面を有
    する第1セラミック層と、 前記第1セラミック層に隣接し、少なくとも1個の充填
    されたバイアを有する第2セラミック層と、 前記第1および第2セラミック層の間に配置され、前記
    第1セラミック層の前記複数の充填されたバイア、およ
    び前記第2セラミック層の前記少なくとも1個の充填さ
    れたバイアと接触する少なくとも1個の内部パッドと、 前記第1セラミック層の前記外部表面から延び、前記第
    1セラミック層の前記複数の充填されたバイアに接触す
    る複数のバイア・カラムと、 前記複数のバイア・カラムに接着された少なくとも1個
    の外部パッドとを具備する、 多層セラミック基板。
  16. 【請求項16】前記複数の充填されたバイアが、30〜
    70体積%の金属材料を含有し、残部がセラミック材料
    である、請求項15に記載の多層セラミック基板。
  17. 【請求項17】前記第1セラミック層と、前記複数のバ
    イア・カラムに接着された前記少なくとも1個の外部パ
    ッドとの間の空間に、セラミック材料が存在しない、請
    求項15に記載の多層セラミック基板。
  18. 【請求項18】少なくとも1個の充填されたバイアと外
    部表面とを有する第1セラミック層と、 前記第1セラミック層の前記外部表面に接着され、前記
    第1セラミック層の前記少なくとも1個の充填されたバ
    イアと接触する内部パッドと、 前記内部パッドから延びる複数のバイア・カラムと、 前記複数のバイア・カラムに接触された外部パッドとを
    具備する多層セラミック基板。
  19. 【請求項19】前記バイア・カラムが、少なくとも80
    体積%の金属材料を含有し、残部がセラミック材料であ
    る、請求項15または18に記載の多層セラミック基
    板。
  20. 【請求項20】前記金属材料が、銅、銅合金、ニッケ
    ル、および銀からなる群から選択されたものである、請
    求項19に記載の多層セラミック基板。
  21. 【請求項21】前記外部パッドが、少なくとも80体積
    %の金属材料を含有し、残部がセラミック材料である、
    請求項15または18に記載の多層セラミック基板。
  22. 【請求項22】前記第1セラミック層の前記少なくとも
    1個の充填されたバイアが、30〜70体積%の金属材
    料を含有し、残部がセラミック材料である、請求項18
    に記載の多層セラミック基板。
  23. 【請求項23】前記内部パッドが、30〜70体積%の
    金属材料を含有し、残部がセラミック材料である、請求
    項15または18に記載の多層セラミック基板。
  24. 【請求項24】前記内部パッドと外部パッドとの間の空
    間に、セラミック材料が存在しない、請求項18に記載
    の多層セラミック基板。
  25. 【請求項25】複数のバイアを有する第1のセラミック
    ・グリーンシートを形成するステップと、 ペースト材料の固形分に対し、少なくとも80体積%の
    金属材料を含有し、残部がセラミック材料である金属ペ
    ースト材料を、少なくとも1個の前記バイアにスクリー
    ニングするステップと、 ペースト材料の固形分に対し、少なくとも80体積%の
    金属材料を含有し、残部がセラミック材料である金属ペ
    ースト材料を、前記第1のセラミック・グリーンシート
    上にスクリーニングして入出力パッドを形成するステッ
    プと、 少なくとも1個のバイアを有する第2のセラミック・グ
    リーンシートを形成するステップと、 ペースト材料の固形分に対し、30〜70体積%の金属
    材料を含有し、残部がセラミック材料である金属ペース
    ト材料を、前記第2のセラミック・グリーンシートの少
    なくとも1個のバイアにスクリーニングするステップ
    と、 ペースト材料の固形分に対し、30〜70体積%の金属
    材料を含有し、残部がセラミック材料である金属ペース
    ト材料を、前記第1または第2のセラミック・グリーン
    シート上にスクリーニングして内部入出力パッドを形成
    するステップと、 前記入出力パッドが未焼結の多層セラミック基板の外側
    になり、前記内部パッドが前記第1および第2セラミッ
    ク・グリーンシートの間に配置され、前記第1セラミッ
    ク・グリーンシート中にある前記複数のバイアのそれぞ
    れが、前記第2セラミック・グリーンシートのバイア、
    または前記内部コンタクト・パッドと接触するように、
    前記第1および第2セラミック・グリーンシートを積層
    して、未焼結の多層セラミック基板を形成するステップ
    と、 入出力パッドを有する焼結した多層セラミック基板が、
    前記第1セラミック層の前記少なくとも1個のバイアに
    接着されるが、前記多層セラミック基板のセラミック材
    料には接着されないように、前記未焼結の多層セラミッ
    ク基板を焼結するステップとを含む、 多層セラミック基板を形成する方法。
  26. 【請求項26】少なくとも1個のバイアを有し、多層セ
    ラミック基板の所定の焼結温度では焼結されないように
    選択されたセラミック材料を含む第1のセラミック・グ
    リーンシートを形成するステップと、 ペースト材料の固形分に対し、少なくとも80体積%の
    金属材料を含有し、残部がセラミック材料である金属ペ
    ースト材料を、前記第1のセラミック・グリーンシート
    の前記少なくとも1個のバイアにスクリーニングするス
    テップと、 ペースト材料の固形分に対し、少なくとも80体積%の
    金属材料を含有し、残部がセラミック材料である金属ペ
    ースト材料を、前記第1のセラミック・グリーンシート
    上にスクリーニングして外部パッドを形成するステップ
    と、 少なくとも1個のバイアを有する第2のセラミック・グ
    リーンシートを形成するステップと、 ペースト材料の固形分に対し、80体積%の金属材料を
    含有し、残部がセラミック材料である金属ペースト材料
    を、前記第2のセラミック・グリーンシートの前記少な
    くとも1個のバイアにスクリーニングするステップと、 少なくとも1個のバイアを有する第3のセラミック・グ
    リーンシートを形成するステップと、 ペースト材料の固形分に対し、30〜70体積%の金属
    材料を含有し、残部がセラミック材料である金属ペース
    ト材料を、前記第3のセラミック・グリーンシートの前
    記少なくとも1個のバイアにスクリーニングするステッ
    プと、 ペースト材料の固形分に対し、30〜70体積%の金属
    材料を含有し、残部がセラミック材料である金属ペース
    ト材料を、前記第2または第3のセラミック・グリーン
    シート上にスクリーニングして内部パッドを形成するス
    テップと、 前記外部パッドが前記未焼結の多層セラミック基板の外
    側になり、前記内部パッドが前記第2および第3セラミ
    ック・グリーンシートの間に配置されるように、前記第
    1、第2、および第3セラミック・グリーンシートを積
    層して、未焼結の多層セラミック基板を形成するステッ
    プと、 前記第1セラミック・グリーンシートは焼結されない
    が、前記第2および第3セラミック・グリーンシートは
    焼結されるように、未焼結の多層セラミック基板を焼結
    するステップと、 焼結前に、パッドを有する焼結された多層セラミック基
    板が、前記第1セラミック・グリーンシートの前記少な
    くとも1個のバイアにのみ接着され、前記多層セラミッ
    ク基板のセラミック材料との間には空間ができるよう
    に、前記第1セラミック・グリーンシートの前記少なく
    とも1個のバイアを残して、未焼結のセラミック材料を
    除去するステップとを含む、 多層セラミック基板を形成する方法。
  27. 【請求項27】少なくとも1個のバイアを有し、多層セ
    ラミック基板の所定の焼結温度では焼結されないように
    選択されたセラミック材料を含む第1のセラミック・グ
    リーンシートを形成するステップと、 ペースト材料の固形分に対し、少なくとも80体積%の
    金属材料を含有し、残部がセラミック材料である金属ペ
    ースト材料を、前記第1のセラミック・グリーンシート
    の前記少なくとも1個のバイアにスクリーニングするス
    テップと、 ペースト材料の固形分に対し、少なくとも80体積%の
    金属材料を含有し、残部がセラミック材料である金属ペ
    ースト材料を、前記第1のセラミック・グリーンシート
    上にスクリーニングして外部パッドを形成するステップ
    と、 少なくとも1個のバイアを有する第2のセラミック・グ
    リーンシートを形成するステップと、 ペースト材料の固形分に対し、30〜70体積%の金属
    材料を含有し、残部がセラミック材料である金属ペース
    ト材料を、前記第2のセラミック・グリーンシートの前
    記少なくとも1個のバイアにスクリーニングするステッ
    プと、 ペースト材料の固形分に対し、30〜70体積%の金属
    材料を含有し、残部がセラミック材料である金属ペース
    ト材料を、前記第1または第2のセラミック・グリーン
    シート上にスクリーニングして内部パッドを形成するス
    テップと、 前記外部パッドが未焼結の多層セラミック基板の外側に
    なり、前記内部パッドが前記第1および第2セラミック
    ・グリーンシートの間に配置されるように、前記第1お
    よび第2セラミック・グリーンシートを積層して、未焼
    結の多層セラミック基板を形成するステップと、 前記第1セラミック・グリーンシートは焼結されない
    が、前記第2セラミック・グリーンシートは焼結される
    ように、前記未焼結の多層セラミック基板を所定の温度
    で前記焼結するステップと、 焼結前に、パッドを有する焼結された多層セラミック基
    板が、前記第1セラミック・グリーンシートの少なくと
    も1個のバイアにのみ接着され、内部パッドおよび前記
    多層セラミック基板のセラミック材料との間から離れる
    空間ができるように、前記第1セラミック・グリーンシ
    ートの前記少なくとも1個のバイアを残して、未焼結の
    セラミック材料を除去するステップとを含む、 多層セラミック基板を形成する方法。
JP2000210777A 1999-07-19 2000-07-12 多層セラミック基板およびその製造方法 Expired - Fee Related JP3401767B2 (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US09/356,944 US6187418B1 (en) 1999-07-19 1999-07-19 Multilayer ceramic substrate with anchored pad
US09/356944 1999-07-19

Publications (2)

Publication Number Publication Date
JP2001068857A JP2001068857A (ja) 2001-03-16
JP3401767B2 true JP3401767B2 (ja) 2003-04-28

Family

ID=23403624

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2000210777A Expired - Fee Related JP3401767B2 (ja) 1999-07-19 2000-07-12 多層セラミック基板およびその製造方法

Country Status (4)

Country Link
US (2) US6187418B1 (ja)
JP (1) JP3401767B2 (ja)
CN (1) CN1181716C (ja)
SG (1) SG93244A1 (ja)

Families Citing this family (44)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7088002B2 (en) * 2000-12-18 2006-08-08 Intel Corporation Interconnect
US6492254B2 (en) * 2001-01-31 2002-12-10 Bae Systems Information And Electronic Systems Integration, Inc. Ball grid array (BGA) to column grid array (CGA) conversion process
US6564986B1 (en) * 2001-03-08 2003-05-20 Xilinx, Inc. Method and assembly for testing solder joint fractures between integrated circuit package and printed circuit board
US7189595B2 (en) * 2001-05-31 2007-03-13 International Business Machines Corporation Method of manufacture of silicon based package and devices manufactured thereby
US6878608B2 (en) * 2001-05-31 2005-04-12 International Business Machines Corporation Method of manufacture of silicon based package
JP3998984B2 (ja) * 2002-01-18 2007-10-31 富士通株式会社 回路基板及びその製造方法
JP4291615B2 (ja) * 2002-05-28 2009-07-08 株式会社巴川製紙所 光学素子ウエハ及びその製造方法、光学素子の製造方法
KR100481216B1 (ko) * 2002-06-07 2005-04-08 엘지전자 주식회사 볼 그리드 어레이 패키지 및 그의 제조 방법
US6900395B2 (en) * 2002-11-26 2005-05-31 International Business Machines Corporation Enhanced high-frequency via interconnection for improved reliability
JP4059085B2 (ja) * 2003-01-14 2008-03-12 松下電器産業株式会社 高周波積層部品およびその製造方法
JP4054269B2 (ja) * 2003-03-20 2008-02-27 Tdk株式会社 電子部品の製造方法および電子部品
US20050047106A1 (en) * 2003-08-29 2005-03-03 Martino Peter Miguel Substrate reinforcing in an LGA package
KR20030074582A (ko) * 2003-09-03 2003-09-19 학교법인 한국정보통신학원 초고주파 다층회로 구조 및 제작 방법
US20050104374A1 (en) * 2003-11-17 2005-05-19 Steur Gunnar V.D. Pull-out resistant compression fitting for fluid lines
US6987316B2 (en) * 2004-01-14 2006-01-17 International Business Machines Corporation Multilayer ceramic substrate with single via anchored pad and method of forming
JP2006013272A (ja) * 2004-06-29 2006-01-12 Hitachi Ltd 多層セラミック基板の製造方法
DE102004031878B3 (de) * 2004-07-01 2005-10-06 Epcos Ag Elektrisches Mehrschichtbauelement mit zuverlässigem Lötkontakt
JP2006073593A (ja) * 2004-08-31 2006-03-16 Toshiba Corp 配線基板とそれを用いた半導体装置
US20080136041A1 (en) * 2006-01-24 2008-06-12 Tessera Interconnect Materials, Inc. Structure and method of making interconnect element having metal traces embedded in surface of dielectric
JP4600065B2 (ja) 2005-02-03 2010-12-15 富士電機システムズ株式会社 半導体装置及びその製造方法
US7387758B2 (en) * 2005-02-16 2008-06-17 Siemens Power Generation, Inc. Tabbed ceramic article for improved interlaminar strength
JP4683269B2 (ja) * 2005-03-23 2011-05-18 Tdk株式会社 多層セラミック基板の製造方法
TWI311451B (en) * 2005-11-30 2009-06-21 Murata Manufacturing Co Ceramic substrate, electronic device, and manufacturing method of ceramic substrate
US7648847B2 (en) * 2006-06-26 2010-01-19 Hamilton Sundstrand Corporation In-situ monitoring and method to determine accumulated printed wiring board thermal and/or vibration stress fatigue using a mirrored monitor chip and continuity circuit
US7573115B2 (en) * 2006-11-13 2009-08-11 International Business Machines Corporation Structure and method for enhancing resistance to fracture of bonding pads
JP2009032992A (ja) * 2007-07-27 2009-02-12 Kuroda Techno Co Ltd 多層回路基板
US8242593B2 (en) 2008-01-27 2012-08-14 International Business Machines Corporation Clustered stacked vias for reliable electronic substrates
TWI434640B (zh) * 2008-01-30 2014-04-11 Murata Manufacturing Co Electronic parts and their construction methods
US8186051B2 (en) 2008-03-28 2012-05-29 Intel Corporation Method for fabricating package substrate and die spacer layers having a ceramic backbone
JP2010045134A (ja) * 2008-08-11 2010-02-25 Shinko Electric Ind Co Ltd 多層配線基板、半導体パッケージ及び製造方法
JP5278371B2 (ja) * 2010-05-17 2013-09-04 富士電機株式会社 半導体装置の製造方法
US8759691B2 (en) * 2010-07-09 2014-06-24 Ibiden Co., Ltd. Wiring board and method for manufacturing the same
KR101153492B1 (ko) * 2010-08-24 2012-06-11 삼성전기주식회사 프로브 카드용 세라믹 기판 제조 방법 및 프로브 카드용 세라믹 기판
JP5693940B2 (ja) * 2010-12-13 2015-04-01 株式会社トクヤマ セラミックスビア基板、メタライズドセラミックスビア基板、これらの製造方法
KR20130077477A (ko) * 2011-12-29 2013-07-09 삼성전자주식회사 파워 반도체 소자 및 그 제조 방법
JP5686225B2 (ja) 2012-07-31 2015-03-18 株式会社村田製作所 積層基板
US20140097002A1 (en) 2012-10-05 2014-04-10 Tyco Electronics Amp Gmbh Electrical components and methods and systems of manufacturing electrical components
US9758858B2 (en) 2012-10-05 2017-09-12 Tyco Electronics Corporation Methods of manufacturing a coated structure on a substrate
JP6142831B2 (ja) * 2014-03-27 2017-06-07 ソニー株式会社 実装用基板及びその製造方法、並びに、部品実装方法
US10291231B2 (en) 2016-07-20 2019-05-14 Microsoft Technology Licensing, Llc Superconducting device with dummy elements
JP2018045212A (ja) 2016-09-16 2018-03-22 株式会社フジクラ 撮像モジュール及びその製造方法
EP3322267A1 (en) * 2016-11-10 2018-05-16 AT & S Austria Technologie & Systemtechnik Aktiengesellschaft Component carrier with adhesion promoting shape of wiring structure
CN114747301B (zh) * 2019-11-14 2024-06-04 株式会社村田制作所 电路基板以及电路基板的制造方法
JP7449076B2 (ja) * 2019-11-26 2024-03-13 Ngkエレクトロデバイス株式会社 セラミック配線基板の製造方法

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4070518A (en) * 1976-10-15 1978-01-24 E. I. Du Pont De Nemours And Company Copper metallizations
JPH05116985A (ja) * 1991-05-22 1993-05-14 Ngk Spark Plug Co Ltd セラミツク基板
US5293504A (en) * 1992-09-23 1994-03-08 International Business Machines Corporation Multilayer ceramic substrate with capped vias
JP2783751B2 (ja) 1993-12-21 1998-08-06 富士通株式会社 多層セラミック基板の製造方法
US5552232A (en) * 1994-12-21 1996-09-03 International Business Machines Corporation Aluminum nitride body having graded metallurgy
US6136419A (en) * 1999-05-26 2000-10-24 International Business Machines Corporation Ceramic substrate having a sealed layer

Also Published As

Publication number Publication date
SG93244A1 (en) 2002-12-17
JP2001068857A (ja) 2001-03-16
CN1281331A (zh) 2001-01-24
CN1181716C (zh) 2004-12-22
US6312791B1 (en) 2001-11-06
US6187418B1 (en) 2001-02-13

Similar Documents

Publication Publication Date Title
JP3401767B2 (ja) 多層セラミック基板およびその製造方法
US6594891B1 (en) Process for forming multi-layer electronic structures
US6262477B1 (en) Ball grid array electronic package
CN100568489C (zh) 电路模块及其制造方法
EP2172089B1 (en) Method for manufacturing a multilayer wiring element having pin interface
JP3294235B2 (ja) 封止層を有するセラミック基板
EP0526133A2 (en) Polyimide multilayer wiring substrate and method for manufacturing the same
JP2004356618A (ja) 中継基板、半導体素子付き中継基板、中継基板付き基板、半導体素子と中継基板と基板とからなる構造体、中継基板の製造方法
JPH1065034A (ja) 電子部品用配線基板及び電子部品パッケージ
US20010018231A1 (en) Bumpless flip chip assembly with strips and via-fill
KR100925314B1 (ko) 단일 비아 고정 패드를 구비한 다층 세라믹 기판
US7656677B2 (en) Multilayer electronic component and structure for mounting multilayer electronic component
JP4509550B2 (ja) 中継基板、半導体素子付き中継基板、中継基板付き基板、半導体素子と中継基板と基板とからなる構造体
US6596620B2 (en) BGA substrate via structure
US8546186B2 (en) Planar interconnect structure for hybrid circuits
JP3378171B2 (ja) 半導体パッケージの製造方法
US5669136A (en) Method of making high input/output density MLC flat pack
JP4718890B2 (ja) 多層配線基板及びその製造方法、多層配線基板構造体
US6407927B1 (en) Method and structure to increase reliability of input/output connections in electrical devices
JP2006310543A (ja) 配線基板及びその製造方法、半導体回路素子付き配線基板
JP3470787B2 (ja) 半導体素子用複合パッケージの製造方法
JP2005011908A (ja) 中継基板、半導体素子付き中継基板、中継基板付き基板、半導体素子と中継基板と基板とからなる構造体
JP2004356619A (ja) 中継基板、半導体素子付き中継基板、中継基板付き基板、半導体素子と中継基板と基板とからなる構造体
TW498024B (en) Multilayer ceramic substrate with anchored pad
JP3441340B2 (ja) 半導体装置の製造方法

Legal Events

Date Code Title Description
FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080229

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090228

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100228

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110228

Year of fee payment: 8

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110228

Year of fee payment: 8

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120229

Year of fee payment: 9

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120229

Year of fee payment: 9

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130228

Year of fee payment: 10

S802 Written request for registration of partial abandonment of right

Free format text: JAPANESE INTERMEDIATE CODE: R311802

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130228

Year of fee payment: 10

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20140228

Year of fee payment: 11

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees