JP3358990B2 - チップ型抵抗器の製造方法 - Google Patents

チップ型抵抗器の製造方法

Info

Publication number
JP3358990B2
JP3358990B2 JP17478398A JP17478398A JP3358990B2 JP 3358990 B2 JP3358990 B2 JP 3358990B2 JP 17478398 A JP17478398 A JP 17478398A JP 17478398 A JP17478398 A JP 17478398A JP 3358990 B2 JP3358990 B2 JP 3358990B2
Authority
JP
Japan
Prior art keywords
ceramic material
screen printing
film
electrode film
material plate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP17478398A
Other languages
English (en)
Other versions
JPH10321421A (ja
Inventor
尊文 勝野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Rohm Co Ltd
Original Assignee
Rohm Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Rohm Co Ltd filed Critical Rohm Co Ltd
Priority to JP17478398A priority Critical patent/JP3358990B2/ja
Publication of JPH10321421A publication Critical patent/JPH10321421A/ja
Application granted granted Critical
Publication of JP3358990B2 publication Critical patent/JP3358990B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Landscapes

  • Apparatuses And Processes For Manufacturing Resistors (AREA)

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、図1〜図3に示すよう
に、チップ型絶縁基板2の上面に、厚膜状の抵抗膜4
を、左右両側に形成した上面電極膜3の間を接続するよ
うに形成する一方、前記絶縁基板2の左右両端面に、前
記上面電極膜3に接続する側面電極5を形成し、更に、
前記絶縁基板2の上面に、ガラス等の耐熱性の保護膜6
を、前記抵抗膜3を覆うように形成して成るチップ型抵
抗器1を製造する方法に関するものである。
【0002】
【従来の技術】従来、このチップ型抵抗器1の製造に
は、例えば、特開平4−241401号公報等に記載さ
れ、且つ、図10〜図13に示すような方法が採用され
ている。
【0003】すなわち、先ず、図10に示すように、チ
ップ型絶縁基板2の多数個を、縦方向及び横方向に並べ
て連接した状態のセラミック素材板A′を、当該セラミ
ック素材体A′を各絶縁基板1ごとにブレイクするため
の溝型の縦筋目線B′及び横筋目線C′とを予め刻設し
た状態に焼成することによって製作し、このセラミック
素材板A′の上面に、図11に示すように、前記両上面
電極膜3を、材料ペーストのスクリーン印刷及びこのス
クリーン印刷後における焼成によって、前記各縦筋目線
B′に沿って延びるように形成し、次いで、前記セラミ
ック素材板A′における各絶縁基板2の上面の各々に、
図12に示すように、前記抵抗膜4を、ペーストのスク
リーン印刷及びこのスクリーン印刷後における焼成によ
って形成する。
【0004】そして、前記各抵抗膜4を、その抵抗値が
所定値になるようにトリミング調整したのち、各絶縁基
板2の上面に、保護膜6を、同じくスクリーン印刷によ
って形成し、次いで、前記セラミック素材板A′を、図
13に示すように、各縦筋目線Bに沿ってブレイク(割
る)することによって、複数本の棒状セラミック素材片
1 ′,A2 ′・・・ごとに分割し、この各棒状セラミ
ック素材片A1 ′,A2 ′・・・の長手側面に、前記側
面電極膜5を、材料ペーストの塗布及びこの塗布後にお
ける焼成によって形成したのち、各筋目線C′に沿って
ブレイク(割る)することにより、各絶縁基板2ごとに
分割するようにしている。
【0005】
【発明が解決しようとする課題】しかし、この従来の製
造方法は、セラミック素材A′を、各縦筋目線B′及び
各横筋目線B′に沿ってブレイク(割る)ことによっ
て、各絶縁基板2ごとに分割するものであるから、前記
セラミック素材体A′を各絶縁基板2ごとに分割するこ
とが可成り早い速度にてできると言う利点を有するが、
その反面、以下に述べるように、.セラミック素材板
A′を、これに予め刻設した各縦筋目線B′及び各横筋
目線C′に沿って各絶縁基板2ごとにブレイクする場合
において、各絶縁基板2の表面に対して、図2及び図3
に二点鎖線で示すように傾斜状にブレイク(割れる)す
ることが多発することにより、絶縁基板2における幅寸
法W及び長さ寸法Lの寸法精度が大幅に低下するばかり
か、場合によっては、前記幅寸法W及び長さ寸法Lが規
格寸法を外れて不良品になる。
【0006】これに加えて、前記したように各縦筋目線
B′及び各横筋目線C′に沿って各絶縁基板2ごとにブ
レイクするときに、このブレイク前に形成されている上
面電極膜3及び側面電極膜5も、同時にブレイクするも
のであることにより、この上面電極膜3及び側面電極膜
5に剥離欠損が発生することが多発するから、不良品の
発生率が高い。.セラミック素材A′は、グリーンシ
ートの状態で、これに各縦筋目線B′及び各横筋目線
C′を刻設したのち焼成することで製作されることによ
り、各縦筋目線B′の相互間における間隔寸法、及び各
横筋目線C′の相互間における間隔寸法には、グリーン
シートを焼成するときにおける収縮によって大きいバラ
ツキが発生する。
【0007】そこで、焼成後におけるセラミック素材板
A′の上面に、上面電極膜3、抵抗膜4及び保護膜6の
各々をスクリーン印刷によって形成するに際しては、そ
の各々のスクリーン印刷に使用するスクリーンマスクに
おける抜き孔を前記各縦筋目線B′の相互間における間
隔寸法のバラツキ及び各横筋目線C′の相互間における
間隔寸法のバラツキに合わせて成るスクリーンマスクを
多数枚用意して、この多数枚のスクリーンマスクを、前
記の両バラツキに応じて使い分けするようにしなければ
ならないから、前記スクリーンマスクの製作に多大の費
用が嵩むばかりか、スクリーン印刷に多大の手数を必要
して、コストが大幅にアップする。と言う問題があっ
た。
【0008】本発明は、これらの問題を招来することが
なく、低コストで製造できるようにした製造方法を提供
することを技術的課題とするものである。
【0009】
【課題を解決するための手段】この技術的課題を達成す
るため本発明は、「チップ型絶縁基板の多数個を縦方向
及び横方向に並べて一体的に連接し且つ周囲に位置認識
マークを備えた余白部を一体的に連接して成るセラミッ
ク素材板の上面に、上面電極膜を、材料ペーストのスク
リーン印刷及びこのスクリーン印刷後の焼成によって、
各絶縁基板の相互間における縦方向の各境界線に沿って
延びるように形成すると共に、前記余白部のうち前記各
絶縁基板における縦方向列の左右両端より外側の部分に
基準マークを、前記位置認識マークを基準として材料ペ
ーストのスクリーン印刷にて形成し、次いで、セラミッ
ク素材板の上面における各絶縁基板の箇所に、抵抗膜
を、材料ペーストのスクリーン印刷及びこのスクリーン
印刷後の焼成によって当該抵抗膜の両端前記上面電極
膜に電気的に導通するように形成すると共に、この各抵
抗膜に対する保護膜をスクリーン印刷にて形成し、次い
で、前記セラミック素材板を、一本の回転軸に複数個設
けたディスクカッターにて、前記位置認識マークを基準
として、各絶縁基板の相互間における縦方向の各境界線
のうち複数本の境界線に沿って同時に切断することを前
記各境界線の全てについて行うことによって、複数本の
棒状セラミック素材片に分断し、そして、この各棒状セ
ラミック素材片の長手側面に、側面電極膜を、材料ペー
ストの塗布及びこの塗布後における焼成によって当該側
面電極膜が前記上面電極膜に電気的に導通するように形
成したのち、各棒状セラミック素材片を、一本の回転軸
に複数個設けた各ディスクカッターにて、その両端にお
ける余白部の基準マークを基準として、各絶縁基板の相
互間における横方向の各境界線のうち複数本の境界線に
沿って同時に切断することを前記各境界線の全てについ
て行うことによって、各絶縁基板ごとに分断する。」こ
とにした。
【0010】
【作 用】本発明は、セラミック素材板を、当該セラ
ミック素材板に前記従来のように予め溝型の縦筋目線及
び横筋目線を刻設し、この各縦筋目線及び横筋目線に沿
ってブレイク(割る)ことなく、各絶縁基板の相互間に
おける各縦方向の境界線及び各横方向の境界線の部分
を、ディスクカッターにて切断することによって、各絶
縁基板ごとに分割するものであることにより、上面電極
膜、抵抗膜及び保護膜をスクリーンマスクを使用して各
々スクリーン印刷にする際しては、前記セラミック素材
板を、グリーンシートから焼成するときにおける収縮に
かかわらず、複数枚のセラミック素材について同じスク
リーンマスクを使用することができるから、各々のスク
リーン印刷ごとに多数枚のスクリーンマスクを用意する
こと、及び、この多数枚のスクリーンマスクを使い分け
ることを省略できるのである。
【0011】しかも、セラミック素材板を、ディスクカ
ッターによる切断にて、各絶縁基板ごとに分断すること
により、各絶縁基板の側面が、前記従来のブレイクによ
る分割のように傾斜状になることがないから、各絶縁基
板における幅寸法及び長さ寸法の寸法精度を向上できる
と共に、分割に際して、幅寸法及び長さ寸法が規格寸法
を外れた不良品が発生することを確実に低減できるので
ある。
【0012】更に、本発明は、前記セラミック素材板を
複数本の棒状セラミック素材片ごとに切断すること、及
び前記各棒状セラミック素材片を複数個の絶縁基板ごと
に切断することの各々を、一本の回転軸に設けた複数個
のディスクカッターにて行うことにより、前記セラミッ
ク素材板を多数個の絶縁基板ごとに切断することに要す
るコストの低減を図るのである。
【0013】
【発明の効果】従って、本発明によると、チップ型抵抗
器の製造に際して、上面電極膜、抵抗膜及び保護膜を形
成することに、複数種類のスクリーンマスクの各々を多
数枚用意すること、これら多数枚のスクリーンマスクを
使い分けることを必要としないことに加えて、不良品の
発生を確実に回避できることにより、製造コストを大幅
に低減できると共に、各チップ型抵抗器における寸法精
度を向上できる効果を有し、しかも、小型のチップ型抵
抗器の製造に際しても前記の効果を発揮することができ
るのである。
【0014】
【0015】これに加えて、本発明は、位置認識マーク
と基準マークとの相対関係位置を正しく設定したうえ
で、セラミック素材板を縦方向の各境界線のうち複数本
の境界線に沿って棒状セラミック素材片ごとに切断する
ことを、前記余白部に設けた位置認識マークを基準とし
て行うことに加えて、前記各棒状セラミック素材片を横
方向の各境界線のうち複数本の境界線に沿って絶縁基板
ごとに切断することを、前記余白部に前記上面電極膜を
形成するとき同時に設けた基準マークを基準として行う
ことにより、棒状セラミック素材片ごとへの切断及び絶
縁基板ごとへの切断に際して、切断線が、前記縦方向の
各境界線及び横方向の各境界線に対して相対的にずれる
ことを僅少にとどめることができるから、寸法精度をよ
り向上できると共に、切断線のずれによる不良品の発生
を確実に低減できる。
【0016】
【実施例】以下、本発明の実施例を、図4〜図9の図面
について説明する。
【0017】先ず、図4に示すように、チップ型絶縁基
板2の多数個を縦方向及び横方向に並べて連接すると共
に、その周囲に余白部を連接して成るセラミック素材板
Aを、グリーンシートを焼成することによって製作し、
このセラミック素材体Aの略中央部における左右両側
に、位置認識用のスルーホールa′を、一対ずつ穿設す
ると共に、一つの隅角部に、当該セラミック素材板Aの
表裏認識用の切欠部a″を設ける。
【0018】このセラミック素材板Aの上面に、上面電
極膜3を、図5に示すように、適宜の材料ペーストをス
クリーンマスクを使用してのスクリーン印刷、及びこの
スクリーン印刷後における焼成によって、当該上面電極
膜3が、前記各絶縁基板1の相互間における縦方向の各
境界線Bに沿って延びるように形成する。
【0019】この上面電極膜3のスクリーン印刷に際し
ては、そのスクリーン印刷に使用するスクリーンマスク
を、セラミック素材板Aに対して、当該セラミック素材
板Aにおける各スルーホールa′をカメラ等で認識しな
がら位置合わせすると共に、各絶縁基板2の横方向列に
おける余白部に、基準マークDを各々形成する。なお、
この基準マークDは、前記上面電極膜3のスクリーン印
刷とは、別のスクリーン印刷によって形成するようにし
ても良い。
【0020】次いで、前記セラミック素材板Aの上面に
おける各絶縁基板2の箇所に、抵抗膜4を、図6に示す
ように、適宜の材料ペーストをスクリーンマスクを使用
してのスクリーン印刷、及びこのスクリーン印刷後にお
ける焼成によって、当該抵抗膜4の両端が前記上面電極
膜3に重なって電気的に導通するように形成する。
【0021】更に、前記各抵抗膜4を、その抵抗値が所
定の抵抗値になるようにトリミング調整したのち、前記
セラミック素材板Aの上面における各絶縁基板2の箇所
に、前記抵抗膜4を覆う保護膜6を、スクリーンマスク
を使用してのスクリーン印刷によって形成する。
【0022】一方、図7に示すように、X方向とY方向
との二つの方向に往復動するXYテーブル10の上面
に、回転テーブル11を設け、この回転テーブル11の
上方に、回転軸12を、前記回転テーブル11の上面に
沿って横方向に往復動するように配設し、この回転軸1
2に、複数枚(三枚)のディスクカッター13を、前記
縦方向の各境界線Bのうち例えば一つ飛ばしの等の複数
本の境界線Bの間隔で設ける。
【0023】そして、前記図5及び図6に示すように、
上面電極膜3、抵抗膜4及び保護膜6を形成した後のセ
ラミック素材板Aを、前記回転テーブル11の上面に載
置したのち、このセラミック素材板Aにおける各スルー
ホールa′をカメラ等で認識しながら、回転テーブル1
1を回転操作したり、或いは、XYテーブル10を移動
操作することによって、各絶縁基板2の相互間における
縦方向の各境界線Bが、前記回転軸12の軸線と直角に
なり、且つ、回転軸12における各ディスクカッター1
3が、前記縦方向の各境界線Bに一致するように位置合
わせする。
【0024】このように位置合わせしたのち、前記回転
軸12を回転しながら横方向に移動することで、セラミ
ック素材板Aのうち縦方向の各境界線Bの部分を、当該
境界線Bに沿って各ディスクカッター13にて、前記上
面電極膜3と一緒に切断することを、当該セラミック素
材板Aにおける各境界線Bについて繰り返して行うこと
により、セラミック素材板Aを、図8に示すように、複
数本の棒状セラミック素材片A1 ,A2 ,A3 ・・・ご
とに分断する。
【0025】次いで、この各棒状セラミック素材片
1 ,A2 ,A3 ・・・の長手側面に、側面電極膜5
を、適宜材料ヘーストの塗布と、その後における焼成と
によって、当該側面電極膜5が前記上面電極膜3に接触
して電気的に導通するように形成する。
【0026】一方、図9に示すように、X方向とY方向
との二つの方向に往復動するXYテーブル14の上面
に、回転テーブル15を設け、この回転テーブル15の
上方に、回転軸16を、前記回転テーブル15の上面に
沿って横方向に往復動するように配設し、この回転軸1
6に、複数枚(二枚)のディスクカッター17を、前記
前記各絶縁基板1の相互間における横方向の各境界線C
のうち例えば少なくとも一つ飛ばしの等の複数本の各境
界線Cの間隔で設ける。
【0027】そして、前記各棒状セラミック素材片
1 ,A2 ,A3 ・・・のうち一本又は複数本を、前記
回転テーブル15の上面に載置したのち、この各棒状セ
ラミック素材片A1 ,A2 ,A3 ・・・のうち第1棒状
セラミック素材片A1 における各基準マークDをカメラ
等で認識しながら、回転テーブル15を回転操作した
り、或いは、XYテーブル14を移動操作することによ
って、前記第1棒状セラミック素材片A1 における各絶
縁基板2の相互間における横方向の各境界線Cが、前記
回転軸16の軸線と直角になり、且つ、回転軸16にお
ける各ディスクカッター17が、前記横方向の各境界線
Cに一致するように位置合わせする。
【0028】このように位置合わせしたのち、前記回転
軸16を回転しながら横方向に移動することで、前記第
1棒状セラミック素材片A1 のうち横方向の各境界線C
の部分を、当該境界線Cに沿って各ディスクカッター1
3にて、前記上面電極膜3を横切るように切断すること
を、当該第1棒状セラミック素材片A1 における各境界
線Cについて繰り返して行うことにより、第1棒状セラ
ミック素材片A1 を、複数個の絶縁基板2ごとに分断す
る。
【0029】この分割を、前記第1棒状セラミック素材
片A1 以外の各棒状セラミック素材片A2 ,A3 ・・・
についても同様にして行うことにより、図1〜図3に示
すようなチップ型抵抗器1を製造できるのである。
【図面の簡単な説明】
【図1】チップ型抵抗器の一部切欠き斜視図である。
【図2】図1のII−II視断面図である。
【図3】図1のIII −III 視断面図である。
【図4】本発明の方法に使用するセラミック素材板の斜
視図である。
【図5】図4におけるセラミック素材板の上面に上面電
極膜を形成したときの斜視図である。
【図6】図4におけるセラミック素材板の上面に抵抗膜
を形成したときの斜視図である。
【図7】前記セラミック素材板を複数本の棒状セラミッ
ク素材片に切断するときの状態を示す斜視図である。
【図8】前記棒状セラミック素材片を示す斜視図であ
る。
【図9】前記棒状セラミック素材片を複数個の絶縁基板
に切断するときの状態を示す斜視図である。
【図10】従来の方法に使用するセラミック素材板の斜
視図である。
【図11】図10におけるセラミック素材板の上面に上
面電極膜を形成したときの斜視図である。
【図12】図10におけるセラミック素材板の上面に抵
抗膜を形成したときの斜視図である。
【図13】前記セラミック素材板を複数本の棒状セラミ
ック素材片にブレイクしたときの斜視図である。
【符号の説明】
1 チップ型抵抗器 2 絶縁基板 3 上面電極膜 4 抵抗膜 5 側面電極膜 6 保護膜 A セラミック素材板 B 縦方向の境界線 C 横方向の境界線 A1 ,A2 ,A3 棒状セラミック素材片 10,14 XYテーブル 11,15 回転テーブル 12,16 回転軸 13,17 ダイシングカッター

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項1】チップ型絶縁基板の多数個を縦方向及び横
    方向に並べて一体的に連接し且つ周囲に位置認識マーク
    を備えた余白部を一体的に連接して成るセラミック素材
    板の上面に、上面電極膜を、材料ペーストのスクリーン
    印刷及びこのスクリーン印刷後の焼成によって、各絶縁
    基板の相互間における縦方向の各境界線に沿って延びる
    ように形成すると共に、前記余白部のうち前記各絶縁基
    板における縦方向列の左右両端より外側の部分に基準マ
    ークを、前記位置認識マークを基準として材料ペースト
    のスクリーン印刷にて形成し、次いで、セラミック素材
    板の上面における各絶縁基板の箇所に、抵抗膜を、材料
    ペーストのスクリーン印刷及びこのスクリーン印刷後の
    焼成によって当該抵抗膜の両端前記上面電極膜に電気
    的に導通するように形成すると共に、この各抵抗膜に対
    する保護膜をスクリーン印刷にて形成し、次いで、前記
    セラミック素材板を、一本の回転軸に複数個設けたディ
    スクカッターにて、前記位置認識マークを基準として、
    各絶縁基板の相互間における縦方向の各境界線のうち複
    数本の境界線に沿って同時に切断することを前記各境界
    線の全てについて行うことによって、複数本の棒状セラ
    ミック素材片に分断し、そして、この各棒状セラミック
    素材片の長手側面に、側面電極膜を、材料ペーストの塗
    布及びこの塗布後における焼成によって当該側面電極膜
    が前記上面電極膜に電気的に導通するように形成したの
    ち、各棒状セラミック素材片を、一本の回転軸に複数個
    設けた各ディスクカッターにて、その両端における余白
    部の基準マークを基準として、各絶縁基板の相互間にお
    ける横方向の各境界線のうち複数本の境界線に沿って同
    時に切断することを前記各境界線の全てについて行うこ
    とによって、各絶縁基板ごとに分断することを特徴とす
    るチップ型抵抗器の製造方法。
JP17478398A 1998-06-22 1998-06-22 チップ型抵抗器の製造方法 Expired - Fee Related JP3358990B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP17478398A JP3358990B2 (ja) 1998-06-22 1998-06-22 チップ型抵抗器の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP17478398A JP3358990B2 (ja) 1998-06-22 1998-06-22 チップ型抵抗器の製造方法

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP02439493A Division JP3155851B2 (ja) 1993-02-12 1993-02-12 チップ型抵抗器の製造方法

Publications (2)

Publication Number Publication Date
JPH10321421A JPH10321421A (ja) 1998-12-04
JP3358990B2 true JP3358990B2 (ja) 2002-12-24

Family

ID=15984602

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17478398A Expired - Fee Related JP3358990B2 (ja) 1998-06-22 1998-06-22 チップ型抵抗器の製造方法

Country Status (1)

Country Link
JP (1) JP3358990B2 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2020001982A1 (de) * 2018-06-25 2020-01-02 Vishay Electronic Gmbh Verfahren zur herstellung einer vielzahl von widerstandsbaueinheiten über ein keramiksubstrat

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3958532B2 (ja) 2001-04-16 2007-08-15 ローム株式会社 チップ抵抗器の製造方法
JP2003124010A (ja) * 2001-10-18 2003-04-25 Rohm Co Ltd チップ型電子部品の製造方法、およびチップ型電子部品
DE102018203033A1 (de) * 2018-03-01 2019-09-05 Robert Bosch Gmbh Verfahren und Vorrichtung zum Fließfertigen von Elektroden für eine Batterie

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2020001982A1 (de) * 2018-06-25 2020-01-02 Vishay Electronic Gmbh Verfahren zur herstellung einer vielzahl von widerstandsbaueinheiten über ein keramiksubstrat
US11302462B2 (en) 2018-06-25 2022-04-12 Vishay Electronic Gmbh Method for producing a plurality of resistance modular units over a ceramic substrate

Also Published As

Publication number Publication date
JPH10321421A (ja) 1998-12-04

Similar Documents

Publication Publication Date Title
JP4078042B2 (ja) 複数の素子を有するチップ型電子部品の製造方法
JP3846312B2 (ja) 多連チップ抵抗器の製造方法
JP3358990B2 (ja) チップ型抵抗器の製造方法
US4757298A (en) Ceramic substrates for tip electronic parts
JP3155851B2 (ja) チップ型抵抗器の製造方法
JP4227821B2 (ja) チップ抵抗器の製造方法
JP2017152576A (ja) チップ抵抗器の製造方法
JPH0897018A (ja) チップ型抵抗器の製造方法
JPH11111513A (ja) チップ抵抗器の製造方法
TWI817476B (zh) 晶片電阻器及晶片電阻器之製造方法
JP3846311B2 (ja) 多連チップ抵抗器の製造方法
WO1997002579A1 (fr) Dispositif de puce a plusieurs elements et son procede de fabrication
JPH0770365B2 (ja) チップ型電子部品
JPH06105755B2 (ja) 電子部品の製造方法
JP2578398Y2 (ja) チップ状電子部品用基板
JP2002208502A (ja) チップ抵抗器及びその製造方法
JPH11307304A (ja) チップ抵抗器及びその製造方法
JPH07230905A (ja) チップ抵抗器の製造方法
JPH0528725Y2 (ja)
JP3812442B2 (ja) 多連チップ抵抗器の製造方法
JPS62176101A (ja) セラミツク基板
JP2004253636A (ja) チップ抵抗器の製造方法
JPH09232101A (ja) チップ型電子部品の製造方法
JP2008028422A (ja) 複数の素子を有するチップ型電子部品の製造方法
JPH09115706A (ja) チップ型抵抗器の製造方法

Legal Events

Date Code Title Description
FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20111011

Year of fee payment: 9

LAPS Cancellation because of no payment of annual fees