JP3288056B2 - 画像記憶装置 - Google Patents
画像記憶装置Info
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- JP3288056B2 JP3288056B2 JP09448791A JP9448791A JP3288056B2 JP 3288056 B2 JP3288056 B2 JP 3288056B2 JP 09448791 A JP09448791 A JP 09448791A JP 9448791 A JP9448791 A JP 9448791A JP 3288056 B2 JP3288056 B2 JP 3288056B2
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- JP
- Japan
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- memory
- address
- moving image
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- writing
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Description
【０００１】
【産業上の利用分野】本発明は、画像記憶装置に関す
る。
る。
【０００２】
【従来の技術】記憶領域の終端アドレスを当該記憶領域
の先頭アドレスにつなぐことにより、記憶領域に循環的
にデータを記憶するメモリ又はそのアドレス制御は、所
謂リング・メモリとして周知であり、このようなリング
・メモリに画像信号を記憶する画像記憶装置は、既に知
られている。
の先頭アドレスにつなぐことにより、記憶領域に循環的
にデータを記憶するメモリ又はそのアドレス制御は、所
謂リング・メモリとして周知であり、このようなリング
・メモリに画像信号を記憶する画像記憶装置は、既に知
られている。
【０００３】
【発明が解決しようとする課題】リング・メモリでは、
そのアドレス制御上、先に記憶されている情報を、次の
情報の書き込みから保護することはできない。例えば、
動画像を記憶する場合、前に記憶された画像は次の画像
により消失してしまい、時間的に非連続の画像を得るこ
とはできなかった。
そのアドレス制御上、先に記憶されている情報を、次の
情報の書き込みから保護することはできない。例えば、
動画像を記憶する場合、前に記憶された画像は次の画像
により消失してしまい、時間的に非連続の画像を得るこ
とはできなかった。
【０００４】本発明は、このような課題を解決する画像
記憶装置を提示することを目的とする。
記憶装置を提示することを目的とする。
【０００５】
【課題を解決するための手段】本発明に係る画像記憶装
置は、動画像信号を入力する入力手段と、前記入力手段
より入力された動画像信号を記憶するメモリと、前記メ
モリにおける前記動画像信号の書き込みアドレスを循環
的に指定して前記メモリに前記動画像信号を書き込む書
き込み制御手段と、前記書き込み制御手段による前記メ
モリの一部の領域に対する前記動画像信号の書き込みを
禁止する禁止手段とを備え、前記書き込み制御手段は、
前記書き込みアドレスが前記禁止手段により書き込みが
禁止された前記一部の領域に到達した場合、前記一部の
領域のアドレスをスキップし、前記一部の領域のアドレ
スの前後のアドレスにわたって連続して前記動画像信号
を書き込むことを特徴とする。
置は、動画像信号を入力する入力手段と、前記入力手段
より入力された動画像信号を記憶するメモリと、前記メ
モリにおける前記動画像信号の書き込みアドレスを循環
的に指定して前記メモリに前記動画像信号を書き込む書
き込み制御手段と、前記書き込み制御手段による前記メ
モリの一部の領域に対する前記動画像信号の書き込みを
禁止する禁止手段とを備え、前記書き込み制御手段は、
前記書き込みアドレスが前記禁止手段により書き込みが
禁止された前記一部の領域に到達した場合、前記一部の
領域のアドレスをスキップし、前記一部の領域のアドレ
スの前後のアドレスにわたって連続して前記動画像信号
を書き込むことを特徴とする。
【０００６】
【作用】上記手段により、上記メモリに先に記憶された
画像を保存しつつ、他の記憶領域に後続の画像を記憶さ
せることができる。これにより、動画像から、非連続の
画像を取り出せる。
画像を保存しつつ、他の記憶領域に後続の画像を記憶さ
せることができる。これにより、動画像から、非連続の
画像を取り出せる。
【０００７】
【実施例】以下、図面を参照して本発明の実施例を説明
する。
する。
【０００８】図１は、ビデオ・カメラの出力処理に適用
した本発明の一実施例の構成ブロック図を示す。１０は
ビデオ・カメラ、１２はビデオ・カメラ１０から出力さ
れるビデオ信号をディジタル化するＡ／Ｄ変換器、１４
はＡ／Ｄ変換器１２から出力されるディジタル・ビデオ
信号を記憶するマルチポート・ランダム・アクセス・メ
モリである。本実施例では、メモリ１４は数秒乃至数十
秒のビデオ信号を記憶できる記憶容量を具備する。
した本発明の一実施例の構成ブロック図を示す。１０は
ビデオ・カメラ、１２はビデオ・カメラ１０から出力さ
れるビデオ信号をディジタル化するＡ／Ｄ変換器、１４
はＡ／Ｄ変換器１２から出力されるディジタル・ビデオ
信号を記憶するマルチポート・ランダム・アクセス・メ
モリである。本実施例では、メモリ１４は数秒乃至数十
秒のビデオ信号を記憶できる記憶容量を具備する。
【０００９】１６はビデオ・カメラ１０から出力される
ビデオ信号に重畳される同期信号に応じて、メモリ１４
の書き込みアドレスを発生する書き込みアドレス・カウ
ンタ、１８はメモリ１４の読み出しアドレスを発生する
読み出しアドレス・カウンタ、２０はメモリ１４から読
み出されたビデオ・データをアナログ信号に変換するＤ
／Ａ変換器、２２は出力端子である。
ビデオ信号に重畳される同期信号に応じて、メモリ１４
の書き込みアドレスを発生する書き込みアドレス・カウ
ンタ、１８はメモリ１４の読み出しアドレスを発生する
読み出しアドレス・カウンタ、２０はメモリ１４から読
み出されたビデオ・データをアナログ信号に変換するＤ
／Ａ変換器、２２は出力端子である。
【００１０】また、２４は、メモリ１４の登録された書
き込み禁止領域に従い、書き込みアドレス・カウンタ１
６及び読み出しアドレス・カウンタ１８を制御するメモ
リ管理回路である。ユーザはメモリ管理回路２４に、メ
モリ１４の書き込み禁止領域、即ち保存すべき任意枚数
の画像を設定登録する。
き込み禁止領域に従い、書き込みアドレス・カウンタ１
６及び読み出しアドレス・カウンタ１８を制御するメモ
リ管理回路である。ユーザはメモリ管理回路２４に、メ
モリ１４の書き込み禁止領域、即ち保存すべき任意枚数
の画像を設定登録する。
【００１１】次に、動作を説明する。ビデオ・カメラ１
０から出力されるビデオ信号はＡ／Ｄ変換器１２により
ディジタル化され、書き込みアドレス・カウンタ１６の
示すアドレスに書き込まれる。書き込みアドレス・カウ
ンタ１６のアドレスは、ビデオ信号に重畳される同期信
号によりインクリメントする。書き込みアドレス・カウ
ンタ１６は、メモリ１４の終端アドレスに達した次に
は、メモリ１４の始端アドレスになる。これにより、メ
モリ１４はリング・メモリとして動作する。図２に、メ
モリ１４の書き込みアドレスを模式的に示す。書き込み
位置は角速度ωで回転するベクトルＷとして表わされて
いる。
０から出力されるビデオ信号はＡ／Ｄ変換器１２により
ディジタル化され、書き込みアドレス・カウンタ１６の
示すアドレスに書き込まれる。書き込みアドレス・カウ
ンタ１６のアドレスは、ビデオ信号に重畳される同期信
号によりインクリメントする。書き込みアドレス・カウ
ンタ１６は、メモリ１４の終端アドレスに達した次に
は、メモリ１４の始端アドレスになる。これにより、メ
モリ１４はリング・メモリとして動作する。図２に、メ
モリ１４の書き込みアドレスを模式的に示す。書き込み
位置は角速度ωで回転するベクトルＷとして表わされて
いる。
【００１２】撮影中に保存したいシーンがあり、これが
メモリ１４に書き込まれたら、直ちにメモリ管理回路２
４に書き込み禁止を指示する。この際、メモリ１４の任
意の記憶位置で任意のサイズを登録できる。
メモリ１４に書き込まれたら、直ちにメモリ管理回路２
４に書き込み禁止を指示する。この際、メモリ１４の任
意の記憶位置で任意のサイズを登録できる。
【００１３】登録完了後、撮影を再開する。書き込みア
ドレス・カウンタ１６は、メモリ管理回路２４に登録さ
れた記憶領域については、書き込みアドレスをスキップ
する。例えば、図３に示すａ−ｂの範囲を書き込み禁止
したとすると、書き込みベクトルＷは、ａ点に到達した
ら、ａ−ｂ間の領域をスキップして、次にｂ点にデータ
を書き込む。これにより、ａ−ｂ間の領域に記憶される
ビデオ・データが保存される。
ドレス・カウンタ１６は、メモリ管理回路２４に登録さ
れた記憶領域については、書き込みアドレスをスキップ
する。例えば、図３に示すａ−ｂの範囲を書き込み禁止
したとすると、書き込みベクトルＷは、ａ点に到達した
ら、ａ−ｂ間の領域をスキップして、次にｂ点にデータ
を書き込む。これにより、ａ−ｂ間の領域に記憶される
ビデオ・データが保存される。
【００１４】次に、ｎ倍速ビデオ信号の処理に適用した
別の実施例を説明する。図４はその構成ブロック図を示
す。図１と同じ構成要素には同じ符号を付してある。３
０は標準テレビジョン信号のｎ倍のフィールド周波数で
の撮影が可能なビデオ・カメラであり、その出力ビデオ
信号は、Ａ／Ｄ変換器１２、書き込みアドレス・カウン
タ１６及びメモリ管理回路２４により、図１の場合と同
様に、メモリ１４に書き込まれる。スロー再生制御回路
３２は、読み出しアドレス・カウンタ３４を制御して、
任意のスピードでメモリ１４からデータを読み出し、読
み出されたデータを、Ｄ／Ａ変換及び方式変換回路３６
により標準テレビジョン信号に変換する。これにより、
任意のスロー・ビデオ信号が出力端子３８から出力され
る。
別の実施例を説明する。図４はその構成ブロック図を示
す。図１と同じ構成要素には同じ符号を付してある。３
０は標準テレビジョン信号のｎ倍のフィールド周波数で
の撮影が可能なビデオ・カメラであり、その出力ビデオ
信号は、Ａ／Ｄ変換器１２、書き込みアドレス・カウン
タ１６及びメモリ管理回路２４により、図１の場合と同
様に、メモリ１４に書き込まれる。スロー再生制御回路
３２は、読み出しアドレス・カウンタ３４を制御して、
任意のスピードでメモリ１４からデータを読み出し、読
み出されたデータを、Ｄ／Ａ変換及び方式変換回路３６
により標準テレビジョン信号に変換する。これにより、
任意のスロー・ビデオ信号が出力端子３８から出力され
る。
【００１５】
【発明の効果】以上の説明から容易に理解できるよう
に、本発明によれば、動画像から非連続な画像を取り出
せる。
に、本発明によれば、動画像から非連続な画像を取り出
せる。
【図１】 本発明の一実施例の構成ブロック図である。
【図２】 メモリ１４の動作説明図である。
【図３】 メモリ１４に書き込み禁止領域を設けた場合
の動作説明図である。
の動作説明図である。
【図４】 別の実施例の構成ブロック図である。
１０：ビデオ・カメラ １２：Ａ／Ｄ変換器 １４：マ
ルチポート・ランダム・アクセス・メモリ １６：書き
込みアドレス・カウンタ １８：読み出しアドレス・カ
ウンタ ２０：Ｄ／Ａ変換器 ２２：出力端子 ３０：
ビデオ・カメラ３２：スロー再生制御回路 ３４：読み
出しアドレス・カウンタ ３６：Ｄ／Ａ及び方式変換回
路 ３８：出力端子
ルチポート・ランダム・アクセス・メモリ １６：書き
込みアドレス・カウンタ １８：読み出しアドレス・カ
ウンタ ２０：Ｄ／Ａ変換器 ２２：出力端子 ３０：
ビデオ・カメラ３２：スロー再生制御回路 ３４：読み
出しアドレス・カウンタ ３６：Ｄ／Ａ及び方式変換回
路 ３８：出力端子
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) H04N 5/907 H04N 5/92 G06F 12/02
Claims (1)
- 【請求項１】 動画像信号を入力する入力手段と、 前記入力手段より入力された動画像信号を記憶するメモ
リと、 前記メモリにおける前記動画像信号の書き込みアドレス
を循環的に指定して前記メモリに前記動画像信号を書き
込む書き込み制御手段と、 前記書き込み制御手段による前記メモリの一部の領域に
対する前記動画像信号の書き込みを禁止する禁止手段と
を備え、 前記書き込み制御手段は、前記書き込みアドレスが前記
禁止手段により書き込みが禁止された前記一部の領域に
到達した場合、前記一部の領域のアドレスをスキップ
し、前記一部の領域のアドレスの前後のアドレスにわた
って連続して前記動画像信号を書き込むことを特徴とす
る画像記憶装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP09448791A JP3288056B2 (ja) | 1991-04-24 | 1991-04-24 | 画像記憶装置 |
| DE69223543T DE69223543T2 (de) | 1991-04-24 | 1992-04-23 | Bildspeichervorrichtung |
| EP92303654A EP0510968B1 (en) | 1991-04-24 | 1992-04-23 | An image memorizing device |
| US08/274,666 US5523799A (en) | 1991-04-24 | 1994-07-13 | Image storing device including an inhibiting function |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP09448791A JP3288056B2 (ja) | 1991-04-24 | 1991-04-24 | 画像記憶装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04324774A JPH04324774A (ja) | 1992-11-13 |
| JP3288056B2 true JP3288056B2 (ja) | 2002-06-04 |
Family
ID=14111652
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP09448791A Expired - Fee Related JP3288056B2 (ja) | 1991-04-24 | 1991-04-24 | 画像記憶装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3288056B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE19628187A1 (de) * | 1996-07-12 | 1998-01-15 | Philips Patentverwaltung | Anordnung zur Aufnahme und Wiedergabe von Videosignalen |
-
1991
- 1991-04-24 JP JP09448791A patent/JP3288056B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04324774A (ja) | 1992-11-13 |
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|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20010515 |
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