JP3225530B2 - Ｃｄ用ディジタルｐｌｌ回路 - Google Patents
Ｃｄ用ディジタルｐｌｌ回路Info
- Publication number
- JP3225530B2 JP3225530B2 JP07411191A JP7411191A JP3225530B2 JP 3225530 B2 JP3225530 B2 JP 3225530B2 JP 07411191 A JP07411191 A JP 07411191A JP 7411191 A JP7411191 A JP 7411191A JP 3225530 B2 JP3225530 B2 JP 3225530B2
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- JP
- Japan
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- length
- asymmetry
- circuit
- pattern
- waveform
- Prior art date
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Optical Recording Or Reproduction (AREA)
Description
【０００１】
【産業上の利用分野】本発明はＣＤ用ディジタルＰＬＬ
回路に係わり、特に、アシンメトリによる波形歪が原因
で発生する誤動作を防止するものに用いて好適なもので
ある。
回路に係わり、特に、アシンメトリによる波形歪が原因
で発生する誤動作を防止するものに用いて好適なもので
ある。
【０００２】
【従来の技術】周知の通り、コンパクトディスクから読
み出される信号にはアシンメトリを有するものがある。
上記アシンメトリは、例えばコンパクトディスクに形成
されるピットの大きさや形が、マスタリングに用いられ
た光のパワーなどの諸条件や、現像時間などによって変
化することにより発生する。
み出される信号にはアシンメトリを有するものがある。
上記アシンメトリは、例えばコンパクトディスクに形成
されるピットの大きさや形が、マスタリングに用いられ
た光のパワーなどの諸条件や、現像時間などによって変
化することにより発生する。
【０００３】例えば、コンパクトディスクの信号のある
一部分が、９つあるピットの長さのうち、例えば３Ｔ，
４Ｔ（Ｔ：チャンネルクロック周期）の長さのものと、
それと同じ長さのピットのない部分とから成り立ってい
るとする。このことは、それぞれの長さのデューティが
５０％の信号を意味する。
一部分が、９つあるピットの長さのうち、例えば３Ｔ，
４Ｔ（Ｔ：チャンネルクロック周期）の長さのものと、
それと同じ長さのピットのない部分とから成り立ってい
るとする。このことは、それぞれの長さのデューティが
５０％の信号を意味する。
【０００４】したがって、もしも全てのパラメータのコ
ントロールが完全であるならば、コンパクトディスクの
トラック上には、デューティが５０％のピットが正確に
形成されることになる。しかし、パラメータがこの状態
から少しずれた場合には、ピットがその長さ方向の前後
に同じ量だけ、少しずつ長く、或いは短くなるような偏
差が生じてしまう不都合が発生する。
ントロールが完全であるならば、コンパクトディスクの
トラック上には、デューティが５０％のピットが正確に
形成されることになる。しかし、パラメータがこの状態
から少しずれた場合には、ピットがその長さ方向の前後
に同じ量だけ、少しずつ長く、或いは短くなるような偏
差が生じてしまう不都合が発生する。
【０００５】上記現象はアシンメトリと呼ばれている現
象であり、現段階においてはコンパクトディスクの製造
時にこれを完全に零にすることはできないとされてい
る。また、ピックアップが読み出した信号自体のアシン
メトリは、このピットとともに使用するレーザの波長に
よっても変動する。
象であり、現段階においてはコンパクトディスクの製造
時にこれを完全に零にすることはできないとされてい
る。また、ピックアップが読み出した信号自体のアシン
メトリは、このピットとともに使用するレーザの波長に
よっても変動する。
【０００６】上記したようなアシンメトリが発生する
と、アシンメトリによるずれがＰＬＬに対して位相、周
波数のジッタ成分となって現れ、その結果、エラーレー
トの悪化を招くことがある。特に、ＥＦＭ信号が周波数
偏位を持ったままＰＬＬにロックしている状態において
は、アシンメトリの影響が非常に大きく現れてしまうの
で都合が悪い。
と、アシンメトリによるずれがＰＬＬに対して位相、周
波数のジッタ成分となって現れ、その結果、エラーレー
トの悪化を招くことがある。特に、ＥＦＭ信号が周波数
偏位を持ったままＰＬＬにロックしている状態において
は、アシンメトリの影響が非常に大きく現れてしまうの
で都合が悪い。
【０００７】ところで、ＣＤ方式の場合は最小ピットの
長さが０．８６μｍ程度あり、幅方向の０．５μｍに比
べて十分に長い。したがって、アシンメトリによりこの
幅方向が影響を受けて、短いピットが長いピットに比べ
て幅方向が狭くなるようなことはほとんどない。つま
り、アシンメトリの影響は、幅方向には、全ての長さの
ピットに同じように影響し、ピットの長さ方向には、全
ての長さのピットに対し、前後に同じ量だけ影響するこ
とになる。ＣＤ方式のディスクは、アシンメトリがある
範囲内に入るように決められている。また、ＣＤプレイ
ヤにおいてはアシンメトリを自動的に補正する回路を組
み込んでアシンメトリによる不都合を防止するようにし
ている。
長さが０．８６μｍ程度あり、幅方向の０．５μｍに比
べて十分に長い。したがって、アシンメトリによりこの
幅方向が影響を受けて、短いピットが長いピットに比べ
て幅方向が狭くなるようなことはほとんどない。つま
り、アシンメトリの影響は、幅方向には、全ての長さの
ピットに同じように影響し、ピットの長さ方向には、全
ての長さのピットに対し、前後に同じ量だけ影響するこ
とになる。ＣＤ方式のディスクは、アシンメトリがある
範囲内に入るように決められている。また、ＣＤプレイ
ヤにおいてはアシンメトリを自動的に補正する回路を組
み込んでアシンメトリによる不都合を防止するようにし
ている。
【０００８】
【発明が解決しようとする課題】すなわち、ＣＤプレイ
ヤに配設されているディジタルＰＬＬでは、位相制御と
周波数制御とを独立に行っており、周波数制御はＥＦＭ
信号の各パターンの長さを計測して周波数偏差Δｆを割
り出し、これを再生クロックにオフセットとして加える
ことにより行っている。また、位相制御はＥＦＭ信号と
再生クロックとの位相差を単純に検出し、それを補正量
として再生クロックにフィードバックするようにして行
っている。
ヤに配設されているディジタルＰＬＬでは、位相制御と
周波数制御とを独立に行っており、周波数制御はＥＦＭ
信号の各パターンの長さを計測して周波数偏差Δｆを割
り出し、これを再生クロックにオフセットとして加える
ことにより行っている。また、位相制御はＥＦＭ信号と
再生クロックとの位相差を単純に検出し、それを補正量
として再生クロックにフィードバックするようにして行
っている。
【０００９】上記周波数の計測は、各パターンの波形長
を計測し正規の長さとの差に所定の重み付け（同じ計測
値でもパターンによって周波数が異なる）を行い、その
積分値を偏差量とするようにして行っている。このた
め、例えば３Ｔ，４Ｔなどのような小さなパターンにお
ける変化量は大きな周波数偏差として認識されるため、
アシンメトリの波形歪みは大きな影響を持つので、例え
ばＰＬＬ外れなどの不都合が発生してしまうことがあっ
た。本発明は上述の問題点に鑑み、波形長を正確に計測
することができるようにしてアシンメトリの影響による
ＰＬＬロック外れを防止できるようにすることを目的と
する。
を計測し正規の長さとの差に所定の重み付け（同じ計測
値でもパターンによって周波数が異なる）を行い、その
積分値を偏差量とするようにして行っている。このた
め、例えば３Ｔ，４Ｔなどのような小さなパターンにお
ける変化量は大きな周波数偏差として認識されるため、
アシンメトリの波形歪みは大きな影響を持つので、例え
ばＰＬＬ外れなどの不都合が発生してしまうことがあっ
た。本発明は上述の問題点に鑑み、波形長を正確に計測
することができるようにしてアシンメトリの影響による
ＰＬＬロック外れを防止できるようにすることを目的と
する。
【００１０】
【課題を解決するための手段】本発明のＣＤ用ディジタ
ルＰＬＬ回路は、コンパクトディスクから再生されたＥ
ＦＭ信号における各パターンのポジティブ部分の長さと
ネガティブ部分の長さの平均値を算出して前記各パター
ンの波形長を決定する平均化回路を設けたことを特徴と
する。
ルＰＬＬ回路は、コンパクトディスクから再生されたＥ
ＦＭ信号における各パターンのポジティブ部分の長さと
ネガティブ部分の長さの平均値を算出して前記各パター
ンの波形長を決定する平均化回路を設けたことを特徴と
する。
【００１１】
【作用】各パターンのポジティブ部分の長さとネガティ
ブ部分の長さの平均値を算出することにより上記各パタ
ーンの波形長を求めるようにすることにより、アシンメ
トリのためにＥＦＭ信号における各パターンの波形長が
極性により変動した場合においても、上記ＥＦＭ信号に
おける波形長を正確に計測することができるようにし
て、ＣＤ特有のアシンメトリによる波形歪みに起因する
誤動作が発生しないようにする。
ブ部分の長さの平均値を算出することにより上記各パタ
ーンの波形長を求めるようにすることにより、アシンメ
トリのためにＥＦＭ信号における各パターンの波形長が
極性により変動した場合においても、上記ＥＦＭ信号に
おける波形長を正確に計測することができるようにし
て、ＣＤ特有のアシンメトリによる波形歪みに起因する
誤動作が発生しないようにする。
【００１２】
【実施例】図１は、本発明の一実施例を示すＣＤ用ディ
ジタルＰＬＬ回路の構成図である。図１から明らかなよ
うに、本実施例のＣＤ用ディジタルＰＬＬ回路は、位相
計測回路１、周波数計測回路２、加算器３、クロック生
成回路４などよって構成されている。
ジタルＰＬＬ回路の構成図である。図１から明らかなよ
うに、本実施例のＣＤ用ディジタルＰＬＬ回路は、位相
計測回路１、周波数計測回路２、加算器３、クロック生
成回路４などよって構成されている。
【００１３】本実施例のＣＤ用ディジタルＰＬＬ回路
は、図３の説明図に示すようなアシンメトリにより、各
パターンの波形長が極性によって変動するのを防止する
ためになされたものである。なお、図３においては、３
Ｔの長さのピットおよびそれと同じ長さのピットのない
部分を示すとともに、４Ｔの長さのピットおよびそれと
同じ長さのピットのない部分を示している。
は、図３の説明図に示すようなアシンメトリにより、各
パターンの波形長が極性によって変動するのを防止する
ためになされたものである。なお、図３においては、３
Ｔの長さのピットおよびそれと同じ長さのピットのない
部分を示すとともに、４Ｔの長さのピットおよびそれと
同じ長さのピットのない部分を示している。
【００１４】そして、図３の（２）は各長さが標準的な
長さに形成されている場合を示している。また、（１）
はポジティブの部分の長さがａμｍだけ短くなっている
場合を示し、（３）はその逆にポジティブの部分の長さ
がｂμｍだけ長くなっている場合を示している。したが
って、例えば、図３の（１）のトラックをトレースした
場合には、図４の波形説明図に示すように、“Ｈ”レベ
ル部分が実線で示す本来のパルス幅よりも狭くなってし
まう不都合が発生する。このような現象が発生すると、
極端な場合はＰＬＬのロック外れを生じてしまう不都合
が生じる。
長さに形成されている場合を示している。また、（１）
はポジティブの部分の長さがａμｍだけ短くなっている
場合を示し、（３）はその逆にポジティブの部分の長さ
がｂμｍだけ長くなっている場合を示している。したが
って、例えば、図３の（１）のトラックをトレースした
場合には、図４の波形説明図に示すように、“Ｈ”レベ
ル部分が実線で示す本来のパルス幅よりも狭くなってし
まう不都合が発生する。このような現象が発生すると、
極端な場合はＰＬＬのロック外れを生じてしまう不都合
が生じる。
【００１５】本実施例のＣＤ用ディジタルＰＬＬ回路の
場合は、このような不都合を次のようにして防止してい
る。すなわち、図１に示したように、コンパクトディス
ク（図示せず）から読み出された再生信号ＥＦＭは、位
相計測回路１に与えられるとともに、周波数計測回路２
に与えられる。位相計測回路１においては、上記したよ
うにＥＦＭ信号と再生クロックとの位相差Δθを検出
し、それを補正量として再生クロックＰＬＣＫにフィー
ドバックするようにしている。したがって、位相計測に
関しては従来のＣＤ用ディジタルＰＬＬ回路と同じ構成
となっている。
場合は、このような不都合を次のようにして防止してい
る。すなわち、図１に示したように、コンパクトディス
ク（図示せず）から読み出された再生信号ＥＦＭは、位
相計測回路１に与えられるとともに、周波数計測回路２
に与えられる。位相計測回路１においては、上記したよ
うにＥＦＭ信号と再生クロックとの位相差Δθを検出
し、それを補正量として再生クロックＰＬＣＫにフィー
ドバックするようにしている。したがって、位相計測に
関しては従来のＣＤ用ディジタルＰＬＬ回路と同じ構成
となっている。
【００１６】しかし、周波数計測回路２については、本
実施例の場合は図２に示したように構成している。すな
わち、周波数が高いために極性による波形長の変化量が
大きな周波数偏差として認識されてしまう３Ｔ，４Ｔな
どの小さいパターンについては、ポジティブ部分とネガ
ティブ部分のそれぞれの長さの平均値を算出してパター
ンの波形長さを決定する平均化回路５，６を設けてい
る。そして、これらの平均化回路５，６から出力される
信号を重み付け回路７に与えて所定の重み付けを行い、
周波数偏差△ｆを求めるようにしている。
実施例の場合は図２に示したように構成している。すな
わち、周波数が高いために極性による波形長の変化量が
大きな周波数偏差として認識されてしまう３Ｔ，４Ｔな
どの小さいパターンについては、ポジティブ部分とネガ
ティブ部分のそれぞれの長さの平均値を算出してパター
ンの波形長さを決定する平均化回路５，６を設けてい
る。そして、これらの平均化回路５，６から出力される
信号を重み付け回路７に与えて所定の重み付けを行い、
周波数偏差△ｆを求めるようにしている。
【００１７】上記したような３Ｔ平均化回路５および４
Ｔ平均化回路６などを構成する手段としては種々の手段
が考慮されるが、例えば次のようにすればよい。すなわ
ち、第１の手段としては、ポジティブおよびネガティブ
の両パルスの長さの平均値を検出してパターンの長さを
決定するようにすることである。これは、図３および図
４で説明したように、アシンメトリが発生するとポジテ
ィブ部分が短くなったり、或いはその逆にポジティブ部
分が長くなったりするので、再生パルス信号についてポ
ジティブおよびネガティブの両パルスの長さの平均値を
求めることにより、アシンメトリによる波形歪みを補償
して波形長を正確に計測することができるようになる。
Ｔ平均化回路６などを構成する手段としては種々の手段
が考慮されるが、例えば次のようにすればよい。すなわ
ち、第１の手段としては、ポジティブおよびネガティブ
の両パルスの長さの平均値を検出してパターンの長さを
決定するようにすることである。これは、図３および図
４で説明したように、アシンメトリが発生するとポジテ
ィブ部分が短くなったり、或いはその逆にポジティブ部
分が長くなったりするので、再生パルス信号についてポ
ジティブおよびネガティブの両パルスの長さの平均値を
求めることにより、アシンメトリによる波形歪みを補償
して波形長を正確に計測することができるようになる。
【００１８】また、第２の手段としては、ポジティブお
よびネガティブの両パルスの極性を無視し、フィルタに
よる平均値算出を行うことによっても波形長を正確に計
測することができる。これは、両パルス信号の極性は平
均すると確率的には１／２ずつであるとの思想に基くも
のであり、このようにして処理しても波形長を問題なく
計測することができる。
よびネガティブの両パルスの極性を無視し、フィルタに
よる平均値算出を行うことによっても波形長を正確に計
測することができる。これは、両パルス信号の極性は平
均すると確率的には１／２ずつであるとの思想に基くも
のであり、このようにして処理しても波形長を問題なく
計測することができる。
【００１９】本実施例においては、上記したように平均
値をとって波形長を計測しているので、アシンメトリが
発生することにより、同じパターンでも極性が変わるこ
とで波形長が変わっても、本来の長さを正確に計測する
ことができる。したがって、アシンメトリによる波形歪
みが原因で発生する種々の悪影響、例えばＰＬＬ外れを
良好に防止することができる。なお、上記実施例におい
ては、コンパクトディスクに形成されるピットの長さの
誤差に基くアシンメトリについて説明したが、上記した
ようにアシンメトリは、例えば、ピットを読み出すため
に使用するレーザの波長などによっても変動する。ま
た、上記実施例においてはパターンが小さいことにより
その変化量が大きな周波数偏差になるので、３Ｔおよび
４Ｔの各信号についてのみ平均化回路を設けた例を示し
たが、他の信号についても必要に応じて上記のような平
均化回路を設けるようにすればよい。
値をとって波形長を計測しているので、アシンメトリが
発生することにより、同じパターンでも極性が変わるこ
とで波形長が変わっても、本来の長さを正確に計測する
ことができる。したがって、アシンメトリによる波形歪
みが原因で発生する種々の悪影響、例えばＰＬＬ外れを
良好に防止することができる。なお、上記実施例におい
ては、コンパクトディスクに形成されるピットの長さの
誤差に基くアシンメトリについて説明したが、上記した
ようにアシンメトリは、例えば、ピットを読み出すため
に使用するレーザの波長などによっても変動する。ま
た、上記実施例においてはパターンが小さいことにより
その変化量が大きな周波数偏差になるので、３Ｔおよび
４Ｔの各信号についてのみ平均化回路を設けた例を示し
たが、他の信号についても必要に応じて上記のような平
均化回路を設けるようにすればよい。
【００２０】
【発明の効果】本発明は上述したように、各パターンの
ポジティブ部分とネガティブ部分のそれぞれの長さの平
均値を算出することによりＥＦＭ信号における各パター
ンの波形長を求めるようにしたので、アシンメトリが発
生することにより、同じパターンでも極性が変わると波
形長が変動する不都合が発生しても、上記ＥＦＭ信号に
おける各パターンの波形長を正確に計測することができ
る。したがって、ＣＤ特有のアシンメトリによる波形歪
みで発生する誤差を無くすことができるので、ＰＬＬロ
ック外れを防止してＣＤの再生能力を大幅に向上させる
ことができる。
ポジティブ部分とネガティブ部分のそれぞれの長さの平
均値を算出することによりＥＦＭ信号における各パター
ンの波形長を求めるようにしたので、アシンメトリが発
生することにより、同じパターンでも極性が変わると波
形長が変動する不都合が発生しても、上記ＥＦＭ信号に
おける各パターンの波形長を正確に計測することができ
る。したがって、ＣＤ特有のアシンメトリによる波形歪
みで発生する誤差を無くすことができるので、ＰＬＬロ
ック外れを防止してＣＤの再生能力を大幅に向上させる
ことができる。
【図１】本発明の一実施例を示すＣＤ用ディジタルＰＬ
Ｌ回路の構成図である。
Ｌ回路の構成図である。
【図２】本発明のＣＤ用ディジタルＰＬＬ回路に配設さ
れる周波数計測回路の構成図である。
れる周波数計測回路の構成図である。
【図３】アシンメトリを説明するための概念図である。
【図４】アシンメトリが発生することにより波形長が変
わる様子を説明するための波形図である。
わる様子を説明するための波形図である。
１ 位相計測回路 ２ 周波数計測回路 ３ 加算器 ４ クロック生成回路 ５ ３Ｔ平均化回路 ６ ４Ｔ平均化回路 ７ 重み付け回路 Δｆ 周波数偏差
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) G11B 20/14 H03L 7/00 - 7/14
Claims (1)
- 【請求項１】 コンパクトディスクから再生されたＥＦ
Ｍ信号における各パターンのポジティブ部分の長さとネ
ガティブ部分の長さの平均値を算出して前記各パターン
の波形長を決定する平均化回路を設けたことを特徴とす
るＣＤ用ディジタルＰＬＬ回路。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP07411191A JP3225530B2 (ja) | 1991-03-13 | 1991-03-13 | Ｃｄ用ディジタルｐｌｌ回路 |
| KR1019920003950A KR100240553B1 (ko) | 1991-03-13 | 1992-03-11 | Cd용 디지탈 pll 회로 |
| US08/052,822 US5416809A (en) | 1991-03-13 | 1993-04-26 | Digital phase locked loop apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP07411191A JP3225530B2 (ja) | 1991-03-13 | 1991-03-13 | Ｃｄ用ディジタルｐｌｌ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04285771A JPH04285771A (ja) | 1992-10-09 |
| JP3225530B2 true JP3225530B2 (ja) | 2001-11-05 |
Family
ID=13537763
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP07411191A Expired - Lifetime JP3225530B2 (ja) | 1991-03-13 | 1991-03-13 | Ｃｄ用ディジタルｐｌｌ回路 |
Country Status (2)
| Country | Link |
|---|---|
| JP (1) | JP3225530B2 (ja) |
| KR (1) | KR100240553B1 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2518148B2 (ja) * | 1993-03-12 | 1996-07-24 | 日本電気株式会社 | クロック従属同期方法 |
-
1991
- 1991-03-13 JP JP07411191A patent/JP3225530B2/ja not_active Expired - Lifetime
-
1992
- 1992-03-11 KR KR1019920003950A patent/KR100240553B1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR920018737A (ko) | 1992-10-22 |
| JPH04285771A (ja) | 1992-10-09 |
| KR100240553B1 (ko) | 2000-01-15 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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| FPAY | Renewal fee payment (event date is renewal date of database) |
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|
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