JP3087818B2 - 光素子固定方法 - Google Patents
光素子固定方法Info
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Description
基板上に薄膜半田を介して一つ又は複数の光素子を搭載
する固定方法に関する。
シリコン基板01上にV溝の光ファイバ02をガイドす
るガイド溝03を形成し、同一基板上にLD,PD等の
光素子04を薄膜半田04を介して搭載したモジュール
が作成されている。このような光素子を半田により固定
する表面実装においては、半田バンプ法(1993年、
信学会春季大会C−278参照)と、薄膜半田法(19
93年、信学会秋期大会C−190参照)とがある。
前に半田バンプ上に接触させ、その後、半田リフローし
て、セルフアライメント効果を利用して搭載するように
している。この半田バンプ法には、以下のような特徴が
ある。 複数光素子搭載に適用が可能である。 光素子との接触面積が小さくなるので放熱が不十分
である。 半田バンプ形成工程が複雑である。
ー前に半田バンプ上に接触させ、密着のための圧力を加
えた状態にし、その後半田をリフローして、固定する。
該薄膜半田法には、以下のような特徴がある。 接触面積が大きいので放熱が消光である。 半田形成工程が容易である。 複数光素子搭載には適用が困難である。
バンプ法では、セルフアライメント効果によりリフロー
後の所定の位置にアライメントされ、複数回リフローし
ても光素子の位置ずれは少ないため、複数光素子搭載が
可能であるが、光素子の放熱特性を考慮した場合、薄膜
半田法が有利である。
半田の厚さは薄いほうが精度が高い。 しかし、半田バ
ンプ法でセルフアライメント効果を有効に利用するため
には、ある程度の半田の厚さが必要である。この点にお
いても、薄膜半田の方が光素子搭載には有利である。し
かし、薄膜半田の厚さが厚くなるとリフロー時の変形に
よる光素子の位置ずれが起き、光軸ずれが問題となるた
め、押圧をかけて位置ずれを抑制しなければならない。
載する際、基板上に薄膜半田を形成する方法と、素子上
に薄膜半田を形成する方法との二種類の方法がある。基
板上に形成された薄膜半田を介して同一基板上に複数の
光素子を搭載する方法として、素子搭載毎にリフローし
搭載する方法がある。
熱伝導率が高い基板上に搭載する場合には、局部だけを
昇温し薄膜半田をリフローすることは困難である。この
ため、シリコン基板上に形成された薄膜半田は搭載素子
数だけ繰り返しリフローされ、半田の酸化や金属間化合
物の生成による固定強度の劣化が生じたり、先に搭載さ
れた光素子の半田が再びリフローしてまうため、同様の
問題が生じる。
リフロー時に密着圧力をかけて搭載することが望まし
い。しかしながら、搭載素子と基板との平行度が完全に
一致しているとは限らないため、密着圧力は完全に半
田、及び基板に垂直とはならず、軸ずれ要因となる面内
方向の分力をもっている。この分力は調芯時は摩擦力に
より平衡が保たれているが、リフロー時は半田表面の摩
擦が減少するため、平衡が崩れてしまい軸ずれの要因と
なる素子変位が起きてしまうという問題がある。このと
き、薄膜半田と密着する素子表面または基板上の搭載部
表面の状態に差が生じることも考えられるが、この密着
面状態差により摩擦力にも差が生じ多種類素子を搭載す
る際、搭載素子ごとに固定強度及び素子変位量にばらつ
きが生じ多種類素子搭載が困難となるという問題があ
る。
望ましい薄膜半田を用いて複数光素子の搭載に適用でき
る光素子固定法を提供することを目的とする。
明の光素子固定法の構成は、光導波路又は光ファイバを
有する基板上に、一つ又は複数の光素子を光導波路又は
光ファイバとの光結合を保ちつつ、薄膜半田を介して固
定する方法において、基板と一つ又は複数の光素子を位
置合わせする第1の工程と、基板と一つ又は複数の光素
子を薄膜半田を介して圧力(P)を加え密着させる第2
の工程と、光素子が密着された状態を保持しつつ初期密
度温度(T0 )から半田リフロー以下の仮固定温度(T
1 )まで昇温させる第3の工程と、仮固定終了温度(T
2 )まで冷却する第4の工程と、密着のための圧力
(P)を無くす第5の工程とからなる光素子仮固定工程
を、搭載するすべての光素子に対して行い、その後、圧
力のない状態で半田リフロー温度(T3 )まで昇温させ
る第6の工程と、固定終了後温度(T4 )まで冷却させ
て半田を硬化させ、素子を基板に固定する第7の工程と
からなることを特徴とする。
素子が複数(n)個の場合、第1の工程から第5の工程
までの光素子の仮固定をする工程が、複数(n)回を個
々に繰りかえして仮固定する方法、又は所定のグループ
単位毎に(n−1)回以下の回数を繰り返して仮固定す
る方法であることを特徴とする。
度温度(T0 ),仮固定温度(T1)及び仮固定終了温
度(T2 )がすべて等しいことを特徴とする。
田の厚さが3μm以下であることを特徴とする。
以下の温度で圧着により仮固定できること、及び半田が
薄ければ圧着無しのリフローでも半田のセルフアライメ
ント効果が抑制でき光軸ずれ無しで固定できるものであ
る。
リフローされる工程は一回で済むため、半田の酸化や金
属間化合物の生成による固定強度の劣化、素子変位によ
る光軸ずれは少ない。
で昇温されており、さらに密着圧力も加わっているた
め、熱圧着ボンディングと同じ効果が生じ、その後、リ
フローされるまでの工程中、光軸ずれの起きない程度の
固定強度が保てる。
先に仮固定した素子の光軸ずれが起きることはない。
力がかからないため、従来技術で生じた平行度のずれに
よる面内方向分力の影響はない。
変形による光素子の変位が少なく光軸ずれが抑制され
る。
力を制御することにより、素子表面の状態の差による仮
固定強度及び仮固定時の素子変位のばらつきを緩和する
ことができる。
態例を図面に基づいて説明する。
載工程のフローチャート、図2〜図7は複数光素子搭載
工程図を示す。本実施の形態例では、光導波路とAuS
n半田薄膜を有するSi基板に二つの光素子を搭載する
一実施の形態例を説明する。
は、Si基板12の素子搭載最適位置近傍に電気的接続
または固定のための要請に応じて、あらかじめパターン
ニングして形成してある。第1の光素子13−1は第2
の光素子13−2より上記AuSn半田薄膜11上に比
較的熱圧着しやすい表面であるとしている。
ーチャート及び図2〜7の工程図を参照して説明する。
14上に上記Si基板12を固定する。第1の光素子1
3−1をSi基板12の所定の位置に移動させることの
できる移動台(以下「ピックアップ」という。)15に
固定する(図2参照)。
させ、第1の光素子13−1をアクティブアライメン
ト、又はマーカー法等のパッシブアライメントにより調
芯し、光導波路16に対し第1の光素子10−1を最適
な位置に設定する(図3参照)。
板12と第1の光素子13−1との密着をよくするため
に圧力(P)を加える。上記ピックアップ15はこの圧
力を加えるための機能を有している。
13−1を固定する作用を無くす(図3参照)。例え
ば、吸着により固定していた場合には、吸引を止める。
これは、以下の仮固定のための昇温過程で熱膨張による
歪が無視できない程度となった場合、ピックアップ15
に既に光素子が固定されている場合、歪の影響が大きく
利いてくる可能性がある。
まの状態で初期密度温度(T0 )から半田リフロー以下
の温度である仮固定温度(T1 )まで昇温する(図4参
照)。AuSn共晶半田薄膜を用いる場合、リフロー温
度は約280℃近傍となる。そこで、仮固定温度
(T1 )は、280℃以下とする必要がある。高温にな
るに従って、AuSn共晶半田は拡散や酸化の影響を受
け、劣化しやすくなるため、仮固定温度(T1 )はでき
るだけ低い方が良い。一方、熱圧着の観点からは、仮固
定温度(T1 )が高い方がよいため、仮固定温度は18
0℃前後となる。
度(T2 )まで冷却し、密着圧力を無くして第1の光素
子13−1を所定の位置に仮固定する(図4参照)。こ
の仮固定工程において、熱膨張の影響を少なくするため
には初期密度温度(T0 )と仮固定温度(T1 )との差
が小さいほうがよい。また、半田はAuを成分に含む半
田を用い(AuSn,AuSi,AuIn等)、半田最
表面にAuの層を持ち、光素子電極をAuとする場合
は、接触面がAuAu接合となり、仮固定が容易にな
る。
アップ15に固定し(図5参照)、第1の光素子13−
1を固定したのと同様の方法で、同一基板12の所定の
位置に仮固定する(図6参照)。この際、第2の光素子
13−2は第1の光素子10−1よりAuSn半田薄膜
14上に比較的熱圧着しにくいため、仮固定温度
(T1 )は高め、密着圧力(P)は強めになる。
(図6参照)、圧力のない状態で半田リフロー温度(T
3 )まで昇温する。AuSn共晶半田薄膜を用いる場
合、上記のようにリフロー温度(T3 )は約280℃近
傍となるので、組成ゆらぎを考慮し、300℃程度まで
上昇させる。
4 )まで冷却し、すべての光素子13−1,13−2を
基板12上に順に固定する(図7参照)。
圧力の変化を図8に示す。
により得られた複数素子搭載基板の側面図、及び斜視図
を示している。これらの図面において、基板12上に設
けられた各導波路16−1,16−2に各々対応するよ
うに、光素子13−1,13−2がAuSn半田11を
介して搭載された状態を示している。
する光素子を二つの場合で説明したが、複数個を搭載す
る場合において、搭載する光素子を例えば5個の場合、
第1の工程から第5の工程までの光素子の仮固定をする
工程が、5回を個々に繰りかえして仮固定する方法や2
個の光素子を1つのグループ単位としこのグループ単位
毎に2回繰り返して仮固定し、最後に1個の光素子を仮
固定するようにして、第1工程〜第5工程までの取り扱
う素子数に何等限定されるものではない。
形態例の搭載において、パッシブアライメントにより位
置合わせを行い、二つの光素子が共に熱圧着できるよう
な温度に保ったまま仮固定工程を行う。すなわち、上記
初期密度温度(T0 ),仮固定温度(T1 ),仮固定終
了温度(T2 ),半田リフロー温度(T3 )及び固定終
了後温度(T4 )がすべて等しい状態、T0 =T1 =T
2 となる。この場合、仮工程における冷却工程を省くと
こが可能となるため、実装工程の簡略化と工程時間の短
縮が可能となる。この第2の実施の形態例の温度及び圧
力との変化を、図11に示す。
を有するシリコン基板に一つの光素子を仮固定し、その
後半田リフローし搭載する。光素子と基板とを薄膜半田
を密着させる工程において、AuSn薄膜半田の膜厚を
1μm〜5μmまで変化させ、光出力を測定した結果を
図12に示す。横軸にAuSn薄膜半田の膜厚、縦軸に
膜厚1μm時の損失を基準とした場合の損失を示す。4
μmから損失が増加することが判明したので、3μmま
での膜厚であれば良好である。
導波路を有する基板上に、薄膜半田による複数の光素子
固定が可能となる。また、十分な固定強度が保たれか
つ、光素子と光導波路とで十分な光結合をとることがき
るため、平面光導波路基板上に光素子を集積することが
可能となり、小型且つ高機能光素子が実現できる。本発
明により、例えば、光通信において要求される高機能ハ
イブリッド回路の実現が可能となる。
フである。
ラフである。
Claims (4)
- 【請求項1】 光導波路又は光ファイバを有する基板上
に、一つ又は複数の光素子を光導波路又は光ファイバと
の光結合を保ちつつ、薄膜半田を介して固定する方法に
おいて、 基板と一つ又は複数の光素子を位置合わせする第1の工
程と、 基板と一つ又は複数の光素子を薄膜半田を介して圧力
(P)を加え密着させる第2の工程と、 光素子が密着された状態を保持しつつ初期密度温度(T
0 )から半田リフロー以下の仮固定温度(T1 )まで昇
温させる第3の工程と、 仮固定終了温度(T2 )まで冷却する第4の工程と、 密着のための圧力(P)を無くす第5の工程とからなる
光素子仮固定工程を、搭載するすべての光素子に対して
行い、 その後、圧力のない状態で半田リフロー温度(T3 )ま
で昇温させる第6の工程と、 固定終了後温度(T4 )まで冷却させて半田を硬化さ
せ、素子を基板に固定する第7の工程とからなることを
特徴とする光素子固定方法。 - 【請求項2】 請求項1記載の光素子固定方法におい
て、 搭載する光素子が複数(n)個の場合、第1の工程から
第5の工程までの光素子の仮固定をする工程が、複数
(n)回を個々に繰りかえして仮固定する方法、又は所
定のグループ単位毎に(n−1)回以下の回数を繰り返
して仮固定する方法であることを特徴とする光素子固定
方法。 - 【請求項3】 請求項1,2記載の光素子固定方法にお
いて、 上記初期密度温度(T0 ),仮固定温度(T1 )及び仮
固定終了温度(T2 )がすべて等しいことを特徴とする
光素子固定方法。 - 【請求項4】 請求項1〜3記載の光素子固定方法にお
いて、 上記薄膜半田の厚さが3μm以下であることを特徴とす
る光素子固定方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP07205493A JP3087818B2 (ja) | 1995-08-11 | 1995-08-11 | 光素子固定方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP07205493A JP3087818B2 (ja) | 1995-08-11 | 1995-08-11 | 光素子固定方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0954229A JPH0954229A (ja) | 1997-02-25 |
JP3087818B2 true JP3087818B2 (ja) | 2000-09-11 |
Family
ID=16507777
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP07205493A Expired - Lifetime JP3087818B2 (ja) | 1995-08-11 | 1995-08-11 | 光素子固定方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3087818B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP1723456B1 (en) * | 2004-02-18 | 2021-08-04 | Color Chip (Israel) Ltd. | System and method for the fabrication of an electro-optical module |
-
1995
- 1995-08-11 JP JP07205493A patent/JP3087818B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH0954229A (ja) | 1997-02-25 |
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