JP2821223B2 - 再生装置 - Google Patents
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- Television Signal Processing For Recording (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は再生装置に関し、特に、情報量が圧縮された
情報信号の記録再生に関する。
情報信号の記録再生に関する。
近年、ダビング時の劣化のない、デジタルVTRやデジ
タルオーデイオテープレコーダ（DAT）が注目されてい
る。
タルオーデイオテープレコーダ（DAT）が注目されてい
る。
２台のデジタルVTRを用いてダビングを行うシステム
の一般的な構成を第４図に示す。図中Ｓはスレーブ側
（記録側）VTR、Ｍはマスター側（再生側）VTRである。
尚、同図においては説明の簡単のためマスター側VTR
（Ｍ）については再生系、スレーブ側VTR（Ｓ）につい
ては記録系のみを示している。
の一般的な構成を第４図に示す。図中Ｓはスレーブ側
（記録側）VTR、Ｍはマスター側（再生側）VTRである。
尚、同図においては説明の簡単のためマスター側VTR
（Ｍ）については再生系、スレーブ側VTR（Ｓ）につい
ては記録系のみを示している。
マスター側VTR（Ｍ）に於いて、磁気テープT1の記録
信号は、磁気ヘツド26により電気信号に変換され、再生
アンプ28で増幅される。なお、通常の記録再生装置では
記録した。
信号は、磁気ヘツド26により電気信号に変換され、再生
アンプ28で増幅される。なお、通常の記録再生装置では
記録した。
再生アンプ28の出力は、不図示のデジタル復調回路に
より復調された後、ECCデコーダ30に印加される。ECCデ
コーダ30は、記録されていた情報符号列に付加されてい
る誤り訂正符号を使って、再生時の誤りを訂正する。伸
長回路32は、ECCデコーダ30の出力する、帯域圧縮符号
化された情報符号に符号化時とは逆の処理、即ち帯域伸
長及び復号を行ない、修整回路34に供給する。該回路34
は、再生符号誤りがECCデコーダ30による訂正能力を越
える場合に、補間等の処理により訂正不能な情報符号を
該情報の相関性を用いて修整する回路である。D/A変換
器36は修整回路34の出力をアナログ信号に変換し、出力
端子38に出力する。また、修整回路34の出力はダビング
用出力端子35に供給される。
より復調された後、ECCデコーダ30に印加される。ECCデ
コーダ30は、記録されていた情報符号列に付加されてい
る誤り訂正符号を使って、再生時の誤りを訂正する。伸
長回路32は、ECCデコーダ30の出力する、帯域圧縮符号
化された情報符号に符号化時とは逆の処理、即ち帯域伸
長及び復号を行ない、修整回路34に供給する。該回路34
は、再生符号誤りがECCデコーダ30による訂正能力を越
える場合に、補間等の処理により訂正不能な情報符号を
該情報の相関性を用いて修整する回路である。D/A変換
器36は修整回路34の出力をアナログ信号に変換し、出力
端子38に出力する。また、修整回路34の出力はダビング
用出力端子35に供給される。
一方、スレーブ側VTR（Ｓ）に於いて、入力端子10に
入力する映像信号はA/D変換器12によるデジタル化さ
れ、切換えスイツチ14のＮ側を介して帯域圧縮符号化回
路16に供給される。ECCエンコーダ18は、帯域圧縮符号
化回路16により帯域圧縮符号化された信号に対し、再生
時に発生する符号誤りを訂正するための誤り訂正符号、
所謂パリテイを付加する。ECCエンコーダ18の出力は、
図示しないデジタル変調回路で変調された後、記録アン
プ20で増幅され、磁気ヘツド22により磁気テープT2に磁
気記録される。
入力する映像信号はA/D変換器12によるデジタル化さ
れ、切換えスイツチ14のＮ側を介して帯域圧縮符号化回
路16に供給される。ECCエンコーダ18は、帯域圧縮符号
化回路16により帯域圧縮符号化された信号に対し、再生
時に発生する符号誤りを訂正するための誤り訂正符号、
所謂パリテイを付加する。ECCエンコーダ18の出力は、
図示しないデジタル変調回路で変調された後、記録アン
プ20で増幅され、磁気ヘツド22により磁気テープT2に磁
気記録される。
ダビング時に於いては、マスター側VTR（Ｍ）の修正
回路34の出力が端子35を介して、スレーブ側VTR（Ｓ）
のダビング用入力端子37に入力される。これは再生され
た情報符号中に訂正不能な符号誤りが発生した場合に、
誤った符号をダビングしない様にするためである。こう
して、端子37には修正済みの情報符号列が入力され、該
修正済みの符号は圧縮符号化回路16に印加され、再度圧
縮符号化処理を行なった後、磁気テープT2に磁気記録さ
れる。
回路34の出力が端子35を介して、スレーブ側VTR（Ｓ）
のダビング用入力端子37に入力される。これは再生され
た情報符号中に訂正不能な符号誤りが発生した場合に、
誤った符号をダビングしない様にするためである。こう
して、端子37には修正済みの情報符号列が入力され、該
修正済みの符号は圧縮符号化回路16に印加され、再度圧
縮符号化処理を行なった後、磁気テープT2に磁気記録さ
れる。
デジタルVTRの場合、アナログVTRのように電磁変換系
の歪の影響を受けることが無く、従って、画質劣化とし
ては、帯域圧縮によるものと、エラーが多発した場合の
エラー修正によるものだけである。また、ダビングに関
しては、電磁変換系の歪による劣化が累積することがな
い点でアナログVTRよりも有利とされている。
の歪の影響を受けることが無く、従って、画質劣化とし
ては、帯域圧縮によるものと、エラーが多発した場合の
エラー修正によるものだけである。また、ダビングに関
しては、電磁変換系の歪による劣化が累積することがな
い点でアナログVTRよりも有利とされている。
しかし、上記従来例では、ダビング時にスイツチ14を
Ｄ側に接続して、修正回路34の出力の修正データを再度
圧縮して磁気記録するので、ダビングを複数回繰り返す
と、圧縮・伸長の繰り返しにより画質が劣化するという
問題点がある。
Ｄ側に接続して、修正回路34の出力の修正データを再度
圧縮して磁気記録するので、ダビングを複数回繰り返す
と、圧縮・伸長の繰り返しにより画質が劣化するという
問題点がある。
そこで本発明は、このような問題点を解決する再生装
置を提供することを目的とする。
置を提供することを目的とする。
［課題を解決するための手段］ このような目的下において、本発明にあっては、第１
の記録媒体に記録されている情報符号列を記録装置によ
り第２の記録媒体に記録するダビングシステムにて用い
られる再生装置であって、情報量が圧縮され、且つ、誤
り訂正符号化された情報データよりなる情報符号列を前
記第１の記録媒体から再生する再生手段と、前記再生手
段により再生された情報符号列に対して誤り訂正復号処
理を施し、前記情報符号列中のエラーを訂正する誤り訂
正手段と、前記誤り訂正手段から出力された前記情報デ
ータの情報量を伸長する伸長手段と、前記誤り訂正手段
にて訂正不能なエラーを前記情報データの相関性を利用
して補間する修整手段と、前記誤り訂正手段により訂正
不能なエラー以外の情報データと、前記修整手段により
補間された情報データとをそれぞれ前記圧縮された状態
で多重してダビング用符号列を生成し、前記記録装置に
出力する第１の出力手段と、前記修整手段により処理さ
れた情報データを前記伸長された状態で装置外部に出力
する第２の出力手段とを備える再生装置が提供される。
の記録媒体に記録されている情報符号列を記録装置によ
り第２の記録媒体に記録するダビングシステムにて用い
られる再生装置であって、情報量が圧縮され、且つ、誤
り訂正符号化された情報データよりなる情報符号列を前
記第１の記録媒体から再生する再生手段と、前記再生手
段により再生された情報符号列に対して誤り訂正復号処
理を施し、前記情報符号列中のエラーを訂正する誤り訂
正手段と、前記誤り訂正手段から出力された前記情報デ
ータの情報量を伸長する伸長手段と、前記誤り訂正手段
にて訂正不能なエラーを前記情報データの相関性を利用
して補間する修整手段と、前記誤り訂正手段により訂正
不能なエラー以外の情報データと、前記修整手段により
補間された情報データとをそれぞれ前記圧縮された状態
で多重してダビング用符号列を生成し、前記記録装置に
出力する第１の出力手段と、前記修整手段により処理さ
れた情報データを前記伸長された状態で装置外部に出力
する第２の出力手段とを備える再生装置が提供される。
［作用］ 前述の如き装置においては、訂正不能なエラー以外の
情報データと補間された情報データとを共に圧縮された
状態で多重してダビング用符号列を生成しているので、
不必要に圧縮・伸長処理を行うことがなくなり、ダビン
グ時における情報データの伝送レートを抑え、画質劣化
を最小限に抑えることが可能となる。
情報データと補間された情報データとを共に圧縮された
状態で多重してダビング用符号列を生成しているので、
不必要に圧縮・伸長処理を行うことがなくなり、ダビン
グ時における情報データの伝送レートを抑え、画質劣化
を最小限に抑えることが可能となる。
以下、図面を参照して本発明の実施例を説明する。
第１図は本発明の一実施例のダビングシステムの構成
を示すブロツク図であり、図中、第４図と同じ構成要素
には同じ符号を付してある。尚、第１図に於いてもマス
ター側VTR（Ｍ）は再生系のみを示し、スレーブ側VTR
（Ｓ）は記録系のみを示している。
を示すブロツク図であり、図中、第４図と同じ構成要素
には同じ符号を付してある。尚、第１図に於いてもマス
ター側VTR（Ｍ）は再生系のみを示し、スレーブ側VTR
（Ｓ）は記録系のみを示している。
ECCデコーダ30は誤り訂正不能な符号であるか否かを
示すフラグをエラー位置記憶回路40に供給する。該回路
40は訂正不能な符号誤りの生じた符号の各データフレー
ム上の位置を記憶し、修整回路34からその訂正不能な符
号誤りの生じた符号、即ち修整された符号が出力される
タイミングで、これを示すフラグデータを端子41に供給
する。42は後述する所定遅延時間での遅延回路であり、
遅延した圧縮情報符号列を端子45に出力する。
示すフラグをエラー位置記憶回路40に供給する。該回路
40は訂正不能な符号誤りの生じた符号の各データフレー
ム上の位置を記憶し、修整回路34からその訂正不能な符
号誤りの生じた符号、即ち修整された符号が出力される
タイミングで、これを示すフラグデータを端子41に供給
する。42は後述する所定遅延時間での遅延回路であり、
遅延した圧縮情報符号列を端子45に出力する。
44は遅延回路42で遅延され、端子47を介して入力され
た符号列と、圧縮符号化回路16の出力する符号列とを選
択的にECCエンコーダ18に印加するスイツチであり、端
子43を介して入力された前述のエラー位置記憶回路40か
らのフラグデータによって制御される。
た符号列と、圧縮符号化回路16の出力する符号列とを選
択的にECCエンコーダ18に印加するスイツチであり、端
子43を介して入力された前述のエラー位置記憶回路40か
らのフラグデータによって制御される。
所定通常の記録再生の動作は第１の場合と同じである
ので以下、ダビング時の動作を中心に説明する。第２図
は各部の符号列を模式的に示す図である。第２図では、
D1（ｉ＝１〜ｎ）はデータ、P1はパリテイ、ED1はECCデ
コーダ30による誤り訂正後でもエラーが残ったデータ、
F1は誤り訂正後の各符号が有効か否かを示すエラー・フ
ラグである。エラー・フラグF1は、訂正済みの符号D1に
符号誤りが残った場合（訂正不能の場合）に“1"、符号
誤りが残らない場合（訂正できた場合及び符号誤りのな
い場合）に“0"である。第２図では、データD2に誤り訂
正不能の符号が残り、他の符号については、符号誤りが
あってもECCデコーダ30により完全に訂正されたとす
る。
ので以下、ダビング時の動作を中心に説明する。第２図
は各部の符号列を模式的に示す図である。第２図では、
D1（ｉ＝１〜ｎ）はデータ、P1はパリテイ、ED1はECCデ
コーダ30による誤り訂正後でもエラーが残ったデータ、
F1は誤り訂正後の各符号が有効か否かを示すエラー・フ
ラグである。エラー・フラグF1は、訂正済みの符号D1に
符号誤りが残った場合（訂正不能の場合）に“1"、符号
誤りが残らない場合（訂正できた場合及び符号誤りのな
い場合）に“0"である。第２図では、データD2に誤り訂
正不能の符号が残り、他の符号については、符号誤りが
あってもECCデコーダ30により完全に訂正されたとす
る。
第２図（１）は１回目ダビング時のECCデコーダ30へ
の入力符号列を示す。即ち、所定シンボル数の符号D
1（ｉ＝１〜ｎ）に対して所定シンボル数のパリテイP1
が付加されている。例えばリード・ソロモン（36、32）
方式では32シンボルの符号列に対して４シンボルのパリ
テイが付加されて、２シンボルの符号誤りが訂正可能で
ある。
の入力符号列を示す。即ち、所定シンボル数の符号D
1（ｉ＝１〜ｎ）に対して所定シンボル数のパリテイP1
が付加されている。例えばリード・ソロモン（36、32）
方式では32シンボルの符号列に対して４シンボルのパリ
テイが付加されて、２シンボルの符号誤りが訂正可能で
ある。
第２図（２）はECCデコーダ30の出力する符号列48を
模式的に示す。符号D1の符号誤りをパリテイP1で訂正
し、次の符号D2がECCデコーダ30に入力すると同時に
（厳密にはエラー訂正復号時間が必要であるが、本実施
例において本質的でないので、無視する）、訂正済みの
符号D1を出力し、その後の符号誤りの存否を示すエラー
・フラグF1を出力する。符号D1については符号誤りが残
っていないので、この場合、エラー・フラグF1は“0"で
ある。
模式的に示す。符号D1の符号誤りをパリテイP1で訂正
し、次の符号D2がECCデコーダ30に入力すると同時に
（厳密にはエラー訂正復号時間が必要であるが、本実施
例において本質的でないので、無視する）、訂正済みの
符号D1を出力し、その後の符号誤りの存否を示すエラー
・フラグF1を出力する。符号D1については符号誤りが残
っていないので、この場合、エラー・フラグF1は“0"で
ある。
符号D2に対しては、ECCデコーダ30は全ての符号誤り
を訂正することができず、符号誤りを含む符号ED2を出
力し、エラー・フラグF2は“1"である。D3〜Dnについて
は、符号誤りがあっても完全に訂正され、エラー・フラ
グF3〜Fnは“0"である。
を訂正することができず、符号誤りを含む符号ED2を出
力し、エラー・フラグF2は“1"である。D3〜Dnについて
は、符号誤りがあっても完全に訂正され、エラー・フラ
グF3〜Fnは“0"である。
第２図（３）は圧縮符号化回路16の出力する符号列54
を示しており、ECCデコーダ30の出力48が伸長回路32、
修正回路34及び圧縮符号化回路16により伸長・修正及び
再圧縮された信号を示す。修正回路34による修正を示す
ために、データD2の添え字ａを付加してある。即ち符号
誤りのある符号ED2が修整データD2aに変化した。このと
きの圧縮符号化回路16の出力54は、ECCデコーダ30の出
力に対して、伸長回路32、修整回路34及び圧縮符号化回
路16での処理時間に相当する時間τだけ遅れており、遅
延回路42の遅延時間もこの時間τに設定してある。第２
図（４）は遅延回路42の出力信号58を示す。
を示しており、ECCデコーダ30の出力48が伸長回路32、
修正回路34及び圧縮符号化回路16により伸長・修正及び
再圧縮された信号を示す。修正回路34による修正を示す
ために、データD2の添え字ａを付加してある。即ち符号
誤りのある符号ED2が修整データD2aに変化した。このと
きの圧縮符号化回路16の出力54は、ECCデコーダ30の出
力に対して、伸長回路32、修整回路34及び圧縮符号化回
路16での処理時間に相当する時間τだけ遅れており、遅
延回路42の遅延時間もこの時間τに設定してある。第２
図（４）は遅延回路42の出力信号58を示す。
エラー位置記憶回路40は、“1"の立ったエラー・フラ
グF1（本実施例ではF2）を記憶し、これに相当する符号
D1（本実施例ではD2）が端子35、45から出力されるタイ
ミングで、スイツチ44をｂ接点側に切り換える。即ち、
スイツチ44は、ECCデコーダ30でもエラー訂正しきれな
かった符号については、ｂ接点側に接続して、修整回路
34で修整され、圧縮符号化回路16で再圧縮された符号を
選択し、ECCデコーダ30の出力段階で符号誤りが存在し
ない符号については、ａ接点側に接続することにより、
遅延回路42で時間調整された誤りのない圧縮情報符号を
選択する。第２図（５）はこのように選択された符号列
（具体的にはECCエンコーダ18の出力）を示す。ECCエン
コーダ18は、修整符号D2aに対して、元のパリテイP2と
は異なるパリテイP2aを付加する。他の符号D1、D3〜Dn
については、当然に同じパリテイP1、P3〜Pnが付加され
る。
グF1（本実施例ではF2）を記憶し、これに相当する符号
D1（本実施例ではD2）が端子35、45から出力されるタイ
ミングで、スイツチ44をｂ接点側に切り換える。即ち、
スイツチ44は、ECCデコーダ30でもエラー訂正しきれな
かった符号については、ｂ接点側に接続して、修整回路
34で修整され、圧縮符号化回路16で再圧縮された符号を
選択し、ECCデコーダ30の出力段階で符号誤りが存在し
ない符号については、ａ接点側に接続することにより、
遅延回路42で時間調整された誤りのない圧縮情報符号を
選択する。第２図（５）はこのように選択された符号列
（具体的にはECCエンコーダ18の出力）を示す。ECCエン
コーダ18は、修整符号D2aに対して、元のパリテイP2と
は異なるパリテイP2aを付加する。他の符号D1、D3〜Dn
については、当然に同じパリテイP1、P3〜Pnが付加され
る。
なお、符号列58（第２図（４））と符号列56（第２図
（５））との時間差Ｔは、ECCエンコーダ18に処理時間
に相当する。
（５））との時間差Ｔは、ECCエンコーダ18に処理時間
に相当する。
以上のようにして、本実施例では、ダビングすべき符
号に訂正不能な符号誤りが無ければ、帯域圧縮されてい
る符号をそのままダビングし、誤りが残った場合にの
み、伸張・修整及び再圧縮を行ってダビングする。これ
により、帯域圧縮の繰り返しによる画質劣化を最小限に
抑えることができる。
号に訂正不能な符号誤りが無ければ、帯域圧縮されてい
る符号をそのままダビングし、誤りが残った場合にの
み、伸張・修整及び再圧縮を行ってダビングする。これ
により、帯域圧縮の繰り返しによる画質劣化を最小限に
抑えることができる。
第３図は本発明の他の実施例としてのダビングシステ
ムの構成を示すブラツク図であり、図中第１図と同様の
機能を果たすものについては同一番号を付した。図示の
如く、本実施例のシステムではマスター側VTR（Ｍ）内
に修整回路34の出力を圧縮符号化する圧縮符号化回路1
6′及びエラー位置記憶回路40から出力されるフラグデ
ータにより制御されるスイツチ44′を設け、第１図のシ
ステムではダビング時にスイツチ44から得られたダビン
グ用符号列をスイツチ44′で得ている。
ムの構成を示すブラツク図であり、図中第１図と同様の
機能を果たすものについては同一番号を付した。図示の
如く、本実施例のシステムではマスター側VTR（Ｍ）内
に修整回路34の出力を圧縮符号化する圧縮符号化回路1
6′及びエラー位置記憶回路40から出力されるフラグデ
ータにより制御されるスイツチ44′を設け、第１図のシ
ステムではダビング時にスイツチ44から得られたダビン
グ用符号列をスイツチ44′で得ている。
従って、このスイツチ44′の出力する符号列を出力端
子51を介して、スレーブ側VTR（Ｓ）の入力端子53に入
力し、ダビング時にはスイツチ19にて圧縮回路16の出力
する符号列に代えて、この入力端子53からの入力符号列
を記憶する。これによって、第１図のシステムと同様の
効果が得られる。また、本実施例のシステムにおいては
第１図のシステムに比し、マスター側VTR（Ｍ）とスレ
ーブ側VTR（Ｓ）の接続ライン数が少なくなるという利
点がある。
子51を介して、スレーブ側VTR（Ｓ）の入力端子53に入
力し、ダビング時にはスイツチ19にて圧縮回路16の出力
する符号列に代えて、この入力端子53からの入力符号列
を記憶する。これによって、第１図のシステムと同様の
効果が得られる。また、本実施例のシステムにおいては
第１図のシステムに比し、マスター側VTR（Ｍ）とスレ
ーブ側VTR（Ｓ）の接続ライン数が少なくなるという利
点がある。
上記説明は、記録媒体として磁気テープを例に取った
が、光デイスク、光磁気デイスク、固体メモリなどの各
種の記録媒体の記録再生装置にも適用できることはいう
までもない。
が、光デイスク、光磁気デイスク、固体メモリなどの各
種の記録媒体の記録再生装置にも適用できることはいう
までもない。
以上の説明から容易に理解できるように、本発明によ
れば、ダビング時における情報データの伝送レートを抑
え、画質劣化を最小限に抑えることができる。
れば、ダビング時における情報データの伝送レートを抑
え、画質劣化を最小限に抑えることができる。
第１図は本発明の一実施例のダビングシステムの構成を
示すブロツク図、 第２図は第１図の各部の符号列を示す模式図、 第３図は本発明の他の実施例としてのダビングシステム
の構成を示すブロツク図、 第４図は従来のダビングシステムの構成例を示すブロツ
ク図である。 図中16は帯域圧縮符号化回路、18はECCエンコーダ、20
は記録アンプ、22は磁気ヘツド、28は再生アンプ、30は
ECCエンコーダ、32は伸張回路、34は修整回路、40はエ
ラー位置記憶回路、42は遅延回路、35、45、51は夫々出
力端子、43、47、53は夫々入力端子、Ｍはマスター側VT
R、Ｓはスレーブ側VTR、T1、T2は磁気テープである。
示すブロツク図、 第２図は第１図の各部の符号列を示す模式図、 第３図は本発明の他の実施例としてのダビングシステム
の構成を示すブロツク図、 第４図は従来のダビングシステムの構成例を示すブロツ
ク図である。 図中16は帯域圧縮符号化回路、18はECCエンコーダ、20
は記録アンプ、22は磁気ヘツド、28は再生アンプ、30は
ECCエンコーダ、32は伸張回路、34は修整回路、40はエ
ラー位置記憶回路、42は遅延回路、35、45、51は夫々出
力端子、43、47、53は夫々入力端子、Ｍはマスター側VT
R、Ｓはスレーブ側VTR、T1、T2は磁気テープである。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 ＦＩ Ｈ０４Ｎ 5/92 Ｈ０４Ｎ 5/92 Ｈ
Claims (1)
- 【請求項１】第１の記録媒体に記録されている情報符号
列を記録装置により第２の記録媒体に記録するダビング
システムにて用いられる再生装置であって、 情報量が圧縮され、且つ、誤り訂正符号化された情報デ
ータよりなる情報符号列を前記第１の記録媒体から再生
する再生手段と、 前記再生手段により再生された情報符号列に対して誤り
訂正復号処理を施し、前記情報符号列中のエラーを訂正
する誤り訂正手段と、 前記誤り訂正手段から出力された前記情報データの情報
量を伸長する伸長手段と、 前記誤り訂正手段にて訂正不能なエラーを前記情報デー
タの相関性を利用して補間する修整手段と、 前記誤り訂正手段により訂正不能なエラー以外の情報デ
ータと、前記修整手段により補間された情報データとを
それぞれ前記圧縮された状態で多重してダビング用符号
列を生成し、前記記録装置に出力する第１の出力手段
と、 前記修整手段により処理された情報データを前記伸長さ
れた状態で装置外部に出力する第２の出力手段とを備え
る再生装置。
Priority Applications (3)
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|---|---|---|---|
| JP2040236A JP2821223B2 (ja) | 1990-02-20 | 1990-02-20 | 再生装置 |
| US07/658,402 US5267094A (en) | 1990-02-20 | 1991-02-20 | Dubbing system for digital information |
| US08/209,378 US5440432A (en) | 1990-02-20 | 1994-03-14 | Dubbing system for digital information |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2040236A JP2821223B2 (ja) | 1990-02-20 | 1990-02-20 | 再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03242877A JPH03242877A (ja) | 1991-10-29 |
| JP2821223B2 true JP2821223B2 (ja) | 1998-11-05 |
Family
ID=12575088
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2040236A Expired - Fee Related JP2821223B2 (ja) | 1990-02-20 | 1990-02-20 | 再生装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (2) | US5267094A (ja) |
| JP (1) | JP2821223B2 (ja) |
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| US6002536A (en) * | 1990-07-06 | 1999-12-14 | Hitachi Ltd. | Digital transmission signal processing system and recording/reproducing system |
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| EP0657887B1 (en) * | 1993-12-13 | 2001-09-05 | Sony Corporation | Editing systems and methods |
| EP0695088B1 (en) * | 1994-07-29 | 2000-05-10 | Sharp Kabushiki Kaisha | Video storage type communication device |
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| JP3704358B2 (ja) * | 1996-07-03 | 2005-10-12 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | ディジタル情報信号の送信および受信 |
| JPH10276396A (ja) | 1997-03-28 | 1998-10-13 | Sony Corp | ディジタルビデオ信号記録再生装置およびその方法 |
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|---|---|---|---|---|
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| JPH07118154B2 (ja) * | 1987-08-20 | 1995-12-18 | パイオニア株式会社 | データ再生装置 |
| JPH0821199B2 (ja) * | 1987-09-14 | 1996-03-04 | 松下電器産業株式会社 | ディジタル信号ダビング方法 |
| JP2637438B2 (ja) * | 1987-10-27 | 1997-08-06 | キヤノン株式会社 | 画像処理装置 |
| US5130864A (en) * | 1989-10-11 | 1992-07-14 | Matsushita Electric Industrial Co., Ltd. | Digital recording and reproducing apparatus or digital recording apparatus |
| JP2821223B2 (ja) * | 1990-02-20 | 1998-11-05 | キヤノン株式会社 | 再生装置 |
-
1990
- 1990-02-20 JP JP2040236A patent/JP2821223B2/ja not_active Expired - Fee Related
-
1991
- 1991-02-20 US US07/658,402 patent/US5267094A/en not_active Expired - Lifetime
-
1994
- 1994-03-14 US US08/209,378 patent/US5440432A/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US5440432A (en) | 1995-08-08 |
| US5267094A (en) | 1993-11-30 |
| JPH03242877A (ja) | 1991-10-29 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |