JP2578984B2 - 映像信号変換回路 - Google Patents

映像信号変換回路

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JP2578984B2
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睦之 岡山
厚雄 越智
明弘 竹内
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Description

【発明の詳細な説明】 産業上の利用分野 この発明は、アスペクト比が4:3よりも大きい映像信
号のアスペクト比を変換する映像信号変換回路に関す
る。
従来の技術 ここで、アスペクト比が4:3よりも大きい映像信号を
以下では、ワイド映像信号と呼ぶことにし、記憶回路を
単にメモリーと呼ぶことにする。
現在のテレビ放送では、アスペクト比が4:3の信号の
みが用いられているので、映画画像のようなワイド映像
信号の場合、放送局側で映像信号の一部を除去してい
る。すなわち、受信側において、映像信号のアスペクト
比を変換する必要がない。
発明が解決しようとする課題 しかしながら、近年、より臨場感のあふれる映像を求
める要求が高まり、アスペクト比が4:3よりも大きい撮
影装置が普及する将来においては、ワイド映像信号を記
録再生するようになり、このとき、ワイド映像信号を記
録再生したものをアスペクト比が4:3のテレビで観賞す
れば、縦長の映像となる。すなわち、アスペクト比が4:
3のテレビで観賞しようとするならば、ワイド映像信号
のアスペクト比を4:3に変換する必要がある。
そこで、本発明はワイド映像信号をアスペクト比が4:
3のテレビに映し出す際に、不自然でない映像を出力す
るようにするものである。すなわち、ワイド映像信号の
アスペクト比を4:3に変換することを提供することを目
的としている。
課題を解決するための手段 この目的を達成するための本発明の技術的な手段は、
ワイド映像信号に対して、ディジタル変換を行いワイド
映像信号の一部をメモリーに書き込む際およびメモリー
に書き込まれている映像信号を読み出しアナログ変換を
行う際に、ディジタル変換およびメモリーに書き込むと
きのクロックとアナログ変換およびメモリーより読み出
すときのクロックとを異ならせることにより映像信号の
時間軸伸長を行なっていることと、メモリーの書き込み
制御回路において、書き込み可能期間を複数用意し、映
像画面に対して動きの量が検出できるような動き検出器
を用いて、書き込み可能期間を動き検出器の出力により
制御できるようにして、除去すべき映像部分を可変にし
たことである。
作用 この技術的な手段による作用は、次のようになる。
すなわち、この構成によって、除去する映像部分を選
択してワイド映像信号のアスペクト比を4:3に変換する
ことができ、しかも、アスペクト比が4:3のテレビでワ
イド映像放送を不自然に感じることなく観賞することが
可能である。
実施例 以下、本発明の一実施例を添付図面に基づいて映像信
号変換回路に関して1H分の入力信号を入力するものとし
て説明を行う。第1図において、1は水平同期信号分離
回路であり、2はクロック発生器であり、3は動き検出
器であり、4はA/Dコンバータであり、5はメモリー制
御回路であり、6はメモリーであり、7はクロック発生
器であり、8はD/Aコンバータである。第2図におい
て、aはワイド映像信号の画面であり、bにおけるAは
時間軸伸長すべき映像部分の画面であり、BおよびCは
削除すべき映像部分の画面であり、cはAの部分の映像
信号を時間軸伸長した画面図である。第3図において、
11,14はカウンタであり、12,13はROMである。
以上のように構成された映像信号変換回路について、
以下その動作を説明する。
まず、入力信号の水平同期信号に同期して動作するク
ロック発生器2からの出力クロックck1(ここでは17.6M
Hz)のサンプリングでA/D変換器4によりワイド映像信
号はディジタル信号に変換される。そして、これらのデ
ィジタル変換された映像信号の一部を除去して書き込み
クロックck1(17.6MHz)によりメモリー6に書き込む。
このときのメモリー6に書き込む映像信号は、第3図の
カウンタ11およびROM12および動き検出器3および書き
込み可能期間選択器15で制御を行う。すなわち、カウン
タのリセットパルスを入力信号の水平同期信号の立ち下
がりと同一のパルスとし、クロックck1によりカウント
アップを行うことによりROM12を制御して複数の書き込
み可能期間信号を生成し、ROM12から出力される複数の
書き込み可能期間信号を動き検出器3および書き込み可
能期間選択器15で制御を行う。この時、例えば、動きの
大きい部分ができるだけテレビ画面の中心に来るように
することが動き検出器3および書き込み可能期間選択器
15によりできる。
次に、メモリー6より映像信号を読み出す場合につい
て述べる。メモリー6の読み出しクロックは、入力信号
の水平同期信号に同期して動作するクロック発生器7か
らの出力クロックck2(ここでは14.3MHz)である。ま
た、メモリー6から映像信号を読み出す制御は、ROM13
およびカウンタ14で行う。すなわち、クロックck2でカ
ウンタ14のカウントアップを行いカウンタからの出力で
カウンタ値45までL(ロウ)を出力、カウンタ値46以降
221までH(ハイ)を出力、カウンタ値222以降Lを出力
するようにROM13のデータを設定する。そして、メモリ
ー6より読み出された映像信号は、クロックck2によりD
/A変換器8でアナログ信号に変えられる。
以上のように本実施例によれば、メモリー書き込み時
と読み出し時のクロックとを異ならせることにより時間
軸伸長を行って、映像信号のアスペクト比を変換するこ
とができ、また、動き検出器および書き込み可能期間選
択器を用いることにより、削除すべき映像部分を可変に
できる。
以下本発明の第2の実施例について添付図面に基づい
て説明する。第4図において、20,21はクランプ回路で
あり、22,23はA/Dコンバータであり、24,25はメモリー
であり、26,27はD/Aコンバータであり、28は同期信号生
成器であり、29はエンコーダである。
上記のように構成することにより、入力信号としてワ
イド映像信号のコンポーネント信号に対してもアスペク
ト比を変換することができる。
また、クロックck1およびck2の周波数とROM12および1
3のデータを変更することにより容易に他のアスペクト
比(4:3以外)の映像信号に変換することができる。
発明の効果 以上説明したように本発明によれば、ワイド映像信号
に対して、除去すべき映像信号を、画面を分割し各画面
ごとに動き量を検出できるような動き検出器により選択
でき、除去しない映像信号に対して、メモリー書き込み
時と読み出し時のクロックとを異ならせることにより時
間軸伸長してワイド映像信号のアスペクト比を4:3に変
換することができる優れた映像信号変換回路を実現でき
るものである。しかも次のような効果も得られる。
すなわち、ワイド映像信号用ホームVTRなどに本発明
の装置を組むことにより従来のアスペクト比が4:3のテ
レビでワイド映像信号による映像を観賞することがで
き、家庭の経済的効果も得られる。
【図面の簡単な説明】
第1図は本発明の実施例のブロック図、第2図は本発明
の一実施例におけるワイド映像信号のアスペクト比を4:
3に変換した際の映像信号を表した図、第3図はコント
ロール部の詳細ブロック図、第4図は本実施例に基づく
一例の簡単なブロック図である。 2……クロック発生器、3……動き検出器、5……制御
回路、6……メモリー、7……クロック発生器。

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項1】アスペクト比が4:3より大きい入力映像信
    号の水平同期信号に同期した特定の周波数f1を発振する
    第1の周波数発振回路と、前記水平同期信号に同期した
    特定の周波数f2(f2<f1)を発振する第2の周波数発振
    回路と、前記入力映像信号を周波数f1によりディジタル
    信号に変換するアナログ/ディジタル変換器と、周波数
    f1で前記ディジタル信号の書き込み動作を行い周波数f2
    で読み出し動作を行なう記憶回路と、前記記憶回路から
    読み出されたディジタル信号を周波数f2によりアナログ
    信号に変換し、アスペクト比が4:3の映像信号を得るデ
    ィジタル/アナログ変換器と、前記入力映像信号で構成
    される画面の動き量を検出する動き検出器と、前記記憶
    回路の書き込み制御と読み出し制御とを行ない、前記動
    き検出器で検出された動き量に基づいて、動きの大きい
    部分が画面の中央部に表示されるように前記記憶回路に
    書き込む際の書き込み可能期間を制御する制御回路とを
    備えたことを特徴とする映像信号変換回路。
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