JP2021064940A - Signal generation device and signal reading system - Google Patents

Signal generation device and signal reading system Download PDF

Info

Publication number
JP2021064940A
JP2021064940A JP2020162898A JP2020162898A JP2021064940A JP 2021064940 A JP2021064940 A JP 2021064940A JP 2020162898 A JP2020162898 A JP 2020162898A JP 2020162898 A JP2020162898 A JP 2020162898A JP 2021064940 A JP2021064940 A JP 2021064940A
Authority
JP
Japan
Prior art keywords
signal
voltage
waveform
restoration
logic
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2020162898A
Other languages
Japanese (ja)
Inventor
浩一 柳沢
Koichi Yanagisawa
浩一 柳沢
真 笠井
Makoto Kasai
真 笠井
大桂 池田
Taikei Ikeda
大桂 池田
智春 坂井
Tomoharu Sakai
智春 坂井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hioki EE Corp
Original Assignee
Hioki EE Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hioki EE Corp filed Critical Hioki EE Corp
Priority to EP20874105.8A priority Critical patent/EP4044536A4/en
Priority to PCT/JP2020/037561 priority patent/WO2021070746A1/en
Publication of JP2021064940A publication Critical patent/JP2021064940A/en
Pending legal-status Critical Current

Links

Images

Landscapes

  • Dc Digital Transmission (AREA)

Abstract

To generate an accurate code identification signal while adopting a configuration connected to a communication path via the coupling capacitance.SOLUTION: A signal generation device 2A that generates a code identification signal Sf that can identify a code corresponding to a logic signal Sa transmitted via a CAN bus (communication channel) SB composed of covered conductors La and Lb on the basis of the logic signal Sa includes: a signal restoration unit 8 that generates a restoration signal Sre of the signal waveform equivalent to the signal waveform of the logic signal Sa by integrating the signal waveform corresponding to the differential waveform of the logic signal Sa detected from the covered conductors La and Lb; and a signal generation unit 6 that generates the code identification signal Sf by comparing the restoration signal Sre with a threshold voltage Vth and binarizing the restoration signal Sre.SELECTED DRAWING: Figure 2

Description

本発明は、通信路を介して伝送される2線差動電圧方式のロジック信号に基づいてロジック信号に対応する符号列を特定可能な符号特定用信号を生成する信号生成装置、およびそのような信号生成装置を備えた信号読取システムに関するものである。 The present invention is a signal generator that generates a code identification signal capable of specifying a code string corresponding to a logic signal based on a logic signal of a two-wire differential voltage system transmitted via a communication path, and such a signal generator. It relates to a signal reading system equipped with a signal generator.

例えば、下記の特許文献1には、CAN通信用のシリアルバス(車内LAN)を介して伝送されている各種CANフレーム(制御データ)を収集して記録可能に構成された車両データ収集装置(以下、単に「収集装置」ともいう)の発明が開示されている。この収集装置は、故障診断やメンテナンスなどを目的として外部機器を接続可能にシリアルバスに設けられているダイアグコネクタ(診断機器接続用コネクタ:以下、単に「コネクタ」ともいう)に接続可能に構成されている。また、この収集装置では、上記のコネクタに接続することでコネクタを介して供給される電源によって動作し、イグニッションスイッチの操作に連動してシリアルバスからのCANフレームの収集の開始/停止を自動的に実行する構成が採用されている。 For example, in Patent Document 1 below, a vehicle data collection device (hereinafter referred to as a vehicle data collection device) configured to collect and record various CAN frames (control data) transmitted via a serial bus (in-vehicle LAN) for CAN communication. , Simply referred to as a "collector") is disclosed. This collection device is configured to be able to connect to a diagnostic connector (connector for connecting diagnostic equipment: hereinafter simply referred to as "connector") provided on the serial bus so that external equipment can be connected for the purpose of failure diagnosis and maintenance. ing. In addition, this collection device is operated by the power supply supplied through the connector by connecting to the above connector, and automatically starts / stops collecting CAN frames from the serial bus in conjunction with the operation of the ignition switch. The configuration to be executed is adopted.

ところで、上記の収集装置の構成とは異なる構成(シリアルバスに設けられているコネクタを使用しない構成)で、シリアルバスからCANフレームを読み取る装置が望まれていたため、本願出願人は、下記の特許文献2に開示されている信号生成装置および信号読取システムを提案した。 By the way, since a device that reads a CAN frame from a serial bus with a configuration different from the configuration of the above-mentioned collecting device (a configuration that does not use a connector provided on the serial bus) has been desired, the applicant of the present application has obtained the following patent. We have proposed a signal generator and a signal reading system disclosed in Document 2.

この信号生成装置は、通信路(CAN通信用のシリアルバスを構成する一対の被覆導線)を介して伝送される2線差動電圧方式のロジック信号における高電位期間および低電位期間の配列パターンであるロジックパターンに従って変化する各被覆導線間の電位差の変化を示す差分信号を検出する検出部と、信号生成部とを備えて、ロジック信号に対応する符号列を特定可能な符号特定用信号を生成する。 This signal generator has an arrangement pattern of a high potential period and a low potential period in a 2-wire differential voltage type logic signal transmitted via a communication path (a pair of covered conductors constituting a serial bus for CAN communication). A code identification signal capable of specifying a code string corresponding to a logic signal is generated by providing a detection unit for detecting a difference signal indicating a change in potential difference between each coated lead wire that changes according to a certain logic pattern and a signal generation unit. To do.

この場合、検出部は、一次巻線および二次巻線を有するトランスとこの二次巻線の各端子間に接続された抵抗とを備えて、一対の被覆導線における被覆部にそれぞれ接触させられる一対の電極とこの一対の被覆導線との間の結合容量を介してこの一対の電極によって検出された各信号を一次巻線の各端子に入力すると共に二次巻線の各端子から出力される出力信号に基づいて、上記の差分信号を検出する。信号生成部は、差分信号の立ち上がり時の電圧が第1基準値以上となったときを低電圧期間の開始とし、かつ差分信号の立ち下がり時の電圧が第2基準値以下となったときを高電圧期間の開始とする信号を符号特定用信号として生成する。 In this case, the detection unit is provided with a transformer having a primary winding and a secondary winding and a resistor connected between each terminal of the secondary winding, and is brought into contact with the coating part of the pair of coated conductors, respectively. Each signal detected by the pair of electrodes is input to each terminal of the primary winding through the coupling capacitance between the pair of electrodes and the pair of coated conductors, and is output from each terminal of the secondary winding. The above difference signal is detected based on the output signal. The signal generation unit starts the low voltage period when the voltage at the rising edge of the difference signal becomes equal to or higher than the first reference value, and when the voltage at the falling edge of the difference signal becomes equal to or lower than the second reference value. A signal for starting the high voltage period is generated as a code identification signal.

この構成の信号生成装置では、一対の電極と検出部とを接続するシールドケーブルの配線容量を考慮しない構成(この配線容量の容量値が無視し得る程度に小さい構成)においては、被覆導線の電圧が結合容量で微分されて電極に伝送される構成のため、検出部から出力される差分信号Sdは、図16に示すように、一対の被覆導線の各電圧Va,Vbの差分電圧(Va−Vb)で表されるロジック信号Saの低電圧の状態(符号Cs「1」を示すレセッシブの状態)から高電圧の状態(符号Cs「0」を示すドミナントの状態)に移行するタイミング(ロジック信号Saの立ち上がりエッジ)でゼロボルトから最大正電圧まで短時間に立ち上がり、その後、徐々に低下してゼロボルトに戻り、ロジック信号Saの高電圧の状態から低電圧の状態に移行するタイミング(ロジック信号Saの立ち下がりエッジ)でゼロボルトから最大負電圧まで短時間に立ち下がり、その後、徐々に上昇してゼロボルトに戻るという波形(微分波形)の信号となっている。 In the signal generator having this configuration, in a configuration that does not consider the wiring capacitance of the shield cable connecting the pair of electrodes and the detection unit (a configuration in which the capacitance value of this wiring capacitance is so small that it can be ignored), the voltage of the coated lead wire Is differentiated by the coupling capacitance and transmitted to the electrode, so that the difference signal Sd output from the detection unit is the difference voltage (Va-) of each voltage Va, Vb of the pair of coated conductors, as shown in FIG. The timing (logic signal) of transitioning from the low voltage state of the logic signal Sa represented by Vb) (the recessive state indicating the reference numeral Cs "1") to the high voltage state (the dominant state indicating the reference numeral Cs "0"). At the rising edge of Sa), the voltage rises from zero volt to the maximum positive voltage in a short time, then gradually decreases and returns to zero volt, and the timing of transition from the high voltage state of the logic signal Sa to the low voltage state (logic signal Sa). It is a signal with a waveform (differential waveform) that falls from zero volt to the maximum negative voltage in a short time at the falling edge), then gradually rises and returns to zero volt.

検出部の後段に配設された信号生成部は、一例として、正負の2つの作動電圧(例えば、±5V)で動作するヒステリシス付のコンパレータ(出力電圧がゼロボルトを基準として抵抗分圧されて非反転入力端子に印加され、差分信号Sdが反転入力端子に入力されるコンパレータ)で構成されている。この構成により、信号生成部は、図16に示すように、正側の出力電圧(正側の作動電圧に近い電圧)が抵抗分圧されて得られる第1基準値としての正側閾値Vr1と、負側の出力電圧(負側の作動電圧に近い電圧)が抵抗分圧されて得られる第2基準値としての負側閾値Vr2(|Vr2|=|Vr1|)とに基づいて、検出部からの差分信号Sdを二値化信号としての符号特定用信号Sfに変換して出力する。この場合、図16に示すように、符号特定用信号Sfは、高電圧期間がロジック信号Saの符号「1」の期間(レセッシブ)に対応し、低電圧期間がロジック信号Saの符号「0」の期間(ドミナント)に対応している。 As an example, the signal generation unit arranged after the detection unit is a comparator with hysteresis that operates at two positive and negative operating voltages (for example, ± 5V) (the output voltage is divided by resistance with reference to zero volt and is not). It is composed of a comparator) that is applied to the inverting input terminal and the difference signal Sd is input to the inverting input terminal. With this configuration, as shown in FIG. 16, the signal generator has a positive voltage Vr1 as a first reference value obtained by dividing the output voltage on the positive side (voltage close to the operating voltage on the positive side) by resistance. , The detection unit is based on the negative side threshold Vr2 (| Vr2 | = | Vr1 |) as the second reference value obtained by dividing the negative side output voltage (voltage close to the negative side operating voltage) by resistance. The difference signal Sd from the above is converted into a code specifying signal Sf as a voltage-separated signal and output. In this case, as shown in FIG. 16, in the code identification signal Sf, the high voltage period corresponds to the period (recessive) of the code “1” of the logic signal Sa, and the low voltage period corresponds to the code “0” of the logic signal Sa. It corresponds to the period (dominant) of.

特開2008−70133号公報(第4−11頁、第1−17図)Japanese Unexamined Patent Publication No. 2008-70133 (Pages 4-11, Fig. 1-17) 特開2019−146141号公報(第14−16頁、第1−3図)Japanese Unexamined Patent Publication No. 2019-146141 (pages 14-16, Fig. 1-3)

ところが、CAN通信用のシリアルバスでは、シリアルバスに接続されている複数の電子制御装置(ECU)から出力される信号同士が衝突する事態が常態において発生している。このため、ロジック信号Saの信号波形は、上記した図16に示すような、符号Cs「1」,「0」の各期間において、符号「1」,「0」に対応した電圧(低電圧または高電圧)で一定となる理想的な波形ではなく、図17に示すように、特に高電圧の期間においてパルス状やステップ状に上昇したり低下したりする波形となっている。このため、上記の本願出願人が提案した信号生成装置のように、検出部が、ロジック信号Saの微分波形に相当する信号波形の差分信号Sdを生成し、かつヒステリシス付のコンパレータで構成される信号生成部が、この差分信号Sdを正側閾値Vr1および負側閾値Vr2と比較して符号特定用信号Sfを生成する構成では、図17に示すように、符号Cs「1」,「0」の切り替わりタイミング以外のときにおいても、ロジック信号Saの電圧がパルス状やステップ状に上昇したり低下したりする際の変化率が大きいタイミングで、差分信号Sdが正側閾値Vr1を上回ったり(例えば、同図中の時間t2,t4,t6のタイミング)、負側閾値Vr2を下回ったり(例えば、同図中の時間t1,t3,t5のタイミング)する状態が発生する。したがって、この信号生成装置には、図17に示すように、符号「0」に対応した低電圧期間において一時的に高電圧となる状態が発生する(つまり、誤った符号特定用信号Sfが生成される)という改善すべき課題が存在している。 However, in the serial bus for CAN communication, a situation in which signals output from a plurality of electronic control devices (ECUs) connected to the serial bus collide with each other occurs in a normal state. Therefore, the signal waveform of the logic signal Sa has a voltage (low voltage or low voltage) corresponding to the reference numerals “1” and “0” in each period of the reference numerals “1” and “0” as shown in FIG. It is not an ideal waveform that becomes constant at high voltage), but as shown in FIG. 17, it is a waveform that rises and falls in a pulsed or stepped manner particularly during a high voltage period. Therefore, like the signal generator proposed by the applicant of the present application, the detection unit generates a difference signal Sd of the signal waveform corresponding to the differential waveform of the logic signal Sa, and is composed of a comparator with hysteresis. In the configuration in which the signal generation unit generates the code identification signal Sf by comparing the difference signal Sd with the positive side threshold Vr1 and the negative side threshold Vr2, as shown in FIG. 17, the symbols Cs “1” and “0” Even at times other than the switching timing of, the difference signal Sd exceeds the positive threshold value Vr1 at a timing when the rate of change when the voltage of the logic signal Sa rises or falls in a pulse or step shape is large (for example). (Timing of time t2, t4, t6 in the figure) or below the negative threshold value Vr2 (for example, timing of time t1, t3, t5 in the figure) occurs. Therefore, as shown in FIG. 17, the signal generator is in a state where the voltage temporarily becomes high during the low voltage period corresponding to the code "0" (that is, an erroneous code identification signal Sf is generated). There is a problem to be improved.

本発明は、かかる改善すべき課題に鑑みてなされたものであり、結合容量を介してCAN通信用のシリアルバスのような通信路と接続される構成を採用しつつ、ロジック信号で示される符号を正確に特定し得る符号特定用信号を生成可能な信号生成装置および信号読取システムを提供することを主目的とする。 The present invention has been made in view of the problem to be improved, and while adopting a configuration in which a communication path such as a serial bus for CAN communication is connected via a coupling capacitance, a code represented by a logic signal is used. It is a main object of the present invention to provide a signal generation device and a signal reading system capable of generating a code identification signal capable of accurately specifying the above.

上記目的を達成すべく本発明の信号生成装置は、被覆導線で構成される通信路を介して伝送されるロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、前記被覆導線から検出された前記ロジック信号の微分波形に相当する信号波形を積分することにより、当該ロジック信号の信号波形と同等の信号波形の復元信号を生成する信号復元部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えている。 In order to achieve the above object, the signal generator of the present invention generates a code identification signal capable of specifying a code corresponding to the logic signal based on a logic signal transmitted via a communication path composed of a covered conductive wire. A signal generator that generates a restored signal having a signal waveform equivalent to the signal waveform of the logic signal by integrating a signal waveform corresponding to the differential waveform of the logic signal detected from the coated lead wire. It includes a restoration unit and a signal generation unit that generates the code identification signal by binarizing the restoration signal with a threshold voltage.

また、本発明の信号生成装置は、上記の信号生成装置において、前記信号復元部は、一次巻線および二次巻線を有するトランスと当該二次巻線の各端子間に接続された抵抗とを備えて、前記被覆導線における被覆部に接触させられる電極と当該被覆導線との間の結合容量を介して当該電極によって検出された信号を前記一次巻線に入力すると共に前記二次巻線から出力される前記ロジック信号の微分波形に相当する信号波形を積分することにより前記復元信号を生成する。ここで、この信号生成装置としては、以下の構成を採用することができる。例えば、通信路が一対の被覆導線で構成されている場合、一対の被覆導線で構成される通信路を介して伝送される2線差動電圧方式のロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、一次巻線および二次巻線を有するトランスと当該二次巻線の各端子間に接続された抵抗とを備えて、前記一対の被覆導線における被覆部にそれぞれ接触させられる一対の電極と当該一対の被覆導線との間の結合容量を介して当該一対の電極によって検出された各信号を前記一次巻線の各端子に入力すると共に前記二次巻線の各端子から出力される出力信号に基づいて前記ロジック信号の微分波形に相当する信号波形の検出信号を出力する検出部と、前記検出信号を積分することにより、前記ロジック信号の信号波形と同等の信号波形の復元信号を出力する積分部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えて構成される。また、通信路が1本の被覆導線で構成されている場合、1本の被覆導線で構成される通信路を介して伝送されるロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、一次巻線および二次巻線を有するトランスと当該二次巻線の各端子間に接続された抵抗とを備えて、前記被覆導線における被覆部に接触させられる電極と当該被覆導線との間の結合容量を介して当該電極によって検出された信号を前記一次巻線に入力すると共に前記二次巻線から出力される出力信号に基づいて前記ロジック信号の微分波形に相当する信号波形の検出信号を出力する検出部と、前記検出信号を積分することにより、前記ロジック信号の信号波形と同等の信号波形の復元信号を出力する積分部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えて構成される。 Further, in the signal generation device of the present invention, in the above signal generation device, the signal restoration unit is a resistor connected between a transformer having a primary winding and a secondary winding and each terminal of the secondary winding. The signal detected by the electrode is input to the primary winding and from the secondary winding through the coupling capacitance between the electrode brought into contact with the coating portion of the coated lead wire and the coated lead wire. The restored signal is generated by integrating a signal waveform corresponding to the differential waveform of the output logic signal. Here, the following configuration can be adopted as this signal generator. For example, when the communication path is composed of a pair of coated conductors, the logic signal corresponds to the logic signal of the two-wire differential voltage system transmitted via the communication path composed of the pair of coated conductors. A signal generator that generates a code-identifiable code-specific signal, including a transformer with primary and secondary windings and a resistor connected between each terminal of the secondary winding. Each signal detected by the pair of electrodes via the coupling capacitance between the pair of electrodes brought into contact with the covering portion of the pair of coated conductors and the pair of coated conductors is sent to each terminal of the primary winding. By integrating the detection signal with the detection unit that outputs the detection signal of the signal waveform corresponding to the differential waveform of the logic signal based on the output signal that is input and is output from each terminal of the secondary winding. An integrating unit that outputs a restored signal having a signal waveform equivalent to the signal waveform of the logic signal, and a signal generating unit that generates a code identification signal by binarizing the restored signal with a threshold voltage. Be prepared. Further, when the communication path is composed of one covered lead wire, the code corresponding to the logic signal can be specified based on the logic signal transmitted through the communication path composed of one covered lead wire. A signal generator that generates a code identification signal, comprising a transformer having a primary winding and a secondary winding and a resistor connected between each terminal of the secondary winding, and covering the coated lead wire. The signal detected by the electrode is input to the primary winding through the coupling capacitance between the electrode brought into contact with the portion and the coated lead wire, and the signal is input to the primary winding and based on the output signal output from the secondary winding. A detection unit that outputs a detection signal of a signal waveform corresponding to a differential waveform of a logic signal, and an integration unit that outputs a restoration signal of a signal waveform equivalent to the signal waveform of the logic signal by integrating the detection signal. It is configured to include a signal generation unit that generates the code identification signal by binarizing the restored signal with a threshold voltage.

また、本発明の信号生成装置は、上記の信号生成装置において、前記信号復元部は、前記被覆導線における被覆部に接触させられる電極と当該被覆導線との間の結合容量を介して容量結合を介して当該電極によって検出された信号を入力する抵抗素子を備え、当該抵抗素子に発生した前記ロジック信号の微分波形に相当する信号波形を積分することにより前記復元信号を生成する。ここで、この信号生成装置としては、以下の構成を採用することができる。例えば、通信路が一対の被覆導線で構成されている場合、一対の被覆導線で構成される通信路を介して伝送される2線差動電圧方式のロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、前記一対の被覆導線における被覆部にそれぞれ接触させられる一対の電極のうちの一方の電極と接続されて、前記一対の被覆導線のうちの当該一方の電極と容量結合する一方の被覆導線に伝送されている電圧信号の微分波形に相当する信号波形の第1電圧信号を発生させる第1抵抗素子、前記一対の電極のうちの他方の電極と接続されて、前記一対の被覆導線のうちの当該他方の電極と容量結合する他方の被覆導線に伝送されている電圧信号の微分波形に相当する信号波形の第2電圧信号を発生させる第2抵抗素子、および前記第1電圧信号および前記第2電圧信号の差分電圧に基づいて前記ロジック信号の微分波形に相当する信号波形の検出信号を出力する差動増幅部を備えている検出部と、前記検出信号を積分することにより、前記ロジック信号の信号波形と同等の信号波形の復元信号を出力する積分部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えて構成される。また、通信路が1本の被覆導線で構成されている場合、1本の被覆導線で構成される通信路を介して伝送されるロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、前記被覆導線における被覆部に接触させられる電極と接続されて、当該電極と容量結合する当該被覆導線に伝送されている前記ロジック信号の微分波形に相当する信号波形の電圧信号を発生させる抵抗素子、および当該電圧信号を増幅して検出信号として出力する増幅部を備えている検出部と、前記検出信号を積分することにより、前記ロジック信号の信号波形と同等の信号波形の復元信号を出力する積分部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えて構成される。 Further, in the signal generation device of the present invention, in the above-mentioned signal generation device, the signal restoration unit performs a capacitance coupling via a coupling capacitance between an electrode brought into contact with the coating portion of the coating conduction wire and the coating conduction wire. A resistance element for inputting a signal detected by the electrode is provided, and the restoration signal is generated by integrating a signal waveform corresponding to a differential waveform of the logic signal generated in the resistance element. Here, the following configuration can be adopted as this signal generator. For example, when the communication path is composed of a pair of coated conductors, the logic signal corresponds to the logic signal of the two-wire differential voltage system transmitted via the communication path composed of the pair of coated conductors. A signal generator that generates a code identification signal capable of specifying a code, and is connected to one of a pair of electrodes that are brought into contact with a coating portion of the pair of coating conductors, respectively, and is connected to the pair of coatings. Of the pair of electrodes, the first resistance element that generates the first voltage signal of the signal waveform corresponding to the differential waveform of the voltage signal transmitted to the one coated lead wire that is capacitively coupled to the one electrode of the lead wire. A second voltage signal having a signal waveform corresponding to a differential waveform of a voltage signal transmitted to the other coated conductor that is connected to the other electrode and is capacitively coupled to the other electrode of the pair of coated conductors. It includes a second resistance element to be generated, and a differential amplification unit that outputs a detection signal of a signal waveform corresponding to the differential waveform of the logic signal based on the difference voltage between the first voltage signal and the second voltage signal. By integrating the detection signal with the detection unit, an integrating unit that outputs a restoration signal having a signal waveform equivalent to the signal waveform of the logic signal, and by binarizing the restoration signal with a threshold voltage. It is configured to include a signal generation unit that generates the code specifying signal. Further, when the communication path is composed of one covered lead wire, the code corresponding to the logic signal can be specified based on the logic signal transmitted through the communication path composed of one covered lead wire. A signal generator that generates a code identification signal, and is a differential waveform of the logic signal transmitted to the coated conductor that is connected to an electrode that is brought into contact with the coated portion of the coated conductor and is capacitively coupled to the electrode. By integrating the detection signal with a detection unit having a resistance element that generates a voltage signal having a signal waveform corresponding to the above and an amplification unit that amplifies the voltage signal and outputs it as a detection signal, the logic signal can be obtained. It is configured to include an integrating unit that outputs a restored signal having a signal waveform equivalent to the signal waveform, and a signal generating unit that generates the code identification signal by binarizing the restored signal with a threshold voltage. To.

また、本発明の信号生成装置は、上記の信号生成装置において、前記信号復元部は、一次巻線および二次巻線を有するトランスと当該二次巻線の各端子間に接続された抵抗とを備えて、前記被覆導線に装着された電流検出プローブから出力される信号を前記一次巻線に入力すると共に前記二次巻線から出力される前記ロジック信号の微分波形に相当する信号波形を積分することにより前記復元信号を生成する。ここで、この信号生成装置としては、以下の構成を採用することができる。例えば、通信路が一対の被覆導線で構成されている場合、一対の被覆導線で構成される通信路を介して伝送される2線差動電圧方式のロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、一次巻線および二次巻線を有するトランスと当該二次巻線の各端子間に接続された抵抗とを備えて、前記一対の被覆導線のうちの一方の被覆導線に装着された第1電流検出プローブから出力される電流信号および前記一対の被覆導線のうちの他方の被覆導線に装着された第2電流検出プローブから出力される電流信号を前記一次巻線の各端子に入力すると共に前記二次巻線の各端子から出力される出力信号に基づいて前記ロジック信号の微分波形に相当する信号波形の検出信号を出力する検出部と、前記検出信号を積分することにより、前記ロジック信号の信号波形と同等の信号波形の復元信号を出力する積分部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えて構成される。また、通信路が1本の被覆導線で構成されている場合、1本の被覆導線で構成される通信路を介して伝送されるロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、一次巻線および二次巻線を有するトランスと当該二次巻線の各端子間に接続された抵抗とを備えて、前記被覆導線に装着された電流検出プローブから出力される電流信号を前記一次巻線に入力すると共に前記二次巻線から出力される出力信号に基づいて前記ロジック信号の微分波形に相当する信号波形の検出信号を出力する検出部と、前記検出信号を積分することにより、前記ロジック信号の信号波形と同等の信号波形の復元信号を出力する積分部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えて構成される。 Further, in the signal generation device of the present invention, in the above signal generation device, the signal restoration unit is a resistor connected between a transformer having a primary winding and a secondary winding and each terminal of the secondary winding. Is provided, a signal output from the current detection probe mounted on the coated lead wire is input to the primary winding, and a signal waveform corresponding to the differential waveform of the logic signal output from the secondary winding is integrated. By doing so, the restoration signal is generated. Here, the following configuration can be adopted as this signal generator. For example, when the communication path is composed of a pair of coated conductors, the logic signal corresponds to the logic signal of the two-wire differential voltage system transmitted via the communication path composed of the pair of coated conductors. A signal generator that generates a code-identifiable code-specific signal, including a transformer with primary and secondary windings and a resistor connected between each terminal of the secondary winding. From the current signal output from the first current detection probe mounted on one of the pair of coated conductors and the second current detection probe mounted on the other of the pair of coated conductors. The output current signal is input to each terminal of the primary winding, and the detection signal of the signal waveform corresponding to the differential waveform of the logic signal is output based on the output signal output from each terminal of the secondary winding. The detection unit to output the restoration signal of the signal waveform equivalent to the signal waveform of the logic signal by integrating the detection signal, and the restoration signal to be binarized by comparing with the threshold voltage. It is configured to include a signal generation unit that generates the code identification signal. Further, when the communication path is composed of one covered lead wire, the code corresponding to the logic signal can be specified based on the logic signal transmitted through the communication path composed of one covered lead wire. A signal generator that generates a code identification signal, which is equipped with a transformer having a primary winding and a secondary winding and a resistor connected between each terminal of the secondary winding, and is attached to the coated lead wire. The current signal output from the current detection probe is input to the primary winding, and the detection signal of the signal waveform corresponding to the differential waveform of the logic signal is output based on the output signal output from the secondary winding. The detection unit to output the restoration signal of the signal waveform equivalent to the signal waveform of the logic signal by integrating the detection signal, and the restoration signal to be binarized by comparing with the threshold voltage. It is configured to include a signal generation unit that generates the code identification signal.

また、本発明の信号生成装置は、上記の信号生成装置において、前記信号復元部は、前記被覆導線に装着された電流検出プローブから出力される信号を入力する抵抗素子を備え、当該抵抗素子に発生した前記ロジック信号の微分波形に相当する信号波形を積分することにより前記復元信号を生成する。ここで、この信号生成装置としては、以下の構成を採用することができる。例えば、通信路が一対の被覆導線で構成されている場合、一対の被覆導線で構成される通信路を介して伝送される2線差動電圧方式のロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、前記一対の被覆導線のうちの一方の被覆導線に装着された第1電流検出プローブと接続されて、当該一方の被覆導線に伝送されている電圧信号の微分波形に相当する信号波形の第1電圧信号を発生させる第1抵抗素子、前記一対の被覆導線のうちの他方の被覆導線に装着された第2電流検出プローブと接続されて、当該他方の被覆導線に伝送されている電圧信号の微分波形に相当する信号波形の第2電圧信号を発生させる第2抵抗素子、および前記第1電圧信号および前記第2電圧信号の差分電圧に基づいて前記ロジック信号の微分波形に相当する信号波形の検出信号を出力する差動増幅部を備えている検出部と、前記検出信号を積分することにより、前記ロジック信号の信号波形と同等の信号波形の復元信号を出力する積分部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えて構成される。また、通信路が1本の被覆導線で構成されている場合、1本の被覆導線で構成される通信路を介して伝送されるロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、前記被覆導線に装着された電流検出プローブと接続されて、当該被覆導線に伝送されている電圧信号の微分波形に相当する信号波形の電圧信号を発生させる抵抗素子、および当該発生させられた電圧信号を増幅して検出信号として出力する増幅部を備えている検出部と、前記検出信号を積分することにより、前記ロジック信号の信号波形と同等の信号波形の復元信号を出力する積分部と、前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えて構成される。 Further, in the signal generation device of the present invention, the signal restoration unit includes a resistance element for inputting a signal output from a current detection probe mounted on the coated lead wire, and the resistance element is provided with a resistance element. The restored signal is generated by integrating a signal waveform corresponding to the generated differential waveform of the logic signal. Here, the following configuration can be adopted as this signal generator. For example, when the communication path is composed of a pair of coated conductors, the logic signal corresponds to the logic signal of the two-wire differential voltage system transmitted via the communication path composed of the pair of coated conductors. A signal generator that generates a code identification signal capable of specifying a code, which is connected to a first current detection probe mounted on one of the pair of coated conductors and is connected to the one coated conductor. A first resistance element that generates a first voltage signal having a signal waveform corresponding to a differential waveform of the voltage signal transmitted to the device, and a second current detection probe mounted on the other coated conductor of the pair of coated conductors. A second resistance element that is connected and generates a second voltage signal having a signal waveform corresponding to a differential waveform of the voltage signal transmitted to the other coated lead wire, and the first voltage signal and the second voltage signal. A detection unit including a differential amplification unit that outputs a detection signal of a signal waveform corresponding to the differential waveform of the logic signal based on the differential voltage, and a signal waveform of the logic signal by integrating the detection signal. It is configured to include an integrating unit that outputs a restored signal having an equivalent signal waveform, and a signal generating unit that generates the code identification signal by binarizing the restored signal with a threshold voltage. Further, when the communication path is composed of one covered lead wire, the code corresponding to the logic signal can be specified based on the logic signal transmitted through the communication path composed of one covered lead wire. A signal generator that generates a code identification signal, which is connected to a current detection probe mounted on the coated conductor and has a signal waveform corresponding to a differential waveform of the voltage signal transmitted to the coated conductor. Is equivalent to the signal waveform of the logic signal by integrating the detection signal with the detection unit including the resistance element that generates the above and the amplification unit that amplifies the generated voltage signal and outputs it as a detection signal. It is configured to include an integrating unit that outputs a restored signal of the signal waveform of the above, and a signal generating unit that generates the code identification signal by binarizing the restored signal with a threshold voltage.

また、本発明の信号生成装置は、上記のいずれかの信号生成装置において、前記信号復元部と前記信号生成部との間に配設されて、前記復元信号を、当該復元信号のピークピーク電圧と同等のピークピーク電圧で、かつ低電圧期間の電圧がターゲット定電圧に規定されたシングルエンド信号に整形して出力する波形整形部を備えている。 Further, the signal generation device of the present invention is arranged between the signal restoration unit and the signal generation unit in any of the above signal generation devices, and the restoration signal is used as the peak peak voltage of the restoration signal. It is equipped with a waveform shaping unit that shapes and outputs a single-ended signal that has the same peak peak voltage as the above and the voltage during the low voltage period is defined as the target constant voltage.

また、本発明の信号生成装置は、上記のいずれかの信号生成装置において、前記信号復元部と前記信号生成部との間に配設されて、前記復元信号を、当該復元信号のピークピーク電圧と同等のピークピーク電圧で、かつ高電圧期間の電圧がターゲット定電圧に規定されたシングルエンド信号に整形して出力する波形整形部を備えている。 Further, the signal generation device of the present invention is arranged between the signal restoration unit and the signal generation unit in any of the above signal generation devices, and the restoration signal is used as the peak peak voltage of the restoration signal. It is equipped with a waveform shaping unit that shapes and outputs a single-ended signal that has the same peak peak voltage as the above and the voltage during the high voltage period is defined as the target constant voltage.

また、本発明の信号読取システムは、上記のいずれかに記載の信号生成装置と、前記信号生成装置によって生成された前記符号特定用信号を前記ロジック信号の通信方式に準拠した通信方式の信号に変換して出力する信号変換装置とを備えている。 Further, the signal reading system of the present invention converts the signal generation device according to any one of the above and the code identification signal generated by the signal generation device into a signal of a communication method based on the communication method of the logic signal. It is equipped with a signal conversion device that converts and outputs.

上記の信号生成装置、およびこの信号生成装置のうちのいずれかを備えた信号読取システムでは、信号復元部が、被覆導線で構成される通信路に伝送されるロジック信号の微分波形に相当する信号波形を積分してロジック信号の信号波形と同等の信号波形の復元信号を生成する。 In the above-mentioned signal generator and a signal reading system including any of the signal generators, the signal restoration unit is a signal corresponding to a differential waveform of a logic signal transmitted to a communication path composed of covered conductors. The waveforms are integrated to generate a restored signal with a signal waveform equivalent to the signal waveform of the logic signal.

したがって、これらの信号生成装置およびこの信号読取システムによれば、ロジック信号の信号波形にパルス状やステップ状の電圧変化が生じている状態においても、この電圧変化の影響を殆ど受けることなく、信号生成部において復元信号を1つの閾値電圧で正しく二値化して、正しい符号特定用信号を生成することができる。 Therefore, according to these signal generators and this signal reading system, even in a state where a pulsed or stepped voltage change occurs in the signal waveform of the logic signal, the signal is hardly affected by this voltage change. In the generation unit, the restoration signal can be correctly binarized with one threshold voltage to generate a correct code identification signal.

上記の信号生成装置、およびこの信号生成装置を備えた信号読取システムによれば、波形整形部が、信号復元部から出力された復元信号の振幅(ピークピーク電圧)を維持しつつ、低電圧側の電圧レベル(低電圧期間の電圧)をターゲット定電圧に揃えて(つまり、シングルエンド信号に整形して)、新たな復元信号として信号生成部に出力するため、信号生成部ではターゲット定電圧よりも若干高い電圧を閾値電圧として規定することで、信号復元部から出力されている復元信号における低電圧側の電圧レベルが変動しているときでも、シングルエンド信号に整形された新たな復元信号を閾値電圧で確実に二値化して符号特定用信号を生成することができる。 According to the above-mentioned signal generator and a signal reading system equipped with this signal generator, the waveform shaping unit maintains the amplitude (peak peak voltage) of the restored signal output from the signal restoration unit while maintaining the low voltage side. The voltage level (voltage during the low voltage period) is aligned with the target constant voltage (that is, shaped into a single-ended signal) and output to the signal generator as a new restoration signal. By defining a slightly higher voltage as the threshold voltage, a new restoration signal shaped into a single-ended signal can be generated even when the voltage level on the low voltage side of the restoration signal output from the signal restoration unit fluctuates. It is possible to reliably binarize at the threshold voltage to generate a code identification signal.

上記の信号生成装置、およびこの信号生成装置を備えた信号読取システムによれば、波形整形部が、信号復元部から出力された復元信号の振幅(ピークピーク電圧)を維持しつつ、高電圧側の電圧レベル(高電圧期間の電圧)をターゲット定電圧に揃えて(つまり、シングルエンド信号に整形して)、新たな復元信号として信号生成部に出力するため、信号生成部ではターゲット定電圧よりも若干低い電圧を閾値電圧として規定することで、信号復元部から出力されている復元信号における高電圧側の電圧レベルが変動しているときでも、シングルエンド信号に整形された新たな復元信号を閾値電圧で確実に二値化して符号特定用信号を生成することができる。 According to the above-mentioned signal generator and a signal reading system equipped with this signal generator, the waveform shaping unit maintains the amplitude (peak peak voltage) of the restored signal output from the signal restoration unit while maintaining the high voltage side. The voltage level (voltage during the high voltage period) is aligned with the target constant voltage (that is, shaped into a single-ended signal) and output to the signal generator as a new restoration signal. By defining a slightly lower voltage as the threshold voltage, a new restoration signal shaped into a single-ended signal can be generated even when the voltage level on the high voltage side of the restoration signal output from the signal restoration unit fluctuates. It is possible to reliably binarize at the threshold voltage to generate a code identification signal.

信号読取システム1Aの構成を示す構成図である。It is a block diagram which shows the structure of the signal reading system 1A. 信号生成装置2Aの構成を示す構成図である。It is a block diagram which shows the structure of the signal generation apparatus 2A. 符号Cs、ロジック信号Sa、電流信号I1、検出信号Sd、復元信号Sre、および符号特定用信号Sfの波形図である。It is a waveform diagram of the code Cs, the logic signal Sa, the current signal I1, the detection signal Sd, the restoration signal Sre, and the code specification signal Sf. 信号生成装置2Bの構成を示す構成図である。It is a block diagram which shows the structure of the signal generation apparatus 2B. 図4における差動増幅部23の他の構成を示す構成図である。It is a block diagram which shows the other structure of the differential amplification part 23 in FIG. 信号読取システム1Bの構成を示す構成図である。It is a block diagram which shows the structure of the signal reading system 1B. 信号生成装置2Cの構成を示す構成図である。It is a block diagram which shows the structure of the signal generation apparatus 2C. 信号生成装置2Dの構成を示す構成図である。It is a block diagram which shows the structure of the signal generator 2D. 信号生成装置2A(2B)を電流検出プローブPLc,PLdで被覆導線La,Lbに接続する信号読取システム1Cの構造を説明するための構成図である。It is a block diagram for demonstrating the structure of the signal reading system 1C which connects the signal generation apparatus 2A (2B) to the coated lead wire La, Lb by the current detection probes PLc, PLd. 信号生成装置2C(2D)を電流検出プローブPLcで被覆導線Lwに接続する信号読取システム1Dの構造を説明するための構成図である。It is a block diagram for demonstrating the structure of the signal reading system 1D which connects the signal generation apparatus 2C (2D) to the coated lead wire Lw by the current detection probe PLc. 信号生成装置2A,2B,2C,2Dの他の構成(波形整形部7を有する構成)を示す構成図である。It is a block diagram which shows the other structure (the structure which has the waveform shaping part 7) of the signal generation apparatus 2A, 2B, 2C, 2D. 図11中の信号生成部6および波形整形部7の回路図である。It is a circuit diagram of the signal generation unit 6 and the waveform shaping unit 7 in FIG. 図11中の信号生成部6および波形整形部7の他の回路図である。It is another circuit diagram of the signal generation unit 6 and the waveform shaping unit 7 in FIG. 信号生成装置2Aの他の構成を示す構成図である。It is a block diagram which shows another structure of a signal generator 2A. 信号生成装置2Bの他の構成を示す構成図である。It is a block diagram which shows another structure of a signal generator 2B. 背景技術を説明するための符号Cs、ロジック信号Sa、差分信号Sd、および符号特定用信号Sfの波形図である。It is a waveform diagram of the code Cs, the logic signal Sa, the difference signal Sd, and the code specifying signal Sf for explaining the background technique. 背景技術の課題を説明するための符号Cs、ロジック信号Sa、差分信号Sd、および符号特定用信号Sfの他の波形図である。It is another waveform diagram of the code Cs, the logic signal Sa, the difference signal Sd, and the code specifying signal Sf for explaining the problem of the background technique.

以下、信号生成装置および信号読取システムの実施の形態について、添付図面を参照して説明する。 Hereinafter, embodiments of the signal generator and the signal reading system will be described with reference to the accompanying drawings.

図1に示すように、「信号読取システム」の一例である信号読取システム1Aは、「信号生成装置」の一例である信号生成装置2Aを有して、一対の被覆導線La,Lbで構成される通信路SBを介して伝送される2線差動電圧方式のロジック信号(被覆導線La,Lbに伝送されている各電圧Va,Vbの差分で規定されるロジック信号Sa)を検出して、ロジック信号Saに対応する符号Cs(ロジック信号Saの電圧で示される「1」または「0」の符号。図3参照)を特定可能な符号特定用信号Sfを生成し(読み取り)、この符号特定用信号Sfを通信路SBのロジック信号Saと同じ通信プロトコルに準拠した送信信号Soに変換して、各種のCAN通信対応機器に出力(送信)することができるように構成されている。 As shown in FIG. 1, the signal reading system 1A, which is an example of the “signal reading system”, has the signal generating device 2A, which is an example of the “signal generating device”, and is composed of a pair of covered conductors La and Lb. A 2-wire differential voltage system logic signal (logic signal Sa defined by the difference between the voltages Va and Vb transmitted to the covered conductors La and Lb) transmitted via the communication path SB is detected. A code identification signal Sf capable of specifying the code Cs corresponding to the logic signal Sa (the code of "1" or "0" indicated by the voltage of the logic signal Sa; see FIG. 3) is generated (read), and this code specification is specified. The signal Sf is converted into a transmission signal So conforming to the same communication protocol as the logic signal Sa of the communication path SB, and is output (transmitted) to various CAN communication compatible devices.

この信号生成装置2Aおよび信号読取システム1Aは、このロジック信号Saとして、「CAN(登録商標)プロトコル」、「CAN FD」、「FlexRay(登録商標)」などの各種通信プロトコルに準拠した各種の「2線差動電圧方式のロジック信号」や、「LVDS」による小振幅低消費電力通信が可能な各種通信プロトコルに準拠した各種の「2線差動電圧方式のロジック信号」を対象とすることができる。この場合、「CANプロトコル」および「CAN FD」の「CAN通信用のシリアルバス」では、「高電位側信号線(CANH)/低電位側信号線(CANL)」が「ロジック信号を伝送するための一対の被覆導線」に相当し、「FlexRay通信用のシリアルバス」では、「正側信号線(BP)/負側信号線(BM)」が「ロジック信号を伝送するための一対の被覆導線」に相当し、「LVDSによる通信を行うシリアルバス」では、「正論理側信号線/負論理側信号線」が「ロジック信号を伝送するための一対の被覆導線」に相当する。以下では、一例として、自動車に配設されている通信路SBとしてのCANバス(CAN通信用のシリアルバス。以下、CANバスSBともいう)に適用した例を挙げて説明する。 The signal generator 2A and the signal reading system 1A use various "CAN (registered trademark) protocol", "CAN FD", "FlexRay (registered trademark)" and other communication protocols as the logic signal Sa. It is possible to target various "2-wire differential voltage system logic signals" that comply with various communication protocols that enable small-amplitude low-power consumption communication by "LVDS" and "2-wire differential voltage system logic signals". it can. In this case, in the "serial bus for CAN communication" of "CAN protocol" and "CAN FD", "high potential side signal line (CANH) / low potential side signal line (CANL)" transmits a "logic signal". In the "serial bus for FlexRay communication", the "positive side signal line (BP) / negative side signal line (BM)" corresponds to the "pair of covered wires", and the "pair of covered wires for transmitting logic signals". In the "serial bus that communicates by LVDS", the "positive logic side signal line / negative logic side signal line" corresponds to "a pair of covered conductors for transmitting a logic signal". In the following, as an example, an example applied to a CAN bus (serial bus for CAN communication, hereinafter also referred to as a CAN bus SB) as a communication path SB arranged in an automobile will be described.

信号読取システム1Aは、図1に示すように、信号生成装置2Aおよび信号変換装置3(「信号変換装置」の一例)を備えて構成されている。なお、CANバスSBを介してのロジック信号Saの伝送原理については公知のため、詳細な説明を省略するが、本例では、被覆導線Laが「CANH」に対応する信号線であり、被覆導線Lbが「CANL」に対応する信号線であるものとする。この構成により、各電圧Va,Vbの差分(Va−Vb)で規定されるロジック信号Saは、図3に示すように、低電圧となる期間では、符号Cs「1」を示すレセッシブの期間に対応し、高電圧となる期間では、符号Cs「0」を示すドミナントの期間に対応する。 As shown in FIG. 1, the signal reading system 1A includes a signal generation device 2A and a signal conversion device 3 (an example of a “signal conversion device”). Since the transmission principle of the logic signal Sa via the CAN bus SB is known, detailed description thereof will be omitted. However, in this example, the covered wire La is a signal line corresponding to "CANH", and the covered wire is a covered wire. It is assumed that Lb is a signal line corresponding to "CANL". With this configuration, as shown in FIG. 3, the logic signal Sa defined by the difference (Va-Vb) of the respective voltages Va and Vb is in the recessive period indicating the symbol Cs "1" in the low voltage period. Correspondingly, the period of high voltage corresponds to the dominant period indicating the symbol Cs "0".

信号生成装置2Aは、一例として、図2に示すように、検出部4A、積分部5および信号生成部6を備えると共に、一対のプローブPLa,PLbを介して一対の被覆導線La,Lbに接続されて、符号特定用信号Sfを生成して出力する。 As an example, the signal generation device 2A includes a detection unit 4A, an integration unit 5, and a signal generation unit 6, and is connected to a pair of coated conductors La and Lb via a pair of probes PLa and PLb. Then, the code identification signal Sf is generated and output.

一対のプローブPLa,PLbは、シールドケーブル(一例として、同軸ケーブル)を用いて、金属非接触型のプローブとして同一に構成されている。具体的には、プローブPLaは、対応する被覆導線Laに取り外し自在に接続される自由端側(自由端部)には、被覆導線Laの不図示の芯線と接続される(容量結合で接続される)電極部11aが配設され、また基端側(基端部)には、信号生成装置2Aの後述する入力端子部14,15のうちの対応する入力端子部14に接続される(固定的、または取り外し自在に接続される)不図示の接続コネクタが配設されて構成されている。また、プローブPLbは、対応する被覆導線Lbに取り外し自在に接続される自由端側(自由端部)には、被覆導線Lbの不図示の芯線と接続される(容量結合で接続される)電極部11bが配設され、また基端側(基端部)には、信号生成装置2Aの入力端子部14,15のうちの対応する入力端子部15に接続される(固定的、または取り外し自在に接続される)接続コネクタ(不図示)が配設されて構成されている。 The pair of probes PLa and PLb are configured in the same manner as a metal non-contact type probe by using a shielded cable (for example, a coaxial cable). Specifically, the probe PLa is connected to a core wire (not shown) of the coated lead wire La on the free end side (free end portion) which is detachably connected to the corresponding coated lead wire La (connected by capacitive coupling). The electrode portion 11a is arranged, and the base end side (base end portion) is connected (fixed) to the corresponding input terminal portion 14 of the input terminal portions 14 and 15 described later of the signal generator 2A. A connection connector (not shown) (which is connected to the target or detachably) is arranged and configured. Further, the probe PLb is an electrode connected to a core wire (not shown) of the coated lead wire Lb on the free end side (free end portion) removably connected to the corresponding coated lead wire Lb (connected by a capacitive coupling). A portion 11b is arranged, and the proximal end side (base end portion) is connected to the corresponding input terminal portion 15 of the input terminal portions 14 and 15 of the signal generator 2A (fixed or removable). A connection connector (not shown) (not shown) is arranged and configured.

電極部11aは、図1,2に示すように、被覆導線Laに接続された状態において、被覆導線Laの不図示の絶縁被覆部(以下、単に「被覆部」ともいう)に接触(当接)して、被覆導線Laの不図示の芯線(導体自体(金属部))と容量結合する電極12aと、被覆導線Laの被覆部における電極12aの接触部位をこの電極12aを含めて覆うことで、電極12aの他の金属部(被覆導線Laの芯線以外の金属部)との容量結合を防止するためのシールド13aとを備えている。また、電極12aは、プローブPLaを構成するシールドケーブルの芯線および入力端子部14の一の端子を介して検出部4Aの後述するトランス21における一次巻線21aの一方の端子TP1に接続されている。また、シールド13aは、このシールドケーブルのシールドおよび入力端子部14の他の端子を介して、信号生成装置2Aにおける一次側(トランス21の一次巻線21a側)の第1基準電位の部位(第1グランドG1)に接続されている。 As shown in FIGS. 1 and 2, the electrode portion 11a comes into contact with (contacts) an insulating coating portion (hereinafter, also simply referred to as “coating portion”) of the coating conductor La, which is not shown, in a state of being connected to the coated conductor La. ), By covering the contact portion between the electrode 12a, which is capacitively coupled to the core wire (conductor itself (metal part)) of the coated conductor La, which is not shown, and the electrode 12a in the coated portion of the coated conductor La, including the electrode 12a. , A shield 13a for preventing capacitance coupling with another metal portion of the electrode 12a (a metal portion other than the core wire of the coated conductor La) is provided. Further, the electrode 12a is connected to one terminal TP1 of the primary winding 21a in the transformer 21 described later of the detection unit 4A via the core wire of the shielded cable constituting the probe PLa and one terminal of the input terminal unit 14. .. Further, the shield 13a is a portion (first reference potential) of the primary side (primary winding 21a side of the transformer 21) in the signal generator 2A via the shield of the shielded cable and other terminals of the input terminal portion 14. It is connected to 1 ground G1).

また、電極部11bは、図1,2に示すように、被覆導線Lbに接続された状態において、被覆導線Lbの不図示の絶縁被覆部(以下、単に「被覆部」ともいう)に接触(当接)して、被覆導線Lbの不図示の芯線(導体自体(金属部))と容量結合する電極12bと、被覆導線Lbの被覆部における電極12bの接触部位をこの電極12bを含めて覆うことで、電極12bの他の金属部(被覆導線Lbの芯線以外の金属部)との容量結合を防止するためのシールド13bとを備えている。また、電極12bは、プローブPLbを構成するシールドケーブルの芯線および入力端子部15の一の端子を介して検出部4Aのトランス21における一次巻線21aの他方の端子TP2に接続されている。また、シールド13bは、このシールドケーブルのシールドおよび入力端子部15の他の端子を介して、第1グランドG1に接続されている。 Further, as shown in FIGS. 1 and 2, the electrode portion 11b is in contact with an insulating coated portion (hereinafter, also simply referred to as “covered portion”) of the coated conducting wire Lb (hereinafter, also simply referred to as “covered portion”) in a state of being connected to the coated conducting wire Lb. Covers the contact portion between the electrode 12b, which is capacitively coupled to the core wire (conductor itself (metal part)) of the coated conductor Lb (not shown), and the electrode 12b in the coated portion of the coated conductor Lb, including the electrode 12b. As a result, it is provided with a shield 13b for preventing capacitive coupling with another metal portion of the electrode 12b (a metal portion other than the core wire of the coated conductor Lb). Further, the electrode 12b is connected to the other terminal TP2 of the primary winding 21a in the transformer 21 of the detection unit 4A via the core wire of the shielded cable constituting the probe PLb and one terminal of the input terminal unit 15. Further, the shield 13b is connected to the first ground G1 via the shield of the shielded cable and other terminals of the input terminal portion 15.

この構成により、被覆導線Laの芯線から、この芯線と電極12aとの間の結合容量、電極12a、プローブPLaを構成するシールドケーブルの芯線、入力端子部14の一の端子、一次巻線21a、入力端子部15の一の端子、プローブPLbを構成するシールドケーブルの芯線、電極12b、被覆導線Lbの芯線と電極12bとの間の結合容量を経由して被覆導線Lbの芯線に至る電流経路(一次側電流経路ともいう)が形成される。また、この一次側電流経路は、このように容量成分(結合容量)が直列に接続されて構成されていることから、この一次側電流経路には、被覆導線La,Lbの各電圧Va,Vbの差分(Va−Vb)で規定されるロジック信号Saの信号波形を微分した信号波形(つまり、ロジック信号Saの信号波形が変化しない期間ではゼロに維持され、ロジック信号Saの信号波形に生じる立ち上がり部に同期して一時的に正側にスパイク状に増加した後に指数関数的に減少してゼロに戻り、一方、ロジック信号Saの信号波形に生じる立ち下がり部に同期して一時的に負側にスパイク状に増加した後に指数関数的に減少してゼロに戻る信号波形)の電流信号I1が図3に示す位相状態で流れる。 With this configuration, from the core wire of the coated lead wire La, the coupling capacitance between the core wire and the electrode 12a, the electrode 12a, the core wire of the shielded cable constituting the probe PLa, one terminal of the input terminal portion 14, the primary winding 21a, A current path (1 terminal of the input terminal portion 15, the core wire of the shielded cable constituting the probe PLb, the electrode 12b, the core wire of the coated lead wire Lb, and the core wire of the coated lead wire Lb via the coupling capacitance between the electrode 12b. The primary side current path) is formed. Further, since the primary side current path is configured by connecting the capacitance components (coupling capacitance) in series in this way, the primary side current path has the respective voltages Va and Vb of the coated lead wires La and Lb. The signal waveform obtained by differentiating the signal waveform of the logic signal Sa defined by the difference (Va-Vb) of (that is, the signal waveform of the logic signal Sa is maintained at zero during the period when the signal waveform does not change, and the rise that occurs in the signal waveform of the logic signal Sa After temporarily increasing to the positive side in a spike shape in synchronization with the part, it decreases exponentially and returns to zero, while it temporarily increases to the negative side in synchronization with the falling part generated in the signal waveform of the logic signal Sa. The current signal I1 (a signal waveform that increases exponentially and then returns to zero after increasing in a spike shape) flows in the phase state shown in FIG.

検出部4Aは、積分部5と相俟って信号復元部8を構成する。この場合、信号復元部8は、被覆導線La,Lbから検出されたロジック信号Saの微分波形に相当する信号波形を積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成する。検出部4Aは、図2に示すように、トランス21、抵抗22、差動増幅部23およびコンデンサ24を備えている。トランス21は、一次巻線21aおよび二次巻線21bを備えて、一次巻線21a側の回路と二次巻線21b側の回路とを電気的に絶縁するための絶縁トランスとして構成されている。また、トランス21は、一次巻線21aに流れる上記の電流信号I1(一次側電流信号)を予め規定された変流比(固定)で二次側電流信号I2に変換して、二次巻線21bを含む電流経路(二次側電流経路ともいう)に供給する。 The detection unit 4A and the integration unit 5 form a signal restoration unit 8. In this case, the signal restoration unit 8 integrates the signal waveform corresponding to the differential waveform of the logic signal Sa detected from the coated conductors La and Lb, thereby integrating the restoration signal Sre of the signal waveform equivalent to the signal waveform of the logic signal Sa. To generate. As shown in FIG. 2, the detection unit 4A includes a transformer 21, a resistor 22, a differential amplification unit 23, and a capacitor 24. The transformer 21 includes a primary winding 21a and a secondary winding 21b, and is configured as an isolation transformer for electrically insulating the circuit on the primary winding 21a side and the circuit on the secondary winding 21b side. .. Further, the transformer 21 converts the above-mentioned current signal I1 (primary side current signal) flowing through the primary winding 21a into a secondary side current signal I2 at a predetermined current change ratio (fixed), and causes the secondary winding. It is supplied to a current path including 21b (also referred to as a secondary current path).

また、一次巻線21aの端子TP1は、上記したように入力端子部14の一の端子を介してプローブPLaを構成するシールドケーブルの芯線(ひいては電極12a)に接続され、端子TP2は、上記したように入力端子部15の一の端子を介してプローブPLbを構成するシールドケーブルの芯線(ひいては電極12b)に接続される。この構成により、被覆導線La,Lbの芯線との間の結合容量を介して各電極12a,12bによって検出された各信号は一次巻線21aの各端子TP1,TP2に入力されて、一次巻線21aを含む上記の一次側電流経路に電流信号I1が流れる。二次巻線21bは、センタータップを備えて構成されている。このセンタータップは、信号生成装置2Aにおける二次側(トランス21の二次巻線21b側)の第2基準電位の部位(第2グランドG2)に接続されている。コンデンサ24は、第1グランドG1と第2グランドG2との間に接続されて、両グランドG1,G2を直流的には分離しつつ、交流的には接続する。 Further, the terminal TP1 of the primary winding 21a is connected to the core wire (and thus the electrode 12a) of the shielded cable constituting the probe PLa via one terminal of the input terminal portion 14 as described above, and the terminal TP2 is described above. As described above, the cable is connected to the core wire (and thus the electrode 12b) of the shielded cable constituting the probe PLb via one terminal of the input terminal portion 15. With this configuration, each signal detected by the electrodes 12a and 12b via the coupling capacitance between the coated lead wires La and Lb with the core wire is input to the terminals TP1 and TP2 of the primary winding 21a to be input to the primary winding. The current signal I1 flows through the primary side current path including 21a. The secondary winding 21b is configured to include a center tap. This center tap is connected to a portion (second ground G2) of the second reference potential on the secondary side (secondary winding 21b side of the transformer 21) of the signal generator 2A. The capacitor 24 is connected between the first ground G1 and the second ground G2, and connects the two grounds G1 and G2 in an alternating current while separating them in a direct current manner.

抵抗22は、二次巻線21bの各端子TP3,TP4間に接続されている。この構成により、抵抗22は、トランス21の二次巻線21bに上記の二次側電流経路を形成すると共に、この二次側電流経路に流れる二次側電流信号I2を電圧信号に変換する。この場合、二次巻線21bのセンタータップが第2グランドG2に接続されているため、この電圧信号は、第2グランドG2を基準として端子TP3に発生する(端子TP3から出力される)第1電圧信号Vc1(一例として、抵抗22で変換された上記の電圧信号の1/2の振幅で、かつこの電圧信号と同位相の信号)と、第2グランドG2を基準として端子TP4に発生する(端子TP4から出力される)第2電圧信号Vc2(一例として、抵抗22で変換された上記の電圧信号の1/2の振幅で、かつこの電圧信号と逆位相の信号)とに分離されて、後段の差動増幅部23に出力される。 The resistor 22 is connected between the terminals TP3 and TP4 of the secondary winding 21b. With this configuration, the resistor 22 forms the above-mentioned secondary side current path in the secondary winding 21b of the transformer 21, and converts the secondary side current signal I2 flowing in the secondary side current path into a voltage signal. In this case, since the center tap of the secondary winding 21b is connected to the second ground G2, this voltage signal is generated at the terminal TP3 (output from the terminal TP3) with the second ground G2 as a reference. A voltage signal Vc1 (for example, a signal having an amplitude of 1/2 of the above voltage signal converted by the resistor 22 and having the same phase as this voltage signal) and a second ground G2 are generated at the terminal TP4 with reference to the second ground G2 (as an example). Separated into a second voltage signal Vc2 (as an example, a signal having an amplitude of 1/2 of the above voltage signal converted by the resistor 22 and having a phase opposite to this voltage signal) (output from the terminal TP4). It is output to the differential amplification unit 23 in the subsequent stage.

差動増幅部23は、一例として、演算増幅器23aおよび4つの抵抗23b〜23eを備えている。演算増幅器23aの入力抵抗としての抵抗23b,23c(同一の抵抗値)のうちの抵抗23bは、一端が演算増幅器23aの反転入力端子に接続されると共に、他端が端子TP3に接続されている。また、抵抗23cは、一端が演算増幅器23aの非反転入力端子に接続されると共に、他端が端子TP4に接続されている。また、抵抗23dは、演算増幅器23aの出力端子と反転入力端子との間に接続されている。また、抵抗23eは、抵抗23dと同一の抵抗値に規定されて、一端が非反転入力端子に接続されると共に、他端が第2グランドG2に接続されている。この構成により、差動増幅部23は、端子TP3に生じる第1電圧信号Vc1と端子TP4に生じる第2電圧信号Vc2との差分電圧(Vc1−Vc2)を、抵抗23dの抵抗値を抵抗23bの抵抗値で除算して得られるゲインで反転増幅して、検出信号Sdとして出力する。また、演算増幅器23aは、図示はしないが、一例として、積分部5を構成する後述の演算増幅器5a、および信号生成部6を構成する後述のコンパレータ6aと同じ作動電圧Vcc,Vee(±5Vなどの正電圧および負電圧)で動作する。 As an example, the differential amplifier 23 includes an operational amplifier 23a and four resistors 23b to 23e. One end of the resistor 23b of the resistors 23b and 23c (same resistance value) as the input resistance of the operational amplifier 23a is connected to the inverting input terminal of the operational amplifier 23a, and the other end is connected to the terminal TP3. .. Further, one end of the resistor 23c is connected to the non-inverting input terminal of the operational amplifier 23a, and the other end is connected to the terminal TP4. Further, the resistor 23d is connected between the output terminal and the inverting input terminal of the operational amplifier 23a. Further, the resistor 23e is defined to have the same resistance value as the resistor 23d, and one end thereof is connected to the non-inverting input terminal and the other end is connected to the second ground G2. With this configuration, the differential amplification unit 23 sets the difference voltage (Vc1-Vc2) between the first voltage signal Vc1 generated at the terminal TP3 and the second voltage signal Vc2 generated at the terminal TP4, and sets the resistance value of the resistor 23d to the resistance 23b. It is inverted and amplified by the gain obtained by dividing by the resistance value, and output as the detection signal Sd. Although not shown, the operational amplifier 23a has the same operating voltage Vcc, Vee (± 5V, etc.) as the operational amplifier 5a, which constitutes the integrating unit 5, and the comparator 6a, which will be described later, which constitutes the signal generation unit 6. Operates at positive and negative voltages.

上記したように、検出部4Aに入力される電流信号I1はロジック信号Saの微分信号であることから、この電流信号I1に起因して発生する二次側電流信号I2、各電圧信号Vc1,Vc2、それらの差分電圧(Vc1−Vc2)、およびこの差分電圧(Vc1−Vc2)が増幅された検出信号Sdもまた、ロジック信号Saの微分信号を示す信号(ロジック信号Saの微分波形に相当する信号波形の信号)である。 As described above, since the current signal I1 input to the detection unit 4A is a differential signal of the logic signal Sa, the secondary side current signal I2 generated by this current signal I1 and the respective voltage signals Vc1 and Vc2 , Their differential voltage (Vc1-Vc2), and the detection signal Sd in which this differential voltage (Vc1-Vc2) is amplified are also signals indicating the differential signal of the logic signal Sa (the signal corresponding to the differential waveform of the logic signal Sa). Wave signal).

積分部5は、例えば、図2に示すような演算増幅器5a、抵抗5bおよびコンデンサ5cで構成された公知の積分回路で構成されている。この積分部5は、ロジック信号Saの微分信号を示す検出信号Sdを積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成して出力する。また、積分部5を構成し得る積分回路は、この積分回路に限定されるものではなく、後述するように、抵抗とコンデンサで構成された公知のローパスフィルタ(RCフィルタ)で構成することもできる。 The integrator 5 is composed of, for example, a known integrator circuit composed of an operational amplifier 5a, a resistor 5b, and a capacitor 5c as shown in FIG. The integrating unit 5 generates and outputs a restored signal Sre having a signal waveform equivalent to the signal waveform of the logic signal Sa by integrating the detection signal Sd indicating the differential signal of the logic signal Sa. Further, the integrator circuit that can form the integrator 5 is not limited to this integrator circuit, and may be formed by a known low-pass filter (RC filter) composed of a resistor and a capacitor, as will be described later. ..

この場合、電流信号I1の位相(つまり、ロジック信号Saの位相)に対する二次側電流信号I2の位相や、各電圧信号Vc1,Vc2(それらの差分電圧(Vc1−Vc2))の位相や、検出信号Sdの位相は、トランス21の一次巻線21aに対する二次巻線21bの極性や、差動増幅部23の構成(反転増幅であるか非反転増幅であるか)や、積分部5の構成(積分信号を、被積分信号の極性に対して同極性で出力するのか逆極性で出力するのか)に応じて変化する。したがって、ロジック信号Saの位相に対する復元信号Sreの位相も、上記したトランス21や差動増幅部23や積分部5の構成に応じて、同位相状態とすることもできるし、逆位相状態とすることもできる。本例では理解の容易のため、検出信号Sdは、ロジック信号Saの位相に対して図3に示す位相状態で出力され、図2に示す構成の積分部5は、この検出信号Sdを積分して、図3に示す位相状態(ロジック信号Saと同位相の状態)で復元信号Sreを生成して出力するものとする。 In this case, the phase of the secondary side current signal I2 with respect to the phase of the current signal I1 (that is, the phase of the logic signal Sa), the phase of each voltage signal Vc1 and Vc2 (the difference voltage between them (Vc1-Vc2)), and detection. The phase of the signal Sd includes the polarity of the secondary winding 21b with respect to the primary winding 21a of the transformer 21, the configuration of the differential amplification unit 23 (whether it is inverting amplification or non-inverting amplification), and the configuration of the integrating unit 5. It changes according to (whether the integrated signal is output with the same polarity or the opposite polarity with respect to the polarity of the integrated signal). Therefore, the phase of the restoration signal Sre with respect to the phase of the logic signal Sa can also be in the same phase state or in the opposite phase state depending on the configuration of the transformer 21, the differential amplification unit 23, and the integration unit 5 described above. You can also do it. In this example, for easy understanding, the detection signal Sd is output in the phase state shown in FIG. 3 with respect to the phase of the logic signal Sa, and the integrating unit 5 having the configuration shown in FIG. 2 integrates the detection signal Sd. Therefore, it is assumed that the restoration signal Sre is generated and output in the phase state shown in FIG. 3 (the state having the same phase as the logic signal Sa).

信号生成部6は、例えば、図2に示すようにコンパレータ6aを備えて構成されて、復元信号Sreを閾値電圧Vthと比較して二値化することにより、符号特定用信号Sfを図3に示すようにロジック信号Saと同位相となる状態(ロジック信号Saの低電圧の期間では、低電圧となり、ロジック信号Saの高電圧の期間では、高電圧となる状態)で生成して出力する。また、復元信号Sreについては、図3に示すように、低電圧側の電圧レベルの方が、高電圧側の電圧レベルと比べて安定していることから、閾値電圧Vthはこの低電圧側の電圧レベルよりも若干高い電圧に規定されている。 The signal generation unit 6 is configured to include, for example, a comparator 6a as shown in FIG. 2, and the restoration signal Sre is binarized with the threshold voltage Vth to convert the code identification signal Sf into FIG. As shown, it is generated and output in a state of being in phase with the logic signal Sa (a state in which the voltage is low in the low voltage period of the logic signal Sa and the voltage is high in the high voltage period of the logic signal Sa). As for the restoration signal Sre, as shown in FIG. 3, the voltage level on the low voltage side is more stable than the voltage level on the high voltage side, so that the threshold voltage Vth is on the low voltage side. The voltage is specified to be slightly higher than the voltage level.

信号変換装置3は、信号生成装置2Aから出力される符号特定用信号Sfを、信号読取システム1Aに接続される各種のCAN通信対応機器の通信プロトコル(つまり、通信路SBのロジック信号Saと同じ通信プロトコル。本例では、CANバスSBの通信プロトコル)に準拠した送信信号Soに変換して、各種のCAN通信対応機器に出力(送信)する。例えば、信号変換装置3は、種々のCANトランシーバで構成することができる。 The signal conversion device 3 uses the code identification signal Sf output from the signal generation device 2A as the same as the communication protocol (that is, the logic signal Sa of the communication path SB) of various CAN communication compatible devices connected to the signal reading system 1A. Communication protocol. In this example, it is converted into a transmission signal So conforming to the communication protocol of the CAN bus SB) and output (transmitted) to various CAN communication compatible devices. For example, the signal converter 3 can be composed of various CAN transceivers.

次に、信号読取システム1Aの使用例、およびその際の信号読取システム1Aの動作について、図面を参照して説明する。 Next, an example of using the signal reading system 1A and the operation of the signal reading system 1A at that time will be described with reference to the drawings.

まず、図1,2に示すように、CANバスSBにおける被覆導線La,Lbの被覆部に各電極12a,12bが接触(当接)するように電極部11a,11bを対応する被覆導線La,Lbにそれぞれ装着すると共に、送信信号Soを出力すべきCAN通信対応機器を信号変換装置3に接続する。 First, as shown in FIGS. 1 and 2, the corresponding coated conductors La, 11b are brought into contact (contact) with the coated portions of the coated conductors La, Lb in the CAN bus SB so that the electrodes 12a, 12b are in contact with each other. A CAN communication compatible device that should be attached to each Lb and output a transmission signal So is connected to the signal conversion device 3.

この場合、本例の信号読取システム1Aでは、被覆導線La,Lb自体を加工する(絶縁被覆を剥がす)ことなく、電極部11a,11bを装着するだけでCANバスSBからロジック信号Saを読み取ることができるため、CANバスSBにダイアグコネクタが配設されていない場合においても使用することができる。また、ダイアグコネクタが配設されていたとしても、CANバスSBに対する接続場所(電極部11a,11bの各装着場所)がダイアグコネクタの配設場所に限定されずに、被覆導線La,Lbの長手方向における任意の場所に接続する(電極部11a,11bを装着する)ことが可能となっている。 In this case, in the signal reading system 1A of this example, the logic signal Sa can be read from the CAN bus SB simply by mounting the electrode portions 11a and 11b without processing the coated conductors La and Lb themselves (peeling the insulating coating). Therefore, it can be used even when the diagnostic connector is not arranged on the CAN bus SB. Further, even if the diagnostic connector is arranged, the connection location with respect to the CAN bus SB (the mounting location of the electrode portions 11a and 11b) is not limited to the arrangement location of the diagnostic connector, and the lengths of the coated conductors La and Lb are not limited. It is possible to connect to any place in the direction (the electrode portions 11a and 11b are attached).

この状態において、信号生成装置2Aでは、検出部4Aを構成するトランス21の一次巻線21aを含む上記の一次側電流経路に、被覆導線La,Lbの各電圧Va,Vbの差分(Va−Vb)で規定されるロジック信号Saの信号波形を微分した信号波形の電流信号I1が流れる。検出部4Aは、この電流信号I1を、ロジック信号Saの微分信号を示す信号(ロジック信号Saの微分波形に相当する信号波形の信号)である検出信号Sdに変換して出力する。 In this state, in the signal generation device 2A, the difference (Va-Vb) of the voltages Va and Vb of the coated conductors La and Lb in the above-mentioned primary side current path including the primary winding 21a of the transformer 21 constituting the detection unit 4A. The current signal I1 of the signal waveform obtained by differentiating the signal waveform of the logic signal Sa defined by) flows. The detection unit 4A converts the current signal I1 into a detection signal Sd which is a signal indicating a differential signal of the logic signal Sa (a signal having a signal waveform corresponding to the differential waveform of the logic signal Sa) and outputs the signal.

また、積分部5が、この検出信号Sdを積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成して出力する。また、信号生成部6が、復元信号Sreを閾値電圧Vthと比較して二値化することにより、符号特定用信号Sfを生成して出力する。 Further, the integrating unit 5 integrates the detection signal Sd to generate and output a restored signal Sre having a signal waveform equivalent to the signal waveform of the logic signal Sa. Further, the signal generation unit 6 generates and outputs a code identification signal Sf by binarizing the restoration signal Sre with the threshold voltage Vth.

次いで、信号変換装置3が、この符号特定用信号Sfを送信信号Soに変換して、接続されているCAN通信対応機器に出力(送信)する。 Next, the signal conversion device 3 converts the code identification signal Sf into a transmission signal So and outputs (transmits) it to the connected CAN communication compatible device.

このように、この信号生成装置2Aおよびこの信号読取システム1Aでは、金属非接触型のプローブPLa,PLbを介して被覆導線La,Lbに接続される構成(容量結合で接続される構成)において、検出部4Aが、被覆導線La,Lbで構成されるCANバスSBに伝送されるロジック信号Saの信号波形を微分した信号波形の電流信号I1(ロジック信号Saの微分信号である電流信号I1)を検出すると共に、この電流信号I1をロジック信号Saの微分信号である検出信号Sdに変換して出力し、積分部5が検出信号Sdを積分してロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成する。 As described above, in the signal generation device 2A and the signal reading system 1A, in the configuration connected to the coated conductors La and Lb via the metal non-contact type probes PLa and PLb (configuration connected by capacitive coupling), The detection unit 4A detects the current signal I1 (current signal I1 which is a differential signal of the logic signal Sa) of the signal waveform obtained by differentiating the signal waveform of the logic signal Sa transmitted to the CAN bus SB composed of the coated conductors La and Lb. At the same time as detecting, this current signal I1 is converted into a detection signal Sd which is a differential signal of the logic signal Sa and output, and the integrating unit 5 integrates the detection signal Sd to obtain a signal waveform equivalent to the signal waveform of the logic signal Sa. Generate the restoration signal Sre.

ところで、この信号生成装置2Aおよびこの信号読取システム1Aのように、ロジック信号Saの信号波形を微分した信号波形の信号(説明のため、以下では微分信号ともいう。本例では、電流信号I1)を検出する構成では、図3に示すように、ロジック信号Saの信号波形には、符号Csの切り替わりタイミング(符号「1」から符号「0」へ、また符号「0」から符号「1」への切り替わりタイミング。以下では、区別のため、このタイミングを特定タイミングともいう)以外のタイミングで、信号同士の衝突に起因してロジック信号Saの電圧がパルス状やステップ状に上昇したり低下したりする事態が発生する。この場合、ロジック信号Saの信号波形を微分した電流信号I1、さらには電流信号I1が電圧信号に変換された信号である検出信号Sdには、図3に示すように、このタイミング(上記の特定タイミング以外のタイミング)でスパイク状の信号が発生する。このスパイク状の信号のピーク値は、ロジック信号Saの電圧の変化量が小さいときであっても、単位時間当たりの変化量が大きいときには大きくなる。 By the way, like the signal generation device 2A and the signal reading system 1A, a signal having a signal waveform obtained by differentiating the signal waveform of the logic signal Sa (for explanation, hereinafter also referred to as a differential signal. In this example, the current signal I1). In the configuration for detecting, as shown in FIG. 3, in the signal waveform of the logic signal Sa, the switching timing of the code Cs (from the code "1" to the code "0" and from the code "0" to the code "1" Switching timing. In the following, for the sake of distinction, this timing is also referred to as a specific timing), and the voltage of the logic signal Sa rises or falls in a pulsed or stepped manner due to the collision between the signals. Situation occurs. In this case, as shown in FIG. 3, the current signal I1 obtained by differentiating the signal waveform of the logic signal Sa and the detection signal Sd which is a signal obtained by converting the current signal I1 into a voltage signal have this timing (specification described above). A spike-like signal is generated at a timing other than the timing). The peak value of this spike-shaped signal becomes large when the amount of change per unit time is large, even when the amount of change in the voltage of the logic signal Sa is small.

このため、背景技術で説明した本願出願人の提案の信号生成装置(上記の特許文献2を参照して説明した信号生成装置)のように、この検出信号Sdに相当する信号(差分信号Sd)を閾値(正側閾値Vr1および負側閾値Vr2)で直接比較して符号特定用信号Sfを生成する構成では、誤った符号特定用信号が生成されるという上記した課題が生じる。これに対して、この信号生成装置2Aおよびこの信号読取システム1Aによれば、積分部5が検出信号Sdを積分してロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成して信号生成部6に出力する構成のため、ロジック信号Saの信号波形にパルス状やステップ状の電圧変化が生じている状態においても、この電圧変化の影響を殆ど受けることなく、信号生成部6において復元信号Sreを1つの閾値電圧Vthで正しく二値化して、正しい符号特定用信号Sfを生成することができる。 Therefore, a signal corresponding to this detection signal Sd (difference signal Sd), such as the signal generator proposed by the applicant of the present application described in the background art (the signal generator described with reference to Patent Document 2 above). Is directly compared with the threshold values (positive side threshold value Vr1 and negative side threshold value Vr2) to generate the code specifying signal Sf, the above-mentioned problem that an erroneous code specifying signal is generated occurs. On the other hand, according to the signal generation device 2A and the signal reading system 1A, the integrating unit 5 integrates the detection signal Sd to generate a restored signal Sre having a signal waveform equivalent to the signal waveform of the logic signal Sa. Since the signal is output to the signal generation unit 6, even in a state where a pulse-like or step-like voltage change occurs in the signal waveform of the logic signal Sa, the signal generation unit 6 is hardly affected by this voltage change. The restoration signal Sre can be correctly binarized at one threshold voltage Vth to generate a correct code identification signal Sf.

なお、検出部4Aの構成は、上記した構成に限定されるものではなく、種々の構成を採用することができる。例えば、図示はしないが、上記の特許文献2の図4に開示されている構成のように、上記のトランス21(二次巻線21bにセンタータップを備えたトランス)に代えて、二次巻線にセンタータップを備えていない二次巻線を有するトランスを使用し、かつ差動増幅部23に代えて、非差動方式の増幅部を使用する構成を採用することもできる。 The configuration of the detection unit 4A is not limited to the above configuration, and various configurations can be adopted. For example, although not shown, as in the configuration disclosed in FIG. 4 of Patent Document 2, the secondary winding is replaced with the transformer 21 (transformer having a center tap on the secondary winding 21b). It is also possible to adopt a configuration in which a transformer having a secondary winding without a center tap on the wire is used and a non-differential amplification unit is used instead of the differential amplification unit 23.

また、上記の検出部4Aでは、トランス21の一次巻線21aの一方の端子TP1を被覆導線Laと容量結合する電極12aにプローブPLaを介して接続し、かつ一次巻線21aの他方の端子TP2を被覆導線Lbと容量結合する電極12bにプローブPLbを介して接続することで、被覆導線Laから一次巻線21aを経由して被覆導線Lbに至る一次側電流経路(容量成分(結合容量)が直列に接続されて構成された電流経路)を形成して、ロジック信号Saの信号波形を微分した信号波形の電流信号I1を検出する構成を採用しているが、ロジック信号Saの信号波形を微分した信号波形の信号を検出する構成は、この構成に限定されない。 Further, in the above-mentioned detection unit 4A, one terminal TP1 of the primary winding 21a of the transformer 21 is connected to the electrode 12a which is capacitively coupled to the coated lead wire La via the probe PLa, and the other terminal TP2 of the primary winding 21a is connected. Is connected to the electrode 12b which is capacitively coupled to the coated conductor Lb via the probe PLb, so that the primary side current path (capacitive component (coupling capacitance)) from the coated conductor La to the coated conductor Lb via the primary winding 21a becomes A configuration is adopted in which the current signal I1 of the signal waveform obtained by differentiating the signal waveform of the logic signal Sa is detected by forming a current path) connected in series, but the signal waveform of the logic signal Sa is differentiated. The configuration for detecting the signal of the signal waveform is not limited to this configuration.

例えば、図示はしないが、上記の特許文献2の図5に開示されている構成のように、信号生成装置の一次側(トランスの一次巻線側)において、プローブPLaを構成するシールドケーブルの芯線を一の抵抗を介して第1グランドG1に接続し、またプローブPLbを構成するシールドケーブルの芯線を他の抵抗(一の抵抗と同じ抵抗値)を介して第1グランドG1に接続することで、被覆導線Laから、結合容量、プローブPLaを構成するシールドケーブルの芯線および一の抵抗を経由して第1グランドG1に至る1つの電流経路(以下では、説明のため、第1電流経路ともいう)と、被覆導線Lbから、結合容量、プローブPLbを構成するシールドケーブルの芯線および他の抵抗を経由して第1グランドG1に至る他の1つの電流経路(以下では、説明のため、第2電流経路ともいう)の2つの電流経路を形成する構成を採用することもできる。 For example, although not shown, as in the configuration disclosed in FIG. 5 of Patent Document 2, the core wire of the shield cable constituting the probe PLa on the primary side (primary winding side of the transformer) of the signal generator. Is connected to the first ground G1 via one resistor, and the core wire of the shield cable constituting the probe PLb is connected to the first ground G1 via another resistor (the same resistance value as the one resistor). , One current path from the coated lead wire La to the first ground G1 via the coupling capacitance, the core wire of the shield cable constituting the probe PLa, and one resistor (hereinafter, also referred to as the first current path for explanation). ) And another current path from the coated lead wire Lb to the first ground G1 via the coupling capacitance, the core wire of the shield cable constituting the probe PLb, and other resistors (hereinafter, for the sake of explanation, the second It is also possible to adopt a configuration in which two current paths (also referred to as current paths) are formed.

この構成の検出部では、第1電流経路には被覆導線Laの電圧Vaの信号波形を微分した信号波形の電流信号(以下では、説明のため、第1電流信号ともいう)が流れ、一の抵抗がこの第1電流信号を電圧信号(以下では、説明のため、第1電圧信号ともいう)に変換して出力する。また、第2電流経路には被覆導線Lbの電圧Vbの信号波形を微分した信号波形の電流信号(以下では、説明のため、第2電流信号ともいう)が流れ、他の抵抗がこの第2電流信号を電圧信号(以下では、説明のため、第2電圧信号ともいう)に変換して出力する。また、この検出部では、入力インピーダンスの極めて高い構成の差動増幅器(トランスを含む差動増幅器)が、第1電圧信号および第2電圧信号を入力してそれらの差分電圧を増幅することにより、検出信号Sdを生成する。 In the detection unit having this configuration, a current signal (hereinafter, also referred to as a first current signal for the sake of explanation) of a signal waveform obtained by differentiating the signal waveform of the voltage Va of the covered lead wire La flows through the first current path. The resistor converts this first current signal into a voltage signal (hereinafter, also referred to as a first voltage signal for the sake of explanation) and outputs it. Further, a current signal (hereinafter, also referred to as a second current signal for the sake of explanation) of a signal waveform obtained by differentiating the signal waveform of the voltage Vb of the coated lead wire Lb flows through the second current path, and the other resistance is the second. The current signal is converted into a voltage signal (hereinafter, also referred to as a second voltage signal for the sake of explanation) and output. Further, in this detection unit, a differential amplifier (differential amplifier including a transformer) having an extremely high input impedance inputs a first voltage signal and a second voltage signal and amplifies the difference voltage between them. The detection signal Sd is generated.

したがって、被覆導線La,Lbの各電圧Va,Vbの信号波形を個別に微分した信号波形の電流信号を検出する構成の検出部4Aを採用した信号生成装置およびこの信号読取システムにおいても、上記した信号生成装置2Aおよび信号読取システム1Aと同等の効果を奏することができる。 Therefore, the signal generator and the signal reading system that employ the detection unit 4A having a configuration for detecting the current signal of the signal waveform obtained by individually differentiating the signal waveforms of the voltages Va and Vb of the coated conductors La and Lb are also described above. The same effect as that of the signal generation device 2A and the signal reading system 1A can be obtained.

また、トランス(絶縁トランス)を有する構成の検出部について説明したが、図4に示す信号生成装置2Bのように、トランスを使用しない検出部4Bを採用することもできる。以下、信号生成装置2Bについて説明する。なお、信号生成装置2Aと同一の構成については同一の符号を付して、重複する説明を省略する。 Further, although the detection unit having a transformer (isolation transformer) has been described, a detection unit 4B that does not use a transformer can also be adopted as in the signal generation device 2B shown in FIG. Hereinafter, the signal generator 2B will be described. The same components as those of the signal generation device 2A are designated by the same reference numerals, and redundant description will be omitted.

この信号生成装置2Bは、一例として、図4に示すように、検出部4B、積分部5および信号生成部6を備えると共に、一対のプローブPLa,PLbを介して一対の被覆導線La,Lbに接続されて、符号特定用信号Sfを生成して出力する。 As an example, this signal generation device 2B includes a detection unit 4B, an integration unit 5, and a signal generation unit 6, and is connected to a pair of coated conductors La and Lb via a pair of probes PLa and PLb. It is connected to generate and output a code identification signal Sf.

検出部4Bは、積分部5と相俟って信号復元部8を構成する。この場合、信号復元部8は、被覆導線La,Lbから検出されたロジック信号Saの微分波形に相当する信号波形を積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成する。検出部4Bは、2つの抵抗25,26、および差動増幅部23を備えている。第1抵抗素子としての抵抗25は、一端が、入力端子部14、プローブPLaを構成するシールドケーブルの芯線を介して電極12aに接続され、他端が、第1グランドG1(この例では、第1グランドG1と第2グランドG2の区別がないため、以下では、グランドGともいう)に接続されている。第2抵抗素子としての抵抗26は、抵抗値が抵抗25と同一に規定されて、一端が、入力端子部15、プローブPLbを構成するシールドケーブルの芯線を介して電極12bに接続され、他端が、グランドGに接続されている。この構成により、この検出部4Bでは、被覆導線Laから、結合容量、電極12a、プローブPLaを構成するシールドケーブルの芯線および抵抗25を経由してグランドGに至る1つの第1電流経路と、被覆導線Lbから、結合容量、電極12b、プローブPLbを構成するシールドケーブルの芯線および抵抗26を経由してグランドGに至る第2電流経路の2つの電流経路が形成される。 The detection unit 4B, together with the integration unit 5, constitutes the signal restoration unit 8. In this case, the signal restoration unit 8 integrates the signal waveform corresponding to the differential waveform of the logic signal Sa detected from the coated conductors La and Lb, thereby integrating the restoration signal Sre of the signal waveform equivalent to the signal waveform of the logic signal Sa. To generate. The detection unit 4B includes two resistors 25 and 26 and a differential amplification unit 23. One end of the resistor 25 as the first resistance element is connected to the electrode 12a via the core wire of the shielded cable constituting the input terminal portion 14 and the probe PLa, and the other end is the first ground G1 (in this example, the first ground G1). Since there is no distinction between the 1st ground G1 and the 2nd ground G2, it is also referred to as the ground G in the following). The resistance value of the resistor 26 as the second resistance element is defined to be the same as that of the resistor 25, and one end thereof is connected to the electrode 12b via the core wire of the shielded cable constituting the input terminal portion 15 and the probe PLb, and the other end. Is connected to the ground G. With this configuration, the detection unit 4B covers one first current path from the coated lead wire La to the ground G via the coupling capacitance, the electrode 12a, the core wire of the shielded cable constituting the probe PLa, and the resistor 25. Two current paths are formed from the lead wire Lb to the ground G via the coupling capacitance, the electrode 12b, the core wire of the shielded cable constituting the probe PLb, and the resistor 26.

また、第1電流経路には、被覆導線Laの電圧Vaの信号波形を微分した信号波形の第1電流信号I1aが流れ、抵抗25がこの第1電流信号I1aを第1電圧信号Vc1に変換して出力する。また、第2電流経路には、被覆導線Lbの電圧Vbの信号波形を微分した信号波形の第2電流信号I1bが流れ、抵抗26がこの第2電流信号I1bを第2電圧信号Vc2に変換して出力する。被覆導線Laの電圧Vaと被覆導線Lbの電圧Vbは、互いの位相が反転した電圧信号であることから、第1電圧信号Vc1および第2電圧信号Vc2も互いの位相が反転した電圧信号となっている。 Further, a first current signal I1a having a signal waveform obtained by differentiating the signal waveform of the voltage Va of the covered lead wire La flows through the first current path, and the resistor 25 converts the first current signal I1a into a first voltage signal Vc1. And output. Further, a second current signal I1b having a signal waveform obtained by differentiating the signal waveform of the voltage Vb of the covered lead wire Lb flows through the second current path, and the resistor 26 converts the second current signal I1b into a second voltage signal Vc2. And output. Since the voltage Va of the coated lead wire La and the voltage Vb of the covered lead wire Lb are voltage signals whose phases are inverted from each other, the first voltage signal Vc1 and the second voltage signal Vc2 are also voltage signals whose phases are inverted from each other. ing.

差動増幅部23は、信号生成装置2Aの検出部4Aでの構成(図2の構成)に加えて、2つの演算増幅器23f,23gおよび3つの抵抗23h,23i,23jを備えている。この場合、演算増幅器23fでは、その非反転入力端子が抵抗25の一端に接続され、その出力端子と反転入力端子との間に抵抗23hが接続され、その出力端子は抵抗23bに接続されている。また、演算増幅器23gでは、その非反転入力端子が抵抗26の一端に接続され、その出力端子と反転入力端子との間に抵抗23i(抵抗23hと同じ抵抗値)が接続され、その出力端子は抵抗23cに接続されている。また、演算増幅器23f,23gの反転入力端子同士は、1つの抵抗23jを介して接続されている。本例の差動増幅部23は、以上の構成により、計装アンプとして構成されて、第1電圧信号Vc1および第2電圧信号Vc2を高入力インピーダンスで入力すると共に、その差分(Vc1−Vc2)を増幅して検出信号Sd(ロジック信号Saの微分波形に相当する信号波形の信号)として出力する。 The differential amplification unit 23 includes two operational amplifiers 23f and 23g and three resistors 23h, 23i and 23j in addition to the configuration of the detection unit 4A of the signal generation device 2A (the configuration of FIG. 2). In this case, in the operational amplifier 23f, the non-inverting input terminal is connected to one end of the resistor 25, the resistor 23h is connected between the output terminal and the inverting input terminal, and the output terminal is connected to the resistor 23b. .. Further, in the operational amplifier 23g, the non-inverting input terminal is connected to one end of the resistor 26, and the resistor 23i (the same resistance value as the resistor 23h) is connected between the output terminal and the inverting input terminal, and the output terminal is It is connected to the resistor 23c. Further, the inverting input terminals of the operational amplifiers 23f and 23g are connected to each other via one resistor 23j. The differential amplifier unit 23 of this example is configured as an instrumentation amplifier by the above configuration, inputs the first voltage signal Vc1 and the second voltage signal Vc2 with high input impedance, and the difference (Vc1-Vc2). Is amplified and output as a detection signal Sd (a signal having a signal waveform corresponding to the differential waveform of the logic signal Sa).

したがって、このようにトランスを有しない構成の検出部4Bを備えた信号生成装置2B、およびこの信号生成装置2Bを備えた構成の信号読取システム1Aにおいても、上記した信号生成装置2A、およびこの信号生成装置2Aを備えた信号読取システム1Aと同様にして、積分部5が検出信号Sdを積分してロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成して信号生成部6に出力する構成となるため、上記した信号生成装置2A、およびこの信号生成装置2Aを備えた信号読取システム1Aと同等の効果を奏することができる。 Therefore, also in the signal generation device 2B having the detection unit 4B having no transformer and the signal reading system 1A having the signal generation device 2B, the above-mentioned signal generation device 2A and this signal. Similar to the signal reading system 1A provided with the generator 2A, the integrating unit 5 integrates the detection signal Sd to generate a restored signal Sre having a signal waveform equivalent to the signal waveform of the logic signal Sa, and causes the signal generating unit 6 to generate a restored signal Sre. Since the output is configured, the same effect as that of the signal generation device 2A described above and the signal reading system 1A provided with the signal generation device 2A can be obtained.

なお、上記の検出部4Bでは、差動増幅部23を計装アンプとする構成を採用しているが、この構成に限定されるものではない。例えば、演算増幅器23f,23gの反転入力端子同士を1つの抵抗23jを介して直接接続する構成(図4の構成)に代えて、図5に示すように、演算増幅器23f,23gの各反転入力端子を個別の抵抗23k,23mを介してグランドGに接続する構成を採用することもできる。さらに、図示はしないが、各抵抗23k,23mに個別にコンデンサを直列に接続して、演算増幅器23f,23gの各反転入力端子をRC直列回路でグランドGに接続する構成を採用することもできる。これらの構成を採用した場合においても、図4に示す構成の検出部4Bを備えた信号生成装置2B、およびこの信号生成装置2Bを備えた構成の信号読取システム1Aと同様の効果を奏することができる。 The detection unit 4B described above employs a configuration in which the differential amplifier unit 23 is an instrumentation amplifier, but the present invention is not limited to this configuration. For example, instead of the configuration in which the inverting input terminals of the operational amplifiers 23f and 23g are directly connected to each other via one resistor 23j (configuration in FIG. 4), as shown in FIG. 5, the inverting inputs of the operational amplifiers 23f and 23g are respectively. It is also possible to adopt a configuration in which the terminals are connected to the ground G via individual resistors 23k and 23m. Further, although not shown, it is also possible to adopt a configuration in which capacitors are individually connected in series to the resistors 23k and 23m, and the inverting input terminals of the operational amplifiers 23f and 23g are connected to the ground G by an RC series circuit. .. Even when these configurations are adopted, the same effects as those of the signal generation device 2B provided with the detection unit 4B having the configuration shown in FIG. 4 and the signal reading system 1A having the configuration provided with the signal generation device 2B can be obtained. it can.

また、2つの被覆導線La,Lbで構成されるCANバスSBに伝送される2線差動電圧方式のロジック信号Saを読み取る各信号生成装置2A,2B、およびこれらのうちのいずれかを備えた信号読取システム1Aについて説明したが、1本の被覆導線で構成される通信路を介して伝送されるロジック信号を読み取って符号特定用信号Sfを生成する信号生成装置、およびこの信号生成装置を備えた信号読取システムにおいても、金属非接触型のプローブを介して1つの被覆導線に接続される構成(容量結合で接続される構成)を採用しつつ、検出部が、この被覆導線に伝送されるロジック信号の信号波形を微分した信号波形の信号を検出し、積分部が、この信号(またはこの信号の増幅信号)を積分して、ロジック信号の信号波形と同等の信号波形の復元信号を生成する構成を採用することができる。以下、この信号生成装置および信号読取システムについて、図6,7,8を参照して説明する。なお、上記した信号生成装置2Aおよび信号生成装置2Bのうちのいずれか1つの装置、並びにこの装置を備えた信号読取システム1Aと同一の構成については同一の符号を付して、重複する説明を省略する。 Further, each signal generator 2A, 2B for reading the 2-wire differential voltage type logic signal Sa transmitted to the CAN bus SB composed of the two coated lead wires La and Lb, and any of these are provided. Although the signal reading system 1A has been described, it includes a signal generation device that reads a logic signal transmitted through a communication path composed of one covered lead wire and generates a code identification signal Sf, and this signal generation device. Even in the signal reading system, the detection unit is transmitted to the coated conductor while adopting a configuration in which the signal is connected to one coated conductor via a metal non-contact probe (a configuration in which the signal is connected by a capacitive coupling). The signal of the signal waveform obtained by differentiating the signal waveform of the logic signal is detected, and the integrating unit integrates this signal (or the amplified signal of this signal) to generate a restored signal of the signal waveform equivalent to the signal waveform of the logic signal. Can be adopted. Hereinafter, the signal generator and the signal reading system will be described with reference to FIGS. 6, 7, and 8. Note that any one of the above-mentioned signal generation device 2A and signal generation device 2B, and the same configuration as the signal reading system 1A provided with this device are designated by the same reference numerals and redundant description will be given. Omit.

図6に示すように、「信号読取システム」の一例である信号読取システム1Bは、「信号生成装置」の一例である信号生成装置2Cおよび信号生成装置2Dのうちのいずれか1つの信号生成装置を有して、1本の被覆導線Lwで構成される通信路SBを介して伝送される単線電圧駆動方式(単線方式)のロジック信号(被覆導線Lwに伝送されている電圧Vwで規定されるロジック信号Sa)を検出して、ロジック信号Saに対応する符号Csを特定可能な符号特定用信号Sfを生成し(読み取り)、この符号特定用信号Sfを通信路SBのロジック信号Saと同じ通信プロトコルに準拠した送信信号Soに変換して、各種のCAN通信対応機器に出力(送信)することができるように構成されている。この信号生成装置2C,2Dは、「CANプロトコル」、「CAN FD」、「FlexRay(登録商標)」などの各種通信プロトコルに準拠した各種の「単線電圧駆動方式のロジック信号」や、「LVDS」による小振幅低消費電力通信が可能な各種通信プロトコルに準拠した各種の「単線電圧駆動方式のロジック信号」を対象とすることができる。 As shown in FIG. 6, the signal reading system 1B, which is an example of the “signal reading system”, is a signal generation device of any one of the signal generation device 2C and the signal generation device 2D, which is an example of the “signal generation device”. Is defined by the logic signal of the single wire voltage drive system (single wire system) transmitted via the communication path SB composed of one covered conductor wire Lw (voltage Vw transmitted to the coated conductor wire Lw). The logic signal Sa) is detected to generate (read) a code specifying signal Sf capable of specifying the code Cs corresponding to the logic signal Sa, and this code specifying signal Sf is used for the same communication as the logic signal Sa of the communication path SB. It is configured so that it can be converted into a transmission signal So conforming to the protocol and output (transmitted) to various CAN communication compatible devices. The signal generators 2C and 2D are various "single line voltage drive type logic signals" compliant with various communication protocols such as "CAN protocol", "CAN FD", and "FlexRay (registered trademark)", and "LVDS". It is possible to target various "single line voltage drive type logic signals" conforming to various communication protocols capable of small amplitude and low power consumption communication.

まず、図6に示すように、信号生成装置2Cおよび信号変換装置3を備えて構成された信号読取システム1Bについて説明する。なお、信号読取システム1Aと同一の構成については同一の符号を付して重複する説明を省略する。 First, as shown in FIG. 6, a signal reading system 1B configured to include a signal generation device 2C and a signal conversion device 3 will be described. The same components as those of the signal reading system 1A are designated by the same reference numerals, and duplicate description will be omitted.

信号生成装置2Cは、一例として、図7に示すように、検出部4C、積分部5および信号生成部6を備えると共に、1本のプローブPLを介して被覆導線Lwに接続されて、符号特定用信号Sfを生成して出力する。なお、プローブPLは、上記したプローブPLa,PLbと同じ構成であるため、一例としてプローブPLaと同一であるものとして、プローブPLaの構成と同一の構成については同一の符号を付して重複する説明を省略する。 As an example, the signal generation device 2C includes a detection unit 4C, an integration unit 5, and a signal generation unit 6, and is connected to a covered lead wire Lw via one probe PL to specify a code. Signal Sf is generated and output. Since the probe PL has the same configuration as the probe PLa and PLb described above, it is assumed that the probe PL has the same configuration as the probe PLa as an example. Is omitted.

検出部4Cは、積分部5と相俟って信号復元部8を構成する。この場合、信号復元部8は、被覆導線Lwから検出されたロジック信号Saの微分波形に相当する信号波形を積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成する。検出部4Cは、トランス31、1つの抵抗素子としての抵抗32、増幅部としての非差動増幅部33およびコンデンサ34を備えている。 The detection unit 4C, together with the integration unit 5, constitutes the signal restoration unit 8. In this case, the signal restoration unit 8 generates a restoration signal Sre having a signal waveform equivalent to the signal waveform of the logic signal Sa by integrating the signal waveform corresponding to the differential waveform of the logic signal Sa detected from the covered lead wire Lw. To do. The detection unit 4C includes a transformer 31, a resistor 32 as one resistance element, a non-differential amplification unit 33 as an amplification unit, and a capacitor 34.

トランス31は、一次巻線31aおよび二次巻線31bを備えて、一次巻線31a側の回路と二次巻線31b側の回路とを電気的に絶縁するための絶縁トランスとして構成されている。具体的には、一次巻線31aの一方の端子TP1は、入力端子部14の一の端子を介してプローブPLaを構成するシールドケーブルの芯線(ひいては電極12a)に接続され、一次巻線31aの他方の端子TP2は、信号生成装置2Cにおける一次側(トランス31の一次巻線31a側)の第1基準電位の部位(第1グランドG1)に接続されている。また、第1グランドG1には、入力端子部14の他の端子も接続されている。この構成により、被覆導線Lwの芯線から、この芯線と電極12aとの間の結合容量、電極12a、プローブPLaを構成するシールドケーブルの芯線、入力端子部14の一の端子、一次巻線31aを経由して第1グランドG1に至る1つの電流経路(一次側電流経路)が形成される。 The transformer 31 includes a primary winding 31a and a secondary winding 31b, and is configured as an isolation transformer for electrically insulating the circuit on the primary winding 31a side and the circuit on the secondary winding 31b side. .. Specifically, one terminal TP1 of the primary winding 31a is connected to the core wire (and thus the electrode 12a) of the shielded cable constituting the probe PLa via one terminal of the input terminal portion 14, and the primary winding 31a The other terminal TP2 is connected to a portion (first ground G1) of the first reference potential on the primary side (primary winding 31a side of the transformer 31) of the signal generator 2C. Further, other terminals of the input terminal portion 14 are also connected to the first ground G1. With this configuration, from the core wire of the coated lead wire Lw, the coupling capacitance between the core wire and the electrode 12a, the electrode 12a, the core wire of the shielded cable constituting the probe PLa, one terminal of the input terminal portion 14, and the primary winding 31a can be obtained. One current path (primary side current path) is formed to reach the first ground G1 via the cable.

また、二次巻線31bの一方の端子TP3は、抵抗32の一端に接続され、二次巻線31bの他方の端子TP4は、信号生成装置2Cにおける二次側(トランス31の二次巻線31b側)の第2基準電位の部位(第2グランドG2)に接続されている。また、第2グランドG2には、抵抗32の他端が接続されている。この構成により、二次巻線31bから、二次巻線31bの一方の端子TP3および抵抗32を経由して、二次巻線31bの他方の端子TP4(第2グランドG2)に至る他の1つの電流経路(二次側電流経路)が形成される。コンデンサ34は、第1グランドG1と第2グランドG2との間に接続されて、両グランドG1,G2を直流的には分離しつつ、交流的には接続する。 Further, one terminal TP3 of the secondary winding 31b is connected to one end of the resistor 32, and the other terminal TP4 of the secondary winding 31b is the secondary side (secondary winding of the transformer 31) in the signal generator 2C. It is connected to the second reference potential portion (second ground G2) on the 31b side). Further, the other end of the resistor 32 is connected to the second ground G2. With this configuration, the other 1 from the secondary winding 31b to the other terminal TP4 (second ground G2) of the secondary winding 31b via one terminal TP3 and the resistor 32 of the secondary winding 31b. Two current paths (secondary current paths) are formed. The capacitor 34 is connected between the first ground G1 and the second ground G2, and connects the two grounds G1 and G2 in an alternating current manner while separating them in a direct current manner.

また、一次巻線31aを含む一次側電流経路には、被覆導線Lwの電圧Vwの信号波形を微分した信号波形の電流信号I1が図3に示す位相状態で流れる。トランス31は、一次巻線31aに流れるこの電流信号I1(一次側電流信号)を予め規定された変流比(固定)で二次側電流信号I2に変換して、二次巻線31bおよび抵抗32で構成される二次側電流経路に供給する。抵抗32は、この二次側電流信号I2を電圧信号Vc1に変換して出力する。また、トランス31は、一例として、この電圧信号Vc1が図3に示す電流信号I1の位相状態と同じ位相状態で出力されるように、一次巻線31aに対する二次巻線31bの極性が規定されているものとする。 Further, in the primary side current path including the primary winding 31a, a current signal I1 having a signal waveform obtained by differentiating the signal waveform of the voltage Vw of the coated lead wire Lw flows in the phase state shown in FIG. The transformer 31 converts this current signal I1 (primary side current signal) flowing through the primary winding 31a into a secondary side current signal I2 at a predetermined variable flow ratio (fixed), and converts the secondary winding 31b and a resistor. It is supplied to the secondary side current path composed of 32. The resistor 32 converts the secondary side current signal I2 into a voltage signal Vc1 and outputs it. Further, as an example, the transformer 31 defines the polarity of the secondary winding 31b with respect to the primary winding 31a so that the voltage signal Vc1 is output in the same phase state as the phase state of the current signal I1 shown in FIG. It is assumed that it is.

非差動増幅部33は、一例として、1つの演算増幅器33aおよび2つの抵抗33b,33cで構成された非反転増幅回路と、この非反転増幅回路の出力信号を反転して検出信号Sdとして出力する反転増幅回路33dとを備えている。この場合、非反転増幅回路では、演算増幅器33aの非反転入力端子が抵抗32の一端に接続され、演算増幅器33aの出力端子と反転入力端子との間に抵抗33bが接続され、演算増幅器33aの反転入力端子は抵抗33cを介して第2グランドG2に接続されている。本例の非差動増幅部33は、以上の構成により、全体として反転増幅アンプとして構成されて、電圧信号Vc1を高インピーダンスで入力すると共に、位相を反転させて増幅して、図3に示す位相状態で検出信号Sd(電圧Vwの微分波形(ロジック信号Saの微分波形)に相当する信号波形の信号)として出力する。なお、非差動増幅部33は、例えば反転増幅回路33dを省いて、反転増幅アンプとして構成することもできる。 As an example, the non-differential amplifier 33 inverting the output signal of the non-inverting amplifier circuit composed of one operational amplifier 33a and two resistors 33b, 33c and the non-inverting amplifier circuit, and outputs the detection signal Sd. It is provided with an inverting amplifier circuit 33d. In this case, in the non-inverting amplifier circuit, the non-inverting input terminal of the operational amplifier 33a is connected to one end of the resistor 32, the resistor 33b is connected between the output terminal and the inverting input terminal of the operational amplifier 33a, and the operational amplifier 33a is connected. The inverting input terminal is connected to the second ground G2 via a resistor 33c. The non-differential amplification unit 33 of this example is configured as an inverting amplification amplifier as a whole by the above configuration, inputs the voltage signal Vc1 with high impedance, inverts the phase and amplifies it, and is shown in FIG. It is output as a detection signal Sd (a signal having a signal waveform corresponding to a differential waveform of voltage Vw (differential waveform of logic signal Sa)) in a phase state. The non-differential amplifier 33 can be configured as an inverting amplifier by omitting, for example, the inverting amplifier circuit 33d.

したがって、この信号生成装置2C、およびこの信号生成装置2Cを備えた信号読取システム1Bにおいても、積分部5が検出信号Sdを積分して電圧Vwの信号波形(ロジック信号Saの信号波形)と同等の信号波形の復元信号Sreを生成して信号生成部6に出力する構成となるため、上記した信号生成装置2B、およびこの信号生成装置2Bを備えた信号読取システム1Aと同等の効果を奏することができる。 Therefore, also in the signal generation device 2C and the signal reading system 1B provided with the signal generation device 2C, the integrating unit 5 integrates the detection signal Sd and is equivalent to the signal waveform of the voltage Vw (the signal waveform of the logic signal Sa). Since the restored signal Sre of the signal waveform of the above is generated and output to the signal generation unit 6, the same effect as that of the above-mentioned signal generation device 2B and the signal reading system 1A provided with the signal generation device 2B can be obtained. Can be done.

次に、図6に示すように、信号生成装置2Dおよび信号変換装置3を備えて構成された信号読取システム1Bについて説明する。なお、信号生成装置2C、および信号生成装置2Cを備えた信号読取システム1Bと同一の構成については同一の符号を付して重複する説明を省略する。 Next, as shown in FIG. 6, a signal reading system 1B configured to include the signal generation device 2D and the signal conversion device 3 will be described. The same components as those of the signal generation device 2C and the signal reading system 1B including the signal generation device 2C are designated by the same reference numerals, and duplicate description will be omitted.

信号生成装置2Dは、一例として、図8に示すように、検出部4D、積分部5および信号生成部6を備えると共に、1本のプローブPLを介して被覆導線Lwに接続されて、符号特定用信号Sfを生成して出力する。なお、プローブPLは、上記したプローブPLa,PLbと同じ構成であるため、一例としてプローブPLaと同一であるものとして、プローブPLaの構成と同一の構成については同一の符号を付して重複する説明を省略する。また、検出部4Dの構成についても、検出部4Cの構成と同一となる構成があるため、同一の構成については同一の符号を付して重複する説明を省略する。 As an example, the signal generation device 2D includes a detection unit 4D, an integration unit 5, and a signal generation unit 6, and is connected to a covered lead wire Lw via one probe PL to specify a code. Signal Sf is generated and output. Since the probe PL has the same configuration as the probe PLa and PLb described above, it is assumed that the probe PL has the same configuration as the probe PLa as an example. Is omitted. Further, since the configuration of the detection unit 4D also has the same configuration as that of the detection unit 4C, the same reference numerals are given to the same configuration, and duplicate description will be omitted.

検出部4Dは、積分部5と相俟って信号復元部8を構成する。この場合、信号復元部8は、被覆導線Lwから検出されたロジック信号Saの微分波形に相当する信号波形を積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成する。検出部4Dは、抵抗32、および増幅部としての非差動増幅部33を備えている。この検出部4Dでは、抵抗32は、その一端が入力端子部14の一の端子を介してプローブPLaを構成するシールドケーブルの芯線に接続され、その他端がグランドGに接続されている。また、抵抗32は、その一端は非差動増幅部33を構成する演算増幅器33aの非反転入力端子に接続されている。また、入力端子部14の他の端子もグランドGに接続されている。 The detection unit 4D, together with the integration unit 5, constitutes the signal restoration unit 8. In this case, the signal restoration unit 8 generates a restoration signal Sre having a signal waveform equivalent to the signal waveform of the logic signal Sa by integrating the signal waveform corresponding to the differential waveform of the logic signal Sa detected from the covered lead wire Lw. To do. The detection unit 4D includes a resistor 32 and a non-differential amplification unit 33 as an amplification unit. In the detection unit 4D, one end of the resistor 32 is connected to the core wire of the shielded cable constituting the probe PLa via one terminal of the input terminal unit 14, and the other end is connected to the ground G. One end of the resistor 32 is connected to the non-inverting input terminal of the operational amplifier 33a constituting the non-differential amplification unit 33. Further, other terminals of the input terminal portion 14 are also connected to the ground G.

また、この検出部4Dでは、被覆導線Lwから、結合容量、電極12a、プローブPLを構成するシールドケーブルの芯線および抵抗32を経由してグランドGに至る1つの電流経路が形成される。この電流経路には、被覆導線Lwの電圧Vwの信号波形を微分した信号波形の電流信号I1が図3に示す位相状態で流れ、抵抗32がこの電流信号I1を電圧信号Vc1に変換して出力する。 Further, in the detection unit 4D, one current path is formed from the coated lead wire Lw to the ground G via the coupling capacitance, the electrode 12a, the core wire of the shielded cable constituting the probe PL, and the resistor 32. A current signal I1 having a signal waveform obtained by differentiating the signal waveform of the voltage Vw of the coated lead wire Lw flows in this current path in the phase state shown in FIG. 3, and the resistor 32 converts the current signal I1 into a voltage signal Vc1 and outputs the current signal I1. To do.

非差動増幅部33は、一例として、1つの演算増幅器33aおよび2つの抵抗33b,33cで構成された非反転増幅回路と、反転増幅回路33dとを備えて、上記した検出部4Cの非差動増幅部33と同一に構成されて、第1電圧信号Vc1を高インピーダンスで入力すると共に、位相を反転させて増幅して、図3に示す位相状態で検出信号Sd(ロジック信号Saの微分波形に相当する信号波形の信号)として出力する。なお、非差動増幅部33は、例えば反転増幅回路33dを省いて、反転増幅アンプとして構成することもできる。 As an example, the non-differential amplifier 33 includes a non-inverting amplifier circuit composed of one operational amplifier 33a and two resistors 33b, 33c and an inverting amplifier circuit 33d, and the non-difference of the detection unit 4C described above. It is configured in the same way as the dynamic amplification unit 33, the first voltage signal Vc1 is input with high impedance, the phase is inverted and amplified, and the detection signal Sd (differential waveform of the logic signal Sa) is in the phase state shown in FIG. Is output as a signal with a signal waveform corresponding to). The non-differential amplifier 33 can be configured as an inverting amplifier by omitting, for example, the inverting amplifier circuit 33d.

したがって、この信号生成装置2D、およびこの信号生成装置2Dを備えた信号読取システム1Bにおいても、積分部5が検出信号Sdを積分して電圧Vwの信号波形(ロジック信号Saの信号波形)と同等の信号波形の復元信号Sreを生成して信号生成部6に出力する構成となるため、上記した信号生成装置2B、およびこの信号生成装置2Bを備えた信号読取システム1Aと同等の効果を奏することができる。 Therefore, even in the signal generation device 2D and the signal reading system 1B provided with the signal generation device 2D, the integrating unit 5 integrates the detection signal Sd and is equivalent to the signal waveform of the voltage Vw (the signal waveform of the logic signal Sa). Since the restored signal Sre of the signal waveform of the above is generated and output to the signal generation unit 6, the same effect as that of the above-mentioned signal generation device 2B and the signal reading system 1A provided with the signal generation device 2B can be obtained. Can be done.

また、上記の各信号読取システム1A,1Bでは、被覆導線La,Lbの金属部(芯線)と容量結合する電極部11a,11bを備えて電圧検出プローブとして機能する上記のプローブPLa,PLbを信号生成装置2A,2B,2C,2Dに接続する構成を採用しているが、この構成に限定されるものではない。 Further, in each of the above-mentioned signal reading systems 1A and 1B, the above-mentioned probes PLa and PLb which are provided with electrode portions 11a and 11b capacitively coupled to the metal portions (core wires) of the coated conducting wires La and Lb and function as voltage detection probes are used as signals. A configuration is adopted in which the generators are connected to the generators 2A, 2B, 2C, and 2D, but the configuration is not limited to this configuration.

例えば、プローブPLa,PLbに代えて、図9に示すように、第1電流検出プローブPLcおよび第2電流検出プローブPLd(以下、電流検出プローブPLc,PLdともいう。被覆導線La,Lbを切断することなく、被覆導線La,Lbに装着し得るクランプ式の電流検出プローブが好ましい)を信号生成装置2A(2B)に接続したり、図10に示すように、電流検出プローブPLc,PLdのうちのいずれか1つ(図10では一例として、電流検出プローブPLc)を信号生成装置2C(2D)に接続したりして、符号特定用信号Sfを生成する構成を採用することもできる。なお、信号生成装置2A(2B,2C,2D)については、既に説明したため、説明を省略する。 For example, instead of the probes PLa and PLb, as shown in FIG. 9, the first current detection probe PLc and the second current detection probe PLd (hereinafter, also referred to as current detection probes PLc and PLd; coated conductors La and Lb are cut. A clamp-type current detection probe that can be attached to the coated conductors La and Lb is preferable), and the current detection probes PLc and PLd can be connected to the signal generator 2A (2B) or as shown in FIG. It is also possible to adopt a configuration in which one of them (as an example in FIG. 10, the current detection probe PLc) is connected to the signal generation device 2C (2D) to generate the code identification signal Sf. Since the signal generator 2A (2B, 2C, 2D) has already been described, the description thereof will be omitted.

この電流検出プローブPLc,PLdは、一例として、分割可能に構成されて被覆導線La,Lbのうちの対応する被覆導線を内部に挿通可能な(被覆導線をクランプ可能な)磁気コア61と、磁気コア61に巻線を巻き付けて構成されたコイル62とを有して構成された電流センサ部を備えて、同一に構成されている。この電流検出プローブPLc,PLdは、各電流センサ部で対応する被覆導線(電流検出プローブPLcでは被覆導線La、電流検出プローブPLdでは被覆導線Lb)をクランプした状態において、対応する被覆導線を流れている電流(被覆導線Laや被覆導線Lwを流れている電流Iaと、被覆導線Lbを流れている電流Ib)を検出することにより、対応する被覆導線に伝送されている信号の微分波形に相当する信号波形の電流信号Ii(電圧Va,Vwについての電流信号Iia、電圧Vbについての電流信号Iib)を、シールドケーブル(一例として、同軸ケーブル)を介して信号生成装置2A(2B,2C,2D)に出力する。 As an example, the current detection probes PLc and PLd have a magnetic core 61 which is configured to be divisible and can insert a corresponding coated wire among the coated wires La and Lb inside (the coated wire can be clamped) and magnetic. A current sensor unit configured to include a coil 62 configured by winding a winding around a core 61 is provided and is configured in the same manner. The current detection probes PLc and PLd flow through the corresponding coated conductors in a state where the corresponding coated conductors (coated conductors La for the current detection probe PLc and coated conductors Lb for the current detection probe PLd) are clamped in each current sensor unit. By detecting the current (current Ia flowing through the coated conductor La or coated conductor Lw and current Ib flowing through the coated conductor Lb), it corresponds to the differential waveform of the signal transmitted to the corresponding coated conductor. The current signal Ii (current signal Iia for voltage Va, Vw, current signal Iib for voltage Vb) of the signal waveform is passed through the shield cable (coaxial cable as an example) to the signal generator 2A (2B, 2C, 2D). Output to.

この電流検出プローブPLc,PLdでは、各磁気コア61は、CANバスSBを構成する被覆導線La,Lb(通常状態において、互いに撚り合わされている被覆導線La,Lb)を部分的に解いて、この解いた被覆導線La,Lbにクランプするように取り付けられる。ただし、解くことができる範囲は狭いことから、断面(周方向と直交する平面での断面)が小さく、これに伴い外径も小さいコア材を磁気コア61として使用せざるを得ない。また、これにより、コイル62のターン数も少なくせざるを得ない。 In the current detection probes PLc and PLd, each magnetic core 61 partially unravels the coated conductors La and Lb (under the normal state, the coated conductors La and Lb twisted together) constituting the CAN bus SB. It is attached so as to be clamped to the unraveled coated lead wires La and Lb. However, since the range that can be solved is narrow, a core material having a small cross section (a cross section in a plane orthogonal to the circumferential direction) and a small outer diameter must be used as the magnetic core 61. Further, as a result, the number of turns of the coil 62 has to be reduced.

したがって、この構成の電流検出プローブPLc,PLdを使用した信号生成装置2Aでは、図示はしないが、電流検出プローブPLc,PLdからの電流信号Iia,Iibが一次巻線21aの各端子TP1,TP2に入力されることから、一次巻線21aを含む上記の一次側電流経路には、上記した電流信号I1と同等の信号波形(ロジック信号Saの信号波形を微分した信号波形)の電流信号が流れる。また、電流検出プローブPLcを使用した信号生成装置2Cでは、図示はしないが、電流検出プローブPLcからの電流信号Iiaが一次巻線21aの端子TP1に入力されることから、一次巻線21aを含む上記の一次側電流経路には、上記した電流信号I1と同等の信号波形(ロジック信号Saの信号波形を微分した信号波形)の電流信号が流れる。 Therefore, in the signal generator 2A using the current detection probes PLc and PLd having this configuration, although not shown, the current signals Iia and Iib from the current detection probes PLc and PLd are connected to the terminals TP1 and TP2 of the primary winding 21a. Since it is input, a current signal having a signal waveform equivalent to that of the current signal I1 (a signal waveform obtained by differentiating the signal waveform of the logic signal Sa) flows through the primary side current path including the primary winding 21a. Further, in the signal generation device 2C using the current detection probe PLc, although not shown, the current signal Iia from the current detection probe PLc is input to the terminal TP1 of the primary winding 21a, and therefore includes the primary winding 21a. A current signal having a signal waveform equivalent to that of the current signal I1 (a signal waveform obtained by differentiating the signal waveform of the logic signal Sa) flows through the primary side current path.

また、電流検出プローブPLc,PLdを使用した信号生成装置2Bでは、図示はしないが、電流検出プローブPLcからの電流信号Iia(上記した第1電流信号I1aと同等の信号波形)が抵抗25を含む第1電流経路(つまり、電流検出プローブPLc側の電流経路)に流れると共に、電流検出プローブPLdからの電流信号Iib(上記した第2電流信号I1bと同等の信号波形)が抵抗26を含む第2電流経路(つまり、電流検出プローブPLd側の電流経路)に流れる。また、電流検出プローブPLcを使用した信号生成装置2Dでは、図示はしないが、電流検出プローブPLcからの電流信号Iia(上記した電流信号I1と同等の信号波形)が抵抗32を含む電流経路に流れる。 Further, in the signal generator 2B using the current detection probes PLc and PLd, although not shown, the current signal Iia from the current detection probe PLc (the signal waveform equivalent to the first current signal I1a described above) includes the resistor 25. A second current signal Iib (a signal waveform equivalent to the second current signal I1b described above) from the current detection probe PLd includes a resistor 26 while flowing through the first current path (that is, the current path on the current detection probe PLc side). It flows in the current path (that is, the current path on the current detection probe PLd side). Further, in the signal generator 2D using the current detection probe PLc, although not shown, the current signal Iia (the signal waveform equivalent to the above current signal I1) from the current detection probe PLc flows in the current path including the resistor 32. ..

これにより、信号生成装置2A(2B,2C,2D)では、電流検出プローブPLc,PLdが接続されている構成においても、プローブPLa,PLbが接続されている構成と同様にして、検出部4A(4B,4C,4D)が上記の検出信号Sdを出力し、積分部5がこの検出信号Sdを積分して、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成して出力し、信号生成部6がこの復元信号Sreを閾値電圧Vthと比較して二値化することにより、符号特定用信号Sfを生成して出力することができる(図3参照)。 As a result, in the signal generator 2A (2B, 2C, 2D), even in the configuration in which the current detection probes PLc and PLd are connected, the detection unit 4A ( 4B, 4C, 4D) outputs the above-mentioned detection signal Sd, and the integrating unit 5 integrates the detection signal Sd to generate and output a restoration signal Sre having a signal waveform equivalent to the signal waveform of the logic signal Sa. , The signal generation unit 6 can generate and output the code identification signal Sf by binarizing the restoration signal Sre with the threshold voltage Vth (see FIG. 3).

また、信号生成部6では、上記したように、復元信号Sreにおける低電圧側の電圧レベルおよび高電圧側の電圧レベルのうちのより安定している電圧レベル(上記の例では、低電圧側の電圧レベル)を基準として規定された閾値電圧Vthで、復元信号Sreを二値化して符号特定用信号Sfを生成する構成を採用しているが、ロジック信号Saの周波数よりも低い周波数のノイズ(例えば、商用周波数と同等の周波数のノイズ)が復元信号Sreに重畳することがある。この場合には、安定しているとした上記の電圧レベルもこのノイズの影響を受けて変動するため、信号生成部6では、一定の閾値電圧Vthに基づく復元信号Sreの二値化を正確に行えない事態が生じることがある。 Further, in the signal generation unit 6, as described above, the more stable voltage level among the voltage level on the low voltage side and the voltage level on the high voltage side in the restoration signal Sre (in the above example, the voltage level on the low voltage side). A configuration is adopted in which the restoration signal Sre is binarized to generate the code identification signal Sf at the threshold voltage Vth defined based on the voltage level), but noise (noise at a frequency lower than the frequency of the logic signal Sa) ( For example, noise having a frequency equivalent to that of a commercial frequency) may be superimposed on the restoration signal Sre. In this case, since the above voltage level, which is considered to be stable, also fluctuates under the influence of this noise, the signal generation unit 6 accurately binarizes the restoration signal Sre based on the constant threshold voltage Vth. There may be situations where it cannot be done.

このような場合においても、信号生成部6が一定の閾値電圧Vthに基づいて、復元信号Sreの二値化を正確に実行し得るように、上記の特許文献2において出願人が開示している種々の波形整形部(以下では、波形整形部7という)を、図11に示すように、積分部5と信号生成部6との間に配置(介装)する構成を採用することもできる。この構成は、上記した信号生成装置2A,2B,2C,2Dのいずれにおいても採用することができる。 Even in such a case, the applicant discloses in Patent Document 2 above so that the signal generation unit 6 can accurately binarize the restoration signal Sre based on a constant threshold voltage Vth. As shown in FIG. 11, it is also possible to adopt a configuration in which various waveform shaping units (hereinafter referred to as waveform shaping units 7) are arranged (intervened) between the integrating unit 5 and the signal generating unit 6. This configuration can be adopted in any of the signal generators 2A, 2B, 2C, and 2D described above.

以下では、上記の特許文献2において開示された波形整形部のうちの最も簡易な構成の波形整形部(コンデンサと抵抗とダイオードとで構成された波形整形部)を使用した例を挙げて、具体的に説明する。 In the following, an example using a waveform shaping unit having the simplest configuration (a waveform shaping unit composed of a capacitor, a resistor, and a diode) among the waveform shaping units disclosed in Patent Document 2 will be given as a specific example. To explain.

まず、復元信号Sreにおける低電圧側の電圧レベルを基準として信号生成部6での閾値電圧Vthを規定する構成では、復元信号Sreにおける低電圧側の電圧レベルを一定にする(予め規定された定電圧(以下、ターゲット定電圧Vtgともいう)で安定化させる)必要がある。この場合、波形整形部7は、図12に示すように、復元信号Sreが入力される入力端子7aと安定化させた新たな復元信号Sre1を出力する出力端子7bとの間に接続されたコンデンサ7cと、一端が出力端子7bに接続されると共に他端にターゲット定電圧Vtgが印加された抵抗7dと、カソード端子が出力端子7bに接続されると共にアノード端子にターゲット定電圧Vtgが印加されたダイオード7eとを備えて構成される。この構成の波形整形部7は、ダイオード7eの順方向降下電圧を無視し得るものとした場合には、入力される復元信号Sreの振幅(ピークピーク電圧)を維持しつつ、低電圧側の電圧レベル(低電圧期間の電圧)をターゲット定電圧Vtgに揃えて(つまり、シングルエンド信号に整形して)、復元信号Sre1として出力する。 First, in the configuration in which the threshold voltage Vth in the signal generation unit 6 is defined with reference to the voltage level on the low voltage side of the restoration signal Sre, the voltage level on the low voltage side of the restoration signal Sre is made constant (predetermined constant). It is necessary to stabilize with a voltage (hereinafter, also referred to as a target constant voltage Vtg). In this case, as shown in FIG. 12, the waveform shaping unit 7 is a capacitor connected between the input terminal 7a to which the restoration signal Sre is input and the output terminal 7b to output the stabilized new restoration signal Sre1. 7c, a resistor 7d with one end connected to the output terminal 7b and a target constant voltage Vtg applied to the other end, and a cathode terminal connected to the output terminal 7b and a target constant voltage Vtg applied to the anode terminal. It is configured to include a diode 7e. When the forward voltage drop of the diode 7e can be ignored, the waveform shaping unit 7 having this configuration maintains the amplitude (peak peak voltage) of the input restoration signal Sre and the voltage on the low voltage side. The level (voltage in the low voltage period) is aligned with the target constant voltage Vtg (that is, shaped into a single-ended signal) and output as the restoration signal Sre1.

したがって、波形整形部7の後段の信号生成部6では、ターゲット定電圧Vtgよりも若干高い電圧を閾値電圧Vthとして規定することで、復元信号Sreにおける低電圧側の電圧レベルが変動しているときでも、復元信号Sreを閾値電圧Vthで確実に二値化して符号特定用信号Sfを生成することが可能となる。 Therefore, when the signal generation unit 6 in the subsequent stage of the waveform shaping unit 7 defines a voltage slightly higher than the target constant voltage Vtg as the threshold voltage Vth, the voltage level on the low voltage side of the restoration signal Sre fluctuates. However, the restoration signal Sre can be reliably binarized at the threshold voltage Vth to generate the code identification signal Sf.

次に、例えば、信号生成装置2A,2B,2C,2Dにおいて復元信号Sreが、図3に示す位相状態に対して反転した位相で出力されている場合について説明する。この場合には、復元信号Sreにおける高電圧側の電圧レベルを基準として信号生成部6での閾値電圧Vthを規定する。この構成では、復元信号Sreにおける高電圧側の電圧レベルを一定にする(ターゲット定電圧Vtgで安定化させる)必要がある。この場合、波形整形部7は、図13に示すように、コンデンサ7cおよび抵抗7dについては図12に示す構成と同一とする。一方、ダイオード7eについては、図12に示す構成とは異なり、アノード端子が出力端子7bに接続され、カソード端子にターゲット定電圧Vtgが印加される構成とする。この構成の波形整形部7は、入力される復元信号Sreの振幅を維持しつつ、高電圧側の電圧レベルをターゲット定電圧Vtgに揃えて、復元信号Sre1として出力する。 Next, for example, a case where the restoration signal Sre is output in the phase inverted with respect to the phase state shown in FIG. 3 in the signal generation devices 2A, 2B, 2C, and 2D will be described. In this case, the threshold voltage Vth in the signal generation unit 6 is defined with reference to the voltage level on the high voltage side of the restoration signal Sre. In this configuration, it is necessary to keep the voltage level on the high voltage side of the restoration signal Sre constant (stabilize at the target constant voltage Vtg). In this case, as shown in FIG. 13, the waveform shaping unit 7 has the same configuration as that shown in FIG. 12 for the capacitor 7c and the resistor 7d. On the other hand, the diode 7e has a configuration in which the anode terminal is connected to the output terminal 7b and the target constant voltage Vtg is applied to the cathode terminal, unlike the configuration shown in FIG. The waveform shaping unit 7 having this configuration aligns the voltage level on the high voltage side with the target constant voltage Vtg while maintaining the amplitude of the input restoration signal Sre, and outputs it as the restoration signal Sre1.

したがって、波形整形部7の後段の信号生成部6では、ターゲット定電圧Vtgよりも若干低い電圧を閾値電圧Vthとして規定することで、復元信号Sreにおける高電圧側の電圧レベルが変動しているときでも、復元信号Sreを閾値電圧Vthで確実に二値化して符号特定用信号Sfを生成することが可能となる。 Therefore, when the signal generation unit 6 in the subsequent stage of the waveform shaping unit 7 defines a voltage slightly lower than the target constant voltage Vtg as the threshold voltage Vth, the voltage level on the high voltage side of the restoration signal Sre fluctuates. However, the restoration signal Sre can be reliably binarized at the threshold voltage Vth to generate the code identification signal Sf.

以上のようにして、波形整形部7は、復元信号Sreにおける低電圧側および高電圧側のうちの所望の電圧側の電圧レベル(信号生成部6において閾値電圧Vthと比較される電圧側の電位)を一定のターゲット定電圧Vtgに揃える機能、言い換えればターゲット定電圧Vtgに固定する機能を有しているため、「基準電位固定回路」とも称呼することもできる。また、この波形整形部7を備えた信号生成装置2A,2B,2C,2D、および信号読取システム1A,1B,1C,1Dによれば、上記のようにして、信号生成部6において復元信号Sreを閾値電圧Vthで確実に二値化して符号特定用信号Sfを生成することができる。 As described above, the waveform shaping unit 7 has the voltage level on the desired voltage side of the low voltage side and the high voltage side of the restoration signal Sre (the potential on the voltage side compared with the threshold voltage Vth in the signal generation unit 6). ) Has a function of aligning the target constant voltage Vtg, in other words, a function of fixing the target constant voltage Vtg, so that it can also be called a “reference potential fixed circuit”. Further, according to the signal generation devices 2A, 2B, 2C, 2D provided with the waveform shaping unit 7, and the signal reading systems 1A, 1B, 1C, 1D, the restoration signal Sre is performed in the signal generation unit 6 as described above. Can be reliably binarized at the threshold voltage Vth to generate the code identification signal Sf.

なお、信号復元部8の構成は、上記の構成に限定されず、各種構成を採用することができる。例えば、上記の信号生成装置2A〜2Dでは、検出部4A〜4Dの後段に積分部5を配置した例について説明したが、積分部5の配置位置は、これに限らない。例えば、信号生成装置2A,2Bでは、電極部11a(または電流検出プローブPLc(コイル62))から信号生成部6の間の任意の位置、および電極部11b(または電流検出プローブPLd(コイル62))から信号生成部6の間の任意の位置に配置することができる。また、信号生成装置2C,2Dでは、電極部11a(または電流検出プローブPLc(コイル62))から信号生成部6の間の任意の位置に配置することができる。また、積分部5の構成に関しても、上記したように、抵抗とコンデンサで構成された公知のローパスフィルタ(RCフィルタ)で構成することができる。なお、以下の説明において、信号生成装置2A,2Bと同一の構成については同一の符号を付して重複する説明を省略する。また、信号生成装置2C,2Dと同一の動作については重複する説明を省略する。 The configuration of the signal restoration unit 8 is not limited to the above configuration, and various configurations can be adopted. For example, in the above signal generation devices 2A to 2D, an example in which the integrating unit 5 is arranged after the detection units 4A to 4D has been described, but the arrangement position of the integrating unit 5 is not limited to this. For example, in the signal generators 2A and 2B, an arbitrary position between the electrode portion 11a (or the current detection probe PLc (coil 62)) and the signal generation portion 6 and the electrode portion 11b (or the current detection probe PLd (coil 62)) ) Can be arranged at any position between the signal generation units 6. Further, in the signal generation devices 2C and 2D, it can be arranged at an arbitrary position between the electrode unit 11a (or the current detection probe PLc (coil 62)) and the signal generation unit 6. Further, as described above, the structure of the integrating unit 5 can also be configured by a known low-pass filter (RC filter) composed of a resistor and a capacitor. In the following description, the same components as those of the signal generators 2A and 2B are designated by the same reference numerals, and duplicate description will be omitted. Further, duplicate description will be omitted for the same operation as the signal generators 2C and 2D.

具体的に、例えば、信号生成装置2Aに関しては、図14に示すように、抵抗RI1とコンデンサCI1とで構成したローパスフィルタ型の積分部5A1を、トランス21の二次巻線21bの端子TP3と抵抗23bの他端との間に配置し、かつ抵抗RI2とコンデンサCI2とで構成して積分部5A1と同じ構成のローパスフィルタ型の積分部5A2(以下、積分部5A1,5A2を区別しないときには、「積分部5A」ともいう)を、トランス21の二次巻線21bの端子TP4と抵抗23cの他端との間に配置する。この構成においても、信号復元部8は、被覆導線La,Lbから検出されたロジック信号Saの微分波形に相当する信号波形を積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成して信号生成部6に出力する。具体的には、この信号復元部8では、積分部5A1が第2グランドG2を基準として端子TP3に発生する第1電圧信号Vc1を積分して積分信号を出力すると共に積分部5A2が第2グランドG2を基準として端子TP4に発生する第2電圧信号Vc2を積分して積分信号を出力し、差動増幅部23が、積分部5A1から出力された積分信号と積分部5A2から出力された積分信号との差分電圧を、抵抗23dの抵抗値を抵抗23bの抵抗値で除算して得られるゲインで反転増幅して、図3に示す復元信号Sreを生成して信号生成部6に出力する。 Specifically, for example, with respect to the signal generator 2A, as shown in FIG. 14, the low-pass filter type integrating unit 5A1 composed of the resistor RI1 and the capacitor CI1 is connected to the terminal TP3 of the secondary winding 21b of the transformer 21. When the low-pass filter type integrating unit 5A2 (hereinafter referred to as the integrating unit 5A1 and 5A2) which is arranged between the other end of the resistor 23b and is composed of the resistor RI2 and the capacitor CI2 and has the same configuration as the integrating unit 5A1 is not distinguished. An “integrator 5A”) is arranged between the terminal TP4 of the secondary winding 21b of the transformer 21 and the other end of the resistor 23c. Also in this configuration, the signal restoration unit 8 restores a signal waveform equivalent to the signal waveform of the logic signal Sa by integrating the signal waveform corresponding to the differential waveform of the logic signal Sa detected from the coated conductors La and Lb. A signal Sre is generated and output to the signal generation unit 6. Specifically, in the signal restoration unit 8, the integrating unit 5A1 integrates the first voltage signal Vc1 generated at the terminal TP3 with the second ground G2 as a reference and outputs an integrated signal, and the integrating unit 5A2 outputs the integrated signal. The second voltage signal Vc2 generated at the terminal TP4 is integrated with reference to G2 to output an integrated signal, and the differential amplification unit 23 outputs the integrated signal output from the integrating unit 5A1 and the integrated signal output from the integrating unit 5A2. The difference voltage between and is inverted and amplified by the gain obtained by dividing the resistance value of the resistor 23d by the resistance value of the resistor 23b to generate the restoration signal Sre shown in FIG. 3 and output it to the signal generation unit 6.

また、信号生成装置2Aに関しては、積分部5A1,5A2を配置することなく、つまりトランス21の二次巻線21bの端子TP3と抵抗23bの他端とを接続すると共に二次巻線21bの端子TP4と抵抗23cの他端とを接続した構成において、互いに同じ容量値のコンデンサCI3,CI4を同図に破線で示すように抵抗23d,23eにそれぞれ並列接続した構成を採用することもできる。この構成の信号復元部8では、差動増幅部23は、第1電圧信号Vc1と第2電圧信号Vc2との差分電圧を、抵抗23dの抵抗値を抵抗23bの抵抗値で除算して得られるゲインで反転増幅すると共に積分して、図3に示す復元信号Sreを生成して信号生成部6に出力する。また、図示はしないが、積分部5(または積分部5A)を、電極部11a(または電流検出プローブPLc(コイル62))と、トランス21における一次巻線21aの端子TP1との間、および電極部11b(または電流検出プローブPLd(コイル62))と、一次巻線21aの端子TP2との間にそれぞれ配置した構成を採用することができる。 Further, regarding the signal generator 2A, the integrating units 5A1 and 5A2 are not arranged, that is, the terminal TP3 of the secondary winding 21b of the transformer 21 and the other end of the resistor 23b are connected and the terminal of the secondary winding 21b is connected. In the configuration in which the TP4 and the other end of the resistor 23c are connected, it is also possible to adopt a configuration in which the capacitors CI3 and CI4 having the same capacitance value are connected in parallel to the resistors 23d and 23e as shown by the broken line in the figure. In the signal restoration unit 8 having this configuration, the differential amplification unit 23 is obtained by dividing the difference voltage between the first voltage signal Vc1 and the second voltage signal Vc2 by the resistance value of the resistor 23d and the resistance value of the resistor 23b. The restoration signal Sre shown in FIG. 3 is generated and output to the signal generation unit 6 by inverting and amplifying with the gain and integrating. Although not shown, the integrating unit 5 (or integrating unit 5A) is connected between the electrode unit 11a (or the current detection probe PLc (coil 62)) and the terminal TP1 of the primary winding 21a in the transformer 21, and the electrode. It is possible to adopt a configuration in which the portion 11b (or the current detection probe PLd (coil 62)) and the terminal TP2 of the primary winding 21a are respectively arranged.

また、信号生成装置2Bに関しても、図15に示すように、抵抗25の一端と演算増幅器23fの非反転入力端子との間、および抵抗26の一端と演算増幅器23gの非反転入力端子との間に積分部5(または積分部5A)をそれぞれ配置する構成を採用することができる。また、図示はしないが、この位置に積分部5(または積分部5A)を配置することなく、演算増幅器23fの出力端子と抵抗23bの他端との間、および演算増幅器23gの出力端子と抵抗23cの他端との間に積分部5(または積分部5A)をそれぞれ配置する構成を採用することもできる。さらに、図示はしないが、この位置に積分部5(または積分部5A)を配置することなく、抵抗23d,23eに並列にコンデンサCI3,CI4を配置する構成を採用することもできる。また、図示はしないが、電極部11a(または電流検出プローブPLc(コイル62))と抵抗25の一端との間、および電極部11b(または電流検出プローブPLd(コイル62))と抵抗26の一端との間に積分部5(または積分部5A)をそれぞれ配置する構成を採用することができる。これらの構成の信号復元部8でも、上記した信号生成装置2Aの信号復元部8と同様にして、信号復元部8が図3に示す復元信号Sreを生成して信号生成部6に出力する。 As for the signal generator 2B, as shown in FIG. 15, between one end of the resistor 25 and the non-inverting input terminal of the operational amplifier 23f, and between one end of the resistor 26 and the non-inverting input terminal of the operational amplifier 23g. It is possible to adopt a configuration in which the integrating unit 5 (or the integrating unit 5A) is arranged in each. Further, although not shown, without arranging the integrator 5 (or the integrator 5A) at this position, between the output terminal of the operational amplifier 23f and the other end of the resistor 23b, and the output terminal and the resistor of the operational amplifier 23g. It is also possible to adopt a configuration in which the integrating unit 5 (or the integrating unit 5A) is arranged between the other end of the 23c. Further, although not shown, it is also possible to adopt a configuration in which the capacitors CI3 and CI4 are arranged in parallel with the resistors 23d and 23e without arranging the integrating unit 5 (or the integrating unit 5A) at this position. Although not shown, between the electrode portion 11a (or the current detection probe PLc (coil 62)) and one end of the resistor 25, and between the electrode portion 11b (or the current detection probe PLd (coil 62)) and one end of the resistor 26. It is possible to adopt a configuration in which the integrating unit 5 (or the integrating unit 5A) is arranged between the two. In the signal restoration unit 8 having these configurations, the signal restoration unit 8 generates the restoration signal Sre shown in FIG. 3 and outputs it to the signal generation unit 6 in the same manner as the signal restoration unit 8 of the signal generation device 2A described above.

同様にして、信号生成装置2Cに関しても、トランス21の二次巻線21bの端子TP3と演算増幅器33aの非反転入力端子との間に積分部5(または積分部5A)を配置する構成、抵抗33bにコンデンサCI3を並列接続する構成、および電極部11a(または電流検出プローブPLc(コイル62))とトランス21における一次巻線21aの端子TP1との間に積分部5(または積分部5A)を配置する構成を採用することができる。これらの構成においても、信号復元部8は、被覆導線Lwから検出されたロジック信号Saの微分波形に相当する信号波形を積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成して信号生成部6に出力する。 Similarly, with respect to the signal generator 2C, the integrator 5 (or the integrator 5A) is arranged between the terminal TP3 of the secondary winding 21b of the transformer 21 and the non-inverting input terminal of the operational amplifier 33a. A configuration in which a capacitor CI3 is connected in parallel to 33b, and an integrator 5 (or an integrator 5A) is provided between the electrode portion 11a (or the current detection probe PLc (coil 62)) and the terminal TP1 of the primary winding 21a in the transformer 21. The configuration to be arranged can be adopted. Even in these configurations, the signal restoration unit 8 integrates the signal waveform corresponding to the differential waveform of the logic signal Sa detected from the coated lead wire Lw, so that the signal restoration signal of the signal waveform equivalent to the signal waveform of the logic signal Sa is restored. Sre is generated and output to the signal generation unit 6.

また、信号生成装置2Dに関しても、抵抗32の一端と演算増幅器33aの非反転入力端子との間に積分部5(または積分部5A)を配置する構成、抵抗33bにコンデンサCI3を並列接続する構成、および電極部11a(または電流検出プローブPLc(コイル62))と抵抗32の一端との間に積分部5(または積分部5A)を配置する構成を採用することができる。これらの構成においても、信号復元部8は、被覆導線Lwから検出されたロジック信号Saの微分波形に相当する信号波形を積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成して信号生成部6に出力する。 Further, the signal generator 2D also has a configuration in which the integrating unit 5 (or the integrating unit 5A) is arranged between one end of the resistor 32 and the non-inverting input terminal of the operational amplifier 33a, and a configuration in which the capacitor CI3 is connected in parallel to the resistor 33b. , And a configuration in which the integrating unit 5 (or the integrating unit 5A) is arranged between the electrode unit 11a (or the current detection probe PLc (coil 62)) and one end of the resistor 32 can be adopted. Even in these configurations, the signal restoration unit 8 integrates the signal waveform corresponding to the differential waveform of the logic signal Sa detected from the coated lead wire Lw, so that the signal restoration signal of the signal waveform equivalent to the signal waveform of the logic signal Sa is restored. Sre is generated and output to the signal generation unit 6.

上記の各積分部5,5Aを備えた構成の信号生成装置2A,2B,2C,2D、およびこれらの信号生成装置2A,2B,2C,2Dを備えた信号読取システム1A,1Bによれば、信号復元部8が、被覆導線La,Lb(または被覆導線Lw)から検出されたロジック信号Saの微分波形に相当する信号波形を積分することにより、ロジック信号Saの信号波形と同等の信号波形の復元信号Sreを生成する構成のため、ロジック信号Saの信号波形にパルス状やステップ状の電圧変化が生じている状態においても、この電圧変化の影響を殆ど受けることなく、信号生成部6において復元信号Sreを1つの閾値電圧Vthで正しく二値化して、正しい符号特定用信号Sfを生成することができる。 According to the signal generators 2A, 2B, 2C, 2D having the above-mentioned integrating units 5, 5A, and the signal reading systems 1A, 1B including these signal generators 2A, 2B, 2C, 2D. The signal restoration unit 8 integrates a signal waveform corresponding to the differential waveform of the logic signal Sa detected from the coated conductors La and Lb (or the coated conductors Lw) to obtain a signal waveform equivalent to the signal waveform of the logic signal Sa. Since the restoration signal Sre is generated, the signal generation unit 6 restores the signal waveform of the logic signal Sa without being affected by the voltage change even in a pulsed or stepped voltage change. The signal Sre can be correctly binarized at one threshold voltage Vth to generate a correct code identification signal Sf.

本願発明によれば、シングルエンド信号に整形された新たな復元信号を閾値電圧で確実に二値化して符号特定用信号を生成することができる。これにより、本願発明は、このような符号特定用信号を生成する信号生成装置、およびこの信号生成装置を備えた信号読取システムに広く適用することができる。 According to the present invention, a new restored signal shaped into a single-ended signal can be reliably binarized at a threshold voltage to generate a code identification signal. Thereby, the present invention can be widely applied to a signal generation device that generates such a code identification signal and a signal reading system including the signal generation device.

1A,1B,1C,1D 信号読取システム
2A,2B,2C,2D 信号生成装置
3 信号変換装置
4A,4B,4C,4D 検出部
5,5A 積分部
6 信号生成部
7 波形整形部
8 信号復元部
12a,12b 電極
21 トランス
21a 一次巻線
21b 二次巻線
22 抵抗
La,Lb 被覆導線
Sa ロジック信号
SB CANバス(通信路)
Sd 検出信号
Sf 符号特定用信号
Sre 復元信号
TP3,TP4 二次巻線の各端子
Vth 閾値電圧
1A, 1B, 1C, 1D signal reading system 2A, 2B, 2C, 2D signal generator 3 signal converter 4A, 4B, 4C, 4D detection unit 5,5A integration unit 6 signal generation unit 7 waveform shaping unit 8 signal restoration unit 12a, 12b Electrode 21 Transformer 21a Primary winding 21b Secondary winding 22 Resistance La, Lb Covered lead wire Sa Logic signal SB CAN bus (communication path)
Sd detection signal Sf code identification signal Sre restoration signal TP3, TP4 Each terminal of the secondary winding Vth threshold voltage

Claims (8)

被覆導線で構成される通信路を介して伝送されるロジック信号に基づき、当該ロジック信号に対応する符号を特定可能な符号特定用信号を生成する信号生成装置であって、
前記被覆導線から検出された前記ロジック信号の微分波形に相当する信号波形を積分することにより、当該ロジック信号の信号波形と同等の信号波形の復元信号を生成する信号復元部と、
前記復元信号を閾値電圧と比較して二値化することにより前記符号特定用信号を生成する信号生成部とを備えている信号生成装置。
A signal generation device that generates a code identification signal capable of specifying a code corresponding to the logic signal based on a logic signal transmitted via a communication path composed of a covered wire.
A signal restoration unit that generates a restoration signal having a signal waveform equivalent to the signal waveform of the logic signal by integrating a signal waveform corresponding to the differential waveform of the logic signal detected from the coated lead wire.
A signal generation device including a signal generation unit that generates a code identification signal by binarizing the restored signal with a threshold voltage.
前記信号復元部は、一次巻線および二次巻線を有するトランスと当該二次巻線の各端子間に接続された抵抗とを備えて、前記被覆導線における被覆部に接触させられる電極と当該被覆導線との間の結合容量を介して当該電極によって検出された信号を前記一次巻線に入力すると共に前記二次巻線から出力される前記ロジック信号の微分波形に相当する信号波形を積分することにより前記復元信号を生成する請求項1記載の信号生成装置。 The signal restoration unit includes an electrode having a transformer having a primary winding and a secondary winding and a resistor connected between each terminal of the secondary winding, and is brought into contact with the coating portion of the coated lead wire. The signal detected by the electrode is input to the primary winding through the coupling capacitance between the coated conductor and the signal waveform corresponding to the differential waveform of the logic signal output from the secondary winding is integrated. The signal generation device according to claim 1, wherein the restoration signal is generated thereby. 前記信号復元部は、前記被覆導線における被覆部に接触させられる電極と当該被覆導線との間の結合容量を介して容量結合を介して当該電極によって検出された信号を入力する抵抗素子を備え、当該抵抗素子に発生した前記ロジック信号の微分波形に相当する信号波形を積分することにより前記復元信号を生成する請求項1記載の信号生成装置。 The signal restoration unit includes a resistance element that inputs a signal detected by the electrode via capacitive coupling via a coupling capacitance between an electrode contacted with the coating portion of the coated conductor and the coated conductor. The signal generation device according to claim 1, wherein the restored signal is generated by integrating a signal waveform corresponding to a differential waveform of the logic signal generated in the resistance element. 前記信号復元部は、一次巻線および二次巻線を有するトランスと当該二次巻線の各端子間に接続された抵抗とを備えて、前記被覆導線に装着された電流検出プローブから出力される信号を前記一次巻線に入力すると共に前記二次巻線から出力される前記ロジック信号の微分波形に相当する信号波形を積分することにより前記復元信号を生成する請求項1記載の信号生成装置。 The signal restoration unit includes a transformer having a primary winding and a secondary winding and a resistor connected between each terminal of the secondary winding, and is output from a current detection probe mounted on the coated lead wire. The signal generator according to claim 1, wherein the restored signal is generated by inputting a signal to the primary winding and integrating a signal waveform corresponding to a differential waveform of the logic signal output from the secondary winding. .. 前記信号復元部は、前記被覆導線に装着された電流検出プローブから出力される信号を入力する抵抗素子を備え、当該抵抗素子に発生した前記ロジック信号の微分波形に相当する信号波形を積分することにより前記復元信号を生成する請求項1記載の信号生成装置。 The signal restoration unit includes a resistance element for inputting a signal output from a current detection probe mounted on the coated lead wire, and integrates a signal waveform corresponding to a differential waveform of the logic signal generated in the resistance element. The signal generation device according to claim 1, wherein the restoration signal is generated by the above. 前記信号復元部と前記信号生成部との間に配設されて、前記復元信号を、当該復元信号のピークピーク電圧と同等のピークピーク電圧で、かつ低電圧期間の電圧がターゲット定電圧に規定されたシングルエンド信号に整形して出力する波形整形部を備えている請求項1から5のいずれかに記載の信号生成装置。 Arranged between the signal restoration unit and the signal generation unit, the restoration signal has a peak peak voltage equivalent to the peak peak voltage of the restoration signal, and a voltage during a low voltage period is defined as a target constant voltage. The signal generation device according to any one of claims 1 to 5, further comprising a waveform shaping unit that shapes and outputs a single-ended signal. 前記信号復元部と前記信号生成部との間に配設されて、前記復元信号を、当該復元信号のピークピーク電圧と同等のピークピーク電圧で、かつ高電圧期間の電圧がターゲット定電圧に規定されたシングルエンド信号に整形して出力する波形整形部を備えている請求項1から5のいずれかに記載の信号生成装置。 Arranged between the signal restoration unit and the signal generation unit, the restoration signal has a peak peak voltage equivalent to the peak peak voltage of the restoration signal, and a voltage during a high voltage period is defined as a target constant voltage. The signal generation device according to any one of claims 1 to 5, further comprising a waveform shaping unit that shapes and outputs a single-ended signal. 請求項1から7のいずれかに記載の信号生成装置と、
前記信号生成装置によって生成された前記符号特定用信号を前記ロジック信号の通信方式に準拠した通信方式の信号に変換して出力する信号変換装置とを備えている信号読取システム。
The signal generator according to any one of claims 1 to 7.
A signal reading system including a signal conversion device that converts the code identification signal generated by the signal generation device into a signal of a communication method conforming to the communication method of the logic signal and outputs the signal.
JP2020162898A 2019-10-10 2020-09-29 Signal generation device and signal reading system Pending JP2021064940A (en)

Priority Applications (2)

Application Number Priority Date Filing Date Title
EP20874105.8A EP4044536A4 (en) 2019-10-10 2020-10-02 Signal generating device and signal reading system
PCT/JP2020/037561 WO2021070746A1 (en) 2019-10-10 2020-10-02 Signal generating device and signal reading system

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2019186996 2019-10-10
JP2019186996 2019-10-10

Publications (1)

Publication Number Publication Date
JP2021064940A true JP2021064940A (en) 2021-04-22

Family

ID=75486620

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2020162898A Pending JP2021064940A (en) 2019-10-10 2020-09-29 Signal generation device and signal reading system

Country Status (1)

Country Link
JP (1) JP2021064940A (en)

Similar Documents

Publication Publication Date Title
JP7073219B2 (en) Signal generator and signal reading system
WO2014052190A1 (en) System and method for ground fault detection in a transformer isolated communication channel of a network device
JP2021043026A (en) Signal generation device and signal reading system
US7599485B2 (en) Communications system employing single-pair identity circuit for remotely powered device
JP7267133B2 (en) Signal generator and signal reading system
CN111289786A (en) Probe interface circuit and probe adapter circuit for probe of oscilloscope
JP2011146934A (en) Transmission circuit, receiving circuit, transmitting method, receiving method, and signal transfer system
WO2014052196A1 (en) System and method for fail-safe communication across a compromised communication channel of a network device
WO2021070746A1 (en) Signal generating device and signal reading system
JP2004356780A (en) Transmission signal equalizing system, method thereof, and method of determining optimum equalization amount of transmission path
WO2020022387A1 (en) Signal generation device and signal reading system
JP2021064940A (en) Signal generation device and signal reading system
JP7237759B2 (en) signal generator
EP1335208B1 (en) Method and apparatus for the digital and analog triggering
JP7267134B2 (en) WAVEFORM SHAPING CIRCUIT, SIGNAL GENERATOR AND SIGNAL READING SYSTEM
JP2020038201A (en) Signal generation device
JP7258660B2 (en) Signal generator and signal reading system
WO2021005884A1 (en) Signal reading system and signal reading method
EP3829121B1 (en) Waveform shaping circuit, signal generation device, and signal reading system
JP2021025886A (en) Detection device and relay
JP5751138B2 (en) Communication system and communication method
JP2020017886A (en) Signal generator and signal reading system
JP7218199B2 (en) signal reader
JP2012222416A (en) Differential signal failure detection device and differential signal failure detection method
JP2020113965A (en) Signal reading system

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20230726