JP2018536900A - アレイ基板及び液晶表示装置 - Google Patents

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Abstract

アレイ基板及び液晶表示装置は、複数のデータ線（２０２）及び複数の走査線（２０１）を備え、前記データ線（２０２）と走査線（２０１）は２本ずつ非接触交差して画素領域（２０３）を形成し、複数のＲ、Ｇ、Ｂサブ画素（２０３１）を更に備え、前記Ｒ、Ｇ、Ｂサブ画素（２０３１）は、前記データ線（２０２）と平行な方向に沿って順に配置され、前記各サブ画素（２０３１）は、薄膜トランジスタＴＦＴ（２０３２）を介して、対応する前記走査線（２０１）及び前記データ線（２０２）に電気的に接続され、前記各画素領域（２０３）には、少なくとも１つの前記サブ画素（２０３１）が設けられ、隣接する２つの前記画素領域（２０３）を形成する走査線（２０１）は異なる。データ線（２０２）の数を減少し、製造コストを低減することができ、さらに、配置スペースを節約し、遮光面積をさらに低減し、画素の開口率を向上させることができる。

Description

本発明は液晶表示の分野に関し、特にアレイ基板及び液晶表示装置に関する。
表示技術の分野において、液晶ディスプレイ（Ｌｉｑｕｉｄ Ｃｒｙｓｔａｌ Ｄｉｓｐｌａｙ、ＬＣＤ）や有機発光ダイオード（Ｏｒｇａｎｉｃ Ｌｉｇｈｔ Ｅｍｉｔｔｉｎｇ Ｄｉｏｄｅ、ＯＬＥＤ）などのフラットパネルディスプレイは、徐々にＣＲＴディスプレイを代替して、液晶テレビ、携帯電話、パーソナルデジタルアシスタント、デジタルカメラ、コンピュータ画面又はノートパソコン画面などに幅広く使用されている。表示パネルは、ＬＣＤ、ＯＬＥＤの重要な構成部分である。
ＬＣＤの表示パネルであれ、ＯＬＥＤの表示パネルであれ、それらは通常、薄膜トランジスタ（Ｔｈｉｎ Ｆｉｌｍ Ｔｒａｎｓｉｓｔｏｒ、ＴＦＴ）アレイ基板を有する。このＴＦＴアレイ基板には、アレイ状に配置された複数のＲ、Ｇ、Ｂサブ画素、複数の走査線、及び複数のデータ線が形成される。各サブ画素はそれぞれ、対応する走査線を介して走査信号を受信し、対応するデータ線を介してデータ信号を受信して、画像を表示する。
図１に示されるように、図１は、従来技術のアレイ基板の構造模式図である。アレイ基板は、互いに平行であり且つ順に縦に配置された複数のデータ線（例えば、Ｄ１、Ｄ２、Ｄ３、Ｄ４、Ｄ５など）、互いに平行であり且つ順に配置された複数の走査線（例えば、Ｇ１、Ｇ２、Ｇ３、Ｇ４など）、及びアレイ状に配置されたサブ画素を備える。同じ行に位置する各サブ画素は、薄膜トランジスタＴＦＴを介して、この行のサブ画素の上方に位置する走査線に電気的に接続される。例えば、第１行の各サブ画素は、ＴＦＴを介して走査線Ｇ１に電気的に接続され、第２行の各サブ画素は、ＴＦＴを介して走査線Ｇ２に電気的に接続され、以下同様である。同じ列に位置する各サブ画素は、ＴＦＴを介してこの列のサブ画素の左側に位置するデータ線に電気的に接続される。例えば、第１列の各サブ画素は、ＴＦＴを介してデータ線Ｄ１に電気的に接続され、第２列の各サブ画素は、ＴＦＴを介してデータ線Ｄ２に電気的に接続され、以下同様である。
しかしながら、上記従来の接続方法では、多くのアレイ基板の配置スペースが占用され、遮光面積が占用され、表示パネルの開口率が低下し、データ線と走査線の利用率が低く、リソースが浪費され、液晶表示装置の製造コストが増加する。
本発明が主に解決しようとする技術的課題は、データ線の数を減少し、製造コストを低減することができ、さらに、配置スペースを節約し、遮光面積をさらに低減し、画素の開口率を向上させることができるアレイ基板及び液晶表示装置を提供することである。
上述の技術的課題を解決するために、本発明の技術的解決手段は、アレイ基板を提供する。このアレイ基板は、複数のデータ線及び複数の走査線を備え、前記データ線と走査線は２本ずつ非接触交差して画素領域を形成し、前記アレイ基板は複数のＲ、Ｇ、Ｂサブ画素を更に備え、前記Ｒ、Ｇ、Ｂサブ画素は、前記データ線と平行な方向に沿って順に配置され、前記各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する前記走査線及び前記データ線に電気的に接続され、前記各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なり、隣接する２つの前記サブ画素は互いに反対の極性を有し、前記走査線の水平方向に沿って配置された前記サブ画素は同じ色を有する。
前記各画素領域には、前記データ線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線及び前記データ線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なるデータ線に接続される。
前記データ線は、列反転駆動データ又は行反転駆動データを出力するために使用される。
奇数列に位置する前記画素領域には、１つの前記サブ画素が設けられ、偶数列に位置する前記画素領域には、前記走査線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なる走査線に接続され、同じデータ線の両側に分離された隣接する２つの前記サブ画素は、前記同じデータ線に接続される。
上述の技術的課題を解決するために、本発明の別の技術的解決手段は、アレイ基板を提供する。このアレイ基板は、複数のデータ線及び複数の走査線を備え、前記データ線と走査線は２本ずつ非接触交差して画素領域を形成し、前記アレイ基板は複数のＲ、Ｇ、Ｂサブ画素を更に備え、前記Ｒ、Ｇ、Ｂサブ画素は、前記データ線と平行な方向に沿って順に配置され、前記各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する前記走査線及び前記データ線に電気的に接続され、前記各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。
前記各画素領域には、前記データ線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線及び前記データ線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なるデータ線に接続される。
前記データ線は、列反転駆動データ又は行反転駆動データを出力するために使用される。
奇数列に位置する前記画素領域には、１つの前記サブ画素が設けられ、偶数列に位置する前記画素領域には、前記走査線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なる走査線に接続され、同じデータ線の両側に分離された隣接する２つの前記サブ画素は、前記同じデータ線に接続される。
隣接する２つの前記サブ画素は、互いに反対の極性を有する。
前記走査線の水平方向に沿って配置された前記サブ画素は、同じ色を有する。
前記ＴＦＴのドレインは前記サブ画素に電気的に接続され、ゲートは前記走査線に電気的に接続され、ソースは前記データ線に電気的に接続される。
上述の技術的課題を解決するために、本発明の他の技術的解決手段は、液晶表示装置を提供する。この液晶表示装置は、対向して設けられたアレイ基板、カラーフィルム基板、及び前記アレイ基板とカラーフィルム基板との間に挟み込まれた液晶分子を備え、前記アレイ基板は、複数のデータ線及び複数の走査線を備え、前記データ線と走査線は２本ずつ非接触交差して画素領域を形成し、前記アレイ基板は複数のＲ、Ｇ、Ｂサブ画素を更に備え、前記Ｒ、Ｇ、Ｂサブ画素は、前記データ線と平行な方向に沿って順に配置され、前記各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する前記走査線及び前記データ線に電気的に接続され、前記各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。
前記各画素領域には、前記データ線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線及び前記データ線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なるデータ線に接続される。
前記データ線は、列反転駆動データ又は行反転駆動データを出力するために使用される。
奇数列に位置する前記画素領域には、１つの前記サブ画素が設けられ、偶数列に位置する前記画素領域には、前記走査線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なる走査線に接続され、同じデータ線の両側に分離された隣接する２つの前記サブ画素は、前記同じデータ線に接続される。
隣接する２つの前記サブ画素は、互いに反対の極性を有する。
前記走査線の水平方向に沿って配置された前記サブ画素は、同じ色を有する。
前記ＴＦＴのドレインは前記サブ画素に電気的に接続され、ゲートは前記走査線に電気的に接続され、ソースは前記データ線に電気的に接続される。
本発明の有益な効果は以下のとおりである。従来技術とは異なり、本実施形態のアレイ基板は、複数のデータ線と走査線が２本ずつ非接触交差して画素領域を形成し、さらに、データ線と平行な方向に沿って順に配置された複数のＲ、Ｇ、Ｂサブ画素を備える。走査線に沿って順に配置する従来技術と比較して、Ｒ、Ｇ、Ｂサブ画素をデータ線方向に沿って順に配置するためのデータ線は１／３しか必要とせず、２／３のデータ線が節約され、アレイ基板のコストを大幅に節約することができる。各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する走査線及びデータ線に電気的に接続され、各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。即ち、データ線に沿って配置された隣接する２つの画素領域の間には、少なくとも２本の走査線が配置される。アレイ基板の配置スペースを節約し、非透光領域の面積を低減し、開口率を向上させることができる。
従来技術のアレイ基板の一実施形態の構造模式図である。 本発明のアレイ基板の一実施形態の構造模式図である。 本発明のアレイ基板の別の実施形態の構造模式図である。 本発明の液晶表示装置の一実施形態の構造模式図である。
本実施形態のアレイ基板は、複数のデータ線及び複数の走査線を備える。データ線と走査線は２本ずつ非接触交差して複数の画素領域を形成する。好ましい実施形態では、複数のデータ線は互いに平行であり、複数の走査線は互いに平行であり、データ線と走査線は互いに垂直であり、ここでは制限されない。さらに、アレイ基板は複数のＲ、Ｇ、Ｂサブ画素を更に備える。上記Ｒ、Ｇ、Ｂサブ画素は、データ線と平行な方向に沿って順に配置され、前記各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する前記走査線及び前記データ線に電気的に接続される。前記各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。
具体的には、図２を参照すると、図２は本発明のアレイ基板の一実施形態の構造模式図である。本実施形態の走査線２０１とデータ線２０２は２本ずつ非接触交差して複数の画素領域２０３を形成する。複数のＲ、Ｇ、Ｂサブ画素２０３１は、データ線２０２の方向に沿って順に配置される。走査線２０１の水平方向に沿って配置された前記サブ画素２０３１は同じ色を有し、隣接する２つのサブ画素２０３１は、互いに反対の極性を有する。走査線に沿って順に配置する従来技術と比較して、Ｒ、Ｇ、Ｂサブ画素をデータ線２０２の方向に沿って順に配置するためのデータ線は１／３しか必要とせず、２／３のデータ線が節約される。走査線２０１の数は相対的に多くなるが、走査線２０１側のチップオンフィルムＣＯＦは、データ線２０２側のチップオンフィルムＣＯＦより格段に安価であり、且つ他の実施形態において、走査線２０１は、チップオンフィルムＣＯＦなしで基板上に直接設置することができるため、Ｒ、Ｇ、Ｂサブ画素２０３１をデータ線２０２の方向に沿って順に配置することによって、アレイ基板のコストを大幅に節約することができる。
図２に示されるように、２つの画素領域２０３を形成する走査線２０１は異なる。即ち、データ線２０２に沿って配置された隣接する２つの画素領域２０３は、走査線２０１を共有していない。即ち、データ線２０２に沿って配置された隣接する２つの画素領域２０３の間には、少なくとも２本の走査線２０１が配置される。アレイ基板の配置スペースを節約し、非透光領域の面積を低減し、開口率を向上させることができる。
図２をさらに参照すると、各画素領域２０３には、データ線と平行な方向に沿って配置された２つのサブ画素２０３１が設けられ、各サブ画素２０３１は、対応するＴＦＴ２０３２を介して対応する走査線２０１及びデータ線２０２にそれぞれ接続される。前記ＴＦＴ２０３２のドレインは前記サブ画素２０３１に電気的に接続され、ゲートは前記走査線２０１に電気的に接続され、ソースは前記データ線２０２に電気的に接続される。好ましい実施形態において、各サブ画素２０３１は、その最も隣接する走査線２０１及びデータ線２０２にそれぞれ接続される。例えば、本実施形態の隣接する２つの画素領域２０３の間には、２本の走査線２０１が配置され、該２本の走査線２０１の両側に分布するサブ画素２０３１は、それに隣接する１つのサブ画素にそれぞれ接続される。また、走査線２０１に沿って平行に配置された隣接する前記サブ画素２０３１に接続されるデータ線２０２も異なる。例えば、図２に示されるように、データ線が水平方向に沿って配置され、走査線が垂直方向に沿って配置される場合、データ線２０２の方向に沿って平行に配置された２つのサブ画素２０３１のうち、上側のサブ画素２０３１は、画素領域２０３の右側のデータ線２０２に接続され、下側のサブ画素２０３１は、画素領域２０３の左側のデータ線２０２に接続され、即ち、奇数行のサブ画素２０３１と偶数行のサブ画素２０３１は位置ずれして配置される。アレイ状に配置されたサブ画素２０３１のうち、隣接する行における同じ順番のサブ画素２０３１は、隣接する２つのデータ線２０２にそれぞれ接続され、隣接するデータ線から供給される電圧が異なり、データ線２０２が列反転データを出力すると、点反転を実現できる。点反転によって消費される大量の電力を節約し、アレイ基板のコストを削減することができるだけでなく、点反転方式からの良好な表示効果を実現し、画面表示の品質を向上させることもできる。
なお、走査線２０１の水平配置とデータ線２０２の垂直配置とは相対的な配列方向であり、アレイ基板の方向が変更すると、それに対応して走査線２０１とデータ線２０２の位置も変化する。そのため、アレイ基板の位置が９０度回転した場合や、ユーザの見る角度が９０度変化した場合には、水平方向と垂直方向も相対的に入れ替わる。このとき、データ線の列反転もそれに対応して行反転に変更する。その本質は変更せず、効果も同じであり、ここではそれを限定しない。
従来技術とは異なり、本実施形態のアレイ基板は、複数のデータ線と走査線が２本ずつ非接触交差して画素領域を形成し、さらに、データ線と平行な方向に沿って順に配置された複数のＲ、Ｇ、Ｂサブ画素を備える。走査線に沿って順に配置する従来技術と比較して、Ｒ、Ｇ、Ｂサブ画素をデータ線方向に沿って順に配置するためのデータ線は１／３しか必要とせず、２／３のデータ線が節約され、アレイ基板のコストを大幅に節約することができる。各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する走査線及びデータ線に電気的に接続され、各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。即ち、データ線に沿って配置された隣接する２つの画素領域の間には、少なくとも２本の走査線が配置される。アレイ基板の配置スペースを節約し、非透光領域の面積を低減し、開口率を向上させることができる。また、各画素領域のデータ線と平行な方向に沿って配置された２つのサブ画素は、対応するＴＦＴを介して対応する走査線及びデータ線にそれぞれ接続され、走査線と平行な方向に沿って配置された隣接する２つのサブ画素も異なるデータ線に接続される。隣接するデータ線から供給される電圧が異なり、データ線が列反転データを出力すると、点反転を実現できる。点反転によって消費される大量の電力を節約し、アレイ基板のコストを削減することができるだけでなく、点反転方式からの良好な表示効果を実現し、画面表示の品質を向上させることもできる。
図３を参照すると、図３は本発明のアレイ基板の別の実施形態の構造模式図である。本実施形態のアレイ基板の走査線３０１とデータ線３０２は２本ずつ非接触交差して複数の画素領域３０３を形成する。複数のＲ、Ｇ、Ｂサブ画素３０３１は、データ線３０２の方向に沿って順に配置される。走査線３０１の水平方向に沿って配置された前記サブ画素３０３１は同じ色を有し、隣接する２つのサブ画素３０３１は、互いに反対の極性を有する。走査線に沿って順に配置する従来技術と比較して、Ｒ、Ｇ、Ｂサブ画素をデータ線３０２の方向に沿って順に配置するためのデータ線は１／３しか必要とせず、２／３のデータ線が節約される。走査線３０１の数は相対的に多くなるが、走査線３０１側のチップオンフィルムＣＯＦは、データ線３０２側のチップオンフィルムＣＯＦより格段に安価であり、且つ他の実施形態において、走査線３０１は、チップオンフィルムＣＯＦなしで基板上に直接設置することができるため、Ｒ、Ｇ、Ｂサブ画素３０３１をデータ線３０２の方向に沿って順に配置することによって、アレイ基板のコストを大幅に節約することができる。
図３に示されるように、２つの画素領域３０３を形成する走査線３０１は異なる。即ち、データ線３０２に沿って配置された隣接する２つの画素領域３０３は、走査線３０１を共有していない。即ち、データ線３０２に沿って配置された隣接する２つの画素領域３０３の間には、少なくとも２本の走査線３０１が配置される。アレイ基板の配置スペースを節約し、非透光領域の面積を低減し、開口率を向上させることができる。
さらに図３を参照すると、本実施形態における走査線３０１は水平方向に沿って配置され、データ線３０２は垂直方向に沿って配置されている。このアレイ基板において、奇数列に位置する前記画素領域３０３には、１つのサブ画素３０３１が設けられ、偶数列に位置する前記画素領域３０３には、走査線３０１と平行な方向に沿って配置された２つの前記サブ画素３０３１が設けられ、前記各サブ画素３０３１は、対応するＦＴＦ３０３２を介して、対応する前記走査線にそれぞれ接続される。前記ＴＦＴ ３０３２のドレインは、前記サブ画素３０３１に電気的に接続され、ゲートは前記走査線３０１に電気的に接続され、ソースは前記データ線３０２に電気的に接続される。また、前記走査線３０１と平行な方向に沿って配置された隣接する２つの前記サブ画素３０３１は、異なる走査線３０１に接続される。例えば、本実施形態のデータ線３０２に沿って配置された２つの画素領域３０３の間には、２本の走査線３０１が配置され、該２本の走査線２０１の両側に分布する奇数行のサブ画素３０３１と偶数行のサブ画素３０３２は、それに最も近い走査線それぞれ接続される。
同じデータ線３０２の両側に分離された隣接する２つの前記サブ画素３０３１は、前記同じデータ線３０２に接続される。各列のサブ画素は異なるデータ線にそれぞれ接続される従来技術の接続方式と比較して、半分のデータ線を節約することができる。即ち、図１の従来技術と比較して、本実施形態のアレイ基板は、１／６のデータ線しか必要とせず、即ち、５／６のデータ線を節約する。アレイ基板の製造コストを大幅に節約することができる。
従来技術とは異なり、本実施形態のアレイ基板は、複数のデータ線と走査線が２本ずつ非接触交差して画素領域を形成し、さらに、データ線と平行な方向に沿って順に配置された複数のＲ、Ｇ、Ｂサブ画素を備える。走査線に沿って順に配置する従来技術と比較して、Ｒ、Ｇ、Ｂサブ画素をデータ線方向に沿って順に配置するためのデータ線は１／３しか必要とせず、２／３のデータ線が節約され、アレイ基板のコストを大幅に節約することができる。各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する走査線及びデータ線に電気的に接続され、各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。即ち、データ線に沿って配置された隣接する２つの画素領域の間には、少なくとも２本の走査線が配置される。アレイ基板の配置スペースを節約し、非透光領域の面積を低減し、開口率を向上させることができる。同じデータ線の両側に分離された隣接する２つの前記サブ画素は前記同じデータ線に接続されることによって、データ線の数を半分に節約してアレイ基板のコストを更に節約することができる。
図４を参照すると、図４は、本発明の液晶表示装置の一実施形態の構造模式図である。本実施形態の液晶表示装置は、アレイ基板４０１、カラーフィルム基板４０２、及び前記アレイ基板とカラーフィルム基板との間に挟み込まれた液晶分子４０３を備える。アレイ基板は、複数のデータ線及び複数の走査線を備える。データ線と走査線は２本ずつ非接触交差して複数の画素領域を形成する。好ましい実施形態では、複数のデータ線は互いに平行であり、複数の走査線は互いに平行であり、データ線と走査線は互いに垂直であり、ここでは制限されない。さらに、アレイ基板は複数のＲ、Ｇ、Ｂサブ画素を更に備える。上記Ｒ、Ｇ、Ｂサブ画素は、データ線と平行な方向に沿って順に配置され、前記各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する前記走査線及び前記データ線に電気的に接続される。前記各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。
一実施形態において、前記各画素領域には、前記データ線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線及び前記データ線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なるデータ線に接続される。詳細については、図２及び関連するテキストの説明を参照されたく、ここでは限定しない。
従来技術とは異なり、本実施形態のアレイ基板は、複数のデータ線と走査線が２本ずつ非接触交差して画素領域を形成し、さらに、データ線と平行な方向に沿って順に配置された複数のＲ、Ｇ、Ｂサブ画素を備える。走査線に沿って順に配置する従来技術と比較して、Ｒ、Ｇ、Ｂサブ画素をデータ線方向に沿って順に配置するためのデータ線は１／３しか必要とせず、２／３のデータ線が節約され、アレイ基板のコストを大幅に節約することができる。各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する走査線及びデータ線に電気的に接続され、各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。即ち、データ線に沿って配置された隣接する２つの画素領域の間には、少なくとも２本の走査線が配置される。アレイ基板の配置スペースを節約し、非透光領域の面積を低減し、開口率を向上させることができる。また、各画素領域のデータ線と平行な方向に沿って配置された２つのサブ画素は、対応するＴＦＴを介して対応する走査線及びデータ線にそれぞれ接続され、走査線と平行な方向に沿って配置された隣接する２つのサブ画素も異なるデータ線に接続される。隣接するデータ線から供給される電圧が異なり、データ線が列反転データを出力すると、点反転を実現できる。点反転によって消費される大量の電力を節約し、アレイ基板のコストを削減することができるだけでなく、点反転方式からの良好な表示効果を実現し、画面表示の品質を向上させることもできる。
他の実施形態において、奇数列に位置する前記画素領域には、１つの前記サブ画素が設けられ、偶数列に位置する前記画素領域には、前記走査線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なる走査線に接続され、同じデータ線の両側に分離された隣接する２つの前記サブ画素は、前記同じデータ線に接続される。詳細については、図３及び関連するテキストの説明を参照されたく、ここでは再度詳述しない。
従来技術とは異なり、本実施形態のアレイ基板は、複数のデータ線と走査線が２本ずつ非接触交差して画素領域を形成し、さらに、データ線と平行な方向に沿って順に配置された複数のＲ、Ｇ、Ｂサブ画素を備える。走査線に沿って順に配置する従来技術と比較して、Ｒ、Ｇ、Ｂサブ画素をデータ線方向に沿って順に配置するためのデータ線は１／３しか必要とせず、２／３のデータ線が節約され、アレイ基板のコストを大幅に節約することができる。各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する走査線及びデータ線に電気的に接続され、各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なる。即ち、データ線に沿って配置された隣接する２つの画素領域の間には、少なくとも２本の走査線が配置される。アレイ基板の配置スペースを節約し、非透光領域の面積を低減し、開口率を向上させることができる。同じデータ線の両側に分離された隣接する２つの前記サブ画素は前記同じデータ線に接続されることによって、データ線の数を半分に節約してアレイ基板のコストを更に節約することができる。
以上の説明は本発明に係る実施形態にすぎず、本発明の保護範囲を制限するものではない。本発明の明細書及び添付図面によって作成したすべての同等構造又は同等フローの変更を、直接又は間接的に他の関連する技術分野に実施することは、いずれも同じ理由により本発明の保護範囲内に含まれるべきである。

Claims (18)

  1. アレイ基板であって、複数のデータ線及び複数の走査線を備え、前記データ線と走査線は２本ずつ非接触交差して画素領域を形成し、前記アレイ基板は複数のＲ、Ｇ、Ｂサブ画素を更に備え、前記Ｒ、Ｇ、Ｂサブ画素は、前記データ線と平行な方向に沿って順に配置され、前記各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する前記走査線及び前記データ線に電気的に接続され、前記各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線は異なり、隣接する２つの前記サブ画素は互いに反対の極性を有し、前記走査線の水平方向に沿って配置された前記サブ画素は同じ色を有する、ことを特徴とするアレイ基板。
  2. 前記各画素領域には、前記データ線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線及び前記データ線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なるデータ線に接続される、ことを特徴とする請求項１に記載のアレイ基板。
  3. 前記データ線は、列反転駆動データ又は行反転駆動データを出力するために使用される、ことを特徴とする請求項２に記載のアレイ基板。
  4. 奇数列に位置する前記画素領域には、１つの前記サブ画素が設けられ、偶数列に位置する前記画素領域には、前記走査線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なる走査線に接続され、同じデータ線の両側に分離された隣接する２つの前記サブ画素は、前記同じデータ線に接続される、ことを特徴とする請求項１に記載のアレイ基板。
  5. アレイ基板であって、複数のデータ線及び複数の走査線を備え、前記データ線と走査線は２本ずつ非接触交差して画素領域を形成し、前記アレイ基板は複数のＲ、Ｇ、Ｂサブ画素を更に備え、前記Ｒ、Ｇ、Ｂサブ画素は、前記データ線と平行な方向に沿って順に配置され、前記各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する前記走査線及び前記データ線に電気的に接続され、前記各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線が異なる、ことを特徴とするアレイ基板。
  6. 前記各画素領域には、前記データ線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線及び前記データ線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なるデータ線に接続される、ことを特徴とする請求項５に記載のアレイ基板。
  7. 前記データ線は、列反転駆動データ又は行反転駆動データを出力するために使用される、ことを特徴とする請求項６に記載のアレイ基板。
  8. 奇数列に位置する前記画素領域には、１つの前記サブ画素が設けられ、偶数列に位置する前記画素領域には、前記走査線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なる走査線に接続され、同じデータ線の両側に分離された隣接する２つの前記サブ画素は、前記同じデータ線に接続される、ことを特徴とする請求項５に記載のアレイ基板。
  9. 隣接する２つの前記サブ画素は、互いに反対の極性を有する、ことを特徴とする請求項５のいずれか一項に記載のアレイ基板。
  10. 前記走査線の水平方向に沿って配置された前記サブ画素は、同じ色を有する、ことを特徴とする請求項５のいずれか一項に記載のアレイ基板。
  11. 前記ＴＦＴのドレインは前記サブ画素に電気的に接続され、ゲートは前記走査線に電気的に接続され、ソースは前記データ線に電気的に接続される、ことを特徴とする請求項５のいずれか一項に記載のアレイ基板。
  12. 液晶表示装置であって、対向して設けられたアレイ基板、カラーフィルム基板、及び前記アレイ基板とカラーフィルム基板との間に挟み込まれた液晶分子を備え、前記アレイ基板は、複数のデータ線及び複数の走査線を備え、前記データ線と走査線は２本ずつ非接触交差して画素領域を形成し、前記アレイ基板は複数のＲ、Ｇ、Ｂサブ画素を更に備え、前記Ｒ、Ｇ、Ｂサブ画素は、前記データ線と平行な方向に沿って順に配置され、前記各サブ画素は、薄膜トランジスタＴＦＴを介して、対応する前記走査線及び前記データ線に電気的に接続され、前記各画素領域には、少なくとも１つの前記サブ画素が設けられ、隣接する２つの前記画素領域を形成する走査線が異なる、ことを特徴とする液晶表示装置。
  13. 前記各画素領域には、前記データ線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線及び前記データ線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なるデータ線に接続される、ことを特徴とする請求項１２に記載の液晶表示装置。
  14. 前記データ線は、列反転駆動データ又は行反転駆動データを出力するために使用される、ことを特徴とする請求項１３に記載の液晶表示装置。
  15. 奇数列に位置する前記画素領域には、１つの前記サブ画素が設けられ、偶数列に位置する前記画素領域には、前記走査線と平行な方向に沿って配置された２つの前記サブ画素が設けられ、前記各サブ画素は、対応するＦＴＦを介して、対応する前記走査線にそれぞれ接続され、前記走査線と平行な方向に沿って配置された隣接する２つの前記サブ画素は、異なる走査線に接続され、同じデータ線の両側に分離された隣接する２つの前記サブ画素は、前記同じデータ線に接続される、ことを特徴とする請求項１２に記載の液晶表示装置。
  16. 隣接する２つの前記サブ画素は、互いに反対の極性を有する、ことを特徴とする請求項１２に記載の液晶表示装置。
  17. 前記走査線の水平方向に沿って配置された前記サブ画素は、同じ色を有する、ことを特徴とする請求項１２に記載の液晶表示装置。
  18. 前記ＴＦＴのドレインは前記サブ画素に電気的に接続され、ゲートは前記走査線に電気的に接続され、ソースは前記データ線に電気的に接続される、ことを特徴とする請求項１２に記載の液晶表示装置。
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