JP2017536065A - 分離型同期整流制御回路、その制御装置、及び、分離型同期整流制御方法 - Google Patents
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Description
Claims (10)
- 電力を供給するための給電モジュールと、
少なくとも第1基準電圧及び第2基準電圧を生成するための基準モジュールと、
当該制御回路の電圧端子の電圧と前記第1基準電圧とを比較するための導通コンパレータ及び前記電圧端子の電圧と前記第2基準電圧とを比較するための第1遮断コンパレータを含むコンパレータモジュールと、
当該制御回路の時間設定用端子から流れた電流により電流の積分を取得し、当該電流の積分と設定値との大きさを比較するための一次側導通判断ユニットと、
前記一次側導通判断ユニットが取得した電流の積分に基づいて同期整流トランジスタの導通に必要な時間を予測し、当該予測した同期整流トランジスタの導通に必要な時間に基づいて遮蔽時間を提供し、前記遮蔽時間と前記同期整流トランジスタの導通に実際に必要な時間との長さを比較するための二次側不連続予測ユニットと、
前記導通コンパレータの比較結果及び前記一次側導通判断ユニットの比較結果に基づいて、前記同期整流トランジスタを導通させるためのロジック制御信号を生成し、前記第1遮断コンパレータの比較結果及び前記二次側不連続予測ユニットの比較結果に基づいて、前記同期整流トランジスタを遮断するためのロジック制御信号を生成するためのロジックユニットと、
前記ロジックユニットが生成したロジック制御信号に基づいて、前記同期整流トランジスタを駆動するための駆動ユニットとを備えることを特徴とする分離型同期整流制御回路。 - 前記コンパレータモジュールは、前記電圧端子の電圧と前記基準モジュールが生成した第3基準電圧とを比較するための第2遮断コンパレータをさらに含むことを特徴とする請求項1に記載の分離型同期整流制御回路。
- 前記同期整流トランジスタの誤導通を防止するためのクランプ回路をさらに備えることを特徴とする請求項1に記載の分離型同期整流制御回路。
- 前記一次側導通判断ユニットは、積分コンデンサと、2つのPMOSトランジスタから構成された第2カレントミラーと、2つのNMOS(N−Metal−Oxide−Semiconductor)トランジスタから構成され、前記時間設定用端子が高電位であるときに電流を生成し、さらに前記第2カレントミラーを介して前記積分コンデンサを充電するための第1カレントミラーと、前記積分コンデンサの電圧と前記基準モジュールがさらに生成した第1基準電圧とを比較し、当該比較結果に基づいて電位信号を出力するためのコンパレータユニットと、各導通周期が終了する際に、前記積分コンデンサにおける電圧をクリアするためのプルダウンNMOSトランジスタとを含むことを特徴とする請求項1に記載の分離型同期整流制御回路。
- 前記二次側不連続予測ユニットは、ゼロクランプを実現するためのNPNトランジスタと、2つのNMOSトランジスタから構成された第4カレントミラーと、2つのPMOSトランジスタから構成され、前記時間設定用端子が低電位であるときに電流を生成し、前記第4カレントミラーを介して積分コンデンサに放電するための第3カレントミラーと、前記積分コンデンサの電圧と前記基準モジュールがさらに生成した第2基準電圧とを比較し、当該比較結果に基づいて電位信号を出力するためのコンパレータユニットとを含むことを特徴とする請求項1に記載の分離型同期整流制御回路。
- 前記給電モジュールは、前記電圧端子が高電位であるときに電流を生成するための起動回路と、電圧を生成するための変調抵抗と、電圧の受取及び導通のために用いられる高電圧PMOSトランジスタと、2つの分圧抵抗と、高電圧NMOSトランジスタと、前記電圧端子が起動電圧に達したときに、前記2つの分圧抵抗の電圧と基準電位とを比較し、当該比較結果に基づいて電圧信号を出力して前記高電圧NMOSトランジスタの遮断を制御するためのオペアンプ回路とを含むことを特徴とする請求項1に記載の分離型同期整流制御回路。
- 前記給電モジュールは、当該制御回路の電源端子から前記電圧端子への電流の逆流を防止するためのNPNトランジスタをさらに含むことを特徴とする請求項6に記載の分離型同期整流制御回路。
- 二次側出力巻線の一端が前記分離型同期整流制御回路の接地端子及びバイパスコンデンサと接続され、前記二次側出力巻線の他端が地面に接続されている変圧器と、
前記分離型同期整流制御回路の電源端子と接続され、前記分離型同期整流制御回路に安定した電圧を提供するためのバイパスコンデンサと、
前記分離型同期整流制御回路の時間設定用端子と接続され、一次側が導通される時定数及び二次側の不連続時間予測の判断を設定するために用いられる時定数設定用抵抗と、
前記時間設定用端子から流れた電流に基づいて、一次側が導通されているか否かを判断し、二次側の不連続時間を予測し、当該判断及び当該予測の結果に基づいてロジック制御信号を生成して前記同期整流トランジスタの導通又は遮断を駆動するための前記分離型同期整流制御回路と、
前記電圧端子と接続され、コンデンサの出力のために用いられる出力コンデンサとを備えることを特徴とする請求項1〜7のいずれか1項に記載の分離型同期整流制御回路の制御装置。 - 一次側が導通される時定数を設定し、制御回路へ流れ込んだ電流により電流の積分を取得するステップと、前記電流の積分と設定値とを比較し、前記制御回路の電圧と基準電圧との大きさにより同期整流トランジスタの導通を制御するステップと、
前記電流の積分に基づいて前記同期整流トランジスタの導通に必要な時間を予測し、当該予測した同期整流トランジスタの導通に必要な時間に基づいて遮蔽時間を提供するステップと、前記同期整流トランジスタの導通に実際に必要な時間が前記遮蔽時間を超え、且つ、前記制御回路の電圧が前記基準電圧より大きい場合、前記同期整流トランジスタの遮断を制御するステップとを含むことを特徴とする分離型同期整流制御方法。 - 前記同期整流トランジスタの導通に必要な時間は、前記制御回路の時間設定用端子と出力グランドとが、二次側が電流を流し続ける際に生じた負の圧力差を推定することによって取得されることを特徴とする請求項9に記載の分離型同期整流制御方法。
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