JP2017016219A - 電子機器および給電制御プログラム - Google Patents
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Abstract
【解決手段】複数のタスクをそれぞれ実行する複数のコアを有するプロセッサーと、実行される前記複数のタスクの処理量の総量であるタスク総量を前記コア毎に計算するタスク総量計算部と、前記コア毎に計算された前記タスク総量に基づき、前記複数のコアの一部をスリープ状態に移行させるスリープ移行処理部と、前記一部のコアが前記スリープ状態にあるとき、前記タスク総量に基づき、前記スリープ状態にあるコアを前記スリープ状態から復帰させるスリープ復帰処理部とを備える。
【選択図】図4
Description
最初に、概要について説明する。
以上、概要について説明した。
次に、電子機器10のハードウェア構成について説明する。電子機器10は、専用のハードウェアやソフトウェアにより構成されていてもよいし、一般的なコンピューターにより構成されてもよい。電子機器10が一般的なコンピューターにより構成される場合の構成図を図1に示す。
次に、各コアをスリープさせたり、スリープから復帰させたりする際の判断に用いるタスク総量を求めるために用いられるタスク量テーブル17aについて説明する。図3はタスク量テーブルの一例である。この例は、例えばコア1においてタスクZが終了してタスク総量をチェックする時点での状態を表したものである。
次に、タスク総量が少なくなった1つのコアがスリープ状態に移行する際の処理について説明する。図4は、タスク総量が少なくなった1つのコアがスリープ状態に移行する際の処理について説明するためのフローチャートである。
次に、一方のコアがスリープしている状態で、もう一方のコアが処理するタスク総量が増え、スリープしているコアをスリープ状態から復帰させる際の処理について説明する。図5は、一方のコアがスリープしている状態で、もう一方のコアが処理するタスク総量が増え、スリープしているコアをスリープ状態から復帰させる際の処理について説明するためのフローチャートである。
以上のように、本発明の一実施形態に係る電子機器10は、複数のタスクをそれぞれ実行する複数のコア(コア0およびコア1)を有するCPU11と、実行される前記複数のタスクの処理量の総量であるタスク総量を前記コア毎に計算するタスク総量計算部11cと、前記コア毎に計算された前記タスク総量に基づき、前記複数のコアの一部をスリープ状態に移行させるスリープ移行処理部11eと、前記一部のコアが前記スリープ状態にあるとき、前記タスク総量に基づき、前記スリープ状態にあるコアを前記スリープ状態から復帰させるスリープ復帰処理部11gとを備える。
1 … コア
10 … 電子機器
11 … CPU
11c… タスク総量計算部
11d… スリープ移行チェック部
11e… スリープ移行処理部
11f… スリープ復帰チェック部
11g… スリープ復帰処理部
12 … ROM
13 … RAM
14 … 操作入力部
15 … ネットワークインターフェイス部
16 … 表示部
17 … 記憶部
17a… タスク量テーブル
18 … バス
Claims (5)
- 複数のタスクをそれぞれ実行する複数のコアを有するプロセッサーと、
実行される前記複数のタスクの処理量の総量であるタスク総量を前記コア毎に計算するタスク総量計算部と、
前記コア毎に計算された前記タスク総量に基づき、前記複数のコアの一部をスリープ状態に移行させるスリープ移行処理部と、
前記一部のコアが前記スリープ状態にあるとき、前記タスク総量に基づき、前記スリープ状態にあるコアを前記スリープ状態から復帰させるスリープ復帰処理部と
を備えた
電子機器。 - 請求項1に記載の電子機器であって、
前記タスク総量が、特定のコアで第1のしきい値を下回ったか否かを判断するスリープ移行チェック部を更に備え、
前記スリープ移行処理部は、
前記スリープ移行チェック部の判断に基づき、前記タスク総量が前記第1のしきい値を下回ったコアをスリープ状態に移行させる
電子機器。 - 請求項2に記載の電子機器であって、
前記スリープ移行チェック部は、
前記タスク総量が前記第1のしきい値を下回ったコア以外のコアの前記タスク総量が第2のしきい値を超えるか否かを更に判断し、
前記スリープ移行処理部は、
前記スリープ移行チェック部の判断に基づき、前記タスク総量が前記第1のしきい値を下回ったコアを、前記タスク総量が前記第1のしきい値を下回ったコア以外のコアの前記タスク総量が第2のしきい値を超えない場合に、スリープ状態に移行させる
電子機器。 - 請求項1から3のいずれか1つに記載の電子機器であって、
一部の前記コアが前記スリープ状態にあるとき、前記スリープ状態にないコアにおける、前記タスク総量の合計が、第3のしきい値を超えるか否かを判断するスリープ復帰チェック部を更に備え、
前記スリープ復帰処理部は、
前記スリープ復帰チェック部の判断に基づき、前記スリープ状態にないコアにおける、前記タスク総量の合計が、第3のしきい値を超える場合に、前記スリープ状態にあるコアを前記スリープ状態から復帰させる
電子機器。 - 複数のタスクをそれぞれ実行する複数のコアを有するプロセッサー上で稼働し、
実行される前記複数のタスクの処理量の総量であるタスク総量を前記コア毎に計算し、
前記コア毎に計算された前記タスク総量に基づき、前記複数のコアの一部をスリープ状態に移行させ、
前記一部のコアが前記スリープ状態にあるとき、前記タスク総量に基づき、前記スリープ状態にあるコアを前記スリープ状態から復帰させる
手順をコンピューターに実行させる給電制御プログラム。
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US11451684B2 (en) | 2019-06-27 | 2022-09-20 | Canon Kabushiki Kaisha | Processor having a plurality of cores and a controller that switches power states based on cores state |
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---|---|---|---|---|
US20240192965A1 (en) * | 2022-12-13 | 2024-06-13 | Ati Technologies Ulc | Continuity of service for virtualized device after resumption from hibernation |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010201961A (ja) * | 2009-02-27 | 2010-09-16 | Denso Corp | 車両用電子制御装置 |
JP2011186531A (ja) * | 2010-03-04 | 2011-09-22 | Nec Corp | Smt対応cpuを有する情報処理装置の消費電力低減方法、消費電力低減装置及び消費電力低減プログラム |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7337334B2 (en) * | 2003-02-14 | 2008-02-26 | International Business Machines Corporation | Network processor power management |
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US8296773B2 (en) * | 2008-06-30 | 2012-10-23 | International Business Machines Corporation | Systems and methods for thread assignment and core turn-off for integrated circuit energy efficiency and high-performance |
JP2013041366A (ja) | 2011-08-12 | 2013-02-28 | Renesas Electronics Corp | データ処理装置 |
JP2013149221A (ja) * | 2012-01-23 | 2013-08-01 | Canon Inc | プロセッサの制御装置およびその方法 |
KR20140089749A (ko) * | 2013-01-07 | 2014-07-16 | 한국전자통신연구원 | 클러스터의 부하 할당 제어 장치 및 그 방법 |
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Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010201961A (ja) * | 2009-02-27 | 2010-09-16 | Denso Corp | 車両用電子制御装置 |
JP2011186531A (ja) * | 2010-03-04 | 2011-09-22 | Nec Corp | Smt対応cpuを有する情報処理装置の消費電力低減方法、消費電力低減装置及び消費電力低減プログラム |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US11451684B2 (en) | 2019-06-27 | 2022-09-20 | Canon Kabushiki Kaisha | Processor having a plurality of cores and a controller that switches power states based on cores state |
US11539851B2 (en) | 2019-06-27 | 2022-12-27 | Canon Kabushiki Kaisha | Apparatus for switching a power state among a plurality of power states and method thereof |
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