JP2016091781A - スイッチングコンバータおよびその制御回路、制御方法、それを用いた照明装置、電子機器 - Google Patents
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Abstract
【解決手段】電流リミットコンパレータ202は、検出抵抗RCSの電圧降下に応じた電流検出信号VCSが第1しきい値VADIMを超えると、リセットパルスS11をアサートする。ゼロ電流検出回路204は、スイッチングトランジスタM1のターンオンを指示するセットパルスS13をアサートする。ロジック回路206は、リセットパルスS11およびセットパルスS13に応じて制御パルスS14を生成する。調光パルス修正部240は、調光パルスS20の点灯レベルから消灯レベルへの遷移が制御パルスS14のオンレベル中に発生するとき、当該遷移を、制御パルスS14の次のオフレベルの期間まで遅延させる。
【選択図】図3
Description
ILEDAVE=ILED×α/100
図3(b)には、調光パルスS4のデューティ比が100%に近い状態が示される。出力パルスSOUTのうち調光パルスS4の1周期の最後の1個Xに注目する。
「一体集積化」とは、回路の構成要素のすべてが半導体基板上に形成される場合や、回路の主要構成要素が一体集積化される場合が含まれ、回路定数の調節用に一部の抵抗やキャパシタなどが半導体基板の外部に設けられていてもよい。
同様に、「部材Cが、部材Aと部材Bの間に設けられた状態」とは、部材Aと部材C、あるいは部材Bと部材Cが直接的に接続される場合のほか、電気的な接続状態に影響を及ぼさない他の部材を介して間接的に接続される場合も含む。
実施の形態では、調光パルスS20のデューティ比(パルス幅)にかかわらず、調光パルス修正部240による修正を行なった。図7(a)は、図4のスイッチングコンバータ100における調光パルスS20と修正調光パルスS21の関係を示す図である。縦軸の修正調光パルスS21は、LED光源502の光量(輝度)とも把握できる。つまり図4のスイッチングコンバータ100では、修正調光パルスS21のデューティ比は、とある最小値MINより小さくならず、またデューティ比が小さな領域において、光量を離散的にしか変化させることができない。
図10は、第2変形例に係るスイッチングコンバータ100bの回路図である。このスイッチングコンバータ100bは、キャパシタC11、抵抗R10に代えて、インダクタL1と結合された補助巻線L2を備える。制御回路200bのZT端子には、補助巻線L2に生ずる電圧VL2に応じた電圧VZTが入力される。ゼロ電流検出回路(セットパルス発生器)204は、補助巻線L2の電圧VZTが所定のしきい値電圧VZEROとクロスすると、セットパルスS13をアサートする。この構成によっても、疑似共振モードを実現できる。
実施の形態では、LED光源502がLEDストリングである場合を説明したが、負荷の種類は特に限定されない。
本実施の形態において、ロジック回路のハイレベル、ローレベルの論理値の設定は一例であって、インバータなどによって適宜反転させることにより自由に変更することが可能である。
Claims (12)
- 光源を駆動するスイッチングコンバータの制御回路であって、
前記スイッチングコンバータは、
入力ラインと出力ラインの間に設けられた出力キャパシタと、
前記出力ラインと接地ラインの間に直列に設けられたインダクタ、スイッチングトランジスタおよび検出抵抗と、
前記入力ラインにカソードが接続され、前記インダクタと前記スイッチングトランジスタの接続点にアノードが接続されたダイオードと、
を備え、
前記制御回路は、
前記検出抵抗の電圧降下に応じた電流検出信号が設定値を超えると、リセットパルスをアサートする電流リミットコンパレータと、
前記インダクタに流れる電流が実質的にゼロとなるとセットパルスをアサートするゼロ電流検出回路と、
前記セットパルスおよび前記リセットパルスを受け、制御パルスを生成するロジック回路であって、(i)前記制御パルスは、前記セットパルスがアサートされると、前記スイッチングトランジスタのオンに対応するオンレベルに遷移し、(ii)前記リセットパルスがアサートされると、前記スイッチングトランジスタのオフに対応するオフレベルに遷移するものである、ロジック回路と、
前記光源の目標輝度に応じてデューティ比が調節される調光パルスを受けるパルス調光端子と、
前記調光パルスと前記制御パルスに応じた信号とを受け、修正調光パルスを生成する調光パルス修正部であって、前記調光パルスの点灯レベルから消灯レベルへの遷移が前記制御パルスのオンレベル中に発生するとき、当該遷移を、前記制御パルスの次のオフレベルの期間まで遅延させる調光パルス修正部と、
前記修正調光パルスが点灯レベルの間、前記制御パルスにもとづいて前記スイッチングトランジスタを駆動する出力部と、
を備えることを特徴とする制御回路。 - 前記調光パルス修正部は、前記調光パルスの周期の先頭から所定数N個の制御パルスの間は、前記調光パルスを修正しないことを特徴とする請求項1に記載の制御回路。
- 前記調光パルス修正部は、
前記調光パルスの周期の先頭から前記制御パルスがN個発生するまでの間、所定レベルとなるマスク信号を生成するマスク信号生成部と、
前記マスク信号と前記調光パルスを論理演算し、前記修正調光パルスを生成する第1論理ゲートと、
を含むことを特徴とする請求項2に記載の制御回路。 - 前記マスク信号生成部は、
クロック端子およびリセット端子に前記制御パルスに応じた信号を受けるフリップフロップと、
クロック端子に前記制御パルスに応じた信号を受け、リセット端子に前記調光パルスを受け、カウント値が前記Nに達するとカウント完了信号をアサートするカウンタと、
前記カウント完了信号と前記フリップフロップの出力を論理演算する第2論理ゲートと、
を含むことを特徴とする請求項3に記載の制御回路。 - 前記スイッチングトランジスタがターンオンしてから所定時間の経過までをマスク期間とし、前記マスク期間の間、前記リセットパルスのアサートをマスクし、マスク後のリセットパルスを前記ロジック回路に出力するリーディングエッジブランキング回路をさらに備えることを特徴とする請求項1から4のいずれかに記載の制御回路。
- 前記スイッチングコンバータは、前記インダクタと前記スイッチングトランジスタの接続点と接地ラインの間に直列に設けられた第1キャパシタおよび第1抵抗をさらに備え、
前記ゼロ電流検出回路は、前記第1抵抗の電位が所定のしきい値電圧がクロスすると、前記セットパルスをアサートすることを特徴とする請求項1から5のいずれかに記載の制御回路。 - 前記スイッチングコンバータは、前記インダクタと結合された補助巻線をさらに備え、
前記ゼロ電流検出回路は、前記補助巻線の電圧が所定のしきい値電圧とクロスすると、前記セットパルスをアサートすることを特徴とする請求項1から5のいずれかに記載の制御回路。 - ひとつの半導体基板に一体集積化されることを特徴とする請求項1から7のいずれかに記載の制御回路。
- 請求項1から8のいずれかに記載の制御回路を備えることを特徴とするスイッチングコンバータ。
- 直列に接続された複数のLED(発光ダイオード)を含むLED光源と、
商用交流電圧を平滑整流する整流回路と、
前記整流回路により平滑整流された直流電圧を入力電圧として受け、前記LED光源を負荷とするスイッチングコンバータと、
を備え、
前記スイッチングコンバータは、請求項1から9のいずれかに記載の制御回路を備えることを特徴とする照明装置。 - 液晶パネルと、
前記液晶パネルを裏面から照射するバックライトである請求項10に記載の照明装置と、
を備えることを特徴とする電子機器。 - 光源を駆動するスイッチングコンバータの制御方法であって、
前記スイッチングコンバータは、
入力ラインと出力ラインの間に設けられた出力キャパシタと、
前記出力ラインと接地ラインの間に直列に設けられたインダクタ、スイッチングトランジスタおよび検出抵抗と、
前記入力ラインにカソードが接続され、前記インダクタと前記スイッチングトランジスタの接続点にアノードが接続されたダイオードと、
を備え、
前記制御方法は、
前記検出抵抗の電圧降下に応じた電流検出信号が設定値を超えると、リセットパルスをアサートするステップと、
前記インダクタに流れる電流が実質的にゼロとなると、セットパルスをアサートするステップと、
前記セットパルスおよび前記リセットパルスにもとづいて制御パルスを生成するステップであって、(i)前記制御パルスは、前記セットパルスがアサートされると、前記スイッチングトランジスタのオンに対応するオンレベルに遷移し、(ii)前記リセットパルスがアサートされると、前記スイッチングトランジスタのオフに対応するオフレベルに遷移するものであるステップと、
前記光源の目標輝度に応じてデューティ比が調節される調光パルスを生成するステップと、
前記制御パルスを利用して前記調光パルスを修正し、修正調光パルスを生成するステップであって、前記調光パルスのオンレベルからオフレベルへの遷移が前記制御パルスのオンレベル中に発生するとき、前記調光パルスのオンレベルからオフレベルへの遷移を、前記制御パルスの次のオフレベルの期間まで遅延させるステップと、
前記修正調光パルスがオンレベルの間、前記制御パルスにもとづいて前記スイッチングトランジスタを駆動するステップと、
を備えることを特徴とする制御方法。
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