JP2015512542A - 低電力状態のためのデュアルスケルチ検出器及び方法 - Google Patents
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Abstract
Description
Claims (22)
- 通信信号の中に複数の見込みのスケルチ信号を検出する第1スケルチ回路と、
(i)前記第1スケルチ回路が前記通信信号の中に前記複数の見込みのスケルチ信号のうちの1つも検出しないことに応答して低電力状態で動作し、(ii)前記第1スケルチ回路が前記通信信号の中に前記複数の見込みのスケルチ信号のうちの1つを検出することに応答して高電力状態で動作する第2スケルチ回路と
を備える装置。 - 前記第2スケルチ回路は、さらに、(iii)前記高電力状態で動作することに応答して、通信信号の中のスケルチ信号に基づいて、帯域外シグナリングシーケンス(OOBシグナリングシーケンス)を決定する請求項1に記載の装置。
- 前記第1スケルチ回路は、
閾値振幅より大きい前記複数の見込みのスケルチ信号の前記1つの振幅に応答して、前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出する第1スケルチ検出器
を備える請求項2に記載の装置。 - 前記第1スケルチ回路は、
前記第1スケルチ検出器が前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出することに応答して、制御信号を無効にする信号検出器
をさらに備え、
前記第2スケルチ回路は、前記制御信号が無効にされていることに応答して、高電力状態で動作する請求項3に記載の装置。 - 前記第1スケルチ回路は、
前記第1スケルチ検出器が前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出することに応答して、第1制御信号を無効にする信号検出器と、
(i)前記第1制御信号が無効にされていること、及び(ii)イネーブル信号が有効にされていることに応答して、第2制御信号を無効にするロジックと
をさらに備え、
前記第2スケルチ回路は、さらに、前記第2制御信号が無効にされていることに応答して、高電力状態で動作する請求項3に記載の装置。 - 前記イネーブル信号は、リンクのリンク状態を表し、
前記リンクは、前記装置に前記通信信号を提供する請求項5に記載の装置。 - 前記第2スケルチ回路は、
(i)前記第1スケルチ回路が前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出すること、(ii)前記スケルチ信号の振幅が第1閾値振幅より大きいこと、及び(iii)前記スケルチ信号の前記振幅が第2閾値振幅より小さいことに応答して、前記通信信号の中の前記スケルチ信号を検出する第2スケルチ検出器
を備え、
前記第2閾値振幅は、前記第1閾値振幅より大きい請求項2に記載の装置。 - 前記第2スケルチ回路は、
前記第2スケルチ検出器が前記通信信号の中の前記スケルチ信号を検出することに応答して、前記スケルチ信号に基づいて前記OOBシグナリングシーケンスを決定するOOB信号検出器
をさらに備える請求項7に記載の装置。 - 前記通信信号は、
シリアルATA(SATA)信号、
PCI Express(PCIe)信号、及び
ユニバーサルシリアルバス(USB)信号
からなるグループから選択される請求項1に記載の装置。 - 請求項1に記載の装置を備える1つ又は複数の集積回路。
- 請求項1に記載の装置を備えるアナログフロントエンド。
- 請求項11に記載のアナログフロントエンドを備える通信デバイス。
- 前記装置は、Serial ATA International OrganizationのSerial ATA Revision 3.0仕様に準拠する請求項1に記載の装置。
- 第1スケルチ回路を用いて通信信号の中の複数の見込みのスケルチ信号を検出する段階と、
前記第1スケルチ回路において前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つも検出しないことに応答して、低電力状態で第2スケルチ回路を動作させる段階と、
前記第1スケルチ回路において前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出することに応答して、高電力状態で前記第2スケルチ回路を動作させる段階と
を備える方法。 - 高電力状態で動作することに応答して、前記複数の見込みのスケルチ信号のうちの1つに基づいて、帯域外シグナリングシーケンス(OOBシグナリングシーケンス)を決定する段階
をさらに備える請求項14に記載の方法。 - 前記複数の見込みのスケルチ信号の前記1つの振幅が閾値振幅より大きいことに応答して、前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出する段階
をさらに備える請求項15に記載の方法。 - 前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出することに応答して、制御信号を無効にする段階と、
前記制御信号が無効にされていることに応答して、前記高電力状態で前記第2スケルチ回路を動作させる段階と
をさらに備える請求項16に記載の方法。 - 前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出することに応答して、第1制御信号を無効にする段階と、
(i)前記第1制御信号が無効にされていること、及び(ii)イネーブル信号が有効にされていることに応答して、第2制御信号を無効にする段階と、
前記第2制御信号が無効にされていることに応答して、前記高電力状態で前記第2スケルチ回路を動作させる段階と
をさらに備える請求項16に記載の方法。 - 前記イネーブル信号は、リンクのリンク状態を表し、
前記リンクは、前記通信信号を提供する請求項18に記載の方法。 - (i)前記通信信号の中の前記複数の見込みのスケルチ信号のうちの1つを検出すること、(ii)前記スケルチ信号の振幅が第1閾値振幅より大きいこと、及び(iii)前記スケルチ信号の前記振幅が第2閾値振幅より小さいことに応答して、前記通信信号の中のスケルチ信号を検出する段階
をさらに備え、
前記第2閾値振幅は、前記第1閾値振幅より大きい請求項15に記載の方法。 - 前記通信信号の中の前記スケルチ信号を検出することに応答して、前記スケルチ信号に基づいて前記OOBシグナリングシーケンスを決定する段階
をさらに備える請求項20に記載の方法。 - 前記通信信号は、
シリアルATA(SATA)信号、
PCI Express(PCIe)信号、及び
ユニバーサルシリアルバス(USB)信号
からなるグループから選択される請求項14に記載の方法。
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